JP2007259130A - ヒステリシスインバータ回路 - Google Patents
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Abstract
【解決手段】インバータ回路と、前記インバータ回路を構成するトランジスタと異なる閾値を有するトランジスタとを組み合わせ、こられのトランジスタのON/OFFのタイミングを制御する。これにより、本発明のヒステリシスインバータ回路に異なる2つの閾値を持たせ、より回路規模が小さく、入力電圧の変動に影響されない高精度なヒステリシスインバータ回路を実現する。
【選択図】図2
Description
このとき、トランジスタM30のゲートにはHレベルの電圧が印加されてオフの状態からにオンの状態へ切り換わり、トランジスタM31のゲートにはLレベルが印加されてオンの状態からオフの状態へ切り換わる。
21、22、23、24 インバータ回路
M21〜M31 トランジスタ
Claims (2)
- PチャネルトランジスタとNチャネルトランジスタとが直接接続されて構成されるインバータ回路と、
前記インバータ回路を構成する一方のトランジスタと電源側又は接地側に直列に接続された低閾値トランジスタと、
前記一方のトランジスタと前記低閾値トランジスタの切り換え制御を行う切り換え手段とを有し、
前記切り換え手段は前記インバータ回路の出力により制御されることを特徴とするヒステリシスインバータ回路。 - 前記切り換え手段は、前記Pチャネルトランジスタと前記Nチャネルトランジスタとの接続点と電源側または接地間に直列に接続された第一のトランジスタと第二のトランジスタであって、
前記第一のトランジスタと前記第二のトランジスタとの接続点が、前記一方のトランジスタと前記低閾値トランジスタとの接続点に接続されていることを特徴とする請求項1に記載のヒステリシスインバータ回路。
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