JP2007249010A - メモリ制御装置およびこれを用いた表示装置 - Google Patents
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Abstract
【解決手段】画像1フレーム分の書込みおよび読出し動作の完了を検出するアドレス検出手段30及びアドレス検出手段40、記憶手段10−1,10−2への書込みあるいは読出し動作の一方の動作に優先権を設定する優先権設定手段90を設ける。切替え手段70,80は、優先権の設定されている動作側のアドレス検出手段が1フレーム分の書込みあるいは読出しの完了を検出する毎に記憶手段10−1,10−2を切替える。また、優先権の設定されていない動作側の書込みあるいは読出し制御手段50,60は、記憶手段の切替え前後で連続したアドレスへの書込みあるいは読出しを行うようにする。
【選択図】図1
Description
(a) V1>V2 読出し優先(図3(a))
書込みが読出しより早いため、1回のフレーム読出し期間(図3(a)中の読出し0期間)に、複数回分のフレームによる書込み(書込み0,1,2,3,4)が行われる。但しこの期間には同じ記憶手段に書込まれるので、上書きが行われることになり、実際に読出し1で読出される内容は、書込み3の後半と書込み4の前半からなる図3(a)中のハッチングされた1フレームに相当する画像となる。書込み読出しの速度の比に対応したほぼ一定のフレーム毎に1フレーム相当の表示となり、表示されないフレーム上前述のように上書き消去される。
(b) V1>V2 書込み優先(図3(b))
読出しより早い書込みが1フレーム分の書込みを終了するたびに記憶手段が切り替わる。このため、読出しは複数のフレームの組み合わせからなる。図3(a)中の読出し0は、それぞれ記憶手段が切替えられる前に書込まれた1フレーム分から一部分のみを読出した画像となる(図3(b)中のハッチング部分)。記憶手段が切替えられる毎に1フレームの一部分のみを読出し、その1フレームは記憶手段が切替えられる毎に新たに書込まれた(更新された)1フレームとなることから、この方法では各入力フレームは一部分ではあるが読出し結果に反映される。
(c) V1<V2 読出し優先(図3(c))
読出しが優先のため、1フレーム分の読出し毎に記憶手段が切り替わる。図3(c)では、書込みは読出しの約4フレーム分の時間をかけて1フレームを書込むとする。このとき、書込みにより読出し1フレーム分の時間で更新できるのは、図3(c)中にハッチングで示した部分のみとなる。残りは一つ前の書込み時の内容が記憶されている。読出しは1フレーム分の容量をもつ記憶手段の一部分のみ順次更新されたものを読出す。
(d) V1<V2 書込み優先(図3(d))
1フレーム分の書込みが完了したデータを書込みより早い読出し速度で複数回読出す。記憶手段の切り替わる部分で、2フレームの混合された内容となる可能性がある。この切り替わる部分以外は、単純に同じフレームを表示続ける。
20 解像度検出手段
30,40 アドレス検出手段
50 書込み制御手段
60 読出し制御手段
70,80 切替え手段
90 優先権設定手段
1001 光源
1012,1014,1016 光変調素子(LCOS)
1017 ダイクロイックプリズム
1018 投射レンズ
1019 スクリーン
1020 フレームバッファ回路
1030 画像処理回路
1040 LCOS制御回路
Claims (8)
- 少なくとも画像1フレーム分を記憶可能な第1および第2の記憶手段と、
前記第1あるいは第2の記憶手段への書込みを制御する書込み制御手段と、
前記第1あるいは第2の記憶手段からの読出しを制御する読出し制御手段と、
前記書込み制御手段および前記読出し制御手段の書込み読出しの対象となる前記第1および第2の記憶手段を替える切替え手段と、
前記書込み制御手段から出力される書込み動作のアドレスを入力して、1フレーム分の書込み動作の完了を検出する第1のアドレス検出手段と、
前記読出しみ制御手段から出力される読出し動作のアドレスを入力して、1フレーム分の読出し動作の完了を検出する第2のアドレス検出手段と、
前記第1あるいは第2の記憶手段への書込みあるいは読出し動作の一方に優先権を設定する優先権設定手段とを有し、
前記切替え手段は、前記優先権の設定されている書込みあるいは読出し動作の方の第1あるいは第2のアドレス検出手段が1フレーム分の書込みあるいは読出し動作の完了を検出する毎に、前記第1あるいは第2の記憶手段を切替え、
前記優先権の設定されていない書込みあるいは読出し動作の方の書込み制御手段あるいは読出し制御手段は、前記第1あるいは第2の記憶手段の切替え前後で連続したアドレスへの書込みあるいは読出しを行うことを特徴とするメモリ制御装置。 - 請求項1に記載のメモリ制御装置において、
前記優先権の設定されていない書込みあるいは読出し動作の方の第1あるいは第2のアドレス検出手段が、前記第1および第2の記憶手段の切替えの時、直前に入力したアドレスを、前記優先権の設定されていない書込みあるいは読出し動作の方の書込み制御手段あるいは読出し制御手段へ出力し、
前記書込み制御手段あるいは前記読出し制御手段は、前記第1あるいは第2のアドレス検出手段からのアドレスをもとに次の書込みあるいは読出し動作を行うアドレスを生成して、前記第1および第2の記憶手段の切替え前後で連続したアドレスへの書込みあるいは読出しを行うことを特徴とするメモリ制御装置。 - 請求項1もしくは2に記載のメモリ制御装置において、
入力画像信号について、1フレームの走査線数、走査線内のデータ数の解像度情報を検出する解像度検出手段をさらに有し、
前記第1および第2のアドレス検出手段は、入力したアドレスを前記解像度情報と比較して、1フレーム分の書込みあるいは読出し動作の完了を検出することを特徴とするメモリ制御装置。 - 請求項1乃至3のいずれか1項に記載のメモリ制御装置において、
前記優先権設定手段は、書込み速度と読出し速度を比較して、書込みあるいは読出し動作に優先権を設定する手段を有することを特徴とするメモリ制御装置。 - 請求項1乃至3のいずれか1項に記載のメモリ制御装置において、
前記優先権設定手段は、外部からの信号により、書込みあるいは読出し動作に優先権を設定する手段を有することを特徴とするメモリ制御装置。 - 請求項1乃至3のいずれか1項に記載のメモリ制御装置において、
前記優先権設定手段は、書込み速度と読出し速度を比較して、書込みあるいは読出し動作に優先権を設定する第1の手段と、外部からの信号により、書込みあるいは読出し動作に優先権を設定する第2の手段とを有し、前記第2の手段の設定結果を優先させることを特徴とするメモリ制御装置。 - 請求項1乃至6のいずれか1項に記載のメモリ制御装置において、
前記第1および2の記憶手段は、シングルポートメモリで構成されることを特徴とするメモリ制御装置。 - 請求項1乃至7のいずれか1項に記載のメモリ制御装置を、入力される画像のフレームバッファ回路として使用してなる表示装置。
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