JP2007088617A - フィードフォワード増幅器 - Google Patents
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Abstract
【解決手段】歪み抽出部を構成する主増幅器または歪み除去部を構成する補助増幅器の整合回路に、負の群遅延時間を有する回路または素子を少なくとも1つ用いる。すなわち、増幅器の入力整合回路2の一部として、負の群遅延時間を有する回路1を用いる。負の群遅延時間を有する回路1は、コンデンサCs、インダクタLsおよび抵抗Rsからなり、信号線路に対して並列接続され、所望の周波数近傍で共振する直列共振回路と、インダクタLp、抵抗RpおよびコンデンサCpからなり、信号線路に対して縦続接続され、所望の周波数近傍で共振する2つの並列共振回路とを有する。
【選択図】図2
Description
従来例1として、増幅器の出力側に直列共振回路や並列共振回路を接続することで出力波形を整形し、増幅器を高効率動作させ、動作周波数の2、4、6倍で短絡、3、5倍で開放のインピーダンスになるようにして、フィードフォワード増幅器の主増幅器、補助増幅器に適用することで、フィードフォワード増幅器の高効率化を実現するものがある(例えば、非特許文献1参照)。
図1は、この発明に適用される一般的なフィードフォワード増幅器の構成図である。
図1に示すフィードフォワード増幅器は、主増幅器103で発生した歪み成分を抽出し、出力側に逆位相で合成することにより歪みを低減する歪み補償方式を適用した増幅器で、歪み抽出ループおよび歪み除去ループからなり、歪み抽出ループは、主増幅器103、第1の遅延線104で構成され、歪み除去ループは、補助増幅器101、第2の遅延線102で構成される。なお、105は入力端子、106は出力端子である。
図2に示す増幅器は、入力端子5と出力端子6との間に、入力整合回路2と、トランジスタ4と、出力整合回路3とを備えている。ここで、入力整合回路2は、ローパス型整合回路7と、負の群遅延時間を有する回路1とを有する。
すなわち、図2に示す増幅器では、トランジスタ4の入力側および出力側に整合回路2、3が接続されており、負の群遅延時間を有する回路1は入力整合回路2の一部として用いられている。
電力増幅器の群遅延時間は、入出力整合回路2,3およびトランジスタ4に起因しているが、主増幅器または補助増幅器の最終段などでは整合回路で発生する群遅延時間が支配的である。電力増幅器で用いられるトランジスタの入出力インピーダンスは低く、外部回路とインピーダンス整合をとるため、ハイパス型整合回路や図2に示すようなローパス型整合回路が用いられる。
図3(A)は、この発明の実施の形態2に係るフィードフォワード増幅器の主増幅器103または補助増幅器101の構成を示す回路図である。
図3(A)に示す増幅器は、入力端子21と出力端子24との間に、入力整合回路22と、トランジスタと、出力整合回路23とを備え、入力整合回路22は、コンデンサ、インダクタおよび抵抗を用いた、図2に示すものと同様な直列共振回路からなる負の群遅延時間を有する回路25と、コンデンサ、インダクタおよび抵抗を用いた、図2に示すものと同様な並列共振回路からなる負の群遅延時間を有する回路26とを有する。
すなわち、図3(A)は、直列共振回路および並列共振回路からなる負の群遅延時間を有する回路25,26を入力整合回路22に用いた増幅器である。
負の群遅延時間を有する回路の有無に対する増幅器の群遅延時間Group_delayを計算した。増幅器には、500MHzで整合が取られた図3(A)、(B)の増幅器を用いた。なお、図3(B)に示す増幅器は、負の群遅延時間を有する回路を用いない従来構成の増幅器である。計算結果を図4に示す。図4より、直列共振回路および並列共振回路からなる負の群遅延時間を有する回路を整合回路の一部として用いる(図4(A)参照)ことで、負の群遅延時間を有する回路を用いない整合回路に比べ(図4(B)参照)、群遅延時間を短縮していることがわかる。
なお、図3(A)、(B)では抵抗が用いられているが、コンデンサおよびインダクタの損失分を抵抗として代用しても良い。
図5は、この発明の実施の形態3に係るフィードフォワード増幅器の主増幅器103または補助増幅器101の構成を示す回路図である。
図5に示す実施の形態3に係る増幅器の基本的な構成、動作に関しては、図3(A)に示す実施の形態2と同じであるが、直列共振回路および並列共振回路を構成するインダクタに、コンデンサCspをそれぞれ直列接続した回路を用いている点が異なる。コンデンサCspを直列接続することで、より大きな負の群遅延時間を得ることができ、電力増幅器の群遅延時間を短縮できる。
図7は、この発明の実施の形態4に係るフィードフォワード増幅器の主増幅器103または補助増幅器101の構成を示す回路図である。
図7に示す実施の形態4に係る増幅器の基本的な構成、動作に関しては、図3(A)に示す実施の形態2と同じであるが、直列共振回路および並列共振回路を構成するインダクタLpおよびLsに、マイクロストリップ線路や同軸線路等の線路を用いている点が異なる。線路を用いることでインダクタの微調整が行うことができ、共振周波数の設定精度を高めることができる。これにより、増幅器の群遅延時間を最小値に設定することができ、フィードフォワード増幅器の高効率化を図ることができる。
図8は、この発明の実施の形態5に係るフィードフォワード増幅器の主増幅器103または補助増幅器101の構成を示す回路図であり、増幅器のRF等価回路を表している。
図8に示す実施の形態5に係る増幅器の基本的な構成、動作に関しては、図3(A)に示す実施の形態2と同じであるが、直列共振回路および並列共振回路を構成するコンデンサCpとして、逆バイアスされた可変容量ダイオードを用いた点が異なる。可変容量ダイオードを用いることで共振周波数の微調整を行うことができ、増幅器の群遅延時間を最小値に設定することができ、フィードフォワード増幅器の高効率化を図ることができる。
実施の形態6の基本的な構成、動作に関しては、図3(A)に示す実施の形態2と同じであるが、縦続接続する負の群遅延時間を有する回路の共振周波数をそれぞれ異なる周波数に設定した点が異なる。共振周波数をそれぞれ異なる周波数に設定することで、広い周波数範囲に渡って群遅延時間偏差を抑圧できる。これより、フィードフォワード増幅器の広帯域化が可能となる。
Claims (6)
- 歪み抽出部を構成する主増幅器または歪み除去部を構成する補助増幅器の整合回路に、負の群遅延時間を有する回路または素子を少なくとも1つ用いた
ことを特徴とするフィードフォワード増幅器。 - 請求項1に記載のフィードフォワード増幅器において、
前記負の群遅延時間を有する回路として、
(A)コンデンサ、インダクタおよび抵抗を用いた直列共振回路を、信号線路に対して並列接続すると共に、所望の周波数近傍で共振させる負の群遅延時間を有する回路、
(B)コンデンサ、インダクタおよび抵抗を用いた並列共振回路を、信号線路に対して縦続接続すると共に、所望の周波数近傍で共振させる負の群遅延時間を有する回路
の少なくとも1つを用いた
ことを特徴とするフィードフォワード増幅器。 - 請求項2に記載のフィードフォワード増幅器において、
前記並列共振回路を構成するインダクタとして、インダクタとコンデンサを直列接続した回路を用いた
ことを特徴とするフィードフォワード増幅器。 - 請求項2に記載のフィードフォワード増幅器において、
前記直列共振回路または前記並列共振回路を構成するインダクタとして、マイクロストリップ線路または同軸線路等の線路を用いた
ことを特徴とするフィードフォワード増幅器。 - 請求項2に記載のフィードフォワード増幅器において、
前記直列共振回路または前記並列共振回路を構成するコンデンサとして、逆バイアスされた可変容量ダイオードを用いた
ことを特徴とするフィードフォワード増幅器。 - 請求項1に記載のフィードフォワード増幅器において、
前記負の群遅延時間を有する回路として、
(A)コンデンサ、インダクタおよび抵抗を用いた直列共振回路を、信号線路に対して並列接続すると共に、所望の周波数近傍で共振させる負の群遅延時間を有する回路、
(B)コンデンサ、インダクタおよび抵抗を用いた並列共振回路を、信号線路に対して縦続接続すると共に、所望の周波数近傍で共振させる負の群遅延時間を有する回路
をそれぞれ1つ以上用い、前記直列共振回路および並列共振回路の共振周波数をそれぞれ異なる周波数に設定する
もしくは、
前記負の群遅延時間を有する回路(A)、(B)のいずれか一方を2つ以上用い、前記直列共振回路または並列共振回路の共振周波数をそれぞれ異なる周波数に設定した
ことを特徴とするフィードフォワード増幅器。
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