JP2007025662A - アレイ基板及びこれを有する表示装置 - Google Patents
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Abstract
【解決手段】多数のゲートラインはベース基板上に形成され、多数のデータラインは、ゲートラインとは絶縁されて交差し、ベース基板上にマトリックス形態の多数の画素領域を定義する。画素マトリックスは、多数の画素領域にそれぞれ形成され、多数の画素行と多数の画素列を含む。各画素行は、隣接する第1ゲートラインに電気的に連結された第1画素グループ及び隣接する第2ゲートラインに電気的に連結された第2画素グループを含み、各ゲートラインに提供されるゲート信号を利用して、多数の画素に提供されるデータ信号の極性が制御される。各画素列は、隣接する一つのデータラインに共通的に連結される。
【選択図】図1
Description
110 第1ベース基板、
121 ポリシリコン層、
122 ゲート絶縁膜、
131 層間絶縁膜、
132 保護膜、
150 ゲート駆動回路、
160 データ駆動回路、
200 カラーフィルター基板、
210 第1ベース基板、
220 カラーフィルター層、
230 共通電極、
400 表示装置。
Claims (20)
- ベース基板と、
前記ベース基板上に形成された多数のゲートラインと、
前記ベース基板上に形成され、前記ゲートラインとは絶縁されて交差し、マトリックス形態の多数の画素領域を定義する多数のデータラインと、
前記多数の画素領域にそれぞれ形成され、多数の画素行と多数の画素列を含む画素マトリックスと、を含み、
前記各画素行は隣接する第1ゲートラインに電気的に連結された第1画素グループ及び隣接する第2ゲートラインに電気的に連結された第2画素グループを含み、前記各画素列は隣接する一つのデータラインに共通的に連結されることを特徴とするアレイ基板。 - 前記第1画素グループは、前記第1ゲートラインに電気的に連結された第1スイッチング素子及び前記第1スイッチング素子に電気的に連結された第1画素電極で構成された多数の第1画素を含むことを特徴とする請求項1記載のアレイ基板。
- 前記第1画素電極は、前記第2ゲートラインと部分的にオーバーラップされることを特徴とする請求項2記載のアレイ基板。
- 前記第1画素電極と前記第2ゲートラインとの間には、絶縁膜が介在されたことを特徴とする請求項3記載のアレイ基板。
- 前記第1スイッチング素子は、前記第1ゲートラインと電気的に連結された制御電極、前記データラインに連結された第1電極、及び前記第1画素電極に連結された第2電極を含むことを特徴とする請求項2記載のアレイ基板。
- 前記第1ゲートラインと前記制御電極は第1金属層から形成され、
前記データライン、前記第1及び第2電極は、前記第1金属層と異なる第2金属層から形成されることを特徴とする請求項5記載のアレイ基板。 - 前記第2画素グループは、前記第2ゲートラインに電気的に連結された第2スイッチング素子及び前記第2スイッチング素子に電気的に連結された第2画素電極で構成された多数の第2画素を含むことを特徴とする請求項1記載のアレイ基板。
- 前記第2画素電極は、前記第1ゲートラインと部分的にオーバーラップされることを特徴とする請求項7記載のアレイ基板。
- ベース基板と、
前記ベース基板上に形成される多数のゲートラインと、
前記ベース基板上に形成され、前記ゲートラインとは絶縁されて交差し、マトリックス形態の多数の画素領域を定義する多数のデータラインと、
前記多数の画素領域にそれぞれ形成され、多数の画素行と多数の画素列を含む画素マトリックスと、を含み、
前記各画素行は、隣接する多数のゲートラインにそれぞれ電気的に連結された多数の画素グループを含み、前記各画素列は、隣接する一つのデータラインに共通的に連結されることを特徴とするアレイ基板。 - アレイ基板及び前記アレイ基板と向かい合う対向基板で構成され画像を表示する表示パネルと、
前記アレイ基板に多数のゲート信号を順次に提供するゲート駆動部と、
前記アレイ基板に多数のデータ信号を提供するデータ駆動部と、を含み、
前記アレイ基板は、
第1ベース基板と、
前記第1ベース基板上に形成された多数のゲートラインと、
前記第1ベース基板上に形成され、前記ゲートラインとは絶縁されて交差し、マトリックス形態の多数の画素領域を定義する多数のデータラインと、
前記多数の画素領域にそれぞれ形成され、多数の画素行と多数の画素列を含む画素マトリックスを含み、
前記各画素行は、隣接する第1ゲートラインに電気的に連結された第1画素グループ及び隣接する第2ゲートラインに電気的に連結された第2画素グループを含み、前記各画素列は、隣接する一つのデータラインに共通的に連結されることを特徴とする表示装置。 - 前記第1画素グループは、前記第1ゲートラインに提供される第1ゲート信号に応答してターンオンされ、
前記第2画素グループは、前記第2ゲートラインに提供される第2ゲート信号に応答してターンオンされることを特徴とする請求項10記載の表示装置。 - 前記各画素行がターンオンされる1H時間の初期時間の間、前記第1ゲート信号はハイ電圧を維持し、前記1H時間の後期時間の間、前記第2ゲートラインはハイ電圧を維持することを特徴とする請求項11記載の表示装置。
- 前記初期時間の間、第1極性を有する前記多数のデータ信号が前記多数のデータラインを通じて前記第1画素グループに提供され、
前記後期時間の間、前記第1極性に対し反転された第2極性を有する前記多数のデータ信号が前記多数のデータラインを通じて前記第2画素グループに提供されることを特徴とする請求項12記載の表示装置。 - 前記多数のデータ信号の極性は、1/2H時間単位に反転されることを特徴とする請求項13記載の表示装置。
- 前記第1極性は負極性(−)で、前記第2極性は正極性(+)であることを特徴とする請求項13記載の表示装置。
- 前記第1ゲート信号は、前記後期時間の間、ロー電圧を維持し、前記後期時間以後、前記ロー電圧より高い第1電圧に上昇することを特徴とする請求項15記載の表示装置。
- 前記第2ゲート信号は、前記後期時間以後、1/2H時間の間、ロー電圧を維持し、以後前記ロー電圧より低い第2電圧に下降することを特徴とする請求項15記載の表示装置。
- 前記第1画素グループは、
前記第1ゲートラインに電気的に連結された第1スイッチング素子と、
前記第1スイッチング素子に電気的に連結された第1画素電極と、
前記第1画素電極と向かい合い、前記第2ゲートラインから延長された第1ストレージ電極と、
前記第1画素電極と前記第1ストレージ電極との間に介在された絶縁膜で構成された多数の第1画素と、を含むことを特徴とする請求項11記載の表示装置。 - 前記第2画素グループは、
前記第2ゲートラインに電気的に連結された第2スイッチング素子と、
前記第2スイッチング素子に電気的に連結された第2画素電極と、
前記第2画素電極と向かい合い、前記第1ゲートラインから延長された第2ストレージ電極と、
前記第2画素電極と前記第2ストレージ電極との間に介在された絶縁膜で構成された多数の第2画素と、を含むことを特徴とする請求項11記載の表示装置。 - 前記第1画素グループは、前記各画素行の偶数番目画素を含み、
前記第2画素グループは、前記各画素行の奇数番目画素を含むことを特徴とする請求項11記載の表示装置。
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