JP2006294815A - 半導体装置及びその製造方法 - Google Patents
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Abstract
【解決手段】本発明の半導体装置の製造方法は、(1)半導体基板上に形成された絶縁膜に溝を形成し、(2)前記溝の内面及び前記絶縁膜上にバリア膜を形成し、(3)前記溝を充填するようにバリア膜上に導電性金属層を形成し、(4)導電性金属層の表面が前記絶縁膜の表面よりも低くなるように、前記絶縁膜上の導電性金属層及びバリア膜並びに前記溝内の導電性金属層の一部を除去し、(5)前記絶縁膜及び導電性金属層上に金属拡散防止膜を形成し、(6)導電性金属層上の金属拡散防止膜の少なくとも一部を残すように、前記絶縁膜上の金属拡散防止膜と前記絶縁膜の一部を除去する工程を含むことを特徴とする。
【選択図】図1
Description
次に、図7(b)に示すように、溝5の内面及び絶縁膜3上にバリア膜7をスパッタリング法などにより形成する。
次に、溝5を充填するようにバリア膜7上に、たとえば銅(Cu)等の導電性金属層9をめっき法などにより形成する。
さらに図7(c)に示すように、CMP(Chemical Mechanical Polishing 、化学的機械研磨)法により、バリア膜7上の不要な導電性金属層9を除去する。
次に、図7(d)に示すように、絶縁膜3上のバリア膜7を除去することにより、埋め込み配線を形成する。
最後に、図7(e)に示すように、金属拡散防止膜13をCVD法などにより形成して、半導体基板上に導電性金属の埋め込み配線を形成する。
なお、ダマシン法には大別してシングルダマシン(Single Damascene)法とデュアルダマシン(Dual Damascene)法がある。シングルダマシン法は、図7(a)〜(e)にて説明したように埋め込み配線を形成する方法であり、デュアルダマシン法は、図8に示すように、絶縁膜3に配線用の溝5および下層配線への接続を行うための孔5aを形成した後、シングルダマシン法と同様の方法をとることにより、埋込み配線と、下層配線への接続孔を同時に形成する方法である。
従って、配線間のTDDB寿命劣化を防止することが可能となり、配線間の絶縁破壊耐性の向上した、高い信頼性をもつ埋め込み導電性金属配線の形成が可能となる。
具体的には、工程(4)は、例えば、前記絶縁膜上の導電性金属層を除去し、前記絶縁膜上のバリア膜及び前記溝内の導電性金属層の一部を除去する工程を備える方法によって行うことができる(第1実施形態に対応)。工程(4)は、前記絶縁膜上の導電性金属層及び前記溝内の導電性金属層の一部を除去し、前記絶縁膜上のバリア膜を除去する工程を備える方法で行ってもよい(第2実施形態に対応)。前者の方法では、バリア膜を除去する際に、導電性金属層の表面が前記絶縁膜の表面との間の段差(以下、単に「段差」ともいう。)を形成し、後者の方法では、絶縁膜上の導電性金属層を除去する際に段差を形成する。何れの方法も、例えば、2度のCMP工程により行うことでき、この2度のCMP工程は、スラリーの種類を変える等によって連続的に行うことができる。
(第1実施形態)
図1は、本発明の第1実施形態による半導体装置の製造方法を説明するための断面図である。
x>70(nm) かつ x<2y−40(nm)
である。図4の33は、この2式を満たすxとyの組み合わせを示したものである。なお、これらから容易に判るように、y>55(nm)の場合のみ解が存在する。
図5は、本発明の第2実施形態による半導体装置の製造方法を説明するための断面図である。本実施形態においては、図5(a)〜(b)に示す導電性金属層9を形成する工程までと、および図5(e)〜(f)に示す金属拡散防止膜13を形成する工程以降は、第1実施形態による構成および形成方法とそれぞれ同様である。
次に、図5(d)に示すように、第2のCMP工程として、絶縁膜3上のバリア膜7を除去する。これ以外の構成および形成方法は、第1実施形態と同様である。
第2のCMP工程においては、例えば、シリカ砥粒を含む研磨剤を流量200ml/minにて用い、研磨圧力21kPa、定盤回転数100rpm、ウエハ回転数93rpmとして銅を100nm/min、バリア膜として用いたタンタルおよびタンタル窒化膜を100nm/min、絶縁膜を10nm/min以下、の研磨速度にて除去し、絶縁膜3が露出された時点を研磨終点とする。
図6は、本発明の第3実施形態による半導体装置の製造方法を説明するための断面図である。本実施形態においては、図6(a)〜(b)に示すように、導電性金属層9を形成する工程までと、および図6(f)〜(g)に示すように、金属拡散防止膜13を形成する工程以降は、第1実施形態による構成および形成方法とそれぞれ同様である。
次に、図6(d)に示すように、第2のCMP工程として、絶縁膜3上のバリア膜7を除去する。
3 絶縁膜
3a 絶縁膜表面
5 配線用溝
7 バリア膜
9 導電性金属層
13 金属拡散防止膜
15 第3のCMP工程直前のウエハ表面
17 第3のCMP工程後のウエハ表面(CMP研磨面)
21 銅
31 銅の検出下限界濃度
33 望ましいxとyの組み合わせを示す領域
x 導電性金属層の表面と絶縁膜表面との段差
y 金属拡散防止膜の堆積膜厚
z 第3のCMP工程で除去される絶縁膜の膜厚
a 第3のCMP工程における金属拡散防止膜と絶縁膜の除去膜厚の和
c 第3のCMP工程における配線用溝内の金属拡散防止膜の残膜厚
Claims (11)
- (1)半導体基板上に形成された絶縁膜に溝を形成し、
(2)前記溝の内面及び前記絶縁膜上にバリア膜を形成し、
(3)前記溝を充填するようにバリア膜上に導電性金属層を形成し、
(4)導電性金属層の表面が前記絶縁膜の表面よりも低くなるように、前記絶縁膜上の導電性金属層及びバリア膜並びに前記溝内の導電性金属層の一部を除去し、
(5)前記絶縁膜及び導電性金属層上に金属拡散防止膜を形成し、
(6)導電性金属層上の金属拡散防止膜の少なくとも一部を残すように、前記絶縁膜上の金属拡散防止膜と前記絶縁膜の一部を除去する工程を含むことを特徴とする半導体装置の製造方法。 - 工程(4)は、CMP法により行われる請求項1に記載の方法。
- 工程(4)は、
前記絶縁膜上の導電性金属層を除去し、
前記絶縁膜上のバリア膜及び前記溝内の導電性金属層の一部を除去する工程を備える請求項2に記載の方法。 - 工程(4)は、
前記絶縁膜上の導電性金属層及び前記溝内の導電性金属層の一部を除去し、
前記絶縁膜上のバリア膜を除去する工程を備える請求項2に記載の方法。 - 工程(4)は、
CMP法により前記絶縁膜上の導電性金属層及びバリア膜を除去し、
エッチングにより前記溝内の導電性金属層の一部を除去する工程を備える請求項1に記載の方法。 - エッチングは、ウェットエッチングからなる請求項5に記載の方法。
- 工程(4)は、導電性金属層表面と前記絶縁膜表面の段差が70nm以上になるように行われる請求項1に記載の方法。
- 前記段差が、金属拡散防止膜の形成膜厚の2倍から40nmを差し引いたものより小さくなるように行われる請求項7に記載の方法。
- 工程(6)は、前記絶縁膜を50nm以上除去するように行われる請求項1に記載の方法。
- 工程(6)は、導電性金属層上の金属拡散防止膜が20nm以上残るように行われる請求項1に記載の方法。
- 半導体基板と、この基板上に形成され、溝を備える絶縁膜と、前記溝にバリア膜を介して充填された導電性金属層と、導電性金属層を覆うように形成された金属拡散防止膜とを備え、前記絶縁膜の表面と、金属拡散防止膜の表面が、実質的に同一平面上にあることを特徴とする半導体装置。
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