JP2005507117A - 出口バッファを使用してdramをキャッシュするシステムおよび方法 - Google Patents
出口バッファを使用してdramをキャッシュするシステムおよび方法 Download PDFInfo
- Publication number
- JP2005507117A JP2005507117A JP2003538907A JP2003538907A JP2005507117A JP 2005507117 A JP2005507117 A JP 2005507117A JP 2003538907 A JP2003538907 A JP 2003538907A JP 2003538907 A JP2003538907 A JP 2003538907A JP 2005507117 A JP2005507117 A JP 2005507117A
- Authority
- JP
- Japan
- Prior art keywords
- data
- processor
- bus
- buffer
- exit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000000872 buffer Substances 0.000 title claims abstract description 68
- 238000000034 method Methods 0.000 title claims abstract description 33
- 230000015654 memory Effects 0.000 claims abstract description 25
- 238000004891 communication Methods 0.000 abstract description 5
- 230000002093 peripheral effect Effects 0.000 description 8
- 238000010586 diagram Methods 0.000 description 6
- 238000004590 computer program Methods 0.000 description 2
- 238000013500 data storage Methods 0.000 description 2
- 230000003287 optical effect Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L47/00—Traffic control in data switching networks
- H04L47/10—Flow control; Congestion control
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3206—Monitoring of events, devices or parameters that trigger a change in power modality
- G06F1/3215—Monitoring of peripheral devices
- G06F1/3225—Monitoring of peripheral devices of memory devices
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3234—Power saving characterised by the action undertaken
- G06F1/325—Power saving in peripheral device
- G06F1/3275—Power saving in memory, e.g. RAM, cache
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/08—Error detection or correction by redundancy in data representation, e.g. by using checking codes
- G06F11/10—Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's
- G06F11/1076—Parity data used in redundant arrays of independent storages, e.g. in RAID systems
- G06F11/108—Parity data distribution in semiconductor storages, e.g. in SSD
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/0802—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
- G06F12/0806—Multiuser, multiprocessor or multiprocessing cache systems
- G06F12/0811—Multiuser, multiprocessor or multiprocessing cache systems with multilevel cache hierarchies
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/0802—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
- G06F12/0806—Multiuser, multiprocessor or multiprocessing cache systems
- G06F12/0813—Multiuser, multiprocessor or multiprocessing cache systems with a network or matrix configuration
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/0802—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
- G06F12/0806—Multiuser, multiprocessor or multiprocessing cache systems
- G06F12/084—Multiuser, multiprocessor or multiprocessing cache systems with a shared cache
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/14—Handling requests for interconnection or transfer
- G06F13/16—Handling requests for interconnection or transfer for access to memory bus
- G06F13/1668—Details of memory controller
- G06F13/1689—Synchronisation and timing concerns
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
- G06F15/163—Interprocessor communication
- G06F15/173—Interprocessor communication using an interconnection network, e.g. matrix, shuffle, pyramid, star, snowflake
- G06F15/17356—Indirect interconnection networks
- G06F15/17368—Indirect interconnection networks non hierarchical topologies
- G06F15/17375—One dimensional, e.g. linear array, ring
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/76—Architectures of general purpose stored program computers
- G06F15/78—Architectures of general purpose stored program computers comprising a single central processing unit
- G06F15/7839—Architectures of general purpose stored program computers comprising a single central processing unit with memory
- G06F15/7842—Architectures of general purpose stored program computers comprising a single central processing unit with memory on one IC chip (single chip microcontrollers)
- G06F15/7846—On-chip cache and off-chip main memory
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/70—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer
- G06F21/71—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure computing or processing of information
- G06F21/72—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure computing or processing of information in cryptographic circuits
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/14—Digital output to display device ; Cooperation and interconnection of the display device with other functional units
- G06F3/1423—Digital output to display device ; Cooperation and interconnection of the display device with other functional units controlling a plurality of local displays, e.g. CRT and flat panel display
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30007—Arrangements for executing specific machine instructions to perform operations on data operands
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/3004—Arrangements for executing specific machine instructions to perform operations on memory
- G06F9/30043—LOAD or STORE instructions; Clear instruction
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3836—Instruction issuing, e.g. dynamic instruction scheduling or out of order instruction execution
- G06F9/3851—Instruction issuing, e.g. dynamic instruction scheduling or out of order instruction execution from multiple instruction streams, e.g. multistreaming
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3877—Concurrent instruction execution, e.g. pipeline or look ahead using a slave processor, e.g. coprocessor
- G06F9/3879—Concurrent instruction execution, e.g. pipeline or look ahead using a slave processor, e.g. coprocessor for non-native instruction execution, e.g. executing a command; for Java instruction set
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3885—Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units
- G06F9/3889—Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units controlled by multiple instructions, e.g. MIMD, decoupled access or execute
- G06F9/3891—Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units controlled by multiple instructions, e.g. MIMD, decoupled access or execute organised in groups of units sharing resources, e.g. clusters
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C11/00—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor
- G11C11/21—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements
- G11C11/34—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements using semiconductor devices
- G11C11/40—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements using semiconductor devices using transistors
- G11C11/401—Digital stores characterised by the use of particular electric or magnetic storage elements; Storage elements therefor using electric elements using semiconductor devices using transistors forming cells needing refreshing or charge regeneration, i.e. dynamic cells
- G11C11/4063—Auxiliary circuits, e.g. for addressing, decoding, driving, writing, sensing or timing
- G11C11/407—Auxiliary circuits, e.g. for addressing, decoding, driving, writing, sensing or timing for memory cells of the field-effect type
- G11C11/4074—Power supply or voltage generation circuits, e.g. bias voltage generators, substrate voltage generators, back-up power, power control circuits
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L45/00—Routing or path finding of packets in data switching networks
- H04L45/74—Address processing for routing
- H04L45/745—Address table lookup; Address filtering
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L47/00—Traffic control in data switching networks
- H04L47/10—Flow control; Congestion control
- H04L47/24—Traffic characterised by specific attributes, e.g. priority or QoS
- H04L47/2441—Traffic characterised by specific attributes, e.g. priority or QoS relying on flow classification, e.g. using integrated services [IntServ]
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/90—Buffering arrangements
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/90—Buffering arrangements
- H04L49/9057—Arrangements for supporting packet reassembly or resequencing
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/90—Buffering arrangements
- H04L49/9084—Reactions to storage capacity overflow
- H04L49/9089—Reactions to storage capacity overflow replacing packets in a storage arrangement, e.g. pushout
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L9/00—Cryptographic mechanisms or cryptographic arrangements for secret or secure communications; Network security protocols
- H04L9/40—Network security protocols
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2352/00—Parallel handling of streams of display data
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2360/00—Aspects of the architecture of display systems
- G09G2360/12—Frame memory handling
- G09G2360/121—Frame memory handling using a cache memory
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2370/00—Aspects of data communication
- G09G2370/02—Networking aspects
- G09G2370/022—Centralised management of display operation, e.g. in a server instead of locally
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2370/00—Aspects of data communication
- G09G2370/20—Details of the management of multiple sources of image data
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L69/00—Network arrangements, protocols or services independent of the application payload and not provided for in the other groups of this subclass
- H04L69/22—Parsing or analysis of headers
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Software Systems (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Computer Hardware Design (AREA)
- Computer Security & Cryptography (AREA)
- Mathematical Physics (AREA)
- Multimedia (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Quality & Reliability (AREA)
- Human Computer Interaction (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Memory System Of A Hierarchy Structure (AREA)
- Multi Processors (AREA)
- Power Sources (AREA)
- Hardware Redundancy (AREA)
- Advance Control (AREA)
- Communication Control (AREA)
- Information Transfer Systems (AREA)
- Microcomputers (AREA)
- Storage Device Security (AREA)
- Steering Control In Accordance With Driving Conditions (AREA)
- Information Retrieval, Db Structures And Fs Structures Therefor (AREA)
- Exchange Systems With Centralized Control (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
【解決手段】システムおよび方法は、結合されバスシステムに結合されたプロセッサとメモリシステムとを含むサーバを含む。ネットワークインタフェースは、プロセッサに結合され、出口バッファは、出口バスによってプロセッサとネットワークインタフェースとに結合される。
【選択図】図4
Description
【0001】
発明の技術分野
本発明は、マイクロプロセッサに関し、特に、メモリシステムからデータ供給するマイクロプロセッサに係る方法およびシステムに関する。
【関連する技術】
【0002】
Webサーバ等、通常のサーバコンピュータは、一つのメインメモリを有する。サーバは、データを要求したクライアントコンピュータに、メモリからのデータを供給する。図1は、インターネットまたはその他のネットワーク等のネットワーク104によってつながれた通常のWebサーバ102とクライアントコンピュータ110とを示している。図2は、通常のWebサーバ102の高レベルブロック図である。表示のように、Webサーバ102は、プロセッサ202、ならびにROM204、メインメモリDRAM206、および大容量記憶デバイス210を含むメモリシステム203を含み、それぞれは周辺バスシステム208によって接続されている。周辺バスシステム208は、この技術において知られているような、様々なブリッジ、コントローラ、およびまたはアダプタを通じて互いに接続された、一つ以上のバスを含むことができる。例えば、周辺バスシステム208は、アダプタを通じて、周辺装置相互接続(PCI)バス等の一つ以上の拡張バスに接続される「システムバス」を含むことができる。更に、周辺バスシステム208には、ネットワークインタフェース212と、多数(N)の入出力(I/O)デバイス216−1ないし216−Nと、周辺暗号プロセッサ220とが結合される。
【0003】
I/Oデバイス216−1ないし216−Nは、例えば、キーボード、ポインティングデバイス、ディスプレイデバイス、およびまたはその他の従来型のI/Oデバイスを含むことができる。大容量記憶デバイス210は、磁気ディスクまたはテープ、光磁気(MO)記憶デバイス、あるいは様々なタイプのデジタル多用途ディスク(DVD)またはコンパクトディスク(CD)に基づくストレージのいずれかといった、大量のデータを格納するのに適切な任意のデバイスを含むことができる。
【0004】
ネットワークインタフェース212は、コンピュータシステムとネットワーク104上の他のコンピュータシステムとの間でのデータ通信を提供する。したがって、ネットワークインタフェース212は、Webサーバ102がデータ通信リンク上でリモート処理システム(例えば、クライアントコンピュータ110)とデータ通信するのに最適な、あるいはこれを可能にする、従来の電話モデム、統合サービスデジタルネットワーク(ISDN)アダプタ、デジタル加入者回線(DSL)アダプタ、ケーブルモデム、衛星トランシーバ、イーサネット(登録商標)アダプタ、またはその他といった任意のデバイスにすることができる。
【0005】
Webサーバ102は、通常、大量のデータを処理し、例えば、ストリーミングビデオまたはストリーミングオーディオまたはその他のデータタイプといったデータをストリーミングし、あるいはWebサイトおよびその他のWebデータを供給する。図3は、10MBデータストリーム等の大量のデータを供給するWebサーバ102の方法の動作300のフローチャートである。動作305において、Webサーバ102は、クライアント110から、10MBデータストリームの要求を受領する。この10MBデータストリームが暗号化等の処理を要する場合には、この10MBデータストリームを、最初に、DRAM206からプロセッサ202に取り込む必要がある。動作310において、データストリームは、DRAM206およびまたはメモリシステム203のその他の部分から取り出される。
【0006】
動作315において、データストリームは、プロセッサ202において処理される。動作320において、処理済みデータストリームは、DRAM206に格納される。動作325において、データストリームは、ネットワークインタフェース212を通じて、クライアント110へ続くネットワーク104に供給される。
【0007】
プロセッサ202とネットワークインタフェース212とは、通常、異なるデータ処理速度を有するため、処理済みデータストリームは、メモリシステム203に格納する必要がある。一例として、プロセッサ202は、約2GHzまたはそれ以上の速度でデータを処理することが可能である。周辺バスシステム208は、通常、約166MHzで動作し、そのため、ネットワークインタフェース212は、通常、2GHzのような速度では動作せず、プロセッサがデータ処理する速さでデータを供給することができない。結果として、ネットワークインタフェース212が処理済みデータをネットワークインタフェース212に最適な速度で供給できるように、処理済みデータは、メモリシステム203内で一時的に格納する必要がある。また、ネットワークインタフェース212が、プロセッサがデータを処理可能な速度より速くデータを出力できるようにしてもよく、その結果、処理済みデータは、メモリシステム203に蓄積することが可能となり、ネットワークインタフェース203は、メモリシステム203からデータを高速で供給することができるようになる。
【0008】
ここで、上の図3において説明したように、10MBデータストリームは、DRAM206とプロセッサ202との間の周辺バスシステム208で三回転送する必要がある。そのため、供給される10MBデータストリームによって、DRAM206とプロセッサ202との間で30MBのデータストリームが流れることになる。こうしたDRAM206とプロセッサ202との間での多数の受け渡しは、プロセッサ202のI/Oの総I/O帯域幅の大部分を消費し、これは、プロセッサ202が10MBデータストリームを供給すること以外の他の動作を実行する能力を制限する可能性がある。
【0009】
必要とされるものは、プロセッサとメモリシステムとのインタフェースの帯域幅使用量を低減するシステムおよび方法である。
【発明の開示】
【0010】
大まかに言って、本発明は、プロセッサとメモリシステムとのインタフェースの帯域幅使用量を低減するためにDRAMをキャッシングするシステムおよび方法を提供することで、こうした必要性を満たす。本発明は、処理、装置、システム、コンピュータ読み取り可能媒体、またはデバイスを含め、多数の方法で実施できると理解するべきである。本発明のいくつかの発明実施形態について、下で説明する。
【0011】
一実施形態は、結合されバスシステムに結合されるプロセッサとメモリシステムとを含むサーバを含む。ネットワークインタフェースは、プロセッサに結合され、出口バッファは、出口バスによってプロセッサとネットワークインタフェースとに結合される。
【0012】
プロセッサは、更に、多数のプロセッサを含むことができる。多数のプロセッサは、一つの第一のダイまたはチップ上に含めることができる。また、多数のプロセッサは、多数の別個のダイまたはチップに含めることができる。
【0013】
出口バッファは、高速ランダムアクセスメモリを含むことができる。一実施形態において、出口バッファは、約400MHzの動作速度を有するランダムアクセスメモリを含む。
【0014】
出口バッファおよび出口バスは、供給されるデータストリームの量の約二倍より大きな、あるいはこれに等しい、データスループット速度を有することができる。
【0015】
出口バッファは、更に、ダブルデータレートバッファを含むことができる。
【0016】
出口バスは、供給されるデータストリームの量の約二倍より大きな、あるいはこれに等しい、帯域幅を有する。出口バスは、更に32ビットデータバスを含むことができる。
【0017】
一実施形態は、データを供給するシステムおよび方法を含み、これらはサーバ内のプロセッサにおいてデータの要求を受領することを含む。要求データは、取り出される。取り出されたデータは、プロセッサにおいて処理される。処理されたデータは、プロセッサとネットワークインタフェースとに結合された出口バッファに格納される。格納されたデータは、出口バッファから、ネットワークインタフェースを通じて供給される。
【0018】
出口バッファは、出口バスによって、プロセッサとネットワークインタフェースとに結合される。
【0019】
要求されたデータは、データストリームを含むことができる。
【0020】
出口バスは、データストリームの帯域幅の約二倍の帯域幅を有する。
【0021】
出口バスは、32ビットデータバスを含むことができる。
【0022】
処理済みデータは、格納データが出口バッファから供給されるのとほぼ同時に、出口バッファに格納することができる。
【0023】
取り出されたデータをプロセッサにおいて処理することは、様々な処理の中の、特に、データをフォーマットすることと、データを暗号化することと、データを復号化することとを更に含むことができる。
【0024】
別の実施形態は、データストリームを供給するシステムおよび方法を含み、該システムおよび方法はサーバ内のプロセッサにおいてデータストリームの要求を受領することを含む。要求データストリームは、取り出される。取り出されたデータストリームは、プロセッサにおいて処理される。処理されたデータストリームは、出口バスによってプロセッサとネットワークインタフェースとに結合された出口バッファに格納される。出口バスは、データストリームの帯域幅の約二倍より大きな、あるいはこれに等しい、帯域幅を有する。格納されたデータストリームは、出口バッファから、ネットワークインタフェースを通じて供給される。データストリームは、音声または映像またはその他の任意のストリーミングメディアを含むことができる。
【0025】
本発明のその他の態様および利点は、本発明の原理を例として示す添付図面と併せて、以下の詳細な説明から明らかになろう。
【実施例の詳細な説明】
【0026】
本発明は、添付図面と併せて、以下の詳細な説明により容易に理解されよう。同じ参照符号は同じ構造要素を示す。
【0027】
以下、プロセッサとメモリシステムとのインタフェースの帯域幅使用量を低減するためにDRAMをキャッシングするいくつかの例示的な実施形態について説明する。本発明は、本明細書で述べる具体的な詳細の一部または全部を伴わずに実施し得ることは当業者には明らかであろう。
【0028】
本発明の一実施形態は、ネットワークインタフェースによって供給されることになる、プロセッサからの処理済みデータを、一時的に格納するために使用可能な出口バッファを含む。出口バッファは、その結果、プロセッサとメモリシステムとのインタフェースの帯域幅使用量に関する需要の約三分の二を減少させる。
【0029】
図4は、本発明の一実施形態による、サーバ400のブロック図を示している。サーバ400は、Webサーバまたはその他のタイプのサーバにすることができる。サーバ400は、プロセッサ402とメモリシステム404とを結合するバスシステム408を含む。プロセッサ402は、少なくとも一つのプロセッサコア402Aを含む。サーバ400は、更に、プロセッサ402とネットワークインタフェースとに結合された出口バッファ420を含む。
【0030】
出口バッファ420は、専用の出口バス422を介して、プロセッサ402とネットワークインタフェース412とに結合される。出口バス422は、必要に応じた幅にすることが可能であり、例えば、出口バス422は、32ビット(即ち、ライン)の幅にすることが可能だが、出口バス422は、16ビットまたは64ビットのように、これより狭くすることまたは広くすることが可能である。出口バッファ420は、下で更に詳細に説明するように、ネットワークインタフェース412の望ましいデータスループットをバッファするのに十分な大きさにすることができる。上の10ギガビットデータスループットの例を参照すると、出口バッファ420は、32メガバイト、あるいは、おそらくはそれより大きなものにする必要がある。
【0031】
一実施形態において、出口バッファ420は、約400MHz以上の速さで動作する高速サイクルタイムRAM(FCRAM)のような非常に高速なRAMを含む。FCRAMによって、出口バッファ420は、出口バス422上で、ネットワークインタフェース412に対して、ネットワークインタフェース412の速度で、データを供給することが可能となる。
【0032】
一実施形態において、サーバ400は、多数のプロセッサチップまたはダイ上で、多数のプロセッサを含むことができる。出口バス422は、更に、単一の出口バッファ420を多数のプロセッサの全てに結合させることが可能である。多数のプロセッサと出口バッファ420との間のデータフローを管理するために、出口バスコントローラを含めることができる。
【0033】
図5は、本発明の一実施形態による、出口バッファを使用してデータを供給する方法の動作500のフローチャートである。動作505では、データの要求が、サーバ400において受領される。この要求は、サーバ400内部のアプリケーションからのものにすること、あるいは、ネットワークによってサーバ400につながれた図1のクライアントコンピュータ110のような、外部のデータリクエスタから受領した要求によるものにすることができる。
【0034】
プロセッサ402は、動作510において、要求データを受領する。このデータは、システムデータバス408を介してメモリシステム404またはその他のソースといった多数のソースから取り出すことができる。動作515において、プロセッサ402は、データのパケット化を行うこと、あるいは、他の何らかのフォーマット、暗号化、復号化、またはその他の処理を取り出されたデータに対して実行すること等により、取り出されたデータを処理する。
【0035】
処理済みデータは、動作520において、出口バス422を介して、出口バッファ420に格納される。動作525において、ネットワークインタフェース412、412’は、出口バス422を介して、出口バッファ420から処理済みデータを取り出し、このデータをデータリクエスタに供給する。
【0036】
図6は、本発明の一実施形態による、プロセッサ402’のブロック図を示している。プロセッサ402’は、プロセッサコア402A’と統合ネットワークインタフェース412’とを含む。統合ネットワークインタフェース412’はプロセッサコア402A’と共にプロセッサダイ402’に含まれるため、統合ネットワークインタフェース412’は、上の図4で説明したネットワークインタフェース412より高速でデータを出力できる。
【0037】
一実施形態において、専用バス422Aは、処理データスイッチ430を通じて、プロセッサコア402A’を出口バス422に結合する。処理データスイッチ430は、更に、バス422Bを介して、ネットワークインタフェース412’に結合される。また、ネットワークインタフェース412’は、別個の専用バスによって出口バッファ420に結合させることができる。処理データスイッチ430は、プロセッサコア402A’からのデータを、出口バッファ420またはメモリシステム404へ振り向け、出口バス422上でのデータフローを制御し、その結果、データがネットワークインタフェース412’へ、あるいはプロセッサコア402Aから、流れるようにする。
【0038】
代替実施形態において、出口バス422は、プロセッサダイ上のその他の構成要素を、出口バッファ420につなげることもできる。
【0039】
一実施形態において、出口バッファ420は、約400MHzのダブルデータレート(DDR)バッファである。32ビット幅の出口バス422と組み合わせた場合、400MHzDDRバッファは、800MHz×32ビット幅出口バス422を生成し、その結果、出口バス422の32ビットライン当たりわずか2または4ビットという比較的小さな実際のバッファにより、毎秒3.2GBのスループットを生成する。出口バス422および出口バッファ420の毎秒3.2GBのスループットは、毎秒24ギガビットをわずかに上回るものに等しい。毎秒24ギガビットの出口バッファ420は、二本の毎秒10ギガビットのデータストリームをサポート可能であり、第一の10ギガビットデータストリームは、出口バッファ420への入力となり、一方、第二の10ギガビットデータストリームは、出口バッファ420からネットワークインタフェース412、412’への出力となる。出口バッファ420の速度は、ネットワークインタフェース412、412’のデータ要求速度をサポートするのに十分なものにする必要がある。
【0040】
出口バッファ420
【0041】
出口バッファ420は専用出口バス422によってプロセッサコア402A’に結合されるため、出口バス422は、メモリシステム404とプロセッサコア402A’との間のI/Oインタフェース432のような共有データバスよりも遙かに迅速にデータを伝達することができる。更に、出口バッファ420は遙かに高速なタイプのRAM(例えば、FCRAM)を使用しているため、出口バッファ420は、標準のDRAMよりも高速でデータを供給することができる。
【0042】
出口バッファ420は、更に、プロセッサコア402Aのデータ処理速度と、ネットワークインタフェース412がデータを供給可能な速度との間のデータインタフェースを実質的に平滑化することができる。両者の処理速度の差異(即ち、一時的変動)は、プロセッサが他の動作を実行する際や、あるいはネットワークが混雑し、ネットワークインタフェース412がデータを供給可能な速度が低減される際に、変化する場合が多い。一時的変動の量は、出口バッファ420のサイズが増加するに従って大きくなる。
【0043】
出口バッファ420のFCRAMは、約100MHzまたは更に遅い速度から、約400MHz以上の任意の範囲で動作することができる。出口バッファ420の速度が高くなれば、プロセッサがデータをネットワークインタフェースに供給する効率も高くなる。また、低速の出口バッファ420のFCRAMも、システムバス408の、具体的にはメモリシステム404とプロセッサ402との間のインタフェースのデマンドを低減することで、効率を高めることになる。
【0044】
出口バッファ420は、プロセッサ402と共に単一のダイまたはチップ内部に置くことができる。しかしながら、通常、出口バッファ420は、プロセッサダイの一部ではなく、これは、プロセッサ402内のマイクロプロセッサデバイスのサイズと比較して、メモリの物理サイズが相対的に大きく、したがって、出口バッファを含めることがプロセッサダイ上のスペースの効率的な使用とはならないためである。
【0045】
ネットワークインタフェース412、412’は、毎秒約4ギガビットまたは毎秒約10ギガビットといった、任意の帯域幅を有することができる。ネットワークインタフェース412、412’は、専用出口バス422を介して、出口バッファ420に対する直接的なアクセスを有する。
【0046】
本明細書での使用において、「約」という用語は、+/−10%を意味する。一例として、「約250」という語句は、225ないし275の範囲を示す。
【0047】
上記の実施形態を考慮すると、本発明では、コンピュータシステムに格納されたデータが関与する様々なコンピュータ実施動作を利用することができると理解するべきである。こうした動作は、物理量の物理的操作を必要とするものである。通常は、必須ではないものの、こうした量は、格納と、転送と、結合と、比較と、その他の操作とが可能な電気または磁気信号の形態を取る。更に、実行される操作は、生成、特定、決定、または比較といった用語で呼ばれることが多い。
【0048】
本発明の一部を形成する、本明細書で説明した任意の動作は、有用な機械動作である。本発明は、こうした動作を実行するデバイスまたは装置にも関する。この装置は、必要な目的のために特別に構築することが可能であり、あるいは、コンピュータに格納されるコンピュータプログラムによって選択的に起動または構成される汎用コンピュータにすることができる。特に、様々な汎用機を、本明細書の教示内容に従って書かれたコンピュータプログラムと共に使用することが可能であり、あるいは、更に特化した装置を構築して必要な動作を実行する方が好都合である場合がある。
【0049】
本発明は、コンピュータ読み取り可能媒体上のコンピュータ読み取り可能コードとして実施することもできる。このコンピュータ読み取り可能媒体は、データを格納することができる任意のデータ記憶装置であり、このデータはその後コンピュータシステムによって読むことが可能である。コンピュータ読み取り可能媒体の例には、ハードドライブと、ネットワーク接続ストレージ(NAS)と、読み出し専用メモリと、ランダムアクセスメモリと、CD−ROMと、CD−Rと、CD−RWと、磁気テープと、その他の光学および非光学データ記憶装置とが含まれる。コンピュータ読み取り可能媒体は、ネットワークに接続されたコンピュータシステム上で分散させ、コンピュータ読み取り可能コードを分散形式で格納および実行することも可能である。
【0050】
更に、図5における動作によって表される命令は、例示の順序で実行する必要はなく、これらの動作により表される全ての処理は、本発明を実施する上で必ずしも必要ではない場合があると理解される。更に、図5において説明した処理は、RAM、ROM、またはハードディスクドライブのいずれか一つまたは組み合わせに格納されるソフトウェアにおいて実施することもできる。
【0051】
上記の発明について、明確な理解の目的から、ある程度詳細に説明してきたが、前記特許請求の範囲内で、一定の変更および変形を実施し得ることは明らかであろう。したがって、本発明は、制限的ではなく例示的なものであるとみなされるべきであり、本発明は、本明細書に記載の詳細によって制限されず、前記特許請求の範囲およびその等価物の範囲内で変形することが可能である。
【図面の簡単な説明】
【0052】
【図1】インターネットまたはその他のネットワーク等のネットワークによりつながれた通常のWebサーバおよびクライアントコンピュータを示す図
【図2】通常のWebサーバの高レベルブロック図
【図3】10MBデータストリーム等の大量のデータを供給するWebサーバの方法の動作のフローチャート
【図4】本発明の一実施形態による、サーバのブロック図
【図5】本発明の一実施形態による、出口バッファを使用してデータを供給する方法の動作のフローチャート
【図6】本発明の一実施形態による、プロセッサのブロック図
Claims (19)
- バスシステムに結合されたプロセッサと、
前記バスシステムに結合されたメモリシステムと、
前記プロセッサに結合されたネットワークインタフェースと、
出口バスによって前記プロセッサと前記ネットワークインタフェースとに結合された出口バッファと、を備えるサーバ。 - 請求項1記載のサーバであって、
前記プロセッサは複数のプロセッサを含む、サーバ。 - 請求項2記載のサーバであって、
前記複数のプロセッサは一つの第一のダイ上に含まれる、サーバ。 - 請求項2記載のサーバであって、
前記複数のプロセッサは複数のダイ上に含まれる、サーバ。 - 請求項1記載のサーバであって、
前記出口バッファは高速ランダムアクセスメモリを含む、サーバ。 - 請求項1記載のサーバであって、
前記出口バッファは、約400MHzの動作速度を有するランダムアクセスメモリを含む、サーバ。 - 請求項1記載のサーバであって、
前記出口バッファおよび前記出口バスは、供給されるデータストリームの量の約二倍以上のデータスループット速度を有する、サーバ。 - 請求項1記載のサーバであって、
前記出口バッファは、ダブルデータレートバッファを含む、サーバ。 - 請求項1記載のサーバであって、
前記出口バスは、供給されるデータストリームの量の約二倍以上の帯域幅を有する、サーバ。 - 請求項1記載のサーバであって、
前記出口バスは、32ビットデータバスを含む、サーバ。 - データを供給する方法であって、
サーバ内のプロセッサにおいてデータの要求を受領するステップと、
要求されたデータを取り出すステップと、
取り出されたデータを、前記プロセッサにおいて処理するステップと、
処理されたデータを、前記プロセッサとネットワークインタフェースとに結合された出口バッファに格納するステップと、
格納されたデータを、前記ネットワークインタフェースを通じて、前記出口バッファから供給するステップと、
を備える方法。 - 請求項11記載の方法であって、
前記出口バッファは、出口バスによって、前記プロセッサと前記ネットワークインタフェースとに結合される、方法。 - 請求項11記載の方法であって、
前記要求されたデータは、データストリームを含む、方法。 - 請求項13記載の方法であって、
前記出口バスは、前記データストリームの帯域幅の約二倍の帯域幅を有する、方法。 - 請求項13記載の方法であって、
前記出口バスは、32ビットデータバスを含む、方法。 - 請求項11記載の方法であって、
前記格納されたデータが前記出口バッファから供給されるのと実質的に同時に、前記処理されたデータが前記出口バッファに格納される、方法。 - 請求項11記載の方法であって、
前記取り出されたデータを前記プロセッサにおいて処理するステップが、前記データをフォーマットするステップと、前記データを暗号化するステップと、前記データを復号化するステップと、からなる群のうちの少なくとも一つを含む、方法。 - データストリームを供給する方法であって、
サーバ内のプロセッサにおいてデータストリームの要求を受領するステップと、
要求されたデータストリームを取り出すステップと、
取り出されたデータストリームを、前記プロセッサにおいて処理するステップと、
処理されたデータストリームを、前記データストリームの約二倍以上の帯域幅を有する出口バスによって前記プロセッサとネットワークインタフェースとに結合された出口バッファに格納するステップと、
格納されたデータストリームを、前記ネットワークインタフェースを通じて、前記出口バッファから供給するステップと、
を備える方法。 - 請求項18記載の方法であって、
前記データストリームは、音声と映像とからなる群のうちの少なくとも一つを含む、方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US34531501P | 2001-10-22 | 2001-10-22 | |
PCT/US2002/033441 WO2003036485A2 (en) | 2001-10-22 | 2002-10-18 | System and method for caching dram using an egress buffer |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2005507117A true JP2005507117A (ja) | 2005-03-10 |
JP3926795B2 JP3926795B2 (ja) | 2007-06-06 |
Family
ID=23354532
Family Applications (6)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003538907A Expired - Lifetime JP3926795B2 (ja) | 2001-10-22 | 2002-10-18 | 出口バッファを使用してdramをキャッシュするシステムおよび方法 |
JP2003538872A Expired - Lifetime JP3768993B2 (ja) | 2001-10-22 | 2002-10-18 | Dram電力管理 |
JP2003538929A Expired - Lifetime JP3789454B2 (ja) | 2001-10-22 | 2002-10-18 | 暗号コプロセッサを有するストリームプロセッサ |
JP2003539249A Pending JP2005508032A (ja) | 2001-10-22 | 2002-10-21 | 複数の通信リンクとリモートダイレクトメモリアクセスプロトコルとの統合のための方法および装置 |
JP2003538904A Expired - Lifetime JP4472339B2 (ja) | 2001-10-22 | 2002-10-21 | マルチコアマルチスレッドプロセッサ |
JP2003539266A Pending JP2005507212A (ja) | 2001-10-22 | 2002-10-21 | パケット分類のための方法および装置 |
Family Applications After (5)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003538872A Expired - Lifetime JP3768993B2 (ja) | 2001-10-22 | 2002-10-18 | Dram電力管理 |
JP2003538929A Expired - Lifetime JP3789454B2 (ja) | 2001-10-22 | 2002-10-18 | 暗号コプロセッサを有するストリームプロセッサ |
JP2003539249A Pending JP2005508032A (ja) | 2001-10-22 | 2002-10-21 | 複数の通信リンクとリモートダイレクトメモリアクセスプロトコルとの統合のための方法および装置 |
JP2003538904A Expired - Lifetime JP4472339B2 (ja) | 2001-10-22 | 2002-10-21 | マルチコアマルチスレッドプロセッサ |
JP2003539266A Pending JP2005507212A (ja) | 2001-10-22 | 2002-10-21 | パケット分類のための方法および装置 |
Country Status (10)
Country | Link |
---|---|
US (7) | US7248585B2 (ja) |
EP (6) | EP1442355B1 (ja) |
JP (6) | JP3926795B2 (ja) |
KR (6) | KR20040083464A (ja) |
CN (1) | CN1286019C (ja) |
AT (1) | ATE518192T1 (ja) |
AU (2) | AU2002335878A1 (ja) |
DE (4) | DE60211730T2 (ja) |
TW (1) | TWI240163B (ja) |
WO (6) | WO2003036508A2 (ja) |
Families Citing this family (363)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2728559B1 (fr) * | 1994-12-23 | 1997-01-31 | Saint Gobain Vitrage | Substrats en verre revetus d'un empilement de couches minces a proprietes de reflexion dans l'infrarouge et/ou dans le domaine du rayonnement solaire |
US7996670B1 (en) | 1999-07-08 | 2011-08-09 | Broadcom Corporation | Classification engine in a cryptography acceleration chip |
CA2404665A1 (en) * | 2000-03-30 | 2001-10-11 | The Penn State Research Foundation | Novel compounds for enhancing chemotherapy |
US7013302B2 (en) * | 2000-12-22 | 2006-03-14 | Nortel Networks Limited | Bit field manipulation |
US7529242B1 (en) * | 2002-02-15 | 2009-05-05 | Symantec Corporation | Routing network packets for multi-processor network flow analysis |
US7400722B2 (en) * | 2002-03-28 | 2008-07-15 | Broadcom Corporation | Methods and apparatus for performing hash operations in a cryptography accelerator |
AU2003251492A1 (en) | 2002-06-11 | 2003-12-22 | Ashish A. Pandya | High performance ip processor for tcp/ip, rdma and ip storage applications |
US7415723B2 (en) * | 2002-06-11 | 2008-08-19 | Pandya Ashish A | Distributed network security system and a hardware processor therefor |
US7631107B2 (en) * | 2002-06-11 | 2009-12-08 | Pandya Ashish A | Runtime adaptable protocol processor |
US20040010781A1 (en) * | 2002-07-12 | 2004-01-15 | Maly John Warren | Parameter parsing system |
US7467243B2 (en) * | 2002-10-08 | 2008-12-16 | Rmi Corporation | Advanced processor with scheme for optimal packet flow in a multi-processor system on a chip |
US8176298B2 (en) * | 2002-10-08 | 2012-05-08 | Netlogic Microsystems, Inc. | Multi-core multi-threaded processing systems with instruction reordering in an in-order pipeline |
US7461213B2 (en) * | 2002-10-08 | 2008-12-02 | Rmi Corporation | Advanced processor system using request, data, snoop, and response rings |
US8037224B2 (en) * | 2002-10-08 | 2011-10-11 | Netlogic Microsystems, Inc. | Delegating network processor operations to star topology serial bus interfaces |
US8478811B2 (en) * | 2002-10-08 | 2013-07-02 | Netlogic Microsystems, Inc. | Advanced processor with credit based scheme for optimal packet flow in a multi-processor system on a chip |
US20050044324A1 (en) * | 2002-10-08 | 2005-02-24 | Abbas Rashid | Advanced processor with mechanism for maximizing resource usage in an in-order pipeline with multiple threads |
US7924828B2 (en) * | 2002-10-08 | 2011-04-12 | Netlogic Microsystems, Inc. | Advanced processor with mechanism for fast packet queuing operations |
US8015567B2 (en) * | 2002-10-08 | 2011-09-06 | Netlogic Microsystems, Inc. | Advanced processor with mechanism for packet distribution at high line rate |
US9088474B2 (en) * | 2002-10-08 | 2015-07-21 | Broadcom Corporation | Advanced processor with interfacing messaging network to a CPU |
US7334086B2 (en) * | 2002-10-08 | 2008-02-19 | Rmi Corporation | Advanced processor with system on a chip interconnect technology |
US20050033889A1 (en) * | 2002-10-08 | 2005-02-10 | Hass David T. | Advanced processor with interrupt delivery mechanism for multi-threaded multi-CPU system on a chip |
US7461215B2 (en) * | 2002-10-08 | 2008-12-02 | Rmi Corporation | Advanced processor with implementation of memory ordering on a ring based data movement network |
US20050033831A1 (en) * | 2002-10-08 | 2005-02-10 | Abbas Rashid | Advanced processor with a thread aware return address stack optimally used across active threads |
US20040103248A1 (en) * | 2002-10-08 | 2004-05-27 | Hass David T. | Advanced telecommunications processor |
US7984268B2 (en) * | 2002-10-08 | 2011-07-19 | Netlogic Microsystems, Inc. | Advanced processor scheduling in a multithreaded system |
US7961723B2 (en) * | 2002-10-08 | 2011-06-14 | Netlogic Microsystems, Inc. | Advanced processor with mechanism for enforcing ordering between information sent on two independent networks |
US7346757B2 (en) | 2002-10-08 | 2008-03-18 | Rmi Corporation | Advanced processor translation lookaside buffer management in a multithreaded system |
US7627721B2 (en) | 2002-10-08 | 2009-12-01 | Rmi Corporation | Advanced processor with cache coherency |
US7568110B2 (en) * | 2002-12-18 | 2009-07-28 | Broadcom Corporation | Cryptography accelerator interface decoupling from cryptography processing cores |
US7434043B2 (en) | 2002-12-18 | 2008-10-07 | Broadcom Corporation | Cryptography accelerator data routing unit |
US20040123120A1 (en) * | 2002-12-18 | 2004-06-24 | Broadcom Corporation | Cryptography accelerator input interface data handling |
US20040123123A1 (en) * | 2002-12-18 | 2004-06-24 | Buer Mark L. | Methods and apparatus for accessing security association information in a cryptography accelerator |
US7673118B2 (en) * | 2003-02-12 | 2010-03-02 | Swarztrauber Paul N | System and method for vector-parallel multiprocessor communication |
US7529367B2 (en) | 2003-04-18 | 2009-05-05 | Via Technologies, Inc. | Apparatus and method for performing transparent cipher feedback mode cryptographic functions |
US7844053B2 (en) | 2003-04-18 | 2010-11-30 | Ip-First, Llc | Microprocessor apparatus and method for performing block cipher cryptographic functions |
US7392400B2 (en) | 2003-04-18 | 2008-06-24 | Via Technologies, Inc. | Microprocessor apparatus and method for optimizing block cipher cryptographic functions |
US7539876B2 (en) | 2003-04-18 | 2009-05-26 | Via Technologies, Inc. | Apparatus and method for generating a cryptographic key schedule in a microprocessor |
US7502943B2 (en) | 2003-04-18 | 2009-03-10 | Via Technologies, Inc. | Microprocessor apparatus and method for providing configurable cryptographic block cipher round results |
US7536560B2 (en) | 2003-04-18 | 2009-05-19 | Via Technologies, Inc. | Microprocessor apparatus and method for providing configurable cryptographic key size |
US7529368B2 (en) | 2003-04-18 | 2009-05-05 | Via Technologies, Inc. | Apparatus and method for performing transparent output feedback mode cryptographic functions |
US7321910B2 (en) * | 2003-04-18 | 2008-01-22 | Ip-First, Llc | Microprocessor apparatus and method for performing block cipher cryptographic functions |
US7925891B2 (en) | 2003-04-18 | 2011-04-12 | Via Technologies, Inc. | Apparatus and method for employing cryptographic functions to generate a message digest |
US7900055B2 (en) | 2003-04-18 | 2011-03-01 | Via Technologies, Inc. | Microprocessor apparatus and method for employing configurable block cipher cryptographic algorithms |
US7542566B2 (en) | 2003-04-18 | 2009-06-02 | Ip-First, Llc | Apparatus and method for performing transparent cipher block chaining mode cryptographic functions |
US8060755B2 (en) | 2003-04-18 | 2011-11-15 | Via Technologies, Inc | Apparatus and method for providing user-generated key schedule in a microprocessor cryptographic engine |
US7519833B2 (en) | 2003-04-18 | 2009-04-14 | Via Technologies, Inc. | Microprocessor apparatus and method for enabling configurable data block size in a cryptographic engine |
US7532722B2 (en) | 2003-04-18 | 2009-05-12 | Ip-First, Llc | Apparatus and method for performing transparent block cipher cryptographic functions |
US7392399B2 (en) * | 2003-05-05 | 2008-06-24 | Sun Microsystems, Inc. | Methods and systems for efficiently integrating a cryptographic co-processor |
US20040230813A1 (en) * | 2003-05-12 | 2004-11-18 | International Business Machines Corporation | Cryptographic coprocessor on a general purpose microprocessor |
CA2467140A1 (en) * | 2003-05-12 | 2004-11-12 | Auckland Uniservices Limited | An integrity mechanism for file transfer in communications networks |
US8266379B2 (en) * | 2003-06-02 | 2012-09-11 | Infineon Technologies Ag | Multithreaded processor with multiple caches |
US7685254B2 (en) * | 2003-06-10 | 2010-03-23 | Pandya Ashish A | Runtime adaptable search processor |
US20050108518A1 (en) * | 2003-06-10 | 2005-05-19 | Pandya Ashish A. | Runtime adaptable security processor |
US8730923B2 (en) * | 2003-06-11 | 2014-05-20 | Alcatel Lucent | Method for controlling resource allocation in a wireless communication system |
JP3761544B2 (ja) | 2003-06-25 | 2006-03-29 | インターナショナル・ビジネス・マシーンズ・コーポレーション | 設定装置、情報処理装置、設定方法、プログラム、及び記録媒体 |
US7996839B2 (en) * | 2003-07-16 | 2011-08-09 | Hewlett-Packard Development Company, L.P. | Heterogeneous processor core systems for improved throughput |
US7133950B2 (en) | 2003-08-19 | 2006-11-07 | Sun Microsystems, Inc. | Request arbitration in multi-core processor |
US8463996B2 (en) * | 2003-08-19 | 2013-06-11 | Oracle America, Inc. | Multi-core multi-thread processor crossbar architecture |
US20050044320A1 (en) * | 2003-08-19 | 2005-02-24 | Sun Microsystems, Inc. | Cache bank interface unit |
US7873785B2 (en) * | 2003-08-19 | 2011-01-18 | Oracle America, Inc. | Multi-core multi-thread processor |
EP1522923A3 (fr) * | 2003-10-08 | 2011-06-22 | STMicroelectronics SA | Architecture de processeur à plusieurs contextes d'exécution simultanés |
US7536692B2 (en) * | 2003-11-06 | 2009-05-19 | Intel Corporation | Thread-based engine cache partitioning |
US7617241B2 (en) * | 2003-11-07 | 2009-11-10 | Rmi Corporation | Method and apparatus for enhanced hashing |
US8516179B2 (en) * | 2003-12-03 | 2013-08-20 | Digital Rna, Llc | Integrated circuit with coupled processing cores |
US7222299B1 (en) * | 2003-12-19 | 2007-05-22 | Google, Inc. | Detecting quoted text |
US7308558B2 (en) * | 2004-01-07 | 2007-12-11 | International Business Machines Corporation | Multiprocessor data processing system having scalable data interconnect and data routing mechanism |
US7007128B2 (en) * | 2004-01-07 | 2006-02-28 | International Business Machines Corporation | Multiprocessor data processing system having a data routing mechanism regulated through control communication |
US7634655B2 (en) * | 2004-02-13 | 2009-12-15 | Microsoft Corporation | Efficient hash table protection for data transport protocols |
US7564381B1 (en) * | 2004-02-16 | 2009-07-21 | Cisco Technology, Inc. | System and method for code-based compression in a communications environment |
US8028164B2 (en) * | 2004-03-19 | 2011-09-27 | Nokia Corporation | Practical and secure storage encryption |
US7606263B1 (en) | 2004-03-30 | 2009-10-20 | Extreme Networks, Inc. | Packet parser |
US7649879B2 (en) * | 2004-03-30 | 2010-01-19 | Extreme Networks, Inc. | Pipelined packet processor |
US7292591B2 (en) | 2004-03-30 | 2007-11-06 | Extreme Networks, Inc. | Packet processing system architecture and method |
US7889750B1 (en) | 2004-04-28 | 2011-02-15 | Extreme Networks, Inc. | Method of extending default fixed number of processing cycles in pipelined packet processor architecture |
US7480302B2 (en) * | 2004-05-11 | 2009-01-20 | Samsung Electronics Co., Ltd. | Packet classification method through hierarchical rulebase partitioning |
KR100594755B1 (ko) * | 2004-05-11 | 2006-06-30 | 삼성전자주식회사 | 계층적 룰베이스 분할을 통한 패킷 분류 방법 |
US7418582B1 (en) | 2004-05-13 | 2008-08-26 | Sun Microsystems, Inc. | Versatile register file design for a multi-threaded processor utilizing different modes and register windows |
US7664810B2 (en) * | 2004-05-14 | 2010-02-16 | Via Technologies, Inc. | Microprocessor apparatus and method for modular exponentiation |
US20060041715A1 (en) * | 2004-05-28 | 2006-02-23 | Chrysos George Z | Multiprocessor chip having bidirectional ring interconnect |
US7369557B1 (en) * | 2004-06-03 | 2008-05-06 | Cisco Technology, Inc. | Distribution of flows in a flow-based multi-processor system |
US7571284B1 (en) | 2004-06-30 | 2009-08-04 | Sun Microsystems, Inc. | Out-of-order memory transactions in a fine-grain multithreaded/multi-core processor |
US7290116B1 (en) | 2004-06-30 | 2007-10-30 | Sun Microsystems, Inc. | Level 2 cache index hashing to avoid hot spots |
US7760719B2 (en) | 2004-06-30 | 2010-07-20 | Conexant Systems, Inc. | Combined pipelined classification and address search method and apparatus for switching environments |
US20060009265A1 (en) * | 2004-06-30 | 2006-01-12 | Clapper Edward O | Communication blackout feature |
US7543132B1 (en) | 2004-06-30 | 2009-06-02 | Sun Microsystems, Inc. | Optimizing hardware TLB reload performance in a highly-threaded processor with multiple page sizes |
US7509484B1 (en) | 2004-06-30 | 2009-03-24 | Sun Microsystems, Inc. | Handling cache misses by selectively flushing the pipeline |
US7519796B1 (en) | 2004-06-30 | 2009-04-14 | Sun Microsystems, Inc. | Efficient utilization of a store buffer using counters |
US7366829B1 (en) | 2004-06-30 | 2008-04-29 | Sun Microsystems, Inc. | TLB tag parity checking without CAM read |
US7492763B1 (en) * | 2004-07-16 | 2009-02-17 | Applied Micro Circuits Corporation | User-specified key creation from attributes independent of encapsulation type |
US20060036826A1 (en) * | 2004-07-30 | 2006-02-16 | International Business Machines Corporation | System, method and storage medium for providing a bus speed multiplier |
US7389375B2 (en) * | 2004-07-30 | 2008-06-17 | International Business Machines Corporation | System, method and storage medium for a multi-mode memory buffer device |
US7296129B2 (en) * | 2004-07-30 | 2007-11-13 | International Business Machines Corporation | System, method and storage medium for providing a serialized memory interface with a bus repeater |
US7681105B1 (en) * | 2004-08-09 | 2010-03-16 | Bakbone Software, Inc. | Method for lock-free clustered erasure coding and recovery of data across a plurality of data stores in a network |
US7594081B2 (en) * | 2004-09-10 | 2009-09-22 | Cavium Networks, Inc. | Direct access to low-latency memory |
EP1794979B1 (en) * | 2004-09-10 | 2017-04-12 | Cavium, Inc. | Selective replication of data structure |
US7941585B2 (en) | 2004-09-10 | 2011-05-10 | Cavium Networks, Inc. | Local scratchpad and data caching system |
US9626194B2 (en) | 2004-09-23 | 2017-04-18 | Intel Corporation | Thread livelock unit |
US7748001B2 (en) * | 2004-09-23 | 2010-06-29 | Intel Corporation | Multi-thread processing system for detecting and handling live-lock conditions by arbitrating livelock priority of logical processors based on a predertermined amount of time |
US7788670B2 (en) * | 2004-10-26 | 2010-08-31 | Intel Corporation | Performance-based workload scheduling in multi-core architectures |
US7331010B2 (en) * | 2004-10-29 | 2008-02-12 | International Business Machines Corporation | System, method and storage medium for providing fault detection and correction in a memory subsystem |
US7441060B2 (en) * | 2004-10-29 | 2008-10-21 | International Business Machines Corporation | System, method and storage medium for providing a service interface to a memory system |
US7277988B2 (en) * | 2004-10-29 | 2007-10-02 | International Business Machines Corporation | System, method and storage medium for providing data caching and data compression in a memory subsystem |
US7395476B2 (en) * | 2004-10-29 | 2008-07-01 | International Business Machines Corporation | System, method and storage medium for providing a high speed test interface to a memory subsystem |
US7305574B2 (en) * | 2004-10-29 | 2007-12-04 | International Business Machines Corporation | System, method and storage medium for bus calibration in a memory subsystem |
US7299313B2 (en) * | 2004-10-29 | 2007-11-20 | International Business Machines Corporation | System, method and storage medium for a memory subsystem command interface |
US20060095620A1 (en) * | 2004-10-29 | 2006-05-04 | International Business Machines Corporation | System, method and storage medium for merging bus data in a memory subsystem |
US7512762B2 (en) * | 2004-10-29 | 2009-03-31 | International Business Machines Corporation | System, method and storage medium for a memory subsystem with positional read data latency |
US7356737B2 (en) * | 2004-10-29 | 2008-04-08 | International Business Machines Corporation | System, method and storage medium for testing a memory module |
US7564847B2 (en) * | 2004-12-13 | 2009-07-21 | Intel Corporation | Flow assignment |
US8473750B2 (en) * | 2004-12-15 | 2013-06-25 | Nvidia Corporation | Chipset security offload engine |
US7920701B1 (en) | 2004-12-15 | 2011-04-05 | Nvidia Corporation | System and method for digital content protection |
US8756605B2 (en) * | 2004-12-17 | 2014-06-17 | Oracle America, Inc. | Method and apparatus for scheduling multiple threads for execution in a shared microprocessor pipeline |
US20060136717A1 (en) | 2004-12-20 | 2006-06-22 | Mark Buer | System and method for authentication via a proximate device |
US8295484B2 (en) | 2004-12-21 | 2012-10-23 | Broadcom Corporation | System and method for securing data from a remote input device |
US7937709B2 (en) * | 2004-12-29 | 2011-05-03 | Intel Corporation | Synchronizing multiple threads efficiently |
US7430643B2 (en) * | 2004-12-30 | 2008-09-30 | Sun Microsystems, Inc. | Multiple contexts for efficient use of translation lookaside buffer |
US8719819B2 (en) * | 2005-06-30 | 2014-05-06 | Intel Corporation | Mechanism for instruction set based thread execution on a plurality of instruction sequencers |
US7428619B2 (en) * | 2005-01-18 | 2008-09-23 | Sony Computer Entertainment Inc. | Methods and apparatus for providing synchronization of shared data |
US7426649B2 (en) * | 2005-02-09 | 2008-09-16 | International Business Machines Corporation | Power management via DIMM read operation limiter |
US7421598B2 (en) * | 2005-02-09 | 2008-09-02 | International Business Machines Corporation | Dynamic power management via DIMM read operation limiter |
US7769858B2 (en) * | 2005-02-23 | 2010-08-03 | International Business Machines Corporation | Method for efficiently hashing packet keys into a firewall connection table |
US7443878B2 (en) | 2005-04-04 | 2008-10-28 | Sun Microsystems, Inc. | System for scaling by parallelizing network workload |
US20060271930A1 (en) * | 2005-05-25 | 2006-11-30 | Letizi Orion D | Clustered object state using synthetic transactions |
US20080082763A1 (en) | 2006-10-02 | 2008-04-03 | Metaram, Inc. | Apparatus and method for power management of memory circuits by a system or component thereof |
US8386722B1 (en) | 2008-06-23 | 2013-02-26 | Google Inc. | Stacked DIMM memory interface |
US7472220B2 (en) * | 2006-07-31 | 2008-12-30 | Metaram, Inc. | Interface circuit system and method for performing power management operations utilizing power management signals |
US8619452B2 (en) | 2005-09-02 | 2013-12-31 | Google Inc. | Methods and apparatus of stacking DRAMs |
US20080028136A1 (en) | 2006-07-31 | 2008-01-31 | Schakel Keith R | Method and apparatus for refresh management of memory modules |
US8060774B2 (en) | 2005-06-24 | 2011-11-15 | Google Inc. | Memory systems and memory modules |
US8111566B1 (en) | 2007-11-16 | 2012-02-07 | Google, Inc. | Optimal channel design for memory devices for providing a high-speed memory interface |
US9171585B2 (en) | 2005-06-24 | 2015-10-27 | Google Inc. | Configurable memory circuit system and method |
US8438328B2 (en) | 2008-02-21 | 2013-05-07 | Google Inc. | Emulation of abstracted DIMMs using abstracted DRAMs |
US7639613B1 (en) * | 2005-06-24 | 2009-12-29 | Packeteer, Inc. | Adaptive, flow-based network traffic measurement and monitoring system |
US8397013B1 (en) | 2006-10-05 | 2013-03-12 | Google Inc. | Hybrid memory module |
US8335894B1 (en) | 2008-07-25 | 2012-12-18 | Google Inc. | Configurable memory system with interface circuit |
US9507739B2 (en) | 2005-06-24 | 2016-11-29 | Google Inc. | Configurable memory circuit system and method |
US8090897B2 (en) | 2006-07-31 | 2012-01-03 | Google Inc. | System and method for simulating an aspect of a memory circuit |
US7386656B2 (en) * | 2006-07-31 | 2008-06-10 | Metaram, Inc. | Interface circuit system and method for performing power management operations in conjunction with only a portion of a memory circuit |
US8041881B2 (en) | 2006-07-31 | 2011-10-18 | Google Inc. | Memory device with emulated characteristics |
US9542352B2 (en) | 2006-02-09 | 2017-01-10 | Google Inc. | System and method for reducing command scheduling constraints of memory circuits |
US8169233B2 (en) | 2009-06-09 | 2012-05-01 | Google Inc. | Programming of DIMM termination resistance values |
US8081474B1 (en) | 2007-12-18 | 2011-12-20 | Google Inc. | Embossed heat spreader |
US8089795B2 (en) | 2006-02-09 | 2012-01-03 | Google Inc. | Memory module with memory stack and interface with enhanced capabilities |
US8244971B2 (en) | 2006-07-31 | 2012-08-14 | Google Inc. | Memory circuit system and method |
US8130560B1 (en) | 2006-11-13 | 2012-03-06 | Google Inc. | Multi-rank partial width memory modules |
US8359187B2 (en) | 2005-06-24 | 2013-01-22 | Google Inc. | Simulating a different number of memory circuit devices |
US8327104B2 (en) | 2006-07-31 | 2012-12-04 | Google Inc. | Adjusting the timing of signals associated with a memory system |
US8077535B2 (en) | 2006-07-31 | 2011-12-13 | Google Inc. | Memory refresh apparatus and method |
US8055833B2 (en) | 2006-10-05 | 2011-11-08 | Google Inc. | System and method for increasing capacity, performance, and flexibility of flash storage |
US10013371B2 (en) | 2005-06-24 | 2018-07-03 | Google Llc | Configurable memory circuit system and method |
US8796830B1 (en) | 2006-09-01 | 2014-08-05 | Google Inc. | Stackable low-profile lead frame package |
US7392338B2 (en) * | 2006-07-31 | 2008-06-24 | Metaram, Inc. | Interface circuit system and method for autonomously performing power management operations in conjunction with a plurality of memory circuits |
US20070005899A1 (en) * | 2005-06-30 | 2007-01-04 | Sistla Krishnakanth V | Processing multicore evictions in a CMP multiprocessor |
US8407432B2 (en) * | 2005-06-30 | 2013-03-26 | Intel Corporation | Cache coherency sequencing implementation and adaptive LLC access priority control for CMP |
CN100458757C (zh) * | 2005-07-28 | 2009-02-04 | 大唐移动通信设备有限公司 | 嵌入式实时操作系统中多核处理器的核间通信方法及装置 |
US20070086456A1 (en) * | 2005-08-12 | 2007-04-19 | Electronics And Telecommunications Research Institute | Integrated layer frame processing device including variable protocol header |
GB0519981D0 (en) | 2005-09-30 | 2005-11-09 | Ignios Ltd | Scheduling in a multicore architecture |
US7159082B1 (en) * | 2005-10-03 | 2007-01-02 | Hewlett-Packard Development Company, L.P. | System and method for throttling memory accesses |
US7984180B2 (en) | 2005-10-20 | 2011-07-19 | Solarflare Communications, Inc. | Hashing algorithm for network receive filtering |
US7478259B2 (en) * | 2005-10-31 | 2009-01-13 | International Business Machines Corporation | System, method and storage medium for deriving clocks in a memory system |
US7685392B2 (en) * | 2005-11-28 | 2010-03-23 | International Business Machines Corporation | Providing indeterminate read data latency in a memory system |
US20070124728A1 (en) * | 2005-11-28 | 2007-05-31 | Mark Rosenbluth | Passing work between threads |
WO2007067562A2 (en) * | 2005-12-06 | 2007-06-14 | Boston Circuits, Inc. | Methods and apparatus for multi-core processing with dedicated thread management |
KR100893980B1 (ko) * | 2005-12-14 | 2009-04-20 | 엔비디아 코포레이션 | 칩세트 보안 오프로드 엔진 |
US7750915B1 (en) * | 2005-12-19 | 2010-07-06 | Nvidia Corporation | Concurrent access of data elements stored across multiple banks in a shared memory resource |
US20070168377A1 (en) * | 2005-12-29 | 2007-07-19 | Arabella Software Ltd. | Method and apparatus for classifying Internet Protocol data packets |
US7817633B1 (en) | 2005-12-30 | 2010-10-19 | Extreme Networks, Inc. | Method of providing virtual router functionality through abstracted virtual identifiers |
US7725624B2 (en) * | 2005-12-30 | 2010-05-25 | Intel Corporation | System and method for cryptography processing units and multiplier |
US7822033B1 (en) | 2005-12-30 | 2010-10-26 | Extreme Networks, Inc. | MAC address detection device for virtual routers |
US7900022B2 (en) * | 2005-12-30 | 2011-03-01 | Intel Corporation | Programmable processing unit with an input buffer and output buffer configured to exclusively exchange data with either a shared memory logic or a multiplier based upon a mode instruction |
US7894451B2 (en) * | 2005-12-30 | 2011-02-22 | Extreme Networks, Inc. | Method of providing virtual router functionality |
US20070157030A1 (en) * | 2005-12-30 | 2007-07-05 | Feghali Wajdi K | Cryptographic system component |
US9632929B2 (en) | 2006-02-09 | 2017-04-25 | Google Inc. | Translating an address associated with a command communicated between a system and memory circuits |
US7774590B2 (en) * | 2006-03-23 | 2010-08-10 | Intel Corporation | Resiliently retaining state information of a many-core processor |
US7610330B1 (en) * | 2006-03-30 | 2009-10-27 | Packeteer, Inc. | Multi-dimensional computation distribution in a packet processing device having multiple processing architecture |
CN100407705C (zh) * | 2006-04-12 | 2008-07-30 | 华为技术有限公司 | 一种路由器控制方法和系统 |
EP2016718B1 (en) | 2006-04-21 | 2014-02-12 | Oracle America, Inc. | Method and system for scaling by parallelizing network workload |
US7852850B2 (en) * | 2006-04-26 | 2010-12-14 | Marvell Israel (M.I.S.L.) Ltd. | Double-hash lookup mechanism for searching addresses in a network device |
US7865694B2 (en) * | 2006-05-12 | 2011-01-04 | International Business Machines Corporation | Three-dimensional networking structure |
EP1858228A1 (en) * | 2006-05-16 | 2007-11-21 | THOMSON Licensing | Network data storage system with distributed file management |
US7636813B2 (en) * | 2006-05-22 | 2009-12-22 | International Business Machines Corporation | Systems and methods for providing remote pre-fetch buffers |
US7594055B2 (en) * | 2006-05-24 | 2009-09-22 | International Business Machines Corporation | Systems and methods for providing distributed technology independent memory controllers |
US7640386B2 (en) * | 2006-05-24 | 2009-12-29 | International Business Machines Corporation | Systems and methods for providing memory modules with multiple hub devices |
DE102006025133A1 (de) * | 2006-05-30 | 2007-12-06 | Infineon Technologies Ag | Speicher- und Speicherkommunikationssystem |
US7584336B2 (en) * | 2006-06-08 | 2009-09-01 | International Business Machines Corporation | Systems and methods for providing data modification operations in memory subsystems |
US7584286B2 (en) | 2006-06-28 | 2009-09-01 | Intel Corporation | Flexible and extensible receive side scaling |
US20080002702A1 (en) * | 2006-06-30 | 2008-01-03 | Symbol Technologies, Inc. | Systems and methods for processing data packets using a multi-core abstraction layer (MCAL) |
WO2008005793A2 (en) * | 2006-06-30 | 2008-01-10 | Symbol Technologies, Inc. | Systems and methods for processing data packets using a multi-core abstraction layer (mcal) |
US20080002681A1 (en) * | 2006-06-30 | 2008-01-03 | Symbol Technologies, Inc. | Network wireless/RFID switch architecture for multi-core hardware platforms using a multi-core abstraction layer (MCAL) |
KR100724527B1 (ko) * | 2006-07-11 | 2007-06-04 | 이평범 | 농산물의 잔류 농약을 제거한 파우더의 제조 방법 및 그제조 시스템 |
US7724589B2 (en) | 2006-07-31 | 2010-05-25 | Google Inc. | System and method for delaying a signal communicated from a system to at least one of a plurality of memory circuits |
US7493439B2 (en) * | 2006-08-01 | 2009-02-17 | International Business Machines Corporation | Systems and methods for providing performance monitoring in a memory system |
US7669086B2 (en) | 2006-08-02 | 2010-02-23 | International Business Machines Corporation | Systems and methods for providing collision detection in a memory system |
US7581073B2 (en) * | 2006-08-09 | 2009-08-25 | International Business Machines Corporation | Systems and methods for providing distributed autonomous power management in a memory system |
US7587559B2 (en) * | 2006-08-10 | 2009-09-08 | International Business Machines Corporation | Systems and methods for memory module power management |
US20080263324A1 (en) * | 2006-08-10 | 2008-10-23 | Sehat Sutardja | Dynamic core switching |
US8006069B2 (en) * | 2006-10-05 | 2011-08-23 | Synopsys, Inc. | Inter-processor communication method |
CN100452757C (zh) * | 2006-10-12 | 2009-01-14 | 杭州华三通信技术有限公司 | 报文转发方法和装置 |
US7870459B2 (en) * | 2006-10-23 | 2011-01-11 | International Business Machines Corporation | High density high reliability memory module with power gating and a fault tolerant address and command bus |
US7477522B2 (en) * | 2006-10-23 | 2009-01-13 | International Business Machines Corporation | High density high reliability memory module with a fault tolerant address and command bus |
WO2008050248A2 (en) * | 2006-10-27 | 2008-05-02 | Nokia Corporation | System and method for improved broadband wireless gateway reliability |
US8356361B2 (en) * | 2006-11-07 | 2013-01-15 | Spansion Llc | Secure co-processing memory controller integrated into an embedded memory subsystem |
US7996348B2 (en) | 2006-12-08 | 2011-08-09 | Pandya Ashish A | 100GBPS security and search architecture using programmable intelligent search memory (PRISM) that comprises one or more bit interval counters |
US9141557B2 (en) | 2006-12-08 | 2015-09-22 | Ashish A. Pandya | Dynamic random access memory (DRAM) that comprises a programmable intelligent search memory (PRISM) and a cryptography processing engine |
US7721140B2 (en) * | 2007-01-02 | 2010-05-18 | International Business Machines Corporation | Systems and methods for improving serviceability of a memory system |
US7603526B2 (en) * | 2007-01-29 | 2009-10-13 | International Business Machines Corporation | Systems and methods for providing dynamic memory pre-fetch |
CN101043446A (zh) * | 2007-03-08 | 2007-09-26 | 华为技术有限公司 | 数据转发处理的方法和装置 |
US8095782B1 (en) | 2007-04-05 | 2012-01-10 | Nvidia Corporation | Multiple simultaneous context architecture for rebalancing contexts on multithreaded processing cores upon a context change |
US7979683B1 (en) * | 2007-04-05 | 2011-07-12 | Nvidia Corporation | Multiple simultaneous context architecture |
ES2345675T3 (es) * | 2007-05-11 | 2010-09-29 | Sca Hygiene Products Ab | Dispositivo de envasado y suministro para agrupar articulos de productos. |
US7840821B2 (en) * | 2007-05-18 | 2010-11-23 | Globalfoundries Inc. | Method and apparatus for monitoring energy consumption of an electronic device |
US7552241B2 (en) * | 2007-05-18 | 2009-06-23 | Tilera Corporation | Method and system for managing a plurality of I/O interfaces with an array of multicore processor resources in a semiconductor chip |
US8209479B2 (en) | 2007-07-18 | 2012-06-26 | Google Inc. | Memory circuit system and method |
CN101350010B (zh) * | 2007-07-20 | 2011-08-17 | 迈普通信技术股份有限公司 | 一种哈希表的操作方法 |
WO2009018481A1 (en) * | 2007-07-31 | 2009-02-05 | Viasat, Inc. | Multi-level key manager |
US8161167B2 (en) * | 2007-08-28 | 2012-04-17 | Cisco Technology, Inc. | Highly scalable application layer service appliances |
US8082482B2 (en) | 2007-08-31 | 2011-12-20 | International Business Machines Corporation | System for performing error correction operations in a memory hub device of a memory module |
US7584308B2 (en) * | 2007-08-31 | 2009-09-01 | International Business Machines Corporation | System for supporting partial cache line write operations to a memory module to reduce write data traffic on a memory channel |
US8086936B2 (en) | 2007-08-31 | 2011-12-27 | International Business Machines Corporation | Performing error correction at a memory device level that is transparent to a memory channel |
US7899983B2 (en) * | 2007-08-31 | 2011-03-01 | International Business Machines Corporation | Buffered memory module supporting double the memory device data width in the same physical space as a conventional memory module |
US7865674B2 (en) * | 2007-08-31 | 2011-01-04 | International Business Machines Corporation | System for enhancing the memory bandwidth available through a memory module |
US7818497B2 (en) * | 2007-08-31 | 2010-10-19 | International Business Machines Corporation | Buffered memory module supporting two independent memory channels |
US7861014B2 (en) * | 2007-08-31 | 2010-12-28 | International Business Machines Corporation | System for supporting partial cache line read operations to a memory module to reduce read data traffic on a memory channel |
US7840748B2 (en) * | 2007-08-31 | 2010-11-23 | International Business Machines Corporation | Buffered memory module with multiple memory device data interface ports supporting double the memory capacity |
US8019919B2 (en) | 2007-09-05 | 2011-09-13 | International Business Machines Corporation | Method for enhancing the memory bandwidth available through a memory module |
US7558887B2 (en) * | 2007-09-05 | 2009-07-07 | International Business Machines Corporation | Method for supporting partial cache line read and write operations to a memory module to reduce read and write data traffic on a memory channel |
KR100899526B1 (ko) * | 2007-09-07 | 2009-05-27 | 삼성네트웍스 주식회사 | 다중 프로세서 기반의 패킷 처리 장치 및 방법 |
US8080874B1 (en) | 2007-09-14 | 2011-12-20 | Google Inc. | Providing additional space between an integrated circuit and a circuit board for positioning a component therebetween |
US7890472B2 (en) | 2007-09-18 | 2011-02-15 | Microsoft Corporation | Parallel nested transactions in transactional memory |
US8560634B2 (en) * | 2007-10-17 | 2013-10-15 | Dispersive Networks, Inc. | Apparatus, systems and methods utilizing dispersive networking |
US8539098B2 (en) | 2007-10-17 | 2013-09-17 | Dispersive Networks, Inc. | Multiplexed client server (MCS) communications and systems |
IL187038A0 (en) * | 2007-10-30 | 2008-02-09 | Sandisk Il Ltd | Secure data processing for unaligned data |
US20090119114A1 (en) * | 2007-11-02 | 2009-05-07 | David Alaniz | Systems and Methods for Enabling Customer Service |
US8838817B1 (en) | 2007-11-07 | 2014-09-16 | Netapp, Inc. | Application-controlled network packet classification |
US8019970B2 (en) * | 2007-11-28 | 2011-09-13 | International Business Machines Corporation | Three-dimensional networking design structure |
US20090172370A1 (en) * | 2007-12-31 | 2009-07-02 | Advanced Micro Devices, Inc. | Eager execution in a processing pipeline having multiple integer execution units |
US7793080B2 (en) * | 2007-12-31 | 2010-09-07 | Globalfoundries Inc. | Processing pipeline having parallel dispatch and method thereof |
US8086825B2 (en) * | 2007-12-31 | 2011-12-27 | Advanced Micro Devices, Inc. | Processing pipeline having stage-specific thread selection and method thereof |
US8375395B2 (en) * | 2008-01-03 | 2013-02-12 | L3 Communications Integrated Systems, L.P. | Switch-based parallel distributed cache architecture for memory access on reconfigurable computing platforms |
US7930470B2 (en) * | 2008-01-24 | 2011-04-19 | International Business Machines Corporation | System to enable a memory hub device to manage thermal conditions at a memory device level transparent to a memory controller |
US7925825B2 (en) * | 2008-01-24 | 2011-04-12 | International Business Machines Corporation | System to support a full asynchronous interface within a memory hub device |
US7925824B2 (en) * | 2008-01-24 | 2011-04-12 | International Business Machines Corporation | System to reduce latency by running a memory channel frequency fully asynchronous from a memory device frequency |
US7930469B2 (en) * | 2008-01-24 | 2011-04-19 | International Business Machines Corporation | System to provide memory system power reduction without reducing overall memory system performance |
US7925826B2 (en) * | 2008-01-24 | 2011-04-12 | International Business Machines Corporation | System to increase the overall bandwidth of a memory channel by allowing the memory channel to operate at a frequency independent from a memory device frequency |
US7770077B2 (en) * | 2008-01-24 | 2010-08-03 | International Business Machines Corporation | Using cache that is embedded in a memory hub to replace failed memory cells in a memory subsystem |
US8140936B2 (en) | 2008-01-24 | 2012-03-20 | International Business Machines Corporation | System for a combined error correction code and cyclic redundancy check code for a memory channel |
US9596324B2 (en) * | 2008-02-08 | 2017-03-14 | Broadcom Corporation | System and method for parsing and allocating a plurality of packets to processor core threads |
JP4621747B2 (ja) * | 2008-02-15 | 2011-01-26 | 株式会社東芝 | 通信制御装置および情報処理装置 |
US8510370B2 (en) * | 2008-02-26 | 2013-08-13 | Avid Technology, Inc. | Array-based distributed storage system with parity |
US8566833B1 (en) | 2008-03-11 | 2013-10-22 | Netapp, Inc. | Combined network and application processing in a multiprocessing environment |
US8209493B2 (en) * | 2008-03-26 | 2012-06-26 | Intel Corporation | Systems and methods for scheduling memory requests during memory throttling |
KR100976628B1 (ko) * | 2008-05-09 | 2010-08-18 | 한국전자통신연구원 | 다중 프로세서 시스템 및 그 시스템에서의 다중 프로세싱방법 |
US20090288104A1 (en) * | 2008-05-19 | 2009-11-19 | Rohati Systems, Inc. | Extensibility framework of a network element |
US8677453B2 (en) * | 2008-05-19 | 2014-03-18 | Cisco Technology, Inc. | Highly parallel evaluation of XACML policies |
US8094560B2 (en) * | 2008-05-19 | 2012-01-10 | Cisco Technology, Inc. | Multi-stage multi-core processing of network packets |
US8667556B2 (en) * | 2008-05-19 | 2014-03-04 | Cisco Technology, Inc. | Method and apparatus for building and managing policies |
JP5583893B2 (ja) | 2008-05-28 | 2014-09-03 | 富士通株式会社 | 演算処理装置及び演算処理装置の制御方法 |
EP2294571A4 (en) * | 2008-05-30 | 2014-04-23 | Advanced Micro Devices Inc | COMPLEX NUANCE COMPRESSOR WITH DISTRIBUTED LEVEL 1 CACHE SYSTEM AND CENTRALIZED LEVEL 2 COVER MEMORY |
US8194582B2 (en) * | 2008-06-30 | 2012-06-05 | The Boeing Company | Method and apparatus for hosting commercially-derived packet routers on satellite payloads |
US7944844B2 (en) | 2008-07-10 | 2011-05-17 | At&T Intellectual Property I, L.P. | Methods and apparatus to monitor network layer functionalities |
TWI362596B (en) * | 2008-07-23 | 2012-04-21 | Inst Information Industry | Intermediary apparatus, intermediary method, computer program product for storing a data in a storage apparatus, and data storage system comprising the same |
US7979671B2 (en) * | 2008-07-28 | 2011-07-12 | CacheIQ, Inc. | Dual hash indexing system and methodology |
JP5395383B2 (ja) * | 2008-08-21 | 2014-01-22 | 株式会社東芝 | パイプライン演算プロセッサを備える制御システム |
US20100070471A1 (en) * | 2008-09-17 | 2010-03-18 | Rohati Systems, Inc. | Transactional application events |
US8688911B1 (en) * | 2008-11-25 | 2014-04-01 | Marvell Israel (M.I.S.L) Ltd. | Transparent processing core and L2 cache connection |
US8484421B1 (en) | 2008-11-25 | 2013-07-09 | Marvell Israel (M.I.S.L) Ltd. | Cache pre-fetch architecture and method |
CN101799750B (zh) * | 2009-02-11 | 2015-05-06 | 上海芯豪微电子有限公司 | 一种数据处理的方法与装置 |
US8549260B2 (en) * | 2009-01-29 | 2013-10-01 | Infineon Technologies Ag | Apparatus for processing data and method for generating manipulated and re-manipulated configuration data for processor |
JP5081847B2 (ja) * | 2009-02-20 | 2012-11-28 | 株式会社日立製作所 | マルチプロセッサによるパケット処理装置およびパケット処理方法 |
US8514874B2 (en) * | 2010-03-12 | 2013-08-20 | Lsi Corporation | Thread synchronization in a multi-thread network communications processor architecture |
US9461930B2 (en) | 2009-04-27 | 2016-10-04 | Intel Corporation | Modifying data streams without reordering in a multi-thread, multi-flow network processor |
US9444757B2 (en) | 2009-04-27 | 2016-09-13 | Intel Corporation | Dynamic configuration of processing modules in a network communications processor architecture |
JP2010288233A (ja) * | 2009-06-15 | 2010-12-24 | Toshiba Corp | 暗号処理装置 |
US8565239B2 (en) * | 2009-07-14 | 2013-10-22 | Broadcom Corporation | Node based path selection randomization |
US8503456B2 (en) * | 2009-07-14 | 2013-08-06 | Broadcom Corporation | Flow based path selection randomization |
US9047217B2 (en) * | 2009-08-27 | 2015-06-02 | Cleversafe, Inc. | Nested distributed storage unit and applications thereof |
US8473818B2 (en) * | 2009-10-12 | 2013-06-25 | Empire Technology Development Llc | Reliable communications in on-chip networks |
US8484439B1 (en) | 2009-10-27 | 2013-07-09 | Juniper Networks, Inc. | Scalable hash tables |
US8446824B2 (en) * | 2009-12-17 | 2013-05-21 | Intel Corporation | NUMA-aware scaling for network devices |
US8452835B2 (en) * | 2009-12-23 | 2013-05-28 | Citrix Systems, Inc. | Systems and methods for object rate limiting in multi-core system |
US9367462B2 (en) * | 2009-12-29 | 2016-06-14 | Empire Technology Development Llc | Shared memories for energy efficient multi-core processors |
US8391305B2 (en) * | 2009-12-30 | 2013-03-05 | International Business Machines Corporation | Assignment constraint matrix for assigning work from multiple sources to multiple sinks |
US8295305B2 (en) * | 2009-12-30 | 2012-10-23 | International Business Machines Corporation | Dual scheduling of work from multiple sources to multiple sinks using source and sink attributes to achieve fairness and processing efficiency |
US8532129B2 (en) * | 2009-12-30 | 2013-09-10 | International Business Machines Corporation | Assigning work from multiple sources to multiple sinks given assignment constraints |
JP5477112B2 (ja) * | 2010-03-31 | 2014-04-23 | 富士通株式会社 | ネットワークシステムの試験方法 |
US9015441B2 (en) | 2010-04-30 | 2015-04-21 | Microsoft Technology Licensing, Llc | Memory usage scanning |
US8699484B2 (en) | 2010-05-24 | 2014-04-15 | At&T Intellectual Property I, L.P. | Methods and apparatus to route packets in a network |
US9491085B2 (en) * | 2010-05-24 | 2016-11-08 | At&T Intellectual Property I, L.P. | Methods and apparatus to route control packets based on address partitioning |
US8559332B2 (en) * | 2010-05-25 | 2013-10-15 | Telefonaktiebolaget L M Ericsson (Publ) | Method for enhancing table lookups with exact and wildcards matching for parallel environments |
US8381004B2 (en) * | 2010-05-26 | 2013-02-19 | International Business Machines Corporation | Optimizing energy consumption and application performance in a multi-core multi-threaded processor system |
EP2590083A4 (en) | 2010-06-30 | 2016-04-20 | Fujitsu Ltd | DATA RECOVERY PROGRAM, DATA RESTORE DEVICE, AND DATA RESTORATION METHOD |
US8681973B2 (en) * | 2010-09-15 | 2014-03-25 | At&T Intellectual Property I, L.P. | Methods, systems, and computer program products for performing homomorphic encryption and decryption on individual operations |
CN102446087B (zh) * | 2010-10-12 | 2014-02-26 | 无锡江南计算技术研究所 | 指令预取方法与预取装置 |
GB2485142A (en) | 2010-10-27 | 2012-05-09 | Nds Ltd | Secure broadcast/multicast of media content |
US8751720B2 (en) | 2010-11-08 | 2014-06-10 | Moon J. Kim | Computationally-networked unified data bus |
KR101153940B1 (ko) * | 2010-11-09 | 2012-06-08 | 아주대학교산학협력단 | 패킷 분류 장치 및 그 방법 |
US8955110B1 (en) | 2011-01-14 | 2015-02-10 | Robert W. Twitchell, Jr. | IP jamming systems utilizing virtual dispersive networking |
US8941659B1 (en) | 2011-01-28 | 2015-01-27 | Rescon Ltd | Medical symptoms tracking apparatus, methods and systems |
US8605732B2 (en) | 2011-02-15 | 2013-12-10 | Extreme Networks, Inc. | Method of providing virtual router functionality |
FR2971872B1 (fr) * | 2011-02-18 | 2014-06-20 | Bull Sas | Circuit integre programmable de cryptographie |
US9158592B2 (en) | 2011-05-02 | 2015-10-13 | Green Hills Software, Inc. | System and method for time variant scheduling of affinity groups comprising processor core and address spaces on a synchronized multicore processor |
CN102779110B (zh) * | 2011-05-11 | 2014-08-06 | 扬智科技股份有限公司 | 基于远端代码调用和数据访问的多核心系统及其控制方法 |
JP2012243105A (ja) * | 2011-05-19 | 2012-12-10 | Buffalo Inc | ファイル管理装置及びその制御プログラム |
US9996403B2 (en) * | 2011-09-30 | 2018-06-12 | Oracle International Corporation | System and method for providing message queues for multinode applications in a middleware machine environment |
US9612934B2 (en) * | 2011-10-28 | 2017-04-04 | Cavium, Inc. | Network processor with distributed trace buffers |
US9330002B2 (en) * | 2011-10-31 | 2016-05-03 | Cavium, Inc. | Multi-core interconnect in a network processor |
US8850557B2 (en) | 2012-02-29 | 2014-09-30 | International Business Machines Corporation | Processor and data processing method with non-hierarchical computer security enhancements for context states |
WO2013072773A2 (en) * | 2011-11-18 | 2013-05-23 | Marvell World Trade Ltd. | Data path acceleration using hw virtualization |
US9075768B2 (en) | 2011-11-30 | 2015-07-07 | Rs Stata Llc | Hierarchical multi-core processor and method of programming for efficient data processing |
WO2013100984A1 (en) * | 2011-12-28 | 2013-07-04 | Intel Corporation | High bandwidth full-block write commands |
US9069912B2 (en) * | 2012-03-31 | 2015-06-30 | Qualcomm Technologies, Inc. | System and method of distributed initiator-local reorder buffers |
US9311228B2 (en) | 2012-04-04 | 2016-04-12 | International Business Machines Corporation | Power reduction in server memory system |
US9237128B2 (en) * | 2013-03-15 | 2016-01-12 | International Business Machines Corporation | Firewall packet filtering |
US9420008B1 (en) * | 2012-05-10 | 2016-08-16 | Bae Systems Information And Electronic Systems Integration Inc. | Method for repurposing of communications cryptographic capabilities |
US8910179B2 (en) * | 2012-05-15 | 2014-12-09 | Freescale Semiconductor, Inc. | Systems and methods for providing semaphore-based protection of system resources |
US9514069B1 (en) | 2012-05-24 | 2016-12-06 | Schwegman, Lundberg & Woessner, P.A. | Enhanced computer processor and memory management architecture |
WO2014038582A1 (ja) * | 2012-09-04 | 2014-03-13 | 日本電気株式会社 | パケット振分装置、パケット振分方法、およびパケット振分プログラム |
US9164570B2 (en) * | 2012-12-13 | 2015-10-20 | Advanced Micro Devices, Inc. | Dynamic re-configuration for low power in a data processor |
US10140129B2 (en) | 2012-12-28 | 2018-11-27 | Intel Corporation | Processing core having shared front end unit |
US9417873B2 (en) | 2012-12-28 | 2016-08-16 | Intel Corporation | Apparatus and method for a hybrid latency-throughput processor |
US9361116B2 (en) | 2012-12-28 | 2016-06-07 | Intel Corporation | Apparatus and method for low-latency invocation of accelerators |
US10346195B2 (en) | 2012-12-29 | 2019-07-09 | Intel Corporation | Apparatus and method for invocation of a multi threaded accelerator |
KR101448951B1 (ko) * | 2013-02-27 | 2014-10-13 | 주식회사 시큐아이 | 패킷 처리 장치 및 방법 |
US8954992B2 (en) * | 2013-03-15 | 2015-02-10 | Lenovo Enterprise Solutions (Singapore) Pte. Ltd. | Distributed and scaled-out network switch and packet processing |
CN105229980B (zh) * | 2013-04-11 | 2018-11-16 | 马维尔以色列(M.I.S.L.)有限公司 | 利用可变关键字大小的精确匹配查找的方法及设备 |
JP5803972B2 (ja) | 2013-04-18 | 2015-11-04 | 株式会社デンソー | マルチコアプロセッサ |
KR101499890B1 (ko) * | 2013-05-15 | 2015-03-06 | 주식회사 코스콤 | Low Latency 프레임워크 시스템 |
US9454196B2 (en) | 2013-06-27 | 2016-09-27 | Apple Inc. | Active peak power management of a high performance embedded microprocessor cluster |
CN104302100A (zh) * | 2013-07-18 | 2015-01-21 | 群联电子股份有限公司 | 焊垫结构及应用其的印刷电路板与存储器存储装置 |
JP5742908B2 (ja) * | 2013-10-03 | 2015-07-01 | 富士通株式会社 | マルチコアプロセッサシステム、制御方法および制御プログラム |
CN104572275B (zh) * | 2013-10-23 | 2017-12-29 | 华为技术有限公司 | 一种进程加载方法、装置及系统 |
US9825857B2 (en) * | 2013-11-05 | 2017-11-21 | Cisco Technology, Inc. | Method for increasing Layer-3 longest prefix match scale |
US10515231B2 (en) * | 2013-11-08 | 2019-12-24 | Symcor Inc. | Method of obfuscating relationships between data in database tables |
GB201322883D0 (en) * | 2013-12-23 | 2014-02-12 | Bae Systems Plc | Data capture |
DK3087700T3 (da) | 2013-12-23 | 2020-10-19 | Bae Systems Plc | Dataindfangning |
KR20150086718A (ko) * | 2014-01-20 | 2015-07-29 | 삼성전자주식회사 | 메모리를 이용하여 파이프라인이 데이터를 처리하는 방법 및 장치 |
US10078613B1 (en) * | 2014-03-05 | 2018-09-18 | Mellanox Technologies, Ltd. | Computing in parallel processing environments |
US9547331B2 (en) | 2014-04-03 | 2017-01-17 | Qualcomm Incorporated | Apparatus and method to set the speed of a clock |
US10721160B2 (en) | 2014-05-15 | 2020-07-21 | Samsung Electronics Co., Ltd. | Method of distributing data and device supporting the same |
US9413783B1 (en) * | 2014-06-02 | 2016-08-09 | Amazon Technologies, Inc. | Network interface with on-board packet processing |
CN105591914B (zh) * | 2014-10-21 | 2020-07-03 | 中兴通讯股份有限公司 | 一种openflow流表的查表方法和装置 |
US10230824B2 (en) * | 2014-11-17 | 2019-03-12 | Keysight Technologies Singapore (Holdings) Pte. Lte. | Packet classification using memory pointer information |
CN104391821A (zh) * | 2014-11-20 | 2015-03-04 | 天津大学 | 一种多核共享simd协处理器的系统级模型构建方法 |
DE102015200301A1 (de) | 2015-01-13 | 2016-07-14 | Robert Bosch Gmbh | Verfahren zum Klassifizieren eines Datensegments bezüglich dessen Weiterverarbeitung |
US9830187B1 (en) * | 2015-06-05 | 2017-11-28 | Apple Inc. | Scheduler and CPU performance controller cooperation |
US10552619B2 (en) * | 2015-07-20 | 2020-02-04 | Intel Corporation | Technologies for secure trusted I/O access control |
CN105468705A (zh) * | 2015-11-18 | 2016-04-06 | 广东南方通信建设有限公司 | 一种移动通信后台数据文件导入方法 |
CN106059792B (zh) * | 2016-05-13 | 2019-03-29 | 北京英诺威尔科技股份有限公司 | 一种低延迟的流量解析处理方法 |
WO2018018611A1 (zh) * | 2016-07-29 | 2018-02-01 | 华为技术有限公司 | 一种任务处理方法以及网卡 |
US10348506B2 (en) | 2016-09-30 | 2019-07-09 | International Business Machines Corporation | Determination of state of padding operation |
US20180122038A1 (en) * | 2016-10-28 | 2018-05-03 | Qualcomm Incorporated | Multi-layer fetch during composition |
US11392488B2 (en) | 2017-04-07 | 2022-07-19 | Keysight Technologies Singapore (Sales) Pte. Ltd. | Optimizing storage of application data in memory |
JP6390748B1 (ja) * | 2017-04-19 | 2018-09-19 | 富士通株式会社 | 情報処理装置、情報処理方法および情報処理プログラム |
US10884811B2 (en) | 2017-06-04 | 2021-01-05 | Apple Inc. | Scheduler for AMP architecture with closed loop performance controller using static and dynamic thread grouping |
US10681607B2 (en) * | 2018-06-22 | 2020-06-09 | Intel Corporation | Receive-side scaling for wireless communication devices |
CN109729021A (zh) * | 2018-12-27 | 2019-05-07 | 北京天融信网络安全技术有限公司 | 一种报文处理方法及电子设备 |
US11488650B2 (en) * | 2020-04-06 | 2022-11-01 | Memryx Incorporated | Memory processing unit architecture |
CN111225021B (zh) * | 2019-11-13 | 2020-11-27 | 北京连山时代科技有限公司 | 一种基于文件破碎与重组的多链路并发传输方法和系统 |
US11210248B2 (en) | 2019-12-20 | 2021-12-28 | Advanced Micro Devices, Inc. | System direct memory access engine offload |
JP7359299B2 (ja) * | 2020-05-18 | 2023-10-11 | 日本電信電話株式会社 | パケット識別装置、パケット識別方法およびパケット識別プログラム |
US11689493B2 (en) * | 2020-07-02 | 2023-06-27 | Vmware, Inc. | Connection tracking records for a very large scale NAT engine |
US11115381B1 (en) | 2020-11-30 | 2021-09-07 | Vmware, Inc. | Hybrid and efficient method to sync NAT sessions |
EP4095704B1 (en) * | 2021-05-26 | 2023-08-23 | STMicroelectronics Application GmbH | Processing system, related integrated circuit, device and method |
Family Cites Families (68)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3736569A (en) | 1971-10-13 | 1973-05-29 | Ibm | System for controlling power consumption in a computer |
US4096571A (en) * | 1976-09-08 | 1978-06-20 | Codex Corporation | System for resolving memory access conflicts among processors and minimizing processor waiting times for access to memory by comparing waiting times and breaking ties by an arbitrary priority ranking |
US4777595A (en) * | 1982-05-07 | 1988-10-11 | Digital Equipment Corporation | Apparatus for transferring blocks of information from one node to a second node in a computer network |
US4754394A (en) * | 1984-10-24 | 1988-06-28 | International Business Machines Corporation | Multiprocessing system having dynamically allocated local/global storage and including interleaving transformation circuit for transforming real addresses to corresponding absolute address of the storage |
US5226171A (en) * | 1984-12-03 | 1993-07-06 | Cray Research, Inc. | Parallel vector processing system for individual and broadcast distribution of operands and control information |
US4744078A (en) * | 1985-05-13 | 1988-05-10 | Gould Inc. | Multiple path multiplexed host to network data communication system |
JPS63163912A (ja) * | 1986-12-26 | 1988-07-07 | Toshiba Corp | マイクロコンピユ−タシステム |
EP0512009A4 (en) * | 1990-11-26 | 1993-10-20 | Adaptive Solutions, Inc. | Temperature-sensing control system and method for integrated circuits |
US5422654A (en) * | 1991-10-17 | 1995-06-06 | Chips And Technologies, Inc. | Data stream converter with increased grey levels |
US5583561A (en) * | 1994-06-07 | 1996-12-10 | Unisys Corporation | Multi-cast digital video data server using synchronization groups |
DE4421640C1 (de) * | 1994-06-21 | 1995-08-03 | Siemens Ag | Hash-Adressierungs- und Speicherverfahren zum Ablegen und Wiedergewinnen von Daten in einem adressierbaren Speicher |
US5671377A (en) * | 1994-07-19 | 1997-09-23 | David Sarnoff Research Center, Inc. | System for supplying streams of data to multiple users by distributing a data stream to multiple processors and enabling each user to manipulate supplied data stream |
US5838603A (en) * | 1994-10-11 | 1998-11-17 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device and method for fabricating the same, memory core chip and memory peripheral circuit chip |
US5878217A (en) * | 1994-11-21 | 1999-03-02 | Cirrus Logic, Inc. | Network controller for switching into DMA mode based on anticipated memory overflow and out of DMA mode when the host processor is available |
JP3132749B2 (ja) | 1994-12-05 | 2001-02-05 | インターナショナル・ビジネス・マシーンズ・コーポレ−ション | マルチプロセッサ・データ処理システム |
JPH096633A (ja) | 1995-06-07 | 1997-01-10 | Internatl Business Mach Corp <Ibm> | データ処理システムに於ける高性能多重論理経路の動作用の方法とシステム |
DE69521616T2 (de) | 1995-11-28 | 2001-10-18 | Bull Sa | Speicherzugangsbegrenzer für dynamischen RAM |
US5923654A (en) * | 1996-04-25 | 1999-07-13 | Compaq Computer Corp. | Network switch that includes a plurality of shared packet buffers |
US5764896A (en) * | 1996-06-28 | 1998-06-09 | Compaq Computer Corporation | Method and system for reducing transfer latency when transferring data from a network to a computer system |
US5802576A (en) * | 1996-07-01 | 1998-09-01 | Sun Microsystems, Inc. | Speculative cache snoop during DMA line update |
US5778243A (en) * | 1996-07-03 | 1998-07-07 | International Business Machines Corporation | Multi-threaded cell for a memory |
DE19630861A1 (de) * | 1996-07-31 | 1998-02-05 | Philips Patentverwaltung | Datenverarbeitungseinrichtung mit einem Mikroprozessor und einer zusätzlichen Recheneinheit |
US5828753A (en) * | 1996-10-25 | 1998-10-27 | Intel Corporation | Circuit and method for ensuring interconnect security within a multi-chip integrated circuit package |
US5895487A (en) | 1996-11-13 | 1999-04-20 | International Business Machines Corporation | Integrated processing and L2 DRAM cache |
US6088788A (en) | 1996-12-27 | 2000-07-11 | International Business Machines Corporation | Background completion of instruction and associated fetch request in a multithread processor |
US6098110A (en) * | 1996-12-30 | 2000-08-01 | Compaq Computer Corporation | Network switch with a multiple bus structure and a bridge interface for transferring network data between different buses |
US5974496A (en) * | 1997-01-02 | 1999-10-26 | Ncr Corporation | System for transferring diverse data objects between a mass storage device and a network via an internal bus on a network card |
US6122669A (en) * | 1997-02-14 | 2000-09-19 | Advanced Micro Devices, Inc. | Method and apparatus for auto-incrementing through table and updating single register in memory |
US6151681A (en) * | 1997-06-25 | 2000-11-21 | Texas Instruments Incorporated | Dynamic device power management |
US5892966A (en) * | 1997-06-27 | 1999-04-06 | Sun Microsystems, Inc. | Processor complex for executing multimedia functions |
US6094435A (en) * | 1997-06-30 | 2000-07-25 | Sun Microsystems, Inc. | System and method for a quality of service in a multi-layer network element |
US6567839B1 (en) | 1997-10-23 | 2003-05-20 | International Business Machines Corporation | Thread switch control in a multithreaded processor system |
US6272520B1 (en) | 1997-12-31 | 2001-08-07 | Intel Corporation | Method for detecting thread switch events |
FR2775369B1 (fr) * | 1998-02-26 | 2001-08-03 | Sgs Thomson Microelectronics | Procede de mise en oeuvre d'une multiplication modulaire specifique relative a la methode de montgomery |
US6151685A (en) * | 1998-05-15 | 2000-11-21 | International Business Machines Corporation | System and method for recovering a segment directory for a log structured array |
US6216205B1 (en) * | 1998-05-21 | 2001-04-10 | Integrated Device Technology, Inc. | Methods of controlling memory buffers having tri-port cache arrays therein |
US6021076A (en) | 1998-07-16 | 2000-02-01 | Rambus Inc | Apparatus and method for thermal regulation in memory subsystems |
US6320964B1 (en) * | 1998-08-26 | 2001-11-20 | Intel Corporation | Cryptographic accelerator |
JP3374820B2 (ja) * | 1999-01-08 | 2003-02-10 | セイコーエプソン株式会社 | 出力バッファ回路 |
US6453360B1 (en) * | 1999-03-01 | 2002-09-17 | Sun Microsystems, Inc. | High performance network interface |
US7243133B2 (en) * | 1999-03-30 | 2007-07-10 | Sedna Patent Services, Llc | Method and apparatus for reducing latency in an interactive information distribution system |
US6938147B1 (en) * | 1999-05-11 | 2005-08-30 | Sun Microsystems, Inc. | Processor with multiple-thread, vertically-threaded pipeline |
US6341347B1 (en) * | 1999-05-11 | 2002-01-22 | Sun Microsystems, Inc. | Thread switch logic in a multiple-thread processor |
JP2001043084A (ja) * | 1999-05-24 | 2001-02-16 | Toshiba Microelectronics Corp | プロセッサ装置 |
US6334180B1 (en) * | 1999-06-27 | 2001-12-25 | Sun Microsystems, Inc. | Processor coupled by visible register set to modular coprocessor including integrated multimedia unit |
US6751698B1 (en) * | 1999-09-29 | 2004-06-15 | Silicon Graphics, Inc. | Multiprocessor node controller circuit and method |
US6434662B1 (en) * | 1999-11-02 | 2002-08-13 | Juniper Networks, Inc. | System and method for searching an associative memory utilizing first and second hash functions |
US6950434B1 (en) * | 1999-12-07 | 2005-09-27 | Advanced Micro Devices, Inc. | Arrangement for searching packet policies using multi-key hash searches in a network switch |
TW536672B (en) * | 2000-01-12 | 2003-06-11 | Hitachi Ltd | IC card and microcomputer |
WO2001076129A2 (en) * | 2000-03-31 | 2001-10-11 | General Dynamics Decision Systems, Inc. | Scalable cryptographic engine |
AU4870801A (en) | 2000-04-11 | 2001-10-23 | P-Cube Ltd. | A method and apparatus for wire-speed application layer classification of data packets |
JP2001339383A (ja) * | 2000-05-29 | 2001-12-07 | Hitachi Ltd | 認証通信用半導体装置 |
US6845099B2 (en) * | 2000-06-14 | 2005-01-18 | Mindspeed Technologies, Inc. | Communication packet processor with a look-up engine and content-addressable memory for modifying selectors to retrieve context information for a core processor |
US6754662B1 (en) * | 2000-08-01 | 2004-06-22 | Nortel Networks Limited | Method and apparatus for fast and consistent packet classification via efficient hash-caching |
US6567900B1 (en) * | 2000-08-31 | 2003-05-20 | Hewlett-Packard Development Company, L.P. | Efficient address interleaving with simultaneous multiple locality options |
US6785783B2 (en) * | 2000-11-30 | 2004-08-31 | International Business Machines Corporation | NUMA system with redundant main memory architecture |
US6963977B2 (en) * | 2000-12-19 | 2005-11-08 | International Business Machines Corporation | Circuits and methods for modular exponentiation |
US20020083344A1 (en) * | 2000-12-21 | 2002-06-27 | Vairavan Kannan P. | Integrated intelligent inter/intra networking device |
US6463510B1 (en) * | 2000-12-29 | 2002-10-08 | Compaq Information Technologies Group, L.P. | Apparatus for identifying memory requests originating on remote I/O devices as noncacheable |
US6980550B1 (en) * | 2001-01-16 | 2005-12-27 | Extreme Networks, Inc | Method and apparatus for server load balancing |
US6968453B2 (en) * | 2001-01-17 | 2005-11-22 | International Business Machines Corporation | Secure integrated device with secure, dynamically-selectable capabilities |
US20020184487A1 (en) * | 2001-03-23 | 2002-12-05 | Badamo Michael J. | System and method for distributing security processing functions for network applications |
US6874014B2 (en) * | 2001-05-29 | 2005-03-29 | Hewlett-Packard Development Company, L.P. | Chip multiprocessor with multiple operating systems |
US7114011B2 (en) * | 2001-08-30 | 2006-09-26 | Intel Corporation | Multiprocessor-scalable streaming data server arrangement |
US6904040B2 (en) * | 2001-10-05 | 2005-06-07 | International Business Machines Corporaiton | Packet preprocessing interface for multiprocessor network handler |
US7283538B2 (en) * | 2001-10-12 | 2007-10-16 | Vormetric, Inc. | Load balanced scalable network gateway processor architecture |
US7145914B2 (en) * | 2001-12-31 | 2006-12-05 | Maxxan Systems, Incorporated | System and method for controlling data paths of a network processor subsystem |
US7036040B2 (en) * | 2002-11-26 | 2006-04-25 | Microsoft Corporation | Reliability of diskless network-bootable computers using non-volatile memory cache |
-
2002
- 2002-10-16 US US10/272,783 patent/US7248585B2/en active Active
- 2002-10-16 US US10/272,786 patent/US7209996B2/en active Active
- 2002-10-16 US US10/272,784 patent/US6901491B2/en not_active Expired - Lifetime
- 2002-10-17 US US10/273,829 patent/US20030105907A1/en not_active Abandoned
- 2002-10-18 KR KR10-2004-7005998A patent/KR20040083464A/ko not_active Application Discontinuation
- 2002-10-18 JP JP2003538907A patent/JP3926795B2/ja not_active Expired - Lifetime
- 2002-10-18 EP EP02780481A patent/EP1442355B1/en not_active Expired - Lifetime
- 2002-10-18 JP JP2003538872A patent/JP3768993B2/ja not_active Expired - Lifetime
- 2002-10-18 WO PCT/US2002/033321 patent/WO2003036508A2/en not_active Application Discontinuation
- 2002-10-18 KR KR10-2004-7005902A patent/KR20040091608A/ko not_active Application Discontinuation
- 2002-10-18 WO PCT/US2002/033441 patent/WO2003036485A2/en active IP Right Grant
- 2002-10-18 WO PCT/US2002/033323 patent/WO2003036450A2/en active Application Filing
- 2002-10-18 US US10/273,806 patent/US6938119B2/en not_active Expired - Lifetime
- 2002-10-18 EP EP02789223A patent/EP1438667B1/en not_active Expired - Lifetime
- 2002-10-18 DE DE60211730T patent/DE60211730T2/de not_active Expired - Fee Related
- 2002-10-18 JP JP2003538929A patent/JP3789454B2/ja not_active Expired - Lifetime
- 2002-10-18 US US10/273,718 patent/US20030084309A1/en not_active Abandoned
- 2002-10-18 DE DE60236309T patent/DE60236309D1/de not_active Expired - Lifetime
- 2002-10-18 EP EP02795530A patent/EP1442365A2/en not_active Ceased
- 2002-10-18 KR KR10-2004-7005999A patent/KR20050013191A/ko not_active Application Discontinuation
- 2002-10-21 KR KR10-2004-7005903A patent/KR20040084893A/ko not_active Application Discontinuation
- 2002-10-21 AT AT02770646T patent/ATE518192T1/de not_active IP Right Cessation
- 2002-10-21 AU AU2002335878A patent/AU2002335878A1/en not_active Abandoned
- 2002-10-21 WO PCT/US2002/033766 patent/WO2003036902A2/en active Application Filing
- 2002-10-21 JP JP2003539249A patent/JP2005508032A/ja active Pending
- 2002-10-21 AU AU2002337940A patent/AU2002337940A1/en not_active Abandoned
- 2002-10-21 EP EP02770647A patent/EP1466448B1/en not_active Expired - Lifetime
- 2002-10-21 DE DE60237222T patent/DE60237222D1/de not_active Expired - Lifetime
- 2002-10-21 JP JP2003538904A patent/JP4472339B2/ja not_active Expired - Lifetime
- 2002-10-21 CN CNB028259432A patent/CN1286019C/zh not_active Expired - Fee Related
- 2002-10-21 WO PCT/US2002/033762 patent/WO2003036482A2/en active Application Filing
- 2002-10-21 EP EP02773845A patent/EP1438818B1/en not_active Expired - Lifetime
- 2002-10-21 KR KR10-2004-7005904A patent/KR20040080431A/ko not_active Application Discontinuation
- 2002-10-21 DE DE60239227T patent/DE60239227D1/de not_active Expired - Lifetime
- 2002-10-21 JP JP2003539266A patent/JP2005507212A/ja active Pending
- 2002-10-21 WO PCT/US2002/033763 patent/WO2003036884A2/en active Search and Examination
- 2002-10-21 EP EP02770646A patent/EP1442374B1/en not_active Expired - Lifetime
- 2002-10-21 KR KR10-2004-7005905A patent/KR20050012220A/ko not_active Application Discontinuation
- 2002-10-22 TW TW091124449A patent/TWI240163B/zh not_active IP Right Cessation
-
2007
- 2007-03-14 US US11/686,317 patent/US7865667B2/en active Active
Also Published As
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3926795B2 (ja) | 出口バッファを使用してdramをキャッシュするシステムおよび方法 | |
EP1738264B1 (en) | Memory arbitration system and method having an arbitration packet protocol | |
JP4124491B2 (ja) | 異なるデータ転送速度での共用メモリへのアクセスを制御するパケット・ルーティング・スイッチ | |
US9274991B2 (en) | Memory hub architecture having programmable lane widths | |
US20100128874A1 (en) | Encryption / decryption in parallelized data storage using media associated keys | |
EP1820309A2 (en) | Streaming memory controller | |
KR20010096613A (ko) | 네트워크 프로세서를 사용하는 서버 클러스터 접속 | |
US7240143B1 (en) | Data access and address translation for retrieval of data amongst multiple interconnected access nodes | |
US20050253858A1 (en) | Memory control system and method in which prefetch buffers are assigned uniquely to multiple burst streams | |
US6813767B1 (en) | Prioritizing transaction requests with a delayed transaction reservation buffer | |
US6119243A (en) | Architecture for the isochronous transfer of information within a computer system | |
WO2004034429A2 (en) | Line rate buffer using single ported memories for variable length packets | |
US9137167B2 (en) | Host ethernet adapter frame forwarding | |
KR100396974B1 (ko) | 내부에서 네트워크 스위칭을 사용하는 컴퓨터 시스템 및방법 | |
US20220416997A1 (en) | Handling unaligned transactions for inline encryption | |
US6584531B1 (en) | Arbitration circuit with plural arbitration processors using memory bank history | |
US5748920A (en) | Transaction queue in a graphics controller chip | |
CN115633098B (zh) | 众核系统的存储管理方法、装置和集成电路 | |
US20060078002A1 (en) | Task queuing methods and systems for transmitting frame information over an I/O interface | |
KR960014177B1 (ko) | 병렬데이터처리시스템의 데이터통신장치 | |
JP2004054419A (ja) | ノード間トランザクション処理装置 | |
JPH05242012A (ja) | Dmaアドレス発生装置 | |
KR20080051021A (ko) | Pci 메모리를 이용한 사용자 메모리와 디스크 간 입출력가속 방법 | |
JPH06187229A (ja) | メモリ制御回路 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20070117 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20070130 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20070228 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 3926795 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110309 Year of fee payment: 4 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110309 Year of fee payment: 4 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120309 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130309 Year of fee payment: 6 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130309 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140309 Year of fee payment: 7 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
EXPY | Cancellation because of completion of term |