JP2005129930A - 半導体基盤に活性化不純物の階層構造を提供する方法 - Google Patents
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Abstract
【解決手段】 半導体基盤内の一領域がアモルファス化される。その後本領域には、第一の不純物濃度で第一の不純物が打ち込まれる。その次に固相エピタキシャル再成長ステップが、アモルファス化領域の所望の厚さを持つ薄膜上になされる。その目的は、本薄膜内でのみ第一の不純物を活性化させることである。続いて第二の不純物が、第二の不純物濃度で残留アモルファス領域内に打ち込まれる。続いて半導体基盤のアニールにより、前記残留領域内でのみ第二の不純物が活性化される。
【選択図】図1C
Description
さらにその上、ハロー領域や拡張領域に対する活性化不純物の分布が、多かれ少なかれオーバーラップする(overlap=重なり合う)ことが問題である。十分に輪郭を明確にした濃度分布と10 nm未満の非常に薄い厚さを持つ活性化不純物の膜を得ることは、非常に困難なことである。
例えばアモルファス副領域を形成するために半導体基盤の一部をアモルファス化することによって、半導体基盤がアモルファス副領域を備える方法を提供し、
アモルファス副領域内に第一の不純物を打ち込み、
第一の不純物を打ち込んだ後、固相エピタキシャル再成長により、副領域より小さな境界領域を形成するために、アモルファス副領域の第一の部分内に第一の不純物を活性化し、
第一の不純物を活性化した後、アモルファス副領域の第二の部分内に第二の不純物を打ち込み、そして、
第二の不純物を打ち込んだ後、アモルファス副領域の第二の部分内に第二の不純物を活性化する、ステップを有する方法である。
固相エピタキシャル再成長は、1000 秒未満の活性化時間内に、500℃と800℃との間の温度でなされる。
本発明による方法において、第一の不純物の打ち込みおよび活性化は、半導体基盤内のポケット領域を形成するために使用される。そして第二の不純物の打ち込みおよび活性化は、例えば拡張領域のような、少なくとも部分的にはポケット領域に囲まれている領域を形成するために使用される。
形成された境界領域は、0.5 nmと5 nmとの間、好ましくは1 nmと3 nmとの間、の厚さtを持っている。
最初の不純物の打ち込みは、第一の不純物の濃度を境界領域内で最高となるようなされる。
境界領域は、例えばポケット状のもしくはハロー状の外形を持っている。
境界領域は、半導体基盤の前記境界領域の境界において、2 nm当たり10倍の濃度変化より高い濃度の急峻な遷移を持っている。
半導体装置は、制御電極と第一および第二の主電極構造を含む。少なくとも主電極構造の一つは、前述のように、半導体基盤の副領域内に作られる。
本発明に関するこれらあるいはその他の特性、特徴そして有利な点は、後述する詳細な説明で明らかになる。そこでは従属する図面と連携して説明され、一例として本発明の原理が図示される。本記述は、本発明の適用範囲を限定することなく、実施例のためだけに提供される。以下で引用された参照記号は、添付の図面に関係している。
さらに、第一の、第二の、第三のというような語句、および明細書や特許請求の範囲にある同類の語句は、同じような要素間の区別のために使用されており、連続的な順番や年代順を記述するために必要としているものではない。このように使用されている語句は、適切な状況のもとでは交換可能であり、そして本文中に記述された発明の具体例は、本文中に記述されあるいは図示されたものとは異なる順番で動作可能であることには注意する必要がある。
さらにその上、最上部、最下部、上部、下部というような語句、および明細書や特許請求の範囲にある同類の語句は、記述された目的のために使用されており、相対的位置関係を記述するために必要としているものではない。このように使用されている語句は適切な状況のもとでは交換可能であり、そして本文中に記述された発明の具体例は、本文中に記述されあるいは図示されたものとは異なる方向で動作可能であるということには注意を要する。
以下で記述するように本発明の方法は、制御電極としてのゲート、そして第一および第二の主電極としてのソースおよびドレインを含む装置の製造に対して記述される。本実施例は説明の容易さを優先して選定されており、発明に対して限定することを意図するものではない。図1Aから図1Cは、MOSFET装置に関する本発明の一具体例に従う製造の異なるステップを図示している。本MOSFET装置は、ソース拡張領域2とドレイン拡張領域3、そして前記ソースおよびドレイン拡張領域2、3の周囲のポケット領域あるいはハロー領域4、5の形の境界領域、を有する。記述される具体例では、ポケット領域あるいはハロー領域4、5の形成は一例として選ばれている。しかしながら活性化不純物が十分局所化し薄膜化したような、他の構成を持つ境界領域が、本発明の方法を使用することによりまた形成されてもよい。
PAIは、打ち込む深さを一定に制御することが十分可能な方法である。それに加えて、原子もしくはさらに厳密にはイオンが、半導体基盤1の本来は完全な結晶格子を崩壊しアモルファス化するのに十分な濃度で打ち込まれる。適切な角度のもとで結晶格子に衝撃を与える(bombard)ことによるアモルファス化のステップは、衝撃を与える間に使用される加速イオンの一部が半導体基盤1に最も近いゲート電極7の一部を通過することを保証し、結果として半導体基盤1内にゲート電極7にオーバーラップしたようなアモルファス化領域8、9を形成する。
本PAIは所望の不純物、その不純物量、その打ち込みエネルギーでもって、そして所望の打ち込み角度βのもとでなされる。本打ち込み角度は、半導体基盤1の平面に直角方向に関する角度として図示される。具体的には図1Bの中で点線により示される。PAIで使用される不純物の例としては、ゲルマニウム、キセノン、アンチモン、アルゴンが使用される。PAIで使用される不純物量、エネルギー、角度、および特に不純物の深さについては、形成する構成に対し必要に応じて選択される。例えばゲルマニウムPAIのある特定の場合、20 keV、5.10e14 atoms/cm3、および0 度から45 度の間の角度の条件で、打ち込みが行われる。さらに不純物の選択は、半導体基盤1に使用される半導体材料に依存する。
SPERの動作時間は、動作温度、不純物量、そして特に活性化されるべき膜の所望の厚さ、すなわち本具体例ではポケット領域4、5の厚さt、に依存する。本動作時間は例えば0.5 秒と1000 秒との間である。好ましくは活性化時間は例えば5 秒より短い方がよい。このような短い活性化時間を選択することにより、活性化される領域の周囲の材料および構成に及ぼす不利な効果は、高度に回避される。特にソースポケット領域4とドレインポケット領域5の両方または片方が、0.5 nmと5 nmとの間、好ましくは1 nmと3 nmとの間、の厚さtを持っているのがよい。十分によく輪郭を明確にした活性化不純物の分布を持つこのような厚さのポケット領域4、5は、例えば非常に小さなMOSFET装置に対し、非常に有効である。例えば、1 nmないし3 nm厚の不純物分布を持つ膜の十分な再成長と活性化は、600℃の温度および1 秒から5 秒の間の時間で到達される。
図1Cに関して、実際の事例では若干角を落とされたような構成になっていることに注意を要する。例えばポケット領域4、5と拡張領域2、3の両方とも、例えば徐々に変化する効果により、ゲート電極7からわずかに曲がっている。しかしながら、このことは、装置の働きに対して不利益になるものではない。
同図において、d=0とd=d1との間の図の部分は拡張領域2に相当し、d=d1とd=d2との間の部分はポケット領域4に相当する。拡張領域2における濃度および活性化は非常に高いということが見て取れる。また例えばLTAもしくはSPERのように選ばれたアニール方法により、高い値や低い値が可能である。拡張領域2における第二の不純物の高濃度間の推移は、ポケット領域4における第一の不純物のより低濃度へと非常に急峻に遷移する、という点には注意を要する。事実、ポケット領域4における活性化された第二の不純物の濃度は、実質は無視できる程度である。
さらに本発明の方法は、ポケット領域以外の構成を持つ境界領域を有する半導体装置の製造に対して適用される。
以上の説明で参照したすべての図において、同じ参照記号は同じあるいは類似した要素に関係している。
2 ソース拡張領域
3 ドレイン拡張領域
4 境界領域、またはポケット領域もしくはハロー領域
5 境界領域、またはポケット領域もしくはハロー領域
6 ゲート絶縁膜
7 ゲート電極
8 アモルファス化領域
9 アモルファス化領域
Claims (7)
- 半導体基盤(1)内に活性化された不純物の階層構造を形成する方法であって、
少なくとも一つのアモルファス副領域を含む半導体基盤(1)を形成し、
前記アモルファス副領域内に第一の不純物を打ち込み、
第一の不純物を打ち込んだ後、前記副領域より小さい境界領域(4、5)を形成するための前記アモルファス副領域の第一の部分、および依然としてアモルファスのままである前記アモルファス副領域の第二の部分、のそれぞれの中で前記第一の不純物を固相エピタキシャル再成長によって活性化させ、
第一の不純物を活性化した後、前記アモルファス副領域の前記第二の部分内に第二の不純物を打ち込み、
第二の不純物を打ち込んだ後、前記アモルファス副領域の前記第二の部分内で第二の不純物を活性化する、
ステップを有することを特徴とする方法。 - 第二の不純物を活性化するステップは、固相エピタキシャル再成長またはレーザ熱アニールのいずれかによってなされることを特徴とする、請求項1記載の方法。
- 特定のまたはそれぞれの固相エピタキシャル再成長は、1000 秒未満の活性化時間内に500℃と800℃との間の温度でなされることを特徴とする、請求項1または2記載の方法。
- 活性化時間は、5 秒未満であることを特徴とする、請求項3記載の方法。
- 第一の不純物を打ち込み活性化するステップは、半導体基板(1)内のポケット領域(4、5)を形成するためになされ、第二の不純物を打ち込み活性化するステップは、ポケット領域(4、5)によって少なくとも部分的に囲まれた拡張領域(2、3)を形成するためになされることを特徴とする、請求項1から4のいずれかに記載の方法。
- 境界領域(4、5)は、0.5 nmと5 nmとの間、好ましくは1 nmと3 nmとの間の厚さであることを特徴とする、請求項1から5のいずれかに記載の方法。
- 第一の不純物の打ち込みは、境界領域(4、5)内で第一の不純物の濃度が最高値を与えるようになされることを特徴とする、請求項1から6のいずれかに記載の方法。
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