JP2005043397A - 表示パネルの駆動装置 - Google Patents
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Abstract
【解決手段】表示パネルの画素を担う放電セルを繰り返し維持放電せしめるべく表示パネルの行電極に繰り返し印加される維持パルス各々の内の最終の維持パルスの立ち下がり区間は、電圧値が緩やかに低下する第1電圧低下区間と、この第1電圧低下区間に後続して電圧値が所定期間に亘り一定となる電圧一定区間と、この電圧一定区間に後続して第1電圧低下区間におけるよりも緩やかに電圧値が低下する第2電圧低下区間と、からなる。
【選択図】 図7
Description
【発明が属する技術分野】
本発明は、容量性の放電セルを備えた表示パネルの駆動装置に関する。
【0002】
【従来の技術】
現在、薄型の表示デバイスとして交流放電型のプラズマディスプレイパネルを搭載したプラズマディスプレイ装置が知られている。
交流放電型のプラズマディスプレイパネル(以下、PDPと称する)は、複数の列電極と、放電ガスが封入されている放電空間を挟んで上記列電極各々と交叉して配列された複数の行電極対を備えている。そして、この放電空間を含む各行電極対と列電極との各交差部に、その放電時において赤色で発光する放電セル、緑色で発光する放電セル、又は青色で発光する放電セルが形成されている。
【0003】
この際、各放電セルは、放電現象を利用して発光を行うものである為、所定の輝度で発光する「点灯状態」と、「消灯状態」の2つの状態しかもたない。つまり、2階調分の輝度しか表現出来ないのである。そこで、このような放電セルを用いて、入力された映像信号に対応した中間調の輝度表示を実現させるべく、サブフィールド法を用いた階調駆動を実施する(例えば、特許文献1参照)。
【0004】
サブフィールド法では、1フィールドの表示期間をN個のサブフィールドに分割し、各サブフィールドに、放電セルを連続して発光(又は消灯)させるべき期間を予め割り付けておく。そして、各サブフィールド毎に放電セル各々をそのサブフィールドに割り当てられている期間だけ、入力映像信号に応じて発光、又は消灯させるのである。これにより、1フィールド表示期間内において発光を実施させるサブフィールドの組み合わせにより、2N(N:サブフィールドの数)段階(以下、階調と称する)で各種の中間輝度を表現することが可能となる。
【0005】
ここで、上記サブフィールド法に基づく階調駆動を実施するにあたり、駆動装置(図示せぬ)は、PDPに対して各種駆動パルスを印加することにより、放電セルの各々に種々の放電を生起させる。すなわち、先ず、駆動装置は、PDPの行電極対にリセットパルスを印加することにより、全ての放電セルにリセット放電を生起させる。この際、上記リセット放電により、所定量の壁電荷が全放電セル内に一様に形成される。次に、駆動装置は、放電セルを1水平走査ライン(以下、1表示ラインと称する)分ずつ順次、入力映像信号に応じて選択的に消去放電させる。この際、選択消去放電の生起された放電セルではその放電セル内に残留していた壁電荷が消滅する。一方、上記選択消去放電の生起されなかった放電セルでは、上記リセット放電によって形成された壁電荷がそのまま残留することになる。次に、駆動装置は、全ての行電極対間に交互に、かつ一斉に各サブフィールドに対応した回数だけ維持パルスを印加する。かかる維持パルスの印加に応じて、壁電荷が残留している放電セルのみがサブフィールドに対応した期間だけ繰り返し維持放電し、この維持放電に伴う発光の状態を維持する。
【0006】
ところが、PDPでは、パネルの温度変動、表示輝度の推移、経年変化等によって、上述した如き各種放電によって形成される壁電荷の量が一定とはならなくなる為、放電の強度にバラツキが生じて表示品質が劣化するという問題があった。
【0007】
【特許文献1】
特開2000−338932号公報
【0008】
【発明が解決しようとする課題】
本発明は、上記の問題を解決するためになされたものであり、常時、良好な画像表示を行うことが出来る表示パネルの駆動装置を提供することを目的とする。
【0009】
【課題を解決するための手段】
請求項1記載による表示パネルの駆動装置は、表示ラインに対応した複数の行電極と前記行電極各々に交叉して配列された複数の列電極とを有し前記行電極及び前記列電極の各交差部に画素を担う容量性の放電セルが形成されている表示パネルを、入力映像信号の各フィールドを構成する複数のサブフィールド毎に駆動する表示パネルの駆動装置であって、前記サブフィールド各々において前記行電極に走査パルスを印加すると共に前記入力映像信号に対応した画素データパルスを前記列電極に印加することにより前記放電セルの各々を選択的に放電せしめて前記放電セルを点灯モード又は消灯モードのいずれか一方に設定するアドレス手段と、前記サブフィールド各々において前記行電極に繰り返し維持パルスを印加することにより前記点灯モードにある前記放電セルのみを繰り返し維持放電せしめる発光維持手段と、を有し、前記サブフィールド内において前記行電極に印加される前記維持パルス各々の内の最終の維持パルスの電圧値の立ち下がり区間は、前記電圧値が緩やかに低下する第1電圧低下区間と、前記第1電圧低下区間に後続して前記電圧値が所定期間に亘り一定となる電圧一定区間と、前記電圧一定区間に後続して前記第1電圧低下区間におけるよりも緩やかに電圧値が低下する第2電圧低下区間と、からなる。
【0010】
【発明の実施の形態】
以下、本発明の実施例を図面を参照しつつ詳細に説明する。
図1は、表示パネルとしてプラズマディスプレイパネルを搭載したプラズマディスプレイ装置の概略構成を示す図である。
図1において、プラズマディスプレイパネルとしてのPDP10は、m個の列電極D1〜Dmと、これら列電極各々と交叉して配列された夫々n個の行電極X1〜Xn及び行電極Y1〜Ynを備えている。これら行電極X1〜Xn及び行電極Y1〜Ynは、夫々一対の行電極Xi(1≦i≦n)及びYi(1≦i≦n)にて、PDP10における第1表示ライン〜第n表示ラインを担っている。列電極Dと、行電極X及びYとの間には、放電ガスが封入されている放電空間が形成されている。そして、この放電空間を含む各行電極対と列電極との各交差部に、容量性の放電セルが形成される構造となっている。
【0011】
A/D変換器1は、駆動制御回路2から供給されたクロック信号に応じてアナログの入力映像信号をサンプリングし、これを各画素に対応した例えば4ビットの画素データPDに変換する。画素駆動データ生成回路30は、4ビットの画素データPDを、図2に示す如きデータ変換テーブルに従って14ビットの画素駆動データGDに変換し、これをメモリ4に供給する。メモリ4は、4ビットの画素駆動データGDを順次取り込んで記憶する。そして、1画像フレーム(n行×m列)分の画素駆動データGD1,1〜GDn,mの書き込みが終了する度に、メモリ4は、画素駆動データGD1,1〜GDn,m各々を各ビット桁(第1〜第14ビット)毎に分離し、夫々、後述するサブフィールドSF1〜SF14に対応させて1表示ライン分ずつ読み出す。メモリ4は、読み出した1表示ライン分(m個)の画素駆動データビットを画素駆動データビットDB1〜DB(m)としアドレスドライバ6に供給する。
【0012】
駆動制御回路2は、上記入力映像信号中の水平及び垂直同期信号に同期して、上記A/D変換器1に対するクロック信号、及びメモリ4に対する書込・読出信号を発生する。更に、駆動制御回路2は、かかる水平及び垂直同期信号に同期して、アドレスドライバ6、第1サスティンドライバ7及び第2サスティンドライバ8各々を駆動制御すべき各種タイミング信号を発生する。
【0013】
アドレスドライバ6は、メモリ4から読み出された1表示ライン分毎の画素駆動データビットDB各々の論理レベルに対応した電圧を有するm個の画素データパルスの各々を列電極D1〜Dmに夫々印加する。第1サスティンドライバ7及び第2サスティンドライバ8は、PDP10の放電セル各々に各種の放電を生起させるべき各種駆動パルスを発生して、PDP10の行電極X1〜Xn及びY1〜Ynに印加する。駆動制御回路2は、図3に示す如き発光駆動フォーマットに従ってPDP10を階調駆動すべく、各種スイッチング信号SW(後述する)を、アドレスドライバ6、第1サスティンドライバ7及び第2サスティンドライバ8各々に供給する。
【0014】
尚、図3に示される発光駆動フォーマットでは、1フィールドの表示期間を14個のサブフィールドSF1〜SF14に分割し、各サブフィールドにおいてPDP10を駆動する。この際、各サブフィールド内ではアドレス行程Wc及び発光維持行程Icを実施し、先頭のサブフィールドSF1内においてのみで一斉リセット行程Rcを実行する。又、最後尾のサブフィールドSF14においてのみで消去行程Eを実施する。
【0015】
図4は、上記一斉リセット行程Rc、アドレス行程Wc、発光維持行程Ic及び消去行程Eにおいて上記アドレスドライバ6、第1サスティンドライバ7及び第2サスティンドライバ8各々がPDP10に印加する各種駆動パルスと、その印加タイミングを示す図である。
先ず、先頭のサブフィールドSF1において実施される一斉リセット行程Rcでは、第1サスティンドライバ7及び第2サスティンドライバ8各々が、PDP10の行電極X1〜Xn及びY1〜Yn各々に対して図4に示す如き波形を有する第1リセットパルスRPx1及びRPY1を同時に印加する。これにより、PDP10中の全ての放電セルがリセット放電されて、各放電セル内には一様に所定量の壁電荷が形成される。そして、上記第1リセットパルスRPx1及びRPY1の印加直後、第1サスティンドライバ7は、図4に示す如き第2リセットパルスRP2を行電極X1〜Xnの各々に同時印加する。更に、この第2リセットパルスRP2の印加直後、第2サスティンドライバ8は、図4に示す如き第3リセットパルスRP3を行電極Y1〜Ynの各々に同時印加する。この際、上記第2リセットパルスRP2及び第3リセットパルスRP3が印加される度に、各放電セルにリセット放電が生起され、その放電空間内には所望量のプライミング粒子が形成される。かかる一斉リセット行程Rcにより、全ての放電セル内には一様に壁電荷が形成され、全放電セルが点灯モードに初期化される。
【0016】
次に、アドレス行程Wcでは、アドレスドライバ6は、メモリ4から供給された1表示ライン分の画素駆動データビットDB1〜DB(m)各々の論理レベルに応じたm個の画素データパルスを生成し、これらm個の画素データパルスからなる画素データパルス群DPを列電極D1〜Dmに印加する。
例えば、アドレスドライバ6は、サブフィールドSF1のアドレス行程Wcでは、先ず、第1表示ラインに対応した画素駆動データビットDB1〜DB(m)各々に基づくm個の画素データパルスからなる画素データパルス群DP1を列電極D1〜Dmに印加する。次に、アドレスドライバ6は、第2表示ラインに対応した画素駆動データビットDB1〜DB(m)各々に対応したm個の画素データパルスからなる画素データパルス群DP2を列電極D1〜Dmに印加する。以降、アドレスドライバ6は、第3表示ライン〜第n表示ライン各々に対応した画素データパルス群DP3〜DP(n)を図4に示す如く順次、列電極D1〜Dmに印加して行く。尚、アドレスドライバ6は、画素駆動データビットDBが論理レベル0である場合には低電圧(0ボルト)、論理レベル1である場合には高電圧の画素データパルスを生成する。
【0017】
更に、上記アドレス行程Wcでは、第2サスティンドライバ8が、各画素データパルス群DPの印加タイミングと同一タイミングにて、図4に示されるが如き走査パルスSPを発生してこれを行電極Y1〜Ynへと順次印加して行く。この際、走査パルスSPが印加された行電極と、高電圧の画素データパルスが印加された列電極との交差部の放電セルにのみ選択的に放電(選択消去放電)が生じ、その放電セル内に残存していた壁電荷が消去される。ここで、上記選択消去放電が生起されて壁電荷を失った放電セルは消灯モードに遷移する。一方、上記選択消去放電の生起されなかった放電セル内には壁電荷が残留したままとなるので、この放電セルは点灯モードの状態を維持する。
【0018】
すなわち、アドレス行程Wcの実行により、画素データに応じて各放電セルが点灯モード又は消灯モードのいずれか一方に設定される、いわゆる画素データの書き込みが為されるのである。
次に、サブフィールドSF1〜SF14各々の発光維持行程Icでは、第1サスティンドライバ7及び第2サスティンドライバ8が行電極X1〜Xn及びY1〜Ynに対して図4に示されるように交互に維持パルスIPX及びIPYを繰り返し印加する。尚、かかる発光維持行程Icにおいて印加する維持パルスIPの回数は、図3に示されるように各サブフィールド毎に異なる。
【0019】
すなわち、サブフィールドSF1の発光維持行程Icでの維持パルスIPの印加回数を「1」とした場合、
SF1:1
SF2:3
SF3:5
SF4:8
SF5:10
SF6:13
SF7:16
SF8:19
SF9:22
SF10:25
SF11:28
SF12:32
SF13:35
SF14:39
なる回数比となるように、各サブフィールドの発光維持行程Icでの維持パルスIPの印加回数が設定されている。
【0020】
この際、壁電荷が残留したままとなっている放電セル、すなわち上記アドレス行程Wcにおいて点灯モードに設定された放電セルのみが、上記維持パルスIPX及びIPYが印加される度に維持放電し、各サブフィールド毎に割り当てられた放電回数分だけ、その維持放電に伴う発光状態を維持する。尚、各発光維持行程Ic内において最後に生起される維持放電は、次のサブフィールドのアドレス行程Wcでの選択消去放電を適切に生起させるべく、各放電セル内に残留する壁電荷の量を適量に調整する役目をも担っている。
【0021】
ここで、各放電セルがアドレス行程Wcにおいて点灯モード又は消灯モードのいずれに設定されるのかは、入力映像信号に基づいて生成された上記画素駆動データGDによって決まる。この際、14ビットの画素駆動データGDとして取り得るパターンは、図2に示されるが如き15パターンである。図2に示す如き15パターン分の画素駆動データGDは、その第1ビット〜第14ビット各々の内で論理レベル1となるビットが必ず1つ以下となる。従って、かかる画素駆動データGDを用いた駆動によれば、図2の黒丸印にて示すように、サブフィールドSF1〜SF14の内の1つのサブフィールドでのアドレス行程Wcにおいてのみで選択消去放電が生起される。すなわち、一斉リセット行程RcによってPDP10の全放電セル内に形成された壁電荷は、上記選択消去放電が生起されるまで残留する。つまり、各放電セルは1フィールド期間内において上記選択消去放電が為されるまでの間、点灯モードの状態を保持し、その間に存在するサブフィールド各々の発光維持行程Ic(白丸にて示す)において連続して維持放電発光するのである。
【0022】
そして、最後尾のサブフィールドSF14のみで実施される消去行程Eでは、アドレスドライバ6が、消去パルスAPを発生してこれを列電極D1−mの各々に印加する。更に、第2サスティンドライバ8は、かかる消去パルスAPの印加タイミングと同時に消去パルスEPを発生してこれを行電極Y1〜Yn各々に印加する。これら消去パルスAP及びEPの同時印加により、PDP10における全放電セル内において消去放電が生起され、全ての放電セル内に残存している壁電荷が消滅する。
【0023】
従って、図2に示す如き15パターンからなる画素駆動データGDを用いて図3に示す発光駆動フォーマットに従った駆動を実施すれば、
{0、1、4、9、17、27、40、56、75、97、122、150、182、217、255}
なる15段階分の中間輝度が表現可能となり、PDP10の画面上には入力映像信号に対応した表示画像が表れることになる。
【0024】
図5は、上記リセットパルスRP、走査パルスSP、維持パルスIP及び消去パルスEPを発生する第1サスティンドライバ7及び第2サスティンドライバ8各々の内部構成を示す図である。
図5に示すように、第1サスティンドライバ7には、上記リセットパルスRPXを発生するリセットパルス発生回路RX、及び上記維持パルスIPXを発生する維持パルス発生回路IXが設けられている。
【0025】
リセットパルス発生回路RXは、直流の電圧VRを発生する直流電源B2、スイッチング素子S7、及び抵抗R1から構成される。直流電源B2の正極端子はアース電位に設定されており、その負極端子は上記スイッチング素子S7に接続されている。スイッチング素子S7は、駆動制御回路2から供給されたスイッチング信号SW7が論理レベル1である期間中に限りオン状態となり、直流電源B2の負極端子の電圧(−VR)を抵抗R1を介して行電極Xに印加する。
【0026】
維持パルス発生回路IXは、直流の電圧VSを発生する直流電源B1、スイッチング素子S1〜S4、コイルL1及びL2、ダイオードD1及びD2、及びコンデンサC1から構成される。スイッチング素子S1は、駆動制御回路2から供給されたスイッチング信号SW1が論理レベル1である期間中に限りオン状態となり、コンデンサC1の一方の電極端子の電圧をコイルL1、ダイオードD1を介して行電極Xに印加する。スイッチング素子S2は、駆動制御回路2から供給されたスイッチング信号SW2が論理レベル1である期間中に限りオン状態となり、行電極X上の電圧をコイルL2、及びダイオードD2を介してコンデンサC1の一方の電極端子に印加する。スイッチング素子S3は、駆動制御回路2から供給されたスイッチング信号SW3が論理レベル1である期間中に限りオン状態となり、上記直流電源B1が発生した電圧VSを行電極Xに印加する。スイッチング素子S4は、駆動制御回路2から供給されたスイッチング信号SW4が論理レベル1である期間中に限りオン状態となり、行電極Xをアース電位に設定する。
【0027】
一方、第2サスティンドライバ8には、図5に示す如きリセットパルスRPYを発生するリセットパルス発生回路RY、上記走査パルスSPを発生する走査パルス発生回路SY、及び上記維持パルスIPY及びIPYEを発生する維持パルス発生回路IYが設けられている。
リセットパルス発生回路RYは、直流の電圧VRを発生する直流電源B4、スイッチング素子S15〜S17、ダイオードD10、抵抗R2及びR3から構成される。直流電源B4の負極端子は接地されており、その正極端子は上記スイッチング素子S17に接続されている。スイッチング素子S17は、駆動制御回路2から供給されたスイッチング信号SW17が論理レベル1である期間中に限りオン状態となり、直流電源B4の正極端子の電圧VRを抵抗R3を介してライン20上に印加する。ダイオードD10は、そのカソード電極がアース電位に設定されている。抵抗R2の一方の電極端子にはダイオードD10のアノード電極が接続されており、その他方の電極端子にはスイッチング素子S16が接続されている。スイッチング素子S16は、駆動制御回路2から供給されたスイッチング信号SW16が論理レベル1である期間中に限りオン状態となり、抵抗R2の他方の電極端子とライン12とを接続する。
【0028】
維持パルス発生回路IYは、直流の電圧VSを発生する直流電源B3、スイッチング素子S11〜S14、コイルL3及びL4、ダイオードD3及びD4、及びコンデンサC2から構成される。スイッチング素子S11は、駆動制御回路2から供給されたスイッチング信号SW11が論理レベル1である期間中に限りオン状態となり、コンデンサC2の一方の電極端子上の電圧をコイルL3、ダイオードD3を介してライン12上に印加する。スイッチング素子S12は、駆動制御回路2から供給されたスイッチング信号SW12が論理レベル1である期間中に限りオン状態となり、上記ライン12上の電圧をコイルL4、及びダイオードD4を介してコンデンサC2の一方の電極端子に印加する。スイッチング素子S13は、駆動制御回路2から供給されたスイッチング信号SW13が論理レベル1である期間中に限りオン状態となり、上記直流電源B3が発生した電圧VSを上記ライン12上に印加する。スイッチング素子S14は、駆動制御回路2から供給されたスイッチング信号SW14が論理レベル1である期間中に限りオン状態となり、上記ライン12をアース電位に設定する。
【0029】
走査パルス発生回路SYは、行電極Y1〜Yn毎に設けられており、夫々、直流の電圧Vhを発生する直流電源B5、スイッチング素子S21、S22、ダイオードD5及びD6から構成される。スイッチング素子S21は、駆動制御回路2から供給されたスイッチング信号SW21が論理レベル1である期間中に限りオン状態となり、直流電源B5の正極端子と、ダイオードD5のアノード電極を行電極Yに夫々接続する。スイッチング素子S22は、駆動制御回路2から供給されたスイッチング信号SW22が論理レベル1である期間中に限りオン状態となり、直流電源B5の負極端子と、ダイオードD6のカソード電極を行電極Yに夫々接続する。駆動制御回路2は、図4に示す如きアドレス行程Wcにおいて、論理レベル0のスイッチング信号SW21及び論理レベル1のスイッチング信号SW22を、行電極Y1〜Yn毎に設けられた走査パルス発生回路SYの各々に対して順次印加する。これにより、直流電源B5の負極端子側の電圧(−Vh)に基づく図4に示す如き負極性の走査パルスSPが順次、行電極Y1〜Ynへと印加されて行く。
【0030】
次に、図5に示される構成による第1リセットパルスRPX1、RPY1、第2リセットパルスRP2、及び第3リセットパルスRP3各々の生成動作について、図6を参照しつつ説明する。
図6において、先ず、駆動制御回路2は、論理レベル1のスイッチング信号SW7をスイッチング素子S7に供給する。この際、スイッチング素子S7はオン状態となり、直流電源B2の負極端子の電圧(−VR)が抵抗R1を介して行電極Xに印加される。これにより、PDP10の負荷容量C0が充電され、行電極X上の電圧は図6に示す如く0ボルトの状態から徐々に低下する。そして、所定期間経過後に、駆動制御回路2は、論理レベル1のスイッチング信号SW4をスイッチング素子S4に供給する。スイッチング素子S4は、論理レベル1のスイッチング信号SW4に応じてオン状態となり、行電極Xをアース電位に設定する。よって、図6に示す如く行電極X上の電圧は急峻に0ボルトに遷移する。
【0031】
よって、上記の如き一連の動作により、その立ち下がりが緩やかであり且つ立ち上がりが急峻な波形を有する図6に示す如き負極性の第1リセットパルスRPx1が生成される。
又、この間、駆動制御回路2は、論理レベル0のスイッチング信号SW15をスイッチング素子S15に供給すると共に、論理レベル1のスイッチング信号SW17をスイッチング素子S17、論理レベル1のスイッチング信号SW21をスイッチング素子S22に夫々供給する。この際、スイッチング素子S17及び21が共にオン状態となり、直流電源B4の正極端子の電圧VRがスイッチング素子S17、抵抗R3、ライン20、及びスイッチング素子S21を介して行電極Yに印加される。これにより、PDP10の負荷容量C0が充電され、行電極Y上の電圧は図6に示す如く0ボルトの状態から徐々に上昇する。そして、所定期間経過後に、前述した如くスイッチング素子S4がオン状態となるので、図6に示す如く行電極Y上の電圧は急峻に0ボルトに遷移する。
【0032】
上記の如き一連の動作により、図6に示す如く、その立ち上がりが緩やかであり且つ立ち下がりが急峻な波形を有するき正極性の第1リセットパルスRPY1が生成される。
次に、駆動制御回路2は、図6に示す如きスイッチングシーケンスSRXに従って状態が推移するスイッチング信号SW1〜SW4を、維持パルス発生回路IXのスイッチング素子S1〜S4に夫々供給する。かかるスイッチングシーケンスSRXによれば、先ず、スイッチング素子S1のみがオン状態となり、コンデンサC1に蓄えられていた電荷に伴う電流がコイルL1、ダイオードD1、行電極Xを介して放電セルに流れ込む。これにより、行電極X上の電圧は図6に示す如く徐々に上昇して行く。次に、スイッチング素子S3のみがオン状態となり、直流電源B1の正極端子の電圧VSが直に行電極Xに印加される。これにより、行電極X上の電圧は図6に示す如く電圧VSとなる。次に、スイッチング素子S2のみがオン状態となり、行電極X及びY間の負荷容量C0に蓄えられていた電荷に伴う電流がコイルL2、ダイオードD2を介してコンデンサC1に流れ込む。これにより、行電極X上の電圧は図6に示す如く徐々に低下して行く。
【0033】
よって、スイッチングシーケンスSRXによれば、図6に示す如く、その立ち上がり及び立ち下がりが共に緩やかな波形を有する正極性の第2リセットパルスRP2が生成される。
この際、かかる第2リセットパルスRP2に応じて行電極X上の電圧が0ボルトから電圧VSに推移するとリセット放電が生起され、更に、行電極X上の電圧が電圧VSから0ボルトに推移する区間、つまり第2リセットパルスRP2の立ち下がり区間において微弱な放電が生起される。
【0034】
次に、駆動制御回路2は、図6に示す如きスイッチングシーケンスSRYに従って状態が推移するスイッチング信号SW11〜SW14を維持パルス発生回路IYに供給すると共に、このスイッチングシーケンスSRYに従って状態が推移するスイッチング信号SW16をリセットパルス発生回路RYに供給する。
かかるスイッチングシーケンスSRYによれば、先ず、スイッチング素子S11のみがオン状態となり、コンデンサC2に蓄えられていた電荷に伴う電流がコイルL3、ダイオードD3、及び行電極Yを介して放電セルに流れ込む。これにより、行電極Y上の電圧は図6に示す如く徐々に上昇して行く。次に、スイッチング素子S13のみがオン状態となり、直流電源B3の正極端子の電圧VSが直に行電極Yに印加される。これにより、行電極Y上の電圧は図6に示す如く電圧VSと等しくなる。次に、スイッチング素子S12のみがオン状態となり、行電極X及びY間の負荷容量C0に蓄えられていた電荷に伴う電流がコイルL4、ダイオードD4を介してコンデンサC2に流れ込む。この際、コンデンサC2の充電動作により、行電極Y上の電圧は図6に示す如く徐々に低下して行く(第1電圧低下区間Tb1)。次に、スイッチング素子S11〜S14及びS16の全てが所定期間に亘りオフ状態に設定される。これにより、ライン12がハイインピーダンス状態となり、この間、行電極Y上の電圧は図6に示す如く一定となる(電圧一定区間Tb2)。次に、スイッチング素子S16のみがオン状態となる。これにより、抵抗R2及びダイオードD10を介して行電極Yがアース電位に設定されるので、行電極Y上の電圧は再び緩やかに低下して0ボルトに到る(第2電圧低下区間Tb3)。尚、第2電圧低下区間Tb3では、第1電圧低下区間Tb1よりも電圧値の変化率が小である。つまり、第2電圧低下区間Tb3では、第1電圧低下区間Tb1よりも緩やかに電圧が低下して行く。
【0035】
よって、スイッチングシーケンスSRYによれば、図6に示す如く、その立ち上がり及び立ち下がりが共に緩やかな波形を有する正極性の第3リセットパルスRP3が生成される。この際、第3リセットパルスRP3における電圧の立ち下がり区間での変化率は、その直前に印加される第2リセットパルスRP2における立ち下がり区間での変化率よりも低い。つまり、一斉リセット行程Rcの最終で印加される第3リセットパルスRP3の電圧値の立ち下がり波形は、その直前に印加される第2リセットパルスRP2における立ち下がり波形よりも緩やかである。
【0036】
ここで、かかる第3リセットパルスRP3が全ての行電極Y上に印加されると、全放電セル内において第3のリセット放電が生起され、その放電空間内にプライミング粒子が発生する。更に、第3リセットパルスRP3の立ち下がり区間(Tb1+Tb2+Tb3)において微弱な放電が生起され、この微弱な放電により、放電セル内に形成されている壁電荷の一部が消失する。これにより、放電セル内の壁電荷の量を、アドレス行程Wcにおいて適切に選択放電を生起させ得る程度の所望の量に調整するのである。
【0037】
ところが、パネル温度、発光負荷の大きさ、経年変化等の影響により放電セル内に形成される壁電荷の量が変動してしまうので、各放電セル内における壁電荷の量を所望量に維持させることが困難となる。
そこで、図6に示すように、第3リセットパルスRP3の立ち下がり区間を、電圧が徐々に低下する第1電圧低下区間Tb1と、電圧の低下が停止して所定期間に亘り電圧値が一定となる電圧一定区間Tb2と、第1電圧低下区間Tb1よりも緩やかに電圧が低下する第2電圧低下区間Tb3とで形成させる。この際、上記電圧一定区間Tb2においてリセットパルスRP3の立ち下がり区間での電圧値を所定期間に亘り一定にすることにより壁電荷の状態を安定化させている。これにより、パネル温度、発光負荷の大きさ、経年変化等の影響に拘わらずに、リセットパルスRP3の立ち下がり区間にて各放電セル内の壁電荷の量を、アドレス行程Wcにおいて適切に選択放電を生起させ得る程度の所望の量に調整することが可能となる。
【0038】
よって、パネル温度、発光負荷の大きさ、経年変化等の影響に拘わらずに、アドレス行程における選択放電を正しく生起させることができるので、表示品質の高い画像表示を維持させることが可能となる。
次に、図5に示される構成による維持パルスIPX、IPY、及び各発光維持行程Icにおいて最終に印加される維持パルスIPYE各々の生成動作について、図7を参照しつつ説明する。
【0039】
図7において、駆動制御回路2は、図7に示す如きスイッチングシーケンスSSXに従って状態が推移するスイッチング信号SW1〜SW4を、維持パルス発生回路IXのスイッチング素子S1〜S4に夫々供給する。かかるスイッチングシーケンスSSXによれば、スイッチング素子S4がオフ状態に設定され、この間、先ず、スイッチング素子S1のみがオン状態となり、コンデンサC1に蓄えられていた電荷に伴う電流がコイルL1、ダイオードD1、行電極Xを介して放電セルに流れ込む。これにより、行電極X上の電圧は図7に示す如く徐々に上昇して行く。次に、スイッチング素子S3のみがオン状態となり、直流電源B1の正極端子の電圧VSがスイッチング素子S3を介して行電極Xに印加される。これにより、行電極X上の電圧は図7に示す如く電圧VSに固定される。次に、スイッチング素子S2のみがオン状態となり、行電極X及びY間の負荷容量C0に蓄えられていた電荷に伴う電流がコイルL2、ダイオードD2及びスイッチング素子S2を介してコンデンサC1に流れ込む。これにより、行電極X上の電圧は図7に示す如く徐々に低下して行く。そして、スイッチング素子S4がオン状態に切り替わることにより、行電極X上の電圧は0ボルトになる。
【0040】
よって、スイッチングシーケンスSSXによれば、図6に示す如く、その立ち上がり及び立ち下がりが共に緩やかな波形を有する正極性の維持パルスIPXが生成される。
駆動制御回路2は、上記スイッチングシーケンスSSXに従った制御を、各サブフィールドに割り当てられた発光の回数分だけ周期的に繰り返し実行する。これにより、維持パルス発生回路IXは、図7に示す如き波形を有する維持パルスIPXを図7に示す如く繰り返し発生する。この際、上記維持パルスIPXが印加される度に、点灯モードにある放電セル内に維持放電(図7のDS1にて示す)が生起される。尚、維持パルスIPXの電圧低下時においても、微弱な放電(図7のDS2にて示す)が生起される。
【0041】
又、駆動制御回路2は、図7に示す如きスイッチングシーケンスSSYに従って状態が推移するスイッチング信号SW11〜SW13を維持パルス発生回路IYに供給する。尚、この間、スイッチング素子S15及びS21は、共にオン状態に設定されている。
スイッチングシーケンスSSYでは、先ず、スイッチング素子S11のみがオン状態となり、コンデンサC2に蓄えられていた電荷に伴う電流がコイルL3、ダイオードD3、スイッチング素子S11、S15、S21及び行電極Yを介して放電セルに流れ込む。これにより、行電極Y上の電圧は図7に示す如く徐々に上昇して行く。次に、スイッチング素子S13のみがオン状態となり、直流電源B3の正極端子の電圧VSがスイッチング素子S13、S15、及びS21を介して行電極Yに印加される。これにより、行電極Y上の電圧は図7に示す如く電圧VSと等しくなる。次に、スイッチング素子S12のみがオン状態となり、行電極X及びY間の負荷容量C0に蓄えられていた電荷に伴う電流が行電極Y、スイッチング素子S21、S15、コイルL4、ダイオードD4及びスイッチング素子S12を介してコンデンサC2に流れ込む。この際、コンデンサC2の充電動作により、行電極Y上の電圧は図7に示す如く徐々に低下して行く。よって、スイッチングシーケンスSSYによれば、図7に示す如く、その立ち上がり及び立ち下がりが共に緩やかな波形を有する正極性の維持パルスIPYが生成される。
【0042】
駆動制御回路2は、上記スイッチングシーケンスSSYに従った制御を図7に示す如く、周期的に繰り返し実行する。これにより、維持パルス発生回路IYは、図7に示す如き波形を有する維持パルスIPYを繰り返し発生する。この際、上記維持パルスIPYが印加される度に、点灯モードにある放電セル内に維持放電が生起される。尚、維持パルスIPYの電圧低下時においても微弱な放電が生起される。
【0043】
ただし、各発光維持行程Icにおいて最終の維持パルスIPYEを生成する際には、駆動制御回路2は、図7に示す如きスイッチングシーケンスSSYEに従って状態が推移するスイッチング信号SW11〜SW14を維持パルス発生回路IYに供給し、スイッチング信号SW16をリセットパルス発生回路RYに供給する。
【0044】
スイッチングシーケンスSSYEでは、スイッチング素子S14がオフ状態に設定され、この間、先ず、スイッチング素子S11のみがオン状態となり、コンデンサC2に蓄えられていた電荷に伴う電流がコイルL3、ダイオードD3、スイッチング素子S11、S15、S21及び行電極Yを介して放電セルに流れ込む。これにより、行電極Y上の電圧は図7に示す如く徐々に上昇して行く。次に、スイッチング素子S13のみがオン状態となり、直流電源B3の正極端子の電圧VSがスイッチング素子S13、S15、及びS21を介して行電極Yに印加される。これにより、行電極Y上の電圧は図7に示す如く電圧VSと等しくなる。次に、スイッチング素子S12のみがオン状態となり、行電極X及びY間の負荷容量C0に蓄えられていた電荷に伴う電流が行電極Y、スイッチング素子S21、S15、コイルL4、ダイオードD4及びスイッチング素子S12を介してコンデンサC2に流れ込む。この際、コンデンサC2の充電動作により、行電極Y上の電圧は図7に示す如く徐々に低下して行く(第1電圧低下区間Tb1)。次に、スイッチング素子S11〜S14及びS16の全てが所定期間に亘りオフ状態に設定される。これにより、ライン12がハイインピーダンス状態となり、この間、行電極Y上の電圧は図7に示す如く一定となる(電圧一定区間Tb2)。次に、スイッチング素子S16のみがオン状態となる。これにより、スイッチング素子S21、S15、S16、抵抗R2及びダイオードD10を介して行電極Yがアース電位に設定されるので、行電極Y上の電圧は再び緩やかに低下して0ボルトに到る(第2電圧低下区間Tb3)。尚、第2電圧低下区間Tb3では、第1電圧低下区間Tb1よりも電圧値の変化率が小である。つまり、第2電圧低下区間Tb3では、第1電圧低下区間Tb1よりも緩やかに電圧が低下して行く。
【0045】
よって、スイッチングシーケンスSSYEによれば、図7に示す如く、その立ち上がり及び立ち下がりが共に緩やかな波形を有する正極性の維持パルスIPYEが生成される。この際、維持パルスIPYEにおける電圧立ち下がり区間での変化率は、その直前に印加される維持パルスIPにおける立ち下がり区間での変化率よりも低い。つまり、発光維持行程Icの最終で印加される維持パルスIPYEの電圧値の立ち下がり波形は、その直前に印加される維持パルスIPにおける立ち下がり波形よりも緩やかなのである。
【0046】
ここで、上記維持パルスIPYEに応じて各発光維持行程Icでの最終の維持放電(図7のDS1にて示す)が生起され、更に、この維持パルスIPYEの立ち下がり区間において微弱な放電が生起される(図7のDS2にて示す)。この微弱な放電により、放電セル内に形成されている壁電荷の一部が消失され、放電セル内の壁電荷の量が、一斉リセット行程Rcにて適切に第1リセット放電を生起させ得る所望の量に調整される。
【0047】
ところが、パネル温度、発光負荷の大きさ、経年変化等の影響により放電セル内に形成される壁電荷の量が変動してしまうので、各放電セル内における壁電荷の量を所望量に維持させることが困難となる。
そこで、図7に示すように、最終の維持パルスIPYEの立ち下がり区間を、電圧が徐々に低下する第1電圧低下区間Tb1と、電圧の低下が停止して所定期間に亘り電圧値が一定となる電圧一定区間Tb2と、第1電圧低下区間Tb1よりも緩やかに電圧が低下する第2電圧低下区間Tb3とで形成させる。この際、上記電圧一定区間Tb2において維持パルスIPYEの立ち下がり区間での電圧値を所定期間に亘り一定にすることにより壁電荷の状態を安定化させている。これにより、パネル温度、発光負荷の大きさ、経年変化等の影響に拘わらずに、最終の維持パルスIPYEの立ち下がり区間にて、各放電セル内の壁電荷の量を、一斉リセット行程Rcにおいて適切に第1リセット放電を生起させ得る程度の所望の量に調整することが可能となる。
【0048】
よって、パネル温度、発光負荷の大きさ、経年変化等の影響に拘わらずに、リセット放電を正しく生起させることができるので、表示品質の高い画像表示を維持させることが可能となる。
尚、上記実施例においては、サブフィールド法に基づく階調駆動として、図2〜図4に示す如き階調駆動方法を採用しているが、本発明が適用される階調駆動方法としてはこれに限定されるものではない。
【0049】
又、上記実施例においては、サブフィールド法として、予め全放電セル内に壁電荷を形成させておき(一斉リセット行程Rc)、各放電セル内の壁電荷を入力映像信号に応じて選択的に消去する(アドレス行程Wc)、いわゆる選択消去アドレス法を採用している。しかしながら、本発明は、サブフィールド法として、予め全放電セル内の壁電荷を消滅させておき、入力映像信号に応じて各放電セル内に選択的に壁電荷を形成させる、いわゆる選択書込アドレス法を採用したものにも同様に適用可能である。
【図面の簡単な説明】
【図1】本発明によるプラズマディスプレイ装置の概略構成を示す図である。
【図2】画素駆動データ生成回路30のデータ変換テーブル、及び1フィールド表示期間内での発光駆動パターンの一例を示す図である。
【図3】発光駆動フォーマットの一例を示す図である。
【図4】PDP10に印加される各種駆動パルスと、その印加タイミングの一例を示す図である。
【図5】図1に示す第1サスティンドライバ7及び第2サスティンドライバ8各々の内部構成の一例を示す図である。
【図6】PDP10に印加される各種リセットパルスと、リセットパルスを生成する際のスイッチングシーケンスの一例を示す図である。
【図7】PDP10に印加される各種維持パルスと、維持パルスを生成する際のスイッチングシーケンスの一例を示す図である。
【主要部分の符号の説明】
2 駆動制御回路
6 アドレスドライバ
7 第1サスティンドライバ
8 第2サスティンドライバ
10 PDP
Claims (3)
- 表示ラインに対応した複数の行電極と前記行電極各々に交叉して配列された複数の列電極とを有し前記行電極及び前記列電極の各交差部に画素を担う容量性の放電セルが形成されている表示パネルを、入力映像信号の各フィールドを構成する複数のサブフィールド毎に駆動する表示パネルの駆動装置であって、
前記サブフィールド各々において前記行電極に走査パルスを印加すると共に前記入力映像信号に対応した画素データパルスを前記列電極に印加することにより前記放電セルの各々を選択的に放電せしめて前記放電セルを点灯モード又は消灯モードのいずれか一方に設定するアドレス手段と、前記サブフィールド各々において前記行電極に繰り返し維持パルスを印加することにより前記点灯モードにある前記放電セルのみを繰り返し維持放電せしめる発光維持手段と、を有し、
前記サブフィールド内において前記行電極に印加される前記維持パルス各々の内の最終の維持パルスの電圧値の立ち下がり区間は、前記電圧値が緩やかに低下する第1電圧低下区間と、前記第1電圧低下区間に後続して前記電圧値が所定期間に亘り一定となる電圧一定区間と、前記電圧一定区間に後続して前記第1電圧低下区間におけるよりも緩やかに電圧値が低下する第2電圧低下区間と、からなることを特徴とする表示パネルの駆動装置。 - 前記発光維持手段は、前記行電極を前記所定期間に亘りハイインピーダンス状態に設定することにより前記電圧一定区間において前記最終の維持パルスの電圧値を一定にすることを特徴とする請求項1記載の表示パネルの駆動装置。
- 前記サブフィールド各々の内の少なくとも1の先頭において全ての前記行電極各々に所定回数だけ繰り返しリセットパルスを印加することにより全ての前記放電セルを繰り返しリセット放電せしめて前記放電セルの状態を初期化するリセット手段を更に備え、
前記サブフィールド内において前記行電極に繰り返し印加される前記リセットパルス各々の内の最終のリセットパルスの電圧値の立ち下がり区間は、前記電圧値が緩やかに低下する第1電圧低下区間と、前記電圧値が所定期間に亘り一定となる電圧一定区間と、前記第1電圧低下区間よりも緩やかに電圧値が低下する第2電圧低下区間と、からなることを特徴とする請求項1記載の表示パネルの駆動装置。
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