JP2003208122A - プラズマディスプレイパネルの駆動方法 - Google Patents

プラズマディスプレイパネルの駆動方法

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Abstract

(57)【要約】 【目的】 低輝度領域における階調表示能力を向上させ
ることが可能なプラズマディスプレイパネルの駆動方法
を提供する。 【解決手段】 先頭サブフィールドを含み連続する少な
くとも１つのサブフィールドからなるサブフィールド群
の各サブフィールドは、映像信号に応じて放電セルを選
択的に書込放電せしめて点灯放電セルモードに設定する
選択書込アドレス行程を含み、当該サブフィールド群に
後続するサブフィールドは、点灯放電セルモードにある
放電セルのみを当該複数のサブフィールドの重み付けに
応じた回数だけ繰り返し維持放電せしめる発光維持行程
を含み、当該サブフィールド群に後続するサブフィール
ドのうちいずれか１のサブフィールドは、直前のサブフ
ィールドにおいて維持放電がなされた放電セルのみを映
像信号に応じて選択的に消去放電せしめて消灯放電セル
モードに設定する選択消去アドレス行程を有する。

Description

【発明の詳細な説明】
【０００１】
【発明が属する技術分野】本発明は、マトリクス表示方
式のプラズマディスプレイパネルの駆動方法に関する。
【０００２】
【従来の技術】最近、２次元画像表示パネルとして、複
数の放電セルがマトリクス状に配列されたプラズマディ
スプレイパネル（以下、ＰＤＰという）が注目されてい
る。ＰＤＰは、ディジタル映像信号によって直接駆動さ
れ、その表現し得る輝度の階調数は、当該ディジタル映
像信号に基づく各画素毎の画素データのビット数によっ
て決まる。かかるＰＤＰの階調表示方法としては、１フ
ィールドの表示期間を複数のサブフィールドに分割して
各セルを駆動するサブフィールド法が知られている。か
かるプラズマディスプレイパネルの駆動方法としては、
例えば、特開２００１−３１２２４４号公報に開示され
ているものがある。
【０００３】サブフィールド法においては、１フィール
ドの表示期間を複数のサブフィールドに分割する。各サ
ブフィールドは、画素データに応じて各画素を点灯モー
ド、又は消灯モードに設定して行くアドレス期間と、上
記点灯モードにある画素のみをそのサブフィールドの重
み付けに対応した期間だけ実際に点灯（発光）させる発
光維持期間を含んでいる。すなわち、サブフィールド毎
に、そのサブフィールド内において放電セルを発光させ
るか否かの設定が為され（アドレス期間）、点灯モード
に設定された放電セルだけをそのサブフィールドに割り
当てられている期間（発光維持期間）だけ発光させるの
である。従って、１フィールド内では、発光状態となる
サブフィールドと、消灯（非発光）状態となるサブフィ
ールドが混在する場合が生じ、各サブフィールドで実施
された発光期間の総和に応じた中間輝度が視覚されるの
である。
【０００４】図１は、ＰＤＰの発光駆動フォーマットの
一例を模式的に示している。すなわち、映像信号におけ
る１フィールドは、１２個のサブフィールドＳＦ１〜Ｓ
Ｆ１２に分割され、各サブフィールド毎にＰＤＰに対す
る駆動が実施される。この際、各サブフィールドは、入
力映像信号に基づいてＰＤＰの各放電セルを"点灯放電
セルモード"（すなわち、動作可能モード）及び"消灯放
電セルモード"（すなわち、不動作モード）のいずれか
一方に設定するアドレス行程Ｗcと、"点灯放電セルモー
ド"にある放電セルのみを各サブフィールドの重み付け
に対応した期間（回数）だけ発光させる発光維持行程Ｉ
cとからなる。ただし、先頭のサブフィールドＳＦ１に
おいてのみで、ＰＤＰの全放電セルを"点灯放電セルモ
ード"に初期化せしめる一斉リセット行程Ｒcを実行し、
最後尾のサブフィールドＳＦ１２のみで消去行程Ｅを実
行する。
【０００５】図２は、画素データに後述する変換処理を
行うことによって得られる画素駆動データＧＤ、これに
対応する階調及び放電セルの発光駆動パターンを示して
いる。映像信号をサンプリングすることによって、例え
ば８ビットの画素データＰＤが得られる。得られた画素
データは、多階調化処理がなされ、現階調数を維持しつ
つもそのビット数を４ビットに削減した多階調化処理画
素データＰＤSが生成される。多階調化処理画素データ
ＰＤSは、図２に示されるが如き変換テーブルに従って
第１〜第１２ビットからなる画素駆動データＧＤに変換
される。これら第１〜第１２ビットの各々は、上記した
サブフィールドＳＦ１〜ＳＦ１２の各々に対応するもの
である。
【０００６】図３は、図２に示される発光駆動フォーマ
ットに従って、ＰＤＰの行電極及び列電極に印加される
各種駆動パルスの印加タイミングを示す図である。な
お、選択消去法（１リセット１選択消去アドレス法）に
よって駆動がなされる場合を示している。先ず、サブフ
ィールドＳＦ１の一斉リセット行程Ｒcでは、負極性の
リセットパルスＲＰxが行電極Ｘ1〜Ｘnに印加される。
かかるリセットパルスＲＰxの印加と同時に、正極性の
リセットパルスＲＰYが行電極Ｙ1〜Ｙ2に印加される。
これらリセットパルスＲＰx及びＲＰYの印加に応じて、
ＰＤＰの全放電セルがリセット放電し、各放電セル内に
は一様に所定量の壁電荷が形成される。これにより、全
ての放電セルは"点灯放電セルモード"に初期化される。
【０００７】次に、各サブフィールドのアドレス行程Ｗ
cでは、画素駆動データビットＤＢ（ＤＢ１〜ＤＢ１
２）の論理レベルに対応した電圧を有する画素データパ
ルスＤＰを発生する。なお、画素駆動データビットＤＢ
１〜ＤＢ１２は、画素駆動データＧＤの第１〜１２ビッ
ト目に対応する。例えば、サブフィールドＳＦ１のアド
レス行程Ｗｃでは、先ず、上記画素駆動データビットＤ
Ｂ１の内から第１行目に対応した分を抽出し、これらの
論理レベルに対応したｍ個の画素データパルスからなる
画素データパルス群ＤＰ１1を列電極Ｄ1〜Ｄmに印加す
る。画素駆動データビットＤＢ１の第２行目以降につい
ても同様な動作を実行することによって、サブフィール
ドＳＦ１のアドレス行程Ｗcでは、１行分毎の画素デー
タパルス群ＤＰ１i（ＤＰ１1〜ＤＰ１n）を順次列電極
Ｄ1〜Ｄmに印加して行く。
【０００８】更に、アドレス行程Ｗcでは、上述した如
き画素データパルスＤＰの各印加タイミングと同一タイ
ミングにて、負極性の走査パルスＳＰを行電極Ｙ1〜Ｙn
へ順次印加する。この際、走査パルスＳＰが印加された
行電極と、高電圧の画素データパルスが印加された列電
極との交差部の放電セルにのみ放電（選択消去放電）が
生じ、その放電セル内に残存していた壁電荷が選択的に
消去される。
【０００９】かかる選択消去放電により、一斉リセット
行程Ｒcにおいて"点灯放電セルモード"に初期化された
放電セルは、"消灯放電セルモード"に移行する。一方、
上記選択消去放電の生起されなかった放電セルは、上記
一斉リセット行程Ｒcにて初期化された状態、つまり"点
灯放電セルモード"を維持する。次に、各サブフィール
ドの発光維持行程Ｉcにおいては、図３に示すように、
行電極Ｘi（Ｘ1〜Ｘn）及びＹi（Ｙ1〜Ｙn）に対して正
極性の維持パルスＩＰ（ＩＰX及びＩＰY）が交互に印加
される。ここで、発光維持行程Ｉcにおいて、維持パル
スＩＰは、各サブフィールドＳＦ１〜ＳＦ１２毎の維持
パルスＩＰの回数が所定の比率となるように印加され
る。例えば、図３に示す場合では、各サブフィールドの
維持パルスＩＰの回数比は、ＳＦ１：ＳＦ２：ＳＦ３：
・・・＝２：４：６：・・・であるように印加される。
【００１０】この際、壁電荷が残留したままとなってい
る放電セル、すなわち上記アドレス行程Ｗcにおいて"点
灯放電セルモード"に設定された放電セルのみが、上記
維持パルスＩＰX及びＩＰYが印加される度に維持放電す
る。よって、"点灯放電セルモード"に設定された放電セ
ルは、上述した如くサブフィールド毎に割り当てられた
放電回数分だけ、その維持放電に伴う発光状態を維持す
る。
【００１１】そして、最後尾のサブフィールドＳＦ１２
のみで消去行程Ｅが実行される。かかる消去行程Ｅで
は、正極性の消去パルスＡＰ（図示しない）を発生して
これを列電極Ｄ1〜Ｄmに印加する。更に、かかる消去パ
ルスＡＰの印加タイミングと同時に負極性の消去パルス
ＥＰを発生してこれを行電極Ｙ1〜Ｙn各々に印加する。
これら消去パルスＡＰ及びＥＰの同時印加により、ＰＤ
Ｐにおける全放電セル内において消去放電が生起され、
全ての放電セル内に残存している壁電荷が消滅する。か
かる消去放電により、ＰＤＰにおける全ての放電セル
が"消灯放電セルモード"になるのである。
【００１２】以上述べた駆動法では、いずれか１のサブ
フィールドにおいてのみ、直前のサブフィールドで発光
状態にある放電セルのみを選択消去アドレス行程におい
て選択的に消去放電せしめている。これにより、先頭の
サブフィールドから順に点灯させ、Ｎ個（例えば、１２
個）のサブフィールドでＮ＋１階調表示（例えば、１３
階調表示）を行うようにしている。そして、各サブフィ
ールドにおける維持放電の発光回数の合計によって入力
画像信号に応じた階調表示を行うようにしている。
【００１３】一方、人間の視覚特性は対数特性であるた
め、低輝度領域における階調変化に敏感である。上述の
駆動法においては、最も低い階調表示のために使用され
るサブフィールド（ＳＦ１）における維持発光回数（維
持パルス数）は、次のサブフィールドにおける選択消去
アドレス時に走査パルスＳＰが印加される行電極Ｙ上に
マイナスの壁電荷が形成されている必要があるため、最
少でも２回としなければならない。従って、これ以上に
細かな階調表示（例えば、維持発光を１回とすること）
は困難であった。
【００１４】
【発明が解決しようとする課題】本発明は、上記の問題
を解決するためになされたものであり、その目的とする
ところは、低輝度領域における階調表示能力を向上させ
ることが可能なプラズマディスプレイパネルの駆動方法
を提供することである。
【００１５】
【課題を解決するための手段】本発明によるプラズマデ
ィスプレイパネルの駆動方法は、表示ラインに対応する
複数の行電極と行電極に交差して配列された複数の列電
極との交差部に放電セルが形成されたプラズマディスプ
レイパネルを、映像信号の各フィールドを構成する複数
のサブフィールド毎に駆動するプラズマディスプレイパ
ネルの駆動方法であって、先頭サブフィールドを含み連
続する少なくとも１つのサブフィールドからなるサブフ
ィールド群の各サブフィールドは、映像信号に応じて放
電セルを選択的に書込放電せしめて点灯放電セルモード
に設定する選択書込アドレス行程を含み、当該サブフィ
ールド群に後続するサブフィールドは、点灯放電セルモ
ードにある放電セルのみを当該複数のサブフィールドの
重み付けに応じた回数だけ繰り返し維持放電せしめる発
光維持行程を含み、当該サブフィールド群に後続するサ
ブフィールドのうちいずれか１のサブフィールドは、直
前のサブフィールドにおいて維持放電がなされた放電セ
ルのみを映像信号に応じて選択的に消去放電せしめて消
灯放電セルモードに設定する選択消去アドレス行程を含
むことを特徴としている。
【００１６】
【発明の実施の形態】以下、本発明の実施例を図を参照
しつつ説明する。 ［第１の実施例］図４は、本発明によるディスプレイ装
置の概略構成を示す図である。尚、図４に示すディスプ
レイ装置は、表示デバイスとしてプラズマディスプレイ
パネルを搭載したプラズマディスプレイ装置である。こ
のディスプレイ装置は、プラズマディスプレイパネル
（ＰＤＰ）１０と、ＰＤＰ１０の駆動部から構成され
る。当該駆動部は、同期検出回路１１、駆動制御回路１
２、Ａ／Ｄ変換器１４、データ変換回路３０、メモリ１
５、アドレスドライバ１６、第１サスティンドライバ１
７及び第２サスティンドライバ１８とから構成される。
【００１７】ＰＤＰ１０は、アドレス電極としての列電
極Ｄ1〜Ｄmと、これら列電極と直交して配列されている
行電極Ｘ1〜Ｘn及び行電極Ｙ1〜Ｙnを備えている。ＰＤ
Ｐ１０では、これら行電極Ｘ及び行電極Ｙの一対にて１
行分に対応した行電極を形成している。列電極Ｄ1〜Ｄm
は、赤色発光駆動を担う列電極Ｄ1、Ｄ4、Ｄ7、・・・・、
Ｄm-2と、緑色発光駆動を担う列電極Ｄ2、Ｄ5、Ｄ8、・・
・・、Ｄm-1と、青色発光駆動を担う列電極Ｄ3、Ｄ6、
Ｄ9、・・・・、Ｄmと、に区分される。赤色発光駆動を担う
列電極Ｄ1、Ｄ4、Ｄ7、・・・・、Ｄm-2各々と、行電極Ｘ及
びＹとの各交差部には、赤色で放電発光する赤色放電セ
ルが形成されている。又、緑色発光駆動を担う列電極Ｄ
2、Ｄ5、Ｄ8、・・・・、Ｄm-1と、行電極Ｘ及びＹとの各交
差部には、緑色で放電発光する緑色放電セルが形成され
ている。更に、青色発光駆動を担う列電極Ｄ3、Ｄ6、Ｄ
9、・・・・、Ｄmと、行電極Ｘ及びＹとの各交差部には、青
色で放電発光する青色放電セルが形成されている。この
際、表示ライン方向において互いに隣接している３つの
放電セル、つまり、赤色放電セル、緑色放電セル、及び
青色放電セルにて１画素を形成している。
【００１８】同期検出回路１１は、アナログの映像信号
中から垂直同期信号を検出したときに垂直同期信号Ｖを
発生する。更に、同期検出回路１１は、かかる映像信号
中から水平同期信号を検出した場合には水平同期信号Ｈ
を発生する。同期検出回路１１は、これら垂直同期信号
Ｖ及び水平同期信号Ｈの各々を、駆動制御回路１２及び
多階調化処理回路３１に供給する。Ａ／Ｄ変換器１４
は、駆動制御回路１２から供給されたクロック信号に応
じて上記映像信号をサンプリングし、これを各画素毎
の、例えば８ビットの画素データＰＤに変換してデータ
変換回路３０に供給する。
【００１９】図５は、かかるデータ変換回路３０の内部
構成を示す図である。データ変換回路３０は、多階調化
処理回路３１及び駆動データ生成回路３２で構成され
る。多階調化処理回路３１は、８ビットの画素データＰ
Ｄに対して誤差拡散処理及びディザ処理を施す。例え
ば、当該誤差拡散処理では、先ず、画素データＰＤの上
位６ビット分を表示データ、残りの下位２ビット分を誤
差データとする。そして、周辺画素各々に対応した当該
画素データＰＤの各誤差データを重み付け加算したもの
を、上記表示データに反映させる。かかる動作により、
原画素における下位２ビット分の輝度が上記周辺画素に
よって擬似的に表現され、それ故に８ビットよりも少な
い６ビット分の表示データにて、上記８ビット分の画素
データと同等の輝度階調表現が可能になる。そして、こ
の誤差拡散処理によって得られた６ビットの誤差拡散処
理画素データに対してディザ処理を施す。
【００２０】ディザ処理では、互いに隣接する複数の画
素を１画素単位とし、この１画素単位内の各画素に対応
した上記誤差拡散処理画素データに夫々、互いに異なる
係数値からなるディザ係数を夫々割り当てて加算してデ
ィザ加算画素データを得る。かかるディザ係数の加算に
よれば、上記１画素単位で眺めた場合には、上記ディザ
加算画素データの上位４ビット分だけでも８ビットに相
当する輝度を表現することが可能となる。そこで、多階
調化処理回路３１は、当該ディザ加算画素データの上位
４ビット分を多階調化画素データＰＤSとして駆動デー
タ生成回路３２に供給する。
【００２１】駆動データ生成回路３２は、当該４ビット
の多階調化処理画素データＰＤSを図６に示されるが如
き変換テーブルに従って第１〜第１２ビットからなる画
素駆動データＧＤに変換する。これら第１〜第１２ビッ
トの各々は、サブフィールドＳＦ１〜ＳＦ１２各々に対
応するものである。後述するように、本実施例において
は、サブフィールドＳＦ１〜ＳＦ３におけるアドレス行
程は選択書込アドレスを用い、ＳＦ４〜ＳＦ１２におけ
るアドレス行程は選択消去アドレスＷＩを用いている。
従って、第１〜第１３階調（階調１〜１３）に関して、
ＳＦ１〜ＳＦ３に対応する画素駆動データＧＤの第１〜
第３ビットを図６に示すように変換するとともに、ＳＦ
４〜ＳＦ１２に対応する第４〜第１２ビットを反転させ
ている。この変換過程を順を追って説明すると、例え
ば、画素データＰＤSが"００１０"（階調３）の場合、
まず、"００１０"を"００１０００００００００"に拡張
する。次に、第１〜第３ビットについて、図６の変換テ
ーブルに示すように変換して"１１０００００００００
０"が得られ、さらに第４〜第１２ビットを反転させて"
１１００１１１１１１１１１"と変換する。また、画素
データＰＤSが"０１００"（階調５）の場合、"０１０
０"を"００００１０００００００"に拡張した後、上記
と同様にしてこれを"１１１１０１１１１１１"に変換す
る。
【００２２】このように、多階調化処理回路３１及び駆
動データ生成回路３２によれば、８ビットで２５６階調
を表現し得る画素データＰＤは、図６に示されるが如き
全部で１３パターンからなる１２ビットの画素駆動デー
タＧＤに変換される。メモリ１５は、駆動制御回路１２
から供給されてくる書込信号に従って上記画素駆動デー
タＧＤを順次書き込んで記憶する。かかる書込動作によ
り、１画面（ｎ行、ｍ列）分の画素駆動データＧＤ11〜
ＧＤnmの書き込みが終了すると、メモリ１５は、駆動制
御回路１２から供給されてくる読出信号に応じて、画素
駆動データＧＤ11〜ＧＤnm各々を同一ビット桁同士にて
１行分毎に順次読み出してアドレスドライバ１６に供給
する。すなわち、メモリ１５は、各々が１２ビットから
なる１画面分の画素駆動データＧＤ11〜ＧＤnmを、 ＤＢ１11-nm：画素駆動データＧＤ11-nmの第１ビット目 ＤＢ２11-nm：画素駆動データＧＤ11-nmの第２ビット目 ＤＢ３11-nm：画素駆動データＧＤ11-nmの第３ビット目 ＤＢ４11-nm：画素駆動データＧＤ11-nmの第４ビット目 ＤＢ５11-nm：画素駆動データＧＤ11-nmの第５ビット目 ＤＢ６11-nm：画素駆動データＧＤ11-nmの第６ビット目 ＤＢ７11-nm：画素駆動データＧＤ11-nmの第７ビット目 ＤＢ８11-nm：画素駆動データＧＤ11-nmの第８ビット目 ＤＢ９11-nm：画素駆動データＧＤ11-nmの第９ビット目 ＤＢ１０11-nm：画素駆動データＧＤ11-nmの第１０ビッ
ト目 ＤＢ１１11-nm：画素駆動データＧＤ11-nmの第１１ビッ
ト目 ＤＢ１２11-nm：画素駆動データＧＤ11-nmの第１２ビッ
ト目 の如く１２分割した画素駆動データビットＤＢ１11-nm
〜ＤＢ１２11-nmとして認識する。そして、これらＤＢ
１11-nm、ＤＢ２11-nm、・・・・、ＤＢ１２11-nm各々を、
駆動制御回路１２から供給された読出信号に従って１行
分毎に順次読み出してアドレスドライバ１６に供給する
のである。
【００２３】駆動制御回路１２は、上記水平同期信号Ｈ
及び垂直同期信号Ｖに同期して、上記Ａ／Ｄ変換器１４
に対するクロック信号、及びメモリ１５に対する書込・
読出信号を発生する。更に、駆動制御回路１２は、図７
に示されるが如き発光駆動フォーマットに従って、ＰＤ
Ｐ１０を駆動させるべき各種タイミング信号をアドレス
ドライバ１６、第１サスティンドライバ１７及び第２サ
スティンドライバ１８各々に供給する。
【００２４】図７に示される発光駆動フォーマットは、
映像信号における１フィールドを１２個のサブフィール
ドＳＦ１〜ＳＦ１２に分割し、各サブフィールド毎にＰ
ＤＰ１０に対する駆動パターンを示している。駆動制御
回路１２は、図６に示される第１〜第１２ビットからな
る画素駆動データＧＤに基づいてサブフィールドＳＦ１
〜ＳＦ１２の各々の発光パターンを確定する。この際、
各サブフィールドは、入力映像信号に基づいてＰＤＰ１
０の各放電セルを"点灯放電セルモード"（すなわち、動
作可能モード）にする選択書込アドレス行程（ＷＯ）又
は"消灯放電セルモード"（すなわち、不動作モード）に
する選択消去アドレス行程（ＷＩ）、"点灯放電セルモ
ード"にある放電セルのみを各サブフィールドの重み付
けに対応した期間(回数)だけ発光させる発光維持行程
（Ｉc）、リセット行程（Ｒc）、及び消去行程（Ｅ）の
組合せにより構成される。より具体的には、図６の変換
テーブル及び図７の発光駆動フォーマットに示すよう
に、ＳＦ１〜ＳＦ３におけるアドレス行程を選択書込ア
ドレスＷＯとし、ＳＦ４〜ＳＦ１２におけるアドレス行
程を選択消去アドレスＷＩとしている。また、ＳＦ１
は、リセット行程Ｒc、選択書込アドレス行程ＷＯ及び
消去行程Ｅで構成し、維持発光行程Ｉcを設けていな
い。ＳＦ２は、選択書込アドレス行程ＷＯ、維持発光行
程Ｉc及び消去行程Ｅで構成している。ＳＦ３は、選択
書込アドレス行程ＷＯ、維持発光行程Ｉcのみで構成
し、消去行程Ｅを設けていない。ＳＦ４〜ＳＦ１２は、
選択消去アドレス行程ＷＩ及び維持発光行程Ｉcで構成
され、最後尾のサブフィールドＳＦ１２において消去行
程Ｅが実行される。
【００２５】図８は、図７に示される発光駆動フォーマ
ットに従って、アドレスドライバ１６、第１サスティン
ドライバ１７及び第２サスティンドライバ１８各々が、
ＰＤＰ１０の行電極及び列電極に印加する各種駆動パル
スの印加タイミングを示すタイムチャートである。ま
た、第２〜第５階調について、パルス印加に対応する放
電状態が下段に示されている。
【００２６】先ず、サブフィールドＳＦ１の一斉リセッ
ト行程Ｒcでは、第２サスティンドライバ１８が、図８
に示されるが如き正極性のリセットパルスＲＰYを行電
極Ｙ1〜Ｙnに印加する。ＲＰYの印加に応じて、ＰＤＰ
１０の全放電セルがリセット放電する。リセットパルス
ＲＰYは矩形波パルスではなく、維持放電パルスに比べ
て緩やかな立ち上がり、立ち下がり波形を有する。かか
る波形のリセットパルスＲＰYの印加によって、リセッ
ト行程Ｒcにおける全面書き込み放電（ＰR1）、全面消
去放電（ＰR2）は微弱である。従って、これらの放電Ｐ
R1，ＰR2によっては低輝度領域においても階調表示に悪
影響を生じることはない。このリセット行程Ｒcによ
り、各放電セル内には一様に所定量の壁電荷が形成さ
れ、これによって、全ての放電セルは"消灯放電セルモ
ード"に初期化される。
【００２７】次に、サブフィールドＳＦ１の選択書込ア
ドレス行程ＷＯでは、第１サスティンドライバ１７によ
り正極性の所定電圧が行電極Ｘ1〜Ｘnに印加される。次
に、アドレスドライバ１６が、メモリ１５から供給され
た画素駆動データビットＤＢの論理レベルに対応した電
圧を有する画素データパルスを発生する。例えば、アド
レスドライバ１６は、画素駆動データビットＤＢの論理
レベルが"１"である場合には高電圧の画素データパルス
を生成し、"０"である場合には低電圧(０ボルト)の画素
データパルスを生成する。この際、アドレスドライバ１
６は、１行分の画素データパルスからなる画素データパ
ルス群ＤＰを列電極Ｄ1〜Ｄmに印加して行く。サブフィ
ールドＳＦ１のアドレス行程ＷＯでは、先ず、上記画素
駆動データビットＤＢ１11-nmの内から第１行目に対応
した分、つまりＤＢ１11-1mを抽出し、これらＤＢ１
11-1m各々の論理レベルに対応したｍ個分の画素データ
パルスからなる画素データパルス群ＤＰ１1を列電極Ｄ1
〜Ｄmに印加する。次に、かかる画素駆動データビット
ＤＢ１11-nmの内の第２行目に対応した分であるＤＢ１
21-2mを抽出し、これらＤＢ１21-2m各々の論理レベルに
対応したｍ個分の画素データパルスからなる画素データ
パルス群ＤＰ１2を列電極Ｄ1〜Ｄmに印加する。以下、
同様にして、サブフィールドＳＦ１のアドレス行程Ｗc
では、１行分毎の画素データパルス群ＤＰ１3〜ＤＰ１n
を順次列電極Ｄ1〜Ｄmに印加して行く。
【００２８】更に、アドレス行程ＷＯでは、第２サステ
ィンドライバ１８が、上述した如き画素データパルス群
ＤＰの各印加タイミングと同一タイミングにて、図８に
示されるが如き負極性の走査パルスＳＰを発生し、これ
を行電極Ｙ1〜Ｙnへと順次印加して行く。この際、走査
パルスＳＰが印加された行電極と、高電圧の画素データ
パルスが印加された列電極との交差部の放電セルにのみ
放電（選択書込放電）による発光ＰWが生じ、"点灯放電
セルモード"に移行する。尚、図においては、第１行電
極Ｙ1の選択書込放電ＰWの発光タイミングを示してい
る。
【００２９】アドレス行程ＷＯが終了した後、全面消去
行程Ｅが実行される。消去行程Ｅでは、第１サスティン
ドライバ１７により正極性の所定電圧ＥXが行電極Ｘ1〜
Ｘnに印加されるとともに、第２サスティンドライバ１
８により正極性の消去パルスＥＰYが行電極Ｙ1〜Ｙn各
々に印加される。これら消去パルスの印加により、ＰＤ
Ｐ１０における全放電セルの消去放電ＰEが生起され、
全ての放電セル内に残存している壁電荷が消滅する。か
かる消去放電により、ＰＤＰ１０における全ての放電セ
ルが"消灯放電セルモード"になるのである。
【００３０】上記したように、サブフィールドＳＦ１に
おいては、１回の書込放電発光ＰWが階調表示の発光と
して用いられる。サブフィールドＳＦ２においては、ま
ず、ＳＦ１の場合と同様にして選択書込アドレス行程Ｗ
Ｏが実行され、画素駆動データビットＤＢが画素の点灯
を指定する発光論理レベル（"１"）である場合に選択書
込放電による発光ＰWが生じる。
【００３１】次に、発光維持行程Ｉcが実行される。す
なわち、第２サスティンドライバ１８により行電極Ｙ1
〜Ｙnにほぼ同時に正極性の発光維持パルス（サスティ
ンパルス）ＩＰYが１回印加される。この際、壁電荷が
残留したままとなっている放電セル、すなわち上記アド
レス行程ＷＯにおいて"点灯放電セルモード"に設定され
た放電セルのみが、当該維持パルスＩＰYの印加によっ
て維持放電し、発光（ＰW）が生じる。
【００３２】発光維持行程Ｉcの後、第１サスティンド
ライバ１７によって行電極Ｘ1〜Ｘnに正極性の消去パル
スＥＰXが印加され、全面消去行程Ｅが実行される。こ
れにより全ての放電セルは"消灯放電セルモード"にな
る。上記したように、サブフィールドＳＦ２において
は、１回の書込放電発光ＰW及び１回の維持放電発光
ＰS、合計２回の放電発光が階調表示の発光として用い
られる。
【００３３】サブフィールドＳＦ３においては、ＳＦ１
及びＳＦ２の場合と同様にして選択書込アドレス行程Ｗ
Ｏが実行され、選択書込放電による発光ＰWが生じる。
次に、発光維持行程Ｉcが実行される。すなわち、第１
サスティンドライバ１７及び第２サスティンドライバ１
８により図８に示すように、行電極Ｘ1〜Ｘn及びＹ1〜
Ｙnに正極性の維持パルスＩＰX及びＩＰYが交互に印加
される。維持パルスＩＰXは１回、ＩＰYは２回印加さ
れ、合計３回の維持放電発光ＰSが生じる。
【００３４】上記したように、サブフィールドＳＦ３に
おいては、１回の書込放電発光ＰW及び３回の維持放電
発光ＰS、合計４回の放電発光が階調表示の発光として
用いられる。サブフィールドＳＦ４〜ＳＦ１２において
は、上述したように、選択消去アドレス行程ＷＩ及び維
持発光行程Ｉcが実行される。より詳細には、行電極Ｘ1
〜Ｘ nには電圧を印加せず、画素データパルスＤＰの各
印加タイミングと同一のタイミングにて、負極性の走査
パルスＳＰを行電極Ｙ1〜Ｙnへ順次印加する。この際、
走査パルスＳＰが印加された行電極と、高電圧の画素デ
ータパルスが印加された列電極との交差部の放電セルに
のみ微弱な放電（すなわち、選択消去放電ＰI）が生
じ、その放電セル内に残存していた壁電荷が選択的に消
去される。かかる選択消去放電により、"点灯放電セル
モード"にあった放電セルは、"消灯放電セルモード"に
移行する。一方、選択消去放電の生起されなかった放電
セルは、"点灯放電セルモード"を維持する。
【００３５】次に、各サブフィールドの発光維持行程Ｉ
cにおいては、図８に示すように、行電極Ｘ1〜Ｘn及び
Ｙ1〜Ｙnに対して正極性の維持パルスＩＰX及びＩＰYが
交互に印加される。ここで、発光維持行程Ｉcにおい
て、各サブフィールドＳＦ４〜ＳＦ１２毎に所定回数の
維持パルスＩＰが印加される。例えば、図６に示す場合
では、サブフィールドＳＦ４〜ＳＦ１２の各々の維持パ
ルスＩＰの回数は、（ＳＦ４，ＳＦ５，ＳＦ６，ＳＦ
７，ＳＦ８，ＳＦ９，ＳＦ１０，ＳＦ１１，ＳＦ１２）
＝（６，１２，１４，２０，２５，３３，４０，４８，
５０）である。なお、サブフィールドＳＦ２，ＳＦ３，
ＳＦ４〜ＳＦ１２の各々の維持パルスＩＰの回数はこれ
に限らず、種々の条件に応じて適宜定めることができ
る。
【００３６】この際、壁電荷が残留したままとなってい
る放電セル、すなわち"点灯放電セルモード"に維持され
た放電セルのみが、上記維持パルスＩＰX及びＩＰYが印
加される度に維持放電する。よって、"点灯放電セルモ
ード"に設定された放電セルは、上述した如くサブフィ
ールド毎に割り当てられた放電回数分だけ、その維持放
電に伴う発光状態を維持する。
【００３７】そして、最後尾のサブフィールドＳＦ１２
（図示しない）のみで消去行程Ｅが実行される。かかる
消去行程Ｅでは、正極性の消去パルスＡＰを発生してこ
れを列電極Ｄ1〜Ｄmに印加する。更に、かかる消去パル
スＡＰの印加タイミングと同時に負極性の消去パルスＥ
Ｐを発生してこれを行電極Ｙ1〜Ｙn各々に印加する。こ
れら消去パルスＡＰ及びＥＰの同時印加により、ＰＤＰ
における全放電セル内において消去放電が生起され、全
ての放電セル内に残存している壁電荷が消滅する。かか
る消去放電により、ＰＤＰにおける全ての放電セルが"
消灯放電セルモード"になるのである。
【００３８】よって、上記した駆動方法によれば、選択
消去アドレス行程ＷＩのなされるサブフィールドＳＦ４
〜ＳＦ１２において"点灯放電セルモード"に維持された
放電セルのみが、その後の発光維持行程Ｉcにおいて上
述した如き回数だけ発光を繰り返す。ここで、各放電セ
ルが"消灯放電セルモード"に設定されるのは、画素駆動
データＧＤによって決まる。画素駆動データＧＤの各ビ
ットが消灯を表す論理レベル"０"である場合には、その
ビット桁に対応したサブフィールドのアドレス行程ＷＩ
において選択消去放電が生起され、放電セルは"消灯放
電セルモード"に設定される。一方、そのビットの論理
レベルが"１"である場合には、上記選択消去放電は生起
されないので、現状を維持する。サブフィールドＳＦ４
〜ＳＦ１２の内で放電セルを"消灯放電セルモード"か
ら"点灯放電セルモード"に移行させることが出来る機会
は無いから、サブフィールドＳＦ４〜ＳＦ１２のいずれ
か１のアドレス行程ＷＩにおいて一旦"消灯放電セルモ
ード"に移行した放電セルが再び"点灯放電セルモード"
に移行することはない。よって、サブフィールドＳＦ４
以降においては、図６中の黒丸に示されるサブフィール
ドにおいて選択消去放電が生起されるまでの間だけ"点
灯放電セルモード"を維持する。そして、その間に存在
する白丸にて示されるサブフィールド各々の発光維持行
程Ｉcにおいて上述した如き回数だけ発光を行うのであ
る。従って、ＳＦ１〜ＳＦ３における選択書込放電及び
ＳＦ２〜ＳＦ１２における維持放電の総数によって中間
調の輝度が表現される。
【００３９】つまり、図６に示す如き１３種類のデータ
パターンを有する画素駆動データＧＤによれば、 ［0：1：3：7：13：25：39：59：84：117：157：205：2
55] なる１３階調の中間輝度を表現できるのである。従っ
て、本発明によれば、低消費電力及び高いコントラスト
性能を有し、また偽輪郭の発生を防止できるという１リ
セット１アドレス法の利点をそのまま保持し、低輝度領
域における階調を微細に調整でき、階調表示能力を向上
させることが可能となる。
【００４０】［第２の実施例］本発明の第２の実施例に
ついて、図９乃至図１１を用いて以下に説明する。図９
は、ＰＤＰ１０の駆動データの変換テーブル及び発光駆
動パターンを示し、図１０は、発光駆動フォーマットで
ある。また、図１１は、ＰＤＰ１０の行電極及び列電極
に印加される各種駆動パルスの印加タイミングを示すタ
イムチャートである。
【００４１】本実施例が第１の実施例と異なるのは、図
９及び図１０に示すように、ＳＦ１及びＳＦ２における
アドレス行程を選択書込アドレスＷＯとし、ＳＦ３〜Ｓ
Ｆ１２におけるアドレス行程を選択消去アドレスＷＩと
している点にある。より具体的には、図１０及び図１１
に示すように、ＳＦ１は、リセット行程Ｒc、選択書込
アドレス行程ＷＯ及び消去行程Ｅで構成し、維持発光行
程Ｉcを設けていない。ＳＦ２は、選択書込アドレス行
程ＷＯ、維持発光行程Ｉcのみで構成し、消去行程Ｅを
設けていない。ＳＦ３〜ＳＦ１２は、選択消去アドレス
行程ＷＩ及び維持発光行程Ｉcで構成され、最後尾のサ
ブフィールドＳＦ１２のみにおいて消去行程Ｅが実行さ
れる。
【００４２】図１１は、図９に示される発光駆動フォー
マットに従って、アドレスドライバ１６、第１サスティ
ンドライバ１７及び第２サスティンドライバ１８各々
が、ＰＤＰ１０の行電極及び列電極に印加する各種駆動
パルスの印加タイミングを示す、図８同様のタイムチャ
ートである。また、第１〜第４階調について、パルス印
加に対応する放電状態が下段に示されている。
【００４３】尚、上述した実施例では、ＳＦ１〜ＳＦ
３、又はＳＦ１及びＳＦ２のアドレス行程を選択書込ア
ドレスとしたが、ＳＦ１のみのアドレス行程を選択書込
アドレスとしてもよい。この場合、ＳＦ１は、リセット
行程Ｒc（全面書込み＋全面消去）、選択書込アドレス
行程、維持発光行程Ｉc（維持パルス数２個）のみで構
成される。
【００４４】また、上述した実施例では、１フィールド
における先頭サブフィールドＳＦ１のアドレス行程に先
立ってリセット行程Ｒcを設けるようにしているが、各
フィールド毎にではなく、複数フィールド毎に１回設け
るようにしてもよい。あるいは、リセット行程を設けな
くてもよい。この場合、階調表示に直接関係しない放電
発光回数が少なくなるためコントラストがより一層向上
する。
【００４５】また、上記したように、リセットパルスの
立ち上がり、立ち下がり波形、又は消去パルスの立ち上
がり、立ち下がり波形を維持放電パルスよりも緩やかに
しているので、リセット行程における全面書き込み放
電、全面消去放電、又はアドレス行程後の消去放電は微
弱な放電となっている。従って、これらの放電発光によ
っては低輝度領域における階調表示に悪影響を生じるこ
とはない。
【００４６】
【発明の効果】以上詳細に説明したように、本発明によ
れば、低輝度領域における階調を微細に調整でき、階調
表示能力を向上させることが可能となる。また、低消費
電力及び高いコントラスト性能を有し、また偽輪郭の発
生を防止できるという利点も有する。
【図面の簡単な説明】
【図１】１リセット１アドレス法によるＰＤＰの発光駆
動フォーマットの一例を模式的に示す図である。
【図２】画素データの変換処理によって得られる画素駆
動データＧＤ、これに対応する階調及び放電セルの発光
駆動パターンを示す図である。
【図３】図２に示される発光駆動フォーマットに従っ
て、ＰＤＰの行電極及び列電極に印加される各種駆動パ
ルスの印加タイミングを示す図である。
【図４】本発明によるディスプレイ装置の概略構成を示
す図である。
【図５】図４に示すデータ変換回路の内部構成を示す図
である。
【図６】本発明の第１の実施例による多階調化画素デー
タＰＤS、画素駆動データＧＤ、これに対応する階調及
び放電セルの発光駆動パターンを示す図である。
【図７】本発明の第１の実施例による発光駆動フォーマ
ットを示す図である。
【図８】本発明の第１の実施例において、アドレスドラ
イバ、第１サスティンドライバ及び第２サスティンドラ
イバが、ＰＤＰの行電極及び列電極に印加する各種駆動
パルスの印加タイミングを示すタイムチャートである。
【図９】本発明の第２の実施例による多階調化画素デー
タＰＤS、画素駆動データＧＤ、これに対応する階調及
び放電セルの発光駆動パターンを示す図である。
【図１０】本発明の第２の実施例による発光駆動フォー
マットを示す図である。
【図１１】本発明の第２の実施例において、ＰＤＰの行
電極及び列電極に印加される各種駆動パルスの印加タイ
ミングを示すタイムチャートである。
【主要部分の符号の説明】
１０ ＰＤＰ １１ 同期検出回路 １２ 駆動制御回路 １４ Ａ／Ｄ変換器 １５ メモリ １６ アドレスドライバ １７ 第１サスティンドライバ １８ 第２サスティンドライバ ３０ データ変換回路 ３１ 多階調化処理回路 ３２ 駆動データ生成回路
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｈ０４Ｎ 5/66 １０１ Ｇ０９Ｇ 3/28 Ｋ Ｆターム(参考） 5C058 AA11 BA01 BA07 BB04 BB11 5C080 AA05 BB05 DD03 EE29 HH05 HH07 JJ02 JJ04 JJ05

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】 表示ラインに対応する複数の行電極と前
    記行電極に交差して配列された複数の列電極との交差部
    に放電セルが形成されたプラズマディスプレイパネル
    を、映像信号の各フィールドを構成する複数のサブフィ
    ールド毎に駆動するプラズマディスプレイパネルの駆動
    方法であって、 先頭サブフィールドを含み連続する少なくとも１つのサ
    ブフィールドからなるサブフィールド群の各サブフィー
    ルドは、前記映像信号に応じて前記放電セルを選択的に
    書込放電せしめて点灯放電セルモードに設定する選択書
    込アドレス行程を含み、 前記サブフィールド群に後続するサブフィールドは、前
    記点灯放電セルモードにある放電セルのみを前記複数の
    サブフィールドの重み付けに応じた回数だけ繰り返し維
    持放電せしめる発光維持行程を含み、 前記サブフィールド群に後続するサブフィールドのうち
    いずれか１のサブフィールドは、直前のサブフィールド
    において維持放電がなされた放電セルのみを前記映像信
    号に応じて選択的に消去放電せしめて消灯放電セルモー
    ドに設定する選択消去アドレス行程を含むことを特徴と
    する駆動方法。
  2. 【請求項２】 前記先頭サブフィールドは、前記選択書
    込アドレス行程と、前記点灯放電セルモードにある放電
    セルを消去放電せしめて消灯放電セルモードに移行せし
    める消去行程と、のみからなることを特徴とする請求項
    １記載の駆動方法。
  3. 【請求項３】 前記先頭サブフィールドは、全放電セル
    を実質的に同時に書込放電せしめた後消去放電せしめる
    リセット行程と、前記選択書込アドレス行程と、前記点
    灯放電セルモードにある放電セルを消去放電せしめて消
    灯放電セルモードに移行せしめる消去行程と、のみから
    なることを特徴とする請求項１記載の駆動方法。
  4. 【請求項４】 前記サブフィールド群のうち前記先頭サ
    ブフィールドを除く各サブフィールドは、前記選択書込
    アドレス行程の終了後に前記点灯放電セルモードにある
    放電セルを前記重み付けに応じた回数だけ繰り返し維持
    放電せしめる発光維持行程を含むことを特徴とする請求
    項１記載の駆動方法。
  5. 【請求項５】 前記映像信号の１フィールドの表示期間
    をＮ個のサブフィールドに分割した際、前記先頭サブフ
    ィールドから順に点灯せしめてＮ＋１階調表示をなすこ
    とを特徴とする請求項１記載の駆動方法。
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