JP2003178584A5 - - Google Patents
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Claims (12)
- 内部回路に供給される電圧を発生する電圧発生回路であって、
それぞれの一端に電源電位が供給される第１，第２，第３スイッチング素子と、
電流通路の一端が前記第１スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、第１駆動能力を有する第１トランジスタと、
電流通路の一端が前記第２スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、前記第１駆動能力と異なる第２駆動能力を有する第２トランジスタと、
電流通路の一端が前記第３スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、前記第１，第２駆動能力と異なる第３駆動能力を有する第３トランジスタと、
を具備することを特徴とする電圧発生回路。 - 前記第１乃至第３トランジスタは、前記内部回路の動作に応じた第１乃至第３モードに応じてオンすることを特徴とする請求項１に記載の電圧発生回路。
- 前記電圧発生回路は、前記第１モード時に前記第１トランジスタがオンし、前記第２モード時に前記第２トランジスタがオンし、前記第３モード時に前記第３トランジスタがオンすることを特徴とする請求項２に記載の電圧発生回路。
- 前記電圧発生回路は、前記第１モード時に前記第１トランジスタがオンし、前記第２モード時に前記第２トランジスタがオンし、前記第３モード時に前記第２、第３トランジスタがオンすることを特徴とする請求項２に記載の電圧発生回路。
- 内部回路に供給される電圧を発生する電圧発生回路であって、
それぞれの一端に電源電位が供給される第１，第２，第３スイッチング素子と、
電流通路の一端が前記第１スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、第１駆動能力を有する第１トランジスタと、
電流通路の一端が前記第２スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、前記第１トランジスタの駆動能力より大きい第２駆動能力を有する第２トランジスタと、
電流通路の一端が前記第３スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、前記第２トランジスタの駆動能力より大きい第３駆動能力を有する第３トランジスタと、
を具備し、
前記電圧発生回路は第１乃至第３モードのうち前記内部回路の動作に応じていずれかのモードとされ、前記第１モードのとき前記第１トランジスタがオンし、前記第２モードのとき前記第２トランジスタがオンし、前記第３モードのとき前記第３トランジスタがオンすることを特徴とする電圧発生回路。 - 内部回路に供給される電圧を発生する電圧発生回路であって、
それぞれの一端に電源電位が供給される第１，第２，第３スイッチング素子と、
電流通路の一端が前記第１スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、第１駆動能力を有する第１トランジスタと、
電流通路の一端が前記第２スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、前記第１トランジスタの駆動能力より大きい第２駆動能力を有する第２トランジスタと、
電流通路の一端が前記第３スイッチング素子の他端と接続され、前記電流通路の他端から前記内部回路に電圧を供給し、前記第２トランジスタの駆動能力より大きい第３駆動能力を有する第３トランジスタと、
を具備し、
前記電圧発生回路は第１乃至第３モードのうち前記内部回路の動作に応じていずれかのモードとされ、前記第１モードのとき前記第１トランジスタがオンし、前記第２モードのとき前記第２トランジスタがオンし、前記第３モードのとき前記第２、第３トランジスタがオンすることを特徴とする電圧発生回路。 - 前記内部回路は半導体メモリ回路であって、前記第３モードは前記半導体メモリ回路のセンス期間中に選択されることを特徴とする請求項５または６に記載の電圧発生回路。
- 前記内部回路は半導体メモリ回路であって、前記第３モードは前記半導体メモリ回路のリストア開始から所定期間中に選択されることを特徴とする請求項５乃至７のいずれか１項に記載の電圧発生回路。
- 前記内部回路は半導体メモリ回路であって、前記第２モードは前記半導体メモリ回路のセンス期間の経過後から所定期間中に選択されることを特徴とする請求項５乃至８のいずれか１項に記載の電圧発生回路。
- 前記内部回路は半導体メモリ回路であって、前記第２モードは前記半導体メモリ回路のリストア開始から所定期間経過後に選択されることを特徴とする請求項５乃至９のいずれか１項に記載の電圧発生回路。
- 前記内部回路は半導体メモリ回路であって、前記第１モードは前記半導体メモリ回路のスタンバイ期間中に選択されることを特徴とする請求項５乃至１０のいずれか１項に記載の電圧発生回路。
- 前記第１乃至第３駆動能力は、前記第１乃至第３トランジスタのゲート幅が相違することにより、それぞれ異なることを特徴とする請求項１乃至１１のいずれか１項に記載の電圧発生回路。
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Applications Claiming Priority (1)
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| JP2001374734A JP2003178584A (ja) | 2001-12-07 | 2001-12-07 | 電圧発生回路 |
Publications (2)
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| JP2003178584A JP2003178584A (ja) | 2003-06-27 |
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Family Applications (1)
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