JP2003046022A - Electronic apparatus - Google Patents
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Abstract
Description
【0001】[0001]
【発明の属する技術分野】本発明は、電子部品を搭載し
たメタルコア基板を備えた電子装置の構造及びその製造
技術に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a structure of an electronic device having a metal core substrate on which electronic parts are mounted and a manufacturing technique thereof.
【0002】[0002]
【従来の技術】電子基板を備えた電子装置は、電子部品
による発熱に起因した不良が生じないようにする必要が
ある。そのため、出荷前には熱サイクル試験を行うこと
にしている。特に、ECU等の車載用電子装置では、環
境等の変化による車体内の温度変化に加えてエンジンの
オンオフによるLSIチップ発熱の有無が影響し、電子
部品等は広い温度領域での熱サイクル(例えば、−40
度〜120度:自動車用電子機器の環境試験通則JASOD0
01)に耐える必要がある。今般、ECUをよりエンジン
近くに配置する傾向があり、さらに、この温度範囲の上
限がより高くなる傾向がある。このような熱サイクルに
さらされると、ECU内の電子部品の性能が安定しなく
なったり、電子部品の搭載基板と電子部品との間の接続
不良が生じやすくなる。すなわち、電子装置には高い放
熱性が要求され、特にECU等の車載用電子装置は一般
の電子部品よりも優れた放熱性が求められている。2. Description of the Related Art In an electronic device having an electronic substrate, it is necessary to prevent defects due to heat generation from electronic components. Therefore, a thermal cycle test will be conducted before shipment. In particular, in an on-vehicle electronic device such as an ECU, the presence or absence of heat generated in the LSI chip due to the turning on / off of the engine affects the temperature change in the vehicle body due to changes in the environment, etc. , -40
-120 degrees: General rules for environmental testing of automobile electronic equipment JASOD0
It is necessary to endure 01). Nowadays, the ECU tends to be arranged closer to the engine, and further, the upper limit of this temperature range tends to be higher. When exposed to such a thermal cycle, the performance of the electronic components in the ECU becomes unstable, and a connection failure between the electronic component mounting board and the electronic components is likely to occur. That is, the electronic device is required to have a high heat dissipation property, and particularly the vehicle-mounted electronic device such as the ECU is required to have a better heat dissipation property than general electronic components.
【0003】基板に搭載される電子部品の発熱を考慮し
た一般的な電子装置の構造に関する従来技術に、特開平
6−169189号公報がある。Japanese Patent Application Laid-Open No. 6-169189 discloses a conventional technique relating to the structure of a general electronic device in consideration of heat generation of electronic components mounted on a substrate.
【0004】この公報には、内層にグランドを有するプ
リント基板上にスルーホールを介してこのグランドと接
続されている放熱電極用パッドが形成され、さらにその
放熱電極用パッドとチップ形発熱部品に設けられた放熱
用電極とが整合するよう搭載されている電子回路基板が
記載されている。この電子回路基板の構造は、チップ形
発熱部品が発生する熱を、放熱用電極、放熱電極用パッ
ド、スルーホールを介してグランドへ逃がすことでプリ
ント基板の放熱性を確保している。In this publication, a heat dissipation electrode pad connected to the ground via a through hole is formed on a printed circuit board having a ground in the inner layer, and the heat dissipation electrode pad and the chip heat generating component are provided. An electronic circuit board mounted so as to be aligned with the heat dissipation electrode is described. The structure of this electronic circuit board ensures the heat dissipation of the printed circuit board by allowing the heat generated by the chip-type heat-generating component to escape to the ground through the heat dissipation electrode, the heat dissipation electrode pad, and the through hole.
【0005】また、一般的な電子部品の基板としてメタ
ルコア基板があり、そのメタルコア基板の放熱性を考慮
した従来技術として特開平7−326690号公報があ
る。Further, there is a metal core substrate as a substrate for general electronic parts, and Japanese Patent Laid-Open No. Hei 7-326690 is a conventional technique in consideration of heat dissipation of the metal core substrate.
【0006】この公報には、内部配線パターンがメタル
コア基板に形成され、アウターリードがその内部配線パ
ターンに接続され、その内部配線パターンを、例えば銅
箔をエッチング加工するなど薄膜を加工して形成するこ
と、および内部配線パターンが形成されたメタルコア基
板のチップ部品が搭載される部分を凹部に形成すること
が記載されている。In this publication, an internal wiring pattern is formed on a metal core substrate, outer leads are connected to the internal wiring pattern, and the internal wiring pattern is formed by processing a thin film, for example, by etching a copper foil. And forming a portion of the metal core substrate, on which the internal wiring pattern is formed, on which the chip component is mounted in the recess.
【0007】[0007]
【発明が解決しようとする課題】特開平6−16918
9号公報は、ガラスエポキシ材を基板のコアとして使用
しているので、基板の種類に対応した放熱構造どころか
メタルコア基板に関しても何ら記載されていない。ま
た、半導体部品のグランド端子も他の信号端子と同様に
一定の大きさにしているため、放熱性を確保するには十
分でない。DISCLOSURE OF THE INVENTION Problems to be Solved by the Invention
Since No. 9 uses a glass epoxy material as the core of the substrate, it does not describe anything about a heat dissipation structure corresponding to the type of the substrate or a metal core substrate. In addition, the ground terminal of the semiconductor component has a constant size like other signal terminals, and is not sufficient to secure heat dissipation.
【0008】また、特開平7−326690号公報で
は、メタルコア基板を用いているので基板自体の熱拡散
効率は向上しているが、メタルコア基板と電子部品との
間にエポキシ樹脂等の有機接着材やポリイミド等の有機
絶縁層を備えているので、電子部品から基板への熱導伝
性が低い。つまり、電子部品から搭載基板への熱伝導性
が十分に考慮されているとはいえない。Further, in Japanese Patent Application Laid-Open No. 7-326690, since a metal core substrate is used, the heat diffusion efficiency of the substrate itself is improved, but an organic adhesive such as an epoxy resin is provided between the metal core substrate and the electronic component. Since it has an organic insulating layer such as or polyimide, the heat conductivity from the electronic component to the substrate is low. That is, it cannot be said that the thermal conductivity from the electronic component to the mounting substrate is sufficiently taken into consideration.
【0009】また、これらの従来技術でメタルコア基板
に配線を形成し、その配線されたメタルコア基板にフリ
ップチップ方式の半導体部品を採用する場合に生じる半
導体部品端子と配線との間の接続不良に関して何ら配慮
がなされていない。Further, there is no problem with connection defects between semiconductor component terminals and wiring that occur when wiring is formed on a metal core substrate by these conventional techniques and a flip chip type semiconductor component is adopted on the wired metal core substrate. No consideration is given.
【0010】また、電子基板を他の基板にインターポー
ザとして搭載する場合やチップを複数搭載したMCM
(マルチチップモジュール)の場合の放熱構造に関して
も何ら考慮されていない。Also, when an electronic board is mounted on another board as an interposer, or an MCM in which a plurality of chips are mounted.
No consideration is given to the heat dissipation structure in the case of (multi-chip module).
【0011】本発明の目的は、メタルコア基板の構造を
使用して電子基板の放熱性を向上させ、電子部品全体の
放熱性(耐熱性)を向上させることにある。An object of the present invention is to improve the heat dissipation of the electronic board by using the structure of the metal core board, and to improve the heat dissipation (heat resistance) of the entire electronic component.
【0012】また、インターポーザを搭載した基板やM
CM構造を採用した基板を有する電子装置全体の放熱性
(耐熱性)を向上させることにある。Also, a substrate having an interposer or an M
It is to improve the heat dissipation (heat resistance) of the entire electronic device having a substrate having a CM structure.
【0013】[0013]
【課題を解決するための手段】本発明の実施態様のひと
つに、金属板又は複合金属板で構成されるコア材と該コ
ア材上に形成された配線層とを備えたメタルコア基板
と、前記配線層と端子が接続されている前記電子部品と
を有する電子装置であって、前記コア材と前記電子部品
とが高熱導伝性部材を介して隣接するように該高熱伝導
性部材が配置されているものがある。According to one embodiment of the present invention, there is provided a metal core substrate comprising a core material composed of a metal plate or a composite metal plate, and a wiring layer formed on the core material, An electronic device having the wiring layer and the electronic component to which a terminal is connected, wherein the high thermal conductivity member is arranged such that the core member and the electronic component are adjacent to each other via a high thermal conductivity member. There is something.
【0014】このような構造により、電子装置の放熱性
が向上する。With such a structure, the heat dissipation of the electronic device is improved.
【0015】また、このような基板をインターポーザ
(他の基板に搭載する基板のことをいう)として用いる
場合、インターポーザが搭載される他の基板と高発熱電
子部品とが、高熱導伝性部材を介して接するように該高
熱導伝性部材を配置した構造、もしくはインターポーザ
が搭載される他の基板とインターポーザとして用いた基
板を構成する金属板とが高熱導伝性部材を介して接する
ように該高熱導伝性部材を配置した構造を備えた電子装
置が好ましい。When such a substrate is used as an interposer (which means a substrate to be mounted on another substrate), the other substrate on which the interposer is mounted and the high-heat-generating electronic component have a high heat-conducting member. The structure in which the high heat conductive member is arranged so as to be in contact with each other, or another substrate on which the interposer is mounted and the metal plate constituting the substrate used as the interposer are in contact with each other through the high heat conductive member. An electronic device having a structure in which a high heat conductive member is arranged is preferable.
【0016】なお、上述の金属板に、少なくともニッケ
ル、クロム、コバルト、アルミニウムのいずれかを含む
鉄系合金、あるいは該鉄系合金に銅クラッドを施した鉄
系複合材、タングステン、銅、モリブデン、タンタル、
ニッケル、アルミニウムなどを用いると、高熱伝導性と
高剛性を備えることができるようになる。例えば表1に
示すように、銅やアルミニウムを用いると、安価に製造
できるだけでなく、熱伝導率も高いので、放熱性が良
い。また、メイン基板をアルミナやガラセラ等のセラミ
ックを用いた基板とする場合には、インバー(鉄−36
wt%ニッケル合金)や42アロイ(鉄−42wt%ニ
ッケル合金)は高弾性でかつ熱膨張係数が低いので、こ
れらを使用したメタルコアインタポーザを使用すること
により、インタポーザとメイン基板の熱膨張率差を小さ
くして、はんだ接続信頼性を向上することができる。特
にインバーや42アロイのような鉄−ニッケルを主成分
とする合金は、それらの組成を変化させることにより、
メイン基板の種類に応じた熱膨張率のインタポーザとす
ることが可能であり、メイン基板とインタポーザ間のは
んだ接続信頼性を向上することができる。An iron-based alloy containing at least one of nickel, chromium, cobalt, and aluminum on the above-mentioned metal plate, or an iron-based composite material obtained by applying copper clad to the iron-based alloy, tungsten, copper, molybdenum, tantalum,
By using nickel, aluminum or the like, it becomes possible to provide high thermal conductivity and high rigidity. For example, as shown in Table 1, when copper or aluminum is used, not only can it be manufactured at low cost, but also the thermal conductivity is high, so that the heat dissipation is good. When the main substrate is a substrate made of ceramics such as alumina or glass ceramic, Invar (iron-36
wt% nickel alloy) and 42 alloy (iron-42 wt% nickel alloy) have high elasticity and a low coefficient of thermal expansion. Therefore, by using a metal core interposer that uses them, the difference in the coefficient of thermal expansion between the interposer and the main board can be reduced. By making it smaller, the solder connection reliability can be improved. In particular, alloys containing iron-nickel as a main component, such as Invar and 42 alloy, are changed by changing their composition.
It is possible to use an interposer having a coefficient of thermal expansion according to the type of the main board, and it is possible to improve reliability of solder connection between the main board and the interposer.
【0017】[0017]
【表1】
また、このような鉄−ニッケルを主成分とする高弾性金
属を前記金属板として用いる場合には、これらは熱伝導
率が低いので、表面を熱伝導性が高い部材、例えば銅め
っきで被覆する構造(複合金属板)とすることが好まし
い。この被覆は、絶縁樹脂との密着性向上のための粗化
処理を行う際にも有効に使用できる。[Table 1] Further, when such a highly elastic metal containing iron-nickel as a main component is used as the metal plate, since they have low thermal conductivity, the surface is coated with a member having high thermal conductivity, for example, copper plating. The structure (composite metal plate) is preferable. This coating can be effectively used also when performing a roughening treatment for improving the adhesion to the insulating resin.
【0018】なお、これまで述べてきた高熱伝導性部材
は、一般に配線基板の絶縁材料として使用されるエポキ
シ・ポリイミドなどの樹脂材料(熱伝導率:0.2〜0.3W/
m・k)と比較して、熱伝導性の高い材料のことをいい、
Al、銀、金、導電性樹脂、銅、及びはんだの少なくと
も1つ若しくはこれらを組み合わせた材料(熱伝導率:
数W/m・k以上)を用いるのが好ましい。The high heat conductive member described so far is a resin material (heat conductivity: 0.2 to 0.3 W // W) which is generally used as an insulating material for a wiring board.
m ・ k) is a material with higher thermal conductivity than
At least one of Al, silver, gold, conductive resin, copper, and solder, or a material combining these (thermal conductivity:
It is preferable to use several W / m · k or more).
【0019】特に、その接続に少なくともはんだを用い
ると、電子部品の搭載工程(リフロー)を用いて形成す
ることができるので、プロセス工程の簡略化が可能であ
る。In particular, if at least solder is used for the connection, it can be formed by using the mounting process (reflow) of the electronic component, so that the process steps can be simplified.
【0020】また、電子部品の搭載を考慮すると、電子
部品に金属(特に、Al、銀、金)の電極を形成してお
き、この電極と金属板をはんだ、導電性樹脂などで接続
する構成とすることが望ましい。場合によっては低コス
ト化のため、特に接続のためだけの金属電極を設けない
電子部品を、銀ペースト等の導線性樹脂や接着剤で接続
しても良い。ただし接着剤は、放熱性という観点では有
利ではない。In consideration of mounting electronic components, a metal (particularly, Al, silver, and gold) electrode is formed on the electronic component, and the electrode and the metal plate are connected by solder, conductive resin, or the like. Is desirable. In some cases, in order to reduce costs, electronic components not provided with metal electrodes only for connection may be connected with a conductive resin such as silver paste or an adhesive. However, the adhesive is not advantageous in terms of heat dissipation.
【0021】さらに、これまで述べてきた導体層は、一
般的に多層配線板に使用されるステンレス、ニクロム、
タングステン、アルミニウムなどの箔でもよいが、好ま
しくは銅の箔である。Further, the conductor layers described so far are made of stainless steel, nichrome, which are generally used for multilayer wiring boards.
A foil such as tungsten or aluminum may be used, but a copper foil is preferable.
【0022】また、放熱用ビアホールを形成する方法と
しては、ドリルやプラズマ、感光性材料を混練した樹脂
のフォトリソグラフィでも可能であるが、望ましくはレ
ーザによる加工である。レーザとして、高エネルギ出力
のCO2レーザ、紫外線レーザ、Xeレーザ、エキシマ
レーザ、YAGレーザ、YLFレーザ、Arレーザなど
を用いてい形成することが可能であるが、CO2レーザ
又は紫外線レーザで形成することが好ましい。特に、紫
外線レーザは、樹脂を炭化させることなく分解し、微小
径のビアホールを形成できる特徴を持っているので、高
熱導伝性部材と信号配線の不要なコンタクトを防止する
ことができる。また、ドリルを用いれば、製造コストを
下げることができる。As a method for forming the heat dissipation via hole, a drill, plasma, or photolithography of a resin in which a photosensitive material is kneaded can be used, but laser processing is preferable. As a laser, a high energy output CO 2 laser, an ultraviolet laser, a Xe laser, an excimer laser, a YAG laser, a YLF laser, an Ar laser, or the like can be used, but a CO 2 laser or an ultraviolet laser can be used. preferable. In particular, the ultraviolet laser has a feature that it can decompose a resin without carbonizing it and form a via hole having a minute diameter, so that unnecessary contact between the high heat conductive member and the signal wiring can be prevented. Moreover, if a drill is used, the manufacturing cost can be reduced.
【0023】本発明に用いる配線形成法のめっきに、
銅、錫、はんだ、ニッケル、クロム、金、およびこれら
の複合材のいずれかを用いることも好ましい。For the plating of the wiring forming method used in the present invention,
It is also preferable to use any of copper, tin, solder, nickel, chromium, gold, and composite materials thereof.
【0024】本発明に用いる放熱用ビアホールを介して
電子部品および基板の金属板を接続する方法は、金属め
っきにより接続する方法、導伝性物質(金属フィラを混
練した樹脂・接着剤、導伝性樹脂など)をビアホールに
塗布・充填する方法、またははんだを充填する方法など
である。The method of connecting the electronic component and the metal plate of the substrate through the heat dissipation via hole used in the present invention includes a method of connecting by metal plating, a conductive material (resin / adhesive mixed with metal filler, conductive material). Resin or the like) is applied and filled in the via hole, or a method of filling solder is used.
【0025】[0025]
【発明の実施の形態】以下、本発明の実施例について詳
細に説明する。
<実施例1>図1は、本発明に関わる電子装置に用いる
電子基板の製造フローを示す図である。BEST MODE FOR CARRYING OUT THE INVENTION Embodiments of the present invention will be described in detail below. <Embodiment 1> FIG. 1 is a diagram showing a manufacturing flow of an electronic substrate used in an electronic device according to the present invention.
【0026】まず、本実施例により製造した電子基板の
一例を図1の工程(g)で説明する。First, an example of the electronic substrate manufactured according to this embodiment will be described with reference to step (g) in FIG.
【0027】本実施例による電子基板は、金属板101
(厚さ0.2mmの42アロイ)とその金属板101の
表面を覆っている粗化されためっき層102とを備えた
コア材である複合金属板103と、複合金属板103の
上に絶縁層であるエポキシ樹脂(80μm厚程度)とそ
のエポキシ樹脂により積層接着された導体層である銅箔
(約18μm厚)とエポキシ樹脂に開口されているビア
ホール107とで構成される配線層104と、放熱用ビ
アホール108(113)と、厚膜銅めっき109と、
ソルダレジスト114と、外部端子118(Ag、A
u、あるいはアルミのいずれかであるが本実施例ではA
u)を有する半導体部品115と、放熱用電極117
(Au)と、はんだ116とで構成されており、放熱用
ビアホール113に充填され複合金属板103と放熱用
電極117に接するように高熱導電性部材の一つである
はんだが形成されている。The electronic substrate according to this embodiment is the metal plate 101.
A composite metal plate 103 which is a core material including (42 alloy having a thickness of 0.2 mm) and a roughened plating layer 102 covering the surface of the metal plate 101, and insulation on the composite metal plate 103. A wiring layer 104 composed of an epoxy resin (about 80 μm thick) which is a layer, a copper foil (about 18 μm thick) which is a conductor layer laminated and adhered by the epoxy resin, and a via hole 107 opened in the epoxy resin; A heat dissipation via hole 108 (113), a thick film copper plating 109,
Solder resist 114 and external terminals 118 (Ag, A
Either u or aluminum, but in this embodiment A
u), a semiconductor component 115, and a heat dissipation electrode 117.
It is composed of (Au) and solder 116, and a solder, which is one of the high thermal conductive members, is formed so as to fill the heat dissipation via hole 113 and contact the composite metal plate 103 and the heat dissipation electrode 117.
【0028】このように半導体部品の外部端子118以
外の領域に形成されている放熱用電極117と放熱用ビ
アホール113に充填されたはんだの2層からなる高熱
導伝性部材が半導体部品101から生じる熱を基板に拡
散させているので、電子基板の一部に熱がこもることが
無く、電子部品全体の放熱性を向上させることができ
る。As described above, a high heat conductive member composed of two layers of the heat radiating electrode 117 formed in the region other than the external terminal 118 of the semiconductor component and the solder filled in the heat radiating via hole 113 is generated from the semiconductor component 101. Since the heat is diffused in the substrate, the heat does not stay in a part of the electronic substrate, and the heat dissipation of the entire electronic component can be improved.
【0029】次に、この電子基板の製造方法の一例につ
いて説明する。この製造方法は次の工程によりなされ
る。Next, an example of a method of manufacturing this electronic substrate will be described. This manufacturing method is performed by the following steps.
【0030】工程(a):金属板101として、厚さ
0.2mmの42アロイ(鉄−42wt%ニッケル合
金)を用意する。この金属板101の42アロイに対
し、銅めっき102を施して熱伝導性を向上させる。さ
らに、この銅めっき102の表面を粗化して複合金属板
103を形成する。Step (a): As the metal plate 101, 42 alloy (iron-42 wt% nickel alloy) having a thickness of 0.2 mm is prepared. Copper alloy 102 is applied to 42 alloy of the metal plate 101 to improve thermal conductivity. Further, the surface of the copper plating 102 is roughened to form the composite metal plate 103.
【0031】工程(b):工程(a)の後、複合金属板
の片面に樹脂(80μm厚程度)を塗布し、約18μm
厚の銅箔104を積層して接着することによりメタルコ
ア基板105を形成する。ここで、プリプレグと銅箔を
積層すると安価ですむ。樹脂つき銅箔(RCF;Resin
Coated Copper Foil)を使用すると、後の工程のレーザ
ー穴あけ性や基板完成後の耐電触性が良いので、微細化
対応に有利である。Step (b): After the step (a), a resin (about 80 μm thick) is applied on one surface of the composite metal plate to a thickness of about 18 μm.
A metal core substrate 105 is formed by laminating and adhering thick copper foils 104. It is cheaper to stack the prepreg and copper foil here. Copper foil with resin (RCF; Resin)
The use of Coated Copper Foil) is advantageous for the miniaturization because it has good laser drilling property in the later process and electric contact resistance after the substrate is completed.
【0032】工程(c):工程(b)の後、メタルコア
基板105の一部の銅箔106を除去し、次にCO2レ
ーザの照射によりエポキシ樹脂を溶解、除去した後、複
合金属板103まで到達する放熱用ビアホール108
と、信号配線用のビアホール107を形成する。また、
ビアホールの形成はドリルで行っても良く、この場合に
は安価ですむ。Step (c): After the step (b), a part of the copper foil 106 of the metal core substrate 105 is removed, and then the epoxy resin is dissolved and removed by irradiation of a CO 2 laser. Heat dissipation via hole 108 to reach
Then, a via hole 107 for signal wiring is formed. Also,
The via holes may be formed by a drill, which is inexpensive in this case.
【0033】工程(d):工程(c)の後、過マンガン
酸カリウム法により樹脂残さの除去処理を施した後、薄
付け化学銅めっき、電気銅めっき液に順次投入すること
で厚膜銅めっき109を析出させ、ビアホール107お
よび放熱用ビアホール108を介して複合金属板103
の表面銅箔と導通せしめる。Step (d): After the step (c), a resin residue is removed by the potassium permanganate method, and then a thin chemical copper plating and an electrolytic copper plating solution are sequentially added to the thick film copper. The plating 109 is deposited, and the composite metal plate 103 is inserted through the via hole 107 and the heat dissipation via hole 108.
Conduct electrical contact with the surface copper foil.
【0034】工程(e):工程(d)の後、表面銅箔の
配線およびランド部となる箇所にエッチングレジスト1
10をラミネートし、塩化第二鉄を用いたエッチングに
より配線層111を形成する。Step (e): After the step (d), the etching resist 1 is formed on the wirings and lands of the surface copper foil.
10 is laminated and the wiring layer 111 is formed by etching using ferric chloride.
【0035】工程(f):以上の工程(b)〜(e)を
繰り返して多層配線層111を形成する。多層配線層を
形成した後、基板側配線の端子となる電極112及び放
熱用ビアホール113を形成する。Step (f): The above steps (b) to (e) are repeated to form the multilayer wiring layer 111. After forming the multi-layered wiring layer, the electrode 112 that serves as a terminal of the board-side wiring and the heat dissipation via hole 113 are formed.
【0036】工程(g):電極112(基板側端子)お
よび放熱用ビアホール113が形成されている領域を除
く領域にソルダレジスト114をラミネートすることに
より、半導体部品115の外部端子118(素子自体の
金メッキされた外部端子若しくは素子自体の端子から再
配線された金メッキ再配線端子)と接続される基板側配
線の電極(端子)112を形成する。その後、半導体部
品115の外部端子以外の表面に形成された外部端子1
18とは絶縁されている放熱用電極117を半導体部品
に形成する。次に、放熱用電極117と複合金属板10
3の間の放熱用ビアホール113にはんだをソルダレジ
ストより若干高く充填するとともに、外部端子118と
電極112の間にはんだを印刷形成する。Step (g): Solder resist 114 is laminated on a region other than the regions where electrodes 112 (terminals on the substrate side) and heat-dissipating via holes 113 are formed, so that external terminals 118 (of the device itself) of semiconductor component 115 are laminated. An electrode (terminal) 112 of the wiring on the substrate is formed, which is connected to a gold-plated external terminal or a gold-plated rewiring terminal that is rewired from the terminal of the element itself. After that, the external terminal 1 formed on the surface of the semiconductor component 115 other than the external terminal 1
A heat-radiating electrode 117 insulated from 18 is formed on the semiconductor component. Next, the heat dissipation electrode 117 and the composite metal plate 10
The heat-dissipating via holes 113 between 3 are filled with solder slightly higher than the solder resist, and the solder is printed between the external terminals 118 and the electrodes 112.
【0037】その後、半導体部品を載置し、リフローす
ることにより半導体部品115を基板にはんだ接続す
る。Thereafter, the semiconductor component is placed and reflowed to solder-connect the semiconductor component 115 to the substrate.
【0038】本実施例の製造方法によれば、放熱用電極
117と複合金属板103の接続にはんだを用いている
ので、外部端子118と電極112との接続に用いるリ
フロー工程で放熱用電極117と複合金属板103を接
続できるようになり工程数の増加を抑制することができ
る。According to the manufacturing method of this embodiment, since solder is used to connect the heat dissipation electrode 117 and the composite metal plate 103, the heat dissipation electrode 117 is used in the reflow process used to connect the external terminal 118 and the electrode 112. Thus, the composite metal plate 103 can be connected, and an increase in the number of steps can be suppressed.
【0039】また、高熱導伝性部材を2層で形成してい
るので、下層の高熱導伝性部材の高さを調整することが
できる。外部端子118と放熱用電極117の高さをほ
ぼ同じ高さにすることができるので、リフローの条件を
ほぼ一致させることができる。Further, since the high heat conductive member is formed in two layers, the height of the lower layer high heat conductive member can be adjusted. Since the height of the external terminal 118 and the height of the heat dissipation electrode 117 can be made substantially the same, the reflow conditions can be made substantially the same.
【0040】また、金属板の表面に金属板(42アロ
イ)よりも高熱導伝性材料である銅の膜を形成している
ので、高い放熱性を確保できている。また、放熱性の確
保を銅膜で行ない、金属板で熱膨張係数の制御を行って
いるので、基板と電子部品の熱膨張率差に起因する接続
不良や電子部品の破壊を抑制することができる。また、
金属板に高剛性で弾性率の高い材料を用いているので、
コア基板の薄化によるスルーホール密度の低下を防止す
ることができるとともに、製造上の優れたハンドリング
特性が得られる。Since a copper film, which is a material having a higher heat conductivity than the metal plate (42 alloy), is formed on the surface of the metal plate, high heat dissipation can be ensured. In addition, since the heat dissipation is ensured by the copper film and the coefficient of thermal expansion is controlled by the metal plate, it is possible to suppress the connection failure and the destruction of the electronic component due to the difference in the thermal expansion coefficient between the substrate and the electronic component. it can. Also,
Because a material with high rigidity and high elastic modulus is used for the metal plate,
It is possible to prevent a decrease in through hole density due to the thinning of the core substrate, and obtain excellent handling characteristics in manufacturing.
【0041】なお、上述の金属板に、少なくともニッケ
ル、クロム、コバルト、アルミニウムのいずれかを含む
鉄系合金、あるいは該鉄系合金に銅クラッドを施した鉄
系複合材、タングステン、銅、モリブデン、タンタル、
ニッケル、アルミニウムなどを用いると、高熱伝導性と
高剛性を備えることができるようになる。例えば表1に
示すように、銅やアルミニウムを用いると、安価に製造
できるだけでなく、熱伝導率も高いので、放熱性が良
い。また、メイン基板をアルミナやガラセラ等のセラミ
ックを用いた基板とする場合には、高弾性率のインバー
(鉄−36wt%ニッケル合金)や42アロイ(鉄−4
2wt%ニッケル合金)は熱膨張係数が低いので、これ
らを使用したメタルコアインタポーザを使用することに
より、インタポーザとメイン基板の熱膨張率差を小さく
して、はんだ接続信頼性を向上することができる。特に
インバーや42アロイのような鉄−ニッケルを主成分と
する合金は、それらの組成を変化させることにより、メ
イン基板の種類に応じた熱膨張率のインタポーザとする
ことが可能であり、メイン基板とインタポーザ間のはん
だ接続信頼性を向上することができる。An iron-based alloy containing at least one of nickel, chromium, cobalt, and aluminum on the above-mentioned metal plate, or an iron-based composite material obtained by copper-cladding the iron-based alloy, tungsten, copper, molybdenum, tantalum,
By using nickel, aluminum or the like, it becomes possible to provide high thermal conductivity and high rigidity. For example, as shown in Table 1, when copper or aluminum is used, not only can it be manufactured at low cost, but also the thermal conductivity is high, so that the heat dissipation is good. When the main substrate is made of a ceramic such as alumina or glass ceramic, Invar (iron-36 wt% nickel alloy) or 42 alloy (iron-4) having a high elastic modulus is used.
Since the 2 wt% nickel alloy) has a low coefficient of thermal expansion, it is possible to reduce the difference in the coefficient of thermal expansion between the interposer and the main board by using the metal core interposer using them, and improve the solder connection reliability. In particular, alloys containing iron-nickel as a main component, such as Invar and 42 alloy, can be used as an interposer having a coefficient of thermal expansion according to the type of the main substrate by changing the composition thereof. The reliability of solder connection between the interposer and the interposer can be improved.
【0042】また、このような鉄−ニッケルを主成分と
する高弾性金属を前記金属板として用いる場合には、こ
れらは熱伝導率が低いので、表面を熱伝導性が高い部
材、例えば銅めっきで被覆する構造(複合金属板)とす
ることが好ましい。この被覆は、絶縁樹脂との密着性向
上のための粗化処理を行う際にも有効に使用できる。Further, when such a highly elastic metal containing iron-nickel as a main component is used as the metal plate, since they have a low thermal conductivity, the surface thereof has a high thermal conductivity, for example, copper plating. It is preferable that the structure (composite metal plate) is covered with. This coating can be effectively used also when performing a roughening treatment for improving the adhesion to the insulating resin.
【0043】なお、これまで述べてきた高熱伝導性部材
は、一般に配線基板の絶縁材料として使用されるエポキ
シ・ポリイミドなどの樹脂材料(熱伝導率:0.2〜0.3W/
m・k)と比較して、熱伝導性の高い材料のことをいい、
Al、銀、金、導電性樹脂、銅、及びはんだの少なくと
も1つ若しくはこれらを組み合わせた材料(熱伝導率:
数W/m・k以上)を用いるのが好ましい。The high heat conductive member described so far is a resin material (heat conductivity: 0.2 to 0.3 W /
m ・ k) is a material with higher thermal conductivity than
At least one of Al, silver, gold, conductive resin, copper, and solder, or a material combining these (thermal conductivity:
It is preferable to use several W / m · k or more).
【0044】特に、その接続にはんだを用いると電子部
品の搭載工程(リフロー)を用いて形成することができ
るので、プロセス工程の簡略化が可能である。In particular, when solder is used for the connection, it can be formed by the mounting process (reflow) of the electronic component, so that the process steps can be simplified.
【0045】また、電子部品との搭載を考慮すると、電
子部品に金属(特に、Al、銀、金)の電極を形成して
おき、この電極と金属板をはんだ、導電性樹脂などで接
続する構成とすることが望ましい。In consideration of mounting on electronic parts, electrodes of metal (in particular, Al, silver, and gold) are formed on the electronic parts, and the electrodes and the metal plate are connected by solder, conductive resin, or the like. It is desirable to have a configuration.
【0046】さらに、これまで述べてきた導体層は、一
般的に多層配線板に使用されるステンレス、ニクロム、
タングステン、アルミニウムなどの箔でもよいが、好ま
しくは銅の箔である。Further, the conductor layers described so far are made of stainless steel, nichrome, which are generally used for multilayer wiring boards.
A foil such as tungsten or aluminum may be used, but a copper foil is preferable.
【0047】また、放熱用ビアホールを形成する方法と
しては、ドリルやプラズマ、感光性材料を混練した樹脂
のフォトリソグラフィでも可能であるが、望ましくはレ
ーザによる加工である。レーザとして、高エネルギ出力
のCO2レーザ、紫外線レーザ、Xeレーザ、エキシマ
レーザ、YAGレーザ、YLFレーザ、Arレーザなど
を用いてい形成することが可能であるが、CO2レーザ
又は紫外線レーザで形成することが好ましい。特に、紫
外線レーザは、樹脂を炭化させることなく分解し、微小
径のビアホールを形成できる特徴を持っているので、高
熱導伝性部材と信号配線の不要なコンタクトを防止する
ことができる。放熱用ビアホールの形成は、複数の絶縁
層および配線層を一括で行うことも可能である。すなわ
ち基板表面から複合金属板103まで到達するざぐり加
工113を工程(f)で行い、工程(c)のざぐり加工
108を省略することができるため、工程数削減による
低コスト化が可能である。このときの放熱用ビアホール
端面の構造を図45(b)に、図1記載の工程による放
熱用ビアホール端面の構造を図45(a)に示す。As a method of forming the heat dissipation via hole, photolithography of a resin in which a drill, plasma, or a photosensitive material is kneaded can be used, but laser processing is preferable. As a laser, a high energy output CO 2 laser, an ultraviolet laser, a Xe laser, an excimer laser, a YAG laser, a YLF laser, an Ar laser, or the like can be used, but a CO 2 laser or an ultraviolet laser can be used. preferable. In particular, the ultraviolet laser has a feature that it can decompose a resin without carbonizing it and form a via hole having a minute diameter, so that unnecessary contact between the high heat conductive member and the signal wiring can be prevented. The heat dissipation via hole can be formed by collectively forming a plurality of insulating layers and wiring layers. That is, since the counterbore processing 113 that reaches the composite metal plate 103 from the substrate surface can be performed in the step (f) and the counterbore processing 108 in the step (c) can be omitted, it is possible to reduce the cost by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a).
【0048】本発明に用いる配線形成法のめっきに、
銅、錫、はんだ、ニッケル、クロム、金、およびこれら
の複合材のいずれかを用いることも好ましい。For the plating of the wiring forming method used in the present invention,
It is also preferable to use any of copper, tin, solder, nickel, chromium, gold, and composite materials thereof.
【0049】本発明に用いる放熱用ビアホールを介して
電子部品および基板の金属板を接続する方法は、金属め
っきにより接続する方法、導伝性物質(金属フィラを混
練した樹脂・接着剤、導伝性樹脂など)をビアホールに
塗布・充填する方法、またははんだを充填する方法など
である。
<実施例2>実施例2を電子基板の構造断面図である図
2を用いて説明する。The method of connecting the electronic component and the metal plate of the substrate through the heat-dissipating via hole used in the present invention includes a method of connecting by metal plating, a conductive material (resin / adhesive mixed with metal filler, conductive material). Resin or the like) is applied and filled in the via hole, or a method of filling solder is used. Example 2 Example 2 will be described with reference to FIG. 2, which is a structural cross-sectional view of an electronic substrate.
【0050】多層配線層201が複合金属板の両面に積
層されていること以外は、実施例1と同様の構造であ
る。The structure is the same as that of the first embodiment except that the multilayer wiring layer 201 is laminated on both surfaces of the composite metal plate.
【0051】この構造は、実施例1の工程(b)の前
に、基板の反対側の面に放熱用ビアホールの形成を除い
て(b)〜(f)の工程を順に実施し、基板の反転を行
って(b)〜(g)を実施する。In this structure, prior to the step (b) of Example 1, steps (b) to (f) are sequentially performed except for the formation of a heat dissipation via hole on the opposite surface of the substrate, and Inversion is carried out to carry out (b) to (g).
【0052】この実施例の構造は、メタルコア基板の表
裏の構成が近くなるので、コア材を中心として表裏の熱
膨張係数が近くなるため、バイメタル効果による基板の
反りが少さくなる。本実施例によれば、実施例1よりも
半導体部品の外部端子と電子基板の電極との間の接続信
頼性を高めることができる。また、基板のコア材を薄く
することが可能となるため、基板の軽量化、低コスト化
が可能となる。実施例1にも記載のとおり、放熱用ビア
ホールの形成を複数の絶縁層および配線層を一括で行え
ば、図1の工程(c)のざぐり加工108を省略するこ
とができるため、工程数削減による低コスト化が可能で
ある。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例3>実施例3について電子基板の製造フローを
示す図3を用いて説明する。In the structure of this embodiment, since the front and back surfaces of the metal core substrate are close to each other, the thermal expansion coefficients of the front and back surfaces around the core material are close to each other, so that the warpage of the substrate due to the bimetal effect is reduced. According to the present embodiment, the connection reliability between the external terminal of the semiconductor component and the electrode of the electronic substrate can be improved as compared with the first embodiment. Moreover, since the core material of the substrate can be made thin, the weight and cost of the substrate can be reduced. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Embodiment 3> Embodiment 3 will be described with reference to FIG. 3 showing a flow of manufacturing an electronic substrate.
【0053】(1文削除)(Delete one sentence)
【0054】実施例3の構造で、実施例2の構造と異な
るのは、複合金属板305の一部に窓303があり、そ
の窓を用いて形成されている銅めっきされたスルーホー
ル312により他方の面に形成されている配線層と接続
されている点である。The structure of the third embodiment differs from the structure of the second embodiment in that a window 303 is formed in a part of the composite metal plate 305, and a copper-plated through hole 312 formed using the window 303 is used. The point is that it is connected to the wiring layer formed on the other surface.
【0055】(削除)図3の(a)〜(h)を用いてこ
の構成を製造することが可能な製造方法について説明す
る。(Deleted) A manufacturing method capable of manufacturing this structure will be described with reference to FIGS.
【0056】工程(a):金属板301として厚さ0.
1mmの42アロイを用意する。次に、金属板の両面に
エッチングレジスト302をラミネートし、両面より露
光・現像することにより、窓303を形成する箇所のレ
ジストを除去する。さらに、塩化第二鉄溶液を用いたエ
ッチングにより金属板に窓303を形成する。この窓と
しては、0.2mm2を0.4mm間隔に、必要な箇所
に並べて配置する。Step (a): The metal plate 301 has a thickness of 0.
Prepare 1 mm of 42 alloy. Next, etching resists 302 are laminated on both surfaces of the metal plate, and exposed and developed from both surfaces to remove the resist at the portions where the windows 303 are formed. Further, the window 303 is formed in the metal plate by etching using a ferric chloride solution. As this window, 0.2 mm 2 is arranged at 0.4 mm intervals and arranged at necessary positions.
【0057】工程(b):金属板に対して銅めっき30
4を施すことにより電気伝導性の向上させて複合金属板
を形成する。この形成後、銅めっきの表面を粗化する。Step (b): Copper plating 30 on metal plate
By applying No. 4, the electrical conductivity is improved and the composite metal plate is formed. After this formation, the surface of the copper plating is roughened.
【0058】工程(c):複合金属板の両面に樹脂付き
銅箔306もしくは樹脂プリプレグと銅箔を個別にを積
層接着し、メタルコア基板307とする。Step (c): A resin-coated copper foil 306 or a resin prepreg and a copper foil are separately laminated and adhered to both surfaces of the composite metal plate to form a metal core substrate 307.
【0059】工程(d):複合金属板301の窓303
および窓ではない領域の一部の表面銅箔308を除去し
た後、CO2レーザを照射してエポキシ樹脂を溶解・除
去することにより、窓を貫通するスルーホール309、
複合金属板を底とするビアホール310および放熱用ビ
アホール311を形成する。Step (d): Window 303 of composite metal plate 301
And after removing a part of the surface copper foil 308 in a region other than the window, a through hole 309 penetrating the window is obtained by irradiating a CO 2 laser to dissolve and remove the epoxy resin.
A via hole 310 having a bottom of the composite metal plate and a heat radiating via hole 311 are formed.
【0060】工程(e):過マンガン酸カリウム法によ
り樹脂残さの除去処理を施した後、薄付け化学銅めっ
き、電気銅めっき液に順次投入することで厚膜銅めっき
312を析出させ、スルーホール309を介して基板表
裏の銅箔間、ビアホール310および放熱用ビアホール
311を介して複合金属板と最上面の銅箔との間を導通
せしめる。Step (e): After the resin residue is removed by the potassium permanganate method, the thin film copper plating 312 is deposited by sequentially adding it to thin chemical copper plating and electrolytic copper plating solution, and then through. Conduction is provided between the copper foils on the front and back of the substrate via the hole 309, and between the composite metal plate and the copper foil on the uppermost surface via the via hole 310 and the heat dissipation via hole 311.
【0061】工程(f):基板側配線の電極及びランド
部となる箇所にエッチングレジスト313をラミネート
し、塩化第二鉄を用いたエッチングにより多層配線層3
14の1層目の配線を形成する。Step (f): A multilayer wiring layer 3 is formed by laminating an etching resist 313 on the electrodes and lands of the wiring on the substrate and by etching with ferric chloride.
The wiring of the first layer 14 is formed.
【0062】工程(g):(c)〜(e)の工程を繰り
返して多層化した多層配線層314を構成する。Step (g): The steps (c) to (e) are repeated to form a multilayer wiring layer 314.
【0063】工程(h):基板の配線電極(端子)30
8と放熱用ビアホールに充填した銅めっき319を除く
領域にソルダレジスト315を製膜する。Step (h): Wiring electrode (terminal) 30 on the substrate
8 and a solder resist 315 is formed in a region excluding the copper plating 319 filling the heat dissipation via holes.
【0064】次に、半導体部品に外部端子と同じ高さに
放熱用電極317を形成する。最後に、半導体部品31
6の外部端子318と基板側配線の電極(端子)30
8、半導体部品316の放熱用電極317と銅めっき3
04とを、はんだを用いて接続する。Next, the heat dissipation electrode 317 is formed on the semiconductor component at the same height as the external terminal. Finally, the semiconductor component 31
6, the external terminal 318 of FIG.
8. Semiconductor component 316 heat dissipation electrode 317 and copper plating 3
04 and 04 are connected using solder.
【0065】本実施例の構造によれば、実施例2よりも
表裏の配線の接続の自由度を上げることができるため、
配線パターンの設計自由度が増し、またより高性能、多
機能な電子部品を搭載することが可能となる。実施例1
にも記載のとおり、放熱用ビアホールの形成を複数の絶
縁層および配線層を一括で行えば、図1の工程(c)の
ざぐり加工108を省略することができるため、工程数
削減による低コスト化が可能である。このときの放熱用
ビアホール端面の構造を図45(b)に、図1記載の工
程による放熱用ビアホール端面の構造を図45(a)に
示す。
<実施例4>実施例4を、電子基板の構造断面図である
図4を用いて説明する。According to the structure of this embodiment, the degree of freedom in connecting the front and back wirings can be increased more than that of the second embodiment.
The degree of freedom in designing the wiring pattern is increased, and it becomes possible to mount electronic parts with higher performance and more functions. Example 1
As described above, if the heat-dissipating via hole is formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted. Is possible. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Fourth Embodiment> A fourth embodiment will be described with reference to FIG. 4, which is a structural cross-sectional view of an electronic substrate.
【0066】実施例4と実施例3の構成上の相違点は、
実施例3では1つの放熱用ビアホール311に高熱導伝
性部材が充填されていたのに対して、実施例4では2つ
の放熱用ビアホール部401、402を設け、はんだを
充填している。The difference in structure between the fourth embodiment and the third embodiment is that
In the third embodiment, one heat-dissipating via hole 311 is filled with the high heat conductive member, whereas in the fourth embodiment, two heat-dissipating via hole portions 401 and 402 are provided and filled with solder.
【0067】また、本実施例の構造は、実施例3の工程
(c)(d)における放熱用ビアホールの形成個所を別
のマスクを用いて複数個に分割して行うことにより、実
施例3の工程を用いて製造することができる。Further, the structure of this embodiment is such that the heat dissipation via holes formed in the steps (c) and (d) of the third embodiment are divided into a plurality of parts by using another mask, so that the structure of the third embodiment is improved. Can be manufactured using the process of.
【0068】本実施例の構造によれば、個々の放熱用ビ
アホールの大きさを小さくすることにより、その形成方
法が容易になるため、低コスト化が可能となる。また、
放熱パスに使用して、配線等に使用できなくなるスペー
スを小さくすることができるため、基板スペースを効率
よく使用することができ、また配線設計ルールを緩和す
ることができる。実施例1にも記載のとおり、放熱用ビ
アホールの形成を複数の絶縁層および配線層を一括で行
えば、図1の工程(c)のざぐり加工108を省略する
ことができるため、工程数削減による低コスト化が可能
である。このときの放熱用ビアホール端面の構造を図4
5(b)に、図1記載の工程による放熱用ビアホール端
面の構造を図45(a)に示す。
<実施例5>実施例5を、電子基板の構造断面図である
図5を用いて説明する。According to the structure of this embodiment, by reducing the size of each heat dissipation via hole, the method of forming the via hole can be facilitated, and the cost can be reduced. Also,
Since it can be used as a heat dissipation path to reduce the space that cannot be used for wiring, etc., the board space can be used efficiently and the wiring design rule can be relaxed. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
5 (b) shows the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 (a). <Fifth Embodiment> A fifth embodiment will be described with reference to FIG. 5, which is a structural cross-sectional view of an electronic substrate.
【0069】実施例1の構造と異なるのは、図1の放熱
用電極117の下方のはんだの層をはんだではなく銅め
っきが充填されており、その銅めっきと放熱用電極がは
んだで接続される点である。The difference from the structure of the first embodiment is that the solder layer below the heat dissipation electrode 117 of FIG. 1 is filled with copper plating instead of solder, and the copper plating and the heat dissipation electrode are connected by solder. That is the point.
【0070】この構造は次の工程により製造される。
工程(a)〜工程(f):実施例1と同様。
工程(g):実施例1の工程(g)では、放熱用ビアホ
ールをはんだで充填しているが、本実施例では、はんだ
を充填するのではなく銅めっきで充填し、充填後基板表
面を研磨により平坦化させる。This structure is manufactured by the following steps. Steps (a) to (f): The same as in Example 1. Step (g): In step (g) of Example 1, the heat dissipation via holes are filled with solder, but in the present example, instead of filling the solder, copper plating is used to fill the substrate surface after filling. It is made flat by polishing.
【0071】上述の工程の後、基板側配線の電極(端
子)および銅めっきを除く領域にソルダレジスト515
をラミネートする。その後、半導体部品を仮置した後、
半導体部品516の外部端子519とメタルコア基板の
電極512、半導体部品516の放熱用電極518と充
填した銅を、はんだ517で接続する。After the above steps, the solder resist 515 is formed on the area of the substrate side wiring except the electrodes (terminals) and the copper plating.
Laminate. After that, after temporarily placing the semiconductor parts,
The external terminal 519 of the semiconductor component 516, the electrode 512 of the metal core substrate, the heat radiation electrode 518 of the semiconductor component 516, and the filled copper are connected by the solder 517.
【0072】本実施例の構造によれば、放熱用ビアホー
ルを熱導伝性の高い銅で充填しているので、電子基板の
放熱特性を向上させることができる。また、絶縁層高さ
と放熱用ビアホール高さをほぼ一致させておくことによ
り、はんだ接続性を良くし、またはんだボイドの発生率
を低下することができる。According to the structure of this embodiment, since the heat dissipation via hole is filled with copper having high heat conductivity, the heat dissipation characteristic of the electronic substrate can be improved. Further, by making the height of the insulating layer and the height of the heat dissipation via holes substantially the same, it is possible to improve the solder connectivity and reduce the occurrence rate of voids.
【0073】また、充填した銅をはんだで接続している
ので、半導体部品516の外部端子519と電極512
との接続を行うリフロー工程で、放熱用電極518との
接続も行うことができるので、製造コストを抑えること
ができる。実施例1にも記載のとおり、放熱用ビアホー
ルの形成を複数の絶縁層および配線層を一括で行えば、
図1の工程(c)のざぐり加工108を省略することが
できるため、工程数削減による低コスト化が可能であ
る。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例6>実施例6を、電子基板の構造断面図である
図6を用いて説明する。Further, since the filled copper is connected by the solder, the external terminal 519 of the semiconductor component 516 and the electrode 512 are connected.
Since the connection with the heat dissipation electrode 518 can also be performed in the reflow step of connecting with, the manufacturing cost can be suppressed. As described in Example 1, if a heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once,
Since the counterbore processing 108 of the step (c) of FIG. 1 can be omitted, the cost can be reduced by reducing the number of steps. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Sixth Embodiment> A sixth embodiment will be described with reference to FIG. 6, which is a structural cross-sectional view of an electronic substrate.
【0074】実施例6は、積層配線層を複合金属板の他
方の面にも積層したこと以外は、実施例5と同様の構造
である。The sixth embodiment has the same structure as the fifth embodiment except that the laminated wiring layer is also laminated on the other surface of the composite metal plate.
【0075】この実施例の構造は、実施例5の工程
(b)の前に、基板の反対側の面に放熱用ビアホールの
形成を除いて(b)〜(f)の工程を順に実施した後、
基板を反転することで製造することができる。In the structure of this embodiment, before the step (b) of the fifth embodiment, steps (b) to (f) are sequentially carried out except that the heat dissipation via hole is not formed on the surface opposite to the substrate. rear,
It can be manufactured by inverting the substrate.
【0076】この実施例の構造によれば、メタルコア基
板の表裏の材料構成が近くなるので、コア材を中心とし
て表裏の熱膨張係数が近似することになる。従って、基
板の反りを抑制でき、半導体部品の外部端子519と基
板側配線の電極512との間の接続信頼性を高めること
ができる。実施例1にも記載のとおり、放熱用ビアホー
ルの形成を複数の絶縁層および配線層を一括で行えば、
図1の工程(c)のざぐり加工108を省略することが
できるため、工程数削減による低コスト化が可能であ
る。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例7>実施例7を、電子基板の構造断面図である
図7を用いて説明する。According to the structure of this embodiment, the material composition of the front and back surfaces of the metal core substrate is close to each other, so that the thermal expansion coefficients of the front and back surfaces are approximated with the core material as the center. Therefore, the warp of the substrate can be suppressed, and the connection reliability between the external terminal 519 of the semiconductor component and the electrode 512 of the substrate side wiring can be improved. As described in Example 1, if a heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once,
Since the counterbore processing 108 of the step (c) of FIG. 1 can be omitted, the cost can be reduced by reducing the number of steps. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Example 7> Example 7 will be described with reference to FIG. 7, which is a structural cross-sectional view of an electronic substrate.
【0077】実施例7の構造は、金属板の上下の配線構
造体を金属板に設けた窓を貫通するビアホール701が
設けられていること以外は、実施例6と同様である。な
お、スルーホール701の形成は実施例3の工程を用い
る。The structure of the seventh embodiment is the same as that of the sixth embodiment except that a via hole 701 is provided which penetrates a window in which wiring structures above and below the metal plate are provided in the metal plate. The formation of the through hole 701 uses the process of the third embodiment.
【0078】実施例7の構造によれば、実施例6の構造
に比べ、上下の配線層を接続するビアホールを高密度化
することができるため、基板の配線密度を向上すること
ができる。
(一文削除)According to the structure of the seventh embodiment, the density of via holes connecting the upper and lower wiring layers can be increased as compared with the structure of the sixth embodiment, so that the wiring density of the substrate can be improved. (Delete one sentence)
【0079】この構造は実施例6の工程(a)の前に、
実施例3の工程(a)を実施することで製造可能であ
る。実施例1にも記載のとおり、放熱用ビアホールの形
成を複数の絶縁層および配線層を一括で行えば、図1の
工程(c)のざぐり加工108を省略することができる
ため、工程数削減による低コスト化が可能である。この
ときの放熱用ビアホール端面の構造を図45(b)に、
図1記載の工程による放熱用ビアホール端面の構造を図
45(a)に示す。
<実施例8>実施例8を、電子基板の構造断面図である
図8を用いて説明する。This structure was formed before the step (a) in Example 6
It can be manufactured by carrying out the step (a) of Example 3. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole according to the process shown in FIG. <Embodiment 8> Embodiment 8 will be described with reference to FIG. 8 which is a structural cross-sectional view of an electronic substrate.
【0080】実施例8の構造で実施例7の構造と異なる
のは、複合金属板に接続された放熱用ビアホール801
が複数に分割され、そのビアホールに銅めっきが充填さ
れ、その銅めっきがはんだを介して半導体部品の放熱用
電極と接続されている点である。The structure of the eighth embodiment differs from the structure of the seventh embodiment in that a heat dissipation via hole 801 connected to the composite metal plate is used.
Is divided into a plurality of parts, the via hole is filled with copper plating, and the copper plating is connected to the heat dissipation electrode of the semiconductor component via solder.
【0081】この構造は、実施例6の工程(b)〜
(g)における絶縁層と導体層の除去パターンを変更す
ることにより製造可能である。This structure corresponds to the steps (b) to (6) in Example 6.
It can be manufactured by changing the removal pattern of the insulating layer and the conductor layer in (g).
【0082】実施例8の構造によれば、実施例7と比較
して、配線を施すことが可能なスペースを増やすことが
可能で、基板の小面積化や配線設計ルールの緩和が可能
である。また、放熱ビア部形成コストも下げることがで
きる。実施例1にも記載のとおり、放熱用ビアホールの
形成を複数の絶縁層および配線層を一括で行えば、図1
の工程(c)のざぐり加工108を省略することができ
るため、工程数削減による低コスト化が可能である。こ
のときの放熱用ビアホール端面の構造を図45(b)
に、図1記載の工程による放熱用ビアホール端面の構造
を図45(a)に示す。
<実施例9>実施例9を、電子基板の構造断面図である
図9を用いて説明する。According to the structure of the eighth embodiment, as compared with the seventh embodiment, it is possible to increase the space where wiring can be provided, and it is possible to reduce the area of the substrate and relax the wiring design rule. . Also, the cost for forming the heat dissipation via portion can be reduced. As described in Example 1, if a heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once, the structure shown in FIG.
Since the counterbore processing 108 in the step (c) can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole by the process described in FIG. <Embodiment 9> Embodiment 9 will be described with reference to FIG. 9 which is a structural cross-sectional view of an electronic substrate.
【0083】実施例9の構造で実施例8の構造と異なる
のは、ビアホール801を配線層の最上層から複合金属
板までではなく、配線層の第1層目のビアホールが形成
されていた領域に第1層目の配線層を形成している点、
ビアホール801の第2層目から最上層までが銅めっき
902で充填されているビアホール901としている点
である。The structure of the ninth embodiment differs from that of the eighth embodiment in that the via hole 801 is not formed from the uppermost layer of the wiring layer to the composite metal plate, but in the region where the first layer via hole of the wiring layer is formed. The point that the first wiring layer is formed in
The second layer to the uppermost layer of the via hole 801 is the via hole 901 filled with the copper plating 902.
【0084】実施例9の構造では、放熱用ビアホール部
における熱伝導性が実施例8に比べて若干劣るが、ビア
ホール穴あけの工程を1回省略できるので、低コスト化
が可能である。
<実施例10>実施例10を、電子基板の構造断面図で
ある図10を用いて説明する。In the structure of the ninth embodiment, the thermal conductivity in the heat dissipation via hole portion is slightly inferior to that of the eighth embodiment, but the cost of the via hole drilling process can be reduced because the step of drilling the via hole can be omitted once. <Example 10> Example 10 will be described with reference to FIG. 10, which is a structural cross-sectional view of an electronic substrate.
【0085】実施例10の構造で実施例7と異なるの
は、配線層の第2層目の放熱用ビアホールを複数個に分
けて設け、内部を銅めっき1002で充填する点と、2
箇所の放熱用電極を共通のはんだで半導体部品に接続し
ている点である。The structure of the tenth embodiment differs from that of the seventh embodiment in that the second layer of heat dissipation via holes of the wiring layer are separately provided and the inside is filled with copper plating 1002.
This is that the heat-radiating electrodes at some points are connected to the semiconductor component by common solder.
【0086】実施例10の構造によれば、放熱用ビアホ
ール部における熱伝導性向上により半導体部品駆動時の
熱をさらに効率よく拡散することができる。According to the structure of the tenth embodiment, the heat conductivity in the heat dissipation via hole portion is improved, so that the heat when driving the semiconductor component can be diffused more efficiently.
【0087】また、この構造もビアホールのパターンを
変化させることで、実施例7の製造方法により製造する
ことができる。実施例1にも記載のとおり、放熱用ビア
ホールの形成を複数の絶縁層および配線層を一括で行え
ば、図1の工程(c)のざぐり加工108を省略するこ
とができるため、工程数削減による低コスト化が可能で
ある。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例11>実施例11を、電子基板の構造断面図で
ある図11を用いて説明する。Also, this structure can be manufactured by the manufacturing method of the seventh embodiment by changing the pattern of the via hole. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Embodiment 11> Embodiment 11 will be described with reference to FIG. 11, which is a structural cross-sectional view of an electronic substrate.
【0088】実施例11の構造は、半導体部品の外部端
子をバンプ型端子1102にしている点、そのバンプ型
端子1102と接続されている基板の電極をバンプ型電
極1103にしている点、放熱用電極を放熱用バンプ型
電極1105にしている点、放熱用ビアホールに充填さ
れた銅めっきの上にバンプ型端子1106が形成されて
いる点、バンプ型端子1102とバンプ型電極1103
とが異方性導電樹脂により電気的に接続されている点、
及び放熱用バンプ型電極1105とバンプ型端子110
3と異方性導電樹脂により電気的に接続されている点以
外は実施例7と同様である。The structure of Example 11 is such that the external terminal of the semiconductor component is the bump type terminal 1102, the electrode of the substrate connected to the bump type terminal 1102 is the bump type electrode 1103, and heat dissipation is performed. The electrode is a heat radiation bump type electrode 1105, the bump type terminal 1106 is formed on the copper plating filled in the heat radiation via hole, the bump type terminal 1102 and the bump type electrode 1103.
And are electrically connected by an anisotropic conductive resin,
And a bump type electrode 1105 for heat dissipation and a bump type terminal 110.
Example 7 is the same as Example 7 except that it is electrically connected to No. 3 by an anisotropic conductive resin.
【0089】より具体的には、実施例5の工程(a)〜
(f)を実施することにより、積層配線層を形成した
後、銅めっきを放熱用ビアホールに施して配線層の最上
層と近接する高さにそろえる。電極及びビアホールを除
く領域にソルダレジストを製膜する。次に基板の配線端
子にバンプ型電極1103を、放熱用ビアホールに充填
した銅めっき上にバンプ型端子1106を形成する。半
導体部品の外部端子として、バンプ型端子1102、1
105を形成する。これら形成したバンプ型の端子(電
極)1102と1103の間、端子(電極)1105と
1106の間に異方性導電樹脂を挟み込み、熱圧着する
ことにより接続する。More specifically, steps (a) to (5) of Example 5 are repeated.
By carrying out (f), after forming the laminated wiring layer, copper plating is applied to the heat radiating via hole so that the height is close to the uppermost layer of the wiring layer. A solder resist is formed on the area excluding the electrodes and via holes. Next, bump type electrodes 1103 are formed on the wiring terminals of the substrate, and bump type terminals 1106 are formed on the copper plating filled in the heat dissipation via holes. Bump type terminals 1102, 1 are used as external terminals of semiconductor parts.
Form 105. Anisotropic conductive resin is sandwiched between the formed bump-type terminals (electrodes) 1102 and 1103, and between the terminals (electrodes) 1105 and 1106, and thermocompression bonding is performed for connection.
【0090】本実施例の構造によれば、はんだを用いる
接続工程よりも低温で載置できるため、基板製造時の熱
履歴を低減できる。さらに、材料コストも低減できる。
実施例1にも記載のとおり、放熱用ビアホールの形成を
複数の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例12>実施例12は、図12に示すように、メ
タルコア基板と半導体部品の外部端子のない面とを対向
させて載置し、ワイヤボンディングによりメタルコア基
板表面の電極と半導体部品の外部端子とを接続している
点、及び放熱用電極を設けずに充填したはんだのみで接
続している点以外は、実施例3と同様である。According to the structure of this embodiment, since the mounting can be performed at a temperature lower than that of the connection process using solder, the thermal history at the time of manufacturing the substrate can be reduced. Further, the material cost can be reduced.
As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Embodiment 12> In Embodiment 12, as shown in FIG. 12, the metal core substrate and the surface of the semiconductor component having no external terminals are placed so as to face each other, and the electrodes on the surface of the metal core substrate and the outside of the semiconductor component are bonded by wire bonding. The third embodiment is the same as the third embodiment except that the terminals are connected and that only the filled solder is provided without providing the heat dissipation electrode.
【0091】本実施例の構造によれば、一般的に用いら
れるワイヤボンディングによる接続に対応し、また半導
体部品と複合金属板との接続面積の増加により、複合金
属板への熱拡散を高めることができる。実施例1にも記
載のとおり、放熱用ビアホールの形成を複数の絶縁層お
よび配線層を一括で行えば、図1の工程(c)のざぐり
加工108を省略することができるため、工程数削減に
よる低コスト化が可能である。このときの放熱用ビアホ
ール端面の構造を図45(b)に、図1記載の工程によ
る放熱用ビアホール端面の構造を図45(a)に示す。
<実施例13>実施例13は、図13に示すように、メ
タルコア基板と半導体部品の外部端子のない面(背面)
とを対向させて載置し、ワイヤボンディングによりメタ
ルコア基板表面の電極と半導体部品の端子とを接続して
いる点、及び放熱用電極を設けずに、充填しためっき
と、そのめっきと半導体部品背面をはんだで接続してい
る点以外は、実施例7と同様である。According to the structure of the present embodiment, it is possible to cope with the connection by the commonly used wire bonding and to increase the heat diffusion to the composite metal plate by increasing the connection area between the semiconductor component and the composite metal plate. You can As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Embodiment 13> As shown in FIG. 13, Embodiment 13 is a surface (rear surface) having no external terminals of the metal core substrate and the semiconductor component.
Are placed facing each other, and the electrode on the surface of the metal core substrate is connected to the terminal of the semiconductor component by wire bonding, and the plated plating and the plating and the semiconductor component rear surface without providing the heat dissipation electrode. Example 7 is the same as Example 7 except that is connected with solder.
【0092】本実施例の構造によれば、半導体部品と複
合金属板との接続面積の増加により、複合金属板への熱
拡散をより高めることができる。実施例1にも記載のと
おり、放熱用ビアホールの形成を複数の絶縁層および配
線層を一括で行えば、図1の工程(c)のざぐり加工1
08を省略することができるため、工程数削減による低
コスト化が可能である。このときの放熱用ビアホール端
面の構造を図45(b)に、図1記載の工程による放熱
用ビアホール端面の構造を図45(a)に示す。
<実施例14>実施例14の構造は、図14に示すよう
に、半導体部品1401の主表面より大きなビアホール
を形成して複合金属板を露出させ、そのビアホールの底
面に半導体部品をはめ込み、はんだにより接続している
点、半導体部品の外部端子1402とメタルコア基板側
配線の電極(配線)1404とをワイヤボンディング1
403により接続したこと以外は、実施例1と同様であ
る。半導体部品1401と複合金属板との接続は、はん
だ以外にも、銀ペーストや接着剤でも良く、この場合半
導体部品にはんだ接続用の金属層を形成しなくても良い
ため、低コスト化できる。According to the structure of this embodiment, the increase of the connection area between the semiconductor component and the composite metal plate can further enhance the heat diffusion to the composite metal plate. As described in Example 1, if the heat-dissipating via holes are collectively formed by a plurality of insulating layers and wiring layers, the spot facing process 1 in the step (c) of FIG. 1 is performed.
Since 08 can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Embodiment 14> As shown in FIG. 14, the structure of Embodiment 14 is such that a via hole larger than the main surface of the semiconductor component 1401 is formed to expose the composite metal plate, and the semiconductor component is fitted to the bottom surface of the via hole and soldered. The external terminal 1402 of the semiconductor component and the electrode (wiring) 1404 of the metal core substrate side wiring are connected by wire bonding 1
The same as Example 1 except that the connection is made by 403. The connection between the semiconductor component 1401 and the composite metal plate may be silver paste or an adhesive other than solder. In this case, the metal layer for solder connection need not be formed on the semiconductor component, so that the cost can be reduced.
【0093】本実施例の構造によれば、熱拡散効率を向
上させることができるとともに、製造コストを下げるこ
とができる。実施例1にも記載のとおり、放熱用ビアホ
ールの形成を複数の絶縁層および配線層を一括で行え
ば、図1の工程(c)のざぐり加工108を省略するこ
とができるため、工程数削減による低コスト化が可能で
ある。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例15>実施例15は、図15に示すように、半
導体部品901を載置するメタルコア基板の複合金属部
に窪み1501を設け、窪みに半導体部品901を載置
した以外は、実施例14と同様である。According to the structure of this embodiment, the heat diffusion efficiency can be improved and the manufacturing cost can be reduced. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Embodiment 15> Embodiment 15 is the same as Embodiment 15 except that the recess 1501 is provided in the composite metal portion of the metal core substrate on which the semiconductor component 901 is mounted and the semiconductor component 901 is mounted in the recess. Similar to 14.
【0094】本実施例の構造によれば、半導体の載置位
置精度を高めることができ、放熱経路上の複合金属板厚
さを薄くすることによる放熱性向上の効果を得ることが
できる。According to the structure of this embodiment, the mounting position accuracy of the semiconductor can be improved, and the effect of improving the heat dissipation by reducing the thickness of the composite metal plate on the heat dissipation path can be obtained.
【0095】本実施例の構造は、実施例12(実施例
1)の工程(a)の前に、複合金属板にくぼみを設ける
工程を加えることで作成できる。実施例1にも記載のと
おり、放熱用ビアホールの形成を複数の絶縁層および配
線層を一括で行えば、図1の工程(c)のざぐり加工1
08を省略することができるため、工程数削減による低
コスト化が可能である。このときの放熱用ビアホール端
面の構造を図45(b)に、図1記載の工程による放熱
用ビアホール端面の構造を図45(a)に示す。
<実施例16>実施例16の構造は、図16に示す工程
(f)までを、パターンを変えて実施し、放熱用ビアホ
ールに充填した銅めっき1602を介して半導体部品1
601をメタルコア基板に実装するとともに、半導体実
装面の裏面に放熱用ビアホールを介して金属板と接続さ
れた放熱用電極1603を設けたこと以外は、実施例7
と同様である。The structure of this embodiment can be prepared by adding a step of providing a recess to the composite metal plate before the step (a) of the twelfth embodiment (embodiment 1). As described in Example 1, if the heat-dissipating via holes are collectively formed by a plurality of insulating layers and wiring layers, the spot facing process 1 in the step (c) of FIG. 1 is performed.
Since 08 can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Example 16> In the structure of Example 16, the steps up to step (f) shown in FIG. 16 are performed by changing the pattern, and the semiconductor component 1 is inserted through the copper plating 1602 filled in the heat dissipation via holes.
Example 7 except that 601 was mounted on a metal core substrate and a heat dissipation electrode 1603 connected to a metal plate via a heat dissipation via hole was provided on the back surface of the semiconductor mounting surface.
Is the same as.
【0096】本実施例の構造によれば、放熱用電極を介
して熱を拡散することができるため、より優れた冷却能
力を付加することができる。本実施例の構造は、両面に
ビアホールを設ける点を除いて実施例3と同様の工程で
製造可能である。つまり、半導体部品の接続を除いて実
施例3の(a)〜(g)を両面に対して行うことで可能
である。実施例1にも記載のとおり、放熱用ビアホール
の形成を複数の絶縁層および配線層を一括で行えば、図
1の工程(c)のざぐり加工108を省略することがで
きるため、工程数削減による低コスト化が可能である。
このときの放熱用ビアホール端面の構造を図45(b)
に、図1記載の工程による放熱用ビアホール端面の構造
を図45(a)に示す。
<実施例17>実施例17は、図17に示すように、複
数の半導体部品1701および1702をメタルコア基
板の主表面に載置し、さらに電子部品1703を半導体
部品1701および1702の裏面に実装したこと以外
は、実施例3と同様である。According to the structure of this embodiment, the heat can be diffused through the heat dissipation electrode, so that a more excellent cooling capacity can be added. The structure of this embodiment can be manufactured by the same process as that of the third embodiment except that via holes are provided on both sides. That is, it is possible to perform (a) to (g) of Example 3 on both sides except for the connection of the semiconductor components. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost.
The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole by the process described in FIG. <Embodiment 17> In Embodiment 17, as shown in FIG. 17, a plurality of semiconductor components 1701 and 1702 are placed on the main surface of a metal core substrate, and further electronic components 1703 are mounted on the back surfaces of the semiconductor components 1701 and 1702. Other than the above, the same as Example 3.
【0097】本実施例の構造によれば、放熱用電極を介
して熱を拡散することができるため、より優れた冷却能
力を付加されたMCM構造が実現できる。実施例1にも
記載のとおり、放熱用ビアホールの形成を複数の絶縁層
および配線層を一括で行えば、図1の工程(c)のざぐ
り加工108を省略することができるため、工程数削減
による低コスト化が可能である。このときの放熱用ビア
ホール端面の構造を図45(b)に、図1記載の工程に
よる放熱用ビアホール端面の構造を図45(a)に示
す。
<実施例18>実施例18について図18を用いて説明
する。According to the structure of the present embodiment, heat can be diffused through the heat dissipation electrode, so that an MCM structure with a better cooling capacity can be realized. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Embodiment 18> Embodiment 18 will be described with reference to FIG.
【0098】図18において、1801~1812は実施例1の101
〜112と同じ構成を示し、工程(a)〜(f)までは、
電極1812を形成するとともに、電極1813を形成している
点を除いて同様である。
工程(g):電極1813の形成後、少なくとも電極および
放熱用ビアホールを除く所望部にソルダレジスト1815を
ラミネートし、半導体部品1816の端子と電極1812、半導
体部品1816の表面と放熱用ビアホール1814とを、はんだ
1817を介して接続した。
工程(h):最後に、プリプレグを介して銅配線を積層
したプリント基板の最外層に設けた電極1818とメタルコ
ア基板の電極1813をはんだ1819を介して接続した。In FIG. 18, reference numerals 1801 to 1812 designate 101 of the first embodiment.
~ 112 shows the same configuration, steps (a) ~ (f),
This is the same except that the electrode 1812 is formed and the electrode 1813 is formed. Step (g): After forming the electrode 1813, a solder resist 1815 is laminated on a desired portion except at least the electrode and the heat dissipation via hole, and the terminal of the semiconductor component 1816 and the electrode 1812, the surface of the semiconductor component 1816 and the heat dissipation via hole 1814 are formed. , Solder
Connected via 1817. Step (h): Finally, the electrode 1818 provided on the outermost layer of the printed board on which the copper wiring was laminated via the prepreg and the electrode 1813 of the metal core board were connected via the solder 1819.
【0099】本実施例の構造によれば、半導体部品の駆
動時における熱を効率よく拡散することができた。さら
にはビアホールおよび放熱用ビアホール部において良好
な電気接続がなされているとともに高剛性である金属板
をコアとしたため、製造上のハンドリングにも優れてい
た。実施例1にも記載のとおり、放熱用ビアホールの形
成を複数の絶縁層および配線層を一括で行えば、図1の
工程(c)のざぐり加工108を省略することができる
ため、工程数削減による低コスト化が可能である。この
ときの放熱用ビアホール端面の構造を図45(b)に、
図1記載の工程による放熱用ビアホール端面の構造を図
45(a)に示す。
<実施例19>実施例19について図19を用いて説明
する。図19において、1901〜1912は実施例3
の301〜312と同じ構成を示し、工程(a)〜(f)まで
は電極1915を形成するとともに、電極1916を形
成している点を除いて図3と同様な構成である。電極1
915および1916を形成した後、さらに、複合金属
板より電気めっきを析出させ、放熱用ビアホールを銅で
充填することで、複合金属板1905と接続された放熱
用電極1918を形成する。少なくとも電極および放熱
用電極を除く所望部にソルダレジスト1919を製膜す
る。半導体部品1920の端子とメタルコア基板の電極
1915、半導体部品1920の表面とメタルコア基板
の放熱用電極1918とを、はんだ1921を介して載
置、接続した。最後にプリプレグを介して銅配線を積層
したプリント基板の最外層に設けた電極1922とメタ
ルコア基板の電極1916とをはんだ1923を介して
接続した。According to the structure of this embodiment, the heat when driving the semiconductor component can be efficiently diffused. Furthermore, since the via hole and the radiating via hole portion have good electrical connection and a metal plate having high rigidity is used as the core, the handling in manufacturing is also excellent. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole according to the process shown in FIG. <Embodiment 19> Embodiment 19 will be described with reference to FIG. In FIG. 19, 1901-1912 are the third embodiment
No. 301 to 312, and has the same structure as that of FIG. 3 except that the electrode 1915 is formed and the electrode 1916 is formed in steps (a) to (f). Electrode 1
After forming 915 and 1916, electroplating is further deposited from the composite metal plate and the heat dissipation via holes are filled with copper to form a heat dissipation electrode 1918 connected to the composite metal plate 1905. A solder resist 1919 is formed on a desired portion except at least the electrode and the heat dissipation electrode. The terminal of the semiconductor component 1920 and the electrode 1915 of the metal core substrate, and the surface of the semiconductor component 1920 and the heat dissipation electrode 1918 of the metal core substrate were placed and connected via the solder 1921. Finally, the electrode 1922 provided on the outermost layer of the printed board on which the copper wiring was laminated via the prepreg and the electrode 1916 of the metal core board were connected via the solder 1923.
【0100】本実施例の構造によれば、半導体部品駆動
時の熱を効率よく拡散することができた。高剛性である
42アロイをコアとしたため、コア基板の薄化によるコ
ア層におけるスルーホール密度の向上が可能となるばか
りでなく、製造上のハンドリングにも優れていた。実施
例1にも記載のとおり、放熱用ビアホールの形成を複数
の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例20>実施例20は、図20に示すように、半
導体部品2001を載置したメタルコア基板を実装する
プリント基板の実装箇所に、放熱用電極2002を設
け、半導体部品2001と放熱用電極2002とをはん
だ2003を介して接続したこと以外は、実施例18と同
様にして作成した。According to the structure of this embodiment, the heat when driving the semiconductor component can be efficiently diffused. Since 42 alloy having high rigidity was used as the core, not only the through hole density in the core layer could be improved by thinning the core substrate, but also the handling in manufacturing was excellent. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Embodiment 20> In Embodiment 20, as shown in FIG. 20, a heat dissipation electrode 2002 is provided at a mounting portion of a printed circuit board on which a metal core substrate on which a semiconductor component 2001 is mounted is mounted, and the semiconductor component 2001 and the heat dissipation electrode are provided. It was produced in the same manner as in Example 18 except that the 2002 and 2002 were connected via solder 2003.
【0101】本実施例の構造によれば、半導体部品の駆
動時における熱をさらに効率よく拡散することができ
た。実施例1にも記載のとおり、放熱用ビアホールの形
成を複数の絶縁層および配線層を一括で行えば、図1の
工程(c)のざぐり加工108を省略することができる
ため、工程数削減による低コスト化が可能である。この
ときの放熱用ビアホール端面の構造を図45(b)に、
図1記載の工程による放熱用ビアホール端面の構造を図
45(a)に示す。
<実施例21>実施例21は、図21に示すように、複合
金属板の両面に放熱用電極2101、2102を形成したメタル
コア基板の表裏一方の放熱用電極2101に半導体部品2103
を載置し、他方の放熱用電極2102とプリント基板の放熱
用電極2104とを、はんだ2105を介して接続したこと以外
は、実施例19と同様に実装構造体を作成した。According to the structure of this embodiment, the heat when driving the semiconductor component can be diffused more efficiently. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole according to the process shown in FIG. <Example 21> In Example 21, as shown in FIG. 21, a semiconductor component 2103 is provided on one of the front and back heat radiating electrodes 2101 of a metal core substrate in which heat radiating electrodes 2101 and 2102 are formed on both surfaces of a composite metal plate.
A mounting structure was prepared in the same manner as in Example 19 except that the heat-dissipating electrode 2102 on the other side and the heat-dissipating electrode 2104 on the printed circuit board were connected via the solder 2105.
【0102】本実施例の構造によれば、プリント基板へ
の半導体を実装する際の熱拡散効率向上することができ
た。実施例1にも記載のとおり、放熱用ビアホールの形
成を複数の絶縁層および配線層を一括で行えば、図1の
工程(c)のざぐり加工108を省略することができる
ため、工程数削減による低コスト化が可能である。この
ときの放熱用ビアホール端面の構造を図45(b)に、
図1記載の工程による放熱用ビアホール端面の構造を図
45(a)に示す。
<実施例22>実施例22は、図22に示すように、複数
の半導体部品2201,2202とメモリ2203をメタルコア基板
に載置したこと以外は、実施例19と同様に作製した。According to the structure of this embodiment, the heat diffusion efficiency when mounting the semiconductor on the printed circuit board can be improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole according to the process shown in FIG. <Example 22> Example 22 was prepared in the same manner as Example 19 except that a plurality of semiconductor components 2201 and 2202 and a memory 2203 were mounted on a metal core substrate as shown in FIG.
【0103】本実施例の構造によれば、プリント基板へ
の実装密度を向上できた。実施例1にも記載のとおり、
放熱用ビアホールの形成を複数の絶縁層および配線層を
一括で行えば、図1の工程(c)のざぐり加工108を
省略することができるため、工程数削減による低コスト
化が可能である。このときの放熱用ビアホール端面の構
造を図45(b)に、図1記載の工程による放熱用ビア
ホール端面の構造を図45(a)に示す。
<実施例23>実施例23は、図23に示すように、半導
体部品2301,2302,2303を載置した複数のメタルコア基
板2304,2305をプリント基板2306に載置したこと以外
は、実施例19と同様に作製した。According to the structure of this embodiment, the mounting density on the printed board can be improved. As described in Example 1,
If the heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted, so that the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Example 23> Example 23 is the same as Example 19 except that a plurality of metal core substrates 2304 and 2305 on which semiconductor components 2301, 2302 and 2303 are mounted are mounted on a printed circuit board 2306 as shown in FIG. Was prepared in the same manner as in.
【0104】本実施例の構造によれば、プリント基板へ
の実装密度向上できた。実施例1にも記載のとおり、放
熱用ビアホールの形成を複数の絶縁層および配線層を一
括で行えば、図1の工程(c)のざぐり加工108を省
略することができるため、工程数削減による低コスト化
が可能である。このときの放熱用ビアホール端面の構造
を図45(b)に、図1記載の工程による放熱用ビアホ
ール端面の構造を図45(a)に示す。
<実施例24>実施例24は、図24に示すように、半導
体部品2401を載置したメタルコア基板2402の電極2403と
セラミック基板2404に形成した電極2405とをはんだ2406
を介して接続・載置したこと以外は、実施例19と同様に
して電子装置を作製した。According to the structure of this embodiment, the mounting density on the printed board can be improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). Example 24 In Example 24, as shown in FIG. 24, an electrode 2403 of a metal core substrate 2402 on which a semiconductor component 2401 is mounted and an electrode 2405 formed on a ceramic substrate 2404 are soldered 2406.
An electronic device was produced in the same manner as in Example 19 except that the electronic device was connected and placed via.
【0105】本実施例の構造によれば、耐熱性を向上す
ることができた。実施例1にも記載のとおり、放熱用ビ
アホールの形成を複数の絶縁層および配線層を一括で行
えば、図1の工程(c)のざぐり加工108を省略する
ことができるため、工程数削減による低コスト化が可能
である。このときの放熱用ビアホール端面の構造を図4
5(b)に、図1記載の工程による放熱用ビアホール端
面の構造を図45(a)に示す。
<実施例25>実施例25は、図25に示すように、半導
体部品2501を載置したメタルコア基板2502の電極2503と
セラミック基板2504に形成した電極2505、メタルコア基
板の内層金属板2506と接続された放熱用電極2507とセラ
ミック基板に設けた放熱用電極2508とを、はんだ2509を
介して接続・載置したこと以外は、実施例19と同様にし
て電子装置を作製した。According to the structure of this example, the heat resistance could be improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
5 (b) shows the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 (a). Example 25 In Example 25, as shown in FIG. 25, an electrode 2503 of a metal core substrate 2502 on which a semiconductor component 2501 is mounted, an electrode 2505 formed on a ceramic substrate 2504, and an inner metal plate 2506 of the metal core substrate are connected. An electronic device was produced in the same manner as in Example 19 except that the heat dissipation electrode 2507 and the heat dissipation electrode 2508 provided on the ceramic substrate were connected and placed via the solder 2509.
【0106】本実施例の構造によれば、耐熱性を向上す
ることができた。実施例1にも記載のとおり、放熱用ビ
アホールの形成を複数の絶縁層および配線層を一括で行
えば、図1の工程(c)のざぐり加工108を省略する
ことができるため、工程数削減による低コスト化が可能
である。このときの放熱用ビアホール端面の構造を図4
5(b)に、図1記載の工程による放熱用ビアホール端
面の構造を図45(a)に示す。
<実施例26>実施例26は、図26に示すように、半導
体部品2601を載置したメタルコア基板A2602の
電極A2603とメタルコア基板B2604に形成した
電極B2605とを、はんだ2606を介して接続・載
置したこと以外は、実施例19と同様である。According to the structure of this example, the heat resistance could be improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
5 (b) shows the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 (a). <Example 26> In Example 26, as shown in FIG. 26, an electrode A2603 of a metal core substrate A2602 on which a semiconductor component 2601 was placed and an electrode B2605 formed on a metal core substrate B2604 were connected and placed via solder 2606. The same as Example 19 except that it was placed.
【0107】本実施例の構造によれば、耐熱性を向上す
ることができた。実施例1にも記載のとおり、放熱用ビ
アホールの形成を複数の絶縁層および配線層を一括で行
えば、図1の工程(c)のざぐり加工108を省略する
ことができるため、工程数削減による低コスト化が可能
である。このときの放熱用ビアホール端面の構造を図4
5(b)に、図1記載の工程による放熱用ビアホール端
面の構造を図45(a)に示す。
<実施例27>実施例27は、図27に示すように、半導
体部品2701を載置したメタルコア基板A2702の電極A27
03とメタルコア基板B2704に形成した電極B2705、メタ
ルコア基板Aの内層金属板2706と接続された放熱用電極
A2707とメタルコア基板Bに設けた放熱用電極B2708と
を、はんだ2709を介して接続・載置したこと以外は、実
施例19と同様にして作製した。According to the structure of this example, the heat resistance could be improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
5 (b) shows the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 (a). <Example 27> In Example 27, as shown in FIG. 27, an electrode A27 of a metal core substrate A2702 on which a semiconductor component 2701 was mounted was used.
03, the electrode B2705 formed on the metal core board B2704, the heat dissipation electrode A2707 connected to the inner metal plate 2706 of the metal core board A, and the heat dissipation electrode B2708 provided on the metal core board B are connected and mounted via the solder 2709. Except for the above, it was prepared in the same manner as in Example 19.
【0108】本実施例の構造によれば、耐熱性およびメ
イン基板への放熱性を向上することができた。実施例1
にも記載のとおり、放熱用ビアホールの形成を複数の絶
縁層および配線層を一括で行えば、図1の工程(c)の
ざぐり加工108を省略することができるため、工程数
削減による低コスト化が可能である。このときの放熱用
ビアホール端面の構造を図45(b)に、図1記載の工
程による放熱用ビアホール端面の構造を図45(a)に
示す。
<実施例28>実施例28は、図28に示すように、メタ
ルコア基板2801の複合金属板2802に接続された複数の放
熱用ビアホール部2803,2804と、半導体部品2805とを、
はんだ2806を介して接続したこと以外は、実施例19と同
様にして作製した。According to the structure of this embodiment, heat resistance and heat dissipation to the main board can be improved. Example 1
As described above, if the heat-dissipating via hole is formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted. Is possible. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Embodiment 28> As shown in FIG. 28, Embodiment 28 includes a plurality of heat dissipation via hole portions 2803 and 2804 connected to a composite metal plate 2802 of a metal core substrate 2801 and a semiconductor component 2805.
It was produced in the same manner as in Example 19 except that the connection was made via the solder 2806.
【0109】本実施例の構造によれば、半導体部品駆動
時の熱による応力を拡散することができた。また、放熱
用ビアホールの形成工程が簡単化されるので、低コスト
化できた。実施例1にも記載のとおり、放熱用ビアホー
ルの形成を複数の絶縁層および配線層を一括で行えば、
図1の工程(c)のざぐり加工108を省略することが
できるため、工程数削減による低コスト化が可能であ
る。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例29>実施例29は、図29に示すように、メタ
ルコア基板2901の複合金属板2902に接続された
複数の放熱用ビアホール2903,2904を設け、電
気銅めっき2905を充填し、はんだ2906を介して
半導体部品2907と接続したこと以外は、実施例19と
同様にして作製した。According to the structure of this embodiment, it is possible to diffuse the stress due to heat when the semiconductor component is driven. Further, since the process of forming the heat dissipation via hole is simplified, the cost can be reduced. As described in Example 1, if a heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once,
Since the counterbore processing 108 of the step (c) of FIG. 1 can be omitted, the cost can be reduced by reducing the number of steps. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Example 29> In Example 29, as shown in FIG. 29, a plurality of heat-dissipating via holes 2903 and 2904 connected to the composite metal plate 2902 of the metal core substrate 2901 were provided, electrolytic copper plating 2905 was filled, and solder 2906 was used. It was produced in the same manner as in Example 19 except that the semiconductor component 2907 was connected via.
【0110】本実施例の構造によれば、熱拡散性を有し
たまま、半導体部品とメタルコア基板のはんだの初期接
続性および接続プロセスを簡易化することができ、低コ
スト化できた。実施例1にも記載のとおり、放熱用ビア
ホールの形成を複数の絶縁層および配線層を一括で行え
ば、図1の工程(c)のざぐり加工108を省略するこ
とができるため、工程数削減による低コスト化が可能で
ある。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例30>実施例30は、図30に示すように、メタ
ルコア基板3001の複合金属板3002に接続された第1層目
の樹脂付き銅箔部におけるビアホール3003を介して第2
層目の樹脂付き銅箔部における放熱用ビアホール3004を
複数個設け、電気銅めっきによりこれを充填し、これら
の表面を放熱用電極3005としてはんだ3006を介して半導
体部品3007と接続したこと以外は、実施例19と同様にし
て作製した。According to the structure of this embodiment, it is possible to simplify the initial connecting property of the solder between the semiconductor component and the metal core substrate and the connecting process while maintaining the thermal diffusivity, and to reduce the cost. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Embodiment 30> As shown in FIG. 30, Embodiment 30 uses the second via via hole 3003 in the resin-coated copper foil portion of the first layer connected to the composite metal plate 3002 of the metal core substrate 3001.
A plurality of heat-dissipating via holes 3004 are provided in the resin-coated copper foil portion of the layer, these are filled by electrolytic copper plating, and these surfaces are connected to the semiconductor component 3007 via the solder 3006 as heat-dissipating electrodes 3005. Was prepared in the same manner as in Example 19.
【0111】本実施例の構造によれば、熱拡散性を有し
たまま、半導体部品とメタルコア基板のはんだの初期接
続性および接続プロセスを簡易化することができ、低コ
スト化できた。
<実施例31>実施例31は、図31に示すように、メタ
ルコア基板3101の複合金属板3102に接続された第1層目
の樹脂付き銅箔部における1つの放熱用ビアホールに電
気銅めっき3103を充填し、第2層目の樹脂付き銅箔部に
おける放熱用ビアホールを複数個設け、内部を電気銅め
っき3104を充填し、これを放熱用電極3105として、はん
だ3106を介して半導体部品3107と接続したこと以外は、
実施例19と同様にして実装構造体を作製した。According to the structure of this embodiment, it is possible to simplify the initial connecting property of the semiconductor component and the solder of the metal core substrate and the connecting process while maintaining the thermal diffusivity, and to reduce the cost. <Example 31> In Example 31, as shown in FIG. 31, one heat radiation via hole in the resin-coated copper foil portion of the first layer connected to the composite metal plate 3102 of the metal core substrate 3101 was plated with electrolytic copper 3103. And a plurality of heat dissipation via holes are provided in the second-layer resin-coated copper foil portion, and the inside is filled with electrolytic copper plating 3104. This is used as a heat dissipation electrode 3105 and a semiconductor component 3107 via solder 3106. Except for the connection
A mounting structure was produced in the same manner as in Example 19.
【0112】本実施例の構造によれば、熱拡散性を有し
たまま、半導体部品とメタルコア基板のはんだの初期接
続性および接続プロセスを簡易化することができ、低コ
スト化できた。
<実施例32>実施例32は、図32に示すように、半導
体部品3201のバンプ型端子3202をメタルコア基板3203の
バンプ型電極3204とを、異方性導伝性樹脂3205を介して
裁置したこと以外は、実施例19と同様にして実装構造体
を作製した。According to the structure of this embodiment, it is possible to simplify the initial connecting property of the semiconductor component and the solder of the metal core substrate and the connecting process while maintaining the thermal diffusivity, and to reduce the cost. <Example 32> In Example 32, as shown in FIG. 32, a bump type terminal 3202 of a semiconductor component 3201 and a bump type electrode 3204 of a metal core substrate 3203 are placed via an anisotropic conductive resin 3205. A mounting structure was produced in the same manner as in Example 19 except for the above.
【0113】本実施例の構造によれば、はんだを用いる
接続工程よりも低温で載置できるため、基板製造時の熱
履歴を低減できた。さらに、材料コストも低減できた。
実施例1にも記載のとおり、放熱用ビアホールの形成を
複数の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例33>実施例33は、図33に示すように、メタ
ルコア基板3301と半導体部品3302の端子のない面とを対
向させて載置し、ワイヤボンディング3303によりメタル
コア基板表面の電極3304と半導体部品の端子3305とを接
続したこと以外は、実施例19と同様にして作製した。According to the structure of this embodiment, the mounting can be performed at a temperature lower than that of the connection process using solder, so that the thermal history at the time of manufacturing the substrate can be reduced. Further, the material cost could be reduced.
As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Example 33> In Example 33, as shown in FIG. 33, the metal core substrate 3301 and the surface of the semiconductor component 3302 having no terminals are placed to face each other, and the electrode 3304 on the surface of the metal core substrate and the semiconductor are mounted by wire bonding 3303. It was produced in the same manner as in Example 19 except that the terminal 3305 of the component was connected.
【0114】本実施例の構造によれば、半導体部品と複
合金属板との接続面積の増加により、複合金属板への熱
拡散を高めることができた。実施例1にも記載のとお
り、放熱用ビアホールの形成を複数の絶縁層および配線
層を一括で行えば、図1の工程(c)のざぐり加工10
8を省略することができるため、工程数削減による低コ
スト化が可能である。このときの放熱用ビアホール端面
の構造を図45(b)に、図1記載の工程による放熱用
ビアホール端面の構造を図45(a)に示す。
<実施例34>実施例34は、図34に示すように、半導
体部品3401の主表面より大きく露出させたメタルコア基
板の露出複合金属部3402と、半導体部品の電極A3403を
有する面Aの裏面Bとを、はんだにより接続し、電極A
とメタルコア基板の樹脂付き銅箔の表面に形成した電極
B3404とをワイヤボンディング3405により接続したこと
以外は、実施例19と同様にして作製した。According to the structure of this embodiment, the increase of the connection area between the semiconductor component and the composite metal plate can enhance the heat diffusion to the composite metal plate. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the spot facing process 10 in the step (c) of FIG. 1 is performed.
Since 8 can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a). <Example 34> In Example 34, as shown in FIG. 34, the exposed composite metal portion 3402 of the metal core substrate exposed more than the main surface of the semiconductor component 3401 and the back surface B of the surface A having the electrode A 3403 of the semiconductor component. And the electrode A
Example 19 was prepared in the same manner as in Example 19 except that the electrode B3404 formed on the surface of the resin-coated copper foil of the metal core substrate was connected by wire bonding 3405.
【0115】本実施例の構造によれば、熱拡散効率を向
上させることができるとともに、実装構造体の製造コス
トを安価にすることができた。さらに図41に示すよう
に、チップサイズよりも小さな放熱用ビアホールとし
て、チップ直下の領域にも内層配線を施せるようにする
と、放熱性はやや落ちるが、配線パターン設計の自由度
を上げ、またメタルコア基板の大きさを小さくすること
が出来た。図40に代表される放熱性と放熱部面積の関係
に従い、放熱性や基板配線自由度を考慮した基板設計が
可能である。実施例1にも記載のとおり、放熱用ビアホ
ールの形成を複数の絶縁層および配線層を一括で行え
ば、図1の工程(c)のざぐり加工108を省略するこ
とができるため、工程数削減による低コスト化が可能で
ある。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例35>実施例35は、図35に示すように、半導
体部品3501を載置するメタルコア基板3502の複合金属板
3503の一部に窪みを設け、窪みに半導体部品3501を載置
したこと以外は、実施例19と同様にして作製した。According to the structure of this embodiment, the heat diffusion efficiency can be improved and the manufacturing cost of the mounting structure can be reduced. Furthermore, as shown in Fig. 41, if the inner layer wiring can be applied to the area directly under the chip as a heat dissipation via hole smaller than the chip size, the heat dissipation will be slightly reduced, but the flexibility of wiring pattern design will be increased and the metal core The size of the board could be reduced. According to the relationship between the heat dissipation property and the area of the heat dissipation part represented in FIG. 40, it is possible to design the board in consideration of the heat dissipation property and the degree of freedom of the board wiring. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Example 35> Example 35 is a composite metal plate of a metal core substrate 3502 on which a semiconductor component 3501 is mounted as shown in FIG.
It was produced in the same manner as in Example 19 except that a recess was provided in a part of 3503 and the semiconductor component 3501 was placed in the recess.
【0116】本実施例の構造によれば、半導体の載置位
置精度を高めることができ、半導体部品と複合金属板と
の距離を短縮することによる放熱性向上の効果を得た。
実施例1にも記載のとおり、放熱用ビアホールの形成を
複数の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例36>実施例36は、図36に示すように、電極
3601および放熱用電極3602を介して半導体部品3603をメ
タルコア基板3604に実装するとともに、半導体実装面の
裏面に放熱用ビアホールを介して内層金属板と接続され
た放熱用電極3605を設けたこと以外は、実施例19と同様
にして作製した。According to the structure of this embodiment, the placement accuracy of the semiconductor can be improved, and the effect of improving the heat dissipation can be obtained by shortening the distance between the semiconductor component and the composite metal plate.
As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Example 36> In Example 36, as shown in FIG.
Semiconductor component 3603 is mounted on metal core substrate 3604 via 3601 and heat dissipation electrode 3602, and heat dissipation electrode 3605 connected to the inner metal plate via a heat dissipation via hole is provided on the back surface of the semiconductor mounting surface. Was prepared in the same manner as in Example 19.
【0117】本実施例の構造によれば、放熱用電極を介
して熱を拡散することができるため、より優れた冷却能
力を付加することができた。実施例1にも記載のとお
り、放熱用ビアホールの形成を複数の絶縁層および配線
層を一括で行えば、図1の工程(c)のざぐり加工10
8を省略することができるため、工程数削減による低コ
スト化が可能である。このときの放熱用ビアホール端面
の構造を図45(b)に、図1記載の工程による放熱用
ビアホール端面の構造を図45(a)に示す。According to the structure of this embodiment, the heat can be diffused through the heat dissipation electrode, so that a more excellent cooling capacity can be added. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the spot facing process 10 in the step (c) of FIG. 1 is performed.
Since 8 can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a).
【0118】<実施例37>実施例37は、図37に示す
ように、メタルコア基板3701の半導体実装面の裏面
に放熱用ビアホールに銅めっきを充填した部分3706
を設ける以外は、実施例33と同様である。このことに
より、さらに効率よく熱を拡散することができた。実施
例1にも記載のとおり、放熱用ビアホールの形成を複数
の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例38>実施例38は、図38に示すように、チッ
プサイズよりも小さな放熱用ビアホールとしている以外
は、実施例37と同様である。本実施例の構造によれ
ば、チップ直下の領域にも内層配線を施せるようにな
り、放熱性はやや落ちるが、配線パターン設計の自由度
を上げ、またメタルコア基板の大きさを小さくすること
が出来た。実施例1にも記載のとおり、放熱用ビアホー
ルの形成を複数の絶縁層および配線層を一括で行えば、
図1の工程(c)のざぐり加工108を省略することが
できるため、工程数削減による低コスト化が可能であ
る。このときの放熱用ビアホール端面の構造を図45
(b)に、図1記載の工程による放熱用ビアホール端面
の構造を図45(a)に示す。
<実施例39>実施例39は、図39に示すように、メタ
ルコア基板3901の半導体実装面の裏面側の放熱用ビ
アホールの銅めっき充填部の表面に、ソルダーレジスト
により、電気的接続用電極径とほぼ同程度の大きさの放
熱用電極を形成し、はんだ付け用にニッケル、金めっき
を施し、メイン基板とはんだ接続する以外は、実施例3
7と同様である。本実施例によれば、はんだ接続性が良
くなる。実施例1にも記載のとおり、放熱用ビアホール
の形成を複数の絶縁層および配線層を一括で行えば、図
1の工程(c)のざぐり加工108を省略することがで
きるため、工程数削減による低コスト化が可能である。
このときの放熱用ビアホール端面の構造を図45(b)
に、図1記載の工程による放熱用ビアホール端面の構造
を図45(a)に示す。
<実施例40>実施例40は、図40に示すように、メタ
ルコア基板A4001を接続するメイン基板も、放熱ビ
アが形成されたメタルコア基板B4002であり、これ
らの放熱ビア同士をはんだ接続する以外は、実施例37
と同様である。本実施例によれば、メイン基板への放熱
性およびメイン基板からの熱の放散性が良くなる。実施
例1にも記載のとおり、放熱用ビアホールの形成を複数
の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例41>実施例41は、図41に示すように、メタ
ルコア基板A4101を接続するメイン基板も、放熱ビ
アが形成されたメタルコア基板B4102であり、これ
らの放熱ビア同士をはんだ接続する以外は、実施例39
と同様である。本実施例によれば、メイン基板への放熱
性およびメイン基板からの熱の放散性が良くなる。実施
例1にも記載のとおり、放熱用ビアホールの形成を複数
の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例42>実施例42は、図42に示すように、メタ
ルコア基板4201を接続するメイン基板が、放熱ビア
が形成されたメタルベース基板4202であり、これら
の放熱ビア同士をはんだ接続する以外は、実施例37と
同様である。本実施例によれば、メイン基板への放熱性
およびメイン基板からの熱の放散性が良くなる。実施例
1にも記載のとおり、放熱用ビアホールの形成を複数の
絶縁層および配線層を一括で行えば、図1の工程(c)
のざぐり加工108を省略することができるため、工程
数削減による低コスト化が可能である。このときの放熱
用ビアホール端面の構造を図45(b)に、図1記載の
工程による放熱用ビアホール端面の構造を図45(a)
に示す。
<実施例43>実施例43は、図43に示すように、半導
体部品4301を載置したメタルコア基板A4302の電極A43
03とメタルベース基板B4304に形成した電極B4305、メ
タルコア基板Aのベースとなる金属板4306と接続された
放熱用電極A4307とメタルベース基板Bに設けた放熱用
電極B4308とを、はんだ4309を介して接続・載置したこ
と以外は、実施例19と同様にして作製した。本実施例の
構造によれば、耐熱性およびメイン基板への放熱性の向
上だけでなく、メイン基板からの放熱性が向上した。実
施例1にも記載のとおり、放熱用ビアホールの形成を複
数の絶縁層および配線層を一括で行えば、図1の工程
(c)のざぐり加工108を省略することができるた
め、工程数削減による低コスト化が可能である。このと
きの放熱用ビアホール端面の構造を図45(b)に、図
1記載の工程による放熱用ビアホール端面の構造を図4
5(a)に示す。
<実施例44>実施例44は、図44に示すように、メタ
ルコア基板4401を接続するメイン基板も、放熱ビア
が形成されたメタルベース基板4402であり、これら
の放熱ビア同士をはんだ接続する以外は、実施例39と
同様である。本実施例によれば、メイン基板への放熱性
およびメイン基板からの熱の放散性が良くなる。実施例
1にも記載のとおり、放熱用ビアホールの形成を複数の
絶縁層および配線層を一括で行えば、図1の工程(c)
のざぐり加工108を省略することができるため、工程
数削減による低コスト化が可能である。このときの放熱
用ビアホール端面の構造を図45(b)に、図1記載の
工程による放熱用ビアホール端面の構造を図45(a)
に示す。<Example 37> In Example 37, as shown in FIG. 37, a portion 3706 in which a heat dissipation via hole was filled with copper plating on the back surface of the semiconductor mounting surface of the metal core substrate 3701.
Example 33 is the same as Example 33 except that is provided. As a result, the heat could be diffused more efficiently. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in step (c) of FIG. 1 can be omitted, so the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Embodiment 38> Embodiment 38 is the same as Embodiment 37 except that it is used as a heat dissipation via hole smaller than the chip size, as shown in FIG. According to the structure of the present embodiment, the inner layer wiring can be provided even in the region immediately below the chip, and the heat dissipation is slightly lowered, but the degree of freedom in wiring pattern design can be increased and the size of the metal core substrate can be reduced. done. As described in Example 1, if a heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once,
Since the counterbore processing 108 of the step (c) of FIG. 1 can be omitted, the cost can be reduced by reducing the number of steps. FIG. 45 shows the structure of the end surface of the heat dissipation via hole at this time.
FIG. 45 (a) shows the structure of the end surface of the heat dissipation via hole in the step shown in FIG. 1 (b). <Example 39> In Example 39, as shown in FIG. 39, the diameter of the electrical connection electrode was made by solder resist on the surface of the copper plating filled portion of the heat dissipation via hole on the back surface side of the semiconductor mounting surface of the metal core substrate 3901. Example 3 except that a heat dissipation electrode having a size approximately the same as that of the above is formed, nickel and gold plating are applied for soldering, and solder connection with the main board is performed.
Similar to 7. According to this embodiment, the solder connectivity is improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted, so that the number of steps can be reduced. It is possible to reduce the cost.
The structure of the end surface of the heat dissipation via hole at this time is shown in FIG.
FIG. 45A shows the structure of the end surface of the heat-dissipating via hole by the process described in FIG. <Example 40> In Example 40, as shown in FIG. 40, the main board to which the metal core board A4001 is connected is also the metal core board B4002 in which heat dissipation vias are formed. Example 37
Is the same as. According to this embodiment, the heat dissipation to the main board and the heat dissipation from the main board are improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted, so that the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Embodiment 41> In Embodiment 41, as shown in FIG. 41, the main board to which the metal core board A 4101 is connected is also a metal core board B 4102 in which heat dissipation vias are formed. Example 39
Is the same as. According to this embodiment, the heat dissipation to the main board and the heat dissipation from the main board are improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted, so that the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Example 42> In Example 42, as shown in FIG. 42, the main substrate to which the metal core substrate 4201 is connected is a metal base substrate 4202 in which heat dissipation vias are formed, and these heat dissipation vias are connected by soldering. Is the same as in Example 37. According to this embodiment, the heat dissipation to the main board and the heat dissipation from the main board are improved. As described in Example 1, if the heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once, the step (c) in FIG.
Since the counterbore processing 108 can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG.
Shown in. <Example 43> In Example 43, as shown in FIG. 43, an electrode A43 of a metal core substrate A4302 on which a semiconductor component 4301 is mounted is mounted.
03, the electrode B4305 formed on the metal base substrate B4304, the heat dissipation electrode A4307 connected to the metal plate 4306 serving as the base of the metal core substrate A, and the heat dissipation electrode B4308 provided on the metal base substrate B via the solder 4309. It was produced in the same manner as in Example 19 except that it was connected and placed. According to the structure of this example, not only the heat resistance and the heat dissipation to the main board were improved, but also the heat dissipation from the main board was improved. As described in Example 1, if the heat dissipation via holes are formed in a batch using a plurality of insulating layers and wiring layers, the counterbore processing 108 in the step (c) of FIG. 1 can be omitted, so that the number of steps can be reduced. It is possible to reduce the cost. The structure of the end surface of the heat dissipation via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat dissipation via hole is shown in FIG.
5 (a). <Embodiment 44> In Embodiment 44, as shown in FIG. 44, the main board to which the metal core board 4401 is connected is also the metal base board 4402 in which the heat dissipation vias are formed. Is the same as in Example 39. According to this embodiment, the heat dissipation to the main board and the heat dissipation from the main board are improved. As described in Example 1, if the heat dissipation via hole is formed in a plurality of insulating layers and wiring layers at once, the step (c) in FIG.
Since the counterbore processing 108 can be omitted, the cost can be reduced by reducing the number of steps. The structure of the end surface of the heat-dissipating via hole at this time is shown in FIG. 45 (b), and the structure of the end surface of the heat-dissipating via hole by the process shown in FIG. 1 is shown in FIG. 45 (a).
Shown in.
【発明の効果】本発明によれば、放熱性の高い電子装置
を提供することができる。According to the present invention, it is possible to provide an electronic device having high heat dissipation.
【図面の簡単な説明】[Brief description of drawings]
【図1】本発明に関わる電子装置に用いる電子基板の製
造フローを示す図FIG. 1 is a diagram showing a manufacturing flow of an electronic substrate used for an electronic device according to the present invention.
【図2】本発明に関わる電子装置に用いた電子基板の断
面構造図FIG. 2 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図3】本発明に関わる電子装置に用いる電子基板の製
造フローを示す図FIG. 3 is a diagram showing a manufacturing flow of an electronic substrate used for an electronic device according to the present invention.
【図4】本発明に関わる電子装置に用いた電子基板の断
面構造図FIG. 4 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図5】本発明に関わる電子装置に用いる電子基板の製
造フローを示す図FIG. 5 is a diagram showing a manufacturing flow of an electronic substrate used for an electronic device according to the present invention.
【図6】本発明に関わる電子装置に用いた電子基板の断
面構造図FIG. 6 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図7】本発明に関わる電子装置に用いた電子基板の断
面構造図FIG. 7 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図8】本発明に関わる電子装置に用いた電子基板の断
面構造図FIG. 8 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図9】本発明に関わる電子装置に用いた電子基板の断
面構造図FIG. 9 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図10】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 10 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図11】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 11 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図12】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 12 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図13】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 13 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図14】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 14 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図15】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 15 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図16】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 16 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図17】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 17 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図18】本発明に関わる電子装置に用いる電子基板の
製造フローを示す図FIG. 18 is a view showing a manufacturing flow of an electronic substrate used for the electronic device according to the present invention.
【図19】本発明に関わる電子装置に用いる電子基板の
製造フローを示す図FIG. 19 is a diagram showing a manufacturing flow of an electronic substrate used for an electronic device according to the present invention.
【図20】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 20 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図21】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 21 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図22】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 22 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図23】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 23 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図24】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 24 is a sectional structural view of an electronic substrate used for an electronic device according to the present invention.
【図25】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 25 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図26】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 26 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図27】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 27 is a sectional structural view of an electronic substrate used for an electronic device according to the present invention.
【図28】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 28 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図29】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 29 is a sectional structural view of an electronic substrate used for an electronic device according to the present invention.
【図30】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 30 is a sectional structural view of an electronic substrate used for an electronic device according to the present invention.
【図31】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 31 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図32】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 32 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図33】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 33 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図34】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 34 is a sectional structural view of an electronic substrate used for an electronic device according to the present invention.
【図35】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 35 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図36】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 36 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図37】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 37 is a sectional structural view of an electronic substrate used in the electronic device according to the present invention.
【図38】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 38 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図39】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 39 is a sectional structural view of an electronic substrate used in the electronic device according to the present invention.
【図40】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 40 is a sectional structural view of an electronic substrate used for an electronic device according to the present invention.
【図41】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 41 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図42】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 42 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図43】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 43 is a sectional structural view of an electronic substrate used in an electronic device according to the present invention.
【図44】本発明に関わる電子装置に用いた電子基板の
断面構造図FIG. 44 is a sectional structural view of an electronic substrate used in the electronic device according to the present invention.
【図45】本発明に関わる放熱用ビアホール端面の構造
図FIG. 45 is a structural diagram of an end surface of a heat dissipation via hole according to the present invention.
金属板・・・101 めっき層・・・102 複合金属板・・・103 ビアホール・・・107 配線層・・・104 放熱用ビアホール・・・108 厚膜銅めっき・・・109 ソルダレジスト・・・114 外部端子・・・118 半導体部品・・・115 放熱用電極・・・117 はんだ・・・116 Metal plate ... 101 Plating layer ... 102 Composite metal plate ... 103 Beer hole ... 107 Wiring layer ... 104 Heat dissipation via hole ... 108 Thick film copper plating ... 109 Solder resist ... 114 External terminal ... 118 Semiconductor parts ・ ・ ・ 115 Heat dissipation electrode ... 117 Solder ... 116
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 FI テーマコート゛(参考) H01L 23/12 S (72)発明者 長谷部 健彦 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立製作所生産技術研究所内 (72)発明者 牛房 信之 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立製作所生産技術研究所内 (72)発明者 山下 志郎 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立製作所生産技術研究所内 (72)発明者 宝蔵寺 裕之 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立製作所生産技術研究所内 (72)発明者 松崎 永二 神奈川県横浜市戸塚区吉田町292番地 株 式会社日立製作所生産技術研究所内 Fターム(参考) 5E315 AA01 BB01 BB15 CC01 CC16 DD16 DD17 DD20 DD25 DD29 GG01 5E336 AA04 BB03 BB19 CC32 CC58 EE03 GG03 5E338 AA03 AA18 BB05 BB13 BB25 BB75 CC08 CD32 EE02 5E346 AA03 AA11 AA12 AA15 BB01 BB16 CC02 CC08 CC31 DD02 DD03 DD12 DD32 EE31 FF45 GG15 GG17 GG19 GG22 GG25 GG28 HH17 ─────────────────────────────────────────────────── ─── Continuation of front page (51) Int.Cl. 7 Identification code FI theme code (reference) H01L 23/12 S (72) Inventor Takehiko Hasebe 292 Yoshida-cho, Totsuka-ku, Yokohama-shi, Kanagawa Hitachi Ltd. Production Technology Laboratory (72) Inventor Nobuyuki Ushifusa 292 Yoshida-cho, Totsuka-ku, Yokohama, Kanagawa Stock Company Hitachi, Ltd. Production Technology Laboratory (72) Inventor Shiro Yamashita 292, Yoshida-cho, Totsuka-ku, Yokohama Hitachi, Ltd., Production Engineering Laboratory (72) Inventor, Hiroyuki Hozoji, 292 Yoshida-cho, Totsuka-ku, Yokohama, Kanagawa, Ltd. Familiar company F-term in Hitachi, Ltd. Production Technology Laboratory (reference) 5E315 AA01 BB01 BB15 CC01 CC16 DD16 DD17 DD20 D D25 DD29 GG01 5E336 AA04 BB03 BB19 CC32 CC58 EE03 GG03 5E338 AA03 AA18 BB05 BB13 BB25 BB75 CC08 CD32 EE02 5E346 AA03 AA11 AA12 AA15 BB01 BB16 CC02 CC08 CC31 DD02 DD03 DD12 DD32 GG15 GG15 EE15 FF31
Claims (22)
と該コア材上に形成された絶縁層と導体層とで構成され
た配線層とを備えたメタルコア基板と、前記配線層の導
体層と端子とが接続されている前記電子部品と、を有す
る電子装置であって、 前記電子部品と前記コア材とに接する高熱導伝性部材を
有していることを特徴とする電子装置。1. A metal core substrate comprising a core material composed of a metal plate or a composite metal plate, and a wiring layer composed of an insulating layer and a conductor layer formed on the core material; An electronic device having the electronic component in which a conductor layer and a terminal are connected to each other, the electronic device having a high heat conductive member in contact with the electronic component and the core material. .
とを特徴とする電子装置。2. The electronic device according to claim 1, wherein the high thermal conductivity member is composed of a plurality of layers.
ることを特徴とする電子装置。3. The high heat conductive member according to claim 1, wherein the layer in contact with the electronic component is made of silver, gold or solder, and the layer in contact with the metal plate is made of copper, gold or solder. An electronic device characterized by being.
での接続であることを特徴とする電子装置。4. The electronic device according to claim 1, wherein the conductor layer and the terminal are connected by a flip chip method.
特徴とする電子装置。5. The electronic device according to claim 1, wherein the wiring layer is formed on both surfaces of the core material.
部材が形成されており、 前記コア材の他方の面は、コア材から基板表面まで高熱
伝導性部材が形成されていることを特徴とする電子装
置。6. The high heat conductive member is formed between one surface of the core material and an electronic component according to claim 5, and the other surface of the core material is a surface of the substrate from the core material. An electronic device having a high thermal conductivity member formed therein.
とによりインターポーザとして用いる場合、 前記他の基板と前記電子基板のコア材とに接する高熱導
伝性部材で構成することを特徴とする電子装置。7. The electronic substrate having the electronic component according to claim 1, wherein the electronic substrate is mounted on another substrate to be used as an interposer. An electronic device comprising a high heat conductive member in contact with the electronic device.
特徴とする電子装置。8. The electronic device according to claim 7, wherein the high thermal conductivity member is composed of a plurality of layers.
と、該コア材上片面もしくは両面に形成された配線層
と、前記配線層と端子が接続されている前記電子部品を
有する第1の基板と、 該第1の基板が搭載され、該第1の基板の配線と電気的に
接続された第2の基板とを有する電子装置であって、 前記第1の基板のコア材と前記第2の基板とに接してい
る高熱導電性部材を有することを特徴とする電子装置。9. A core material comprising a metal plate or a composite metal plate, a wiring layer formed on one or both surfaces of the core material, and the electronic component having terminals connected to the wiring layer. An electronic device comprising: a first substrate; and a second substrate on which the first substrate is mounted and which is electrically connected to the wiring of the first substrate, the core material of the first substrate An electronic device comprising a high thermal conductive member in contact with the second substrate.
しくははんだ材料もしくは導電金属フィラー入り樹脂の
いずれか又はそれら複数であることを特徴とする電子装
置。10. The electronic device according to claim 9, wherein the high thermal conductivity member is any one or more of a metal material, a metal plating, a solder material, and a resin containing a conductive metal filler.
しくははんだ材料のいずれか又はそれら複数であること
を特徴とする電子装置。11. The electronic device according to claim 9, wherein the high thermal conductivity member is a metal material, a metal plating material, a solder material, or a plurality thereof.
カバーに接着されていることを特徴とする電子装置。12. The electronic device according to claim 9, wherein the first substrate non-mounting surface of the second substrate is adhered to a housing cover.
コア材と、該コア材上に形成された配線層と、前記配線
層と端子が接続されている前記電子部品とを有するメタ
ルコア基板であることを特徴とする電子装置。13. The core material made of a metal plate or a composite metal plate, the wiring layer formed on the core material, and the wiring according to any one of claims 9 to 11. An electronic device, which is a metal core substrate having a layer and the electronic component to which a terminal is connected.
カバーに接着されていることを特徴とする電子装置14. The electronic device according to claim 13, wherein the first substrate non-mounting surface of the second substrate is bonded to a housing cover.
コア材と、該コア材片側上に形成された配線層と、前記
配線層と端子が接続されている前記電子部品とを有し、
配線層および絶縁層を有さない側にはコアメタルが露出
したメタルベース基板であることを特徴とする電子装
置。15. The core material made of a metal plate or a composite metal plate, the wiring layer formed on one side of the core material, and the second substrate according to any one of claims 9 to 11. Having the electronic component in which the wiring layer and the terminal are connected,
An electronic device comprising a metal base substrate having a core metal exposed on a side having no wiring layer or insulating layer.
側を筐体カバーに接着されていることを特徴とする電子
装置。16. The electronic device according to claim 15, wherein a side of the second substrate having no wiring layer and no insulating layer is bonded to a housing cover.
導性部材を有することを特徴とする電子装置。17. The electronic device according to claim 9, further comprising a high thermal conductive member that is in contact with the first core material and the electronic component.
しくははんだ材料もしくは導電金属フィラー入り樹脂の
いずれか又はそれら複数であることを特徴とする電子装
置。18. The electronic device according to claim 17, wherein the high thermal conductivity member is one or more of a metal material, a metal plating, a solder material, and a resin containing a conductive metal filler.
しくははんだ材料のいずれか又はそれら複数であること
を特徴とする電子装置。19. The electronic device according to claim 17, wherein the high thermal conductivity member is made of a metal material, a metal plating material, a solder material, or a plurality thereof.
もしくは金属ベース材に接する高熱伝導性部材を有する
ことを特徴とする電子装置。20. The high thermal conductive member according to claim 12, comprising a metal core material of the first substrate and a metal core material or a metal base material of the second substrate. Electronic device.
しくははんだ材料もしくは導電金属フィラー入り樹脂の
いずれか又はそれら複数であることを特徴とする電子装
置。21. The electronic device according to claim 20, wherein the high thermal conductivity member is one or more of a metal material, a metal plating, a solder material, and a resin containing a conductive metal filler.
しくははんだ材料のいずれか又はそれら複数であること
を特徴とする電子装置。22. The electronic device according to claim 20, wherein the high thermal conductivity member is made of a metal material, a metal plating material, a solder material, or a plurality thereof.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002143983A JP3849573B2 (en) | 2001-05-22 | 2002-05-20 | Electronic equipment |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001-151818 | 2001-05-22 | ||
JP2001151818 | 2001-05-22 | ||
JP2002143983A JP3849573B2 (en) | 2001-05-22 | 2002-05-20 | Electronic equipment |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2003046022A true JP2003046022A (en) | 2003-02-14 |
JP3849573B2 JP3849573B2 (en) | 2006-11-22 |
Family
ID=26615451
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002143983A Expired - Lifetime JP3849573B2 (en) | 2001-05-22 | 2002-05-20 | Electronic equipment |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3849573B2 (en) |
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A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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RD01 | Notification of change of attorney |
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R151 | Written notification of patent or utility model registration |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090908 Year of fee payment: 3 |
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S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
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R350 | Written notification of registration of transfer |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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|
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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|
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R350 | Written notification of registration of transfer |
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