JP2002344085A - 半導体光素子及びその製造方法 - Google Patents

半導体光素子及びその製造方法

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JP2002344085A JP2001141184A JP2001141184A JP2002344085A JP 2002344085 A JP2002344085 A JP 2002344085A JP 2001141184 A JP2001141184 A JP 2001141184A JP 2001141184 A JP2001141184 A JP 2001141184A JP 2002344085 A JP2002344085 A JP 2002344085A
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Abstract

(57)【要約】 【課題】 pn埋め込み構造ではリークパスを防ぎ、半
絶縁性埋め込みでは、相互拡散を防ぎ、リークや接合容
量の少ない高性能な半導体光素子、及びそれを製作歩留
まり良く製造する方法を提供するものである。 【解決手段】 半導体基板上10に、少なくとも第一の
導電型を有するクラッド層12、光ガイド層或いは活性
層でなる活性領域14、第二の導電型を有するクラッド
層16が積層された積層体からなるメサストライプがあ
り、該活性領域14の幅は該メサストライプの幅よりも
狭く、該活性領域14の両側面が該メサストライプの側
面の内側にあり、該メサストライプの両側を埋め込み層
26で埋め込んだ埋込型半導体素子において、少なくと
も該活性領域14について、その両側面にある空隙に、
ルテニウムを添加した半絶縁層24を配することを特徴
とする。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は光通信に有用な埋め
込み型の半導体光素子及びその製造方法に関するもので
ある。
【0002】
【従来の技術】半導体材料を用いた発光素子や光変調器
の製作に当たっては、素子性能や信頼性等の向上のため
に埋め込み構造が用いられている。この埋め込み構造の
一つとしてマストランスポートによる埋め込み構造があ
る(特開平8−250806号公報)。このマストラン
スポートとは、メサストライプに加工された活性層側面
の加工ダメージをいわゆるウェットエッチングで除去
し、その後成長装置に装填し、昇温時にクラッド層の一
部が融解し活性層側面に移動し再結晶化することによ
り、活性層側面をクラッド領域の材料で埋め込むもので
ある。
【0003】これによって、ドライエッチングの表面加
工層の除去や、昇温時の熱ダメージを防げるという特徴
がある。しかし、このマストランスポートでは、クラッ
ド領域の材料の一部が溶解して活性層側面に移動し、再
結晶化することにより埋め込みを行うために、クラッド
層に添加されている不純物も一緒に移動し再結晶化した
埋め込み部位に取り込まれることになる。このため接合
領域の面積が増えたり、リーク電流の原因となったりす
る。
【0004】また、溶解したクラッド層の材料に含まれ
ている不純物が、埋め込み部位に隣接する活性層に拡散
し、活性層の発光特性を劣化させる原因にもなる。特
に、マストランスポートで形成された部位にp形不純物
の亜鉛(Zn)が含くまれると、pn接合埋め込みの場
合にはp形埋め込み層とマストランスポートで形成した
部位が連続したり、鉄(Fe)を添加した半絶縁層によ
る埋め込みの場合には、FeとZnの相互拡散の原因とな
り、リーク電流や接合容量の増える要因となる。
【0005】高抵抗埋め込み層には、従来、鉄(Fe)
をドーピングした半導体結晶が用いられているが、埋め
込み層に含まれる鉄(Fe)とp型クラッド層とp型コ
ンタクト層のドーパントである亜鉛(Zn)とが埋め込
み界面で相互拡散する問題があった。その結果、亜鉛が
埋め込み層に拡散し、素子特性劣化、特に変調特性劣化
の要因となっていた。
【0006】ところが、最近、Ruをドーパントとした
半絶縁性InP結晶がエピタキシャル成長法により得ら
れている(A.Dadger et.al, Appl.ied Physics Letters
73, N026 pp3878-3880 (1998)) 。ビスジメチルペンタ
ディエニルルテニウム(bis(η5-2,4-dimethylpentadi
enyl ruthenium(II)) をRuの原料ガスとして用い、有
機金属気相エピタキシ(MOVPE)法により、Ruを
4×1018cm3まで添加したInP結晶を成長してい
る。
【0007】RuはZnとほとんど相互拡散をおこさない
ことが見いだされ、電子に対してのみならず正孔に対し
ても十分補償可能なものである。また、Ruを添加した
高抵抗埋め込み層を用いた半導体レーザ作製の報告がな
されている(A.van Geelen et. al, 11th International
Conference on IndiumPhosphide and Related materia
ls TuB1-2 (1999))。この報告では、Ruを添加した高抵
抗InP層とその上に形成したn型InPホールブロック
層を埋め込み層として用いた半導体レーザの製作が述べ
られている。埋め込み層の成長は、MOVPE法を用い
たエピタキシャル成長により行われており、マストラン
スポートは用いられていない。
【0008】
【発明が解決しようとする課題】従来技術では、マスト
ランスポートで形成された部位がp型となる、接合容量
が増える、電流のリークパスができる、等の問題がある
ため素子の性能が低下し、製作歩留まりが低かった。ま
た、Ruの添加はエピタキシャル成長法により行われて
おり、マストランスポートによる添加は行われていなか
った。
【0009】本発明は、これらの従来素子の有する欠点
を解決するため、及びマストランスポートを用いた作製
方法の欠点を解決するためになされたものである。即
ち、pn埋め込み構造ではリークパスを防ぎ、半絶縁性
埋め込みでは、相互拡散を防ぎ、リークや接合容量の少
ない高性能な半導体光素子、及びそれを製作歩留まり良
く製造する方法を提供するものである。
【0010】
【課題を解決するための手段】前記目的を達成する本発
明の請求項1に係る半導体光素子は、半導体基板上に、
少なくとも第一の導電型を有するクラッド層、光ガイド
層或いは活性層でなる活性領域、第二の導電型を有する
クラッド層が積層された積層体からなるメサストライプ
があり、該活性領域の幅は該メサストライプの幅よりも
狭く、該活性領域の両側面が該メサストライプの側面の
内側にあり、該メサストライプの両側を埋め込み層で埋
め込んだ埋込型半導体素子において、少なくとも該活性
領域について、その両側面にある空隙に、ルテニウム
(元素記号:Ru)を添加した半絶縁層を配することを
特徴とする。
【0011】前記目的を達成する本発明の請求項2に係
る半導体光素子の製造方法は、第一の導電型を有する半
導体基板上に、第一の導電型を有するクラッド層、光ガ
イド層或いは活性層でなる活性領域、及び第二の導電形
を有するクラッド層を順次積層して積層体を形成する第
1の工程と、該積層体上に誘電体薄膜からなるマスクを
形成し、該マスクを介して該積層体層をエッチングし、
メサストライプを形成する第2の工程と、選択的なエッ
チングにより該活性領域の両側面をエッチングし、該活
性領域の幅が該メサストライプ幅よりも狭く、該活性領
域の両側面が該メサストライプの側面の内側になるよう
にする第3の工程と、該活性領域の両側面をマストラン
スポートにより埋め込む第4の工程と、マストランスポ
ートにより活性領域の両側面が埋め込まれたメサストラ
イプ構造の両わきに、第二の導電形半導体層と第一の導
電形を有する半導体層で順次埋め込んだ埋め込み層、或
いは半絶縁性半導体で埋め込む第5の工程とからなる半
導体光素子の製造方法において、上記第4の工程におい
て(元素記号:Ru)を含む原料ガスを流しながらマス
トランスポートを行うことを特徴とする。
【0012】〔作用〕Ruを添加した半導体層は半絶縁
性であり、p形不純物との相互拡散がなく、安定した高
抵抗層を実現でき、良質な電流狭窄層を実現できる。そ
のため、活性領域の両脇にRu添加層を配することによ
りpn接合面積を減少させたり、活性領域側壁のリーク
電流を少なくし、高周波特性が良く、効率のよい、変調
器や発光素子を実現できる。
【0013】また、Ruはマストランスポートを行う際
に雰囲気中にRuを含む有機金属ガスを供給すれば、マ
ストランスポートで形成した部位に簡単に添加すること
ができる。そのため、マストランスポートにより活性領
域の両脇を埋め込めば、その埋め込んだ領域(マストラ
ンスポート形成部位)は半絶縁性となる。Ruの持つ正
孔(ホール)に対する補償効果により、例えマストラン
スポート形成部位にp型不純物の亜鉛(Zn)が混入し
ても半絶縁性の層ができる。
【0014】
【発明の実施の形態】〔実施例1〕本発明の第1の実施
例を図1に示す。本実施例は、InGaAlAs/InAlA
s−MQWを光吸収層に用いた電界吸収型光変調器(E
A変調器)である。
【0015】図1に示すように、n型InP基板10上
に層厚約1μmのn型InPクラッド層12、活性領域
14、層厚1.5μmのp型InPクラッド層16、層
厚0.1μmのp型インジウムガリウム砒素燐(InGa
AsP:組成波長1.3ミクロン)電極層18、層厚
0.3μmのp型インジウムガリウム砒素(InGaA
s)電極層20の順に積層した。
【0016】それぞれの化合物半導体は特に断らない限
り、InP基板に格子整合する組成である。このときの
活性領域14は下から層厚40nmの無添加(故意に添
加していない)InGaAsP層(組成波長1.3μ
m)、6対のInGaAs井戸層(圧縮歪み0.5%、層
厚5nm)、InAlAs障壁層(伸張歪み0.4%、層
厚11nm)からなるMQW層、層厚40nmの無添加
InGaAsP層(組成波長1.3μm)からなる。
【0017】この積層体がメサストライプに加工され、
その両脇を半絶縁InP埋め込み層26で埋め込んでい
る。更にn型InP基板10の裏面にAuGeNiのn型電
極30を、p型インジウムガリウム砒素(InGaAs)
電極層20の上にAuZn/Auのp型ストライプ電極2
8をそれぞれ形成している。この構造が従来の埋め込み
型光素子と異なる点は、活性領域14と半絶縁InP埋
め込み層26との間にRu添加InP層24が配されてい
ることである。
【0018】即ち、活性領域14の幅がメサストライプ
の幅よりも狭く、活性領域14の両側面がメサストライ
プの側壁より内側に入り込んでおり、この様にして出来
た空隙にRu添加InP層24が配されている。この様な
構成をとったために、活性領域の両側にpn接合が形成
されず、従来問題となっていた容量の増加は起こらな
い。また、リーク電流も発生しない。
【0019】従来、活性領域の両側に空隙がある場合に
は、マストランスポートによりクラッド層の一部が融解
し、この空隙に移動して再結晶化するため、クラッド層
に添加されている不純物が取り込まれ、活性領域の両側
にpn接合が形成されていた。また、従来のマストラン
スポートにより活性領域の両脇を埋め込んだものではR
uの添加は行われておらず、取り込まれた不純物は補償
されないままであった。
【0020】本実施例では、n型InP基板10上に素
子を作製した場合を説明したが、基板はn型InPに限
られず、半絶縁性のInP基板でもp型InP基板でも可
能である。半絶縁性のInP基板の場合、n型電極は基
板裏面に形成されるのではなく、n型InPクラッド層
12に電気的な接触が得られるように形成する事が必要
である。
【0021】また、p型InP基板の場合には、p型In
P基板上に層厚約1μmのp型InPクラッド層、活性
領域、層厚1.5μmのn型InPクラッド層、層厚
0.1μmのn型インジウムガリウム砒素燐(InGaA
sP:組成波長1.3ミクロン)電極層、層厚0.3μ
mのn型インジウムガリウム砒素(InGaAs)電極層
の順に積層すればよい。活性領域の構造はn型InP基
板上のものと同じでよい。そして、基板裏面にAuZn/
Auのp型電極、n型インジウムガリウム砒素(InGa
As)電極層の上にAuGeNiのn型ストライプ電極電極
を形成する。
【0022】次に、この電界吸収型光変調器の製造方法
を説明する。まず、図2(a)に示すようにn型InP
基板10上に公知のMOVPE法により層厚約1μmの
n型InPクラッド層12、活性領域14、層厚1.5
μmのp型InPクラッド層16、層厚0.1μmのp
型インジウムガリウム砒素燐(InGaAsP,組成波長
1.3ミクロン)電極層18、層厚0.3μmのp型イ
ンジウムガリウム砒素(InGaAs)電極層20の順に
成長した。
【0023】それぞれの化合物半導体は特に断らない限
り、InP基板に格子整合する組成である。このときの
活性領域14は層厚40nmの無添加(故意に添加して
いない)InGaAsP層(組成波長1.3μm)、6対
のInGaAs井戸層(圧縮歪み0.5%、層厚5n
m)、InAlAs障壁層(伸張歪み0.4%、層厚11
nm)からなるMQW層、層厚40nmの無添加InGa
AsP層(組成波長1.3μm)からなる。原料はトリ
メチルインジウム、トリエチルガリウム、トリメチルア
ルミニウム、ジエチル亜鉛、フォスフィン、アルシン、
シランである。
【0024】次に、図2(b)に示すように、p型イン
ジウムガリウム砒素(InGaAs)電極層20の上にプ
ラズマCVD法やスパッタ法によりSiO2等の誘電体膜
を形成し、通常のフォトリソグラフィーでストライプ状
に加工した誘電体マスク22を形成する。そして、図2
(c)に示す様に、反応性イオンエッチング(RIE)
により、垂直メサストライプを形成する。
【0025】更に、塩酸でInP層12,16の側壁を
エッチングし、更に、室温で硫酸系エッチング液(例え
ば、硫酸:過酸化水素:水=3:1:1の混合液)で活
性領域14及び電極層18,20の側壁をエッチングし
た。この様な選択的に材料をエッチングするエッチング
液を用いることにより、図3(a)に示す様に、活性領
域14の幅がメサストライプ幅よりも狭くなるようにす
ることができる。
【0026】また、エッチングを行うことによりメサ側
面の変成層や加工によるダメージを除去することができ
る。続いて、MOVPE成長装置に装填し、水素とフォ
スフィンを導入しながら加熱し、500℃から更にRu
を含む有機金属原料ガスであるビスジメチルペンタディ
エニルルテニウム(bis(η5-2,4-dimethylpentadienyl
ruthenium(II)) を流し、昇温する。
【0027】このまま、650℃まで昇温し、ビスジメ
チルペンタジエニルルテニウムを流したままマストラン
スポートを行った。この結果、活性領域14周辺のIn
P層12,16から、InPがマストランスポートされ
活性領域側壁にマストランスポート形成部位24が形成
された。このとき、図3(b)に示すように、ビスジメ
チルペンタディエニルルテニウム(bis(η5-2,4-dimet
hylpentadienyl ruthenium(II)) は熱分解しRuを生
じ、マストランスポート形成部位24にRu金属が取り
込まれ、半絶縁性となる。この図3(b)に示す工程が
従来技術と著しく異なるところである。
【0028】従来のマストランスポートにおいてはRu
添加を行わないので、クラッドInPに含まれていた不
純物がそのままマストランスポート形成部位に添加され
ていた。しかしながら、本発明のようにマストランスポ
ートを行うときにRuを含む有機金属原料ガスを流すた
め、マストランスポート形成部位24にRuが添加され
る。RuはクラッドInPに含まれていた不純物を補償
し、マストランスポート形成部位24を半絶縁にする。
【0029】次に、図3(c)に示すように、この垂直
メサストライプ基板上に、公知のMOVPE法により、
Ruを添加しながらInP層26を成長させた。原料とし
てトリメチルインジウム、トリエチルガリウム、トリメ
チルアルミニウム、アルシンを用い、Ruの原料として
ビスジメチルペンタディエニルルテニウム(bis(η5-
2,4-dimethylpentadienyl ruthenium(II)) を用いた。
この後、誘電体マスク22を除去し、AuZn/Auのp
型ストライプ電極28を蒸着とリフトオフにより形成
し、基板側にAuGeNin型電極30を蒸着により形成
した。
【0030】この様にして作製した電界吸収型光変調器
の断面構造は、図1に示したものと同じである。この様
にして作製された電界吸収型光変調器の断面を走査型電
子顕微鏡で観察したところ、活性領域14とマストラン
スポート形成部位24との間、及びメサストライプと埋
め込み層26との間には空隙が無く、良質なマストラン
スポート形成部位24と埋め込み層が得られていること
が判った。この構造は劈開後実装し、その特性を評価し
たところ、電界吸収型光変調器として好適なものであっ
た。即ち、この変調器の容量は0.5pFであり、従来
の1pFに対し半減した。このため、高速変調器として
極めて好適であり、15GHzの高速変調が可能であっ
た。
【0031】更に、暗電流についても改善が得られ、2
Vの逆バイアス時で、90%の素子(チップ)で1nA
以下となった。本発明のマストランスポートによる埋め
込みは、従来のエピタキシャル成長による埋め込み層に
比べ容易に空孔のない埋め込みが実現でき、かつ、Ru
とZnの相互拡散も生じないために、活性層側面のリー
ク電流は極めて少ない特徴をもっている。
【0032】このため、電界吸収型光変調器のような、
逆バイアス型デバイスにおいても、十分良好な埋め込み
構造が実現できた。この変調器は印可電圧1.5Vで消
光比15dB,15GHzの変調特性を得た。上記の実
施例では、埋め込み層26としてRu添加InP埋め込み
層を用いたが、これに限られるものではない。光の伝搬
モードを調整するため、埋め込み層として組成により屈
折率を変えることが可能なRu添加InGaAsP層として
も良く、また、埋め込み層として従来から用いられてい
るFe添加InP層を用いても、またp型InPとn型In
P層の積層体を用いても同様な効果が期待できる。
【0033】ここでは、InGaAlAs/InAlAs−M
QWを光吸収層に用いた電界吸収型光変調器を例として
示したが、MQWを活性層とするレーザも同様にして作
製できる。また、活性層をMQWからバルク層に代えて
も同様な効果が得られることは云うまでもない。また、
MQWをInGaAsP系の材料で構成しても同様の効果
を得ることが出来る。
【0034】〔実施例2〕本発明の第2の実施例として
pn接合埋め込みレーザを取り上げ説明する。作製方法
を説明しながら、その構造を逐次説明する。実施例1と
同様にして、図1(a)から図3(b)に示された工程
により、図4(a)に示すメサストライプ構造を制作す
る。マストランスポートの工程においては、Ruを含む
有機金属原料ガスであるビスジメチルペンタディエニル
ルテニウム(bis(η5-2,4-dimethylpentadienyl ruthe
nium(II)) を流し、マストランスポート形成部位24に
Ruを添加したことは云うまでもない。その結果、マス
トランスポート形成部位24は半絶縁化されている。
【0035】つぎに、成長装置から取り出さずに、その
まま、図4(b)に示すように、マストランスポートよ
りも低い温度でZnを添加したp型InP埋め込み層40
を0.7μm、続けてSiを添加したn型InP埋め込み
層42を約1.3μm成長した。ここで注意してほしい
のは、マストランスポート形成部位24がRu添加によ
り半絶縁化されているため、この領域とp型InP埋め
込み層40が接してもリーク電流は発生しないことであ
る。
【0036】この後、誘電体マスク22を除去し、基板
側にAuGeNiのn型電極30、メサ上部にAuZnのp
型電極28を形成した。この構造のレーザは活性層側面
のリークが防げるため、発光効率が5%向上した。ここ
では、n型InP基板を例としたが、p型基板において
も、導電型を逆にすれば容易に実現できる。以上のよう
にして、発光効率のよいレーザを歩留まり良く実現でき
た。
【0037】このように説明したように本発明は、埋め
込み構造半導体光素子の活性領域を、ルテニウム(R
u)を添加した半絶縁層で埋め込むことにより、従来問
題となっていたリーク電流や接合容量の増大を抑制する
ものであり、この考えを素子構造及び作製方法として実
現したものである。尚、上記実施例において、Ruを含
む有機金属原料ガスとして、ビスジメチルペンタディエ
ニルルテニウムが挙げたが、これに限るものではなく、
Ruを含む他の有機金属原料ガスでも良い。
【0038】
【発明の効果】以上、実施例に基づいて具体的に説明し
たように、本発明によれば、Ruを添加した半導体層が
半絶縁性となり、p形不純物との相互拡散がなく、安定
した高抵抗層を実現でき、良質な電流狭窄層を実現でき
る。このため、pn接合面積を減少させたり、活性領域
側壁のリーク電流を少なくし、高周波特性が良く、効率
のよい、変調器や発光素子を実現できるという著しい効
果を奏する。また、Ruはマストランスポートを行う際
に雰囲気中にRuを含む有機金属ガスを供給すれば、マ
ストランスポートで形成した部位に簡単に添加すること
ができる。このためpn埋め込み構造では、リークパス
を防ぎ、半絶縁性埋め込みでは、相互拡散を防ぎ、リー
クや接合容量の少ない高性能な半導体光素子を製作歩留
まり良く製造する方法を提供するという著しい効果を奏
する。
【図面の簡単な説明】
【図1】本発明の第1の実施例に係る電界吸収型光変調
器の構造を示す断面図である。
【図2】図2(a)〜(c)は本発明にかかる第1の実
施例の作製方法を示す工程図である。
【図3】図3(a)〜(c)は本発明にかかる第1の実
施例の作製方法を示す工程図である。
【図4】図4(a)〜(c)は本発明にかかる第2実施
例の作製方法を示す工程図である。
【符号の説明】
10 n型InP基板 12 n型InPクラッド層 14 活性領域 16 p型InPクラッド層 18 p型InGaAsP電極層 20 p型InGaAs電極層 22 誘電体マスク 24 Ru添加層 26 半絶縁埋め込み層 28 p型電極 30 n型電極 40 p型InP埋め込み層 42 n型InP埋め込み層
───────────────────────────────────────────────────── フロントページの続き (72)発明者 小笠原 松幸 東京都千代田区大手町二丁目3番1号 日 本電信電話株式会社内 (72)発明者 近藤 康洋 東京都千代田区大手町二丁目3番1号 日 本電信電話株式会社内 (72)発明者 野口 悦男 東京都千代田区大手町二丁目3番1号 日 本電信電話株式会社内 Fターム(参考) 2H079 AA02 AA13 BA01 CA04 DA16 EA03 EA07 EA08 EB04 HA15 5F073 AA22 AA74 BA01 CA07 CB11 DA05 EA14

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 半導体基板上に、少なくとも第一の導電
    型を有するクラッド層、光ガイド層或いは活性層でなる
    活性領域、第二の導電型を有するクラッド層が積層され
    た積層体からなるメサストライプがあり、該活性領域の
    幅は該メサストライプの幅よりも狭く、該活性領域の両
    側面が該メサストライプの側面の内側にあり、該メサス
    トライプの両側を埋め込み層で埋め込んだ埋込型半導体
    素子において、少なくとも該活性領域について、その両
    側面にある空隙に、ルテニウムを添加した半絶縁層を配
    することを特徴とする半導体光素子。
  2. 【請求項2】 半導体基板上に、少なくとも第一の導電
    型を有するクラッド層、光ガイド層或いは活性層でなる
    活性領域、及び第二の導電形を有するクラッド層を順次
    積層して積層体を形成する第1の工程と、該積層体上に
    誘電体薄膜からなるマスクを形成し、該マスクを介して
    該積層体層をエッチングし、メサストライプを形成する
    第2の工程と、選択的なエッチングにより該活性領域の
    両側面をエッチングし、該活性領域の幅が該メサストラ
    イプ幅よりも狭く、該活性領域の両側面が該メサストラ
    イプの側面の内側になるようにする第3の工程と、該活
    性領域の両側面をマストランスポートにより埋め込む第
    4の工程と、マストランスポートにより活性領域の両側
    面が埋め込まれたメサストライプ構造の両わきに、第二
    の導電形を有する半導体層と第一の導電形を有する半導
    体層で順次埋め込んだ埋め込み層、或いは半絶縁性半導
    体で埋め込む第5の工程とからなる半導体光素子の製造
    方法において、上記第4の工程においてルテニウムを含
    む原料ガスを流しながらマストランスポートを行うこと
    を特徴とする半導体光素子の製造方法。
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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2007096939A1 (ja) * 2006-02-20 2007-08-30 Fujitsu Limited 光半導体装置とその製造方法
JP2008288284A (ja) * 2007-05-15 2008-11-27 Sumitomo Electric Ind Ltd 半導体光素子及びその製造方法
JP2009004450A (ja) * 2007-06-19 2009-01-08 Sumitomo Electric Ind Ltd 半導体光素子及びその製造方法
JP2010040649A (ja) * 2008-08-01 2010-02-18 Sumitomo Electric Ind Ltd 半導体発光素子の製造方法
JP2011044564A (ja) * 2009-08-20 2011-03-03 Fujitsu Ltd 光半導体装置及び光半導体装置の製造方法

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2007096939A1 (ja) * 2006-02-20 2007-08-30 Fujitsu Limited 光半導体装置とその製造方法
US8093581B2 (en) 2006-02-20 2012-01-10 Fujitsu Limited Optical semiconductor device and method for manufacturing the same
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JP2008288284A (ja) * 2007-05-15 2008-11-27 Sumitomo Electric Ind Ltd 半導体光素子及びその製造方法
JP2009004450A (ja) * 2007-06-19 2009-01-08 Sumitomo Electric Ind Ltd 半導体光素子及びその製造方法
JP2010040649A (ja) * 2008-08-01 2010-02-18 Sumitomo Electric Ind Ltd 半導体発光素子の製造方法
JP2011044564A (ja) * 2009-08-20 2011-03-03 Fujitsu Ltd 光半導体装置及び光半導体装置の製造方法

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