JP2002246919A - 自動レベル制御回路 - Google Patents
自動レベル制御回路Info
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Abstract
(57)【要約】
【課題】 分解能の高いＤ／Ａコンバータを使用するこ
となく、簡単な構成で、低送信出力時の出力電力の規定
のレベルへの調整を容易に且つ正確に行う。 【解決手段】 Ｄ／Ａコンバータ７とフィルタ８との間
に切替スイッチ１６を設ける。切替スイッチ１６の入力
端子１６ＡにＤ／Ａコンバータ７からのアナログ電圧Ｖ
ｂを与える。分圧回路１５を設け、Ｄ／Ａコンバータ７
からのアナログ電圧Ｖｂを分圧し、アナログ分圧電圧Ｖ
ｃとして切替スイッチ１６の入力端子１６Ｂに与える。
切替スイッチ１６の切り替えをＣＰＵ５によって制御す
る。送信出力電力としてＰＬ５〜ＰＬ１８を指示する場
合には端子１６Ａ側とし、ＰＬ１９を指示する場合には
端子１６Ｂ側とする。
となく、簡単な構成で、低送信出力時の出力電力の規定
のレベルへの調整を容易に且つ正確に行う。 【解決手段】 Ｄ／Ａコンバータ７とフィルタ８との間
に切替スイッチ１６を設ける。切替スイッチ１６の入力
端子１６ＡにＤ／Ａコンバータ７からのアナログ電圧Ｖ
ｂを与える。分圧回路１５を設け、Ｄ／Ａコンバータ７
からのアナログ電圧Ｖｂを分圧し、アナログ分圧電圧Ｖ
ｃとして切替スイッチ１６の入力端子１６Ｂに与える。
切替スイッチ１６の切り替えをＣＰＵ５によって制御す
る。送信出力電力としてＰＬ５〜ＰＬ１８を指示する場
合には端子１６Ａ側とし、ＰＬ１９を指示する場合には
端子１６Ｂ側とする。
Description
【０００１】
【発明の属する技術分野】この発明は、ＧＳＭ（Global
System for Mobile communications）方式の携帯電話
機に用いて好適な自動レベル制御回路に関するものであ
る。
System for Mobile communications）方式の携帯電話
機に用いて好適な自動レベル制御回路に関するものであ
る。
【０００２】
【従来の技術】ヨーロッパやアジアで使用されているＧ
ＳＭ方式の携帯電話機（ＧＳＭ携帯電話機）は、ＥＴＳ
Ｉ（Europeans Telecommunications Standards Institu
te）が規定している。ＧＳＭ電話機の送信電力の規格
は、ＥＴＳＩのＧＳＭ０５．０５に記載されている。例
えば、ＣＬＡＳＳ４と呼ばれるＧＳＭ携帯電話機では、
最大出力電力はパワーレベルＰＬ５と呼び、３３ｄＢｍ
の出力電力であり、パワーレベルＰＬ６では出力電力は
３１ｄＢｍである。以下、ＰＬ７〜ＰＬ１８と続き、最
小出力電力はパワーレベルＰＬ１９と呼び、５ｄＢｍで
ある。つまり、このＣＬＡＳＳ４のＧＳＭ携帯電話機の
場合、パワーレベルはＰＬ５からＰＬ１９の１５段階、
２ｄＢステップで規定されている。
ＳＭ方式の携帯電話機（ＧＳＭ携帯電話機）は、ＥＴＳ
Ｉ（Europeans Telecommunications Standards Institu
te）が規定している。ＧＳＭ電話機の送信電力の規格
は、ＥＴＳＩのＧＳＭ０５．０５に記載されている。例
えば、ＣＬＡＳＳ４と呼ばれるＧＳＭ携帯電話機では、
最大出力電力はパワーレベルＰＬ５と呼び、３３ｄＢｍ
の出力電力であり、パワーレベルＰＬ６では出力電力は
３１ｄＢｍである。以下、ＰＬ７〜ＰＬ１８と続き、最
小出力電力はパワーレベルＰＬ１９と呼び、５ｄＢｍで
ある。つまり、このＣＬＡＳＳ４のＧＳＭ携帯電話機の
場合、パワーレベルはＰＬ５からＰＬ１９の１５段階、
２ｄＢステップで規定されている。
【０００３】また、ＧＳＭ方式はＴＤＭＡ（Time Divis
ion Multiple Access ）でバースト動作しており、工場
出荷時にＰＬ５〜ＰＬ１９の各出力電力の調整を行って
いる。このような送信電力の調整方法として、ＡＬＣ
（Auto Level Control）方式が用いられている。一般的
なＧＳＭ電話機におけるＡＬＣ回路（自動レベル調整回
路）を図２に示す。
ion Multiple Access ）でバースト動作しており、工場
出荷時にＰＬ５〜ＰＬ１９の各出力電力の調整を行って
いる。このような送信電力の調整方法として、ＡＬＣ
（Auto Level Control）方式が用いられている。一般的
なＧＳＭ電話機におけるＡＬＣ回路（自動レベル調整回
路）を図２に示す。
【０００４】このＡＬＣ回路は、送信電力を増幅する電
力増幅器１と、カプラ２と、電力検波部３と、ゲインコ
ントロール部４と、ＣＰＵ５と、メモリ６と、Ｄ／Ａコ
ンバータ７と、フィルタ（ローパスフィルタ）８とを備
えている。電力増幅器１は自身のゲイン、すなわち送信
電力に対するゲインを可変可能とする外部入力端子（以
下、ゲインコントロール端子と呼ぶ）１ａを有してい
る。電力検波部３は検波ダイオード９と抵抗１０とによ
って構成されている。ゲインコントロール部４はオペア
ンプ１１と抵抗１２，１３とコンデンサ１４とで構成さ
れている。
力増幅器１と、カプラ２と、電力検波部３と、ゲインコ
ントロール部４と、ＣＰＵ５と、メモリ６と、Ｄ／Ａコ
ンバータ７と、フィルタ（ローパスフィルタ）８とを備
えている。電力増幅器１は自身のゲイン、すなわち送信
電力に対するゲインを可変可能とする外部入力端子（以
下、ゲインコントロール端子と呼ぶ）１ａを有してい
る。電力検波部３は検波ダイオード９と抵抗１０とによ
って構成されている。ゲインコントロール部４はオペア
ンプ１１と抵抗１２，１３とコンデンサ１４とで構成さ
れている。
【０００５】ゲインコントロール部４において、抵抗１
２，１３およびコンデンサ１４は、オペアンプ１１のゲ
インや過渡応答等を調整するために設けられている。Ｃ
ＰＵ５は携帯電話機全体を制御する。メモリ６には、Ｃ
ＰＵ５を動作させるためのプログラムなどの他、ＰＬ５
〜ＰＬ１９の各出力電力の設定値が格納されている。こ
の例において、ＰＬ５〜ＰＬ１９の設定値は、時間の経
過と共に段階的に上昇し、所定値になった後、段階的に
下降するパターンとされている。このＰＬ５〜ＰＬ１９
の設定値のパターンがＰＬ５〜ＰＬ１９用のＡＬＣ制御
用データとしてメモリ６に格納されている。すなわち、
メモリ６には、１５個のＡＬＣ制御用データテーブルが
ある。
２，１３およびコンデンサ１４は、オペアンプ１１のゲ
インや過渡応答等を調整するために設けられている。Ｃ
ＰＵ５は携帯電話機全体を制御する。メモリ６には、Ｃ
ＰＵ５を動作させるためのプログラムなどの他、ＰＬ５
〜ＰＬ１９の各出力電力の設定値が格納されている。こ
の例において、ＰＬ５〜ＰＬ１９の設定値は、時間の経
過と共に段階的に上昇し、所定値になった後、段階的に
下降するパターンとされている。このＰＬ５〜ＰＬ１９
の設定値のパターンがＰＬ５〜ＰＬ１９用のＡＬＣ制御
用データとしてメモリ６に格納されている。すなわち、
メモリ６には、１５個のＡＬＣ制御用データテーブルが
ある。
【０００６】このＡＬＣ回路において、電力増幅器１で
増幅された送信波は、カプラ２を介してアンテナ側へ送
られる。この際、大部分の電力はアンテナ側へ送られる
が、一部の電力が電力検波部３に供給される。電力検波
部３は、ダイオード９と抵抗１０とによって一般的な包
絡線検波を行い、電力増幅器１の出力電力に応じた直流
電圧成分（検出電圧）Ｖａを抵抗１２を介してオペアン
プ１１の反転入力端へ与える。
増幅された送信波は、カプラ２を介してアンテナ側へ送
られる。この際、大部分の電力はアンテナ側へ送られる
が、一部の電力が電力検波部３に供給される。電力検波
部３は、ダイオード９と抵抗１０とによって一般的な包
絡線検波を行い、電力増幅器１の出力電力に応じた直流
電圧成分（検出電圧）Ｖａを抵抗１２を介してオペアン
プ１１の反転入力端へ与える。
【０００７】一方、ＣＰＵ５は、メモリ６から取り出す
設定値のパワーレベルを指示する。例えば、ＣＰＵ５が
ＰＬ５の送信出力電力を指示した場合、Ｄ／Ａコンバー
タ７はメモリ６からＰＬ５用のＡＬＣ制御用データを読
み込み、Ｄ／Ａ変換し、直流電圧成分（アナログ電圧）
Ｖｂを出力する。Ｄ／Ａコンバータ７が出力するアナロ
グ電圧Ｖｂはフィルタ８へ与えられる。フィルタ８は、
アナログ電圧Ｖｂの階段状部分を平滑化してＶｂ’と
し、オペアンプ１１の非反転入力端へ与える。図３にＤ
／Ａコンバータ７が出力するアナログ電圧Ｖｂを示す。
図３にはＰＬ５とＰＬ１９しか示していないが、実際に
はＣＰＵ５からの指示に応じ、ＰＬ５からＰＬ１９まで
１５種類のパターンのアナログ電圧Ｖｂとなる。
設定値のパワーレベルを指示する。例えば、ＣＰＵ５が
ＰＬ５の送信出力電力を指示した場合、Ｄ／Ａコンバー
タ７はメモリ６からＰＬ５用のＡＬＣ制御用データを読
み込み、Ｄ／Ａ変換し、直流電圧成分（アナログ電圧）
Ｖｂを出力する。Ｄ／Ａコンバータ７が出力するアナロ
グ電圧Ｖｂはフィルタ８へ与えられる。フィルタ８は、
アナログ電圧Ｖｂの階段状部分を平滑化してＶｂ’と
し、オペアンプ１１の非反転入力端へ与える。図３にＤ
／Ａコンバータ７が出力するアナログ電圧Ｖｂを示す。
図３にはＰＬ５とＰＬ１９しか示していないが、実際に
はＣＰＵ５からの指示に応じ、ＰＬ５からＰＬ１９まで
１５種類のパターンのアナログ電圧Ｖｂとなる。
【０００８】オペアンプ１１は、電力検波部３からの検
出電圧ＶａとＤ／Ａコンバータ７からのフィルタ８を介
するアナログ電圧Ｖｂ’とを比較し、その差分を電力増
幅器１のゲインコントロール端子１ａへ与える。例え
ば、検出電圧Ｖａがアナログ電圧Ｖｂ’よりも低い場
合、電力増幅器１へのゲインコントロール端子電圧を上
げ、電力増幅器１の出力電力を大きくする。つまり、こ
のＡＬＣ回路では、Ｄ／Ａコンバータ７の出力電圧Ｖｂ
に電力増幅器１の出力電力が追従する一種の閉ループ制
御系になる。
出電圧ＶａとＤ／Ａコンバータ７からのフィルタ８を介
するアナログ電圧Ｖｂ’とを比較し、その差分を電力増
幅器１のゲインコントロール端子１ａへ与える。例え
ば、検出電圧Ｖａがアナログ電圧Ｖｂ’よりも低い場
合、電力増幅器１へのゲインコントロール端子電圧を上
げ、電力増幅器１の出力電力を大きくする。つまり、こ
のＡＬＣ回路では、Ｄ／Ａコンバータ７の出力電圧Ｖｂ
に電力増幅器１の出力電力が追従する一種の閉ループ制
御系になる。
【０００９】したがって、ＣＰＵ５がＰＬ５の送信出力
電力を指示すれば、その指示期間における電力増幅器１
の出力電力はメモリ６に格納されているＰＬ５の出力電
力の設定値に応じた値となる。ここで、工場出荷時にお
いて出力電力を調整する場合、ＰＬ５の指示期間におけ
る電力増幅器１の出力電力の最大値がＰＬ５の規定の電
力レベルでない場合には、規定の電力レベルとなるよう
に、メモリ６内のＰＬ５の設定値を調整する。同様に、
ＰＬ６〜ＰＬ１９についても、ＰＬ６〜ＰＬ１９の指示
期間における電力増幅器１の出力電力の最大値がＰＬ６
〜ＰＬ１９の規定の電力レベルになるように、メモリ６
内のＰＬ６〜ＰＬ１９の設定値を調整する。
電力を指示すれば、その指示期間における電力増幅器１
の出力電力はメモリ６に格納されているＰＬ５の出力電
力の設定値に応じた値となる。ここで、工場出荷時にお
いて出力電力を調整する場合、ＰＬ５の指示期間におけ
る電力増幅器１の出力電力の最大値がＰＬ５の規定の電
力レベルでない場合には、規定の電力レベルとなるよう
に、メモリ６内のＰＬ５の設定値を調整する。同様に、
ＰＬ６〜ＰＬ１９についても、ＰＬ６〜ＰＬ１９の指示
期間における電力増幅器１の出力電力の最大値がＰＬ６
〜ＰＬ１９の規定の電力レベルになるように、メモリ６
内のＰＬ６〜ＰＬ１９の設定値を調整する。
【００１０】
【発明が解決しようとする課題】電力増幅器１のゲイン
コントロール端子電圧と出力電力の特性を図４に示す。
図４において、Ａは送信出力電力の小さい（例えば、Ｐ
Ｌ１９）ところを示し、Ｂは送信出力電力の大きい（例
えば、ＰＬ５）ところを示す。送信出力電力が大きいＢ
の付近ではゲインコントロール端子電圧の変化に対する
出力電力の変化幅は小さい。これに対し、送信出力電力
が小さいＡの付近では、ゲインコントロール端子電圧の
変化に対する出力電力の変化幅が大きい。このため、低
送信出力時（例えば、ＰＬ１９の場合）、送信出力電力
を規定の電力レベルに正確に合わせ込むことができない
という不具合が発生していた。
コントロール端子電圧と出力電力の特性を図４に示す。
図４において、Ａは送信出力電力の小さい（例えば、Ｐ
Ｌ１９）ところを示し、Ｂは送信出力電力の大きい（例
えば、ＰＬ５）ところを示す。送信出力電力が大きいＢ
の付近ではゲインコントロール端子電圧の変化に対する
出力電力の変化幅は小さい。これに対し、送信出力電力
が小さいＡの付近では、ゲインコントロール端子電圧の
変化に対する出力電力の変化幅が大きい。このため、低
送信出力時（例えば、ＰＬ１９の場合）、送信出力電力
を規定の電力レベルに正確に合わせ込むことができない
という不具合が発生していた。
【００１１】すなわち、このＡＬＣ回路において、Ｄ／
Ａコンバータ７として例えば９ビットのものを使用した
場合、Ｄ／Ａコンバータ７に設定可能な設定値は２9 ＝
５１２、つまり０から５１１となる。Ｄ／Ａコンバータ
７の出力電圧範囲を０〜２Ｖとすると、このＤ／Ａコン
バータ７の分解能は２Ｖ／５１２＝３．９ｍＶとなり、
Ｄ／Ａコンバータ７への設定値が１変化すると、Ｄ／Ａ
コンバータ７の出力電圧は３．９ｍＶ変化することにな
る。例えば、ＰＬ１９の場合、Ｄ／Ａコンバータ７への
設定値を１変化させると、Ｄ／Ａコンバータ７の出力電
圧が３．９ｍＶ変化し、電力増幅器１の出力電力も大き
く変化する。したがって、この出力電力の変化幅よりも
小さな調整ができず、規定の電力レベルに正確に合わせ
込むことができない。
Ａコンバータ７として例えば９ビットのものを使用した
場合、Ｄ／Ａコンバータ７に設定可能な設定値は２9 ＝
５１２、つまり０から５１１となる。Ｄ／Ａコンバータ
７の出力電圧範囲を０〜２Ｖとすると、このＤ／Ａコン
バータ７の分解能は２Ｖ／５１２＝３．９ｍＶとなり、
Ｄ／Ａコンバータ７への設定値が１変化すると、Ｄ／Ａ
コンバータ７の出力電圧は３．９ｍＶ変化することにな
る。例えば、ＰＬ１９の場合、Ｄ／Ａコンバータ７への
設定値を１変化させると、Ｄ／Ａコンバータ７の出力電
圧が３．９ｍＶ変化し、電力増幅器１の出力電力も大き
く変化する。したがって、この出力電力の変化幅よりも
小さな調整ができず、規定の電力レベルに正確に合わせ
込むことができない。
【００１２】なお、この問題を回避するために、Ｄ／Ａ
コンバータ７として分解能の高いものを用いることが考
えられるが、Ｄ／Ａコンバータ７が高価になったり、分
解能が増えた分メモリ６に格納されるデータが大きくな
り、メモリ容量の増加という問題が生じる。
コンバータ７として分解能の高いものを用いることが考
えられるが、Ｄ／Ａコンバータ７が高価になったり、分
解能が増えた分メモリ６に格納されるデータが大きくな
り、メモリ容量の増加という問題が生じる。
【００１３】本発明はこのような課題を解決するために
なされたもので、その目的とするところは、分解能の高
いＤ／Ａコンバータを使用することなく、簡単な構成
で、低送信出力時の出力電力の規定のレベルへの調整を
容易に且つ正確に行うことの可能なＡＬＣ回路を提供す
ることにある。
なされたもので、その目的とするところは、分解能の高
いＤ／Ａコンバータを使用することなく、簡単な構成
で、低送信出力時の出力電力の規定のレベルへの調整を
容易に且つ正確に行うことの可能なＡＬＣ回路を提供す
ることにある。
【００１４】
【課題を解決するための手段】このような目的を達成す
るために本発明は、Ｄ／Ａ変換部からのアナログ電圧を
分圧し分圧アナログ電圧とする分圧部と、分圧アナログ
電圧およびＤ／Ａ変換部からのアナログ電圧を入力とし
その何れか一方を選択出力する切替スイッチ部とを設
け、Ｄ／Ａ変換部への設定値のパワーレベルを指定する
際、その指定パワーレベルに応じて切替スイッチ部の選
択出力モードを切り替えるようにしたものである。
るために本発明は、Ｄ／Ａ変換部からのアナログ電圧を
分圧し分圧アナログ電圧とする分圧部と、分圧アナログ
電圧およびＤ／Ａ変換部からのアナログ電圧を入力とし
その何れか一方を選択出力する切替スイッチ部とを設
け、Ｄ／Ａ変換部への設定値のパワーレベルを指定する
際、その指定パワーレベルに応じて切替スイッチ部の選
択出力モードを切り替えるようにしたものである。
【００１５】この発明によれば、高パワーレベル（例え
ば、ＰＬ５〜ＰＬ１８）の指定時には切替スイッチ部
（切替スイッチ１６（図１参照））の選択出力モードを
Ｄ／Ａ変換部（Ｄ／Ａ変換器７）からのアナログ電圧を
出力するモードに切り替え、低パワーレベル（例えば、
ＰＬ１９）の指定時には切替スイッチ部の選択出力モー
ドを分圧部（分圧回路１５）からの分圧アナログ電圧を
出力するモードに切り替えるようにすると、低パワーレ
ベルの指定時には分圧部からの分圧アナログ電圧と電力
検出部（電力検波部９）からの検出電圧とが比較され、
その比較結果に基づいて電力増幅部（電力増幅器１）に
おける送信電力に対するゲインがコントロールされる。
この場合、電力検出部からの検出電圧と比較されるアナ
ログ電圧は、Ｄ／Ａ変換部からのアナログ電圧を分圧し
た分圧アナログ電圧であり、指定パワーレベルの設定値
を１変化させたときの変化量が小さく、あたかもＤ／Ａ
変換部の分解能が高くなったかのように作用する。
ば、ＰＬ５〜ＰＬ１８）の指定時には切替スイッチ部
（切替スイッチ１６（図１参照））の選択出力モードを
Ｄ／Ａ変換部（Ｄ／Ａ変換器７）からのアナログ電圧を
出力するモードに切り替え、低パワーレベル（例えば、
ＰＬ１９）の指定時には切替スイッチ部の選択出力モー
ドを分圧部（分圧回路１５）からの分圧アナログ電圧を
出力するモードに切り替えるようにすると、低パワーレ
ベルの指定時には分圧部からの分圧アナログ電圧と電力
検出部（電力検波部９）からの検出電圧とが比較され、
その比較結果に基づいて電力増幅部（電力増幅器１）に
おける送信電力に対するゲインがコントロールされる。
この場合、電力検出部からの検出電圧と比較されるアナ
ログ電圧は、Ｄ／Ａ変換部からのアナログ電圧を分圧し
た分圧アナログ電圧であり、指定パワーレベルの設定値
を１変化させたときの変化量が小さく、あたかもＤ／Ａ
変換部の分解能が高くなったかのように作用する。
【００１６】
【発明の実施の形態】以下、本発明を図面に基づいて詳
細に説明する。図１はこの発明に係るＡＬＣ回路の一実
施の形態を示す回路図である。同図において、図２と同
一符号は同一或いは同等構成要素を示し、その説明は省
略する。
細に説明する。図１はこの発明に係るＡＬＣ回路の一実
施の形態を示す回路図である。同図において、図２と同
一符号は同一或いは同等構成要素を示し、その説明は省
略する。
【００１７】この実施の形態では、Ｄ／Ａコンバータ７
とフィルタ８との間に切替スイッチ１６を設け、この切
替スイッチ１６の第１の入力端子１６ＡにＤ／Ａコンバ
ータ７からのアナログ電圧Ｖｂを与えるようにしてい
る。また、Ｄ／Ａコンバータ７と切替スイッチ１６の入
力端子１６Ａとの接続ラインと接地ラインとの間に抵抗
１７と１８との直列接続回路（分圧回路）１５を設け、
抵抗１７と１８との接続点Ｐ１に生ずる分圧電圧Ｖｃ
を、すなわちＤ／Ａコンバータ７からのアナログ電圧Ｖ
ｂを抵抗１８と１９とによって分圧したアナログ分圧電
圧Ｖｃを、切替スイッチ１６の第２の入力端子１６Ｂに
与えるようにしている。
とフィルタ８との間に切替スイッチ１６を設け、この切
替スイッチ１６の第１の入力端子１６ＡにＤ／Ａコンバ
ータ７からのアナログ電圧Ｖｂを与えるようにしてい
る。また、Ｄ／Ａコンバータ７と切替スイッチ１６の入
力端子１６Ａとの接続ラインと接地ラインとの間に抵抗
１７と１８との直列接続回路（分圧回路）１５を設け、
抵抗１７と１８との接続点Ｐ１に生ずる分圧電圧Ｖｃ
を、すなわちＤ／Ａコンバータ７からのアナログ電圧Ｖ
ｂを抵抗１８と１９とによって分圧したアナログ分圧電
圧Ｖｃを、切替スイッチ１６の第２の入力端子１６Ｂに
与えるようにしている。
【００１８】切替スイッチ１６は、第１の入力端子１６
Ａと出力端子１６Ｃとの接続モード時（第１の選択出力
モード時）には、Ｄ／Ａコンバータ７からのアナログ電
圧Ｖｂを選択出力する。第２の入力端子１６Ｂと出力端
子１６Ｃとの接続モード時（第２の選択出力モード時）
には、分圧回路１５からの分圧アナログ電圧Ｖｃを選択
出力する。この切替スイッチ１６の選択出力モードの切
替はＣＰＵ５によって制御される。この実施の形態にお
いて、ＣＰＵ５は、送信出力電力としてＰＬ５〜ＰＬ１
８を指示する場合には切替スイッチ１６を第１の選択出
力モードとし、ＰＬ１９を指示する場合には第２の選択
出力モードとする。
Ａと出力端子１６Ｃとの接続モード時（第１の選択出力
モード時）には、Ｄ／Ａコンバータ７からのアナログ電
圧Ｖｂを選択出力する。第２の入力端子１６Ｂと出力端
子１６Ｃとの接続モード時（第２の選択出力モード時）
には、分圧回路１５からの分圧アナログ電圧Ｖｃを選択
出力する。この切替スイッチ１６の選択出力モードの切
替はＣＰＵ５によって制御される。この実施の形態にお
いて、ＣＰＵ５は、送信出力電力としてＰＬ５〜ＰＬ１
８を指示する場合には切替スイッチ１６を第１の選択出
力モードとし、ＰＬ１９を指示する場合には第２の選択
出力モードとする。
【００１９】〔ＰＬ５〜ＰＬ１８の場合〕ＣＰＵ５がＰ
Ｌ５〜ＰＬ１８の送信出力電力を指示すると、Ｄ／Ａコ
ンバータ７はメモリ６からＰＬ５〜ＰＬ１８用のＡＬＣ
制御用データを読み込み、Ｄ／Ａ変換し、直流電圧成分
（アナログ電圧）Ｖｂを出力する。この場合、切替スイ
ッチ１６は、ＣＰＵ５からの制御により第１の選択出力
モードとされる。すなわち、第１の入力端子１６Ａと出
力端子１６Ｃとの接続モードとされる。これにより、Ｄ
／Ａコンバータ７からのアナログ電圧Ｖｂが切替スイッ
チ１６を通過し、フィルタ８で平滑化され、アナログ電
圧Ｖｂ’としてオペアンプ１１の非反転入力端へ与えら
れる。
Ｌ５〜ＰＬ１８の送信出力電力を指示すると、Ｄ／Ａコ
ンバータ７はメモリ６からＰＬ５〜ＰＬ１８用のＡＬＣ
制御用データを読み込み、Ｄ／Ａ変換し、直流電圧成分
（アナログ電圧）Ｖｂを出力する。この場合、切替スイ
ッチ１６は、ＣＰＵ５からの制御により第１の選択出力
モードとされる。すなわち、第１の入力端子１６Ａと出
力端子１６Ｃとの接続モードとされる。これにより、Ｄ
／Ａコンバータ７からのアナログ電圧Ｖｂが切替スイッ
チ１６を通過し、フィルタ８で平滑化され、アナログ電
圧Ｖｂ’としてオペアンプ１１の非反転入力端へ与えら
れる。
【００２０】オペアンプ１１は、電力検波部３からの検
出電圧ＶａとＤ／Ａコンバータ７からのフィルタ８を介
するアナログ電圧Ｖｂ’とを比較し、その差分を電力増
幅器１のゲインコントロール端子１ａへ与える。例え
ば、検出電圧Ｖａがアナログ電圧Ｖｂ’よりも低い場
合、電力増幅器１へのゲインコントロール端子電圧を上
げ、電力増幅器１の出力電力を大きくする。
出電圧ＶａとＤ／Ａコンバータ７からのフィルタ８を介
するアナログ電圧Ｖｂ’とを比較し、その差分を電力増
幅器１のゲインコントロール端子１ａへ与える。例え
ば、検出電圧Ｖａがアナログ電圧Ｖｂ’よりも低い場
合、電力増幅器１へのゲインコントロール端子電圧を上
げ、電力増幅器１の出力電力を大きくする。
【００２１】したがって、ＣＰＵ５がＰＬ５〜ＰＬ１８
の送信出力電力を指示した場合、その指示期間における
電力増幅器１の出力電力はメモリ６に格納されているＰ
Ｌ５〜ＰＬ１８の出力電力の設定値に応じた値となる。
ここで、ＰＬ５〜ＰＬ１８の指示期間における電力増幅
器１の出力電力の最大値がＰＬ５〜ＰＬ１８の規定の電
力レベルでない場合には、規定の電力レベルとなるよう
に、メモリ６内のＰＬ５〜ＰＬ１８の設定値を調整す
る。
の送信出力電力を指示した場合、その指示期間における
電力増幅器１の出力電力はメモリ６に格納されているＰ
Ｌ５〜ＰＬ１８の出力電力の設定値に応じた値となる。
ここで、ＰＬ５〜ＰＬ１８の指示期間における電力増幅
器１の出力電力の最大値がＰＬ５〜ＰＬ１８の規定の電
力レベルでない場合には、規定の電力レベルとなるよう
に、メモリ６内のＰＬ５〜ＰＬ１８の設定値を調整す
る。
【００２２】〔ＰＬ１９の場合〕ＣＰＵ５がＰＬ１９の
送信出力電力を指示すると、Ｄ／Ａコンバータ７はメモ
リ６からＰＬ１９用のＡＬＣ制御用データを読み込み、
Ｄ／Ａ変換し、直流電圧成分（アナログ電圧）Ｖｂを出
力する。この場合、切替スイッチ１６は、ＣＰＵ５から
の制御により第２の選択出力モードとされる。すなわ
ち、第２の入力端子１６Ｂと出力端子１６Ｃとの接続モ
ードとされる。これにより、分圧回路１５によって分圧
された分圧アナログ電圧Ｖｃが切替スイッチ１６を通過
し、フィルタ８で平滑化され、アナログ電圧Ｖｃ’とし
てオペアンプ１１の非反転入力端へ与えられる。
送信出力電力を指示すると、Ｄ／Ａコンバータ７はメモ
リ６からＰＬ１９用のＡＬＣ制御用データを読み込み、
Ｄ／Ａ変換し、直流電圧成分（アナログ電圧）Ｖｂを出
力する。この場合、切替スイッチ１６は、ＣＰＵ５から
の制御により第２の選択出力モードとされる。すなわ
ち、第２の入力端子１６Ｂと出力端子１６Ｃとの接続モ
ードとされる。これにより、分圧回路１５によって分圧
された分圧アナログ電圧Ｖｃが切替スイッチ１６を通過
し、フィルタ８で平滑化され、アナログ電圧Ｖｃ’とし
てオペアンプ１１の非反転入力端へ与えられる。
【００２３】オペアンプ１１は、電力検波部３からの検
出電圧ＶａとＤ／Ａコンバータ７からのフィルタ８を介
するアナログ電圧Ｖｃ’とを比較し、その差分を電力増
幅器１のゲインコントロール端子１ａへ与える。例え
ば、検出電圧Ｖａがアナログ電圧Ｖｃ’よりも低い場
合、電力増幅器１へのゲインコントロール端子電圧を上
げ、電力増幅器１の出力電力を大きくする。
出電圧ＶａとＤ／Ａコンバータ７からのフィルタ８を介
するアナログ電圧Ｖｃ’とを比較し、その差分を電力増
幅器１のゲインコントロール端子１ａへ与える。例え
ば、検出電圧Ｖａがアナログ電圧Ｖｃ’よりも低い場
合、電力増幅器１へのゲインコントロール端子電圧を上
げ、電力増幅器１の出力電力を大きくする。
【００２４】したがって、ＣＰＵ５がＰＬ９の送信出力
電力を指示した場合、その指示期間における電力増幅器
１の出力電力はメモリ６に格納されているＰＬ１９の出
力電力の設定値に応じた値となる。なお、この場合のＰ
Ｌ１９の出力電力の設定値は、分圧回路１５での分圧比
に応じて定める。例えば、分圧比を１：１とした場合、
従来の設定値の２倍とする。ここで、ＰＬ１９の指示期
間における電力増幅器１の出力電力の最大値がＰＬ１９
の規定の電力レベルでない場合には、規定の電力レベル
となるように、メモリ６内のＰＬ１９の設定値を調整す
る。この場合、設定値を１変化させたときの電力増幅器
１の出力電力の変化量は小さく、これにより規定の電力
レベルに容易に且つ正確に合わせ込むことが可能とな
る。
電力を指示した場合、その指示期間における電力増幅器
１の出力電力はメモリ６に格納されているＰＬ１９の出
力電力の設定値に応じた値となる。なお、この場合のＰ
Ｌ１９の出力電力の設定値は、分圧回路１５での分圧比
に応じて定める。例えば、分圧比を１：１とした場合、
従来の設定値の２倍とする。ここで、ＰＬ１９の指示期
間における電力増幅器１の出力電力の最大値がＰＬ１９
の規定の電力レベルでない場合には、規定の電力レベル
となるように、メモリ６内のＰＬ１９の設定値を調整す
る。この場合、設定値を１変化させたときの電力増幅器
１の出力電力の変化量は小さく、これにより規定の電力
レベルに容易に且つ正確に合わせ込むことが可能とな
る。
【００２５】例えば、分圧回路１５の分圧比を１：１と
すると、すなわち抵抗１７，１８の抵抗比を１：１とす
ると、切替スイッチ１６から出力されるアナログ分圧電
圧ＶｃはＤ／Ａコンバータ７からの出力電圧Ｖｂの半分
となる。具体的には、Ｄ／Ａコンバータ７のビット数を
９ビットとすると、Ｄ／Ａコンバータ７に設定可能な設
定値の段階数は２9 ＝５１２、つまり０から５１１とな
る。Ｄ／Ａコンバータ７の出力電圧範囲を０〜２Ｖとす
ると、このＤ／Ａコンバータ７の分解能は２Ｖ／５１２
＝３．９ｍＶとなり、Ｄ／Ａコンバータ７の設定値が１
変化すると、Ｄ／Ａコンバータ７の出力電圧は３．９ｍ
Ｖ変化することになる。しかし、抵抗１７，１８で分圧
されるので切替スイッチ１６から出力されるアナログ分
圧電圧Ｖｃは、Ｄ／Ａコンバータ７の設定値が１変化し
た場合でも、３．９ｍＶ／２＝１．９５ｍＶとなる。
すると、すなわち抵抗１７，１８の抵抗比を１：１とす
ると、切替スイッチ１６から出力されるアナログ分圧電
圧ＶｃはＤ／Ａコンバータ７からの出力電圧Ｖｂの半分
となる。具体的には、Ｄ／Ａコンバータ７のビット数を
９ビットとすると、Ｄ／Ａコンバータ７に設定可能な設
定値の段階数は２9 ＝５１２、つまり０から５１１とな
る。Ｄ／Ａコンバータ７の出力電圧範囲を０〜２Ｖとす
ると、このＤ／Ａコンバータ７の分解能は２Ｖ／５１２
＝３．９ｍＶとなり、Ｄ／Ａコンバータ７の設定値が１
変化すると、Ｄ／Ａコンバータ７の出力電圧は３．９ｍ
Ｖ変化することになる。しかし、抵抗１７，１８で分圧
されるので切替スイッチ１６から出力されるアナログ分
圧電圧Ｖｃは、Ｄ／Ａコンバータ７の設定値が１変化し
た場合でも、３．９ｍＶ／２＝１．９５ｍＶとなる。
【００２６】図４にて、Ａの付近がパワーレベルＰＬ１
９の出力電力とし、曲線の傾きを１ｄＢ／ｍＶとする
と、切替スイッチ１６が第１の選択出力モード（アナロ
グ電圧Ｖｂを出力）である場合、電力増幅器１の出力電
力の変化量は１＊３．９＝３．９ｄＢとなる。切替スイ
ッチ１６が第２の選択出力モードである場合（分圧アナ
ログ電圧Ｖｃを出力）、電力増幅器１の出力電力の変化
量は１＊１．９５＝１．９５ｄＢとなる。
９の出力電力とし、曲線の傾きを１ｄＢ／ｍＶとする
と、切替スイッチ１６が第１の選択出力モード（アナロ
グ電圧Ｖｂを出力）である場合、電力増幅器１の出力電
力の変化量は１＊３．９＝３．９ｄＢとなる。切替スイ
ッチ１６が第２の選択出力モードである場合（分圧アナ
ログ電圧Ｖｃを出力）、電力増幅器１の出力電力の変化
量は１＊１．９５＝１．９５ｄＢとなる。
【００２７】なお、上述においては、パワーレベルがＰ
Ｌ１９の場合にのみ切替スイッチ１６を第２の選択出力
モードに切り替えるようにしたが、どのパワーレベルで
切り替えるかは自由である。すなわち、パワーレベルが
ＰＬ１８でも微調整が必要な場合、ＰＬ１８とＰＬ１９
にて切替スイッチ１６の選択出力モードを切り替えるよ
うにしてもよい。
Ｌ１９の場合にのみ切替スイッチ１６を第２の選択出力
モードに切り替えるようにしたが、どのパワーレベルで
切り替えるかは自由である。すなわち、パワーレベルが
ＰＬ１８でも微調整が必要な場合、ＰＬ１８とＰＬ１９
にて切替スイッチ１６の選択出力モードを切り替えるよ
うにしてもよい。
【００２８】また、分圧を目的とした抵抗１７，１８の
比率を変化させれば、当然ながら電力増幅器１の変化量
をより微少にする事も可能である。抵抗１７，１８の比
率を２：１とすれば、Ｄ／Ａコンバータ７の設定値が１
変化した場合のアナログ分圧電圧Ｖｃの変化量は３．９
ｍＶ／３＝１．３ｍＶとなり、電力増幅器１の出力電力
の変化量は１＊１．３＝１．３ｄＢとなる。
比率を変化させれば、当然ながら電力増幅器１の変化量
をより微少にする事も可能である。抵抗１７，１８の比
率を２：１とすれば、Ｄ／Ａコンバータ７の設定値が１
変化した場合のアナログ分圧電圧Ｖｃの変化量は３．９
ｍＶ／３＝１．３ｍＶとなり、電力増幅器１の出力電力
の変化量は１＊１．３＝１．３ｄＢとなる。
【００２９】また、本実施の形態では、切替スイッチ１
６の後段にフィルタ８を設けたが、必ずしも設けなくて
もよい。また、本実施の形態では、メモリ６に格納させ
る設定値を時間の経過と共に段階的に上昇し、所定値に
なった後、段階的に下降するパターンとしたが、必ずし
もこのようなパターンとしなくてもよい。
６の後段にフィルタ８を設けたが、必ずしも設けなくて
もよい。また、本実施の形態では、メモリ６に格納させ
る設定値を時間の経過と共に段階的に上昇し、所定値に
なった後、段階的に下降するパターンとしたが、必ずし
もこのようなパターンとしなくてもよい。
【００３０】
【発明の効果】以上説明したことから明らかなように本
発明によれば、Ｄ／Ａ変換部からのアナログ電圧を分圧
し分圧アナログ電圧とする分圧部と、分圧アナログ電圧
およびＤ／Ａ変換部からのアナログ電圧を入力としその
何れか一方を選択出力する切替スイッチ部とを設け、Ｄ
／Ａ変換部への設定値のパワーレベルを指定する際、そ
の指定パワーレベルに応じて切替スイッチ部の選択出力
モードを切り替えるようにしたので、低パワーレベル指
定時に切替スイッチ部の選択出力モードを分圧アナログ
電圧を出力するモードに切り替えることにより、電力増
幅部の変化量を自在にすることが可能となり、その変化
量を微少にすることにより、分解能の高いＤ／Ａコンバ
ータを使用することなく、低送信出力時でも出力電力の
規定のレベルへの調整を容易に且つ正確に行えることが
できるようになる。
発明によれば、Ｄ／Ａ変換部からのアナログ電圧を分圧
し分圧アナログ電圧とする分圧部と、分圧アナログ電圧
およびＤ／Ａ変換部からのアナログ電圧を入力としその
何れか一方を選択出力する切替スイッチ部とを設け、Ｄ
／Ａ変換部への設定値のパワーレベルを指定する際、そ
の指定パワーレベルに応じて切替スイッチ部の選択出力
モードを切り替えるようにしたので、低パワーレベル指
定時に切替スイッチ部の選択出力モードを分圧アナログ
電圧を出力するモードに切り替えることにより、電力増
幅部の変化量を自在にすることが可能となり、その変化
量を微少にすることにより、分解能の高いＤ／Ａコンバ
ータを使用することなく、低送信出力時でも出力電力の
規定のレベルへの調整を容易に且つ正確に行えることが
できるようになる。
【図１】 本発明に係るＡＬＣ回路の一実施の形態を示
す回路図である。
す回路図である。
【図２】 従来のＡＬＣ回路を示す回路図である。
【図３】 このＡＬＣ回路におけるＤ／Ａコンバータの
出力電圧例を示す図である。
出力電圧例を示す図である。
【図４】 このＡＬＣ回路における電力増幅器のゲイン
コントロール端子電圧と出力電力の特性を示す図であ
る。
コントロール端子電圧と出力電力の特性を示す図であ
る。
１…電力増幅器、１ａ…ゲインコントロール端子、２…
カプラ、３…電力検波部、４…ゲインコントロール部、
５…ＣＰＵ、６…メモリ、７…Ｄ／Ａコンバータ、８…
フィルタ（ローパスフィルタ）、９…ダイオード、１
０，１２，１３，１７，１８…抵抗、１１…オペアン
プ、１４…コンデンサ、１５…分圧回路、１６…切替ス
イッチ。
カプラ、３…電力検波部、４…ゲインコントロール部、
５…ＣＰＵ、６…メモリ、７…Ｄ／Ａコンバータ、８…
フィルタ（ローパスフィルタ）、９…ダイオード、１
０，１２，１３，１７，１８…抵抗、１１…オペアン
プ、１４…コンデンサ、１５…分圧回路、１６…切替ス
イッチ。
Claims (4)
- 【請求項１】 送信電力を増幅する電力増幅部と、 この電力増幅部からの増幅された送信電力を検出しその
電力値に応じた検出電圧を出力する電力検出部と、 複数種類のパワーレベルに応じた設定値が格納されたメ
モリ部と、 このメモリ部から取り出される設定値をアナログ電圧に
変換するＤ／Ａ変換部と、 このＤ／Ａ変換部からのアナログ電圧を分圧し分圧アナ
ログ電圧とする分圧部と、 この分圧部からの分圧アナログ電圧および前記Ｄ／Ａ変
換部からのアナログ電圧を入力としその何れか一方を選
択出力する切替スイッチ部と、 この切替スイッチ部からのアナログ電圧と前記電力検出
部からの検出電圧とを比較し、その比較結果に基づいて
前記電力増幅部における送信電力に対するゲインをコン
トロールするゲインコントロール部と、 前記Ｄ／Ａ変換部への設定値のパワーレベルを指定する
とともにその指定パワーレベルに応じて前記切替スイッ
チ部の選択出力モードを切り替える制御部とを備えたこ
とを特徴とする自動レベル制御回路。 - 【請求項２】 請求項１において、前記ゲインコントロ
ール部において比較される切替スイッチ部からのアナロ
グ電圧はローパスフィルタを通して与えられることを特
徴とする自動レベル制御回路。 - 【請求項３】 請求項１又は２において、前記制御部
は、高パワーレベルの指定時には前記切替スイッチ部の
選択出力モードを前記Ｄ／Ａ変換部からのアナログ電圧
を出力するモードに切り替え、低パワーレベルの指定時
には前記切替スイッチ部の選択出力モードを前記分圧部
からの分圧アナログ電圧を出力するモードに切り替える
ことを特徴とする自動レベル制御回路。 - 【請求項４】 請求項１〜３の何れか１項において、前
記メモリ部に格納された設定値が時間の経過と共に段階
的に上昇し、所定値になった後、段階的に下降するパタ
ーンとされていることを特徴とする自動レベル制御回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001038177A JP4103335B2 (ja) | 2001-02-15 | 2001-02-15 | 自動レベル制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001038177A JP4103335B2 (ja) | 2001-02-15 | 2001-02-15 | 自動レベル制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2002246919A true JP2002246919A (ja) | 2002-08-30 |
| JP4103335B2 JP4103335B2 (ja) | 2008-06-18 |
Family
ID=18901203
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001038177A Expired - Fee Related JP4103335B2 (ja) | 2001-02-15 | 2001-02-15 | 自動レベル制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP4103335B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8295796B2 (en) | 2010-06-30 | 2012-10-23 | Icom Incorporated | High frequency circuit |
-
2001
- 2001-02-15 JP JP2001038177A patent/JP4103335B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8295796B2 (en) | 2010-06-30 | 2012-10-23 | Icom Incorporated | High frequency circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JP4103335B2 (ja) | 2008-06-18 |
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