JP2001518731A - 信号を増幅する装置および方法 - Google Patents
信号を増幅する装置および方法Info
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Abstract
Description
よび方法に関する。
者には周知である。しかし、ドハティ増幅器は、通常、線形性が比較的悪いこと
も知られる。また、その線形性は効率性に反比例するのが普通である。その結果
、ドハティ増幅器はピーク対平均値の比が高い線形増幅器の性能を改善すること
ができたとしても、狭いダイナミック・レンジにおいてしかできない。
ンジにおいて効率良く動作することのできるドハティ増幅器を設計するための少
なくとも1つの試みがなされた。これは、「Efficiency of Doherty radio freq
uency (RF)-power amplifier systems」(F.Raab著 Green Mountain Radio Re
serach Company, RN84-23;1984年8月発行;)に説明される。Rabbの実行 例において説明されるようにドハティ増幅器をネスティングするには、平行する
追加の増幅器段と関連する駆動制御回路構成とが必要である。
ればさらに魅力的になる。特に、多重搬送波電力増幅器に印加されるRF入力信号
が30dBも可変するセルラ基地局装置のための多重搬送波電力増幅器の用途にお
いて魅力的である。
れる信号の増幅システムおよび方法が必要である。
結合される入力,出力および制御入力を有する第1ドハティ増幅器とを備える増
幅器回路により上記の必要性が満足される。増幅器回路は、第1ドハティ増幅器
の出力から第1ドハティ出力信号を検出するために結合される検出器入力と出力
とを有する検出器も備える。この出力はコントローラの入力に結合され、コント
ローラは第1および第2コントローラ出力を有する。増幅器回路は、第1コント
ローラ出力に結合される入力と、第1ドハティ増幅器の制御入力に結合される出
力とを有する切替調整器をさらに備える。対応して、増幅器回路は、信号入力と
、増幅器の入力に結合される出力と、第2コントローラ出力に結合される制御入
力とを有する可変減衰器を備える。
。本方法は、可変減衰器の入力において入力信号を受信する段階,入力信号を減
衰して被減衰信号を形成する段階および被減衰信号を増幅して被増幅信号を形成
する段階を備える。本方法は、ドハティ増幅器内で被増幅信号を増幅する段階お
よび切替調整器により制御入力においてドハティ増幅器に対し提供される電源電
圧を受信することに応答してドハティ出力信号を生成する段階も備える。さらに
本方法は、検出器内の全信号を検出して被検出出力信号を形成する段階であって
、全信号が少なくとも第1ドハティ出力信号を含む段階,被検出出力信号をコン
トローラ内の所定のコントローラ閾値と比較する段階および被検出出力信号が所
定の閾値より低い場合にコントローラ内に第1および第2制御信号を生成する段
階を備える。第1制御信号に応答して、切替調整器内に切替調整器出力電圧を生
成し、その後で切替調整器出力電圧に基づき第1ドハティ増幅器の電圧を修正す
る。第2制御信号に応答して、可変減衰器の電圧を修正する。
する第1ドハティ増幅器を備える増幅器回路により上記の必要性は満足される。
このとき、出力は第2ドハティ制御入力および出力を有する第2ドハティ増幅器
の入力に結合される。増幅器回路は、第2ドハティ増幅器の出力から第2ドハテ
ィ出力信号を検出するために結合される検出器入力と出力とを有する検出器も備
える。出力は、コントローラ出力を有するコントローラの入力に結合される。増
幅器回路は、コントローラ出力に結合される入力と、第1および第2切替調整器
出力とを有する切替調整器をさらに備え、第1切替調整器出力は第1ドハティ制
御入力に結合され、第2切替調整器出力は第2ドハティ制御入力に結合される。
足される。本方法は、第1ドハティ増幅器の入力において入力信号を受信する段
階,第1ドハティ増幅器の第1ドハティ制御入力において第1電源電圧を受信す
る段階,第1ドハティ増幅器において入力信号を増幅して第1ドハティ出力信号
を形成する段階,第2ドハティ増幅器の入力において第1ドハティ出力信号を受
信する段階,第2ドハティ増幅器の第2ドハティ制御入力において第2電源電圧
を受信する段階および第2ドハティ増幅器内で第1ドハティ出力信号を増幅して
第2ドハティ出力信号を形成する段階を備える。本方法は、全信号を検出して被
検出出力信号を形成する段階であって、全信号が少なくとも第2ドハティ出力信
号を含む段階と、コントローラ内で被検出出力信号を所定のコントローラ閾値と
比較する段階とをさらに備える。また、本方法は、前記の被検出出力信号が所定
のコントローラ閾値より低い場合にコントローラ内で制御信号を生成する段階と
、制御信号に基づいて切替調整器内で第1電源電圧を生成する段階と、その後で
第1電源電圧に基づき第1ドハティ増幅器の電圧を修正する段階とを備える。平
行して、制御信号に基づき切替調整器内で第2電源電圧を生成し、その後で前記
第2電源電圧に基づき第2ドハティ増幅器の電圧を修正する。
以下の説明から当業者には容易に理解頂けよう。言うまでもなく、本発明は他の
異なる実施例も可能であり、その詳細は種々の観点から変更することができる。
従って、図面および解説は説明のためのものであり、制限を加えるためのもので
はないと見なされる。
ティ増幅器を示す。ドハティ増幅器208は、入力信号206を受信し、制御入
力234の受信に応答してドハティ出力信号220を生成する。制御入力は一般
に、通常ドレイン電圧と呼ばれる電圧を表し、VDdと記される。
増幅器は、一定のドレイン電圧で動作するのが普通である。ドハティ出力信号2
20が飽和電力にある場合は、ドハティ増幅器208は最大ドレイン効率におい
て動作する。言い換えると、ドハティ増幅器208は、ドハティ出力信号220
の電圧がドレイン電圧VDdに等しいときに最大効率で動作する。飽和は図2に示 されるように9dBのバックオフにおいて起こる。RF電力出力のDC入力電力に対す
る比として定義されるドハティ効率は、飽和から6dBにおいて遷移電圧に到達す
るまでは、飽和からのバックオフが増すと少しずつ下がる。飽和から6dBのバッ
クオフにおいて、再び最大ドハティ効率に達する。遷移電圧のもとでは、ドハテ
ィ効率は、飽和からのバックオフが増大するにつれて急速に下がる。当技術では
周知の如く、ドハティ出力信号220の電力が下がるにつれて、ドハティ増幅器
208の効率は出力信号電圧振幅に比例して下がる。従って、ドハティ出力信号
220が低い場合、ドハティ効率は低くなる。逆にドハティ出力信号220が高
い場合、ドハティ効率は高くなる。たとえば、20ワットのドハティ出力信号電
力は、20ボルトの一定ドレイン電圧に関して約40%の効率であり、60ワッ
トのドハティ出力信号電力は20ボルトの一定ドレイン電圧に関して約57%の
効率である。
とえば、飽和から6dBのバックオフにおいて、900Mhzの用例では、ドハティ 効率は20ボルトの一定ドレイン電圧に関して約46%であり、30ボルトの一
定ドレイン電圧に関して約40%に下がる。
つの実際的な問題がある。1つの問題は、歪みとも呼ばれる、ドハティ出力信号
220の相互変調の増大である。この歪みは、ドハティ出力信号220の電力を
低い値たとえば飽和より9ないし10dB低く抑えることにより軽減することがで
きる。もう1つの問題は、ドハティ増幅器208の電力利得の低下である。ドハ
ティ増幅器208の電力利得の低下は、可変減衰器をドライバ増幅器により与え
られる固定利得と共に加えることにより対処することができる。可変減衰器およ
び固定利得ドライバ増幅器は、ドハティ増幅器208の両端で利得損失を相殺す
るよう構築される。
より広いダイナミック・レンジにおいてドハティ効率を改善することが可能にな
る。ドハティ増幅器208を飽和付近に維持するためには、制御入力234に現
れる電源電圧をドハティ出力信号220の電圧に比例して調整する。本発明の好
適な実施例においては、制御入力234に現れる可調整電源電圧が上記の一定電
源(またはドレイン)電圧VDdに置き換わる。
器効率を増大する増幅器回路200のブロック図である。増幅器回路200は、
入力201および出力240を有して構築される。増幅器回路200は、可変減
衰器202,増幅器204,第1ドハティ増幅器208,検出器224,コント
ローラ228および切替調整器232を備える。入力信号250(たとえば複数
のRFトランシーバにより生成される多重搬送波900メガヘルツ(Mhz)のRF信 号)が入力201において受信される。
器202により生成される被減衰信号を受信する入力を有し、入力信号206を
第1ドハティ増幅器208に提供する。第1ドハティ増幅器208は、入力信号
206を受信し、制御入力234における切替調整器232により提供される電
源電圧の受信に応答して、第1ドハティ出力信号220を生成する。好適な実施
例においては、検出器224好ましくはダイオード検出器が、方向性カプラ(図
示せず)を介して第1ドハティ増幅器208の出力に結合される。検出器224
は、第1ドハティ出力信号をサンプリングおよび整流して、被検出出力信号22
6をコントローラ228に提供する。被検出出力信号228は、検出器入力22
2において検出される信号に比例する直流(DC)電圧である。
、コントローラ228は第1および第2制御信号を生成する。これに応じて、コ
ントローラ228は、被検出出力信号226を切替調整器232への入力に適し
た第1制御信号230に変換する。この変換は、切替調整器232が第1ドハテ
ィ増幅器208への制御入力234として提供される電源電圧を、被検出出力信
号の減少に応じて低下させるように行われる。その結果、第1ドハティ増幅器2
08の両端の電圧利得(第1利得)が下がる。
の入力に適した第2制御入力231に変換する。この変換は、可変減衰器が入力
信号250の減衰を削減して、結果として第1ドハティ増幅器208の入力に現
れる信号を大きくするよう行われる。その結果、可変減衰器202およびドライ
バ増幅器204の和の両端の電圧利得(第2利得)が上がる。
る可変減衰器202およびドライバ増幅器204の和の両端の電圧の増大と結合
して、より広いダイナミック・レンジにおいてドハティ増幅器208をその飽和
点付近に維持する。それに対応して、第1および第2利得の和は、増幅器回路2
00の両端で実質的に一定になる。
入手可能なMRF 183シリーズ増幅器などの金属酸化物半導体電界効果トランジス タ(MOSFET:metal oxide semiconductor field effect transistor)である。 可変減衰器202は、好ましくはM/A-COM社製のAT-108電圧可変吸収減衰器であ る。検出器224はこれもM/A-COM社製のMA4E932Aゼロ・バイアス検出器ダイオ ードとすることができる。切替調整器232は、AT&TバージョンのFE150R DC-DC
電力モジュールと同様の任意の数の種類の切替調整器とすることができる。コン
トローラ228は、ソフトウェアまたはハードウェア方法のいずれでも構築する
ことができる。たとえば、コントローラ228をハード・コード化されたルック
アップ・テーブルとして実現しても、あるいはレベル・シフティングおよびスケ
ーリング演算増幅器を備えるアナログ回路として実現してもよい。
0をドハティ増幅器208と並列に加えて、図示されるように第2ドハティ増幅
器310がドハティ増幅器208の入力に結合される入力と、ドハティ増幅器2
08の出力に結合される出力とを有するようにする。第2ドハティ増幅器310
は、切替調整器232の出力に結合される制御入力も有する。第1ドハティ出力
信号220に第2ドハティ増幅器310が出力する第2ドハティ出力信号320
を加算する効果により、全信号322が生成される。追加のドハティ増幅器は、
所望の全信号322の大きさによっては並列に加えてもよい。
ブロック62で始まり、ここで増幅器回路200が入力201において入力信号
250を受信する。次にブロック64において、入力信号250が可変減衰器2
02により減衰され、被減衰信号を形成する。ブロック66において、被減衰信
号がドライバ増幅器204により増幅され、第1ドハティ増幅器208に入力信
号206を提供する。次にブロック68において、第1ドハティ増幅器208が
、制御入力234における電源電圧の受信に応答して、第1ドハティ出力信号2
20を生成する。
り検出され、検出器224は被検出器出力信号226を生成する。被検出力信号
226はブロック72において、コントローラ228により閾値電圧と比較され
る。被検出出力信号226の電圧が閾値電圧より低い場合は、ブロック74にお
いてコントローラ228が第1制御信号230および第2制御信号231を生成
する。被検出出力信号226の電圧が閾値電圧よりも高い場合は、コントローラ
228は第1および第2制御信号を生成しない。ブロック78において、第1制
御信号230を受信すると、切替調整器232は出力を生成し、これが第1ドハ
ティ増幅器208の制御入力234において電源電圧として現れる。この電源電
圧は、第1制御信号230に比例する。電源電圧に応答して、第1ドハティ出力
信号220がブロック80において修正される。平行して、第2制御信号231
を受信すると、可変減衰器202がブロック82において入力信号250を減衰
する。これに応答して、ブロック84において、可変減衰器202と増幅器20
4の和の両端の電圧が修正される。
置き換えることによって、さらに増幅器回路を強化することができる。増幅器回
路500は、入力403および出力240を有して構築される。増幅器回路は、
可変減衰器202,第1ドハティ増幅器404,第2ドハティ増幅器408,検
出器224,コントローラ228および切替調整器232を備える。入力信号2
50(たとえば複数のRFトランシーバにより生成される多重搬送波900メガヘ
ルツ(Mhz)RF信号)が入力403において受信される。
て入力信号250を受信し、第1ドハティ制御入力233に提供される切替調整
器232からの第1電源電圧に基づいて、第1ドハティ出力信号406を生成す
る。第2ドハティ増幅器408は第1ドハティ出力信号406を受信し、第2ド
ハティ制御入力234において受信される切替調整器232からの第2電源電圧
に基づいて第2ドハティ出力信号220を生成する。
性カプラ(図示せず)を介して第2ドハティ増幅器408の出力に結合される。
検出器224は、第2ドハティ出力信号220をサンプリングおよび整流して、
被検出出力信号226をコントローラ228に提供する。被検出出力信号226
は、検出器入力222において検出される信号に比例する直流(DC)電圧である
。
、コントローラ228は制御信号を生成しない。被検出出力信号226が閾値電
圧よりも低いと、コントローラ228は被検出出力信号226を切替調整器23
2への入力に適した第2制御入力230に変換する。この変換は、切替調整器2
32が第2ドハティ制御入力234において提供される電源電圧を下げるように
行われる。その結果、第2ドハティ増幅器408の電圧利得が、被検出出力信号
226の低下に応答して下がる。
る電源電圧を上げる。その結果、 被検出出力信号226の低下に応答して第1 ドハティ増幅器404の電圧利得が上がる。第1ドハティ増幅器404の両端の
電圧利得の増大は第2ドハティ増幅器408の両端の電圧損失と結合して、結果
的には、増幅器回路500の両端の電圧は実質的に一定になり、それによって第
2ドハティ増幅器408の動作はその飽和点付近に維持される。
ハティ増幅器408と並列に加えられて、図示されるように第3ドハティ増幅器
510が第2ドハティ増幅器408の入力に結合される入力と、第2ドハティ増
幅器408の出力に結合される出力とを有するようにする。第3ドハティ増幅器
510は、第1ドハティ出力信号406を受信し、第3ドハティ制御入力234
において受信される切替調整器232からの第2電源電圧に基づいて、第3ドハ
ティ出力信号520を生成する。第2ドハティ出力信号220と第3ドハティ出
力信号520とを加算する効果により、全信号322が生成される。追加のドハ
ティ増幅器は、所望の全信号322の大きさによっては並列に加えてもよい。
ブロック87で始まり、ここで増幅器回路500が入力403において入力信号
250を受信する。次にブロック88において、第1ドハティ増幅器404が第
1ドハティ制御入力233の受信に応答して第1ドハティ出力信号406を生成
する。第1ドハティ制御入力233は、切替調整器232からの電源電圧を表す
。次にブロック89において、第2ドハティ増幅器408が第1ドハティ出力信
号406および第2ドハティ制御入力234の受信に応答して、第2ドハティ出
力信号220を生成する。
出され、検出器224は被検出器出力信号226を生成する。被検出力信号22
6はブロック91において、コントローラ228により閾値電圧と比較される。
被検出出力信号226の電圧が閾値電圧より低い場合は、ブロック92において
コントローラ228が制御信号230を生成する。被検出出力信号226の電圧
が閾値電圧よりも高い場合は、コントローラ228は制御信号230を生成しな
い。ブロック93において、制御信号230を受信すると、切替調整器232は
出力を生成し、これが第1ドハティ制御入力233において第1電源電圧として
現れる。第1ドハティ制御入力233の受信に応答して、第1ドハティ出力信号
406がブロック94で修正される。平行して、ブロック95において、制御信
号230を受信すると、切替調整器232は出力を生成し、これが第2ドハティ
制御入力234において第2電源電圧として現れる。これに応答して、第2ドハ
ティ出力信号420がブロック96において修正される。この後は、第1および
第2ドハティ出力信号に対する修正により、増幅器回路500の利得は、ドハテ
ィ出力信号に対する歪みを最小限に抑えながら実質的に一定のレベルに維持され
る。また、ドハティ増幅器の動作は最大効率付近で行われる。
求項またはその等価物の精神および範囲から逸脱せずに考案できることは明白で
ある。故に、本発明の範囲は添付の請求項およびその等価物によってのみ決定さ
れるものとする。
ィ増幅器の効率性をグラフに示す。
とによる信号増幅回路のブロック図である。
とによる信号増幅回路のブロック図である。
Claims (23)
- 【請求項1】 入力および出力を有する増幅器; 前記増幅器の前記出力に結合される入力と、出力と、制御入力(234)とを
有する第1ドハティ増幅器; 前記第1ドハティ増幅器の前記出力の第1ドハティ出力信号を検出するために
結合される検出器入力と、出力とを有する検出器; 前記検出器の前記出力に結合される入力と、第1出力と、第2出力とを有する
コントローラ; 前記コントローラの前記第1出力に結合される入力と、前記第1ドハティ増幅
器の前記制御入力に結合される出力とを有する切替調整器;および 信号入力と、前記増幅器の前記入力に結合される出力と、前記コントローラの
前記第2出力に結合される制御入力とを有する可変減衰器; によって構成されることを特徴とする増幅器回路。 - 【請求項2】 前記増幅器回路の第1利得が前記第1ドハティ増幅器の両端
の電圧によって構成されることを特徴とする請求項1記載の増幅器回路。 - 【請求項3】 前記増幅器回路の第2利得が前記可変減衰器と前記増幅器の
和の両端の電圧によって構成されることを特徴とする請求項1記載の増幅器回路
。 - 【請求項4】 前記第1利得および前記第2利得の和が実質的に一定である
ことを特徴とする請求項2および3記載の増幅器回路。 - 【請求項5】 前記第1ドハティ増幅器の前記入力に結合される入力と、前
記第1ドハティ増幅器の前記出力に結合される出力と、前記切替調整器の前記出
力に結合される制御入力とを有する第2ドハティ増幅器によってさらに構成され
ることを特徴とする請求項1記載の増幅器回路。 - 【請求項6】 前記増幅器群が無線周波数トランジスタ半導体装置によって
構成されることを特徴とする請求項1記載の増幅器回路。 - 【請求項7】 入力信号を増幅する方法であって: 前記入力信号を可変減衰器の信号入力において受信する段階; 前記入力信号を減衰して被減衰信号を形成する段階; 前記被減衰信号を増幅して被増幅信号を形成する段階; 第1ドハティ増幅器において前記被増幅信号を増幅して第1ドハティ出力信号
を形成する段階; 検出器において全信号を検出して被検出出力信号を形成する段階であって、前
記全信号が少なくとも前記第1ドハティ出力信号によって構成される段階; 前記被検出出力信号をコントローラ内で所定のコントローラ閾値と比較する段
階; 被検出出力信号が前記所定のコントローラ閾値より低い場合に、前記コントロ
ーラにおいて第1制御信号および第2制御信号を生成する段階; 前記第1制御信号に基づき、切替調整器において切替調整器出力電圧を生成す
る段階; 前記切替調整器出力電圧に基づき、前記第1ドハティ増幅器の電圧を修正する
段階;および 前記第2制御信号に基づき、前記可変減衰器の電圧を修正する段階; によって構成されることを特徴とする方法。 - 【請求項8】 前記増幅器回路の第1利得が前記第1ドハティ増幅器の両端
の前記電圧修正によって構成されることを特徴とする請求項7記載の方法。 - 【請求項9】 前記増幅器回路の第2利得が前記可変減衰器と前記増幅器の
前記電圧修正の和によって構成されることを特徴とする請求項7記載の方法。 - 【請求項10】 前記第1利得および前記第2利得の和が実質的に一定であ
ることを特徴とする請求項8および9記載の方法。(*1) - 【請求項11】 前記被増幅信号を第2ドハティ増幅器内で増幅して第2ド
ハティ出力信号を形成する段階;および 前記第1および第2ドハティ出力信号を合成して前記全信号を形成する段階; によってさらに構成されることを特徴とする請求項7記載の方法。 - 【請求項12】 入力と第1ドハティ制御入力と出力とを有する第1ドハテ
ィ増幅器; 前記第1ドハティ増幅器の前記出力に結合される入力と、出力と、第2ドハテ
ィ制御入力とを有する第2ドハティ増幅器; 前記第2ドハティ増幅器の前記出力の第2ドハティ出力信号を検出するために
結合される検出器入力と、出力とを有する検出器; 前記検出器の前記出力に結合される入力と、出力とを有するコントローラ;お
よび 前記コントローラの前記出力に結合される入力と、第1および第2切替調整器
出力とを有する切替調整器であって、前記第1切替調整器出力が前記第1ドハテ
ィ制御入力に結合され、前記第2切替調整器出力が前記第2ドハティ制御入力に
結合される切替調整器; によって構成されることを特徴とする増幅器回路。 - 【請求項13】 前記増幅器回路の第1利得が前記第2ドハティ増幅器の両
端の電圧によって構成されることを特徴とする請求項12記載の増幅器回路。 - 【請求項14】 前記増幅器回路の第2利得が前記第1ドハティ増幅器の両
端の電圧によって構成されることを特徴とする請求項12記載の増幅器回路。 - 【請求項15】 前記第1利得および前記第2利得の和が実質的に一定であ
ることを特徴とする請求項13および14記載の増幅器回路。 - 【請求項16】 前記第2ドハティ増幅器の前記入力に結合される入力と、
前記第2ドハティ増幅器の前記出力に結合される出力と、前記第2切替調整器出
力に結合される制御入力とを有する第3ドハティ増幅器によってさらに構成され
ることを特徴とする請求項12記載の増幅器回路。 - 【請求項17】 前記ドハティ増幅器が無線周波数トランジスタ半導体装置
によって構成されることを特徴とする請求項12記載の増幅器回路。 - 【請求項18】 入力信号を増幅する方法であって: 前記入力信号を第1ドハティ増幅器の入力において受信する段階; 前記第1ドハティ増幅器の第1ドハティ制御入力において第1電源電圧を受信
する段階; 前記第1ドハティ増幅器において前記入力信号(250)を増幅して第1ドハ
ティ出力信号を形成する段階; 前記第1ドハティ出力信号を第2ドハティ増幅器の入力において受信する段階
; 前記第2ドハティ増幅器の第2ドハティ制御入力において第2電源電圧を受信
する段階; 前記第2ドハティ増幅器において前記第1ドハティ出力信号を増幅して第2ド
ハティ出力信号を形成する段階; 全信号を検出して被検出出力信号を形成する段階であって、前記全信号が少な
くとも前記第2ドハティ出力信号によって構成される段階; 前記被検出出力信号をコントローラ内で所定のコントローラ閾値と比較する段
階; 前記被検出出力信号が前記所定のコントローラ閾値より低い場合に、前記コン
トローラにおいて制御信号を生成する段階; 前記制御信号に基づき、切替調整器において第1電源電圧を生成する段階; 前記第1電源電圧に基づき、前記第1ドハティ増幅器の電圧を修正する段階; 前記制御信号に基づき、前記切替調整器において第2電源電圧を生成する段階
;および 前記第2電源電圧に基づき、前記第2ドハティ増幅器の電圧を修正する段階; によって構成されることを特徴とする方法。 - 【請求項19】 前記増幅器回路の第1利得が前記第2ドハティ増幅器の前
記電圧修正によって構成されることを特徴とする請求項18記載の方法。 - 【請求項20】 前記増幅器回路の第2利得が前記第1ドハティ増幅器の前
記電圧修正によって構成されることを特徴とする請求項18記載の方法。 - 【請求項21】 前記第1利得および前記第2利得の和が実質的に一定であ
ることを特徴とする請求項19および20記載の方法。(*2) - 【請求項22】 前記第1ドハティ出力信号を第3ドハティ増幅器内で増幅
して第3ドハティ出力信号を形成する段階;および 前記第2ドハティ出力信号および第3ドハティ出力信号を合成して前記全信号
を形成する段階; によってさらに構成されることを特徴とする請求項9記載の方法。 - 【請求項23】 前記所定のコントローラ閾値が、測定される入力信号電力
に基づいて選択されることを特徴とする請求項18記載の方法。
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