JP2001028761A - Ｐａｌ方式ビデオ信号生成装置 - Google Patents
Ｐａｌ方式ビデオ信号生成装置Info
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Abstract
(57)【要約】 （修正有）
【課題】主要回路をＮＴＳＣ方式と共用することが可能
なＯＳＤ制御のビデオ信号生成装置、デジタル処理のＰ
ＡＬ方式ビデオ信号生成装置。 【解決手段】ＰＡＬ方式の副搬送波ｆscに対してｆsc×
４ｎの周波数（ｎは１以上整数）のクロック発生回路
と、１水平走査ラインにおけるＮＴＳＣ方式の副搬送波
の４ｎ倍周波数でのクロックカウント数が設定可能でか
つそれ以上のＰＡＬ方式における１水平走査ラインにお
けるクロック発生回路のクロックをカウントする水平カ
ウンタ回路と、ＮＴＳＣ方式の１画面の水平走査ライン
数のカウント値が設定可能でかつそれ以上のＰＡＬ方式
における１画面の水平走査ライン数のカウント値が設定
されて水平タイミング信号を設定された数カウントして
垂直タイミング信号を発生する垂直カウンタ回路とを有
し、水平カウンタ回路に設定されたカウント数が各水平
走査ラインで副搬送波の位相がすべて揃う。
なＯＳＤ制御のビデオ信号生成装置、デジタル処理のＰ
ＡＬ方式ビデオ信号生成装置。 【解決手段】ＰＡＬ方式の副搬送波ｆscに対してｆsc×
４ｎの周波数（ｎは１以上整数）のクロック発生回路
と、１水平走査ラインにおけるＮＴＳＣ方式の副搬送波
の４ｎ倍周波数でのクロックカウント数が設定可能でか
つそれ以上のＰＡＬ方式における１水平走査ラインにお
けるクロック発生回路のクロックをカウントする水平カ
ウンタ回路と、ＮＴＳＣ方式の１画面の水平走査ライン
数のカウント値が設定可能でかつそれ以上のＰＡＬ方式
における１画面の水平走査ライン数のカウント値が設定
されて水平タイミング信号を設定された数カウントして
垂直タイミング信号を発生する垂直カウンタ回路とを有
し、水平カウンタ回路に設定されたカウント数が各水平
走査ラインで副搬送波の位相がすべて揃う。
Description
【０００１】
【発明の属する技術分野】この発明は、ＰＡＬ方式ビデ
オ信号生成装置に関し、詳しくは、水平、垂直のタイミ
ング発生回路をはじめとして主要回路をＮＴＳＣ方式と
共用することが可能なＯＳＤ（オンスクリーンディスプ
レイ）制御のビデオ信号生成装置、デジタルカメラやＴ
Ｖゲーム等に適するデジタル処理の簡易型のＰＡＬ方式
ビデオ信号生成装置回路に関する。
オ信号生成装置に関し、詳しくは、水平、垂直のタイミ
ング発生回路をはじめとして主要回路をＮＴＳＣ方式と
共用することが可能なＯＳＤ（オンスクリーンディスプ
レイ）制御のビデオ信号生成装置、デジタルカメラやＴ
Ｖゲーム等に適するデジタル処理の簡易型のＰＡＬ方式
ビデオ信号生成装置回路に関する。
【０００２】
【従来の技術】ＰＡＬ方式にあっては、水平同期信号周
波数ｆHと副搬送波周波数ｆscとは、ｆH＝（ｆsc−２
５）／１１３５／４＝１５，６２５Ｈｚ，１Ｈ＝６４μ
secの関係にあって、垂直同期信号周波数ｆvと水平同期
信号周波数ｆHとは、ｆH＝５０×６２５／２Ｈｚ、ｆv
＝２ｆH／６２５の関係にある。しかし、この関係のビ
デオ信号を生成するには回路が複雑になるために、ゲー
ム機などでは、簡易的にノンインターレース画面表示と
してｆH＝ｆsc／（１１３４／４）＝１５，６３９Ｈ
ｚ，１Ｈ＝６３．９４３μsec、ｆv＝ｆH／３１３など
によりＰＡＬ方式のビデオ信号を生成している。このよ
うにｆH，ｆvの周波数が多少ずれていても、受像機側で
は、水平同期系、垂直同期系にそれぞれ同期引き込み範
囲があるので問題なく表示することが可能である。
波数ｆHと副搬送波周波数ｆscとは、ｆH＝（ｆsc−２
５）／１１３５／４＝１５，６２５Ｈｚ，１Ｈ＝６４μ
secの関係にあって、垂直同期信号周波数ｆvと水平同期
信号周波数ｆHとは、ｆH＝５０×６２５／２Ｈｚ、ｆv
＝２ｆH／６２５の関係にある。しかし、この関係のビ
デオ信号を生成するには回路が複雑になるために、ゲー
ム機などでは、簡易的にノンインターレース画面表示と
してｆH＝ｆsc／（１１３４／４）＝１５，６３９Ｈ
ｚ，１Ｈ＝６３．９４３μsec、ｆv＝ｆH／３１３など
によりＰＡＬ方式のビデオ信号を生成している。このよ
うにｆH，ｆvの周波数が多少ずれていても、受像機側で
は、水平同期系、垂直同期系にそれぞれ同期引き込み範
囲があるので問題なく表示することが可能である。
【０００３】通常は、ＰＡＬ方式ではｆsc ４．４３Ｍ
Ｈｚであり、ＮＴＳＣ方式では、ｆsc ３．５７ＭＨｚ
である。いずれの方式であってもほぼ同様に、輝度信号
（Ｙ）と色差信号（Ｂ−Ｙ，Ｒ−Ｙ）とを伝送し、復調
する方式であり、ＰＡＬ方式では１ライン遅延線を用い
て強制的に位相を反転して１ライン分の加算、減算をし
て復調している。また、いずれの方式にあっても画面上
の色の表示については前後の水平走査線の垂直方向での
積分効果を利用して色副搬送波の漏れや色ずれを防止し
ている。特にＰＡＬ方式では走査ラインごとにほぼ強制
的に位相反転することで色差信号の相互干渉を防止し、
画面上での副搬送波の位相と水平走査ラインとの関係を
各ラインごとに９０゜−αの位相差に設定することで各
水平走査ラインの色表示箇所が静止することなく、その
積分効果により色ずれを防止している。
Ｈｚであり、ＮＴＳＣ方式では、ｆsc ３．５７ＭＨｚ
である。いずれの方式であってもほぼ同様に、輝度信号
（Ｙ）と色差信号（Ｂ−Ｙ，Ｒ−Ｙ）とを伝送し、復調
する方式であり、ＰＡＬ方式では１ライン遅延線を用い
て強制的に位相を反転して１ライン分の加算、減算をし
て復調している。また、いずれの方式にあっても画面上
の色の表示については前後の水平走査線の垂直方向での
積分効果を利用して色副搬送波の漏れや色ずれを防止し
ている。特にＰＡＬ方式では走査ラインごとにほぼ強制
的に位相反転することで色差信号の相互干渉を防止し、
画面上での副搬送波の位相と水平走査ラインとの関係を
各ラインごとに９０゜−αの位相差に設定することで各
水平走査ラインの色表示箇所が静止することなく、その
積分効果により色ずれを防止している。
【０００４】
【発明が解決しようとする課題】画面上における水平走
査線の垂直方向での積分効果と色信号との関係は、ＮＴ
ＳＣ方式では、水平走査ラインごとに−１８０゜位相が
相違しているので色副搬送波の漏れや色ずれが画面上に
現れることが少ない。ＰＡＬ方式では水平走査ラインご
とに９０゜−α分位相が相違しているが、これを簡易型
のＰＡＬ方式では水平走査ラインごとに９０゜分の位相
を順次相違させることになる。図３は、この水平走査と
副搬送波の位相との関係を示す従来のノンインターレー
スの簡易型ＰＡＬ方式の説明図である。図示するよう
に、１ラインを重ねるごとに４ｆscの信号は、９０度位
相がずれている。これは、簡易型として、ｆsc×４の周
波数（＝１７．７３４ＭＨｚ）において１１３５クロッ
クを水平走査においてカウントするように設定した場合
である。この場合には、縦線や斜め線に色ずれが発生し
易く再生映像の画質が低下する。
査線の垂直方向での積分効果と色信号との関係は、ＮＴ
ＳＣ方式では、水平走査ラインごとに−１８０゜位相が
相違しているので色副搬送波の漏れや色ずれが画面上に
現れることが少ない。ＰＡＬ方式では水平走査ラインご
とに９０゜−α分位相が相違しているが、これを簡易型
のＰＡＬ方式では水平走査ラインごとに９０゜分の位相
を順次相違させることになる。図３は、この水平走査と
副搬送波の位相との関係を示す従来のノンインターレー
スの簡易型ＰＡＬ方式の説明図である。図示するよう
に、１ラインを重ねるごとに４ｆscの信号は、９０度位
相がずれている。これは、簡易型として、ｆsc×４の周
波数（＝１７．７３４ＭＨｚ）において１１３５クロッ
クを水平走査においてカウントするように設定した場合
である。この場合には、縦線や斜め線に色ずれが発生し
易く再生映像の画質が低下する。
【０００５】ところで、ビデオ信号生成装置としては、
ＰＡＬ方式 もＮＴＳＣ方式も副搬送波であるｆscの周
波数の相違と、１ライン遅延、そして垂直周波数、水平
周波数の相違を除けば、ビデオ信号を生成する主要処理
回路は、ほとんど同じである。特に、デジタル処理でビ
デオ信号を生成するＯＳＤ制御のビデオ信号生成装置、
デジタルカメラやＴＶゲーム等においては、クロックを
基準としてそれをカウントすることであるいはクロック
に同期さえて信号処理をすることで１フィールドあるい
は１フレームの画面を構成する。そこで、コントローラ
の処理内容や変調回路、バースト回路等が共通にでき
る。
ＰＡＬ方式 もＮＴＳＣ方式も副搬送波であるｆscの周
波数の相違と、１ライン遅延、そして垂直周波数、水平
周波数の相違を除けば、ビデオ信号を生成する主要処理
回路は、ほとんど同じである。特に、デジタル処理でビ
デオ信号を生成するＯＳＤ制御のビデオ信号生成装置、
デジタルカメラやＴＶゲーム等においては、クロックを
基準としてそれをカウントすることであるいはクロック
に同期さえて信号処理をすることで１フィールドあるい
は１フレームの画面を構成する。そこで、コントローラ
の処理内容や変調回路、バースト回路等が共通にでき
る。
【０００６】しかし、ＮＴＳＣ方式の副搬送波であるｆ
scの発振器（ｆsc×４の周波数発振器）をＰＡＬ方式で
使用しようとすると、特定の走査ラインで色副搬送波の
位相が本来のＰＡＬ方式の位相関係に保持できなくなる
ので、色ずれが発生して使用することができない。その
ためｆscの発振器や水平、垂直のタイミング発生回路を
共用することは難しい。この発明の目的は、このような
従来技術の問題点を解決するものであって、水平、垂直
のタイミング発生回路をはじめとして主要回路をＮＴＳ
Ｃ方式と共用することが可能なＯＳＤ制御のビデオ信号
生成装置、デジタルカメラやＴＶゲーム等に適するデジ
タル処理のＰＡＬ方式のビデオ信号生成装置を提供する
ことにある。
scの発振器（ｆsc×４の周波数発振器）をＰＡＬ方式で
使用しようとすると、特定の走査ラインで色副搬送波の
位相が本来のＰＡＬ方式の位相関係に保持できなくなる
ので、色ずれが発生して使用することができない。その
ためｆscの発振器や水平、垂直のタイミング発生回路を
共用することは難しい。この発明の目的は、このような
従来技術の問題点を解決するものであって、水平、垂直
のタイミング発生回路をはじめとして主要回路をＮＴＳ
Ｃ方式と共用することが可能なＯＳＤ制御のビデオ信号
生成装置、デジタルカメラやＴＶゲーム等に適するデジ
タル処理のＰＡＬ方式のビデオ信号生成装置を提供する
ことにある。
【０００７】
【課題を解決するための手段】このような目的を達成す
るためのこの発明のＰＡＬ方式のビデオ信号生成装置の
特徴は、ＰＡＬ方式の副搬送波ｆscに対してｆsc×４ｎ
の周波数（ｎは１以上整数）のクロックを発生するクロ
ック発生回路と、１水平走査ラインにおけるＮＴＳＣ方
式の副搬送波の４ｎ倍の周波数でのクロックカウント数
が設定可能でかつそれ以上のＰＡＬ方式における１水平
走査ラインにおけるクロック発生回路のクロックをカウ
ントするクロックカウント数が設定されてクロックを設
定された数カウントして水平タイミング信号を発生する
水平カウンタ回路と、ＮＴＳＣ方式の１画面の水平走査
ラインの数のカウント値が設定可能でかつそれ以上のＰ
ＡＬ方式における１画面の水平走査ラインの数のカウン
ト値が設定されて水平タイミング信号を設定された数カ
ウントして垂直のタイミング信号を発生する垂直カウン
タ回路とを有し、水平カウンタ回路に設定されたカウン
ト数が各水平走査ラインで副搬送波の位相がすべて揃う
ものである。
るためのこの発明のＰＡＬ方式のビデオ信号生成装置の
特徴は、ＰＡＬ方式の副搬送波ｆscに対してｆsc×４ｎ
の周波数（ｎは１以上整数）のクロックを発生するクロ
ック発生回路と、１水平走査ラインにおけるＮＴＳＣ方
式の副搬送波の４ｎ倍の周波数でのクロックカウント数
が設定可能でかつそれ以上のＰＡＬ方式における１水平
走査ラインにおけるクロック発生回路のクロックをカウ
ントするクロックカウント数が設定されてクロックを設
定された数カウントして水平タイミング信号を発生する
水平カウンタ回路と、ＮＴＳＣ方式の１画面の水平走査
ラインの数のカウント値が設定可能でかつそれ以上のＰ
ＡＬ方式における１画面の水平走査ラインの数のカウン
ト値が設定されて水平タイミング信号を設定された数カ
ウントして垂直のタイミング信号を発生する垂直カウン
タ回路とを有し、水平カウンタ回路に設定されたカウン
ト数が各水平走査ラインで副搬送波の位相がすべて揃う
ものである。
【０００８】
【発明の実施の形態】このように、各水平走査ラインで
副搬送波の位相がすべて揃うようにカウントして水平の
タイミング信号を発生する水平カウンタ回路を設けるこ
とで、色ずれが防止され、水平カウンタ回路がＮＴＳＣ
方式の副搬送波の４ｎ倍の周波数におけるクロック数に
対してカウントする数値設定が可能なものであり、か
つ、その数値を越えるＰＡＬ方式について数値設定が可
能なカウンタとなっているので、また、垂直カウンタ回
路も同様な関係になっているので、水平カウンタ回路と
垂直カウンタ回路の値の設定値変更により水平、垂直の
タイミング発生回路をＮＴＳＣ方式、ＰＡＬ方式の両者
において選択的に使用できる。また、デジタル処理で
は、ビデオメモリと、コントローラ、ＹＵＶ信号生成回
路、バースト付加回路、同期信号付加回路、信号合成回
路、Ｄ／Ａ変換回路等は、実質的に両者方式にに共通す
る回路にすることができる。その結果、タイミング発生
回路をはじめとして主要回路をＮＴＳＣ方式と共用する
ことが可能になり、ＯＳＤ制御のビデオ信号生成装置、
デジタルカメラやＴＶゲーム等に適するデジタル処理の
ＰＡＬ方式のビデオ信号生成装置をＮＴＳＣ方式の回路
を用いて実現することができる。
副搬送波の位相がすべて揃うようにカウントして水平の
タイミング信号を発生する水平カウンタ回路を設けるこ
とで、色ずれが防止され、水平カウンタ回路がＮＴＳＣ
方式の副搬送波の４ｎ倍の周波数におけるクロック数に
対してカウントする数値設定が可能なものであり、か
つ、その数値を越えるＰＡＬ方式について数値設定が可
能なカウンタとなっているので、また、垂直カウンタ回
路も同様な関係になっているので、水平カウンタ回路と
垂直カウンタ回路の値の設定値変更により水平、垂直の
タイミング発生回路をＮＴＳＣ方式、ＰＡＬ方式の両者
において選択的に使用できる。また、デジタル処理で
は、ビデオメモリと、コントローラ、ＹＵＶ信号生成回
路、バースト付加回路、同期信号付加回路、信号合成回
路、Ｄ／Ａ変換回路等は、実質的に両者方式にに共通す
る回路にすることができる。その結果、タイミング発生
回路をはじめとして主要回路をＮＴＳＣ方式と共用する
ことが可能になり、ＯＳＤ制御のビデオ信号生成装置、
デジタルカメラやＴＶゲーム等に適するデジタル処理の
ＰＡＬ方式のビデオ信号生成装置をＮＴＳＣ方式の回路
を用いて実現することができる。
【０００９】
【実施例】図１は、この発明のＰＡＬ方式のビデオ信号
生成装置を適用した一実施例のブロック図、図２は、そ
の水平走査ラインと副搬送波の位相関係の説明図であ
る。図１において、１０は、ＰＡＬ方式のビデオ信号生
成装置であって、信号処理系として、ビデオメモリ１
と、コントローラ２、ＹＵＶ信号生成回路３、平衡変調
回路４、バースト付加回路５、同期信号付加回路６、信
号合成回路７、Ｄ／Ａ変換回路（Ｄ／Ａ）８、そしてタ
イミング信号生成回路９を有している。タイミング信号
生成回路９は、４ｆsc発振器９ａ、水平カウンタ回路９
ｂ、垂直カウンタ回路９ｃ、１／４分周器９ｄ、そして
クロック位相調整回路９ｅとからなる。ここで、水平カ
ウンタ回路９ｂは、ＮＴＳＣ方式の副搬送波の４ｎ倍の
周波数における１水平走査ラインにおけるクロック数
（＝９１０）に対してカウントする数値設定が可能なも
のであり、かつ、その数値を越えるＰＡＬ方式について
も数値設定（＝１１３６）が可能な、いわゆるプリセッ
トカウンタとなっている。また、垂直カウンタ回路９ｃ
も同様に、水平走査ラインのカウント数は、ＮＴＳＣ方
式の数（＝２１０）が設定可能であり、かつ、これを越
えてＰＡＬ方式の数（＝３１２）が設定され、カウント
可能なものである。
生成装置を適用した一実施例のブロック図、図２は、そ
の水平走査ラインと副搬送波の位相関係の説明図であ
る。図１において、１０は、ＰＡＬ方式のビデオ信号生
成装置であって、信号処理系として、ビデオメモリ１
と、コントローラ２、ＹＵＶ信号生成回路３、平衡変調
回路４、バースト付加回路５、同期信号付加回路６、信
号合成回路７、Ｄ／Ａ変換回路（Ｄ／Ａ）８、そしてタ
イミング信号生成回路９を有している。タイミング信号
生成回路９は、４ｆsc発振器９ａ、水平カウンタ回路９
ｂ、垂直カウンタ回路９ｃ、１／４分周器９ｄ、そして
クロック位相調整回路９ｅとからなる。ここで、水平カ
ウンタ回路９ｂは、ＮＴＳＣ方式の副搬送波の４ｎ倍の
周波数における１水平走査ラインにおけるクロック数
（＝９１０）に対してカウントする数値設定が可能なも
のであり、かつ、その数値を越えるＰＡＬ方式について
も数値設定（＝１１３６）が可能な、いわゆるプリセッ
トカウンタとなっている。また、垂直カウンタ回路９ｃ
も同様に、水平走査ラインのカウント数は、ＮＴＳＣ方
式の数（＝２１０）が設定可能であり、かつ、これを越
えてＰＡＬ方式の数（＝３１２）が設定され、カウント
可能なものである。
【００１０】ビデオメモリ１は、１画面に対応して、例
えば、８ビット２５６階調のデジタル値のビデオ信号を
記憶するメモリであり、Ｒ（赤），Ｇ（緑），Ｂ（青）
の三原色に対応させて、Ｒ画面メモリ１ａ、Ｇ画面メモ
リ１ｇ、Ｂ画面メモリ１ｂとから構成されている。この
ビデオメモリ１については、出願人による出願である特
開平５−３０４６３５号に示されるように、ＰＡＬ方式
とＮＴＳＣ方式とに共用できる技術が公知である。その
原理は、実際に６４ｋビット（実際には、６５，５３６
ビット）のメモリを使用したとする。デジタル処理での
カウンタのカウント値は、２と８の倍数かこれに近いこ
とが実用的である。そこで、ＮＴＳＣ方式において、２
と８の倍数に近い数でかつ水平走査線数を２４３に近い
数を使用するとなると、それは２５６になる。その結
果、ＮＴＳＣ方式の水平方向のサンプリング数は、６
５，５３６÷２５６＝２５６により２５６となる。そこ
で、水平サンプリング数を決定するＮＴＳＣドットクロ
ック発生回路９の周波数は、５０μsec ÷２５６ ０．
１９５μsec ５ＭＨｚになる。なお、５０μsec は、
帰線期間を除いた有効画面走査期間である。帰線期間は
サンプリングしないからである。一方、ＰＡＬ方式で
は、１画面６２５本の水平走査線数となっているので、
１フィールドが３１２．５本になる。６４ｋビットのメ
モリを使用した場合に垂直サンプリング数について帰線
期間を考慮した実質的な垂直サンプリング数は２８０本
程度である。水平サンプリング数は、６５，５３６÷２
８０ ２３４となる。そこで、余裕をみて水平サンプリ
ング数を２２４とすれば、ＰＡＬ／ＮＴＳＣ切換信号が
ＰＡＬを示しているときにＰＡＬ／ＮＴＳＣドットクロ
ック発生回路が発生するクロックの周波数は、５０μse
c ÷２２４ ０．２２３μsec ４．４５ＭＨｚにな
る。また、前記において、水平サンプリング数を２２１
とすれば ４．４３ＭＨｚになる。なお、実際には、Ｐ
ＡＬ方式では、４ｆsc発振器９ａの発振周波数（例え
ば、１７．７３４ＭＨｚ）の整数分の１の周波数でかつ
前記の周波数に近い周波数のドットクロック周波数が選
択される。ＮＴＳＣ方式も４ｆsc発振器の発振周波数に
応じて同様な関係でドットクロック周波数が選択され
る。
えば、８ビット２５６階調のデジタル値のビデオ信号を
記憶するメモリであり、Ｒ（赤），Ｇ（緑），Ｂ（青）
の三原色に対応させて、Ｒ画面メモリ１ａ、Ｇ画面メモ
リ１ｇ、Ｂ画面メモリ１ｂとから構成されている。この
ビデオメモリ１については、出願人による出願である特
開平５−３０４６３５号に示されるように、ＰＡＬ方式
とＮＴＳＣ方式とに共用できる技術が公知である。その
原理は、実際に６４ｋビット（実際には、６５，５３６
ビット）のメモリを使用したとする。デジタル処理での
カウンタのカウント値は、２と８の倍数かこれに近いこ
とが実用的である。そこで、ＮＴＳＣ方式において、２
と８の倍数に近い数でかつ水平走査線数を２４３に近い
数を使用するとなると、それは２５６になる。その結
果、ＮＴＳＣ方式の水平方向のサンプリング数は、６
５，５３６÷２５６＝２５６により２５６となる。そこ
で、水平サンプリング数を決定するＮＴＳＣドットクロ
ック発生回路９の周波数は、５０μsec ÷２５６ ０．
１９５μsec ５ＭＨｚになる。なお、５０μsec は、
帰線期間を除いた有効画面走査期間である。帰線期間は
サンプリングしないからである。一方、ＰＡＬ方式で
は、１画面６２５本の水平走査線数となっているので、
１フィールドが３１２．５本になる。６４ｋビットのメ
モリを使用した場合に垂直サンプリング数について帰線
期間を考慮した実質的な垂直サンプリング数は２８０本
程度である。水平サンプリング数は、６５，５３６÷２
８０ ２３４となる。そこで、余裕をみて水平サンプリ
ング数を２２４とすれば、ＰＡＬ／ＮＴＳＣ切換信号が
ＰＡＬを示しているときにＰＡＬ／ＮＴＳＣドットクロ
ック発生回路が発生するクロックの周波数は、５０μse
c ÷２２４ ０．２２３μsec ４．４５ＭＨｚにな
る。また、前記において、水平サンプリング数を２２１
とすれば ４．４３ＭＨｚになる。なお、実際には、Ｐ
ＡＬ方式では、４ｆsc発振器９ａの発振周波数（例え
ば、１７．７３４ＭＨｚ）の整数分の１の周波数でかつ
前記の周波数に近い周波数のドットクロック周波数が選
択される。ＮＴＳＣ方式も４ｆsc発振器の発振周波数に
応じて同様な関係でドットクロック周波数が選択され
る。
【００１１】さて、４ｆsc発振器９ａは、ここでは、Ｐ
ＡＬ方式の副搬送波の４倍のｆsc×４の周波数（４．４
３ＭＨｚ×４＝１７．７３４ＭＨｚ）で発振する発振回
路である。また、平衡変調回路４とクロック位相調整回
路９ｅは、それぞれＰＡＬ方式に対応するような回路に
なっているが、それぞれの回路は、ここではＮＴＳＣ方
式の回路をパラメータ設定によりＰＡＬ方式として利用
している。コントローラ２は、水平カウンタ回路９ｂに
プリセットレジスタ９１にカウント値１１３６を設定
し、垂直カウンタ回路９ｃにプリセットレジスタ９２に
カウント値３１２を設定する。そして、水平カウンタ回
路９ｂ、垂直カウンタ回路９ｃからカウントアップ信号
Ｈｔ，Ｖｔを受けて、これら信号に同期してビデオメモ
リ１からＲＧＢ信号をそれぞれに読出してＹＵＶ信号生
成回路３に送出する。ＹＵＶ信号生成回路３は、各ＲＧ
Ｂ信号をそれぞれコントローラ２から受けて所定のデジ
タル演算処理をして輝度信号であるＹ信号と２つの色差
信号であるＵ信号、Ｖ信号とを生成する。
ＡＬ方式の副搬送波の４倍のｆsc×４の周波数（４．４
３ＭＨｚ×４＝１７．７３４ＭＨｚ）で発振する発振回
路である。また、平衡変調回路４とクロック位相調整回
路９ｅは、それぞれＰＡＬ方式に対応するような回路に
なっているが、それぞれの回路は、ここではＮＴＳＣ方
式の回路をパラメータ設定によりＰＡＬ方式として利用
している。コントローラ２は、水平カウンタ回路９ｂに
プリセットレジスタ９１にカウント値１１３６を設定
し、垂直カウンタ回路９ｃにプリセットレジスタ９２に
カウント値３１２を設定する。そして、水平カウンタ回
路９ｂ、垂直カウンタ回路９ｃからカウントアップ信号
Ｈｔ，Ｖｔを受けて、これら信号に同期してビデオメモ
リ１からＲＧＢ信号をそれぞれに読出してＹＵＶ信号生
成回路３に送出する。ＹＵＶ信号生成回路３は、各ＲＧ
Ｂ信号をそれぞれコントローラ２から受けて所定のデジ
タル演算処理をして輝度信号であるＹ信号と２つの色差
信号であるＵ信号、Ｖ信号とを生成する。
【００１２】Ｙ信号、Ｕ信号、Ｖ信号は、パラレルに平
衡変調回路４に送出される。平衡変調回路４は、水平カ
ウンタ回路９ｂ、垂直カウンタ回路９ｃからそれぞれカ
ウントアップ信号Ｈｔ，Ｖｔと、クロック位相調整回路
９ｅからＰＡＬ方式に対応するようにタイミング調整さ
れた色副搬送波信号ｆscとを受けて、前記のカウントア
ップ信号Ｈｔ，Ｖｔ信号に同期させてＹ信号、Ｕ信号、
Ｖ信号をデジタル値として１ラインごとに位相を１８０
゜反転するＰＡＬ方式の平衡変調処理をしてバースト付
加回路５に出力する。バースト付加回路５は、水平カウ
ンタ回路９ｂ、垂直カウンタ回路９ｃからそれぞれカウ
ントアップ信号Ｈｔ，Ｖｔを受けて、これら信号に同期
して同期信号に対応するタイミング位置にカラーバース
ト信号（デジタル値）を付加して信号合成回路７に送出
する。
衡変調回路４に送出される。平衡変調回路４は、水平カ
ウンタ回路９ｂ、垂直カウンタ回路９ｃからそれぞれカ
ウントアップ信号Ｈｔ，Ｖｔと、クロック位相調整回路
９ｅからＰＡＬ方式に対応するようにタイミング調整さ
れた色副搬送波信号ｆscとを受けて、前記のカウントア
ップ信号Ｈｔ，Ｖｔ信号に同期させてＹ信号、Ｕ信号、
Ｖ信号をデジタル値として１ラインごとに位相を１８０
゜反転するＰＡＬ方式の平衡変調処理をしてバースト付
加回路５に出力する。バースト付加回路５は、水平カウ
ンタ回路９ｂ、垂直カウンタ回路９ｃからそれぞれカウ
ントアップ信号Ｈｔ，Ｖｔを受けて、これら信号に同期
して同期信号に対応するタイミング位置にカラーバース
ト信号（デジタル値）を付加して信号合成回路７に送出
する。
【００１３】ＹＵＶ信号生成回路３は、同期信号付加回
路６に同期信号挿入のタイミング信号ＳＹＣを発生して
同期信号付加回路６に送出する。同期信号付加回路６
は、タイミング信号ＳＹＣと、水平カウンタ回路９ｂ、
垂直カウンタ回路９ｃからカウントアップ信号Ｈｔ，Ｖ
ｔとを受けて所定のタイミングでデジタル値で所定の期
間の水平同期信号と垂直同期信号とをそれぞれのＰＡＬ
方式のＴＶ規格のタイミングで生成して信号合成回路７
に出力する。信号合成回路７は、同期信号付加回路６と
変調済みのＹ信号、Ｕ信号、Ｖ信号とを受けてこれらを
合成してＤ／Ａ変換器８に送出する。その結果、アナロ
グ信号に変換されたＰＡＬ方式のコンポジットビデオ信
号が出力端子１０ａに出力される。ここで、水平カウン
タ回路９ｂには、プリセットレジスタ９１が設けられ、
このプリセットレジスタ９１に設定された値１１３６を
上限値として循環カウントしてそのカウント終了信号を
タイミング出力信号Ｈｔとして出力する。垂直カウンタ
回路９ｃには、プリセットレジスタ９２が設けられ、こ
のプリセットレジスタ９２に設定された値３１２を上限
値として循環カウントしてそのカウント終了信号をタイ
ミング出力信号Ｖｔとして出力する。
路６に同期信号挿入のタイミング信号ＳＹＣを発生して
同期信号付加回路６に送出する。同期信号付加回路６
は、タイミング信号ＳＹＣと、水平カウンタ回路９ｂ、
垂直カウンタ回路９ｃからカウントアップ信号Ｈｔ，Ｖ
ｔとを受けて所定のタイミングでデジタル値で所定の期
間の水平同期信号と垂直同期信号とをそれぞれのＰＡＬ
方式のＴＶ規格のタイミングで生成して信号合成回路７
に出力する。信号合成回路７は、同期信号付加回路６と
変調済みのＹ信号、Ｕ信号、Ｖ信号とを受けてこれらを
合成してＤ／Ａ変換器８に送出する。その結果、アナロ
グ信号に変換されたＰＡＬ方式のコンポジットビデオ信
号が出力端子１０ａに出力される。ここで、水平カウン
タ回路９ｂには、プリセットレジスタ９１が設けられ、
このプリセットレジスタ９１に設定された値１１３６を
上限値として循環カウントしてそのカウント終了信号を
タイミング出力信号Ｈｔとして出力する。垂直カウンタ
回路９ｃには、プリセットレジスタ９２が設けられ、こ
のプリセットレジスタ９２に設定された値３１２を上限
値として循環カウントしてそのカウント終了信号をタイ
ミング出力信号Ｖｔとして出力する。
【００１４】このようにカウント値がプリセットできる
カウンタにより、ＮＴＳＣ方式の水平、垂直のタイミン
グ発生回路を設けて、水平カウンタ回路９ｂがＮＴＳＣ
方式の副搬送波の４ｎ倍の周波数におけるクロック数に
対してカウントする数値設定が可能なものであり、か
つ、その数値を越えるＰＡＬ方式について数値設定が可
能なカウンタとしている。しかも、ここでは、水平カウ
ンタ回路９ｂに設定されたカウント数が各水平走査ライ
ンで副搬送波の位相がすべて揃うものである。このこと
により、この水平走査と副搬送波の位相との関係を示す
と、図２のような関係になる。すなわち、水平走査ライ
ンのカウント値を１１３６とすることにより、すべての
走査ラインでの副搬送波ｆscの画面上での位相が一致す
る。これにより各ライン間での位相が揃い色ずれが発生
し難い。このように各ライン間で位相が揃うと、ベネチ
アンブラインドという縦縞が画面上に現れる危険性が高
くなるが、簡易型ＰＡＬ方式では、色ずれほど縦縞が気
にならない。そこで問題になるほどではない。
カウンタにより、ＮＴＳＣ方式の水平、垂直のタイミン
グ発生回路を設けて、水平カウンタ回路９ｂがＮＴＳＣ
方式の副搬送波の４ｎ倍の周波数におけるクロック数に
対してカウントする数値設定が可能なものであり、か
つ、その数値を越えるＰＡＬ方式について数値設定が可
能なカウンタとしている。しかも、ここでは、水平カウ
ンタ回路９ｂに設定されたカウント数が各水平走査ライ
ンで副搬送波の位相がすべて揃うものである。このこと
により、この水平走査と副搬送波の位相との関係を示す
と、図２のような関係になる。すなわち、水平走査ライ
ンのカウント値を１１３６とすることにより、すべての
走査ラインでの副搬送波ｆscの画面上での位相が一致す
る。これにより各ライン間での位相が揃い色ずれが発生
し難い。このように各ライン間で位相が揃うと、ベネチ
アンブラインドという縦縞が画面上に現れる危険性が高
くなるが、簡易型ＰＡＬ方式では、色ずれほど縦縞が気
にならない。そこで問題になるほどではない。
【００１５】また、この発明では、タイミング信号生成
回路９の水平、垂直のタイミング信号が数値設定になっ
ているので、ＮＴＳＣ方式とするには、４ｆsc発振器９
ａを３．５７×４の周波数（＝１４．２８ＭＨｚ）と
し、コントローラ２により水平カウンタ回路９ｂの水平
走査ラインのカウント値を９１０としてプリセットレジ
スタ９１に設定し、垂直カウンタ回路９ｃのカウント値
を２５２としてプリセットレジスタ９２に設定すれば、
タイミング発生回路をＮＴＳＣ方式とすることができ
る。４ｆsc発振器９ａの発振器の周波数変更は、４ｆsc
発振器９ａをこてに外部素子として取り付けられている
セラミックス振動子を取り替えることで容易にできる。
すなわち、４ｆsc発振器９ａは、ここでは外部取り付け
の発振素子を取り付けて周波数が設定可能なセラミック
ス発振器である。
回路９の水平、垂直のタイミング信号が数値設定になっ
ているので、ＮＴＳＣ方式とするには、４ｆsc発振器９
ａを３．５７×４の周波数（＝１４．２８ＭＨｚ）と
し、コントローラ２により水平カウンタ回路９ｂの水平
走査ラインのカウント値を９１０としてプリセットレジ
スタ９１に設定し、垂直カウンタ回路９ｃのカウント値
を２５２としてプリセットレジスタ９２に設定すれば、
タイミング発生回路をＮＴＳＣ方式とすることができ
る。４ｆsc発振器９ａの発振器の周波数変更は、４ｆsc
発振器９ａをこてに外部素子として取り付けられている
セラミックス振動子を取り替えることで容易にできる。
すなわち、４ｆsc発振器９ａは、ここでは外部取り付け
の発振素子を取り付けて周波数が設定可能なセラミック
ス発振器である。
【００１６】このようにすることでビデオメモリ１と、
コントローラ２、ＹＵＶ信号生成回路３、バースト付加
回路５、同期信号付加回路６、信号合成回路７、Ｄ／Ａ
変換回路８、タイミング信号生成回路９とをＮＴＳＣ方
式と共用することができる。さらに、平衡変調回路４
は、通常、パラメータ設定により変調タイミングが演算
されるものであるので、ＰＡＬ方式とＮＴＳＣ方式との
両者に設定できるようにパラメータ設定できる設定回路
にすれば、これもＮＴＳＣ方式と共用可能になる。な
お、コントローラ２の水平、垂直のカウント値に対する
ＮＴＳＣ方式とＰＡＬ方式の切換えは、外部にディップ
スイッチ等を設けてそれをＯＮ／ＯＦＦにより行うこと
で、例えば、ＯＮのときにコントローラの機能をＮＴＳ
Ｃ方式、ＯＦＦのときにＰＡＬ方式に対応させることが
できる。
コントローラ２、ＹＵＶ信号生成回路３、バースト付加
回路５、同期信号付加回路６、信号合成回路７、Ｄ／Ａ
変換回路８、タイミング信号生成回路９とをＮＴＳＣ方
式と共用することができる。さらに、平衡変調回路４
は、通常、パラメータ設定により変調タイミングが演算
されるものであるので、ＰＡＬ方式とＮＴＳＣ方式との
両者に設定できるようにパラメータ設定できる設定回路
にすれば、これもＮＴＳＣ方式と共用可能になる。な
お、コントローラ２の水平、垂直のカウント値に対する
ＮＴＳＣ方式とＰＡＬ方式の切換えは、外部にディップ
スイッチ等を設けてそれをＯＮ／ＯＦＦにより行うこと
で、例えば、ＯＮのときにコントローラの機能をＮＴＳ
Ｃ方式、ＯＦＦのときにＰＡＬ方式に対応させることが
できる。
【００１７】以上説明してきたが、実施例では、ｆsc×
４の周波数（＝１７．７３４ＭＨｚ）において１１３６
クロックを１水平走査ラインとして設定した場合である
が、これらの整数倍の制御をしても同様な結果が得られ
ることはもちろんである。要するに、この発明は、ＰＡ
Ｌ方式において、各水平走査ラインの副搬送波の位相が
全水平走査ラインで揃うようにカウントする水平カウン
タ回路を設ければよい。なお、垂直方向のカウント値
は、画面仕様に合わせて任意に設定することができる。
４の周波数（＝１７．７３４ＭＨｚ）において１１３６
クロックを１水平走査ラインとして設定した場合である
が、これらの整数倍の制御をしても同様な結果が得られ
ることはもちろんである。要するに、この発明は、ＰＡ
Ｌ方式において、各水平走査ラインの副搬送波の位相が
全水平走査ラインで揃うようにカウントする水平カウン
タ回路を設ければよい。なお、垂直方向のカウント値
は、画面仕様に合わせて任意に設定することができる。
【００１８】
【発明の効果】以上説明してきたように、この発明にあ
っては、各水平走査ラインで副搬送波の位相がすべて揃
うようにカウントして水平のタイミング信号を発生する
水平カウンタ回路を設けることで、色ずれが防止され、
水平カウンタ回路と垂直カウンタ回路がＮＴＳＣ方式の
副搬送波の４ｎ倍の周波数におけるクロック数に対して
カウントする数値設定が可能なものであり、かつ、その
数値を越えるＰＡＬ方式について数値設定が可能なカウ
ンタとなっているので、水平カウンタ回路と垂直カウン
タ回路の値の設定値変更により水平、垂直のタイミング
発生回路をＮＴＳＣ方式、ＰＡＬ方式の両者において選
択的に使用できる。その結果、タイミング発生回路をは
じめとして主要回路をＮＴＳＣ方式と共用することが可
能になり、ＯＳＤ制御のビデオ信号生成装置、デジタル
カメラやＴＶゲーム等に適するデジタル処理のＰＡＬ方
式のビデオ信号生成装置をＮＴＳＣ方式の回路を用いて
実現することができる。
っては、各水平走査ラインで副搬送波の位相がすべて揃
うようにカウントして水平のタイミング信号を発生する
水平カウンタ回路を設けることで、色ずれが防止され、
水平カウンタ回路と垂直カウンタ回路がＮＴＳＣ方式の
副搬送波の４ｎ倍の周波数におけるクロック数に対して
カウントする数値設定が可能なものであり、かつ、その
数値を越えるＰＡＬ方式について数値設定が可能なカウ
ンタとなっているので、水平カウンタ回路と垂直カウン
タ回路の値の設定値変更により水平、垂直のタイミング
発生回路をＮＴＳＣ方式、ＰＡＬ方式の両者において選
択的に使用できる。その結果、タイミング発生回路をは
じめとして主要回路をＮＴＳＣ方式と共用することが可
能になり、ＯＳＤ制御のビデオ信号生成装置、デジタル
カメラやＴＶゲーム等に適するデジタル処理のＰＡＬ方
式のビデオ信号生成装置をＮＴＳＣ方式の回路を用いて
実現することができる。
【図１】図１は、この発明のＰＡＬ方式のビデオ信号生
成装置を適用した一実施例のブロック図である。
成装置を適用した一実施例のブロック図である。
【図２】図２は、その水平走査ラインと副搬送波の位相
関係の説明図である。
関係の説明図である。
【図３】図３は、従来の簡易のＰＡＬ方式の走査と副搬
送波の位相関係の説明図である。
送波の位相関係の説明図である。
１…ビデオメモリ、２…コントローラ、３…ＹＵＶ信号
生成回路、４…平衡変調回路、５…バースト付加回路、
６…同期信号付加回路、７…信号合成回路、８…Ｄ／Ａ
変換回路、９…タイミング信号生成回路、９ａ…４ｆsc
発振器、９ｂ…水平カウンタ回路、９ｃ…垂直カウンタ
回路、９ｄ…１／４分周器、９ｅ…クロック位相調整回
路。
生成回路、４…平衡変調回路、５…バースト付加回路、
６…同期信号付加回路、７…信号合成回路、８…Ｄ／Ａ
変換回路、９…タイミング信号生成回路、９ａ…４ｆsc
発振器、９ｂ…水平カウンタ回路、９ｃ…垂直カウンタ
回路、９ｄ…１／４分周器、９ｅ…クロック位相調整回
路。
Claims (2)
- 【請求項１】ＰＡＬ方式の副搬送波ｆscに対してｆsc×
４ｎの周波数（ｎは１以上整数）のクロックを発生する
クロック発生回路と、１水平走査ラインにおけるＮＴＳ
Ｃ方式の副搬送波の４ｎ倍の周波数でのクロックカウン
ト数が設定可能でかつそれ以上の前記ＰＡＬ方式におけ
る１水平走査ラインにおける前記クロック発生回路の前
記クロックをカウントするクロックカウント数が設定さ
れて前記クロックを設定された数カウントして水平タイ
ミング信号を発生する水平カウンタ回路と、前記ＮＴＳ
Ｃ方式の１画面の水平走査ラインの数のカウント値が設
定可能でかつそれ以上の前記ＰＡＬ方式における１画面
の水平走査ラインの数のカウント値が設定されて前記水
平タイミング信号を設定された数カウントして垂直のタ
イミング信号を発生する垂直カウンタ回路とを有し、前
記水平カウンタ回路に設定されたカウント数は、各水平
走査ラインで前記副搬送波の位相がすべて揃うことを特
徴とするＰＡＬ方式ビデオ信号生成装置。 - 【請求項２】前記水平カウンタ回路は、前記設定された
カウント数として前記クロックをｎ×１１３６個カウン
トして前記水平タイミング信号を発生するものである請
求項１記載のＰＡＬ方式ビデオ信号生成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19842999A JP2001028761A (ja) | 1999-07-13 | 1999-07-13 | Ｐａｌ方式ビデオ信号生成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19842999A JP2001028761A (ja) | 1999-07-13 | 1999-07-13 | Ｐａｌ方式ビデオ信号生成装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2001028761A true JP2001028761A (ja) | 2001-01-30 |
Family
ID=16390951
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19842999A Pending JP2001028761A (ja) | 1999-07-13 | 1999-07-13 | Ｐａｌ方式ビデオ信号生成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2001028761A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002305754A (ja) * | 2001-04-03 | 2002-10-18 | Sony Corp | 画像処理装置および画像処理システム |
-
1999
- 1999-07-13 JP JP19842999A patent/JP2001028761A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002305754A (ja) * | 2001-04-03 | 2002-10-18 | Sony Corp | 画像処理装置および画像処理システム |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Effective date: 20060712 Free format text: JAPANESE INTERMEDIATE CODE: A621 |
|
| A977 | Report on retrieval |
Effective date: 20081226 Free format text: JAPANESE INTERMEDIATE CODE: A971007 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20090113 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20090519 |