JP2000513875A - 小型寸法の電気的、電子的又は電気機械的な素子の製造方法 - Google Patents

小型寸法の電気的、電子的又は電気機械的な素子の製造方法

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Abstract

(57)【要約】 本発明は、絶縁材料により封止され、回路に組み込むことができ又は組み込むことができない電気的、電子的及び電気機械的素子の製造方法に関するものであり、(a)封止されるべき素子と電気的に接触するように表面に金属膜が被着されている電気的絶縁材料のプレート上に又はこのプレートのキャビティ内に素子を配置し、(b)前記素子を配置した後、前記絶縁材料のプレートの一方の側、又は両側を、前記素子を支持する電気的絶縁材料のプレートに気密状に固定される電気的絶縁材料のプレートで覆い、(c)分割線に沿って前記素子と電気的に接触するように作用する金属膜を切断し、この本体を、それぞれ電気的絶縁材料で封止された素子から成る複数のブロックに分割し、(d)次に、これらブロックに2個又はそれ以上の電気的コンタクトを形成する。本発明は、ここで述べた方法により封止された素子にも関するものである。この方法により得られる村止された素子は高い寸法精度を有する。

Description

【発明の詳細な説明】 小型寸法の電気的、電子的又は電気機械的な素子の製造方法 本発明は、電気的絶縁材料中に封止された電気的、電子的又は電気機械的素子 の製造方法に関するものである。特に、本発明は導体パターンが形成されている 基板(プリント回路基板)上に適切に機械的に実装でき、これにより電気回路又 は電子回路を構成する小型寸法の素子に関するものである。 このような素子は既知である。この既知の素子は、リード線が無く表面実装可 能なデバイス(SMD)と称せられている。この素子の電気的コンタクトを用い ることにより素子をプリント回路基板上に簡単な方法でハンダ付けすることがで きる。この素子の寸法が小型であること及びリード線が無いことにより、PCB への高い実装密度を達成することができる。 小型化を達成するためには、これらの素子の寸法を一層小さくする必要がある 。PCB上に実装される素子の場合、その寸法は1×0.5×0.5mm程度で ある。このような小さな素子が例えば配置装置のような機械的な手段により供給 される場合、素子が高い寸法精度を有することが極めて重要である。 本発明の目的は、小さな寸法の電気的に絶縁された素子を高い寸法精度で製造 することができる方法を提供することにある。本発明は、この方法において適切 に用いることができる素子を提供することも目的とする。 本発明によれば、この目的は、 (a)封止されるべき素子と電気的に接触するように表面に金属膜が被着されて いる電気的絶縁材料のプレート上に又はこのプレートのキャビティ内に素子を配 置し、 (b)前記素子を配置した後、前記絶縁材料のプレートの一方の側、又は前記素 子が貫通孔内に位置する場合には両側を、前記素子を支持する電気的絶縁材料の プレートに気密状に固定される電気的絶縁材料のプレートで覆い、これにより前 記素子を外界から封止し、 (c)分割線に沿って前記素子と電気的に接触するように作用する金属膜を切断 し、この本体を、それぞれ電気的絶縁材料で封止された素子から成る複数のブロ ックに分割し、 (d)次に、これらブロックにハンダ付け可能な金属層の形態の2個又はそれ以 上の電気的コンタクトを形成し、この金属層は、必要な場合封止部材の部分間で 突出する金属膜と電気的に接触するように前記ブロックを十分に取り囲み、前記 金属膜が封止されている素子と電気的に接触するように作用することを特徴とす る方法により現在の実際的な観点において満足されるように達成される。 これに関連して、「金属膜を切断する」とは、例えばパターンに従って形成さ れた金属の細条の形態の金属膜を、ブロックに分割する際に切断し、又はこれら 金属膜又は金属細条の側面がブロックの封止部材の部分間で十分に突出して封止 された素子とブロックに形成された電気的コンタクトとの間で電気的接続を形成 するように少なくとも接触することを意味する。 本発明による方法において、個別に製造された素子又は素子の部分は電気的絶 縁材料のプレートの表面上に又はこのプレートの表面に形成したキャビティ内に 配置することができる。一方、適当な導電性及び/又は半導電性及び絶縁性の層 をパターンに従って形成することにより、これらの素子をこのプレートの表面上 に又はこのプレートのキャビィティ内に組み込むことができる。これは、薄膜技 術(気相堆積、スパッタリング等)及び厚膜技術(スクリーン印刷、印刷等)の ような層を形成する既知の技術により達成することができる。プレートのキャビ ィティは、表面に形成した小さなピット又は空孔或いは貫通孔又は開口とするこ とができる。このキャビィティの形状及び寸法は、所望の素子を収納できるよう に選択する必要がある。全ての場合において、電気的コンタクト用のパターン化 された金属膜は素子と共にプレートの表面上に配置され、必要な場合には素子の 形状によりプレートの空孔又は開口内に或いはプレートの両方の表面上に配置さ れる。 プレートは、本発明に適切に適合する例えば0.2〜0.5mm又はそれ以上 或いはそれ以下の厚さを有する電気的絶縁材料の薄いプレートで構成することが できる。極めて好適に用いることができる材料はガラスである。アルミニウム酸 化物及びジルコニウム酸化物のようなセラミック材料のプレートも用いることが できる。空孔及び貫通孔又は開口は、パウダバラスティング、化学エッチング、 レーザエッチング等のような既知の技術によりプレートに形成することができる 。このようなキャビィティを形成しようとする場合、用いるプレートは好ましく は選択的にエッチング可能な形式のガラスとする。 プレート上に素子を配置し電気的コンタクトを構成するように作用する金属膜 を形成した後、同一の又は異なる電気的絶縁性材料の別のプレートを、表面に素 子が位置し又は表面のキャビィティに素子が存在するプレートの側に配置する。 プレートが貫通孔を有する場合、素子を配置した後、同一の又は異なる電気的絶 縁性材料のプレートを両側で覆う。これらのプレートは、素子及びカバープレー トを支持するプレートがガラスで構成される場合、例えばガラスフリットを用い て素子が配置されているプレートに接着する。このガラスフリットの溶融温度は 、用いるプレートのガラスの溶融温度よりも低くする必要がある。さらに、これ らの素子は耐熱性を有する必要がある。或いは、本発明の順次の工程における処 理に耐久性を有する場合合成樹脂を主成分とする接着剤を用いることができる。 封止部材の特定の構造に関して、素子が配置されているプレート及び別のプレー ト或いは素子と電気的コンタクトを形成するように作用するプレート上の金属膜 は、素子が配置されているプレートとカバープレートとの間のボンディング層と して用いることができる。 次に、このようにして形成された本体を、電気的絶縁材料中に封止されている 少なくとも1個の素子をそれぞれ具える小さなブロックに分割する。分割工程に おいて、素子と電気的に接触する金属膜はブロック間の分割線に沿って切断する 。ブロックへの切断は、例えばソーイング、ブレイキング、カッティング又はレ ーザ等により機械的に行うことができる。これらの処理により高い寸法精度を達 成することができる。 電気的コンタクトを形成するように作用する金属の側面は、封止部材の部分間 の側面において局部的に突出する。本発明による方法のその後の工程において、 ブロックには2個の位置において電気的コンタクトを形成し、これらのコンタク トは金属膜の側面つまり実際の素子に電気的に接続され、封止部材の構造の観点 において必要な場合金属層はブロックを取り囲むことができる。封止された素子 の回路中における機能に応じて、封止された素子は2個以上のコンタクトを有す ることができる。 或いは、素子は電気的絶縁材料の2個のプレートの2個の対応する空孔により 構成されるキャビィティ内に収納することができる。これを達成するため、本発 明による方法は、 (a)電気的絶縁材料の2個のプレートに同一のパターンにしたがって空孔を形 成し、これら空孔の結合深さ及び他の寸法を素子を収納するのに十分なものとし 、 (b)前記プレートに、前記キャビティの底部まで延在する金属膜の細条の形態 のパターン形成された電気的コンタクト層を形成し、 (c)プレートのキャビティに素子を配置し、 (d)前記他方のプレートを、キャビティが形成されている側が素子を支持する 側と対向するように、素子を支持するプレートに気密状に固定し、その後、最終 的な本体を、電気的コンタクトが形成されている複数のブロックに分割すること を特徴とする。 本発明による方法の当該実施例の重要な変形例は、素子の互いに対向する端部 に端部コンタクトが形成されている素子を電気的絶縁材料の支持プレートの貫通 孔内に各素子の各端部コンタクトが支持プレートの表面まで延在し又はこの表面 から上方に突出するように配置する。その後、貫通孔内に素子を有する支持プレ ートをその両側から、電極層として作用すると共に素子の端部コンタクトと電気 的に接触するパターン状の金属細条が形成されているプレートで覆う。貫通孔を 有する支持プレートの厚さを貫通孔内に配置されている素子の端部コタクトのコ ンタクト面間の距離に等しくすれば、平坦なカバープレートを用いることができ 、しかも両方のカバープレートが配置された後これらの素子はプレートの表面の 電極層と電気的に接触する。端部コンタクト又は金属細条の接触面に好ましくは 金のような変形可能な金属の薄い層を形成することにより、満足し得る電気的接 触を得る電気的接触を得ることができる。 素子の端部コンタクトの接触面間の距離が支持プレートの厚さよりも厚い場合 、素子の端部コンタクトは支持プレートの表面から突出する。この場合、一方又 は両方のカバープレートに素子の突出部分を収容するのに十分な深さの空孔を形 成する。素子を支持する支持プレートにカバープレートを設けた後、金属細条に より各素子が列として異なる2個の素子に電気的に接続されるように、金属細条 をカバープレート上に適切なパターンに従って形成する。 貫通孔内に素子を有するプレートの一方の側又は他方の側の金属細条を常時通 る長手軸線上で金属細条と直角に延在する分割面に沿って本体をブロックに分割 するとき、貫通孔内に素子を収容するブロックの上記部分の対向する側に位置す る金属細条は、ブロックの対向する端部において封止部材の部分間で突出する。 次に、これらブロックの端部に表面がハンダ付け可能な金属から成る電気的端部 コンタクトを形成する。 本発明の方法の別の好適実施例において、電気的コンタクトを形成する前に、 研摩剤の存在のもとで例えばタンブリングによりブロックのシャープな縁部を機 械的に除去する。これにより電気的コンタクトの形成、測定及び仕分け並びに最 終的に封止された素子の電気又は電子回路への実装のような以後の処理中に封止 されたチィップの表面の一部が欠けるような不具合が防止される。 電気的コンタクトは、例えば始めにブロックの表面に金属の核層を形成するこ とにより形成することができる。この核層は、例えば真空チャンバ内でバルクサ ンプルをマグネトロン−スパッタリング(バレル−スパッタリング)することに より形成されるニッケル−クロム合金で構成することができる。このような核層 は、気相堆積又はウェット化学処理により形成することもできる。次に、除去可 能なマスク層をブロックの以後の工程において電気的コンタクトを構成する金属 層が形成される予定の位置に形成する。このマスキング層は、容易に溶解し又は 低融点のラッカ又はワックスで構成することができる。 次に、金属の核層を例えば化学エッチングによりマスキング層で覆われていな い部分から除去し、その後マスキング層も除去する。核層の露出した部分に、金 属層(電着により)及びハング層(浸漬コーティングにより)を順次形成する。 所望の場合、例えば封止部材の構造の見地において、このようにして形成した電 気的コンタクトはブロックの端部に拡がって封止部材の部分間に位置し少なくと も部分的に封止された素子の電気的コンタクトとして作用する金属膜と電気的に 接触することができる。 本発明の方法は、例えば封止された単層及び多層の薄膜と厚膜のキャパシタ、 薄膜と厚膜の抵抗、ダイオード、センサ(NTC)、薄膜コイル、安全フューズ 、リードコンタクト等の製造、並びにキャパシタ、抵抗、センサ、ダイオード及 び/又はトランジスタ等の組み合わせのようなこれらの素子の組み合わせの製造 に用いることができ、本発明の方法はこのような素子を含む電気回路及び電子回 路にも用いることができる。前述した説明、以後の説明及び請求の範囲で用いら れる「素子」の用語は、機能的に等しい素子及び異なる素子の組み合わせ並びに これらの素子を含む電気的及び電子的回路を含むものと理解すべきである。 これらの素子は電気的絶材料のプレートに全体的に又は部分的に構築すること ができ、或いは個別に、一体的に又は部分的に製造することができ、並びに必要 な場合電気的又は電子的回路の形成中にプレートの凹部内に配置することができ 、この目的のために支持プレートには既知方法により例えば金属膜から適当なパ ターンに基づいて導電性のトラックをエッチングすることにより導電性の配線を 形成することができる。 本発明の方法はPCB上の電気的回路又は電子的回路に容易に実装することが できる封止された素子又はこれらの素子の組み合わせを実現することができ、こ れらの素子が外界から気密に閉成することができる。封止された素子又は極めて 良好な寸法公差を有し、この寸法公差はパターンにしたがってブロックに分割す ることにより達成される。封止部材は外界から適切に閉成する。この理由は、封 止部材をガラス及び/又はセラミック材料で構成できるからである。必要な場合 、封止された素子についてタンブリング処理を行ない、この処理の結果として封 止された素子からシャープな縁部が除去される。角ばった縁部は、選択、測定、 バッキング、バルクフィーダを用いた処理等のような別の処理中に欠けるおそれ がある。素子の封止部材の端部が電気的コンタクトにより包囲されている場合、 良好なハンダ付け可能性及び検査性能並びにコンタクトの封止部材への良好な機 械的接着が達成される。 本発明による電気的、電子的又は電気機械的素子は、ガラス及び/又はセラミ ック材料の気密性封止部材中に埋設され、前記封止部材が複数の部分から構成さ れると共に好ましくは伸長状をなし、この封止部材の少なくとも両端に金属の電 気的コンタクトが形成され、電気的接続部材は、封止部材の側部を部分的に取り 囲むと共に封止部材の構成部分間に位置する金属膜を介して封止部材内に埋設さ れた素子と電気的に接触する端部コンタクトの形態とすることを特徴とする。 本発明による封止された素子の好適実施例は、素子と電気的コンタクトとの間 の電気的接続部材を構成するように作用する封止部材の部分間の金属膜は、封止 部材の部分間のボンティング膜としても作用する。このようにして、封止部材の 部分間において極めて強力で気密性の接続部材が達成され、特にこれらの部分が ガラスで構成される場合に有益である。 これらの及び他の概念は、後述する実施例に基づいて明確にする。 図面として、 図1は種々の層が形成されているプレートの一部を示す平面図である。 図2は図1のII−II線で切った側方断面図である。 図3は電気的接続部材がが形成されていない素子の斜視図である。 図4はシャープな縁部を除去した後の図3の素子の一部を示す。 図5は図3の素子の別の部分の線図である。 図6は核層が部分的に形成されている素子の側面図である。 図7は電気的端部コンタクトが形成されている素子の側面図である。 図8空孔及び金属膜の細条が形成されているプレートの一部の平面図である。 図9はキャビィティないダイオードが収納されている図8に基づく一方のプレ ートが他方のプレートの上側に配置されている2個のプレートの断面図である。 図10は電気的端部コンタクトを有する伸長状ダイオードの長手方向断面図で ある。 図11は貫通孔が形成されているプレートの一部の断面図である。 図12は図11に示すプレートのVII−VII線で切った断面図である。 図13は金属細条を有するカバープレートの平面図である。 図14は金属細条を有するカバープレートの平面図である。 図15は素子を支持するプレート及びカバープレートの組立体の断面図である 。 図16は最終的な封止された素子の断面図である。 図面はスケール通りに表示されていないことに注意されたい。図面において、 同様な部材には同一符号を付することにする。 実施例1(図1〜7) 厚さ0.3mmのガラス基板11に金属膜、例えばアルミニウムの膜をスパッ タリンク又は蒸着により形成する。次に、アルミニウム膜の一部をフォトリソグ ラフィ法により除去し、マトリッスク状に配置された第1の電極層を残存させる 。次に、化学気相堆積法により全面に窒化シリコンの誘電体層3を形成する(図 2において、右上側のコーナ部分において層3が部分的に除去され電極層2が表 れている)。誘電体層3にはアルミニウムの金属膜を形成し、この金属膜により 電極層2について説明した方法と同一の方法により電極層4を形成し、各電極層 4はそれぞれ下側の2個の電極層2と部分的にオーバラップする。 図2は図1のII−II線で切った断面を示し、上述した層構造体を図示する。次 に、この本体に例えばエポキシラッカのラッカ層5及び厚さ0.2mmのガラス のカバープレート6を接着する。この本体の厚さは、支持プレート1に被着され るラッカ層の厚さが数10μmであるので、0.5mmを僅かに超える程度であ る。 得られた本体は、それぞれ少なくとも1個の素子を有するブロックに分割する 。図1及び2において、多数の分割線A,B,C,D,E並びにC’,d’及び E’がそれぞれ図示され、分割線C,D,E及びC’,d’,E’は電極層2及 び4を通過するように延在する。ブロックへの分割は、好ましくはソーイングに より行う。図3は電気的コンタクトが形成される前の封止された素子の斜視図で ある。 電気的コンタクトの形成に先立って、好ましくはタンブリングのような機械的 な手段により封止された素子からシャープな縁部を除去する。このようにして、 多数のブロックを機械的に整列させる以後の処理中にブロックの縁部の一部が欠 けるのが防止される。このタンブリング処理の結果を図4及び5に示し、これら 図4及び5はブロックの両方の端部(素子及び封止部材)を示す。 次に、真空中でのスパッタリング(バレルスパッタリング)により、ブロック 全体をニッケル−クロミウム合金の核層で覆う。次の工程で端部コンタクトの形 態の電気的コンタクトが形成される予定の部分に例えばビーズワックスのマスク 層をコートする。核層のうちコートされなかった部分を適当なエッチング剤を用 いてエッチングにより除去する。例えば高温の水溶性石鹸溶液によりマスク層を 除去した後、部分の両端に電気的コンタクト及びハンダ層を形成する。 図6は、上述した方法により得られた両方の端部に核層7が形成されているブ ロックの線図的側面図である。これらの多数のブロックには、電着により1μm 程度の厚さの第1の銅層を同時に形成する。次に、電着処理中に、1μm程度の 厚さを有するニッケル層をその上に形成し、次に10μm程度の厚さのハンダ金 属(PbSn)をニッケル層上に被着する。得られたブロックを図7において側 面として図示し、ハンダ層が形成されている電気的端部コンタクトを符号8で示 す。このようにして、封止された単一層のキャパシタが得られる。 実施例2 単一層の抵抗器を実施例1で説明した方法で製造でき、実施例1との差異は、 電気的に絶縁性の誘電体層3の代わりに、薄膜技術により例えばクロミウム−ニ ッケル−シリコン合金の抵抗層を被着することである。 実施例3(図8〜10) 例えば30×40cmの寸法及び0.5mmの厚さを有するガラスの2個のプ レート10に、パターン形成された、300×300μmの表面形状の貫通孔及 び深さ150μmの空孔を形成する。これらの開口部は所望のパターンを有する 開口が形成されているマスクを用いてサンドブラスト処理により或いはエッチン グ剤を用いフォトリソグラフィ法により形成することができる。後者の場合、商 品名FOTURANとしてSCHOTT社から市販されているガラスの形式のも のを用いるのが極めて有益である。UV光をパターン照射した後、このガラスの 露光された領域をフッ化水素酸により選択的にエッチングすることができる。 次に、空孔が形成されているプレートの表面に銅の膜を形成する。電極層2は フォトリソグラフィ法によりこの銅層に形成され、次にこれら電極層に電気機械 処理により金層を形成する。次に、プレート10の凹部に例えば250×250 ×200μmの寸法のダイオード13を配置し、その後第2のプレートを第1の プレート上に設ける。この状態を図8のIV−IV線断面図である図9に示す。 ダイオードの端部コンタクトと両方のプレート10の表面上の金属箔との間で 良好な電気的接触を得るため、ダイオードと金属箔との間に微小な金片を挟むこ とができる。2個のプレート10は薄い接着層により又はガラスフリットにより 互いに結合する。次に、この本体を複数のブロックに分割し、これらブロックに 実施例1で説明した方法で端部コンタクト14及び15を形成する。図10は封 止されているダイオード13の断面図である。プレート10の封止部材の部分に 関して、この断面図は図8のX−X線断面である。 実施例4(図11〜16) 商品名FOTURANの厚さ0.6mmのガラスプレート16をマスクを介し てUV光で照射する。ガラスプレートの露光された部分のガラスを変換する熱処 理の後、0.3mmの直径を有する貫通孔16Aをフッ化水素の10%水溶液を 用いてエッチングにより形成する。次に、2個の対向する端部コンタクト17A 及び17Bが形成されている例えばダイオードの形態の素子17を開口16Aに 配置する。 例えば電気化学処理において、好ましくは同一のガラス組成の2個のカバープ レート18及び19の一方の側に薄い銅箔を形成する。次に、フォトリソグラフ ィ処理により、細条18A及び18Bをこれらの箔から形成する。これらの細条 には金層を電気化学的に形成する。次に、カバープレート18及び19を例えば エポキシド樹脂接着剤を用いて、それぞれ金属細条18A及び19Aを支持する 側部において支持プレート16に固定する。ダイオード17の端部コンタクト1 7A及び17Bと対応する金属細条18A及び19Bとの間の電気的接触を改善 するため、これらの間に微量の金(図示せず)を介在させることができる。 この方法の次の工程でブロックに分割した後、金属細条がブロックの種々の端 部において突出するようにカバープレート18及び19を支持プレート16に固 定する。この状態を図15に示し、図15はブロックに分割する前の本体の断面 図である。図11から図15において破線x,y及びzで示す分割線及び分割面 、及び図11から図14の破線a,b及びcで示す分割線及び分割面に互いに対 応する。次に、この本体は好ましくはソーイングにより複数のブロックに分割し 、その後実施例3で示した方法により端部コンタクトを形成する。図16は完成 した封止されたダイオード17の断面図である。図16の符号はそれ以前の図面 で用いた部材と同一の意義を有する。 実施例3及び4で図示したキャビティは矩形断面又は円形断面とする。一方、 本発明の範囲内において、三角形、伸長状のような種々の断面形状を有するキャ ビティを用いることができる。本例で示す伸長状の素子は2個の電気的端部又は ヘッドコンタクトを具える。電気回路又は電子回路に含まれることができ本発明 に基づいて共通の封止部材を設けることができる封止された素子、又は機能的に 等しい素子及び/又は機能的に異なる素子の組合せは、必要に応じて2個以上の コンタクトを具えることができる。 本発明による方法により製造された封止された素子は極めて高い寸法精度を発 揮する。この効果は、これらの素子が配置装置によりPCB上に配置される場合 、配置効率について積極的な効果となる。

Claims (1)

  1. 【特許請求の範囲】 1.電気的絶縁材料で封止された電気的、電子的又は電気機械的素子を製造する に際し、 (a)封止されるべき素子と電気的に接触するように表面に金属膜が被着され ている電気的絶縁材料のプレート上に又はこのプレートのキャビティ内に 素子を配置し、 (b)前記素子を配置した後、前記絶縁材料のプレートの一方の側、又は前記 素子が貫通孔内に位置する場合には両側を、前記素子を支持する電気的絶 縁材料のプレートに気密状に固定される電気的絶縁材料のプレートで覆い 、これにより前記素子を外界から封止し、 (c)分割線に沿って前記素子と電気的に接触するように作用する金属膜を切 断し、この本体を、それぞれ電気的絶縁材料で封止された素子から成る複 数のブロックに分割し、 (d)次に、これらブロックにハンダ付け可能な金属層の形態の2個又はそれ 以上の電気的コンタクトを形成し、この金属層は、必要な場合封止部材の 部分間で突出する金属膜と電気的に接触するように前記ブロックを十分に 取り囲み、前記金属膜が封止されている素子と電気的に接触するように作 用する ことを特徴とする電気的絶縁材料で封止されている素子の製造方法。 2.請求項1に記載の方法において、 (a)電気的絶縁材料の2個のプレートに同一のパターンにしたがって空孔を 形成し、これら空孔の結合深さ及び他の寸法を素子を収納するのに十分な ものとし、 (b)前記プレートに、前記キャビティの底部まで延在する金属膜の細条の形 態のパターン形成された電気的コンタクト層を形成し、 (c)プレートのキャビティに素子を配置し、 (d)前記他方のプレートを、キャビティが形成されている側が素子を支持す る側と対向するように、素子を支持するプレートに気密状に固定し、その 後、最終的な本体を、電気的コンタクトが形成されている複数のブロック に分割する ことを特徴とする方法。 3.請求項1に記載の方法において、 (a)電気的絶縁材料の支持プレートに貫通孔を形成し、 (b)前記に貫通孔に素子を配置し、 (c)前記支持プレートを、その両側において、金属細条のパターンが形成さ れているプレートで覆い、この金属細条は前記プレートを支持プレート上 に配置したとき素子と電気的に接触し、前記金属細条は、工程(d)にお いてブロックに分割した後、貫通孔内に素子を収容するブロックの部分の 互いに対向する側に位置する金属細条が封止部材の部分間においてブロッ クの対向する端部において突出するように配置し、前記本体を、電気的コ ンタクトが形成されているブロックに分割する ことを特徴とする方法。 4.請求項1から3までのいずれか1項に記載の方法において、 (a)前記ブロックのシャープな端縁を機械的手段により除去し、 (b)前記ブロックに金属の核層を形成し、 (c)前記ブロックの、その後の工程において金属層が形成される予定の部分 をマスキング層で覆い、 (d)マスキング層で覆われていない部分から金属の核層を除去し、 (e)前記マスキング層を除去し、 (f)露出した核層に金属層及びブロックを取り囲むハンダ層を形成する ことを特徴とする方法。 5.請求項1から4までのいずれか1項に記載の方法において、一度に1個の素 子を形成する代わりに、電気的コンタクトを有する共通の封止部材を具える電 気回路又は電子回路に含まれ又は含まれない機能的に等しい素子及び/又は機 能的に異なる素子の組合せを形成できることを特徴とする方法。 6.ガラス及び/又はセラミック材料の気密性封止部材中に埋設され、前記封止 部材が複数の部分から構成されると共に金属の電気的コンタクトが形成され、 この電気的コンタクトが、前記封止部材の側部を部分的に取り囲むと共に封止 部材の構成部分間に位置する金属膜を介して封止部材内に埋設された素子と電 気的に接触することを特徴とする封止された電気的、電子的又は電気機械的な 素子。 7.請求項6に記載の封止された素子において、前記封止部材間に位置し、素子 と電気的コンタクトとの間で電気接続を行うように作用するの金属膜が、封止 部材間でボンディング膜としても作用することを特徴とする封止された素子。 8.電気回路又は電子回路に含まれることができ又は含まれることのできない、 同一の素子又は機能的に異なる素子の封止された組合せにおいて、ガラス及び /又はセラミック材料の気密性封止部材中に埋設され、前記封止部材が複数の 部分から構成されると共に金属の電気的コンタクトが形成され、この電気的コ ンタクトが、前記封止部材の側部を部分的に取り囲むと共に封止部材の構成部 分間に位置する金属膜を介して封止部材内に埋設された回路の複数の素子の組 合せと電気的に接触することを特徴とする封止された素子の組合せ。 9.請求項8に記載の封止された素子の組合せにおいて、前記封止部材の部分間 に位置し、素子と電気的接続部との間で接触するように作用する金属膜が、前 記封止部材の部分間でボンディング膜として作用することを特徴とする封止さ れた素子の組合せ。
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US4079511A (en) * 1976-07-30 1978-03-21 Amp Incorporated Method for packaging hermetically sealed integrated circuit chips on lead frames
US4633573A (en) * 1982-10-12 1987-01-06 Aegis, Inc. Microcircuit package and sealing method
DE3539518A1 (de) * 1985-11-07 1987-05-14 Siemens Ag Anschlusselemente, insbesondere anschlussfahnen fuer auf traeger angeordnete umhuellte elektrische bauelemente, bauelementegruppen oder integrierte schaltungen, insbesondere oberflaechenwellenfilter
US4852250A (en) * 1988-01-19 1989-08-01 Microelectronics And Computer Technology Corporation Hermetically sealed package having an electronic component and method of making
DE3913066A1 (de) * 1989-04-21 1990-11-08 Schoppe & Faeser Gmbh Verfahren zur herstellung eines hermetisch dichten gehaeuses sowie nach diesem verfahren hergestelltes gehaeuse
FR2666190B1 (fr) * 1990-08-24 1996-07-12 Thomson Csf Procede et dispositif d'encapsulation hermetique de composants electroniques.

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