JP2000244332A - データ誤り訂正装置 - Google Patents
データ誤り訂正装置Info
- Publication number
- JP2000244332A JP2000244332A JP11042187A JP4218799A JP2000244332A JP 2000244332 A JP2000244332 A JP 2000244332A JP 11042187 A JP11042187 A JP 11042187A JP 4218799 A JP4218799 A JP 4218799A JP 2000244332 A JP2000244332 A JP 2000244332A
- Authority
- JP
- Japan
- Prior art keywords
- error correction
- syndrome calculation
- code
- data
- syndrome
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/03—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
- H03M13/05—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
- H03M13/13—Linear codes
- H03M13/15—Cyclic codes, i.e. cyclic shifts of codewords produce other codewords, e.g. codes defined by a generator polynomial, Bose-Chaudhuri-Hocquenghem [BCH] codes
- H03M13/159—Remainder calculation, e.g. for encoding and syndrome calculation
- H03M13/1595—Parallel or block-wise remainder calculation
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B02—CRUSHING, PULVERISING, OR DISINTEGRATING; PREPARATORY TREATMENT OF GRAIN FOR MILLING
- B02B—PREPARING GRAIN FOR MILLING; REFINING GRANULAR FRUIT TO COMMERCIAL PRODUCTS BY WORKING THE SURFACE
- B02B7/00—Auxiliary devices
- B02B7/02—Feeding or discharging devices
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B07—SEPARATING SOLIDS FROM SOLIDS; SORTING
- B07B—SEPARATING SOLIDS FROM SOLIDS BY SIEVING, SCREENING, SIFTING OR BY USING GAS CURRENTS; SEPARATING BY OTHER DRY METHODS APPLICABLE TO BULK MATERIAL, e.g. LOOSE ARTICLES FIT TO BE HANDLED LIKE BULK MATERIAL
- B07B13/00—Grading or sorting solid materials by dry methods, not otherwise provided for; Sorting articles otherwise than by indirectly controlled devices
- B07B13/08—Grading or sorting solid materials by dry methods, not otherwise provided for; Sorting articles otherwise than by indirectly controlled devices according to weight
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B07—SEPARATING SOLIDS FROM SOLIDS; SORTING
- B07B—SEPARATING SOLIDS FROM SOLIDS BY SIEVING, SCREENING, SIFTING OR BY USING GAS CURRENTS; SEPARATING BY OTHER DRY METHODS APPLICABLE TO BULK MATERIAL, e.g. LOOSE ARTICLES FIT TO BE HANDLED LIKE BULK MATERIAL
- B07B4/00—Separating solids from solids by subjecting their mixture to gas currents
- B07B4/02—Separating solids from solids by subjecting their mixture to gas currents while the mixtures fall
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/03—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
- H03M13/05—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
- H03M13/13—Linear codes
- H03M13/15—Cyclic codes, i.e. cyclic shifts of codewords produce other codewords, e.g. codes defined by a generator polynomial, Bose-Chaudhuri-Hocquenghem [BCH] codes
- H03M13/151—Cyclic codes, i.e. cyclic shifts of codewords produce other codewords, e.g. codes defined by a generator polynomial, Bose-Chaudhuri-Hocquenghem [BCH] codes using error location or error correction polynomials
- H03M13/1515—Reed-Solomon codes
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/03—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
- H03M13/05—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
- H03M13/13—Linear codes
- H03M13/15—Cyclic codes, i.e. cyclic shifts of codewords produce other codewords, e.g. codes defined by a generator polynomial, Bose-Chaudhuri-Hocquenghem [BCH] codes
- H03M13/151—Cyclic codes, i.e. cyclic shifts of codewords produce other codewords, e.g. codes defined by a generator polynomial, Bose-Chaudhuri-Hocquenghem [BCH] codes using error location or error correction polynomials
- H03M13/158—Finite field arithmetic processing
Landscapes
- Physics & Mathematics (AREA)
- Mathematical Physics (AREA)
- Algebra (AREA)
- General Physics & Mathematics (AREA)
- Pure & Applied Mathematics (AREA)
- Probability & Statistics with Applications (AREA)
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Error Detection And Correction (AREA)
- Detection And Correction Of Errors (AREA)
Abstract
(57)【要約】
【課題】 複数の誤り訂正符号によって、データの誤り
を訂正するデータ誤り訂正装置において、訂正能力の大
きい符号のシンドローム計算回路を有効に使用すること
で、訂正能力の小さな符号のシンドローム計算の並列処
理符号語数を大きくして、誤り訂正処理の高速化を実現
する。 【解決手段】 ガロア体の加算器140〜155、フリ
ップフロップ回路160〜175、およびガロア体の元
の第1定数乗算器180〜195により、8重誤り訂正
リードソロモン符号の1符号語のシンドロームを計算す
る16個のシンドローム計算回路が構成される。これら
の一部のシンドローム計算回路102〜115に、ガロ
ア体の元の第2定数乗算器200〜213と、第1定数
乗算器と第2定数乗算器を選択する選択回路222〜2
35とを付加して、1重誤り訂正リードソロモン符号を
8並列処理することのできるシンドローム計算回路10
0〜115が構成される。
を訂正するデータ誤り訂正装置において、訂正能力の大
きい符号のシンドローム計算回路を有効に使用すること
で、訂正能力の小さな符号のシンドローム計算の並列処
理符号語数を大きくして、誤り訂正処理の高速化を実現
する。 【解決手段】 ガロア体の加算器140〜155、フリ
ップフロップ回路160〜175、およびガロア体の元
の第1定数乗算器180〜195により、8重誤り訂正
リードソロモン符号の1符号語のシンドロームを計算す
る16個のシンドローム計算回路が構成される。これら
の一部のシンドローム計算回路102〜115に、ガロ
ア体の元の第2定数乗算器200〜213と、第1定数
乗算器と第2定数乗算器を選択する選択回路222〜2
35とを付加して、1重誤り訂正リードソロモン符号を
8並列処理することのできるシンドローム計算回路10
0〜115が構成される。
Description
【0001】
【発明の属する技術分野】本発明は、複数の誤り訂正符
号によってデータの誤りを訂正するデータ誤り訂正装置
に関する。
号によってデータの誤りを訂正するデータ誤り訂正装置
に関する。
【0002】
【従来の技術】データ処理システムの高信頼度化の一手
法として、データの誤りを訂正する誤り訂正符号がさま
ざまな機器において適用されている。特にリードソロモ
ン符号を含むBCH(Bose-Chaundhuri-Hocqenghen)符
号は、符号の効率が高いために重要な符号の一つとなっ
ている。リードソロモン符号は、原始多項式をW(z) と
し、W(z) =0の根をαとするとき、この根αを原始元
とするガロア体(Galoisfield)上の符号であって、ブ
ロック誤り訂正符号の1つである。
法として、データの誤りを訂正する誤り訂正符号がさま
ざまな機器において適用されている。特にリードソロモ
ン符号を含むBCH(Bose-Chaundhuri-Hocqenghen)符
号は、符号の効率が高いために重要な符号の一つとなっ
ている。リードソロモン符号は、原始多項式をW(z) と
し、W(z) =0の根をαとするとき、この根αを原始元
とするガロア体(Galoisfield)上の符号であって、ブ
ロック誤り訂正符号の1つである。
【0003】図3は、特開平5−55926号公報に記
載された誤り訂正装置の構成を示すブロック図である。
この誤り訂正装置は、入力データを記憶するデータメモ
リ72と、入力データに付加された多重誤り訂正符号の
シンドローム(Syndrome)を計算するシンドローム計算
回路76,78と、該シンドローム計算回路76,78
により計算されたシンドロームを記憶するシンドローム
メモリ80と、シンドロームメモリ80に記憶されるシ
ンドロームを読み出してデータメモリ72上の誤りデー
タを書き換える誤り検出訂正処理回路86とを有するも
のである。また、OR回路82は計算されたシンドロー
ムの全ビットの論理和をとり、その結果よりデータの誤
りの存在を示すフラグ情報としてフラグメモリ84に記
憶される。また、タイミング制御回路88は該誤り訂正
装置の動作タイミングを制御する。シンドローム計算回
路76,78は、加算器20,22,24,36,3
8,40、遅延器26,28,30,42,44,4
6,52,54,56、およびガロア体の元の定数乗算
器32,34,48,50からなり、入力データWi、
生成多項式の根をαm とすると、以下の式(1),
(2),(3)に従い、シンドロームS0,S1,S2
を計算する。
載された誤り訂正装置の構成を示すブロック図である。
この誤り訂正装置は、入力データを記憶するデータメモ
リ72と、入力データに付加された多重誤り訂正符号の
シンドローム(Syndrome)を計算するシンドローム計算
回路76,78と、該シンドローム計算回路76,78
により計算されたシンドロームを記憶するシンドローム
メモリ80と、シンドロームメモリ80に記憶されるシ
ンドロームを読み出してデータメモリ72上の誤りデー
タを書き換える誤り検出訂正処理回路86とを有するも
のである。また、OR回路82は計算されたシンドロー
ムの全ビットの論理和をとり、その結果よりデータの誤
りの存在を示すフラグ情報としてフラグメモリ84に記
憶される。また、タイミング制御回路88は該誤り訂正
装置の動作タイミングを制御する。シンドローム計算回
路76,78は、加算器20,22,24,36,3
8,40、遅延器26,28,30,42,44,4
6,52,54,56、およびガロア体の元の定数乗算
器32,34,48,50からなり、入力データWi、
生成多項式の根をαm とすると、以下の式(1),
(2),(3)に従い、シンドロームS0,S1,S2
を計算する。
【0004】
【数1】
【0005】そして、誤り検出処理回路86が、シンド
ロームメモリ80からシンドロームS0,S1,S2を
読み出し、少なくとも1つのシンドロームが“0”でな
い場合は、S0〜S2により誤りの位置及び大きさを算
出し、その結果によりデータメモリ72上の入力データ
中の誤ったデータを書き換える。
ロームメモリ80からシンドロームS0,S1,S2を
読み出し、少なくとも1つのシンドロームが“0”でな
い場合は、S0〜S2により誤りの位置及び大きさを算
出し、その結果によりデータメモリ72上の入力データ
中の誤ったデータを書き換える。
【0006】このように、上記誤り訂正装置によれば、
入力端子70から入力されたデータがデータメモリ72
に書き込まれると同時に、シンドローム計算回路76,
78にて該データに付加された誤り訂正符号のシンドロ
ームが計算され、このシンドロームの結果に基づいてデ
ータの誤りを訂正し、訂正されたデータは出力端子74
から出力されることとなる。
入力端子70から入力されたデータがデータメモリ72
に書き込まれると同時に、シンドローム計算回路76,
78にて該データに付加された誤り訂正符号のシンドロ
ームが計算され、このシンドロームの結果に基づいてデ
ータの誤りを訂正し、訂正されたデータは出力端子74
から出力されることとなる。
【0007】一般に、t(tは1以上の整数である。)
重誤り訂正BCH符号の誤り訂正処理を行う際、2t個
のシンドロームが計算される。例えば、デジタルオーデ
ィオテープレコーダ(DAT)では、データの誤りを訂
正するために、3重誤り訂正リードソロモン符号および
2重誤り訂正リードソロモン符号が付加されており、こ
の場合、1符号語に対して、3重誤り訂正リードソロモ
ン符号では6個のシンドロームが計算され、2重誤り訂
正リードソロモン符号では4個のシンドロームが計算さ
れる。
重誤り訂正BCH符号の誤り訂正処理を行う際、2t個
のシンドロームが計算される。例えば、デジタルオーデ
ィオテープレコーダ(DAT)では、データの誤りを訂
正するために、3重誤り訂正リードソロモン符号および
2重誤り訂正リードソロモン符号が付加されており、こ
の場合、1符号語に対して、3重誤り訂正リードソロモ
ン符号では6個のシンドロームが計算され、2重誤り訂
正リードソロモン符号では4個のシンドロームが計算さ
れる。
【0008】図2に、データ誤り訂正装置に用いられて
いる従来のシンドローム計算回路の構成図を示す。シン
ドローム計算回路は、図2に示すように、6個のシンド
ローム計算回路300〜305から構成されており、こ
れらシンドローム計算回路300〜305のそれぞれ
に、入力データの入力端子320〜325、ガロア体の
加算器340〜345、遅延器としてのフリップフロッ
プ回路360〜365、およびガロア体の元αの0乗
(以下「α^0」と表記する。)〜α^5を乗算する定
数乗算器380〜385を有するものである。そして、
これらシンドローム計算回路300〜305において
は、符号語の先頭データから順番に、各入力端子320
〜325へデータが入力されるたびに、フリップフロッ
プ回路360〜365の保持データを定数乗算器380
〜385にて定数乗算し、加算器340〜345にて該
定数乗算したデータと上記入力データとを加算し、該加
算器340〜345から出力されるデータで、上記フリ
ップフロップ回路360〜365の保持データを更新
し、これによって、誤り訂正符号のシンドロームが計算
される。例えば、3重誤り訂正リードソロモン符号は6
個のシンドロームが計算されるため、上記シンドローム
計算回路300〜305を用いて3重誤り訂正リードソ
ロモン符号のシンドロームを計算する場合には、6個の
シンドローム計算回路の全てを使用する。一方、2重誤
り訂正リードソロモン符号は4個のシンドロームが計算
されるため、上記シンドローム計算回路300〜305
を用いて2重誤り訂正リードソロモン符号のシンドロー
ムを計算する場合には、上記シンドローム計算回路30
0〜305のうち、訂正能力の小さい方のシンドローム
計算回路300〜303の4個だけを使用し、残りの2
個のシンドローム計算回路304,305による計算結
果は使用されない。
いる従来のシンドローム計算回路の構成図を示す。シン
ドローム計算回路は、図2に示すように、6個のシンド
ローム計算回路300〜305から構成されており、こ
れらシンドローム計算回路300〜305のそれぞれ
に、入力データの入力端子320〜325、ガロア体の
加算器340〜345、遅延器としてのフリップフロッ
プ回路360〜365、およびガロア体の元αの0乗
(以下「α^0」と表記する。)〜α^5を乗算する定
数乗算器380〜385を有するものである。そして、
これらシンドローム計算回路300〜305において
は、符号語の先頭データから順番に、各入力端子320
〜325へデータが入力されるたびに、フリップフロッ
プ回路360〜365の保持データを定数乗算器380
〜385にて定数乗算し、加算器340〜345にて該
定数乗算したデータと上記入力データとを加算し、該加
算器340〜345から出力されるデータで、上記フリ
ップフロップ回路360〜365の保持データを更新
し、これによって、誤り訂正符号のシンドロームが計算
される。例えば、3重誤り訂正リードソロモン符号は6
個のシンドロームが計算されるため、上記シンドローム
計算回路300〜305を用いて3重誤り訂正リードソ
ロモン符号のシンドロームを計算する場合には、6個の
シンドローム計算回路の全てを使用する。一方、2重誤
り訂正リードソロモン符号は4個のシンドロームが計算
されるため、上記シンドローム計算回路300〜305
を用いて2重誤り訂正リードソロモン符号のシンドロー
ムを計算する場合には、上記シンドローム計算回路30
0〜305のうち、訂正能力の小さい方のシンドローム
計算回路300〜303の4個だけを使用し、残りの2
個のシンドローム計算回路304,305による計算結
果は使用されない。
【0009】このように、上記のシンドローム計算回路
では、3重誤り訂正リードソロモン符号と2重誤り訂正
リードソロモン符号のような訂正能力の異なる符号のシ
ンドローム計算を共通のハードウエアで実現する。
では、3重誤り訂正リードソロモン符号と2重誤り訂正
リードソロモン符号のような訂正能力の異なる符号のシ
ンドローム計算を共通のハードウエアで実現する。
【0010】
【発明が解決しようとする課題】しかしながら、上記の
従来例では、訂正能力の異なる符号のシンドローム計算
を共通のハードウエアで実現するが、3重誤り訂正リー
ドソロモン符号と2重誤り訂正リードソロモン符号のよ
うに誤り訂正符号の訂正能力の差が小さいために、3重
誤り訂正リードソロモン符号のシンドローム計算の処理
符号語数と、2重誤り訂正リードソロモン符号のシンド
ローム計算の処理符号語数とを等しくせざるを得なかっ
た。すなわち、3重誤り訂正リードソロモン符号のシン
ドローム計算をする場合と、訂正能力の小さい2重誤り
訂正リードソロモン符号のシンドローム計算をする場合
とは、いずれも1回の処理で1符号語しか処理できない
ということである。特に、符号長が大きい場合や符号語
に誤りがない場合、シンドローム計算によって誤り訂正
装置の訂正速度が律速されるため、誤り訂正の高速化の
ためにはシンドローム計算の高効率化が望まれる。
従来例では、訂正能力の異なる符号のシンドローム計算
を共通のハードウエアで実現するが、3重誤り訂正リー
ドソロモン符号と2重誤り訂正リードソロモン符号のよ
うに誤り訂正符号の訂正能力の差が小さいために、3重
誤り訂正リードソロモン符号のシンドローム計算の処理
符号語数と、2重誤り訂正リードソロモン符号のシンド
ローム計算の処理符号語数とを等しくせざるを得なかっ
た。すなわち、3重誤り訂正リードソロモン符号のシン
ドローム計算をする場合と、訂正能力の小さい2重誤り
訂正リードソロモン符号のシンドローム計算をする場合
とは、いずれも1回の処理で1符号語しか処理できない
ということである。特に、符号長が大きい場合や符号語
に誤りがない場合、シンドローム計算によって誤り訂正
装置の訂正速度が律速されるため、誤り訂正の高速化の
ためにはシンドローム計算の高効率化が望まれる。
【0011】ところで、例えばDVD−ROM用データ
誤り訂正装置では、DVD−ROMのみならずCD−R
OMやCD−Rなどのデータを処理しなければならな
い。DVD−ROMには、8重誤り訂正リードソロモン
符号および5重誤り訂正リードソロモン符号が付加さ
れ、CD−ROMには1重誤り訂正リードソロモン符号
が付加されているため、訂正能力の大きく異なる誤り訂
正符号のシンドローム計算が必要とされる。この場合、
図2に示す上記のシンドローム計算回路では、DVD−
ROMのような訂正能力の大きい符号、例えば8重誤り
訂正リードソロモン符号では16個のシンドロームを計
算するので、この場合、シンドローム計算を行うために
16個のシンドローム計算回路を要する。従って、この
ようなシンドローム計算回路を有したデータ誤り訂正装
置では、上記DVD−ROMのような訂正能力の大きい
符号のシンドローム計算を行う16個のシンドローム計
算回路を用いて、CD−ROMのような訂正能力の小さ
な符号、例えば1重誤り訂正リードソロモン符号では2
個のシンドロームを計算するので、そのシンドローム計
算を行う際に、上記16個のシンドローム計算回路のう
ち2個しか使用されず、残りの14個のシンドローム計
算回路は使用されない。特に、訂正能力の大きく異なる
符号を共通のシンドローム計算回路で処理する場合、低
能力符号のシンドローム計算の際に未使用のシンドロー
ム計算回路が多く存在するため、シンドローム計算の効
率が悪く、その結果、データ誤り訂正の処理を高速化す
ることが困難となるという問題があった。
誤り訂正装置では、DVD−ROMのみならずCD−R
OMやCD−Rなどのデータを処理しなければならな
い。DVD−ROMには、8重誤り訂正リードソロモン
符号および5重誤り訂正リードソロモン符号が付加さ
れ、CD−ROMには1重誤り訂正リードソロモン符号
が付加されているため、訂正能力の大きく異なる誤り訂
正符号のシンドローム計算が必要とされる。この場合、
図2に示す上記のシンドローム計算回路では、DVD−
ROMのような訂正能力の大きい符号、例えば8重誤り
訂正リードソロモン符号では16個のシンドロームを計
算するので、この場合、シンドローム計算を行うために
16個のシンドローム計算回路を要する。従って、この
ようなシンドローム計算回路を有したデータ誤り訂正装
置では、上記DVD−ROMのような訂正能力の大きい
符号のシンドローム計算を行う16個のシンドローム計
算回路を用いて、CD−ROMのような訂正能力の小さ
な符号、例えば1重誤り訂正リードソロモン符号では2
個のシンドロームを計算するので、そのシンドローム計
算を行う際に、上記16個のシンドローム計算回路のう
ち2個しか使用されず、残りの14個のシンドローム計
算回路は使用されない。特に、訂正能力の大きく異なる
符号を共通のシンドローム計算回路で処理する場合、低
能力符号のシンドローム計算の際に未使用のシンドロー
ム計算回路が多く存在するため、シンドローム計算の効
率が悪く、その結果、データ誤り訂正の処理を高速化す
ることが困難となるという問題があった。
【0012】本発明は、上記課題に鑑みてなされたもの
であり、データ誤り訂正装置において、訂正能力の異な
る符号を処理する共通のシンドローム計算回路で、訂正
能力の小さな符号のシンドローム計算を並列処理できる
ように構成することによって誤り訂正処理の高速化を実
現するものである。
であり、データ誤り訂正装置において、訂正能力の異な
る符号を処理する共通のシンドローム計算回路で、訂正
能力の小さな符号のシンドローム計算を並列処理できる
ように構成することによって誤り訂正処理の高速化を実
現するものである。
【0013】
【課題を解決するための手段】本発明に係るデータ誤り
訂正装置は、2t(tは1以上の整数である。)重以上
のn(nは1以上の整数である。)重誤り訂正BCH符
号のシンドロームを計算するのに用いられる,ガロア体
の元を求める第1定数乗算器、該第1定数乗算器で求め
たデータと入力端子からの入力データとを加算する加算
器、該加算器からの加算データでその保持データを更新
する遅延器をそれぞれに有する2n個のシンドローム計
算回路を備え、2t重以上のn重誤り訂正BCH符号が
付加されたデータの誤り訂正処理を行うデータ誤り訂正
装置において、t重誤り訂正BCH符号が付加されたデ
ータの誤り訂正処理を行う場合に、該t重誤り訂正BC
H符号のシンドローム計算の並列処理符号語数が、上記
2t重以上のn重誤り訂正BCH符号のシンドローム計
算の処理符号語数の2倍以上となるよう,上記2n個の
シンドローム計算回路のうち訂正能力の小さい方の2t
個以外の任意の2t個以上のシンドローム計算回路は、
上記t重誤り訂正BCH符号のシンドロームを計算する
のに用いられる,ガロア体の元を求める第2定数乗算器
と、上記加算器との接続を上記第1定数乗算器から上記
第2定数乗算器に切り換える選択手段とを有することを
特徴とするものである。
訂正装置は、2t(tは1以上の整数である。)重以上
のn(nは1以上の整数である。)重誤り訂正BCH符
号のシンドロームを計算するのに用いられる,ガロア体
の元を求める第1定数乗算器、該第1定数乗算器で求め
たデータと入力端子からの入力データとを加算する加算
器、該加算器からの加算データでその保持データを更新
する遅延器をそれぞれに有する2n個のシンドローム計
算回路を備え、2t重以上のn重誤り訂正BCH符号が
付加されたデータの誤り訂正処理を行うデータ誤り訂正
装置において、t重誤り訂正BCH符号が付加されたデ
ータの誤り訂正処理を行う場合に、該t重誤り訂正BC
H符号のシンドローム計算の並列処理符号語数が、上記
2t重以上のn重誤り訂正BCH符号のシンドローム計
算の処理符号語数の2倍以上となるよう,上記2n個の
シンドローム計算回路のうち訂正能力の小さい方の2t
個以外の任意の2t個以上のシンドローム計算回路は、
上記t重誤り訂正BCH符号のシンドロームを計算する
のに用いられる,ガロア体の元を求める第2定数乗算器
と、上記加算器との接続を上記第1定数乗算器から上記
第2定数乗算器に切り換える選択手段とを有することを
特徴とするものである。
【0014】
【発明の実施の形態】図1に、本発明の一実施の形態に
よるデータ誤り訂正装置に用いられているシンドローム
計算回路の構成図を示す。本実施の形態では、DVD−
ROMの8重誤り訂正リードソロモン符号の1符号語に
対して16個のシンドローム計算回路を持つ場合に、C
D−ROMの1重誤り訂正リードソロモン符号の8符号
語を1回で並列処理する例を示している。すなわち、本
実施の形態におけるシンドローム計算回路は、図1に示
すように、DVD−ROMの8重誤り訂正リードソロモ
ン符号に対する16個のシンドローム計算回路100〜
115から構成されており、これらシンドローム計算回
路100〜115のそれぞれに、入力データの入力端子
120〜135、ガロア体の加算器140〜155、遅
延器としてのフリップフロップ回路160〜175、お
よびガロア体の元αの0乗(以下「α^0」と表記す
る。)〜α^15を乗算する第1定数乗算器180〜1
95を有するものである。
よるデータ誤り訂正装置に用いられているシンドローム
計算回路の構成図を示す。本実施の形態では、DVD−
ROMの8重誤り訂正リードソロモン符号の1符号語に
対して16個のシンドローム計算回路を持つ場合に、C
D−ROMの1重誤り訂正リードソロモン符号の8符号
語を1回で並列処理する例を示している。すなわち、本
実施の形態におけるシンドローム計算回路は、図1に示
すように、DVD−ROMの8重誤り訂正リードソロモ
ン符号に対する16個のシンドローム計算回路100〜
115から構成されており、これらシンドローム計算回
路100〜115のそれぞれに、入力データの入力端子
120〜135、ガロア体の加算器140〜155、遅
延器としてのフリップフロップ回路160〜175、お
よびガロア体の元αの0乗(以下「α^0」と表記す
る。)〜α^15を乗算する第1定数乗算器180〜1
95を有するものである。
【0015】また、本実施の形態におけるシンドローム
計算回路は、CD−ROMの1重誤り訂正リードソロモ
ン符号のシンドロームを並列処理できるようにするため
に、上記16個のシンドローム計算回路100〜115
のうち訂正能力の小さい方の2個(100と101)を
除いた残りのシンドローム計算回路102〜115のそ
れぞれに、上記CD−ROMの1重誤り訂正リードソロ
モン符号のシンドロームを計算するのに用いられる,ガ
ロア体の元α^0およびα^1を求める第2定数乗算器
200〜213と、上記加算器142〜155との接続
を上記第1定数乗算器182〜195から該第2定数乗
算器200〜213に切り換える選択回路222〜23
5とを有するものである。すなわち、新たにα^0を乗
算する第2定数乗算器200〜206およびα^1を乗
算する第2定数乗算器207〜213と、上記第1定数
乗算器と該第2定数乗算器とを選択する選択回路222
〜235を、各シンドローム計算回路102〜115に
付加し、これにより、8組の1重誤り訂正リードソロモ
ン符号のシンドローム計算回路100と101、102
と103、104と105、106と107、108と
109、110と111、112と113、114と1
15を構成する。
計算回路は、CD−ROMの1重誤り訂正リードソロモ
ン符号のシンドロームを並列処理できるようにするため
に、上記16個のシンドローム計算回路100〜115
のうち訂正能力の小さい方の2個(100と101)を
除いた残りのシンドローム計算回路102〜115のそ
れぞれに、上記CD−ROMの1重誤り訂正リードソロ
モン符号のシンドロームを計算するのに用いられる,ガ
ロア体の元α^0およびα^1を求める第2定数乗算器
200〜213と、上記加算器142〜155との接続
を上記第1定数乗算器182〜195から該第2定数乗
算器200〜213に切り換える選択回路222〜23
5とを有するものである。すなわち、新たにα^0を乗
算する第2定数乗算器200〜206およびα^1を乗
算する第2定数乗算器207〜213と、上記第1定数
乗算器と該第2定数乗算器とを選択する選択回路222
〜235を、各シンドローム計算回路102〜115に
付加し、これにより、8組の1重誤り訂正リードソロモ
ン符号のシンドローム計算回路100と101、102
と103、104と105、106と107、108と
109、110と111、112と113、114と1
15を構成する。
【0016】次に、上記シンドローム計算回路の動作を
説明する。DVD−ROMの8重誤り訂正リードソロモ
ン符号のシンドローム計算の場合、1符号語に対して1
6個のシンドロームを計算する。この場合、ガロア体の
元α^0〜α^15までを乗算するので、図1に示すシ
ンドローム計算回路102〜115における選択回路2
22〜235は、いずれも第1定数乗算器182〜19
5に接続される。そして、DVD−ROMの8重誤り訂
正リードソロモン符号の1符号語につき、その先頭デー
タから順番に、シンドローム計算回路100〜115の
各入力端子120〜135へデータが入力される。デー
タが各入力端子120〜135に入力されるたびに、フ
リップフロップ回路160〜175の保持データを第1
定数乗算器180〜195にて定数乗算し、加算器14
0〜155にて該定数乗算したデータと上記入力データ
とを加算し、該加算器140〜155から出力されるデ
ータで、上記フリップフロップ回路160〜175の保
持データを更新し、これによって、8重誤り訂正リード
ソロモン符号のシンドロームが計算されていく。なお、
シンドロームSの計算は、従来の技術で説明した計算式
(1)〜(3)に倣って計算され、ここではその詳細は
省略する。
説明する。DVD−ROMの8重誤り訂正リードソロモ
ン符号のシンドローム計算の場合、1符号語に対して1
6個のシンドロームを計算する。この場合、ガロア体の
元α^0〜α^15までを乗算するので、図1に示すシ
ンドローム計算回路102〜115における選択回路2
22〜235は、いずれも第1定数乗算器182〜19
5に接続される。そして、DVD−ROMの8重誤り訂
正リードソロモン符号の1符号語につき、その先頭デー
タから順番に、シンドローム計算回路100〜115の
各入力端子120〜135へデータが入力される。デー
タが各入力端子120〜135に入力されるたびに、フ
リップフロップ回路160〜175の保持データを第1
定数乗算器180〜195にて定数乗算し、加算器14
0〜155にて該定数乗算したデータと上記入力データ
とを加算し、該加算器140〜155から出力されるデ
ータで、上記フリップフロップ回路160〜175の保
持データを更新し、これによって、8重誤り訂正リード
ソロモン符号のシンドロームが計算されていく。なお、
シンドロームSの計算は、従来の技術で説明した計算式
(1)〜(3)に倣って計算され、ここではその詳細は
省略する。
【0017】一方、CD−ROMの1重誤り訂正リード
ソロモン符号のシンドローム計算の場合、1符号語に対
して2個のシンドロームを計算する。この場合、ガロア
体の元α^0とα^1を乗算するので、図1に示すシン
ドローム計算回路102〜115における選択手段22
2〜235は、いずれも第2定数乗算器200〜213
に接続される。そして、CD−ROMの1重誤り訂正リ
ードソロモン符号の第1の符号語はシンドローム計算回
路100と101で、第2の符号語はシンドローム計算
回路102と103で、第3の符号語はシンドローム計
算回路104と105で、第4の符号語はシンドローム
計算回路106と107で、第5の符号語はシンドロー
ム計算回路108と109で、第6の符号語はシンドロ
ーム計算回路110と111で、第7の符号語はシンド
ローム計算回路112と113で、第8の符号語はシン
ドローム計算回路114と115で、それぞれシンドロ
ーム計算される。これら第1〜第8の符号語につき、そ
の先頭データから順番に、シンドローム計算回路100
〜115の各入力端子120〜135へデータが入力さ
れる。入力データが各入力端子120〜135に入力さ
れるたびに、フリップフロップ回路160〜175の保
持データを第1定数乗算器180,181、第2定数乗
算器200〜213にて定数乗算し、加算器140〜1
55にて該定数乗算したデータと上記入力データとを加
算し、該加算器140〜155からの出力データで、上
記フリップフロップ160〜175の保持データを更新
し、これによって、1重誤り訂正リードソロモン符号の
シンドロームが計算される。
ソロモン符号のシンドローム計算の場合、1符号語に対
して2個のシンドロームを計算する。この場合、ガロア
体の元α^0とα^1を乗算するので、図1に示すシン
ドローム計算回路102〜115における選択手段22
2〜235は、いずれも第2定数乗算器200〜213
に接続される。そして、CD−ROMの1重誤り訂正リ
ードソロモン符号の第1の符号語はシンドローム計算回
路100と101で、第2の符号語はシンドローム計算
回路102と103で、第3の符号語はシンドローム計
算回路104と105で、第4の符号語はシンドローム
計算回路106と107で、第5の符号語はシンドロー
ム計算回路108と109で、第6の符号語はシンドロ
ーム計算回路110と111で、第7の符号語はシンド
ローム計算回路112と113で、第8の符号語はシン
ドローム計算回路114と115で、それぞれシンドロ
ーム計算される。これら第1〜第8の符号語につき、そ
の先頭データから順番に、シンドローム計算回路100
〜115の各入力端子120〜135へデータが入力さ
れる。入力データが各入力端子120〜135に入力さ
れるたびに、フリップフロップ回路160〜175の保
持データを第1定数乗算器180,181、第2定数乗
算器200〜213にて定数乗算し、加算器140〜1
55にて該定数乗算したデータと上記入力データとを加
算し、該加算器140〜155からの出力データで、上
記フリップフロップ160〜175の保持データを更新
し、これによって、1重誤り訂正リードソロモン符号の
シンドロームが計算される。
【0018】このように、1回のシンドローム計算処理
において、8重誤り訂正リードソロモン符号では1符号
語しか処理できないが、1重誤り訂正リードソロモン符
号のシンドロームを計算する場合は、8符号語を並列処
理することとなる。従って、1重誤り訂正リードソロモ
ン符号のシンドロームを計算する場合、8重誤り訂正リ
ードソロモン符号のシンドローム計算で使用されるシン
ドローム計算回路100〜115をすべて有効に使用し
て、1重誤り訂正リードソロモン符号のシンドローム計
算を8並列処理することができ、この結果、誤り訂正処
理を高速化することができるという効果がある。なお、
上記シンドローム計算回路100〜115は、例えば、
図3に示すデータ誤り訂正装置に組み込んで用いること
ができる。
において、8重誤り訂正リードソロモン符号では1符号
語しか処理できないが、1重誤り訂正リードソロモン符
号のシンドロームを計算する場合は、8符号語を並列処
理することとなる。従って、1重誤り訂正リードソロモ
ン符号のシンドロームを計算する場合、8重誤り訂正リ
ードソロモン符号のシンドローム計算で使用されるシン
ドローム計算回路100〜115をすべて有効に使用し
て、1重誤り訂正リードソロモン符号のシンドローム計
算を8並列処理することができ、この結果、誤り訂正処
理を高速化することができるという効果がある。なお、
上記シンドローム計算回路100〜115は、例えば、
図3に示すデータ誤り訂正装置に組み込んで用いること
ができる。
【0019】また、上記の実施の形態では、定数乗算器
の組み合わせとして、ガロア体の元α^15とα^1
(シンドローム計算回路115)、α^14とα^0
(シンドローム計算回路114)、α^13とα^1
(シンドローム計算回路113)、α^12とα^0
(シンドローム計算回路112)、α^11とα^1
(シンドローム計算回路111)、α^10とα^0
(シンドローム計算回路110)、α^9とα^1(シ
ンドローム計算回路109)、α^8とα^0(シンド
ローム計算回路108)、α^7とα^1(シンドロー
ム計算回路107)、α^6とα^0(シンドローム計
算回路106)、α^5とα^1(シンドローム計算回
路105)、α^4とα^0(シンドローム計算回路1
04)、α^3とα^1(シンドローム計算回路10
3)、およびα^2とα^0(シンドローム計算回路1
02)において、そのいずれかの定数乗算器を選択する
例を示しているが、本発明は、上記の例に限られるもの
ではなく任意に組合せてもよい。
の組み合わせとして、ガロア体の元α^15とα^1
(シンドローム計算回路115)、α^14とα^0
(シンドローム計算回路114)、α^13とα^1
(シンドローム計算回路113)、α^12とα^0
(シンドローム計算回路112)、α^11とα^1
(シンドローム計算回路111)、α^10とα^0
(シンドローム計算回路110)、α^9とα^1(シ
ンドローム計算回路109)、α^8とα^0(シンド
ローム計算回路108)、α^7とα^1(シンドロー
ム計算回路107)、α^6とα^0(シンドローム計
算回路106)、α^5とα^1(シンドローム計算回
路105)、α^4とα^0(シンドローム計算回路1
04)、α^3とα^1(シンドローム計算回路10
3)、およびα^2とα^0(シンドローム計算回路1
02)において、そのいずれかの定数乗算器を選択する
例を示しているが、本発明は、上記の例に限られるもの
ではなく任意に組合せてもよい。
【0020】また、上記の実施の形態では、シンドロー
ム計算回路100,101に第2定数乗算器と選択回路
とを有していない例を示しているが、本発明は、上記の
例に限られるものではなく、シンドローム計算回路10
0,101に第2定数乗算器と選択回路とを有する構成
としてもよい。
ム計算回路100,101に第2定数乗算器と選択回路
とを有していない例を示しているが、本発明は、上記の
例に限られるものではなく、シンドローム計算回路10
0,101に第2定数乗算器と選択回路とを有する構成
としてもよい。
【0021】また、上記の実施の形態では、訂正能力の
小さい符号の並列処理符号語数についても、訂正能力の
大きい符号のシンドローム計算回路をすべて使用する例
を示しているが、本発明は、訂正能力の小さい符号のシ
ンドローム計算を2並列以上で処理すれば誤り訂正処理
の高速化という目的は達成されるので、訂正能力の小さ
い符号のシンドローム計算において、訂正能力の大きい
符号のシンドローム計算回路をすべて使用することなく
2並列、3並列または4並列などで並列処理できるよう
にしてもよい。
小さい符号の並列処理符号語数についても、訂正能力の
大きい符号のシンドローム計算回路をすべて使用する例
を示しているが、本発明は、訂正能力の小さい符号のシ
ンドローム計算を2並列以上で処理すれば誤り訂正処理
の高速化という目的は達成されるので、訂正能力の小さ
い符号のシンドローム計算において、訂正能力の大きい
符号のシンドローム計算回路をすべて使用することなく
2並列、3並列または4並列などで並列処理できるよう
にしてもよい。
【0022】また、上記の実施の形態では、8重誤り訂
正符号と1重誤り訂正符号との2種類の能力の異なる誤
り訂正符号に対する例を示しているが、本発明は、例え
ば8重誤り訂正符号と2重誤り訂正符号と1重誤り訂正
符号などのように3種類またはそれ以上の能力の異なる
誤り訂正符号に対して、複数のガロア体の元の定数乗算
器と、これら複数の定数乗算器を選択する選択手段を持
つようにしてもよい。
正符号と1重誤り訂正符号との2種類の能力の異なる誤
り訂正符号に対する例を示しているが、本発明は、例え
ば8重誤り訂正符号と2重誤り訂正符号と1重誤り訂正
符号などのように3種類またはそれ以上の能力の異なる
誤り訂正符号に対して、複数のガロア体の元の定数乗算
器と、これら複数の定数乗算器を選択する選択手段を持
つようにしてもよい。
【0023】さらに、上記の実施の形態では、8重誤り
訂正符号と1重誤り訂正符号に対する例を示している
が、本発明は、例えば、8重誤り訂正符号と2重誤り訂
正符号、8重誤り訂正符号と3重誤り訂正符号、5重誤
り訂正符号と1重誤り訂正符号などのように任意の2種
またはそれ以上の能力の異なる誤り訂正符号に対して適
用できるように構成してもよい。
訂正符号と1重誤り訂正符号に対する例を示している
が、本発明は、例えば、8重誤り訂正符号と2重誤り訂
正符号、8重誤り訂正符号と3重誤り訂正符号、5重誤
り訂正符号と1重誤り訂正符号などのように任意の2種
またはそれ以上の能力の異なる誤り訂正符号に対して適
用できるように構成してもよい。
【0024】
【発明の効果】以上のように、本発明に係るデータ誤り
訂正装置よれば、t(tは1以上の整数である。)重誤
り訂正BCH符号が付加されたデータの誤り訂正処理を
行う場合に、該t重誤り訂正BCH符号のシンドローム
計算の並列処理符号語数が、2t重以上のn(nは1以
上の整数である。)重誤り訂正BCH符号のシンドロー
ム計算の処理符号語数の2倍以上となるよう,2n個の
シンドローム計算回路のうち訂正能力の小さい方の2t
個以外の任意の2t個以上のシンドローム計算回路は、
上記t重誤り訂正BCH符号のシンドロームを計算する
のに用いられる,ガロア体の元を求める第2定数乗算器
と、上記加算器との接続を上記第1定数乗算器から上記
第2定数乗算器に切り換える選択手段とを有し、これに
より、訂正能力の大きい2t重以上のn重誤り訂正BC
H符号のシンドローム計算回路を有効に使用すること
で、訂正能力の小さいt重誤り訂正BCH符号のシンド
ローム計算が高速化され、その結果、誤り訂正処理の高
速化が実現できるという効果を有する。
訂正装置よれば、t(tは1以上の整数である。)重誤
り訂正BCH符号が付加されたデータの誤り訂正処理を
行う場合に、該t重誤り訂正BCH符号のシンドローム
計算の並列処理符号語数が、2t重以上のn(nは1以
上の整数である。)重誤り訂正BCH符号のシンドロー
ム計算の処理符号語数の2倍以上となるよう,2n個の
シンドローム計算回路のうち訂正能力の小さい方の2t
個以外の任意の2t個以上のシンドローム計算回路は、
上記t重誤り訂正BCH符号のシンドロームを計算する
のに用いられる,ガロア体の元を求める第2定数乗算器
と、上記加算器との接続を上記第1定数乗算器から上記
第2定数乗算器に切り換える選択手段とを有し、これに
より、訂正能力の大きい2t重以上のn重誤り訂正BC
H符号のシンドローム計算回路を有効に使用すること
で、訂正能力の小さいt重誤り訂正BCH符号のシンド
ローム計算が高速化され、その結果、誤り訂正処理の高
速化が実現できるという効果を有する。
【図1】本発明の一実施の形態によるシンドローム計算
回路の構成図である。
回路の構成図である。
【図2】従来のシンドローム計算回路の構成図である。
【図3】従来のデータ誤り訂正装置の構成図である。
20,22,24,36,38,40:ガロア体の加算
器 26,28,30,42,44,46,52,54,5
6:遅延器 32,34,48,50:ガロア体の元の定数乗算器 70:入力端子 72:データメモリ 74:出力端子 76,78:シンドローム計算回路 80:シンドロームメモリ 82:OR回路 84:フラグメモリ 86:誤り検出訂正処理回路 88:タイミング制御回路 100〜115,300〜305:シンドローム計算回
路 120〜135,320〜325:入力端子 140〜155,340〜345:ガロア体の加算器 160〜175,360〜365:フリップフロップ回
路(遅延器) 180〜195:ガロア体の元の第1定数乗算器 200〜213:ガロア体の元の第2定数乗算器 222〜235:選択回路 380〜385:ガロア体の元の定数乗算器
器 26,28,30,42,44,46,52,54,5
6:遅延器 32,34,48,50:ガロア体の元の定数乗算器 70:入力端子 72:データメモリ 74:出力端子 76,78:シンドローム計算回路 80:シンドロームメモリ 82:OR回路 84:フラグメモリ 86:誤り検出訂正処理回路 88:タイミング制御回路 100〜115,300〜305:シンドローム計算回
路 120〜135,320〜325:入力端子 140〜155,340〜345:ガロア体の加算器 160〜175,360〜365:フリップフロップ回
路(遅延器) 180〜195:ガロア体の元の第1定数乗算器 200〜213:ガロア体の元の第2定数乗算器 222〜235:選択回路 380〜385:ガロア体の元の定数乗算器
───────────────────────────────────────────────────── フロントページの続き Fターム(参考) 5B001 AA11 AB02 AC01 AD04 AE02 5J065 AA01 AB01 AC03 AD11 AE06 AF01 AG02 AH02 AH04 AH06 AH20
Claims (1)
- 【請求項1】 2t(tは1以上の整数である。)重以
上のn(nは1以上の整数である。)重誤り訂正BCH
符号のシンドロームを計算するのに用いられる,ガロア
体の元を求める第1定数乗算器、該第1定数乗算器で求
めたデータと入力端子からの入力データとを加算する加
算器、該加算器からの加算データでその保持データを更
新する遅延器をそれぞれに有する2n個のシンドローム
計算回路を備え、2t重以上のn重誤り訂正BCH符号
が付加されたデータの誤り訂正処理を行うデータ誤り訂
正装置において、 t重誤り訂正BCH符号が付加されたデータの誤り訂正
処理を行う場合に、該t重誤り訂正BCH符号のシンド
ローム計算の並列処理符号語数が、上記2t重以上のn
重誤り訂正BCH符号のシンドローム計算の処理符号語
数の2倍以上となるよう,上記2n個のシンドローム計
算回路のうち訂正能力の小さい方の2t個以外の任意の
2t個以上のシンドローム計算回路は、 上記t重誤り訂正BCH符号のシンドロームを計算する
のに用いられる,ガロア体の元を求める第2定数乗算器
と、 上記加算器との接続を上記第1定数乗算器から上記第2
定数乗算器に切り換える選択手段とを有することを特徴
とするデータ誤り訂正装置。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11042187A JP2000244332A (ja) | 1999-02-19 | 1999-02-19 | データ誤り訂正装置 |
TW089102595A TW457418B (en) | 1999-02-19 | 2000-02-16 | Data error correction device |
CN001022466A CN1264032B (zh) | 1999-02-19 | 2000-02-18 | 数据错误纠正装置 |
KR1020000007723A KR100336234B1 (ko) | 1999-02-19 | 2000-02-18 | 데이터 오류 정정 장치 |
US09/506,319 US6470471B1 (en) | 1999-02-19 | 2000-02-18 | Data error correction apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11042187A JP2000244332A (ja) | 1999-02-19 | 1999-02-19 | データ誤り訂正装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2000244332A true JP2000244332A (ja) | 2000-09-08 |
Family
ID=12629012
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11042187A Pending JP2000244332A (ja) | 1999-02-19 | 1999-02-19 | データ誤り訂正装置 |
Country Status (5)
Country | Link |
---|---|
US (1) | US6470471B1 (ja) |
JP (1) | JP2000244332A (ja) |
KR (1) | KR100336234B1 (ja) |
CN (1) | CN1264032B (ja) |
TW (1) | TW457418B (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100386979B1 (ko) * | 2000-05-25 | 2003-06-09 | 주식회사데이콤 | 갈로아체상에서 비트 직렬 승산기의 병렬화 방법 및 이를이용한 직병렬 승산기 |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4095587B2 (ja) * | 2004-06-30 | 2008-06-04 | 株式会社東芝 | データ処理装置及びデータ処理方法 |
CN105227192B (zh) * | 2014-06-05 | 2018-12-21 | 深圳衡宇芯片科技有限公司 | 一种用于多模式bch码编码的方法及使用该方法的编码器 |
CN104950478B (zh) * | 2015-05-20 | 2017-08-01 | 吉林大学 | 一种基于有机聚合物材料的有源复合光波导及其制备方法 |
US10230399B2 (en) * | 2015-06-18 | 2019-03-12 | Altera Corporation | Circuitry and method for decomposable decoder |
CN106941356B (zh) * | 2016-01-04 | 2020-10-27 | 阿尔特拉公司 | 用于可分解的解码器的电路装置和方法 |
US11750223B2 (en) * | 2018-03-28 | 2023-09-05 | Maxlinear, Inc. | Low-power block code forward error correction decoder |
US20230089736A1 (en) * | 2021-09-21 | 2023-03-23 | Nvidia Corporation | Single-cycle byte correcting and multi-byte detecting error code |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5130990A (en) * | 1990-02-15 | 1992-07-14 | The United States Of America, As Represented By The Administrator, National Aeronautics And Space Administration | VLSI architecture for a Reed-Solomon decoder |
JPH0574066A (ja) * | 1991-02-28 | 1993-03-26 | Nec Home Electron Ltd | 誤り訂正方法 |
JPH0555926A (ja) | 1991-08-27 | 1993-03-05 | Canon Inc | 誤り訂正装置 |
US5699368A (en) * | 1994-03-25 | 1997-12-16 | Mitsubishi Denki Kabushiki Kaisha | Error-correcting encoder, error-correcting decoder, and data transmitting system with error-correcting codes |
US5912905A (en) * | 1994-03-25 | 1999-06-15 | Mitsubishi Denki Kabushiki Kaisha | Error-correcting encoder, error-correcting decoder and data transmitting system with error-correcting codes |
JPH10150367A (ja) * | 1996-11-15 | 1998-06-02 | Seiko Epson Corp | 誤り訂正装置 |
JP3863252B2 (ja) * | 1996-11-15 | 2006-12-27 | 富士通株式会社 | 誤り訂正方法、誤り訂正装置、データ読み出し装置、及び、データマッピング方法 |
-
1999
- 1999-02-19 JP JP11042187A patent/JP2000244332A/ja active Pending
-
2000
- 2000-02-16 TW TW089102595A patent/TW457418B/zh not_active IP Right Cessation
- 2000-02-18 US US09/506,319 patent/US6470471B1/en not_active Expired - Lifetime
- 2000-02-18 CN CN001022466A patent/CN1264032B/zh not_active Expired - Fee Related
- 2000-02-18 KR KR1020000007723A patent/KR100336234B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100386979B1 (ko) * | 2000-05-25 | 2003-06-09 | 주식회사데이콤 | 갈로아체상에서 비트 직렬 승산기의 병렬화 방법 및 이를이용한 직병렬 승산기 |
Also Published As
Publication number | Publication date |
---|---|
KR100336234B1 (ko) | 2002-05-09 |
TW457418B (en) | 2001-10-01 |
KR20000076689A (ko) | 2000-12-26 |
CN1264032A (zh) | 2000-08-23 |
US6470471B1 (en) | 2002-10-22 |
CN1264032B (zh) | 2010-05-26 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5170399A (en) | Reed-Solomon Euclid algorithm decoder having a process configurable Euclid stack | |
US7406651B2 (en) | Forward Chien search type Reed-Solomon decoder circuit | |
JP3176171B2 (ja) | 誤り訂正方法及びその装置 | |
EP0836285B1 (en) | Reed-Solomon decoder with general-purpose processing unit and dedicated circuits | |
JP2000244332A (ja) | データ誤り訂正装置 | |
JP3281387B2 (ja) | Crc/edcチェッカシステム | |
EP1502356A2 (en) | A method of soft-decision decoding of reed-solomon codes | |
JP2001127645A (ja) | 誤り訂正方法および誤り訂正装置 | |
JP3248098B2 (ja) | シンドローム計算装置 | |
JP2605966B2 (ja) | 誤り訂正回路 | |
JP2810397B2 (ja) | 誤り訂正装置 | |
JP2662472B2 (ja) | 誤り訂正処理用シンドローム演算回路 | |
JP3614978B2 (ja) | ガロア体の除算方法および除算装置 | |
JP3233502B2 (ja) | 復号化装置 | |
US20010023497A1 (en) | Parallel processing reed-solomon encoding circuit and method | |
JP2718481B2 (ja) | ロングディスタンスコードの誤り訂正装置 | |
JP2000295116A (ja) | 誤り修正符号化方法 | |
JP2907138B2 (ja) | 誤り訂正の演算処理方法及び処理回路 | |
JP2725598B2 (ja) | 誤り訂正符号化器 | |
JPS6355815B2 (ja) | ||
JP2600683B2 (ja) | リード・ソロモン符号の復号方法 | |
JPH09162753A (ja) | 符号語の復号方式 | |
JP2534563B2 (ja) | 許容誤り逐次訂正回路 | |
JPS6345923A (ja) | シンドロ−ム計算回路 | |
JP2002009630A (ja) | ガロア体ユークリッド互除演算装置 |