JP2000244299A - スイッチ装置 - Google Patents
スイッチ装置Info
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- JP2000244299A JP2000244299A JP11039854A JP3985499A JP2000244299A JP 2000244299 A JP2000244299 A JP 2000244299A JP 11039854 A JP11039854 A JP 11039854A JP 3985499 A JP3985499 A JP 3985499A JP 2000244299 A JP2000244299 A JP 2000244299A
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Abstract
き、第2の制御端子5にローレベルが供給され、MOS
トランジスタM1とM2はオンし、コンデンサCに入力
電圧の電荷を蓄積する。このとき、帰還回路31は不動
作状態となっている。入力端子1に入力電圧が供給され
なくなった時、第2の制御端子5にハイレベルが供給さ
れ、MOSトランジスタM1とM2はオフし、帰還回路
31は動作状態になる。この結果、 MOSトランジス
タM1およびM2のゲート、ソース、ドレイン電圧は、
帰還回路31を介してほぼ同電位となり、トンネル電流
は発生しない。
Description
れるスイッチ装置、特にサンプルホールド回路などのス
イッチ装置に関する。
す。
されると、MOSトランジスタM1およびM2はオン
し、コンデンサCに入力端子101に供給される入力電
圧の電荷を蓄積する。
されると、MOSトランジスタM1およびM2はオフす
る。このとき入力端子101には、入力電圧は供給され
ない。そしてコンデンサCは、蓄積した電荷を保持する
ことになっている。
1およびM2がオンからオフに変化すると、図5に示す
如く、PチャンネルのMOSトランジスタM2のゲート
とソース間に逆バイアスがかかり、空乏層にかかる電界
が強くなって、ソースSからバックゲートにトンネル電
流(Band To Band Leak)が流れる。
このため、コンデンサCに貯えられている電荷が減少す
るという欠点があった。
To Band Leak)の発生を防止可能なスイ
ッチ装置を提供することを目的とする。
は、第1の電極が入力端子に接続され、第2の電極が出
力端子に接続された第1のMOSトランジスタと、第1
の電極が前記入力端子に接続され、第2の電極が前記出
力端子に接続された前記第1のMOSトランジスタと異
なるチャンネルの第2のMOSトランジスタと、前記第
1および第2のMOSトランジスタの動作を制御するた
めに前記入力端子に接続された制御端子と、一方の端子
が前記第1のMOSトランジスタのゲートに接続され、
他方の端子が第1の電圧源に接続された第1のスイッチ
回路と、一方の端子が前記第1のMOSトランジスタの
ゲートに接続され、他方の端子が前記制御端子に接続さ
れた第2のスイッチ回路と、一方の端子が前記第2のM
OSトランジスタのゲートに接続され、他方の端子が第
2の電圧源に接続された第3のスイッチ回路と、一方の
端子が前記第2のMOSトランジスタのゲートに接続さ
れ、他方の端子が前記制御端子に接続された第4のスイ
ッチ回路と、前記出力端子に接続されたコンデンサと、
前記出力端子に接続され、前記第1および第2のMOS
トランジスタがオフの場合に動作する帰還回路を具備し
たことを特徴とする。
一実施の形態の構成を示す。
例えばソースとPチャンネルのMOSトランジスタM2
の例えばソースが、入力端子1に接続されている。MO
SトランジスタM1およびM2のドレインが、出力端子
7に接続されている。このMOSトランジスタM1およ
びM2で、入出力間スイッチ回路9を構成する。
MOSトランジスタM1のゲートに接続され、他方の端
子は、電圧源VCC(第1の電圧源)に接続されてい
る。
MOSトランジスタM1のゲートに接続され、他方の端
子は、第1の制御端子3に接続されている。
MOSトランジスタM2のゲートに接続され、他方の端
子は、グランド(第2の電圧源)に接地されている。
MOSトランジスタM2のゲートに接続され、他方の端
子は、第1の接続端子に接続されている。
れ、MOSトランジスタM1およびM2のオン、オフ動
作を制御するためのものである。
して、第1および第3のスイッチ回路11、15の制御
端子に接続されている。更に第2の制御端子5は、直列
接続されたインバータ19および21を介して、第2お
よび第4のスイッチ回路13、17の制御端子に接続さ
れている。
サCが接続されている。出力端子7に、帰還回路31が
接続されている。帰還回路31は、MOSトランジスタ
M1およびM2がオフのとき、動作状態になり、コンデ
ンサCと入力端子1を接続する。帰還回路31の出力
が、スイッチ装置の出力となる。
17の一回路図を、図2(a)乃至図2(d)に示す。
また帰還回路31の一回路図を、図3に示す。
第2の制御端子5に、ローレベルの信号が供給される。
このとき、第1と第3のスイッチ回路11、15がオン
となり、第2と第4のスイッチ回路13、17がオフと
なる。
ト電圧は、電源電圧VCCとなり、MOSトランジスタ
M2のゲート電圧は、グランド電圧となり、MOSトラ
ンジスタM1およびM2は、オンする。これにより、コ
ンデンサCに入力端子1に供給される入力電圧の電荷を
蓄積する。このとき、帰還回路31は、不動作状態であ
る(図3のスイッチ回路はオフ)。
たとき、第2の制御端子5に、ハイレベルの信号が供給
される。このとき、第1と第3のスイッチ回路11、1
5がオフとなり、第2と第4のスイッチ回路13、17
がオンとなる。このとき、帰還回路31は、動作状態と
なっている(図3のスイッチ回路はオン)。
M2のゲート、ソース、ドレイン電圧は、帰還回路31
を介してほぼ同電位となり、トンネル電流は発生しな
い。
ンネル電流(Band To Band Leak)を
発生しない。
示す図である。
7の一回路図である。
に、トンネル電流が流れる状態を示す図である。
・・PチャンネルのMOSトランジスタ、9・・・入出
力間スイッチ回路、11・・・第1のスイッチ回路、1
3・・・第2のスイッチ回路、15・・・第3のスイッ
チ回路、17・・・第4のスイッチ回路、C・・・コン
デンサ、31・・・帰還回路。
Claims (2)
- 【請求項1】 第1の電極が入力端子に接続され、第2
の電極が出力端子に接続された第1のMOSトランジス
タと、 第1の電極が前記入力端子に接続され、第2の電極が前
記出力端子に接続された前記第1のMOSトランジスタ
と異なるチャンネルの第2のMOSトランジスタと、 前記第1および第2のMOSトランジスタの動作を制御
するために前記入力端子に接続された制御端子と、 一方の端子が前記第1のMOSトランジスタのゲートに
接続され、他方の端子が第1の電圧源に接続された第1
のスイッチ回路と、 一方の端子が前記第1のMOSトランジスタのゲートに
接続され、他方の端子が前記制御端子に接続された第2
のスイッチ回路と、 一方の端子が前記第2のMOSトランジスタのゲートに
接続され、他方の端子が第2の電圧源に接続された第3
のスイッチ回路と、 一方の端子が前記第2のMOSトランジスタのゲートに
接続され、他方の端子が前記制御端子に接続された第4
のスイッチ回路と、 前記出力端子に接続されたコンデンサと、 前記出力端子に接続され、前記第1および第2のMOS
トランジスタがオフの場合に動作する帰還回路を具備し
たことを特徴とするスイッチ装置。 - 【請求項2】 前記第1および第3のスイッチ回路が同
時にオンしたとき、前記第2および第4のスイッチ回路
が同時にオフし、前記第1および第3のスイッチ回路が
同時にオフしたとき、前記第2および第4のスイッチ回
路が同時にオンすることを特徴とする請求項1に記載の
スイッチ装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP03985499A JP3764597B2 (ja) | 1999-02-18 | 1999-02-18 | スイッチ装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP03985499A JP3764597B2 (ja) | 1999-02-18 | 1999-02-18 | スイッチ装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000244299A true JP2000244299A (ja) | 2000-09-08 |
JP3764597B2 JP3764597B2 (ja) | 2006-04-12 |
Family
ID=12564566
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP03985499A Expired - Fee Related JP3764597B2 (ja) | 1999-02-18 | 1999-02-18 | スイッチ装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3764597B2 (ja) |
-
1999
- 1999-02-18 JP JP03985499A patent/JP3764597B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP3764597B2 (ja) | 2006-04-12 |
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