JP2000174786A5 - - Google Patents
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Description
【請求項１】リクエストパケットを生成する処理装置と、
シリアルバスに接続され、上記リクエストパケットを上記シリアルバスに送信して確認信号待ち状態となる送信装置と、
上記シリアルバスに接続され、上記リクエストパケットに対する応答である第１の確認信号又は第２の確認信号とレスポンスパケットを上記シリアルバスから受信し、上記第１又は第２の確認信号を上記送信装置に出力し、上記レスポンスパケットを上記処理装置に出力する受信装置と、
上記リクエストパケットに含まれるリクエストパケットを特定するための送信情報を記憶する送信情報記憶手段と、
上記送信情報と送信結果又は上記レスポンスパケットに含まれるレスポンスパケットを特定するための受信情報とレスポンスパケットの応答状態を示す状態通知情報とを記憶する受信結果記憶手段と、
を有し、
上記送信装置は、上記リクエストパケットを送信する際に上記送信情報を上記送信情報記憶手段に出力し、上記確認信号が上記第１の確認信号である場合には上記送信情報及び当該第１の確認信号が示す送信結果を上記受信結果記憶手段に出力して新たなリクエストパケットを送信可能な状態になり、
上記処理装置は、上記送信情報記憶手段に記憶されている上記送信情報と上記受信結果記憶手段に記憶されている上記送信情報及び上記送信結果に基づいて上記リクエストパケットの送信による一連の処理が正常に行なわれたか否かを判断するデータ処理装置。
シリアルバスに接続され、上記リクエストパケットを上記シリアルバスに送信して確認信号待ち状態となる送信装置と、
上記シリアルバスに接続され、上記リクエストパケットに対する応答である第１の確認信号又は第２の確認信号とレスポンスパケットを上記シリアルバスから受信し、上記第１又は第２の確認信号を上記送信装置に出力し、上記レスポンスパケットを上記処理装置に出力する受信装置と、
上記リクエストパケットに含まれるリクエストパケットを特定するための送信情報を記憶する送信情報記憶手段と、
上記送信情報と送信結果又は上記レスポンスパケットに含まれるレスポンスパケットを特定するための受信情報とレスポンスパケットの応答状態を示す状態通知情報とを記憶する受信結果記憶手段と、
を有し、
上記送信装置は、上記リクエストパケットを送信する際に上記送信情報を上記送信情報記憶手段に出力し、上記確認信号が上記第１の確認信号である場合には上記送信情報及び当該第１の確認信号が示す送信結果を上記受信結果記憶手段に出力して新たなリクエストパケットを送信可能な状態になり、
上記処理装置は、上記送信情報記憶手段に記憶されている上記送信情報と上記受信結果記憶手段に記憶されている上記送信情報及び上記送信結果に基づいて上記リクエストパケットの送信による一連の処理が正常に行なわれたか否かを判断するデータ処理装置。
【００２３】
【課題を解決するための手段】
上記課題を解決するために、本発明の請求項１に記載のデータ処理装置は、リクエストパケットを生成する処理装置と、シリアルバスに接続され、上記リクエストパケットを上記シリアルバスに送信して確認信号待ち状態となる送信装置と、上記シリアルバスに接続され、上記リクエストパケットに対する応答である第１の確認信号又は第２の確認信号とレスポンスパケットを上記シリアルバスから受信し、上記第１又は第２の確認信号を上記送信装置に出力し、上記レスポンスパケットを上記処理装置に出力する受信装置と、上記リクエストパケットに含まれるリクエストパケットを特定するための送信情報を記憶する送信情報記憶手段と、上記送信情報と送信結果又は上記レスポンスパケットに含まれるレスポンスパケットを特定するための受信情報とレスポンスパケットの応答状態を示す状態通知情報とを記憶する受信結果記憶手段とを有し、上記送信装置は、上記リクエストパケットを送信する際に上記送信情報を上記送信情報記憶手段に出力し、上記確認信号が上記第１の確認信号である場合には上記送信情報及び当該第１の確認信号が示す送信結果を上記受信結果記憶手段に出力して新たなリクエストパケットを送信可能な状態になり、上記処理装置は、上記送信情報記憶手段に記憶されている上記送信情報と上記受信結果記憶手段に記憶されている上記送信情報及び上記送信結果に基づいて上記リクエストパケットの送信による一連の処理が正常に行なわれたか否かを判断する。
【課題を解決するための手段】
上記課題を解決するために、本発明の請求項１に記載のデータ処理装置は、リクエストパケットを生成する処理装置と、シリアルバスに接続され、上記リクエストパケットを上記シリアルバスに送信して確認信号待ち状態となる送信装置と、上記シリアルバスに接続され、上記リクエストパケットに対する応答である第１の確認信号又は第２の確認信号とレスポンスパケットを上記シリアルバスから受信し、上記第１又は第２の確認信号を上記送信装置に出力し、上記レスポンスパケットを上記処理装置に出力する受信装置と、上記リクエストパケットに含まれるリクエストパケットを特定するための送信情報を記憶する送信情報記憶手段と、上記送信情報と送信結果又は上記レスポンスパケットに含まれるレスポンスパケットを特定するための受信情報とレスポンスパケットの応答状態を示す状態通知情報とを記憶する受信結果記憶手段とを有し、上記送信装置は、上記リクエストパケットを送信する際に上記送信情報を上記送信情報記憶手段に出力し、上記確認信号が上記第１の確認信号である場合には上記送信情報及び当該第１の確認信号が示す送信結果を上記受信結果記憶手段に出力して新たなリクエストパケットを送信可能な状態になり、上記処理装置は、上記送信情報記憶手段に記憶されている上記送信情報と上記受信結果記憶手段に記憶されている上記送信情報及び上記送信結果に基づいて上記リクエストパケットの送信による一連の処理が正常に行なわれたか否かを判断する。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35081198A JP4112717B2 (ja) | 1998-12-10 | 1998-12-10 | データ処理装置 |
| US09/458,595 US6604154B1 (en) | 1998-12-10 | 1999-12-10 | Data processing device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35081198A JP4112717B2 (ja) | 1998-12-10 | 1998-12-10 | データ処理装置 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2000174786A JP2000174786A (ja) | 2000-06-23 |
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| JP4112717B2 JP4112717B2 (ja) | 2008-07-02 |
Family
ID=18413044
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP35081198A Expired - Fee Related JP4112717B2 (ja) | 1998-12-10 | 1998-12-10 | データ処理装置 |
Country Status (2)
| Country | Link |
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| US5961623A (en) * | 1996-08-29 | 1999-10-05 | Apple Computer, Inc. | Method and system for avoiding starvation and deadlocks in a split-response interconnect of a computer system |
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1998
- 1998-12-10 JP JP35081198A patent/JP4112717B2/ja not_active Expired - Fee Related
-
1999
- 1999-12-10 US US09/458,595 patent/US6604154B1/en not_active Expired - Lifetime
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