JP2000124216A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JP2000124216A JP10290539A JP29053998A JP2000124216A JP 2000124216 A JP2000124216 A JP 2000124216A JP 10290539 A JP10290539 A JP 10290539A JP 29053998 A JP29053998 A JP 29053998A JP 2000124216 A JP2000124216 A JP 2000124216A
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Abstract

(57)【要約】 (修正有) 【課題】CMP(化学的・機械的研磨)により銅配線層
を形成する場合に、CMP後に銅配線層が界面から剥が
れてしまうことがない半導体装置の製造方法を提供す
る。 【解決手段】定盤上に固定された研磨パッド上にウェハ
ーを置き、ウェハーの表面に形成された金属配線に化学
的機械的研磨を施し、ダマシン配線を形成する過程を含
む半導体装置の製造方法において、下地酸化膜11に溝
を形成する溝形成過程(B)と、溝の内面をバリア膜1
3で覆うバリア膜形成過程(C)と、銅膜14で前記溝
を埋め込む銅成膜過程(D)と、無機スラリーを用い、
研磨荷重が140g/cm以下、ウェハー中央点にお
ける線速度が0.1m/s以下の研磨条件の下に、銅膜
を研磨する研磨過程(E)と、を備える。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、LSIなどの半導
体装置の製造方法に関し、特に、半導体装置の製造工程
における化学的機械的研磨に関する。
【0002】
【従来の技術】近年のLSIの高集積化に伴い、より高
度な微細加工技術に対する要求が高まっている。特に、
現在では、配線パターンの最小加工寸法はサブミクロン
のオーダーに突入しており、微細化技術に対する要求は
年々高まっている。
【0003】このような要求に対して開発された技術の
一つが化学的機械的研磨(Chemical Mech
anical Polishing:以下、単に「CM
P」と呼ぶ)がある。現在では、このCMPは、例え
ば、層間絶縁膜の平坦化、ビアホール内のプラグの形
成、埋め込み金属配線の形成などに欠かせない技術とな
っている。
【0004】図4(A)−(E)に、CMPを用いて、
埋め込み金属配線を形成する場合の各過程を示す。
【0005】先ず、図4(A)に示すように、半導体基
板40上に絶縁膜41を形成した後、絶縁膜41の表面
を平坦化する。
【0006】次いで、図4(B)に示すように、フォト
リソグラフィー及びエッチングにより、絶縁膜41に複
数の配線形成用の溝42を形成する。
【0007】次いで、図4(C)に示すように、バリア
メタル膜43を全面に形成する。
【0008】この後、図4(D)に示すように、バリア
メタル膜43上に配線用金属膜44を堆積させる。
【0009】次いで、配線用金属膜44に対してCMP
を施し、図4(E)に示すように、各溝42の内部にの
み、配線用金属膜44を残す。
【0010】このようにして、金属膜44からなる配線
層が形成される。
【0011】図5(A)には、金属膜44として銅を選
定した場合の配線層の形成過程が示されている。 先
ず、下地酸化膜としての二酸化シリコン膜51に溝52
を形成する。次いで、バリア膜としてTiN膜53を全
面に形成する。
【0012】続いて、銅膜54をメッキ法で成膜し、溝
52を埋め込む。
【0013】次いで、アルミナ粒子と、酸化剤としての
過酸化水素水との混合物からなるスラリーで銅膜54を
研磨する。
【0014】そのときの研磨条件は、一般的には、研磨
荷重490g/cm2、ウェハー中心点における線速度
が0.2m/sである。
【0015】
【発明が解決しようとする課題】しかしながら、上記の
ような研磨条件で銅膜54にCMPを施すと、研磨荷重
が大きく、かつ、線速度も大きいため、銅膜54に機械
的な力が作用し、CMP後において、図5(B)に示す
ように、銅膜54がバリア膜53との界面から剥がれる
ことがある。
【0016】CMP技術については、これまでに、例え
ば、特開平7−86216号公報、同7−193034
号公報、同9−22907号公報、同9−213699
号公報、特許第2728025号公報(特開平8−28
8389号公報)などにおいて、多くの提案がなされて
いる。
【0017】このうち、例えば、特開平7−86216
号公報は、有機高分子化合物からなる粒子を研磨粒子と
して用い、研磨後に残留スラリーを燃焼させ、除去する
方法を提案している。この方法において用いられる研磨
粒子の形状は球形であるため、被研磨膜に傷が付くこと
はない。この方法における研磨条件は回転数100rp
m、荷重300gf/cm2である。なお、回転数10
0rpmは線速度に換算すれば、0.5m/sである。
【0018】また、特開平同9−213699号公報
は、選択CVD法により金属アルミニウムを溝に埋め込
み、この金属アルミニウムに化学的機械的研磨(CM
P)を施し、多層配線を形成する方法を提案している。
アルミニウム配線を形成するための研磨条件は、定盤回
転数が30乃至60rpm、荷重が2乃至8psiであ
る。なお、30乃至60rpmは線速度に換算すれば、
0.15乃至0.3m/sであり、2乃至8psiは1
40乃至560gf/cm2である。 これら二つの公
報に提案されているCMPにおける研磨条件において
も、研磨荷重が大きく、かつ、線速度も大きいため、図
5(B)に示した場合と同様に、銅配線に機械的な応力
が作用し、CMP後において、銅配線が剥がれてしまう
ことを避けることはできなかった。
【0019】本発明は、以上のような従来のCMPにお
ける問題点に鑑みてなされたものであり、CMP後にお
いて、銅配線が剥がれてしまうことがない半導体装置の
製造方法を提供することを目的とする。
【0020】
【課題を解決するための手段】この目的を達成するた
め、本発明のうち、請求項1は、定盤上に固定された研
磨パッド上にウェハーを置き、該ウェハーの表面に形成
された金属配線に化学的機械的研磨を施し、ダマシン配
線を形成する過程を含む半導体装置の製造方法におい
て、銅配線をウェハー中央の線速度が0.1m/s以下
であるような研磨条件で研磨する過程を備えることを特
徴とする半導体装置の製造方法を提供する。
【0021】請求項2は、定盤上に固定された研磨パッ
ド上にウェハーを置き、該ウェハーの表面に形成された
金属配線に化学的機械的研磨を施し、ダマシン配線を形
成する過程を含む半導体装置の製造方法において、下地
酸化膜に溝を形成する溝形成過程と、溝の内面をバリア
膜で覆うバリア膜形成過程と、銅膜で溝を埋め込む銅成
膜過程と、無機スラリーを用い、研磨荷重が140g/
cm2以下、ウェハー中心点における線速度が0.1m
/s以下の研磨条件の下に、銅膜を研磨する研磨過程
と、を備えることを半導体装置の製造方法を提供する。
【0022】請求項3は、定盤上に固定された研磨パッ
ド上にウェハーを置き、該ウェハーの表面に形成された
金属配線に化学的機械的研磨を施し、ダマシン配線を形
成する過程を含む半導体装置の製造方法において、下地
酸化膜に溝を形成する溝形成過程と、銅膜で溝を埋め込
む銅成膜過程と、無機スラリーを用い、研磨荷重が14
0g/cm2以下、ウェハー中心点における線速度が
0.1m/s以下の研磨条件の下に、銅膜を研磨する研
磨過程と、を備えることを半導体装置の製造方法を提供
する。
【0023】請求項3に係る方法においては、請求項4
に記載されているように、溝形成過程後であって銅成膜
過程前に、下地酸化膜をプラズマ処理する過程を含むこ
とが好ましい。
【0024】また、請求項5に記載されているように、
裏面荷重は研磨荷重の80%以下に設定されることが好
ましい。
【0025】請求項6に記載されているように、上述の
方法における銅成膜過程は、第一の厚さを有する銅のシ
ード層を形成する過程と、第一の厚さよりも大きい第二
の厚さを有する銅膜を成膜する過程と、からなるもので
あることが好ましい。
【0026】請求項7に記載されているように、シード
層及び銅膜はメッキ法、CVD法又はスパッタ法の何れ
かにより形成することができる。
【0027】請求項8に記載されているように、バリア
膜は、TiN、TiW、Ta又はTaN膜の何れか一つ
であることが好ましい。
【0028】また、請求項9に記載されているように、
これらのバリア膜の膜厚は1000オングストローム以
下であることが好ましい。
【0029】請求項10に記載されているように、例え
ば、無機スラリーとしては、アルミナ粒子又はシリカ粒
子の縣濁液と過酸化水素水との混合物からなるものを用
いることができる。
【0030】その場合、請求項11に記載されているよ
うに、アルミナ粒子又はシリカ粒子の縣濁液と過酸化水
素水との混合比は3:1乃至1:3の範囲内にあること
が好ましい。
【0031】
【発明の実施の形態】(第1の実施形態)図1(A)−
(E)は、本発明に係る半導体装置の製造方法の第1の
実施形態における各過程を示す。
【0032】先ず、図1(A)に示すように、半導体基
板10上に絶縁膜としての二酸化シリコン膜11を形成
した後、二酸化シリコン膜11の表面を平坦化する。
【0033】次いで、図1(B)に示すように、フォト
リソグラフィー及びエッチングにより、二酸化シリコン
膜11に複数の配線形成用の溝12を形成する。各溝1
2の深さは5000オングストロームである。
【0034】次いで、図1(C)に示すように、バリア
メタル膜として厚さ500オングストロームのTiN膜
13を全面に形成する。
【0035】この後、図1(D)に示すように、バリア
メタル膜13上に銅膜14を堆積させ、溝12を埋め込
む。銅膜14の堆積は、先ず、銅膜のシード層をスパッ
タ法で1000オングストロームの厚さで形成し、その
後、直ちに、メッキ法により8000オングストローム
の銅膜を成膜することにより、行われる。
【0036】次いで、銅膜14に対してCMPを施し、
図1(E)に示すように、各溝12の内部にのみ、銅膜
14を残し、ダマシン配線を形成する。
【0037】CMPに際しては、アルミナ粒子の縣濁液
と酸化剤としての過酸化水素水とを混合比1:1で調合
及び攪拌することにより得たスラリーを用いる。
【0038】研磨条件は以下の通りである。
【0039】荷重:140g/cm2 裏面荷重:112g/cm2 ウェハー中心点における線速度:0.1m/s 図2は本実施形態におけるCMPを実施するための装置
の概略的な斜視図である。
【0040】この装置は、モーター(図示せず)から動
力の供給を受けて回転する定盤20と、定盤20上に固
定された発泡ウレタンからなる研磨パッド21と、研磨
パッド21上にウェハー22を固定する回転可能なキャ
リア23と、上述のスラリーが蓄積されているスラリー
源24と、スラリー源24に蓄積されているスラリーを
研磨パッド21とウェハー22との間に供給するスラリ
ー供給配管25と、を備えている。
【0041】ウェハー22の表面には、図1(D)に示
したように、銅膜14が形成されており、この銅膜14
が研磨パッド21に接するように、ウェハー22がキャ
リア23によって支持される。この状態において、定盤
20及びキャリア23がそれぞれ回転することにより、
研磨パッド21及びウェハー22が相互に接触した状態
で回転し、銅膜14に対してCMPが施される。
【0042】本実施形態によれば、CMPに起因して銅
膜14に作用する機械的な力を抑制することができ、密
着力の弱い銅膜14のバリアメタル膜43との界面から
のはがれ、スクラッチなどの問題を解決することができ
る。
【0043】なお、本実施形態においては、バリアメタ
ル膜13として厚さ500オングストロームのTiN膜
を用いたが、TiN膜に代えて、TiW、Ta、TaN
膜のいずれをも用いることができる。また、その膜厚も
1000オングストローム以下であれば同様な効果を得
ることができる。
【0044】また、本実施形態においては、銅膜14の
成膜方法としては、シード層についてはスパッタ法、埋
め込み膜についてはメッキ法を用いたが、成膜方法は、
メッキ法、CVD法、スパッタ法のいずれかであればよ
い。
【0045】また、アルミナ粒子の縣濁液と過酸化水素
水との混合比は3:1〜1:3の範囲であればよい。さ
らに、アルミナ粒子の代わりにシリカ粒子を用いること
もできる。
【0046】また、研磨条件として荷重140g/cm
2を用いたが、荷重は140g/cm2以下であれば、任
意の値に設定することができる。
【0047】また、裏面荷重として荷重112g/cm
2を用いたが、裏面荷重は荷重の80%以下であればよ
い。
【0048】さらに、ウェハー中央における線速度は
0.1m/s以下の任意の値を設定することができる。 (第2の実施形態)図3(A)−(D)は、本発明に係
る半導体装置の製造方法の第2の実施形態における各過
程を示す。
【0049】先ず、図3(A)に示すように、半導体基
板30上に絶縁膜としての二酸化シリコン膜31を形成
した後、二酸化シリコン膜31の表面を平坦化する。
【0050】次いで、図3(B)に示すように、フォト
リソグラフィー及びエッチングにより、二酸化シリコン
膜31に複数の配線形成用の溝22を形成する。各溝3
2の深さは5000オングストロームである。
【0051】次いで、二酸化シリコン膜31にプラズマ
処理を施した後、図3(C)に示すように、二酸化シリ
コン膜31上に銅膜34を堆積させ、溝32を銅膜34
で埋め込む。銅膜34の堆積は、先ず、銅膜のシード層
をスパッタ法で11000オングストロームの厚さで形
成し、その後、直ちに、メッキ法により8000オング
ストロームの銅膜を成膜することにより、行われる。
【0052】次いで、銅膜34に対してCMPを施し、
図3(D)に示すように、各溝32の内部にのみ、銅膜
34を残し、ダマシン配線を形成する。
【0053】CMPに際しては、アルミナ粒子の縣濁液
と酸化剤としての過酸化水素水とを混合比1:1で調合
及び攪拌することにより得たスラリーを用いる。
【0054】研磨条件は以下の通りである。
【0055】荷重:140g/cm2 裏面荷重:112g/cm2 ウェハー中心点における線速度:0.1m/s CMPは、第1の実施形態の場合と同様に、図2に示し
た装置を用いて行われる。
【0056】本実施形態によれば、第1の実施形態の場
合と同様に、CMPに起因して銅膜34に作用する機械
的な力を抑制することができるので、密着力の弱い銅膜
34の二酸化シリコン膜31との界面からのはがれ、ス
クラッチなどの問題を解決することができる。
【0057】さらに、本実施形態においては、第1の実
施形態において形成したバリアメタル膜13を形成する
必要がないので、第1の実施形態よりも工程数を削減す
ることができる。
【0058】本実施形態においても、第1の実施形態の
場合と同様に、銅膜34の成膜方法はメッキ法、CVD
法、スパッタ法の何れをも用いることができる。
【0059】また、アルミナ粒子の縣濁液と過酸化水素
水との混合比は3:1〜1:3の範囲であればよい。
【0060】さらに、研磨条件において、荷重は140
g/cm2以下であればよく、裏面荷重は荷重の80%
以下であればよい。また、ウェハー中央における線速度
は0.1m/s以下であればよい。
【0061】
【発明の効果】本発明によれば、研磨条件、特に、ウェ
ハー中央における線速度や研磨荷重を上記のような範囲
内の値に制御することによって、CMPに起因して銅膜
に作用する機械的な力を抑制することができ、密着力の
弱い銅膜の界面からのはがれを防止することができる。
【図面の簡単な説明】
【図1】本発明に係る半導体装置の製造方法の第1の実
施形態の各工程を示す断面図である。
【図2】第1の実施形態において使用するCMPの実施
のための装置を示す斜視図である。
【図3】本発明に係る半導体装置の製造方法の第2の実
施形態の各工程を示す断面図である。
【図4】従来の半導体装置の製造方法の各工程を示す断
面図である。
【図5】従来の半導体装置の製造方法の各工程を示す断
面図である。
【符号の説明】
10 半導体基板 11 二酸化シリコン膜 12 溝 13 バリアメタル膜 14 銅膜 20 定盤 21 研磨パッド 22 ウェハー 23 キャリア 24 スラリー源 25 スラリー供給配管 30 半導体基板 31 二酸化シリコン膜 32 溝 34 銅膜 40 半導体基板 41 二酸化シリコン膜 42 溝 43 バリアメタル膜 44 銅膜 51 二酸化シリコン膜 52 溝 53 バリア膜 54 銅膜

Claims (11)

    【特許請求の範囲】
  1. 【請求項1】 定盤上に固定された研磨パッド上にウェ
    ハーを置き、該ウェハーの表面に形成された金属配線に
    化学的機械的研磨を施し、ダマシン配線を形成する過程
    を含む半導体装置の製造方法において、 銅配線を前記ウェハー中央の線速度が0.1m/s以下
    であるような研磨条件で研磨する過程を備えることを特
    徴とする半導体装置の製造方法。
  2. 【請求項2】 定盤上に固定された研磨パッド上にウェ
    ハーを置き、該ウェハーの表面に形成された金属配線に
    化学的機械的研磨を施し、ダマシン配線を形成する過程
    を含む半導体装置の製造方法において、 下地酸化膜に溝を形成する溝形成過程と、 前記溝の内面をバリア膜で覆うバリア膜形成過程と、 銅膜で前記溝を埋め込む銅成膜過程と、 無機スラリーを用い、研磨荷重が140g/cm2
    下、ウェハー中心点における線速度が0.1m/s以下
    の研磨条件の下に、前記銅膜を研磨する研磨過程と、 を備えることを半導体装置の製造方法。
  3. 【請求項3】 定盤上に固定された研磨パッド上にウェ
    ハーを置き、該ウェハーの表面に形成された金属配線に
    化学的機械的研磨を施し、ダマシン配線を形成する過程
    を含む半導体装置の製造方法において、 下地酸化膜に溝を形成する溝形成過程と、 銅膜で前記溝を埋め込む銅成膜過程と、 無機スラリーを用い、研磨荷重が140g/cm2
    下、ウェハー中心点における線速度が0.1m/s以下
    の研磨条件の下に、前記銅膜を研磨する研磨過程と、 を備えることを半導体装置の製造方法。
  4. 【請求項4】 前記溝形成過程後であって前記銅成膜過
    程前に、前記下地酸化膜をプラズマ処理する過程を含む
    ことを特徴とする請求項3に記載の半導体装置の製造方
    法。
  5. 【請求項5】 裏面荷重は前記研磨荷重の80%以下に
    設定されていることを特徴とする請求項2乃至4の何れ
    か一項に記載の半導体装置の製造方法。
  6. 【請求項6】 前記銅成膜過程は、第一の厚さを有する
    銅のシード層を形成する過程と、前記第一の厚さよりも
    大きい第二の厚さを有する銅膜を成膜する過程と、から
    なるものであることを特徴とする請求項2乃至5の何れ
    か一項に記載の半導体装置の製造方法。
  7. 【請求項7】 前記シード層及び前記銅膜はメッキ法、
    CVD法又はスパッタ法の何れかにより形成されるもの
    であることを特徴とする請求項6に記載の半導体装置の
    製造方法。
  8. 【請求項8】 前記バリア膜は、TiN、TiW、Ta
    又はTaN膜の何れか一つであることを特徴とする請求
    項2乃至7の何れか一項に記載の半導体装置の製造方
    法。
  9. 【請求項9】 前記バリア膜の膜厚は1000オングス
    トローム以下であることを特徴とする請求項8に記載の
    半導体装置の製造方法。
  10. 【請求項10】 前記無機スラリーは、アルミナ粒子又
    はシリカ粒子の縣濁液と過酸化水素水との混合物からな
    るものであることを特徴とする請求項2乃至9の何れか
    一項に記載の半導体装置の製造方法。
  11. 【請求項11】 前記アルミナ粒子又はシリカ粒子の縣
    濁液と前記過酸化水素水との混合比は3:1乃至1:3
    の範囲内にあることを特徴とする請求項10に記載の半
    導体装置の製造方法。
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