JP2000068639A - 電子部品の半田付け方法 - Google Patents

電子部品の半田付け方法

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JP2000068639A
JP2000068639A JP23725398A JP23725398A JP2000068639A JP 2000068639 A JP2000068639 A JP 2000068639A JP 23725398 A JP23725398 A JP 23725398A JP 23725398 A JP23725398 A JP 23725398A JP 2000068639 A JP2000068639 A JP 2000068639A
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Japan
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electronic component
soldering
solder paste
paste
solder
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JP23725398A
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English (en)
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Norihisa Imaizumi
典久 今泉
Akira Tanahashi
棚橋  昭
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Denso Corp
Original Assignee
Denso Corp
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Publication date
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19105Disposition of discrete passive components in a side-by-side arrangement on a common die mounting substrate

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  • Electric Connection Of Electric Components To Printed Circuits (AREA)

Abstract

(57)【要約】 【課題】 リフロー半田付けによって電子部品を基板に
実装する場合、その半田付け部にボイドが発生すること
を極力防止する。 【解決手段】 基板1に半田ペースト8を供給した後、
半田ペースト8上に電子部品を搭載してリフロー半田付
けする前に、半田ペースト8をその中の粉末半田が溶融
しない程度の温度(70℃〜150℃)で加熱する。こ
れによれば、電子部品を搭載する前の工程で、半田ペー
スト8を加熱するので、その時、フラックス中の低沸点
の成分が蒸発する。このため、リフロー半田付け時に蒸
気が発生することを極力防止でき、ボイドとして残留す
ることを極力防止できる。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、リフロー半田付け
によって電子部品を半田付けする方法に係り、特にリフ
ロー半田付け時にフラックスから発生する蒸気を減少さ
せ、ボイドとして残ることを防止しようとしたものに関
する。
【0002】
【従来の技術】半田付け部にボイドが残留することを防
止する技術として特開昭63−300519号公報に開
示されたものがある。これは、半導体チップを半田付け
によってヒートシンクにダイボンディングしてなる半導
体装置において、ダイボンディング面を、その縁部より
も中央部ほど隆起した傾斜面として形成するというもの
である。
【0003】このようにすれば、半導体チップとダイボ
ンディング面との間に介装された半田の厚みは、ダイボ
ンディング面の中央部から縁部側にいくほど厚くなる。
このため、ダイボンディング作業時における半田の溶融
および凝固は、まず、ダイボンディング面の中央部付近
から始まり、その縁部へと徐々に進んで行くことにな
る。このため、半導体チップとヒートシンクとの間に存
在していた空気は順次押し出されて外部に放出されるこ
ととなり、半導体チップとヒートシンクとの間の隙間に
存在する空気がボイドとして半田付け部に残留すること
を防止できるというものである。
【0004】
【発明が解決しようとする課題】リフロー半田付けによ
って電子部品を回路基板に実装する場合、従来では、ま
ず、回路基板に半田ペーストを印刷或いはノズル等によ
り塗布し、その後、半田ペーストの塗布部に電子部品を
搭載し、そして、リフロー半田付けを行う。
【0005】上記半田ペーストは、粉末半田とフラック
スとを混練したもので、そのフラックス中には、ロジ
ン、活性剤、増粘剤、チクソ剤、溶剤などの様々な成分
が含まれている。このため、リフロー半田付け時に、半
田ペーストが加熱されると、フラックス中の低沸点の成
分が蒸発し、半田付け部にいわゆるボイドとして残留す
るという問題を生ずる。特に、電子部品がパワートラン
ジスタのような比較的大きな半田付け面積をもったもの
では、リフロー半田付け時に発生した蒸気は電子部品と
基板との間から抜け出し難く、ボイドとして残留する傾
向が高い。
【0006】このように、半田ペースト中の低沸点成分
が蒸発することによって発生した蒸気は、前述の特開昭
63−300519号公報に開示された構造では、外部
に逃がすことはできず、その解決が強く望まれている。
【0007】本発明は上記の事情に鑑みてなされたもの
で、その目的は、リフロー半田付けによって電子部品を
実装する場合に、その半田付け部にボイドが発生するこ
とを極力防止できる電子部品の半田付け方法を提供する
にある。
【0008】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明の電子部品の半田付け方法は、電子部品を
半田付けしようとする部材にリフロー半田付けによって
半田付けするものにおいて、前記実装対象物に半田ペー
ストを供給する工程と、前記半田ペーストを当該半田ペ
ースト中の半田の溶融温度以下で加熱する工程と、前記
半田ペースト上に前記電子部品を搭載する工程と、前記
半田ペーストをリフロー加熱して当該半田ペースト中の
半田を溶融させ、前記電子部品を前記実装対象物に半田
付けする工程とを順に実行することを特徴とするもので
ある。
【0009】この構成によれば、電子部品を搭載する前
の工程で、半田ペーストが半田の溶融温度以下で加熱さ
れるので、その時、フラックス中の低沸点の成分が蒸発
する。このため、リフロー半田付け時に蒸気が発生せ
ず、発生してもその量は少ないので、半田付け部にいわ
ゆるボイドとして残留することを極力防止できる。
【0010】
【発明の実施の形態】以下、本発明の一実施例を電子部
品をセラミック基板にリフロー半田付けによって実装す
る場合に適用して図面を参照しながら説明する。図1は
電子部品を実装した後のセラミック基板(以下、基板)
1を示すもので、基板1上の導体2に例えばセラミック
コンデンサ3、IC4、パワートランジスタ5、ターミ
ナル6等が半田7によって接続されている。
【0011】これらの電子部品のリフロー半田付けによ
る実装方法を説明するに、基板1には、図2に示すよう
に、導体2が予め所定の回路パターンで形成されてい
る。そして、第1工程(ペースト塗布工程)では、その
導体2上に半田ペースト8をスクリーン印刷手段、ノズ
ル等による供給手段によって塗布する。
【0012】そして、次の第2工程(プレヒート工程)
で、導体2上の半田ペースト8を、大気または窒素もし
くは水素の雰囲気で、或る温度、例えば80℃〜150
℃、具体的には70℃で1分間加熱するプレヒートを行
う。半田ペースト8は、粉末半田とフラックスとを混練
したもので、そのフラックス中には、ロジン、活性剤、
増粘剤、チクソ剤、溶剤などの様々な成分を含んでい
る。そして、プレヒートにより半田ペースト8中に含ま
れている上記のような成分のうち、低沸点成分(150
℃よりも低い温度で蒸発する成分)が蒸発する。このと
き、半田ペースト8上には、まだ電子部品等が搭載され
ていないので、低沸点成分の蒸気は、半田ペースト8の
上面等から外部に自由に逃げ出る。また、半田ペースト
8中には、吸湿した水分が含まれているが、この水分も
プレヒートにより蒸発し、外部に逃げ出る。
【0013】なお、上記の低沸点成分とは、ロジンなど
の常温固体成分を溶解し、ペースト化するために用いら
れる溶剤(従って、導体2への印刷後は不要)や、部品
粘着性、リフロー特性に影響を与えない成分である。粉
末半田としては、一般的には共晶半田が用いられ、その
溶融温度は183℃前後であるから、プレヒートにより
粉末半田が溶融することはない。従って、第2工程のプ
レヒートは、半田ペースト8の粉末半田が溶融せず、フ
ラックス中の部品粘着性やリフロー特性等に影響を与え
ない成分が気化するような温度と時間で半田ペースト8
を加熱する工程ということができる。
【0014】さて、上記の第2工程を行った後、直ち
に、図3に示すように、半田ペースト8上にセラミック
コンデンサ3、IC4、パワートランジスタ5、ターミ
ナル6等を搭載し、大気または窒素もしくは水素の雰囲
気中で基板1を粉末半田の溶融温度に加熱して半田付け
する第3工程(リフロー加熱工程)を行う。これにより
半田ペースト8中の粉末半田が溶融し、セラミックコン
デンサ3、IC4、パワートランジスタ5、ターミナル
6等が導体2に半田付けされる。なお、リフロー工程に
おける加熱温度と時間との関係(温度プロフィル)の一
例を図4に示す。
【0015】このように本実施例では、リフロー加熱工
程の前にプレヒート工程を行って低沸点成分、水分を蒸
発させているので、最後のリフロー工程では、半田ペー
スト8の成分の蒸発がなく、蒸発があっても、その量は
少ない。このため、比較的大きな半田付け面積をもった
パワートランジスタ5でも、その半田付け部にボイドが
形成されず、或いは、ボイドが形成されてもその量は少
なくなる。
【0016】なお、本発明は上記し且つ図面に示す実施
例に限定されるものではなく、例えばパワートランジス
タ5を半田付けする場合に限られず、電子部品を実装す
る場合に広く適用でき、また、電子部品を半田付けする
実装対象物としては基板1に限られない等、その要旨を
逸脱しない範囲で種々変更して実施できる。
【図面の簡単な説明】
【図1】本発明の一実施例を示す実装後の基板を示す断
面図
【図2】基板に半田ペーストを印刷した状態で示す断面
【図3】半田ペースト上に電子部品を装着した状態で示
す断面図
【図4】リフロー加熱工程の温度プロファイル図
【符号の説明】
図中、1は基板、2は導体(実装対象物)、5はパワー
トランジスタ(電子部品)、8は半田ペーストである。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 電子部品を半田付けしようとする部材に
    リフロー半田付けによって半田付けするものにおいて、 前記実装対象物に半田ペーストを供給する工程と、 前記半田ペーストを当該半田ペースト中の半田の溶融温
    度以下で加熱する工程と、 前記半田ペースト上に前記電子部品を搭載する工程と、 前記半田ペーストをリフロー加熱して当該半田ペースト
    中の半田を溶融させ、前記電子部品を前記実装対象物に
    半田付けする工程とを順に実行してなる電子部品の半田
    付け方法。
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