JP2000003806A - 積層型セラミック電子部品 - Google Patents

積層型セラミック電子部品

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JP2000003806A
JP2000003806A JP10186859A JP18685998A JP2000003806A JP 2000003806 A JP2000003806 A JP 2000003806A JP 10186859 A JP10186859 A JP 10186859A JP 18685998 A JP18685998 A JP 18685998A JP 2000003806 A JP2000003806 A JP 2000003806A
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substrate
mounting
time
varistor
laminated
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Akihito Kondo
昭仁 近藤
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Marcon Electronics Co Ltd
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Abstract

(57)【要約】 【課題】 積層型セラミック電子部品において、高さ寸
法が幅寸法に非常に近くなってしまう場合でも、実装の
際に区別が容易である電子部品を提供する。 【解決手段】 対向面から交互に導出するように内部電
極を有し、この内部電極導出面に外部電極が設けられる
積層型セラミック電子部品において、外部電極が設けら
れる面以外の面のうち実装時に基板に平行となる面を基
板に垂直となる面と異なる色の焼結体で形成する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、積層型セラミック
電子部品に関する。
【0002】
【従来の技術】従来の積層型セラミック電子部品、例と
して積層型電圧非直線抵抗器(以後、積層型バリスタと
する)は、例えばZnOを主成分とし、他に数種類の金
属酸化物を混合したものからなり、図2に示すように、
内部に複数の電極を有する焼結体1と、内部電極を引き
出す外部電極2を有する。
【0003】こうした積層型バリスタは、長さ寸法
(L),幅寸法(W),厚さ寸法(T)において、一般
に、幅寸法(W)>厚さ寸法(T)である。
【0004】
【発明が解決しようとする課題】ところで、バリスタ
は、バリスタ電圧を高くするためには、焼結体を厚くす
る必要がある。そのため、積層型バリスタの場合は、1
層の厚さを厚くする必要がある。また、サージ電流耐量
等の諸特性の向上をはかるために、積層数を増す必要が
ある場合がある。
【0005】このような場合、積層型バリスタの厚さ寸
法(T)が幅寸法(W)と非常に近くなってしまう時が
あり、実装の際、区別が非常に困難となる。さらに、実
装時に基板に平行となる面に高抵抗層や絶縁層などの機
能が付与されている場合や、形名や定格等を示すマーキ
ングが施されており、実装後でも確認できるようにその
面を上向きにする必要がある場合等に問題となる。
【0006】そこで、実装時に、基板に平行となる面と
基板に垂直となる面の区別を明確にするために、例え
ば、異なる色の塗料をどちらかの面に塗るといった方法
が考えられるが、そうした場合、工程が増え、生産効率
が悪くなる他に、塗料による外観不良といった不良が発
生し、歩留まりが悪くなるといったことが考えられる。
【0007】
【課題を解決するための手段】以上のような課題を解決
するために、請求項1記載の積層型セラミック電子部品
は外部電極が設けられる面以外の面のうち実装時に基板
に平行となる面が基板に垂直となる面と異なる色の焼結
体で形成されることを特徴とするものである。
【0008】
【発明の実施の形態】以下に、本発明による積層型セラ
ミック電子部品について積層型バリスタを実施例として
具体的に説明する。
【0009】
【実施例】バリスタ機能を有する焼結体となる原料とし
て、ZnO(95.5mol%),CoO(1.5mol%) ,MnO(1.0
mol%) ,Sb(1.0mol%) ,NiO(0.5mol%) ,B
(0.5mol%) に、純水を加えてボールミルで混
合,乾燥した後、600〜1100℃で仮焼し、その後
に粉砕し有機バインダーとともに溶媒中に分散させスラ
リー状とする。次にドクターブレード法で10μm〜3
000μm程度の均一なバリスタ組成生シートを形成す
る(シートAとする)。
【0010】同様に、ZnO(83.0mol%),CoO(6.5mo
l%) ,MnO(4.5mol%) ,Sb(5.0mol%) ,Ni
O(0.5mol%) ,Bi(0.5mol%) に、純水を加えて
ボールミルで混合,乾燥した後、600〜1100℃で
仮焼し、その後に粉砕し有機バインダーとともに溶媒中
に分散させスラリー状とする。次にドクターブレード法
で10μm〜100μm程度の均一なバリスタ組成生シ
ートを形成する(シートBとする)。
【0011】このようにしてできたグリーンシート(シ
ートA)上に内部電極として銀−パラジウム(70/3
0)の金属ペーストをスクリーン印刷し、これを内部電
極対向面が交互にずれるように積層し、さらにその外層
となる表裏両面にシートBを各10μm〜300μm程
度積層し、これを圧着した後、前記内部電極が対向面か
ら交互に導出するように所定の大きさに切断し、100
0〜1250℃で0.5〜8時間焼結し、前記内部電極
の導出部両端面に外部電極を塗布し、450〜850℃
にて焼き付け、外部電極を形成する。
【0012】以上のように構成してなる積層型バリスタ
によれば、図1に示すように、実装時に基板に平行とな
る面3の色が基板に垂直となる面4と異なるバリスタ組
成焼結体で構成されているため、チップ寸法の高さ寸法
(T)が幅寸法(W)に非常に近くなってしまう場合で
も、実装の際に区別が容易となるものである。
【0013】なお、積層バリスタを例として用いたが、
本発明は積層型のセラミック電子部品であれば、セラミ
ックコンデンサ等にも同様に利用できる。
【0014】また、基板に平行となる面の色が基板に垂
直となる面と異なる色の焼結体で構成されていれば、そ
の組成はどのようなものでも本発明に含まれる。
【0015】
【発明の効果】以上述べたように、本発明によれば、生
産効率や歩留まりを悪化させることなく、実装時に基板
に平行となる面の色が基板に垂直となる面と異なる組成
焼結体で構成されているため、チップ寸法の高さ寸法
(T)が幅寸法(W)に非常に近くなってしまう場合で
も、実装の際に区別が容易となるセラミック電子部品を
提供できる。
【図面の簡単な説明】
【図1】 本発明の積層型セラミック電子部品の斜視
図。
【図2】 従来例の積層型セラミック電子部品の斜視
図。
【符号の説明】 1…焼結体 2…外部電極 3…実装時に基板に対して平行となる面 4…実装時に基板に対して垂直となる面

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 対向面から交互に導出するように内部電
    極を有し、この内部電極導出面に外部電極が設けられる
    積層型セラミック電子部品において、前記外部電極が設
    けられる面以外の面のうち実装時に基板に平行となる面
    が基板に垂直となる面と異なる色の焼結体で形成される
    ことを特徴とする積層型セラミック電子部品。
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