DE3044835C2 - Digitaler Phasendetektor - Google Patents

Digitaler Phasendetektor

Info

Publication number
DE3044835C2
DE3044835C2 DE19803044835 DE3044835A DE3044835C2 DE 3044835 C2 DE3044835 C2 DE 3044835C2 DE 19803044835 DE19803044835 DE 19803044835 DE 3044835 A DE3044835 A DE 3044835A DE 3044835 C2 DE3044835 C2 DE 3044835C2
Authority
DE
Germany
Prior art keywords
signal
phase
reference signal
output
phase detector
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
DE19803044835
Other languages
English (en)
Other versions
DE3044835A1 (de
Inventor
Reinhold Dipl.-Phys. 7000 Stuttgart Braun
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Alcatel Lucent Deutschland AG
Original Assignee
Standard Elektrik Lorenz AG
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Standard Elektrik Lorenz AG filed Critical Standard Elektrik Lorenz AG
Priority to DE19803044835 priority Critical patent/DE3044835C2/de
Priority to GR66609A priority patent/GR76352B/el
Priority to ES507433A priority patent/ES507433A0/es
Priority to FI813772A priority patent/FI73103C/fi
Priority to CH756181A priority patent/CH656758A5/de
Priority to JP56189406A priority patent/JPS57118445A/ja
Publication of DE3044835A1 publication Critical patent/DE3044835A1/de
Application granted granted Critical
Publication of DE3044835C2 publication Critical patent/DE3044835C2/de
Expired legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION, OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/06Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08Details of the phase-locked loop
    • H03L7/085Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
    • H03L7/089Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03DDEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
    • H03D13/00Circuits for comparing the phase or frequency of two mutually-independent oscillations
    • H03D13/003Circuits for comparing the phase or frequency of two mutually-independent oscillations in which both oscillations are converted by logic means into pulses which are applied to filtering or integrating means
    • H03D13/004Circuits for comparing the phase or frequency of two mutually-independent oscillations in which both oscillations are converted by logic means into pulses which are applied to filtering or integrating means the logic means delivering pulses at more than one terminal, e.g. up and down pulses

Description

3 4
bei Null und nicht bei Verfolgt stellung (PU = H, PD = H) ein. Sind beide Ausgänge Um eine zeitrichtige Durchschaltung des Bezugs-und inaktiv (H^Zustand) und treten an beiden Eingängen Vergleichssignals auf die Eingänge des Phasendetektors gleichzeitig Abfallflanken auf, dann erscheinen an beizu erreichen, ist bei einer Weiterbildung der Erfindung den Ausgängen PU und PD lediglich kurze Spannungsvorgesehen, daß die Korrekturschaltung zwei Durch- 5 impulse, die sich in ihrer Wirkung kompensieren,
schaltegatter aufweist deren Ausgänge mit den Aus- Im folgenden wird ausgehend von der Grundstellung gangen der Korrekturschaltung verbunden sind; daß je- des Phasendetektors PDTmh PU = H und PD = H die des Durchschaltegatter zwei Eingänge aufweist, von de- erste Abfallflanke, die den zugeordneten Ausgang aktinen einer mit dem zugeordneten Eingang der Korrek- viert (L-Zustand, als frühe Flanke und diejenige Abfallturschaltung verbunden ist und der andere über eine 10 flanke, die das Zurückschalten des Ausganges in den Logikschaltung angesteuert wird, die die zeitrichtige inaktiven Zustand (Η-Zustand) bewirkt, als späte Flanke Ansteuerung der Durchschaltegatter nach einem Aus- bezeichnet Bei aktiviertem (L-Zustand) Ausgang PU fall des Bezugssignals vornimmt. wird in einem PLL-Regelkreis die Phase des spannungs-Damit diese Logikschaltung den Beginn und das Ende gesteuerten Oszillators VCO beschleunigt und bei aktider Unterbrechung des Bezugssignals auf einfache Art 15 viertem Ausgang PD dagegen verzögere
feststellen kann, weist sie eine Monoflop-Schaltung auf, Im Betriebsfall ist mit einem Ausfall oder einer Unterdie von den Anstiegsflanken des Bezugssignals ange- brechung des Bezugssignals R zu rechnen. Diese Untersteuert *ird und solange im Einschaltzustand bleibt, wie brechung kann auch die Folge einer Umschaltung von das Bezugssignal ansteht, und die bei Ausfall des Be- einer ersten auf eine zweite Bezugssignal-Quelle sein, zugssignals nach Ablauf der Standzeit die Sperrung der 20 Der Ausfall und die Unterbrechung des Bezugssignals Durchschaltegatter einleitet. müssen erkannt werden. Das nach ie.t Unterbrechung Vorteilhafte Weiterbildungen der Erfindung sind auftretende Bezugssignal kann aufgrund von Bausteinauch in den übrigen Unteransprüchen gekennzeichnet toleranzen gegenüber dem Bezugssignal vor der Unter-Die Erfindung wird im folgenden anhand der Zeich- brechung bzw. dem Ausfall einen Phasenversatz in posinung näher erläutert Es zeigt 25 tiver oder negativer Rieh tung aufweisen. Wenn die Pha-F i g. 1 das Blockschaltbild eines Phasenregelkreises se des Eszugssignals nach der Unterbrechung der Phase mit einem Phasendetektor, des Bezugssignals vor der Unterbrechung vorauseilt F i g. 2 das Blockschaltbild einer Korrekturschaltung, erfolgt der Phasenabgleich in falscher Richtung, wie andie dem Phasendetektor gemäß der Erfindung vorge- hand der Signaldiagramme nach F ig. 3 gezeigt wird,
schaltet ist, 30 Im Zeitpunkt /1 liegt die neutrale Grundsteilung Fi g. 3 die Signaldiagramme des bekannten Phasen- (PU = H, PD = H) des Phasendetektors PDTVor. Die detektors und zum Zeitpunkt 12 auftretende Abfallflanke des Bezugs-F i g. 4 die Signaldiagramme des eine Korrekturschal- signals R wirkt deshalb als frühe Flanke und aktiviert tung aufweisenden erfindungsgemäßen Phasendetek- den Ausgang P£/(L-Zustand). Die Abfallflanke des Vertors. 35 gleichssignals Vim Zeitpunkt f 3 wirkt als späte Ranke In einem PLL-Regelsystem (Fig. 1) werden die Fre- und schaltet den Ausgang PU wieder in den inaktiven quenz und die Phase eines steuerbaren Oszillators VCO Zustand (Η-Zustand). Die Impulsbreite des Ausgangssiauf die Frequenz und die Phase eines Bezugssignals ein- gnals am Ausgang PUist durch die Zeitdifferenz 13— 12 geregelt Das Bezugssignal R wird dem einen Eingang gegeben. Im Idealfall ist ί 3—f 2 = 0, d. h. das Beiugssieines digitalen Phasendetektors PDT zugeführt, wäh- 40 gnal R ist mit dem Vergleichssignal V'in Phase. Auch im rend das Ausgangssignal des Oszillators VCO als Ver- Zeitpunkt 14 sind die beiden Ausgänge PU und PD gleichssignal V auf den anderen Eingang des Phasende- inaktiv (Η-Zustand). Daher wirkt die Abfallflanke des tektors PDT gelangt Die Auslegung des Phasendetek- Vergleichssignals V im Zeitpunkt ί 5 als frühe Flanke tors PDTisi so, daß an dem Ausgang PUein Ausgangs- und aktiviert den Ausgang PD (L-Zustand). Im Zeitsignal auftritt, wenn das Bezugssignal R in der Phase 45 punkt f 6 tritt zum erstenmal nach der Unterbrechung dem Vergleichssignal Vin der Phase vorauseilt, und daß des Bezugssignals R eine Abfallflanke dieses Bezugssian dem Ausgang PD ein Ausgangssignal auftritt, wenn gnals R auf. Da zu diesem Zeitpunkt / 6 der Ausgang PD das Bezugssignal R in der Phase dem Vergleichssignal V aktiviert (L-Zustand) ist, wirkt die Abfallflanke des Bein der Phase nacheilt Das Ausgangssignal hat dabei eine zugssignals R als späte Flanke und schaltet den Ausgang Impulsbreite, die dem Wsrt der Phasendifferenz pro- 50 PD inaktiv (Η-Zustand). Die Grundstellung (PU = H, portional ist und gelangt über den Verstärker Vr und PD = H) des Phasvjndetektors PDT ist damit wieder ein Tiefpaßfilter FaIs Regelspannung Ur auf den Regel- hergestellt. Im Zeitpunkt ί 7 wird daher die Abfallflanks eingang des spannungsgesteuerten Oszillators VCO. des Vergleichssignals V bereits wieder als frühe Flanke Der Phasendetektor PDT besteht aus zwei symme- gtwertei, auch wenn die Zeit- bzw. Phasendifferenz ΔΦ irischen Hälften. Dem Eingang für das Bezugssignal R 55 zwischen f 7 und /6 nur einen kleinen Bruchteil einer ist der Ausgang PU und dem Eingang für das Ver- Signalperiode beträgt. Das Ausgangssignal am Ausgang gleichssignal V der Ausgang PD zugeordnet. Aus der PD hat daher eine Impulsbreite, die durch der. Ausdruck neutralen Grundstellung, in der die Ausgänge PlJ und (2.,τ—ΔΨ) bestimmt ist. Der Phasenfehler ΔΦ wird auf PD im Η-Zustand sind, d. h. inaktiv sind, wird bei einer den Wert 2„t vergrößert.
Abfallflanke des zugeordneten Signals der zugeordnete 60 Die Wirkungsweise des bekannten Phasendetektors Ausgang in den L-Zustand geschaltet, d. h. aktiviert. 1st PDTkann also folgendermaßen beschrieben warden:
ein Ausgang bereits aktiviert dann haben weitere Ab- Beim Ausbleiben der Abfallflanken des Bezugssignals fallflanken am zugeordneten Eingang keinen Einfluß R stellt der Phasendetektor PDTiest, daß die Abfallflanmehr auf den Zustand des Ausganges. Ist ein Ausgang ken des Vergleichssignals V in viel zu rascher Folge aktiviert und tritt am Eingang der nicht aktivierten Half- 65 auftreten. Deshalb -<erden die Abfallflanken des Verte eine Abfallflanke auf, dann wird der aktivierte Aus- gleichssignals V solange verzögert, bis wieder Gleichgang wieder inaktiv gehaltet (Η-Zustand) und der zeitigkeit mit den Abfallflanken des Bezugssignals R Phasendetektor nimmt wieder seine neutrale Grund- vorliegt Falls die Abfallflanken des wieder einsetzenden
Bezugssignals R den Abfallflanken des Vergleichssignals V um einen Phasenwinkel ΔΦ (der nur einen Bruchteil einer Signalperiode 2,τ beträgt) nacheilen, füht die Verzögerung der Abfallflanken des Vergleichssignals V zur Verkleinerung des Phasenwinkels gegen den Wert Null. Falls dagegen die Abfallflanken des wieder einsetzenden Bezugssignals R den Abfallflanken des Vergleichssignals Vum einen Phasenwinkel//!?vorauseilen, wird dieser Phasenwinkel auf den Wert 2,t vergrößert, denn erst bei diesem Phasenwinkel haben die Abfallflanken des Bezugssignals R und des Vergleichssignals V wieder übereinstimmende Phasenlage. Bei vorauseilenden Abfallflanken des Bezugssignals R ist daher eine Korrektur im Ziehverhalten des Phasendetektors PD7erforderlich.
Diesem Zweck dient die Korrekturschaltung KS nach F i g. 2, die dem bekannten Phasendetektor PDTvorgeschaltet wird. Die Korrekturschaltung KShat zwei Ausgänge, die mii den beiden Eingängen des rriaicndcicktors PDTverbunden sind. Das Bezugssignal R wird jetzt dem einen Eingang der Korrekturschaltung KS zugeführt, während das Vergleichssignal V auf den zweiten Eingang der Korrekturschaltung KS gelangt. Diese Korrekturschaltung AfS bewirkt, daß bei einem Ausfall bzw. einer Unterbrechung des Bezugssignals R beide Eingänge des Phasendetektors PDT in den inaktiven Zustand (Η-Zustand) gebracht werden und daß nach dem Wiedereinsetzen des Bezugssignals R. zuerst an den dem Vergleichssignal V zugeordneten Eingang des Phasendetektors PDTd\e Abfallflanke des Vergleichssignals V angelegt wird und erst danach an den dem Bezugssignal R zugeordneten Eingang des Phasendetektors PDTdIt Abfallflanke des Bezugssignals R. Dabei bleibt die Abfallflanke des Vergleichssignals V ohne Wirkung, denn der Ausgang PD des Phasendetektors PDT\%\ zu diesem Zeitpunkt bereits aktiviert (PD = L). Demzufolge hat die Abfaüflanke des Bezugssignals R die Wirkung einer spaten Flanke und bringt den Phasendetektor PDT in seine Grundstellung (PD = H, PU = H). Weitere Abfallflanken des Bezugssignals R und des Vergleichssignals V treten erst bei der nächsten Signalperiode auf. Da in diesem Zeitpunkt der Phasendetektor PDT in seiner Grundstellung (PD = H, PU = H) ist, wird jetzt die Phase richtig abgeglichen.
Die Wirkungsweise der erfindungsgemäßen Korrekturschaltung KS wird anhand des Schaltbildes nach F i g. 2 und der Signaldiagramme nach F i g. 4 näher erläutert. Durch eine retriggerbare Monoflop-Schaltung MF wird überwacht, ob das Bezugssignal R ansteht. Solange an dem dem Bezugssignal R zugeordneten Eingang der Korrekturschaltung KS Anstiegsflanken des Bezugssignals R auftreten, bleibt der Ausgang Q der Monoflop-Schaltung AiF im Η-Zustand. Dabei nimmt die aus den Gattern G 4 und G 5 bestehende Kippschaltung ihre Arbeitsstellung (D — L, B = H) ein, denn an dem Punkt Q liegt das dem Η-Zustand entsprechende Potential und am Punkt A tritt periodisch das dem L-Zustand entsprechende Potential auf. Der eine Ausgang der Kippschaltung führt über einen durch das Gatter G 6 gebildeten Inverter auf den zweiten Eingang des dem Bezugssignal R zugeordneten Durchschaltegatters G 1. während der andere Ausgang direkt mit dem zweiten Eingang des dem Vergleichssignal V zugeordneten Durchschaltegatters G 2 verbunden ist In der Arbeitsstellung der Kippschaltung sind die Durchschakegatter G 1 und G 2 für das Bezugssignal R und das Vergleichssignal K geöffnet, da die Punkte fund B ein dem H-Zustand entsprechendes Potential führen.
Fällt das Bezugssignal R im Zeitpunkt 111 aus, dann kippt die Monoflop-Schaltung MF nach seiner Standzeit ts in den Zustand, in dem der Ausgang (?den L-Zustand aufweist. Dies ist zum Zeitpunkt ί 12 der Fall. Durch die Änderung des Potentials am Punkt Q wird auch durch die Kippschaltung in die Ruhestellung (B = L, D = H) umgesteuert. Die Durchschaltegatter G1 und G 2 werden demzufolge gesperrt. Die dem Phasendetektor PDTzugeführten Signale Ä'und Vsind im ίο Η-Zustand. Im Zeitpunkt 113 folgt die erste Anstiegsflanke des wiedereinsetzenden Bezugssignals R, so daß die Monoflop-Schaltung AiF wieder die Stellung mit dem Η-Zustand am Ausgang Q einnimmt. Ist der Punkt Q im Η-Zustand und steht das Vergleichssignal V an, dann tritt am Punkt A eine Abfallflanke zum Zeitpunkt ί 15 auf. Da zu diesem Zeitpunkt am Eingang des Gatters GA das dem Η-Zustand des Punktes Q entsprechende Potential anliegt, wird durch die Abfallflanke am Punkt A das Kippglied wieder in seine Arbeitsstellung zurückgestellt.
Dabei tritt zunächst am Punkt B im Zeitpunkt /16 eine Anstiegsflanke auf und eine Gatterlaufzeit später zum Zeitpunkt fl 7 eine Abfallflanke am Punkt D. Schließlich tritt wiederum eine Gatterlaufzeit später im Zeitpunkt ί 18 am Eingang des Durchschaltegatters G 1 (Punkt E) eine Anstiegsflanke auf. Durch den dem Eingang parallelgeschalteten Kondensator Cl kann letztere GäMsrlaufzeit relativ groß gemacht werden. Bei dieser Reihenfolge der Pegelübergänge ist gewährleistet, daß zuerst am Punkt B des Durchschaltegatters G 2 das dem Η-Zustand entsprechende Potential anliegt (Zeitpunkt ί 16) und erst zwei Gatterlaufzeiten später (Zeitpunkt 118) an dem Punkt E des Durchschaltegatters G 1. Andererseits ist auch gewährleistet, daß in diesen Zeitpunkten f 16 und M 8 am Durchschaltegatter Cl das Bezugssignal R und am Durchschaltegatter G 2 das Vergleichssignal V ansteht. Diese beiden Schaltzustände an den Durchschaltegattern G 1 und G 2 waren Voraussetzung, daß die Abfallflanke am Punkt A zum Zeitpunkt ί 15 überhaupt auftrat. Diese Abfallflanke am Punkt A hatte die Kippschaltung in die Arbeitsstellung gebracht. Damit ist die Zielsetzung erreicht, daß nach dem Wiedereinsetzen des Bezugssignals R zuerst die Abfallflanke des Vergleichssignals V dem Phasendetektor PDTzugeführt wird und erst danach die Abfallflanke des Bezugssignals R, und dies unabhängig von der Phasenbeziehung zwischen dem Bezugssignal R und dem Vergleichssignal V.
Im eingeregelten Zustand bringt die Korrekturschaltung KS keine Ungenauigkeit für die Phasenlage, da die beiden Signale R und Vüber gleichartige Durchschaltegatter G1 und G 2 durchgeschaltet werden. Aufgrund der inneren Laufzeiten des Phasendetektors PDT genügt es, wenn die beiden aktiven Abfallflanken des Vergleichssignals V \m Zeitpunkt ί 19 und des Bezugssignals R'\m Zeitpunkt 120 gleichzeitig angelegt werden. Beim Ausgangszustand PU = H und PD = L wird nämlich die Abfallflanke des Bezugssignals R' selbst dann noch als späte Flanke ausgewertet, wenn sie ungefähr eine Gatterlaufzeit vor der aktiven Abfallflanke des Vergleichssignals V'auftritt.
Selbstverständlich kann auch der dem Vergleichssignal V zugeordnete Eingang der Korrekturschaltung KS in gleicher Weise überwacht werden.
Hierzu 3 Blatt Zeichnungen

Claims (5)

1 2 rückstellt, wenn die Monoflop-Schaitung (MF) im Patentansprüche: Einschaltznstand (Q = H) ist und das Vergleichssi gnal (V) ansteht.
1. Digitaler Phasendetektor für ein Phasenregelsy- 6. Phasendetektor nach Anspruch 4 oder 5, dastem, mit einem ersten Eingang, dem ein Bezugssi- 5 durch gekennzeichnet, daß zwischen dem zweiten gnal zugeführt wird, und einem zweiten Eingang, Eingang des von dem Bezugssignal gesteuerten dem ein Vergleichssignal zugeführt wird, mit minde- Durchschaltegatters (G 1) und Masse ein Kondensastens einem Ausgang, an dem ein erstes Ausgangssi- tor (C 1) liegt.
gnal abgegeben wird, wenn das Bezugssignal dem
Vergleichssignal in der Phase vorauseilt, und an dem 10
ein zweites Ausgangssignal abgegeben wird, wenn
das Bezugssignal dem Vergleichssignal in der Phase
nacheilt, wobei die Impulsbreite dieser Ausgangssi- Die Erfindung betrifft einen digitalen Phasendetektor
gnale jeweils dem Wert der Phasenverschiebung für ein Phasenregelsystem, mit einem ersten Eingang, zwischen Bezugssignal und Vergleichssignal propor- i~ dem ein Bezugssignal zugeführt wird, und einem zweitional ist, sowie mit einer Korrekturschaltung, deren ten Eingang, dem ein Vergleichssignal zugeführt wird, Eingängen jeweils das Bezugssignal und das Ver- mit mindestens einem Ausgang, an dem ein erstes Ausgteichssignal zugeführt wird und deren Ausgänge gangssignal abgegeben wird, wenn das Bezugssignal mit den Eingängen des Phasendetektors verbunden dem Vergleichssignal in der Phase vorauseilt, und an sind, d&öurch gekennzeichnet, daß die 20 dem ein zweites Ausgangssignal abgegeben wird, wenn Korrekturschaltung (KS) ausschließlich durch Be- das Bezugssigna! dem Vergleichssigna! in der Phase zugs- und Vergleichssignal gesteuert wird und daß nacheilt, wobei die Impulsbreite dieser Ausgangssignale die Eingänge der Korrekturschaltung (KS) nach ei- jeweils dem Wert der Phasenverschiebung zwischen ner Unterbrechung des Bezugssignals (R) derart zu Bezugssignal und Vergleichssignal proportional ist soihren Ausgängen durchgeschaltet werden, daß die 25 wie mit einer Korrekturschaltung, deren Eingängen je-Abfallflanke des Vergleichssignals (V) nach der Ab- weils das Bezugssignal und das Vergleichssignal zugefallflanke des Bezugssignals (R') an den Ausgang ge- führt wird und deren Ausgänge mit den Eingängen des langt. Phasendetektors verbunden sind.
2. Phasendetektor nach Anspruch 1, dadurch ge- Ein derartiger Phasendetektor wird vorzugsweise in kennzeichnet, daß die Korrekturschaltung (KS) zwei 30 PLL-Regelsystemen eingesetzt (US-PS 39 21095), um Durchschz!»egatter (G 1, G 2) aufweist, deren Aus- das Ausgangssignal eines spannungsgesteuerten Oszilgänge mit den Ausgängen .der Korrekturschaltung lators als Vergleichssignal mit einem Steuer- oder Bc- (KS) verbanden sind; daß jedes Durchschaltegatter zugssignal zu synchronisieren. Der Phasendetektor ver- (Gi, G 2) zwei Eingänge, aufweist, von denen einer gleicht die Phase des Bezugssignals mit der Phase des mit dem zugeordneten Eingang der Korrekturschal- 35 Vergleichssignals. Je nach der Phasendifferenz entsteht tung (KS) verbunden ist, und der andere über eine an dem Ausgang des Phasendetektors ein unterschiedli-Logikschaltung (MF, G 4, G 5, G 6) angesteuert ches Ausgangssignal, dessen Impulsbreite dem Wert der wird, die die zeitrichtige Ansteuerung der Durch- Phasendifferenz proportional Lst. Das Ausgangssignal schaltegatter (G 1, G 2) nach einem Ausfall des Be- wird über ein Filter und ggf übertönen Verstärker dem zugssignals (R) vornimmt. 40 Oszillator als Regelspannung zugeführt.
3. Phasendetektor nach Anspruch 2, dadurch ge- Bei den bekannten Phasendetektoren (vgl. auch kennzeichnet, daß die Logikschaltung eine Mono- »NTZ«, 1971, Heft 8, Seite 437 bis 439; DE-OS flop-Schaltung (MF) aufweist, die von den Anstiegs- 28 56 211; DE-OS 29 49 206) tritt im Falle der Unterbreflanken des Bezugssignals (R) angesteuert wird und chung des Bezugssignals immer dann ein Fehlverhalten solange im Einschaltzustand (Q = H) bleibt, wie das 45 auf, wenn die Phase des wiedereinsetzenden Bezugssi-Bezugssignal (R) ansteht, und die bei Ausfall des gnals der Phase des ursprünglichen Bezugsignals vor-Bezugssignals (R) nach Ablauf der Standzeit (ts) die auseilt. Die Phase wird dann auf statt auf Null abge-Sperrung der Durchschaltegatter (G I1G 2) einleitet. glichen. Dieses Fehlverhalten tritt besonders dann auf,
4. Phasendetektor nach Anspruch 2 oder 3, da- wenn das Bezugssignal vor der Unterbrechung aus eidurch gekennzeichnet, daß die Logikschaltung eine 50 ner anderen Quelle entnommen wird als das Bezugsi-Kippschaltung (G 4, G 5) aufweist, die sich im Ruhe- gnal nach der Unterbrechung.
zustand (Q = L) der Monoflop-Schaitung (MF) in Der Erfindung liegt die Aufgabe zugrunde, einen digi-Ruhestellung (D — H, B = L) befindet; daß der eine talen Phasendetektor der eingangs genannten Art zu Ausgang (D) der Kippschaltung (G 4, G 5) über ei- schaffen, der auch nach Unterbrechungen des Bezugsinen Inverter (G 6) mit dem zweiten Eingang des von 55 gnals in jedem Fall die Phase auf Null abgleicht,
dem Bezugsignal (R) angesteuerten Durchschalte- Diese Aufgabe wird gemäß der Erfindung dadurch gatters (G 1) verbunden ist; daß der andere Ausgang gelöst, daß die Korrekturschaltung ausschließlich durch (B) der Kippschaltung (G 4, GS) mit dem zweiten Bezugs- und Vergleichssignal angesteuert wird und daß Eingang des von dem Vergleichssignal (V) angesteu- die Eingänge der Korrekturschaltung nach einer Untererten Durchschaltegatters (G 2) verbunden ist, und 60 brechung des Bezugssignals derart zu ihren Ausgängen daß die Kippschaltung (G 4, G 5) über eine Gatter- durchgeschaltet werden, daß die Abfallflanke des Verschaltung (G3), die von dem Ausgangssignal (Q) der gleichssignals nach der Abfallflanke des Bezugssignals Monoflop-Schaitung (MF) und vom Vergleichssi- an den Ausgang gelangt.
gnal (V) angesteuert wird, in die Arbeitsstellung Auf diese Weise werden das Bezugsignal und das Ver-
(D=L, B= H) verbracht wird. 65 gleichssignal unabhängig von ihrer Phasenbeziehung
5. Phasendetektor nach Anspruch 4, dadurch ge- vor und nach der Unterbrechung stets in der vorgegekennzeichnet, daß die Gatterschaltung (G 3) die benen Reihenfolge zu dem digitalen Phasendetektor geKippschaltung (G 4, G 5) in die Arbeitsstellung zu- langen, womit sichergestellt ist, daß der Phasenabgleich
DE19803044835 1980-11-28 1980-11-28 Digitaler Phasendetektor Expired DE3044835C2 (de)

Priority Applications (6)

Application Number Priority Date Filing Date Title
DE19803044835 DE3044835C2 (de) 1980-11-28 1980-11-28 Digitaler Phasendetektor
GR66609A GR76352B (de) 1980-11-28 1981-11-24
ES507433A ES507433A0 (es) 1980-11-28 1981-11-25 Un detector de fase digital.
FI813772A FI73103C (fi) 1980-11-28 1981-11-25 Digital fasdetektor.
CH756181A CH656758A5 (en) 1980-11-28 1981-11-26 Phase monitoring circuit
JP56189406A JPS57118445A (en) 1980-11-28 1981-11-27 Digital phase detector

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
DE19803044835 DE3044835C2 (de) 1980-11-28 1980-11-28 Digitaler Phasendetektor

Publications (2)

Publication Number Publication Date
DE3044835A1 DE3044835A1 (de) 1982-06-03
DE3044835C2 true DE3044835C2 (de) 1986-04-03

Family

ID=6117795

Family Applications (1)

Application Number Title Priority Date Filing Date
DE19803044835 Expired DE3044835C2 (de) 1980-11-28 1980-11-28 Digitaler Phasendetektor

Country Status (6)

Country Link
JP (1) JPS57118445A (de)
CH (1) CH656758A5 (de)
DE (1) DE3044835C2 (de)
ES (1) ES507433A0 (de)
FI (1) FI73103C (de)
GR (1) GR76352B (de)

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3544675A1 (de) * 1985-12-18 1987-06-25 Philips Patentverwaltung Schaltungsanordnung zur steuerung eines frequenzabhaengigen oszillators
JPH04250712A (ja) * 1991-01-25 1992-09-07 Toshiba Corp 半導体集積回路
US5340159A (en) * 1991-07-12 1994-08-23 The Standard Register Company Varying tone security document

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3921095A (en) * 1974-11-14 1975-11-18 Hewlett Packard Co Startable phase-locked loop oscillator
US4237423A (en) * 1978-12-08 1980-12-02 Rca Corporation Digital phase detector
DE2856211A1 (de) * 1978-12-27 1980-07-03 Licentia Gmbh Digitale phasenregelschaltung mit einer hilfsschaltung

Also Published As

Publication number Publication date
JPS6347163B2 (de) 1988-09-20
JPS57118445A (en) 1982-07-23
FI73103B (fi) 1987-04-30
FI813772L (fi) 1982-05-29
FI73103C (fi) 1987-08-10
ES8300421A1 (es) 1982-11-01
ES507433A0 (es) 1982-11-01
GR76352B (de) 1984-08-06
CH656758A5 (en) 1986-07-15
DE3044835A1 (de) 1982-06-03

Similar Documents

Publication Publication Date Title
EP0012899B1 (de) Digitale Phasenregelschaltung mit einer Hilfsschaltung
DE2645638C2 (de) Phasendetektor in einer phasenstarren Schleife
DE69734954T2 (de) Verfahren und Vorrichtung zur Einphasung von digitalen Zeitsignalen wie z.B. einem Taktsignal und einem Datenstrom
DE2548265C3 (de) Schaltungsanordnung zur symmetrischen Frequenzteilung durch eine ungerade Zahl
DE2355533C3 (de) Empfänger für synchrone Datensignale mit einem Übertragungsgeschwindigkeitsänderungsdetektor
DE3022746A1 (de) Digitale phasenkomparatorschaltung
DE2502630A1 (de) Phasengekoppelter oszillator mit frequenznachsteuerung
DE2648560C2 (de) Synchronisierung von Taktsignalen mit Eingangssignalen
DE3044835C2 (de) Digitaler Phasendetektor
EP0504209B1 (de) Schaltungsanordnung zum erkennen eines fernsehsignals
DE2646147B2 (de) Digitale Phasenvergleichsanordnung
DE2808762C2 (de)
EP0199147B1 (de) Schaltungsanordnung zum Wiedergewinnen binärer Datensignale und in diesen enthaltener Datentaktsignale
DE2159629C2 (de) Synchronisationsschaltung
DE2422979A1 (de) Digitaler phasen- und frequenzkomparator
DE2141888A1 (de) Rahmensynchronisiersystem
DE19905053C2 (de) Komparatorschaltung
DE19918047A1 (de) Frequenzkomparator und mit einem solchen Frequenzkomparator ausgestattete PLL-Schaltung
DE3324919C2 (de)
DE3818089C2 (de)
DE3625270C2 (de)
DE10306619B4 (de) DLL-Schaltung zur Stabilisierung der Einschwingphase
DE2418546A1 (de) Schnelle gleichstrom-klemmschaltung
DE10158700C1 (de) Regelkreis
EP0369047A1 (de) Anordnung zur Umschaltung eines Taktes auf einen Takt gleicher Frequenz aber nacheilender Taktphase

Legal Events

Date Code Title Description
OP8 Request for examination as to paragraph 44 patent law
D2 Grant after examination
8364 No opposition during term of opposition
8327 Change in the person/name/address of the patent owner

Owner name: ALCATEL SEL AKTIENGESELLSCHAFT, 7000 STUTTGART, DE

8339 Ceased/non-payment of the annual fee