DE2756832A1 - Addierer fuer fibonacci-codes - Google Patents
Addierer fuer fibonacci-codesInfo
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Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| SU762432391A SU732864A1 (ru) | 1976-12-22 | 1976-12-22 | Сумматор кодов фибоначчи |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| DE2756832A1 true DE2756832A1 (de) | 1978-07-06 |
Family
ID=20687540
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| DE19772756832 Withdrawn DE2756832A1 (de) | 1976-12-22 | 1977-12-20 | Addierer fuer fibonacci-codes |
Country Status (9)
| Country | Link |
|---|---|
| US (1) | US4159529A (enExample) |
| JP (1) | JPS53101242A (enExample) |
| CA (1) | CA1103807A (enExample) |
| DD (1) | DD136317A1 (enExample) |
| DE (1) | DE2756832A1 (enExample) |
| FR (1) | FR2375655A1 (enExample) |
| GB (1) | GB1565460A (enExample) |
| PL (1) | PL109971B1 (enExample) |
| SU (1) | SU732864A1 (enExample) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN112787658A (zh) * | 2020-12-31 | 2021-05-11 | 卓尔智联(武汉)研究院有限公司 | 基于斐波那契进制的逻辑运算电路 |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| SU840891A1 (ru) * | 1978-05-15 | 1981-06-23 | Винницкийполитехнический Институт | Параллельный сумматор кодов фибоначчи |
| EP0754373B1 (en) * | 1995-02-03 | 2001-06-06 | Koninklijke Philips Electronics N.V. | Encoding arrangement for encoding a sequence of (n-1)-bit information words into a sequence of n-bit channel words, and a decoding arrangement for decoding a sequence of n-bit channel words into a sequence of (n-1) bit information words |
| US6934733B1 (en) * | 2001-12-12 | 2005-08-23 | Lsi Logic Corporation | Optimization of adder based circuit architecture |
| US12511123B2 (en) * | 2022-10-28 | 2025-12-30 | Jun Zhou | Fast carry-calculation oriented redundancy-tolerated fixed-point number coding for massive parallel ALU circuitry design in GPU, TPU, NPU, AI infer chip, CPU, and other computing devices |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR1547633A (fr) * | 1967-10-16 | 1968-11-29 | Labo Cent Telecommunicat | Circuit d'addition de nombres binaires provenant du codage non linéaire de signaux |
-
1976
- 1976-12-22 SU SU762432391A patent/SU732864A1/ru active
-
1977
- 1977-12-16 US US05/861,412 patent/US4159529A/en not_active Expired - Lifetime
- 1977-12-19 FR FR7738258A patent/FR2375655A1/fr active Granted
- 1977-12-20 PL PL1977203158A patent/PL109971B1/pl unknown
- 1977-12-20 DD DD77202802A patent/DD136317A1/xx unknown
- 1977-12-20 DE DE19772756832 patent/DE2756832A1/de not_active Withdrawn
- 1977-12-22 JP JP15500877A patent/JPS53101242A/ja active Granted
- 1977-12-22 GB GB53430/77A patent/GB1565460A/en not_active Expired
- 1977-12-22 CA CA293,680A patent/CA1103807A/en not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN112787658A (zh) * | 2020-12-31 | 2021-05-11 | 卓尔智联(武汉)研究院有限公司 | 基于斐波那契进制的逻辑运算电路 |
Also Published As
| Publication number | Publication date |
|---|---|
| US4159529A (en) | 1979-06-26 |
| PL203158A1 (pl) | 1978-12-18 |
| SU732864A1 (ru) | 1980-05-05 |
| FR2375655A1 (fr) | 1978-07-21 |
| JPS53101242A (en) | 1978-09-04 |
| JPS573100B2 (enExample) | 1982-01-20 |
| CA1103807A (en) | 1981-06-23 |
| PL109971B1 (en) | 1980-06-30 |
| FR2375655B1 (enExample) | 1980-08-22 |
| GB1565460A (en) | 1980-04-23 |
| DD136317A1 (de) | 1979-06-27 |
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