DE2437197A1 - Halbleiteranordnung und verfahren zur herstellung derselben - Google Patents
Halbleiteranordnung und verfahren zur herstellung derselbenInfo
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Description
Halbleiteranordnung· und Verfahren zur Herstellung derselben.
Die Erfindung bezieht sich auf eine Halbleiteranordnung
mit einem Halbleiterkörper, der auf zwei
einander gegenüber liegenden Seiten Hauptflächen und quer zu den Hauptflächen Seitenflächen aufweist, wobei
in dem Halbleiterkörper mindestens ein Schaltungselement gebildet wird, das mit elektrischen Anschlusspunkten versehen
ist, die an der Oberfläche des Halbleiterkörpers voneinander durch eine elektrisch isolierende Schicht
getrennt sind; weiterhin bezieht sich die Erfindung auf ein Verfahren zur Herstellung dieser Halbleiteranordnung.
Bei der Herstellung von Halbleiteranor.dnungen der eingangs genannten Art wird häufig von Halb—
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leiterscheiben ausgegangen, in denen eine Vielzahl von Schaltungselementen gebildet wird. Danach, z.B. nach dem
Anbringen metallischer Anschlusspunkte für die Schaltungselemente, werden die Halbleiterscheiben in einzelne,
praktisch identische, die Schaltungselemente enthaltende Halbleiterkörper unterteilt.
Die Halbleiterkörper werden dann mit Anschlussleitern und gegebenenfalls mit einer Umhüllung
versehen.
Die eingangs genannte Halbleiteranordnung
kann z.Bo eine whiskerlose Diode und das Schaltungselement
kann eine planare Diode sein.
In der Praxis bilden sich, insbesondere
beim Unterteilen einer Halbleiterscheibe in Halbleiterkörper, keine Splitter, die Kurzschluss herbeiführen,
z.B. dadurch, dass die Splitter einen unerwünschten leitenden Kontakt zwischen einem Anschlussleiter eines Diodengebietes
und einem anderen Diodengebiet herstellen.
Die Erfindung bezweckt u.a. die Bildung
des obengenannten Kurzschlusses wenigstens in erheblichem Masse zu vermeiden. Ihr liegt die Erkenntnis zugrunde,
dass dies möglich ist, wenn dafür gesorgt wird, dass gebildete Splitter an der Stelle ihrer Bildung an der
Oberfläche eines Halbleiterkörpers fixiert werden.
Die eingangs genannte Halbleiteranordnung
ist nach der Erfindung dadurch gekennzeichnet, dass frei
liegende Teile der Hauptflächen und der Seitenflächen
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mit einer Metallschicht versehen sind.
Vorzugsweise besteht die Metallschicht
aus einer stromlos abgelagerten Niekelschicht.
Nickelschichten können stromlos auf übliche Weise auf Halbleiterkörpern und auf etwa vorhandenen
metallischen Anschlusspunkten angebracht werden, wobei vermieden wird, dass das Nickel an elektrisch isolierenden
Schichten haftet, und wobei ein unerwünschter elektrischer Kontakt zwischen den Anschlusspunkten verhindert
wird.
Die Erfindung bezieht sich weiterhin auf
ein Verfahren zur Hei-stellung einer Halbleiteranordnung
nach der Erfindung, bei dem von einer Halbleiterscheibe ausgegangen wird, in der eine Vielzahl von Halbleiterschaltungselementen
gebildet wird, wonach die Halbleiterscheibe in die Schaltungselemente enthaltende Halbleiterkörper
unterteilt wird, dadurch gekennzeichnet, dass die Halbleiterkörper einem stromlosen Metallisierungsvorgang
unterworfen werden. ■
Dabei kann derart verfahren werden, dass
nach einer auf übliche Weise durchgeführten Unterteilung
der Halbleiterscheibe in die Halbleiterkörper diese Körper z.B. in ein stromloses Vernickelungsbad eingetaucht
werden.
Vorzugsweise wird die Halbleiterscheibe
z.B. mit Hilfe von Ultraschallschwingungen in einem stromlosen Metallisierungsbad in die Halbleiterkörper unterteilt,
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Dadurch wird erreicht, dass nahezu sofort
nach der Bildung von Splittern beim Unterteilen der Halbleiterscheibe
diese Splitter fixiert verden und Wanderung der Splitter praktisch unmöglich ist. Bei Anwendung eines
stromlosen Vernickelungsbades wurde gefunden, dass das Nickel gut auf den bei der Unterteilung frisch gebildeten
Oberflächen haftet und eine duktile Schicht bildet, wobei die Isolierschicht frei von Nickel bleibt.
Weiterhin bezieht sich die Erfindung auf
ein Verfahren, bei dem von einer Halbleiterscheibe ausgegangen wird, in der eine Vielzahl von Halbleiterschaltungselementen
gebildet wird, wobei die Halbleiterscheibe mit Nuten versehen und dann gemäss diesen Nuten in die
Schaltungselemente enthaltende Halbleiterkörper unterteilt wird, dadurch gekennzeichnet, dass die Oberflache
der Halbleiterscheibe und der Nuten mit einer Metallschicht versehen wird.
Es hat sich herausgestellt, dass es zur
Verhinderung von Splitterbildung genügt, wenn nur die Oberflache der Nuten und nicht die ganze bei der Unterteilung
der Halbleiterscheibe gebildeten Seitenflächen mit Metall überzogen wird.
Bei dem zuletzt genannten Verfahren kann die Halbleiterscheibe auf stromlosem Vege oder unter
Stromdurchgäng, z.B. durch A-blagerung von Rhodium, metallisiert
verden,
Die Erfindung wird nachstehend an einem
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Ausführungsbeispiel an Hand der Zeichnung näher erläutert.
Es zeigen:
Fig. 1 schematisch einen Schnitt durch
einen Teil einer Halbleiteranordnung der* eingangs genannten
Art,
Fig. 2 schematisch einen Schnitt durch
einen Teil einer Halbleiteranordnung nach der Erfindung, und
Fig. 3 schematisch eine Draufsicht auf
eine Anzahl Halbleiteranordnungen in einer Stufe der Herstellung nach dem erfindungsgemässen Verfahren.
Fig. 1 zeigt eine whiskerlose Diode mit
einem Siliciumkörper 1, der auf zwei einander gegenüber
liegenden Seiten Hauptflächen 2 und quer zu den Hauptflächen 2 Seitenflächen 3 aufweist. Der Siliciumkörpei-1
enthält ein N -Typ Substrat k und eine N-leitende epitaktische
Schicht 5, in der durch Diffusion einer den
P-Typ herbeiführenden Verunreinigung ein Gebiet 6 erhalten ist, das mit dem übrigen Teil des Siliciumkörpers eine
Diode bildet.
Die Diode ist mit elektrischen Anschlusspunkten 7 und 8 aus' einer Titansilber- bzw. Nickelsilbermetallisierung
versehen. Die Anschlusspunkte 7 und 8 sind
an der Oberfläche des Siliciumkörpers 1 durch eine elektrisch isolierende Siliciumoxidechicht 9 voneinander
getrennt.
Die Anschlusspunkte 7 und 8 sind mit
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- 6
Anschlussleitern 10 und 11 versehen, die aus je einem Nickel-Eisen-Kern 12 und einem Kupfermantel 13 bestehen.
Mit Λΐ± ist eine isolierende Glasumhüllung bezeichnet.
Bei der noch zu beschreibenden Herstellung der planaren Diode können sich Splitter bilden, die z.B. eine leitende
Verbindung zwischen der Oberfläche der epitaktischen
Schicht 5 und dem Anschlussleiter 10 herstellen können,
wodurch der PN-Übergang 15 kurzgeschlossen wird.
Um dies zu verhindern, sind nach der Erfindung frei liegende Teile der Hauptflächen 2 und der
Seitenflächen 3 mit einer auf stromlosem Wege niedergeschlagenen
Nickelschicht 16 versehen (siehe Fig. 2).
Auch die Anschlusspunkte 7 und 8 können
mit einer Nickelschicht 16 überzogen sein. Die Nickelschicht 16 fixiert bei der Herstellung gebildete Splitter.
Bei der Herstellung wird von einer mit einer epitaktischen Schicht versehenen N —leitenden
Siliciumscheibe 31 ausgegangen (Fig. 3), auf der auf übliche Weise eine elektrisch isolierende Siliciumoxidschicht
9 gebildet wird, die mit Hilfe einer Photoätztechnik mit Fenstern 32 an den jenigen Stellen versehen
wird, an denen die Scheibe 31 nachher in Siliciumkörper
unterteilt wird, während diese Isolierschicht weiter mit Fenstern 33 zum Diffundieren der den P-Typ herbeiführenden Verunreinigung versehen wird. Bei der Diffusionsbehandlung
werden die Gebiete 6 und I7 gebildet. Die Gebiete 6 werden auf übliche Weise mit elektrischen
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Anschlusspunkten 7 vorsehen, gleich wie das Substrat der
Siliciumscheibe 31· Dann wird die Siliciumscheibe längs
der Linien 34 und 35 in Siliciumkörper z.B. durch Kratzen
und Brechen unterteilt. Nach der Erfindung werden die Siliciumkörper einem stromlosen Metallisierungs- z.B.
Vernickelungsvorgang unterworfen.
Dazu kann ein an sich bekanntes stromloses
Vernickelungsbad verwendet werden. Dabei werden z.B. die Siliciumkörper 5 Minuten lang bei 900C in ein Vernickelungsbad
eingetaucht. Anschliessend werden die Siliciumkörper 10 Minuten lang auf 5100C in einer nicht-oxidierenden
Atmosphäre erhitzt, um aus dem Nickelbäd niedergeschlagenen Phosphor zu entfernen und die Haftung der Nickelschicht
zu verbessern. Schliesslich werden die Siliciumkörper noch 3 Minuten lang bei 9O0C im Vernickelungsbad
behandelt, um eine frische Nickeloberfläche und somit einen niedrigen Kontaktwiderstand mit den Anschlussleitern
zu erhalten. Die erhaltene Nickelscliicht weist eine Dicke
von einigen Zehnteln eines Mikrons auf.
Vorzugsweise'erfolgt die Unterteilung der
Halbleiterscheibe in dem stromlosen Metallisierungsbad z.B. mit Hilfe von Ultraschallschwingungen. Stromlos abgelagertes
Nickel z.B. haftet oft besonders gut an frisch gebildeten Bruchflächen, also gerade an denjenigen Stellen,
an denen sich Splitter bilden können.
Auf übliche Weise werden die Siliciumkörper
mit Anschlussleitern und einer Umhüllung versehen.
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τ 8 -
Es hat sich herausgestellt, dass der Anschluss infolge Kurzschluss durch Splitter bei Halbleiteranordnungen
nach der Erfindung oft um eine Grössenordnung niGdriger als bei bekannten Halbleiteranordnungen ist.
Es ist einleuchtend, dass sich die Erfindung nicht auf das beschriebene Ausführungsbeispiel beschränkt,
sondern dass im Rahmen der Erfindung viele Abwandlungen möglich sind.
So braucht die Unterteilung der Halbleiterschicht nicht durch Kratzen und Brechen zu erfolgen,
sondern können z.B. durch Sägen oder unter der Einwirkung eines Laserstrahls in der Halbleiterscheibe Nuten gebildet
werden, wonach die Halbleiterscheibe längs dieser Nuten
in die Halbleiterkörper unterteilt wird.
Nach der Bildung der Nuten und vor der
Unterteilung wird die Oberfläche der Halbleitprscheibe und der Nuten mit einer Metallschicht versehen. Eine
derartige Metallschicht kann z.B. durch elektrolytische Ablagerung von Rhodium angebracht werden.
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Claims (5)
1. J . Halbleiteranordnung mit einem Halbleiterkörper, der auf zwei einander gegenüber liegenden Seiten
Hauptflachen und quer zu den Hauptflachen Seitenflächen
aufweist, wobei in dem Halbleiterkörper mindestens ein Schaltungselement gebildet wird, das mit elektrischen
Ansclilusspunkten versehen ist, die an der Oberfläche des
Halbleiterkörpers durch eine elektrisch isolierende Schicht voneinander getrennt sind, dadurch gekennzeichnet, dass
frei liegende Teile der Hauptflächen und der Seitenflächen mit einer Metallschicht versehen sind.
2. Halbleiteranordnung nach Anspruch 1, dadurch gekennzeichnet, dass die Metallschicht aus einer
stromlos abgelagerten Nickelschicht besteht.
3. Verfahren zur Herstellung einer Halbleiteranordnung nach Anspruch 1 oder 2, bei dem von einer HaIbleiterscheibe
ausgegangen wird, in der eine Vielzahl von Halbleiterschaltungselementen gebildet wird, wobei die
Halbleiterscheibe dann in die Schaltungselemente enthaltende Halbleiterkörper unterteilt wird, dadurch gekennzeichnet,
dass die Halbleiterkörper einem stromlosen Metallisierungsvorgang unterworfen werden.
h. Verfahren nach Anspruch 3» dadurch gekennzeichnet,
dass die Halbleiterscheibe in einem stromlosen Metallisierungsbad in die Halbleiterlcorper unterteilt wird.
5· Verfahren nach Anspruch 3» bei dem von
einer Halbleiterscheibe ausgegangen wird, in der eine
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Vielzahl von HalbleiterSchaltungselementen gebildet wird,
wobei die Halbleiterscheibe mit Nuten versehen und dann längs dieser Nuten in die Schaltungselemente
enthaltende Halbleiterkörper unterteilt wird, dadurch gekennzeichnet, dass die Oberfläche der Halbleiterscheibe
und der Nuten mit einer Metallschicht versehen wird.
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NL (1) | NL7311226A (de) |
Cited By (2)
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---|---|---|---|---|
US4541000A (en) * | 1980-02-13 | 1985-09-10 | Telefunken Electronic Gmbh | Varactor or mixer diode with surrounding substrate metal contact and top surface isolation |
US4916716A (en) * | 1980-02-13 | 1990-04-10 | Telefunken Electronic Gmbh | Varactor diode |
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1973
- 1973-08-15 NL NL7311226A patent/NL7311226A/xx unknown
-
1974
- 1974-08-02 DE DE19742437197 patent/DE2437197A1/de active Pending
- 1974-08-12 IT IT2624874A patent/IT1019889B/it active
- 1974-08-13 FR FR7428045A patent/FR2241143A1/fr active Granted
- 1974-08-15 JP JP9379174A patent/JPS5051270A/ja active Pending
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US4541000A (en) * | 1980-02-13 | 1985-09-10 | Telefunken Electronic Gmbh | Varactor or mixer diode with surrounding substrate metal contact and top surface isolation |
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Also Published As
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---|---|
FR2241143A1 (en) | 1975-03-14 |
IT1019889B (it) | 1977-11-30 |
JPS5051270A (de) | 1975-05-08 |
NL7311226A (nl) | 1975-02-18 |
FR2241143B3 (de) | 1977-06-10 |
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