DE2014110A1 - Schaltungsanordnung zur Realisierung von logischen Funktionen - Google Patents
Schaltungsanordnung zur Realisierung von logischen FunktionenInfo
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Description
- Schaltungsanordnung zur Realisierung von logischen Funktionen Zusatz zu Patentanmeldung P 19 33 713.4, angem.: 28. 6. 1969 Die Hauptanmeldung P 19 33 713.4 bezieht sich auf eine Schaltungsanordnung zur Realisierung von logischen Funktionen durch die dynamische Verknüpfung von wechselspannungsförmigen Eingangssignalen mittels getrennter Eingangsübertrager und einem diesen Übertragern nachgeschalteten gemeinsamen, einen weiteren Übertrager aufweisenden Sperrschwingerschaltkreis, dessen Impulsspannung über eine in den Sekundärstromkreis des Sperrschwingerübertragers eingeschaltete Verstärker stufe dem Ausgang zugeführt wird.
- Eine derartige Schaltungsanordnung erfüllt-die Aufgabe, fehlersicher mit binärer Wirkung zu arbeiten. Jede Schaltungsanordnung für sich bildet einen togikbaustein.
- Unter Fehlersicherheit wird dabei verstanden, daß beim Auftreten beliebiger Fehler innerhalb und außerhalb der Bausteine niemals ein gefährlich fehlerhaftes Ausgangssignal auftreten darf. Führt ein Logikbaustein nach seiner logischen Funktion und den anliegenden Eingangsbedingungen am Ausgang ein O-Signal, so darf beim Auftreten eines inneren Defektes (Bauelementeausfall) kein L-Signal am ausgang auftreten. Führt der Baustein am Ausgang en L-Signal nach seiner logischen Funktion und den anliegenden Eingangssignalen, muß der Ausgang beim Auftreten eines innere. Fehlers nach O-Signal wechseln und in diesem Zustand bleiben, auch wenn die Eingangssignale erneut wechseln. Jeder Störungsfall bringt den Ausgang des fehlersicheren Bausteines in den Grundzustand "Null".
- Durch die in der Hauptpatentanmeldung aufgezeigte Schaltungsanordnung wird der Aufbau eines logischen Systems, bestehend aus UND-, ODER-, NICHT- und SPEICHER-Einheiten, ermöglicht.
- Für das Zusammenwirken mit gleichstromgekoppelten Logiksystemen, die nicht fehlersicher im Sinne der vorgenannten Definition sind, daß jedoch Anpassungsglieder benötigt, die die dynamischen Ausgangssignale der fehlersicheren Logik für die Weiterverarbeitung potentialgetrennt in statische Signale umformen.
- Aufgabe der vorliegenden Erfindung St es deshalb, basierend auf dem Gegenstand der Hauptpatentanmeldung, eine derartige Anpassungseinheit anzugeben, die die vorgenannte Forderung erfüllt.
- Diese Aufgabe wird gemaß der Ir-findung dadurch gelöst, daß zur Anpassung der Schaltungsanordung an gleichstromgekoppelte Logiksysteme die dynamischen Ausgangssignale potentialgetrennt durch einen mit de Ausgang verbundenen Ubertrager nach Gleichrichtung durch eine im Sekundärkreis des Übertragers eingeschaltete Diode zur Ansteuerung; einer aus einer Trsnsistor-Widerstandsanordnung bestehenden Negatorstufe dienen, die die dynamischen Ausgangssignale in statische Signale umformt.
- Die Erfindung sei nachstehend an Hand der Figur näher erläutert.
- In der Figur ist mit E der Eingang und mit A der Ausgang des Anpassungsgliedes bezeichnet. Der Eingang E führt auf einen Eingangsübertrager 1. In den Sekundärkreis dieses Ubertragers 1 ist eine Diode 2 eingeschaltet, die zur Gleichrichtung der übertragenen Eingangsimpulsspannungen dient. Nachgeschaltet ist eine aus den Widerständen 3 und 5 und dem Transistor 4 bestehende Negatorstufe, der die Kollektorversorgungsspannung +UB an der Klemme 6 zugeführt wird.
- Durch das Anpassungsglied wird folgende Verknüpfung realisiert: E = X bzw. z = A.
- Wird der Eingang E mit einem dynamischen Eingangssignal belegt, erscheint am Ausgang A ein statisches O-Signal.
- Wird der Eingang E mit O-Signal angesteuert oder der Eingang ist nicht angeschlossen, so gibt der Ausgang A ein statisches L-Signal ab. Diese Einheit arbeitet nicht mehr fehlersicher. Beim Auftreten einer Störung in der Schaltung (Bauelemente defekt) kann der Ausgang jeden möglichen Zustand (L- oder O-Signal) annehmen.
Claims (1)
- P a t e n t a n s S r u c h :Schaltungsanordnung zur Realisierung von logischen Funktionen durch die dynamische Verknüpfung von wechselspannungsförmigen Eingangssignalen mittels getrennter Eingangsübertrager und einem diesen Übertragern nachgeschalteten gemeinsamen, einen weiteren Ubertrager aufweisenden Sperrschwingerschaltkreis, dessen Impulsspannung über eine in den Sekundärstromkreis des Sperrschwingerübertragers eingeschaltete Verstärkerstufe dem Ausgang zugeführt wird, nach Patentanmeldung P 19 33 713.4, d a d u r c h g e k e n n z e i c h n e t daß zur Anpassung der Schaltungsanordnung an gleichstromgekoppelte Logiksysteme die dynamischen Ausgangssignale potentialgetrennt durch einen mit dem Ausgang verbundenen Übertrager (1) nach Gleichrichtung durch eine im Sekundärkreis des Übertragers eingeschaltete Diode (2) zur Ansteuerung einer aus einer Transistor-Widerstandsanordnung (3, 4, 5) bestehenden Negatorstufe dienen, die die dynamischen Ausgangssignale In statische Signale umformt.
Priority Applications (5)
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---|---|---|---|
DE19702014110 DE2014110C3 (de) | 1969-06-28 | 1970-03-19 | Schaltungsanordnung zur Realisierung von logischen Funktionen |
CH917470A CH508311A (de) | 1969-06-28 | 1970-06-17 | Schaltungsanordnung zur Realisierung von logischen Funktionen |
FR7023422A FR2053940A5 (de) | 1969-06-28 | 1970-06-24 | |
GB3119070A GB1321459A (en) | 1969-06-28 | 1970-06-26 | Circuit arrangement for realising logical functions |
US50609A US3654485A (en) | 1969-06-28 | 1970-06-29 | A.c. signal logic circuit |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
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DE19691933713 DE1933713B2 (de) | 1969-06-28 | 1969-06-28 | Schaltungsanordnung zur logischen verknuepfung wechsel spannungsfoermiger eingangssignale |
DE19702014110 DE2014110C3 (de) | 1969-06-28 | 1970-03-19 | Schaltungsanordnung zur Realisierung von logischen Funktionen |
Publications (3)
Publication Number | Publication Date |
---|---|
DE2014110A1 true DE2014110A1 (de) | 1971-09-30 |
DE2014110B2 DE2014110B2 (de) | 1978-08-31 |
DE2014110C3 DE2014110C3 (de) | 1979-10-31 |
Family
ID=25757585
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19702014110 Expired DE2014110C3 (de) | 1969-06-28 | 1970-03-19 | Schaltungsanordnung zur Realisierung von logischen Funktionen |
Country Status (1)
Country | Link |
---|---|
DE (1) | DE2014110C3 (de) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE2402880A1 (de) * | 1974-01-18 | 1975-07-31 | Licentia Gmbh | Elektronische schaltung zur zeitlichen normierung von elektrischen signalen |
-
1970
- 1970-03-19 DE DE19702014110 patent/DE2014110C3/de not_active Expired
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE2402880A1 (de) * | 1974-01-18 | 1975-07-31 | Licentia Gmbh | Elektronische schaltung zur zeitlichen normierung von elektrischen signalen |
Also Published As
Publication number | Publication date |
---|---|
DE2014110C3 (de) | 1979-10-31 |
DE2014110B2 (de) | 1978-08-31 |
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Legal Events
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---|---|---|---|
C3 | Grant after two publication steps (3rd publication) |