DE102012104731A1 - Mechanismen zum Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe - Google Patents
Mechanismen zum Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe Download PDFInfo
- Publication number
- DE102012104731A1 DE102012104731A1 DE102012104731A DE102012104731A DE102012104731A1 DE 102012104731 A1 DE102012104731 A1 DE 102012104731A1 DE 102012104731 A DE102012104731 A DE 102012104731A DE 102012104731 A DE102012104731 A DE 102012104731A DE 102012104731 A1 DE102012104731 A1 DE 102012104731A1
- Authority
- DE
- Germany
- Prior art keywords
- assembly
- molding compound
- semiconductor chip
- conductive
- metal contact
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 230000007246 mechanism Effects 0.000 title abstract description 6
- 150000001875 compounds Chemical class 0.000 claims abstract description 42
- 238000000465 moulding Methods 0.000 claims abstract description 42
- 229910052751 metal Inorganic materials 0.000 claims abstract description 39
- 239000002184 metal Substances 0.000 claims abstract description 39
- 239000004065 semiconductor Substances 0.000 claims description 72
- 239000000758 substrate Substances 0.000 claims description 23
- 238000000034 method Methods 0.000 claims description 18
- 239000012778 molding material Substances 0.000 claims description 4
- 229910000679 solder Inorganic materials 0.000 description 60
- 239000010410 layer Substances 0.000 description 38
- 239000000463 material Substances 0.000 description 10
- 230000000712 assembly Effects 0.000 description 9
- 238000000429 assembly Methods 0.000 description 9
- 229910052802 copper Inorganic materials 0.000 description 9
- 239000010949 copper Substances 0.000 description 9
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 8
- 239000004020 conductor Substances 0.000 description 8
- 230000008569 process Effects 0.000 description 7
- 238000005553 drilling Methods 0.000 description 6
- 238000004382 potting Methods 0.000 description 6
- 238000004806 packaging method and process Methods 0.000 description 5
- 238000004088 simulation Methods 0.000 description 5
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 4
- 238000004377 microelectronic Methods 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 239000003990 capacitor Substances 0.000 description 3
- 238000009826 distribution Methods 0.000 description 3
- 238000002955 isolation Methods 0.000 description 3
- 238000001465 metallisation Methods 0.000 description 3
- 230000007423 decrease Effects 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 230000005669 field effect Effects 0.000 description 2
- 239000012212 insulator Substances 0.000 description 2
- 230000010354 integration Effects 0.000 description 2
- 239000007788 liquid Substances 0.000 description 2
- 230000008018 melting Effects 0.000 description 2
- 238000002844 melting Methods 0.000 description 2
- 229910044991 metal oxide Inorganic materials 0.000 description 2
- 150000004706 metal oxides Chemical class 0.000 description 2
- 229920005989 resin Polymers 0.000 description 2
- 239000011347 resin Substances 0.000 description 2
- 239000010936 titanium Substances 0.000 description 2
- JYEUMXHLPRZUAT-UHFFFAOYSA-N 1,2,3-triazine Chemical compound C1=CN=NN=C1 JYEUMXHLPRZUAT-UHFFFAOYSA-N 0.000 description 1
- XQUPVDVFXZDTLT-UHFFFAOYSA-N 1-[4-[[4-(2,5-dioxopyrrol-1-yl)phenyl]methyl]phenyl]pyrrole-2,5-dione Chemical compound O=C1C=CC(=O)N1C(C=C1)=CC=C1CC1=CC=C(N2C(C=CC2=O)=O)C=C1 XQUPVDVFXZDTLT-UHFFFAOYSA-N 0.000 description 1
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 description 1
- UHNRLQRZRNKOKU-UHFFFAOYSA-N CCN(CC1=NC2=C(N1)C1=CC=C(C=C1N=C2N)C1=NNC=C1)C(C)=O Chemical compound CCN(CC1=NC2=C(N1)C1=CC=C(C=C1N=C2N)C1=NNC=C1)C(C)=O UHNRLQRZRNKOKU-UHFFFAOYSA-N 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- 241001424392 Lucia limbaria Species 0.000 description 1
- 229910000577 Silicon-germanium Inorganic materials 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 1
- LEVVHYCKPQWKOP-UHFFFAOYSA-N [Si].[Ge] Chemical compound [Si].[Ge] LEVVHYCKPQWKOP-UHFFFAOYSA-N 0.000 description 1
- 239000012790 adhesive layer Substances 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 230000004888 barrier function Effects 0.000 description 1
- 239000011230 binding agent Substances 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000000919 ceramic Substances 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 150000002118 epoxides Chemical class 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 239000000835 fiber Substances 0.000 description 1
- 239000011152 fibreglass Substances 0.000 description 1
- 239000000945 filler Substances 0.000 description 1
- 230000009970 fire resistant effect Effects 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 150000002344 gold compounds Chemical class 0.000 description 1
- 238000000227 grinding Methods 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 230000002452 interceptive effect Effects 0.000 description 1
- 229910052745 lead Inorganic materials 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 238000011068 loading method Methods 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 239000004033 plastic Substances 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 229920003192 poly(bis maleimide) Polymers 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 238000010992 reflux Methods 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000002904 solvent Substances 0.000 description 1
- 238000006467 substitution reaction Methods 0.000 description 1
- 229910052715 tantalum Inorganic materials 0.000 description 1
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 description 1
- MZLGASXMSKOWSE-UHFFFAOYSA-N tantalum nitride Chemical compound [Ta]#N MZLGASXMSKOWSE-UHFFFAOYSA-N 0.000 description 1
- -1 tape Substances 0.000 description 1
- 229920001187 thermosetting polymer Polymers 0.000 description 1
- 229910052718 tin Inorganic materials 0.000 description 1
- 229910052719 titanium Inorganic materials 0.000 description 1
- 238000001721 transfer moulding Methods 0.000 description 1
- 238000009736 wetting Methods 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/065—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L25/0657—Stacked arrangements of devices
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
- H01L21/565—Moulds
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/03—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/11—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L24/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L24/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/10—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers
- H01L25/105—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers the devices being of a type provided for in group H01L27/00
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/50—Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/033—Manufacturing methods by local deposition of the material of the bonding area
- H01L2224/0333—Manufacturing methods by local deposition of the material of the bonding area in solid form
- H01L2224/03334—Manufacturing methods by local deposition of the material of the bonding area in solid form using a preform
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/038—Post-treatment of the bonding area
- H01L2224/0383—Reworking, e.g. shaping
- H01L2224/0384—Reworking, e.g. shaping involving a mechanical process, e.g. planarising the bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/03—Manufacturing methods
- H01L2224/039—Methods of manufacturing bonding areas involving a specific sequence of method steps
- H01L2224/0391—Forming a passivation layer after forming the bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/0401—Bonding areas specifically adapted for bump connectors, e.g. under bump metallisation [UBM]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05075—Plural internal layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05099—Material
- H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/05138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/05147—Copper [Cu] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05099—Material
- H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/05163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
- H01L2224/05166—Titanium [Ti] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05099—Material
- H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/05163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
- H01L2224/05181—Tantalum [Ta] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/0556—Disposition
- H01L2224/05571—Disposition the external layer being disposed in a recess of the surface
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/06—Structure, shape, material or disposition of the bonding areas prior to the connecting process of a plurality of bonding areas
- H01L2224/061—Disposition
- H01L2224/0618—Disposition being disposed on at least two different sides of the body, e.g. dual array
- H01L2224/06181—On opposite sides of the body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/113—Manufacturing methods by local deposition of the material of the bump connector
- H01L2224/1133—Manufacturing methods by local deposition of the material of the bump connector in solid form
- H01L2224/11334—Manufacturing methods by local deposition of the material of the bump connector in solid form using preformed bumps
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/118—Post-treatment of the bump connector
- H01L2224/1183—Reworking, e.g. shaping
- H01L2224/1184—Reworking, e.g. shaping involving a mechanical process, e.g. planarising the bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/119—Methods of manufacturing bump connectors involving a specific sequence of method steps
- H01L2224/1191—Forming a passivation layer after forming the bump connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13005—Structure
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/1301—Shape
- H01L2224/13012—Shape in top view
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/1301—Shape
- H01L2224/13012—Shape in top view
- H01L2224/13013—Shape in top view being rectangular or square
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/1301—Shape
- H01L2224/13012—Shape in top view
- H01L2224/13014—Shape in top view being circular or elliptic
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/1302—Disposition
- H01L2224/13022—Disposition the bump connector being at least partially embedded in the surface
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/1302—Disposition
- H01L2224/13023—Disposition the whole bump connector protruding from the surface
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13075—Plural core members
- H01L2224/13078—Plural core members being disposed next to each other, e.g. side-to-side arrangements
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/13111—Tin [Sn] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/13113—Bismuth [Bi] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/13116—Lead [Pb] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/13139—Silver [Ag] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/13147—Copper [Cu] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/13155—Nickel [Ni] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16135—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/16145—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16135—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/16145—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
- H01L2224/16147—Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked the bump connector connecting to a bonding area disposed in a recess of the surface
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/17—Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
- H01L2224/171—Disposition
- H01L2224/1718—Disposition being disposed on at least two different sides of the body, e.g. dual array
- H01L2224/17181—On opposite sides of the body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32135—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/32145—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
- H01L2224/73204—Bump and layer connectors the bump connector being embedded into the layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/8119—Arrangement of the bump connectors prior to mounting
- H01L2224/81191—Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/8119—Arrangement of the bump connectors prior to mounting
- H01L2224/81193—Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed on both the semiconductor or solid-state body and another item or body to be connected to the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/818—Bonding techniques
- H01L2224/81801—Soldering or alloying
- H01L2224/81815—Reflow soldering
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06513—Bump or bump-like direct electrical connections between devices, e.g. flip-chip connection, solder bumps
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06517—Bump or bump-like direct electrical connections from device to substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/10—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
- H01L2225/1005—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/1011—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
- H01L2225/1017—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support
- H01L2225/1023—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support the support being an insulating substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/10—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
- H01L2225/1005—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/1011—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
- H01L2225/1047—Details of electrical connections between containers
- H01L2225/1058—Bump or bump-like electrical connections, e.g. balls, pillars, posts
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/10—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
- H01L2225/1005—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/1011—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
- H01L2225/1076—Shape of the containers
- H01L2225/1088—Arrangements to limit the height of the assembly
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49811—Additional leads joined to the metallisation on the insulating substrate, e.g. pins, bumps, wires, flat leads
- H01L23/49816—Spherical bumps on the substrate for external connection, e.g. ball grid arrays [BGA]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/562—Protection against mechanical damage
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/00014—Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/049—Nitrides composed of metals from groups of the periodic table
- H01L2924/0494—4th Group
- H01L2924/04941—TiN
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/049—Nitrides composed of metals from groups of the periodic table
- H01L2924/0495—5th Group
- H01L2924/04953—TaN
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/12—Passive devices, e.g. 2 terminal devices
- H01L2924/1204—Optical Diode
- H01L2924/12042—LASER
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1305—Bipolar Junction Transistor [BJT]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1306—Field-effect transistor [FET]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1306—Field-effect transistor [FET]
- H01L2924/13091—Metal-Oxide-Semiconductor Field-Effect Transistor [MOSFET]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/153—Connection portion
- H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
- H01L2924/15311—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Wire Bonding (AREA)
Abstract
Die vorliegende Anmeldung betrifft Ausführungsformen eines Mechanismus für das Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe erlauben kleinere Verbindungselemente mit kleinerem Abstand, was es erlaubt, kleinere Baugruppengrößen und weitere Verbindungselemente bereitzustellen. Die leitenden Elemente (117', 117A) auf einer Baugruppe sind teilweise in die Formmasse (121') der Baugruppe eingebettet, um an Kontakte (104A) oder Metallkontaktflächen (122C) einer anderen Baugruppe gebondet zu werden. Durch das Einbetten der leitenden Elemente (117', 117A) können diese kleiner hergestellt werden, und es gibt keine Lücke zwischen den leitenden Elementen (117', 117A) und der Formmasse (121'). Ein Abstand der Verbindungselemente kann bestimmt werden, indem eine Abstandstoleranz zu einer maximalen Breite der Verbindungselemente addiert wird. Verschiedene Arten von Kontakten auf der anderen Baugruppe können an die leitenden Elemente (117', 117A) gebondet werden.
Description
- Die vorliegende Erfindung betrifft Mechanismen zum Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe.
- Halbleitervorrichtungen werden bei einer Vielzahl von elektronischen Anwendungen verwendet, wie beispielsweise bei PC's, Mobiltelefonen, Digitalkameras und anderen elektronischen Gegenständen. Halbleitervorrichtungen werden typischerweise hergestellt, indem sequenziell isolierende oder dielektrische Schichten, leitende Schichten und Halbleiterschichten über einem Halbleitersubstrat abgeschieden und dann unter Verwendung von Lithographie strukturiert werden, um Schaltkreiskomponenten und Elemente auszubilden.
- Die Halbleiterindustrie verbessert stetig die Integrationsdichte von verschiedenen elektronischen Komponenten (z. B. Transistoren, Dioden, Widerstände, Kondensatoren, usw.), indem kontinuierlich die minimalen Strukturgrößen reduziert werden, was es erlaubt, mehr Komponenten in einen gegebenen Bereich zu integrieren. Diese kleineren elektronischen Komponenten erfordern bei einigen Anwendungen auch kleinere Baugruppen, die eine geringere Fläche und/oder eine geringere Höhe als frühere Baugruppen aufweisen.
- Dementsprechend wurden neue Packtechniken entwickelt, wie Baugruppe-auf-Baugruppe (Package an Package, PoP), bei der eine obere Baugruppe mit einem Vorrichtungschip an eine untere Baugruppe mit einem anderen Vorrichtungschip gebondet wird. Durch das Anwenden dieser neuen Packtechniken kann der Integrationslevel der Baugruppen erhöht werden. Bei diesen relativ neuen Typen von Packtechniken für Halbleiter ergeben sich Herausforderungen bezüglich der Herstellung.
- Für ein vollständigeres Verständnis der vorliegenden Erfindung und deren Vorteile wird nun auf die folgende Beschreibung in Verbindung mit den angehängten Zeichnungen Bezug genommen.
-
1A zeigt eine perspektivische Ansicht einer Baugruppe gemäß einigen Ausführungsformen. -
1B zeigt eine Schnittansicht eines Teils einer Baugruppe der1A entlang der Linie P-P gemäß einigen Ausführungsformen. -
1C zeigt eine vergrößerte Schnittansicht des Bereichs150 der1B gemäß einigen Ausführungsformen. -
1D zeigt eine Öffnung, die gemäß einigen Ausführungsformen unter Verwendung von Laserbohren ausgebildet wird, um ein Verbindungselement mit einem leitenden Objekt auszubilden. -
2A zeigt eine Chip-Baugruppe mit leitenden Elementen, die gemäß einigen Ausführungsformen in eine Formmasse eingebettet sind. -
2B zeigt, dass die Formmasse gemäß einigen Ausführungsformen teilweise entfernt ist, um leitende Elemente freizulegen. -
2C zeigt eine Chip-Baugruppe mit leitenden Elementen, die gemäß einigen Ausführungsformen in eine Formmasse eingebettet sind. -
3A –3F zeigen Schnittansichten von Baugruppen, die gemäß einigen Ausführungsformen basierend auf drei Prozessschritten zum Ausbilden von Verbindungselementen bearbeitet sind. -
4A zeigt eine Lötkugel über einer Metallkontaktfläche gemäß einigen Ausführungsformen. -
4B zeigt gemäß einigen Ausführungsformen ein Diagramm einer maximalen Lötkugelhöhe und eines Durchmessers als Funktion einer UBM(Unterhöckermetallisierung, engl. Under Bump Metallization, UBM)-Schichtgröße. -
5 zeigt die Höhe eines Verbindungselements nach einem Reflow als Funktion einer freigelegten Breite einer Lötkugel vor einem Reflow gemäß einigen Ausführungsformen. -
6A und6B zeigen zwei beispielhafte Baugruppen gemäß einigen Ausführungsformen für eine Belastungssimulation an deren Verbindungselementen. -
7A –7C zeigen verschiedene beispielhafte Ausführungsformen von Kontakten auf einer Baugruppe. - Entsprechende Bezugszeichen und Symbole in den verschiedenen Figuren beziehen sich im allgemeinen auf entsprechende Teile, soweit es nicht anderweitig angezeigt ist. Die Figuren sind gezeichnet, um die relevanten Aspekte der Ausführungsformen zu illustrieren, und sie sind nicht notwendigerweise maßstabsgetreu gezeichnet.
- Die Herstellung und die Verwendung von Ausführungsformen der vorliegenden Erfindung sind nachfolgend im Detail diskutiert. Die diskutierten Ausführungsformen sind lediglich illustrativ für besondere Art und Weisen, um die Erfindung herzustellen und zu verwenden, und sie begrenzen nicht den Schutzumfang der Erfindung.
-
1A zeigt eine perspektivische Ansicht einer Baugruppe100 mit einer Baugruppe110 , die an eine andere Baugruppe120 gebondet ist, die wiederum an ein Substrat130 gebondet ist. Jede Baugruppe, wie Baugruppe110 oder Baugruppe120 , umfasst wenigstens einen Halbleiterchip (nicht gezeigt). Der Halbleiterchip umfasst ein Substrat, wie es bei der Herstellung von integrierten Halbleiterschaltkreisen verwendet wird, und integrierte Schaltkreise können darin und/oder darauf ausgebildet sein. Das Halbleitersubstrat kann jede beliebige Ausgestaltung mit Halbleitermaterialien aufweisen, diese umfassend, aber nicht begrenzt auf, Bulk-Silizium, einen Halbleiterwaver, ein Silizium-auf-Isolator(silicon-on-insulator, SOI)-Substrat, oder ein Siliziumgermanium-Substrat. Andere Halbleitermaterialien mit Elementen der Gruppe III, IV und V können ebenfalls verwendet werden. Das Substrat130 kann weiter mehrere Isolationsstrukturen (nicht gezeigt) umfassen, wie Flachgraben-Isolationsstrukturen (shallow trench isolation, STI) oder Strukturen mit lokaler Oxidation von Silizium (local Oxidation of silicon, LOCOS). Die Isolationsstrukturen können die verschiedenen mikroelektronischen Elemente definieren und isolieren. Beispiele der verschiedenen mikroelektronischen Elemente, die im Substrat130 ausgebildet sein können, umfassen Transistoren (z. B. Metalloxidhalbleiter-Feldeffekttransistoren (MOSFET), komplementäre Metalloxidhalbleiter(CMOS)-Transistoren, bipolare Kontakttransistoren (bipolar junction transistor, BJT), Hochspannungstransistoren, Hochfrequenztransistoren, p-Kanal- und/oder n-Kanal-Feldeffekttransistoren (PFETs/NFETs), usw.), Widerstände, Dioden, Kondensatoren, Induktivitäten, Sicherungen, und andere geeignete Elemente. Verschiedene Arbeitsschritte werden ausgeführt, um die verschiedenen mikroelektronischen Elemente auszubilden, umfassend Abscheidung, Ätzen, Implantation, Photolithographie, Ausheizen, und andere geeignete Prozesse. Die mikroelektronischen Elemente sind untereinander verbunden, um die integrierte Schaltkreisvorrichtung zu bilden, wie eine logische Vorrichtung, Speichervorrichtung (z. B. SRAM), RF-Vorrichtung, Eingang/Ausgang(I/O)-Vorrichtung, System-auf-Chip(system-on-chip, SoC)-Vorrichtung, Kombinationen davon, und andere geeignete Arten von Vorrichtungen. - Das Substrat
130 kann aus einem Halbleiterwaver oder einem Teil eines Wavers bestehen. In einigen Ausführungsformen umfasst das Substrat130 Silizium, Galliumarsenid, Silizium-auf-Isolator (silicon-on-insulator, SoI) oder andere ähnliche Materialien. In einigen Ausführungsformen umfasst das Substrat130 auch passive Vorrichtungen, wie Widerstände, Kondensatoren, Induktivitäten und Ähnliches, oder aktive Vorrichtungen wie Transistoren. In einigen Ausführungsformen umfasst das Substrat130 weitere integrierte Schaltkreise. Das Substrat130 kann weiter Substratdurchgangskontaktierungen (through substrate vias, TSVs) umfassen und kann ein Interposer oder Zwischenelement sein. Weiter kann das Substrat130 aus anderen Materialien bestehen. Beispielsweise ist das Substrat130 in einigen Ausführungsformen eine Schaltkreisplatte mit multiplen Schichten. In einigen Ausführungsformen umfasst das Substrat130 auch Bismaleimidtriazin(BT)-Harz, FR-4 (ein Verbundmaterial, das aus gewobenen Fiberglasfasern mit einem Epoxidharzbinder besteht und das feuerresistent ist), Keramik, Glas, Plastik, Klebestreifen, Film, oder andere Trägermaterialien, die die leitenden Kontaktflächen oder Ebenen tragen können, die erforderlich sind, um leitende Anschlüsse aufzunehmen. - Die Baugruppe
110 ist über Verbindungselemente115 an die Baugruppe120 gebondet, und Baugruppe120 ist über Verbindungselemente125 an das Substrat130 gebondet.1B zeigt eine Schnittansicht eines Bereichs der Baugruppe der1A entlang der Linie P-P.1B zeigt Verbindungselemente115 und125 nahe dem Rand der Baugruppe100 . In einigen Ausführungsformen sind Verbindungselemente125 nahe dem Zentrum der Baugruppe120 vorhanden. Ein Bereich150 in1B ist durch ein Rechteck markiert, und Details des Bereichs150 sind gemäß einigen Ausführungsformen in1C gezeigt. -
1C zeigt Details des Bereichs150 der1B gemäß einigen Ausführungsformen. Baugruppe110 umfasst einen Halbleiterchipbereich A, der einen Halbleiterchip (nicht gezeigt) aufweist, der von einer Formmasse111 bedeckt ist. Die Formmasse111 befindet sich gemäß einigen Ausführungsformen anfänglich in einer flüssigen Form und wird getrocknet, nachdem sie auf den Halbleiterchip aufgetragen wurde, um wenigstens einen Teil des Halbleiterchips zu bedecken. Beispielsweise kann die Formmasse111 anfänglich Epoxid, eine Füllmasse (filler), ein Lösungsmittel, usw. umfassen. In einigen Ausführungsformen kann die Formmasse111 durch Transfervergießen ausgebildet werden, wo ein abgemessenes Vergussmaterial (gewöhnlicherweise eine Duroplaste) vorgeheizt wird, so dass es flüssig ist, bevor es auf das Substrat aufgetragen wird. Nach dem Auftragen wird das Vergussmaterial erhitzt, um den Vergussprozess zu vollenden. Verschiedene Harze können als Vergussmaterialien für das Ausbilden der Formmasse verwendet werden. - Baugruppe
110 umfasst auch einen Verteilungsbereich B mit Verbindungsstrukturen, wie einer oder mehrerer Verteilungsschichten (redistribution layers, RDLs), die Verbindungen zwischen dem Halbleiterchip in der Baugruppe und den Verbindungselementen115 herstellen. Ähnlich umfasst die Baugruppe120 einen Halbleiterchipbereich A* mit einem Halbleiterchip (nicht gezeigt), der in einer Formmasse121 eingebettet ist. Die Baugruppe120 umfasst ebenfalls einen Verteilungsbereich B* mit Verbindungsstrukturen, wie einer oder mehrerer Verteilungsschichten (RDLs), die Verbindungen zwischen dem Halbleiterchip in der Baugruppe und den Verbindungselementen125 herstellen. - Beispielhafte Mechanismen für das Ausbilden der Baugruppen
110 und120 sind in der am 8. September 2011 eingereichten US-Patentanmeldung Nr. 13/228,244 mit dem Titel ”Packaging Methods and Structures Using a Die Attach Film” dargelegt. -
1C zeigt, dass Verbindungselemente115 mit Metallkontaktflächen112 der Baugruppe110 und Metallkontaktflächen122 der Baugruppe120 in Kontakt stehen, und dass Verbindungselemente125 mit Metallkontaktflächen123 der Baugruppe120 und Metallkontaktflächen131 des Substrats130 in Kontakt stehen. Die Metallkontaktflächen112 sind elektrisch mit Vorrichtungen in einem Halbleiterchip (nicht gezeigt) in Baugruppe110 verbunden. Die Metallkontaktflächen122 sind elektrisch mit Vorrichtungen in einem Halbleiterchip (nicht gezeigt) in der Baugruppe120 verbunden.1C zeigt, dass Teile der Verbindungselemente115 in der Formmasse121 der Baugruppe120 eingebettet sind. Die Öffnungen für das Einbetten der Verbindungselemente115 werden gemäß einigen Ausführungsformen durch Laserbohren ausgebildet.1D zeigt eine Öffnung114 für das Einbetten eines Verbindungselements115 , die durch die Verwendung von Laserbohren ausgebildet wurde, um die Formmasse112 gemäß einigen Ausführungsformen zu entfernen. Die Öffnung114 weist ein Querschnittsprofil auf, das oben größer und unten kleiner ist, um das Platzieren eines leitenden Elements, wie einer Lötkugel, in der Öffnung zu vereinfachen. Aufgrund der Prozessbegrenzungen des Laserbohrens ist eine Breite W eines oberen Bereichs der Öffnung114 in einigen Ausführungsformen im Bereich von etwa 0,2 mm bis etwa 0,4 mm. Nach dem Ausbilden der Öffnung114 wird ein leitendes Objekt116 (durch die gestrichelte Linie angedeutet), wie eine Lötkugel, in der Öffnung114 platziert. Der Durchmesser des leitenden Objekts116 ist kleiner als die Breite W der Öffnung114 . Der Abstand zwischen dem oberen Bereich der Öffnung und dem leitenden Objekt116 ist der Abstand ”G”, wie in1D gezeigt ist. Nach einem Reflow (Rückfluss, Aufschmelzen) steht das leitende Objekt116 in Kontakt mit einem leitenden Material über der Metallkontaktfläche112 der Baugruppe110 , um Verbindungselemente115 auszubilden.1C zeigt, dass Verbindungselemente115 nach einem Reflow Metallkontaktflächen122 kontaktieren und eine Lücke ”O” zur oberen Oberfläche der Formmasse121 aufweisen. In einigen anderen Ausführungsformen können die leitenden Objekte116 einen direkten Kontakt mit Metallkontaktflächen112 herstellen, die kein anderes leitendes Material über ihrer Oberfläche aufweisen, um die Verbindungselemente115 auszubilden. - Der Abstand P von Verbindungselementen
115 ist durch die Breite W der Öffnungen114 begrenzt. In einigen Ausführungsformen ist die größte Breite W der Öffnung im Bereich von etwa 0,23 mm bis etwa 0,5 mm. In einigen Ausführungsformen ist der Abstand P in einem Bereich von etwa 0,35 mm bis etwa 0,6 mm. In einigen Ausführungsformen ist die Höhe H so gewählt, dass sie ausreichend ist, um die gesamte Baugruppenhöhe für einen Formfaktor gering zu halten. Die Höhe C zwischen den Baugruppen110 und120 wird auch durch die Größe der in den Öffnungen114 platzierten Verbindungselemente beeinflusst. In einigen Ausführungsformen ist die Höhe C in einem Bereich von etwa 0,25 mm bis etwa 0,35 mm. - Für ein vorteilhaftes Packen ist es wünschenswert, den Abstand P zwischen den Verbindungselementen zu reduzieren, um eine kleinere Baugruppengröße und zusätzliche Verbindungen zu ermöglichen. Deshalb sind neue Mechanismen für das Ausbilden der Verbindungselemente
115 mit kleinerem Abstand P wünschenswert.2A zeigt eine Chipbaugruppe120' mit leitenden Elementen117' , die gemäß einigen Ausführungsformen in eine Formmasse121' eingebettet sind. Die leitenden Elemente117' werden auf Metallkontaktflächen122 ausgebildet oder aufgebracht, bevor die Formmasse121' auf dem Bereich B* der Baugruppe120' ausgebildet wird. Beispielsweise können leitende Elemente117' auf Metallkontaktflächen122 galvanisiert und durch Reflow (Rückfluss, Aufschmelzen) in eine Kugelform gebracht werden. Danach wird die Formmasse121' über den leitenden Elementen117' ausgebildet. Alternativ können Metallkugeln auf Metallkontaktflächen122 platziert und an die Metallkontaktflächen122 gebondet werden, um leitende Elemente117' auszubilden. Die leitenden Elemente117' können aus jedem leitenden Material mit geringem Widerstand bestehen. Beispielsweise können sie aus einem Lötmittel (z. B. Lötzinn) bestehen, einer Lötmittel-Verbindung, Gold, einer Gold-Verbindung, usw.. Beispielhafte Elemente, die in einer Lötmittel-Verbindung enthalten sein können, umfassen Sn, Pb, Ag, Cu, Ni, Bi oder Kombinationen davon. -
2B zeigt, dass die Formmasse121' teilweise entfernt wurde, um die leitenden Elemente117' gemäß einigen Ausführungsformen freizulegen. Der Entfernungsprozess160 kann jeder anwendbare Prozess sein, wie Schleifen, Polieren, usw.. Die freigelegten leitenden Elemente117' weisen eine Breite W1 auf. Da die leitenden Elemente117' in der Formmasse121' eingebettet werden, bevor sie freigelegt werden, ist kein Laserbohren erforderlich, um die Öffnungen für die leitenden Elemente117' auszubilden. Im Ergebnis gibt es keine Lücke zwischen der oberen Oberfläche der Formmasse121' und den leitenden Elementen117' , wie es bei1C der Fall ist, wo eine Lücke ”O” vorhanden ist. Weiter kann die Größe (oder Breite) W1 der leitenden Elemente117' kleiner sein als die der leitenden Elemente116 , da sie nicht länger durch die Größe der Öffnung114 aufgrund der Beschränkung beim Laserbohren beeinflusst wird. Im Ergebnis kann der Abstand P1 kleiner als der Abstand P der1C sein. In einigen Ausführungsformen ist der Abstand P1 im Bereich von etwa 100 μm bis etwas 500 μm. In einigen Ausführungsformen ist eine Breite W1 in einem Bereich von etwa 100 μm bis etwa 400 μm, was gleich oder kleiner als die Breite W der Öffnungen der oben beschriebenen1D ist. - Bei einer alternativen Ausführungsform können die leitenden Elemente
117'' teilweise in der Formmasse eingebettet sein, und ein Teil der leitenden Elemente117'' kann freigelegt sein, wie in2C gezeigt ist. Eine Form oder ein Film können gegen die Formmasse121'' und die leitenden Elemente117'' während des Ausbildens der Formmasse121'' gedrückt werden, um zu ermöglichen, dass ein Teil der leitenden Elemente117'' freigelegt wird. Die Breite der freigelegten leitenden Elemente117'' ist W2. Da die leitenden Elemente117'' in der Formmasse121'' eingebettet sind, ist auch ein Abstand P2 der leitenden Elemente117'' kleiner als der Abstand P in der oben beschriebenen1C . In einigen Ausführungsformen ist der Abstand P2 in einem Bereich von etwa 100 μm bis etwa 500 μm. In einigen Ausführungsformen ist eine Breite W2 in einem Bereich von etwa 100 μm bis etwa 400 μm. -
3A zeigt eine Baugruppe110 A mit Kontakten104 A und eine Baugruppe120 A mit leitenden Elementen117 A gemäß einigen Ausführungsformen. Die Kontakte104 A sind ausgebildet, so dass sie Metallkontaktflächen122 A bedecken, und sie bestehen aus einem leitenden Material/leitenden Materialien. In einigen Ausführungsformen bestehen die Kontakte104 A aus einem Lötmittel (z. B. Lötzinn). Die leitende Elemente117 A der Baugruppe120 A werden in einigen Ausführungsformen durch einen unter Bezugnahme auf die2A und2B beschriebenen Prozess ausgebildet. Die Kontakte104 A und die leitenden Elemente117 A werden durch Reflow aneinander gebondet, um Verbindungselemente115 A auszubilden, wie gemäß einigen Ausführungsformen in3B gezeigt ist. Die Höhe eines Verbindungselements115 A ist HA. -
3C zeigt eine Baugruppe110 B mit Kontakten104 B und eine Baugruppe120 B mit leitenden Elementen117 B gemäß einigen Ausführungsformen. Die Kontakte104 B sind ausgebildet, so dass sie Metallkontaktflächen122 B bedecken, und sie bestehen aus einem leitenden Material/leitenden Materialien. In einigen Ausführungsformen bestehen die Kontakte104 B aus einem Lötmittel (z. B. Lötzinn). Die leitenden Elemente117 B der Baugruppe120 B werden in einigen Ausführungsformen durch einen Prozess ausgebildet, wie er in2C beschrieben ist. Die Kontakte104 B und die leitenden Elemente117 werden durch Reflow aneinander gebondet, um Verbindungselemente115 B auszubilden, wie in3D gemäß einigen Ausführungsformen gezeigt ist. Die Höhe der Verbindungselemente115 B ist HB. - In einigen alternativen Ausführungsformen weist die Baugruppe
110 C keine Kontakte (wie Kontakte104 B) auf den Metallkontaktflächen122 C auf, wie in3E gezeigt ist. Leitende Elemente117 C sind in direktem Kontakt mit den Metallkontaktflächen112 C, um Verbindungselemente115 C auszubilden, wie in3F gezeigt ist. Die Höhe der Verbindungselemente115 C ist HC. -
4A zeigt eine Lötkugel401 über einer Metallkontaktfläche405 nach einem Reflow gemäß einigen Ausführungsformen. Die Breite der Metallkontaktfläche405 ist etwa 200 μm, und sie umfasst eine UBM-Schicht (Unterhöckermetallisierungsschicht, under bump metallization (UBM) layer)402 . Die UBM-Schicht402 kann eine Klebeschicht und/oder eine Nässungsschicht umfassen. In einigen Ausführungsformen kann die UBM-Schicht402 auch als eine Diffusionssperrchicht dienen. In einigen Ausführungsformen umfasst die UBM-Schicht402 Titan (Ti), Titannitrid (TiN), Tantalnitrid (TaN), Tantal (Ta), oder Ähnliches. In einigen Ausführungsformen umfasst die UBM-Schicht402 weiter eine Kupferschicht (copper seed layer). - In einigen Ausführungsformen ist die Dicke der UBM-Schicht
402 in einem Bereich von etwa 0,05 μm bis etwa 0,5 μm. Die Lötkugel401 wird durch Reflow einer runden Lötkugel mit einem Durchmesser von etwa 250 μm über der UBM-Schicht402 ausgebildet. Das Lötmittel verteilt sich über die Oberfläche der UBM-Schicht402 und die Oberflächenspannung führt dazu, dass die Lötkugel401 einen Durchmesser von etwa 246 μm aufweist, wie in4A gezeigt ist. Die Höhe der Lötkugel401 ist etwa 216 μm. Das Profil der Reflow-Lötkugel auf einer UBM-Schicht kann durch Simulationswerkzeuge simuliert werden, wie SURFACE EVOLVER oder ANSYS FLUENT. SURFACE EVOLVER ist ein interaktives Programm für das Studieren von Oberflächen, die durch Oberflächenspannung und andere Energieskalen ausgebildet werden, und die verschiedenen Randbedingungen unterliegen. SURFACE EVOLVER wurde am THE GEOMETRY CENTER an der UNIVERSITY OF MINNESOTA entwickelt. ANSYS FLUENT ist ein Simulationswerkzeug von ANSYS INC., Canonsburg, Pennsylvania. Solche Simulationswerkzeuge können verwendet werden, um Lötkugeln mit verschiedenen Breiten und Höhen zu simulieren. -
4B zeigt ein Diagramm einer simulierten Lötkugelhöhe nach einem Reflow als Funktion des Durchmessers (also der maximalen Breite) und UBM-Größe (oder Breite) gemäß einigen Ausführungsformen. Die Kurve410 zeigt eine Kugelhöhe für verschiedene UBM-Größen, wenn die Durchmesser der Lötkugeln (vor dem Reflow) dieselben wie die Breiten (oder Größen) der darunterliegenden UBM-Schichten sind. Die Kurve410 zeigt, dass, wenn eine Lötkugel mit einem Durchmesser von 200 μm einen Reflow vollzieht, um an eine UBM-Schicht (kreisförmig) mit einem Durchmesser von 200 μm gebondet zu werden, die Kugelhöhe nach einem Reflow 152 μm ist. Wenn der Durchmesser der Kugel vor dem Reflow 250 μm ist, ist die Höhe nach dem Reflow (auf der 250 μm UBM-Schicht) 186 μm. Die Kurve420 zeigt, dass, wenn eine Lötkugel mit einem Durchmesser von 200 μm einen Reflow vollzieht, um an eine UBM-Schicht (kreisförmig) mit einem Durchmesser von 200 μm gebondet zu werden, die Kugelbreite nach einem Reflow 218 μm ist. Wenn der Durchmesser der Kugel vor dem Reflow 250 μm ist, ist die maximale Breite nach dem Reflow (auf der 250 μm UBM-Schicht) 274 μm. Da die Kugelgrößen vor dem Reflow für die Kurven410 und420 mit den Breiten (oder Größen) der UBM-Schichten korrelieren, sind die Kurven410 und420 linear. -
4B zeigt einen Datenpunkt411 , der die Kugelhöhe nach einem Reflow einer Kugel mit dem Durchmesser 250 μm vor dem Reflow angibt, die an eine UBM-Schicht mit einem Durchmesser von 150 μm gebondet wird. Der Datenpunkt411 zeigt, dass die Höhe 223 μm ist.4B zeigt auch einen Datenpunkt412 der maximalen Breite der Lötkugel nach einem Reflow. Der Datenpunkt412 zeigt, dass maximale Breite 256 μm ist. Die Datenpunkte411 und412 zeigen, dass die Höhe und der Durchmesser auch von der Kugelgröße vor dem Reflow abhängen. - Die Datenpunkte der maximalen Kugelbreiten nach dem Reflow helfen, den minimalen Abstand zu bestimmen, der erforderlich ist, um einen Kurzschluss zu verhindern. Eine Toleranz kann zu einer maximalen Breite addiert werden, um den minimalen Abstand für Verbindungselemente zu erhalten. Die Kurve
450 zeigt eine beispielhafte Kurve für den Abstand gemäß einigen Ausführungsformen. Eine Toleranz (M) ist zur maximalen Verbindungselementbreite addiert, und die gesamte Breite ist der minimale Abstand. Die Toleranz M kann sich mit der Kugelgröße (vor dem Reflow) ändern. In einigen Ausführungsformen ist die Toleranz M ein Prozentanteil der maximalen Breite der Reflow-Lötkugeln. In einigen Ausführungsformen ist die Toleranz M im Bereich von etwa 5% bis etwa 7% der maximalen Breite. In einigen Ausführungsformen ist die Toleranz M im Bereich von etwa 5% bis etwa 30% der maximalen Breite. -
5 zeigt eine simulierte Höhe HB von Verbindungselementen115 B nach einem Reflow als Funktion einer freigelegten Breite (oder Durchmesser) der Lötkugel W2 vor dem Reflow (wie in2C gezeigt) gemäß einigen Ausführungsformen. Die Datenpunkte mit gefüllten Dreiecken in5 sind Datenpunkte von Verbindungen, die durch die Baugruppe120 B und die Baugruppe110 B gebildet werden. Die Datenpunkte mit gefüllten Dreiecken befinden sich auf der Kurve510 . Die eingebetteten Lötkugeln in Baugruppe120 B für die Datenpunkte der Kurve510 weisen einen Durchmesser von 250 μm auf, und die UBM-Schicht weist ebenfalls einen Durchmesser von 250 μm auf. Die Lötkugeln für die Baugruppe110 B für die Datenpunkte der Kurve510 weisen einen Durchmesser von 200 μm auf, und die UBM-Schicht weist einen Durchmesser von 250 μm auf. Die Daten zeigen, dass die Höhe HB abnimmt, wenn die freigelegte Breite W2 der eingebetteten Lötkugeln zunimmt. - Die Kurve
520 umfasst Datenpunkte mit offenen Dreiecken für eingebettete Lötkugeln mit einem Durchmesser von 250 μm auf UBM-Schichten mit einem Durchmesser von 200 μm, was kleiner als 250 μm für Kurve510 ist. Der Durchmesser der Lötkugel für die Baugruppe110 B für Kurve520 ist ebenfalls 200 μm. Die Kurve520 überlappt fast mit Kurve510 , was zeigt, dass der Einfluss von verschiedenen UBM-Breiten minimal ist, wenn die Differenz 50 μm ist. -
5 zeigt auch einen Datenpunkt511 für Verbindungselemente115 C der3F , wenn die Baugruppe110 C nicht auf jeder Metallkontaktfläche112 C eine Lötkugel aufweist. Die Baugruppe120 C für Datenpunkt511 weist auch Lötkugeln mit einem Durchmesser von 250 μm auf einer UBM-Schicht mit einem Durchmesser von 200 μm auf. Ohne die Lötkugeln auf der Baugruppe120 C ist die Höhe der Verbindungselemente115 C um etwa 80 μm geringer (verglichen mit den Kurven510 und520 ).5 zeigt auch eine Kurve530 mit Datenpunkten mit gefüllten Quadraten. Die eingebetteten Lötkugeln in Baugruppe120 B für die Datenpunkte der Kurve530 weisen einen Durchmesser von 250 μm auf, und die UBM-Schicht weist einen Durchmesser von 200 μm auf. Die Preflow-Lötkugeln (Lötkugeln vor einem Reflow) auf der Baugruppe120 B für die Kurve530 sind kleiner als die Preflow-Lötkugeln auf der Baugruppe120 B der Kurven510 und520 . Die Lötkugeln für die Baugruppe110 B der Datenpunkte der Kurve530 weisen einen Durchmesser von 200 μm auf einer UBM-Schicht mit einem Durchmesser von 250 μm auf. Die Lötkugeln auf der Baugruppe110 B der Kurve530 sind ähnlich zu denen der Kurven510 und520 . Aufgrund der reduzierten Lötkugelgröße auf der Baugruppe120 B liegen die Datenpunkte auf der Kurve530 niedriger als die Datenpunkte auf den Kurven510 und520 . - Wie oben erwähnt ist es wünschenswert, eine kleinere Gesamtbaugruppenhöhe zu haben, um einen kleinen Formfaktor zu erreichen.
5 zeigt, dass größere freigelegte Breiten von eingebetteten Lötkugeln in einer geringeren Verbindungshöhe resultieren. Deshalb können die Breiten von freigelegten eingebetteten Lötkugeln erhöht werden, um kleinere Verbindungshöhen zu erreichen. Wenn die freigelegten Breiten gleich oder größer als 100 μm für die oben beschriebenen Baugruppen sind, ist die gesamte Verbindungshöhe gleich oder kleiner als etwa 300 μm. -
6A zeigt gemäß einigen Ausführungsformen eine Baugruppe100 A'' mit einer Baugruppe120 A'', die eingebettete Lötkugeln aufweist. Baugruppe100 A'' ist ähnlich zur oben beschriebenen Baugruppe100 , mit Ausnahme davon, dass die Baugruppe120 A'' ähnlich zu den2C ,3C und3E eingebettete Lötkugeln in einer Formmasse aufweist, anstelle davon, dass die Lötkugeln wie in1B in Laserbohrlöchern platziert sind.6B zeigt gemäß einigen Ausführungsformen eine Baugruppe100 B'' mit einer Baugruppe120 B'', die eingebettete Lötkugeln aufweist. Die Baugruppe100 B'' ist ähnlich zur Baugruppe100 A'' mit Ausnahme davon, dass die Lötkugeln auf der Baugruppe110 B'' ein Volumen aufweisen, das zweimal so groß ist wie das Volumen der Lötkugeln auf der Baugruppe100 A''. Im Ergebnis ist die Höhe HB'' der6B größer als die Höhe HA'' der6A . Eine Belastungssimulation zeigt, dass, wenn die Belastung an den Randverbindungselementen125 A'' als Referenzwert verwendet wird (das Belastungsverhältnis ist 1), das Belastungsverhältnis (stress ratio, SR) des Verbindungselements115 A'' 1,2 ist. Im Gegensatz dazu ist das Belastungsverhältnis des Randverbindungselements125 B'' der6B 1,17, was größer als das Belastungsverhältnis von 1 für das Randverbindungselement125 A'' der6A ist. Weiter ist das Belastungsverhältnis des Verbindungselements115 B'' 0,85, was kleiner als das Belastungsverhältnis von 1,2 des Verbindungselements115 A'' ist. - Der Unterschied in den Belastungsverhältnissen zwischen den zwei Strukturen entsteht aufgrund des zusätzlichen Lötmittelvolumens der Baugruppe
110 B'' (das Zweifache des Lötmittelvolumens der Baugruppe110' ) und der Höhe HB'', die größer als HA'' ist. In einigen Ausführungsformen wird das Volumen des Lötmittelmaterials in der Lötkugel auf der Baugruppe110 A'' oder110 B'' so gewählt, dass die optimale Herstellausbeute erzielt wird. Beispielsweise, wenn aufgrund einer hohen Belastung ein Risiko eines Brechens der Lötkugel auf den Randverbindungselementen besteht, wie bei125 B'', ist es wünschenswert, die Struktur in6A mit einem geringeren Lötmittelvolumen auf der Baugruppe110 A'' zu wählen und die Baugruppe-auf-Baugruppe-Höhe HA'' zu verringern. Auf der anderen Seite, wenn ein Brechen des Lötmittels der Randverbindungselemente125 B'' unbedeutend ist und ein Brechen des Lötmittels des Verbindungselements125 A'' von Bedeutung ist, sollte die Struktur der6B gewählt werden. Dies ist, da6B eine geringeren Belastung an den Verbindungselement125 A'' aufweist. Die entstehende Belastung wird, wie oben beschrieben, durch die Verwendung eines ANSYS-Belastungssimulators simuliert. - Die in den
3A –3D und6A –6B beschriebenen Baugruppenstrukturen zeigen obere Baugruppen110 A,110 B,110 A'' und110 B'' mit Kontakten104 , die Lötkugeln sind, und die an leitende Elemente117' ,117'' der unteren Baugruppen120 A,120 B,120 A'' und120 B'' gebondet sind. Die Kontakte104 können jedoch aus anderen leitenden Materialien bestehen und andere Formen aufweisen. Beispielsweise können die Kontakte104* Kupfersäulen sein, wie in7A gemäß einigen Ausführungsformen gezeigt ist. Kupfersäulen104* können auf einer UBM-Schicht102* ausgebildet sein, die gemäß einigen Ausführungsformen die Metallkontaktfläche112* bedeckt. Die Breite der Kupfersäule104* (W*) ist gemäß einigen Ausführungsformen im Bereich von etwa 100 μm bis etwa 250 μm. Die Höhe der Kupfersäule104* (H*) ist gemäß einigen Ausführungsformen im Bereich von etwa 10 μm bis etwa 200 μm. Alternativ können die Kontakte104** Kupfersäulen sein, die eine Breite aufweisen, die kleiner als die der UBM-Schicht102* ist, wie in7B gemäß einigen Ausführungsformen gezeigt ist. Es können gemäß einigen Ausführungsformen zwei oder mehrere solcher kleiner Kupfersäulen auf einer UBM-Schicht102** vorhanden sein, die die Metallkontaktfläche112** bedeckt.7C zeigt verschiedene Draufsichten von Kupfersäulen104** gemäß einigen Ausführungsformen. Wie in7C gezeigt ist, können zwei oder mehrere Kontakte104** mit verschiedenen Formen vorhanden sein. Beispielsweise können die Kontakte104** kreisförmige Säulen (Pfeiler, Stäbe) sein, verlängerte Säulen (Pfeiler, Stäbe), oder quadratische Säulen (Pfeiler, Stäbe) mit abgerundeten Ecken. Die in7C gezeigten Ausführungsformen sind lediglich Beispiele. Andere Konfigurationen sind möglich. Beispielsweise könnten die UBM-Schicht102** nicht kreisförmig sein, und könnte andere Formen aufweisen. - Die beschriebenen Ausführungsformen des Mechanismus zum Ausbilden von Verbindungselementen für eine Baugruppe-auf-Baugruppe erlauben kleinere Verbindungselemente mit kleinerem Abstand, was kleinere Baugruppengrößen und zusätzliche Verbindungen erlaubt, verglichen mit existierenden Verbindungselementen. Die leitenden Elemente auf einer Baugruppe sind teilweise in die Formmasse der Baugruppe eingebettet, um an Kontakte oder Metallkontaktflächen einer anderen Baugruppe gebondet zu werden. Durch das Einbetten der leitenden Elemente können diese kleiner sein, und es gibt keine Lücke zwischen den leitenden Elementen und der Formmasse. Ein Abstand der Verbindungselemente kann bestimmt werden, indem eine Abstandstoleranz zu einer maximalen Breite der Verbindungselemente addiert wird. Verschiedene Typen von Kontakten auf der anderen Baugruppe können an die leitenden Elemente gebondet werden.
- In einigen Ausführungsformen ist eine gepackte Halbleitervorrichtung bereitgestellt. Die gepackte Halbleitervorrichtung umfasst einen Halbleiterchip, der in eine Formmasse (Vergussmaterial) eingebettet ist, und ein leitendes Element, das in die Formmasse eingebettet ist. Das leitende Element ist auf einer Oberfläche der Formmasse freigelegt. Die gepackte Halbleitervorrichtung umfasst auch eine Metallkontaktfläche. Die Metallkontaktfläche kontaktiert das leitende Element und stellt eine elektrische Verbindung zu Vorrichtungen im Halbleiterchip her.
- In einigen anderen Ausführungsformen ist eine Halbleitervorrichtungsbaugruppe bereitgestellt. Die Halbleitervorrichtungsbaugruppe umfasst eine erste Halbleiterchipbaugruppe mit einem leitenden Element, das in eine Formmasse (Vergussmaterial) eingebettet ist. Das leitende Element ist auf einer Oberfläche der Formmasse freigelegt, und die Formmasse bedeckt wenigstens einen ersten Halbleiterchip. Die Halbleitervorrichtungsbaugruppe umfasst auch eine zweite Halbleiterchipbaugruppe mit einem leitenden Kontakt auf einer Oberfläche. Das leitende Element der ersten Halbleiterchipbaugruppe ist an den leitenden Kontakt der zweiten Halbleiterchipbaugruppe gebondet, um ein Verbindungselement zu bilden.
- In noch anderen Ausführungsformen ist ein Verfahren für das Ausbilden einer Halbleitervorrichtungsbaugruppe bereitgestellt. Das Verfahren umfasst das Vorbereiten einer ersten Halbleiterchipbaugruppe mit leitenden Elementen, die in eine Formmasse (Vergussmaterial) eingebettet sind, wobei die leitenden Elemente auf einer Oberfläche der Formmasse freigelegt sind. Das Verfahren umfasst auch das Bereitstellen der ersten Halbleiterchipbaugruppe. Das Verfahren umfasst weiter das Bereitstellen einer zweiten Halbleiterchipbaugruppe, und das Bonden des leitenden Elements der ersten Halbleiterchipbaugruppe an Kontakte auf der zweiten Halbleiterchipbaugruppe.
- Obwohl Ausführungsformen der vorliegenden Erfindung und ihre Vorteile im Detail beschrieben wurden, ist zu verstehen, dass verschiedene Änderungen und Ersetzungen durchgeführt werden können, ohne vom Schutzumfang der Erfindung abzuweichen, wie er in den angehängten Ansprüchen definiert ist.
Claims (10)
- Gepackte Halbleitervorrichtung, umfassend: einen Halbleiterchip, der in eine Formmasse (
121' ) eingebettet ist; ein leitendes Element (117' ), das in der Formmasse (121' ) eingebettet ist, wobei das leitende Element (117' ) an einer Oberfläche der Formmasse (121' ) freigelegt ist; und eine Metallkontaktfläche (122 ), wobei die Metallkontaktfläche (122 ) das leitende Element (117' ) kontaktiert und einen elektrischen Kontakt mit Vorrichtungen im Halbleiterchip herstellt. - Gepackte Halbleitervorrichtung nach Anspruch 1, umfassend: eine weitere Metallkontaktfläche, wobei die weitere Metallkontaktfläche ausgelegt ist, um an Kontakte eines Substrats gebondet zu werden.
- Gepackte Halbleitervorrichtung nach Anspruch 1 oder 2, wobei das leitende Element (
117' ) eine ebene Oberfläche aufweist, die mit einer Oberfläche der Formmasse (121' ) fluchtet. - Gepackte Halbleitervorrichtung nach Anspruch 1 oder 2, wobei das leitende Element (
121' ) eine gekrümmte Oberfläche aufweist. - Halbleitervorrichtungsbaugruppe, umfassend: eine erste Halbleiterchipbaugruppe (
120 A) mit einem leitenden Element (117 A), das in eine Formmasse eingebettet ist, wobei das leitende Element (117 A) an einer Oberfläche der Formmasse freigelegt ist, und wobei die Formmasse wenigstens einen ersten Halbleiterchip bedeckt; und eine zweite Halbleiterchipbaugruppe (110 A) mit einem leitenden Kontakt (104 A) auf einer Oberfläche, wobei das leitende Element (117 A) der ersten Halbleiterchipbaugruppe (120 A) an den leitenden Kontakt (104 A) der zweiten Halbleiterbaugruppe (110 A) gebondet ist, um ein Verbindungselement zu bilden. - Halbleitervorrichtungsbaugruppe nach Anspruch 5, wobei keine Lücke zwischen dem leitenden Element (
117 A) und der Formmasse vorhanden ist. - Halbleitervorrichtungsbaugruppe nach Anspruch 5 oder 6, weiter umfassend: eine Metallkontaktfläche (
122 A), die in der ersten Halbleiterchipbaugruppe (120 A) eingebettet ist, wobei das leitende Element (117 A) die Metallkontaktfläche (122 A) kontaktiert, und wobei die Metallkontaktfläche (122 A) elektrisch mit einer Vorrichtung in einem ersten Halbleiterchip in der ersten Halbleiterchipbaugruppe (120 A) verbunden ist. - Halbleitervorrichtungsbaugruppe nach Anspruch 7, weiter umfassend: weitere Metallkontaktfläche, wobei die andere Metallkontaktfläche ausgelegt ist, um an einen Kontakt eines Substrats gebondet zu werden.
- Verfahren für das Ausbilden einer Halbleitervorrichtungsbaugruppe, umfassend: Vorbereiten einer ersten Halbleiterchipbaugruppe (
120 A) mit leitenden Elementen (117 A), die in eine Formmasse eingebettet sind, wobei die leitenden Elemente (117 A) an einer Oberfläche der Formmasse freigelegt sind; Bereitstellen der ersten Halbleiterchipbaugruppe (120 A); Bereitstellen einer zweiten Halbleiterchipbaugruppe (110 A); und Bonden der leitenden Elemente (117 A) der ersten Halbleiterchipbaugruppe (120 A) an Kontakte (104 A) auf der zweiten Halbleiterchipbaugruppe (110 A). - Verfahren nach Anspruch 9, wobei das Vorbereiten der ersten Halbleiterchipbaugruppe (
120 A) umfasst: Platzieren von leitenden Elementen (117 A) über Metallkontaktflächen (122 A) auf einem ersten Halbleiterchip, wobei die Metallkontaktflächen (122 A) mit einer Vorrichtung auf dem ersten Halbleiterchip verbunden sind; und Planarisieren der eingebetteten leitenden Elemente (117 A) und der Formmasse, um die eingebetteten leitenden Elemente (117 A) freizulegen.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US13/406,031 US9418947B2 (en) | 2012-02-27 | 2012-02-27 | Mechanisms for forming connectors with a molding compound for package on package |
US13/406,031 | 2012-02-27 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102012104731A1 true DE102012104731A1 (de) | 2013-08-29 |
DE102012104731B4 DE102012104731B4 (de) | 2019-07-25 |
Family
ID=48950711
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102012104731.6A Active DE102012104731B4 (de) | 2012-02-27 | 2012-05-31 | Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser |
Country Status (4)
Country | Link |
---|---|
US (3) | US9418947B2 (de) |
CN (1) | CN103295986B (de) |
DE (1) | DE102012104731B4 (de) |
TW (2) | TWI567906B (de) |
Families Citing this family (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8624392B2 (en) | 2011-06-03 | 2014-01-07 | Taiwan Semiconductor Manufacturing Company, Ltd. | Electrical connection for chip scale packaging |
US9548281B2 (en) | 2011-10-07 | 2017-01-17 | Taiwan Semiconductor Manufacturing Company, Ltd. | Electrical connection for chip scale packaging |
US8912668B2 (en) | 2012-03-01 | 2014-12-16 | Taiwan Semiconductor Manufacturing Company, Ltd. | Electrical connections for chip scale packaging |
DE102012109922B4 (de) | 2012-04-16 | 2020-04-16 | Taiwan Semiconductor Manufacturing Co., Ltd. | Package-on-Package-Struktur und Verfahren zur Herstellung derselben |
US9219030B2 (en) | 2012-04-16 | 2015-12-22 | Taiwan Semiconductor Manufacturing Co., Ltd. | Package on package structures and methods for forming the same |
US9196573B2 (en) | 2012-07-31 | 2015-11-24 | Taiwan Semiconductor Manufacturing Company, Ltd. | Bump on pad (BOP) bonding structure |
US8829673B2 (en) | 2012-08-17 | 2014-09-09 | Taiwan Semiconductor Manufacturing Company, Ltd. | Bonded structures for package and substrate |
US9673161B2 (en) | 2012-08-17 | 2017-06-06 | Taiwan Semiconductor Manufacturing Company, Ltd. | Bonded structures for package and substrate |
CN104103536A (zh) * | 2014-07-15 | 2014-10-15 | 南通富士通微电子股份有限公司 | Pop封装方法 |
CN108807200A (zh) * | 2014-09-26 | 2018-11-13 | 英特尔公司 | 具有引线键合的多管芯堆叠的集成电路封装 |
JP6319026B2 (ja) * | 2014-09-29 | 2018-05-09 | 日亜化学工業株式会社 | 発光装置及びその製造方法 |
US9806066B2 (en) | 2015-01-23 | 2017-10-31 | Samsung Electronics Co., Ltd. | Semiconductor package including exposed connecting stubs |
US9761566B1 (en) * | 2016-04-13 | 2017-09-12 | Taiwan Semiconductor Manufacturing Company, Ltd. | Multi-die structure and method of forming same |
TWI611530B (zh) * | 2016-10-14 | 2018-01-11 | 鈺橋半導體股份有限公司 | 具有散熱座之散熱增益型面朝面半導體組體及製作方法 |
US10276481B2 (en) * | 2017-06-26 | 2019-04-30 | Taiwan Semiconductor Manufacturing Co., Ltd. | Package structure having a plurality of conductive balls having narrow width for the ball waist |
US20210265237A1 (en) * | 2020-02-20 | 2021-08-26 | Sumitomo Electric Industries, Ltd. | Semiconductor device and method for producing semiconductor device |
CN114664779A (zh) * | 2020-12-24 | 2022-06-24 | 江苏长电科技股份有限公司 | 具有电感器件的封装结构及其制造方法 |
CN117423664A (zh) * | 2022-07-08 | 2024-01-19 | 长鑫存储技术有限公司 | 半导体封装组件及制备方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19754372A1 (de) * | 1997-03-10 | 1998-09-24 | Fraunhofer Ges Forschung | Chipanordnung und Verfahren zur Herstellung einer Chipanordnung |
US20070200257A1 (en) * | 2006-02-25 | 2007-08-30 | Stats Chippac Ltd. | Stackable integrated circuit package system with multiple interconnect interface |
Family Cites Families (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6400574B1 (en) * | 2000-05-11 | 2002-06-04 | Micron Technology, Inc. | Molded ball grid array |
US20020151164A1 (en) | 2001-04-12 | 2002-10-17 | Jiang Hunt Hang | Structure and method for depositing solder bumps on a wafer |
US6908784B1 (en) * | 2002-03-06 | 2005-06-21 | Micron Technology, Inc. | Method for fabricating encapsulated semiconductor components |
KR100493063B1 (ko) | 2003-07-18 | 2005-06-02 | 삼성전자주식회사 | 스택 반도체 칩 비지에이 패키지 및 그 제조방법 |
EP1775059B1 (de) * | 2004-08-06 | 2015-01-07 | Hamamatsu Photonics K.K. | Laserbearbeitungsverfahren und halbleiterbauelement |
JP4541253B2 (ja) * | 2005-08-23 | 2010-09-08 | 新光電気工業株式会社 | 半導体パッケージ及びその製造方法 |
EP1790744A1 (de) * | 2005-11-28 | 2007-05-30 | Siemens Aktiengesellschaft | Verfahren zum Reparieren von Rissen in Bauteilen und Lotmaterial zum Löten von Bauteilen |
US7508012B2 (en) * | 2006-01-18 | 2009-03-24 | Infineon Technologies Ag | Electronic component and method for its assembly |
US7435619B2 (en) | 2006-02-14 | 2008-10-14 | Stats Chippac Ltd. | Method of fabricating a 3-D package stacking system |
SG149726A1 (en) * | 2007-07-24 | 2009-02-27 | Micron Technology Inc | Microelectronic die packages with metal leads, including metal leads for stacked die packages, and associated systems and methods |
US8349721B2 (en) * | 2008-03-19 | 2013-01-08 | Stats Chippac, Ltd. | Semiconductor device and method of forming insulating layer on conductive traces for electrical isolation in fine pitch bonding |
US8163597B2 (en) * | 2009-03-24 | 2012-04-24 | Stats Chippac, Ltd. | Semiconductor device and method of forming no-flow underfill material around vertical interconnect structure |
US8592995B2 (en) * | 2009-07-02 | 2013-11-26 | Taiwan Semiconductor Manufacturing Company, Ltd. | Method and structure for adhesion of intermetallic compound (IMC) on Cu pillar bump |
US8035235B2 (en) | 2009-09-15 | 2011-10-11 | Stats Chippac Ltd. | Integrated circuit packaging system with package-on-package and method of manufacture thereof |
US8198131B2 (en) | 2009-11-18 | 2012-06-12 | Advanced Semiconductor Engineering, Inc. | Stackable semiconductor device packages |
US8508954B2 (en) | 2009-12-17 | 2013-08-13 | Samsung Electronics Co., Ltd. | Systems employing a stacked semiconductor package |
US8446006B2 (en) * | 2009-12-17 | 2013-05-21 | International Business Machines Corporation | Structures and methods to reduce maximum current density in a solder ball |
US8508045B2 (en) * | 2011-03-03 | 2013-08-13 | Broadcom Corporation | Package 3D interconnection and method of making same |
US8779601B2 (en) * | 2011-11-02 | 2014-07-15 | Stmicroelectronics Pte Ltd | Embedded wafer level package for 3D and package-on-package applications, and method of manufacture |
US9412689B2 (en) * | 2012-01-24 | 2016-08-09 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor packaging structure and method |
-
2012
- 2012-02-27 US US13/406,031 patent/US9418947B2/en active Active
- 2012-05-09 TW TW105102818A patent/TWI567906B/zh active
- 2012-05-09 TW TW101116457A patent/TWI567899B/zh active
- 2012-05-31 DE DE102012104731.6A patent/DE102012104731B4/de active Active
- 2012-06-08 CN CN201210189750.9A patent/CN103295986B/zh active Active
-
2016
- 2016-08-08 US US15/230,695 patent/US10553561B2/en active Active
-
2020
- 2020-01-28 US US16/774,983 patent/US11282817B2/en active Active
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19754372A1 (de) * | 1997-03-10 | 1998-09-24 | Fraunhofer Ges Forschung | Chipanordnung und Verfahren zur Herstellung einer Chipanordnung |
US20070200257A1 (en) * | 2006-02-25 | 2007-08-30 | Stats Chippac Ltd. | Stackable integrated circuit package system with multiple interconnect interface |
Also Published As
Publication number | Publication date |
---|---|
US9418947B2 (en) | 2016-08-16 |
DE102012104731B4 (de) | 2019-07-25 |
CN103295986B (zh) | 2016-12-14 |
TW201620102A (zh) | 2016-06-01 |
US20200168583A1 (en) | 2020-05-28 |
TWI567906B (zh) | 2017-01-21 |
TWI567899B (zh) | 2017-01-21 |
US10553561B2 (en) | 2020-02-04 |
TW201336032A (zh) | 2013-09-01 |
US20130221522A1 (en) | 2013-08-29 |
US11282817B2 (en) | 2022-03-22 |
CN103295986A (zh) | 2013-09-11 |
US20160343691A1 (en) | 2016-11-24 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE102012104731B4 (de) | Halbleitervorrichtungsbaugruppe und Verfahren zum Ausbilden dieser | |
DE102019103993B4 (de) | Package mit Dummy-Dies zum reduzieren von Wölbungen im Package und Herstellungsverfahren dafür | |
DE102016101685B4 (de) | Verfahren zur herstellung eines integrierten fan-out-packages | |
DE102016102108B4 (de) | CoWoS-Dreischichtstruktur | |
DE102020120137B4 (de) | Halbleiterpackage und verfahren | |
DE102016100274B4 (de) | Verfahren und packages für struktur eines dreidimensionalen chip-stackings | |
DE102013101192B4 (de) | Halbleitergehäuse | |
DE112011105992B4 (de) | 3D-integriertes Halbleiterpaket mit Through-Mold-Kopplungsstrukturen der ersten Ebene und Verfahren zur Herstellung desselben | |
DE102016101770A1 (de) | Struktur und Bildungsverfahren für Chippaket | |
DE102019128460A1 (de) | Halbleiterpackages und verfahren für deren herstellung | |
DE102019115952A1 (de) | Halbleiter-packages | |
DE102019103952A1 (de) | Kreuzwafer-RDLs in konstruierten Wafern | |
DE102013104970A1 (de) | Gekapselte Halbleitervorrichtungen und Kapselungsvorrichtungen und -verfahren | |
DE102010036678A1 (de) | Multichip-Modul und Verfahren zu seiner Herstellung | |
DE102019118492A1 (de) | Eingebettete spannungsreglerstruktur undverfahren zum bilden derselben | |
DE102020100002B4 (de) | Fan-out-packages und verfahren zu deren herstellung | |
DE102019120381A1 (de) | Integriertes schaltungs-package und verfahren | |
DE102019117199A1 (de) | Fan-out-packages und verfahren zu deren herstellung | |
DE102019114074A1 (de) | Integriertes-schaltkreis-package und verfahren | |
DE102020124229A1 (de) | Halbleitervorrichtung und verfahren | |
DE102020130962A1 (de) | Halbleitervorrichtung und herstellungsverfahren | |
DE102018122228A1 (de) | Integriertes Multichip-Fan-Out-Package | |
DE102017122831A1 (de) | Gehäusestrukturen und Ausbildungsverfahren | |
DE102021120241A1 (de) | Packagestruktur, halbleitervorrichtung und verfahren zu deren herstellung | |
DE102017122096A1 (de) | Gehäusetrukturen und Ausbildungsverfahren |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final |