DE102010030742B4 - Phasenwechselspeicher in einem doppelreihigen Speichermodul - Google Patents

Phasenwechselspeicher in einem doppelreihigen Speichermodul Download PDF

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Abstract

System, umfassend: Ein doppelreihiges Speichermodul (DIMM – Dual Inline Memory Module) (200), das ein Phasenwechselspeicher-Modul (PCM-Modul – Phase Change Memory Module) (214) und ein DRAM – Modul (218) umfaßt; einen Speicherbus (240, 250), um elektronisch mit dem System zu verbinden, wobei das PCM-Modul (214) elektronisch parallel zum Speicherbus (240, 250) gekoppelt ist; einen dynamischen RAM-Cache-Speicher (DRAM – Dynamic Random Access Memory), um Schreibdaten des PCM-Modules (214) zwischenzuspeichern, welche bestimmten Adressen des DIMM (200) entsprechen, um die Häufigkeit des Auftretens von Programmier-Lösch-Zyklen des PCM-Moduls (214) zu begrenzen und/oder zu reduzieren; und einen Speicher, um ein BIOS (Basic Input/Output System) zu speichern, welches Parameter enthält, die dem PCM-Modul (214) entsprechen.

Description

  • ALLGEMEINER STAND DER TECHNIK
  • Erfindungsgebiet:
  • Der hierin offenbarte Gegenstand betrifft das Verwalten einer Speichereinheit.
  • Informationen:
  • Speichereinheiten werden in vielen Arten von Elektronikeinrichtungen, wie beispielsweise Computern, Mobiltelefonen, PDAs, Dataloggern, Spielen und Navigationsgeräten, verwendet. Unter solchen Elektronikeinrichtungen können verschiedene Arten von Speichereinheiten verwendet werden, wie etwa NAND- oder NOR-Flash, SRAM, DRAM und Phasenwechsel, um nur einige Beispiele zu nennen. Entsprechend den Steigerungen bei der Arbeitsgeschwindigkeit und den Cacheleitungsgrößen können Speichereinheiten in einer doppelreihigen Speichermodulkonfiguration (DIMM – Dual Inline Memory Module) verpackt sein. Beispielsweise kann ein derartiges DIMM, das als ein Hauptspeicher in einer Rechenplattform verwendet werden kann, eine Reihe von parallel auf dem DIMM montierten DRAM-Speichermodulen umfassen. Dementsprechend kann eine Lese-/Schreibanforderung an das DIMM über parallele DRAM-Module aufgeteilt werden, so daß individuelle DRAM-Module eine Teilmenge der Gesamtcacheleitungsanforderung liefern. Solche DRAM-Einheiten weisen in der Regel spezielle intrinsische Parameter auf, die mit der Lese-/Schreib-Zeitsteuerung, der Speicherseitengröße und/oder dem Adressierungsprotokoll assoziiert sind, um nur einige Beispiele zu nennen.
  • Aus der Patentschrift US 6,765,812 B2 ist ein erweitertes Speichermodul mit DRAM und Flash-Speichern bekannt.
  • In der Patentschrift US 6,000,006 A wird ein Flash-Speicher beschrieben, dessen logische Adressen in einem RAM den physikalischen Adressen zugeordnet werden.
  • Aus der Patentanmeldung US 2008/0094808 A1 ist ein Flash-Speicher mit ASCICs zum Multiplexen von Daten und Puffern von Adressen der Speicherdaten bekannt.
  • KURZE BESCHREIBUNG DER FIGUREN
  • Unter Bezugnahme auf die folgenden Figuren werden Ausführungsformen beschrieben, wobei sich in den verschiedenen Figuren gleiche Bezugszahlen auf gleiche Teile beziehen, sofern nicht etwas anderes angegeben ist.
  • 1 ist ein schematisches Diagramm einer Speicherkonfiguration gemäß dem Stand der Technik.
  • 2 ist ein schematisches Diagramm einer Speicherkonfiguration gemäß einer weiteren Ausführungsform.
  • 3 ist ein Zeitsteuerdiagramm eines Speichersteuerprozesses gemäß einer Ausführungsform.
  • 4 ist ein Flußdiagramm eines Speichersteuerprozesses gemäß einer Ausführungsform.
  • 5 ist eine schematische Ansicht eines Rechensystems und einer Speichereinheit gemäß einer Ausführungsform.
  • AUSFÜHRLICHE BESCHREIBUNG
  • Bei einer Ausführungsform kann eine Speichereinheit ein doppelreihiges Speichermodul (DIMM – Dual Inline Memory Module) umfassen, das Phasenwechselspeichermodule (PCM – Phase Change Memory) enthält. Solche PCM-Module können parallel auf einem DIMM montiert und mit diesem elektronisch verbunden sein. Bei einer Implementierung kann ein derartiges DIMM, das beispielsweise mindestens einen Abschnitt eines Hauptspeichers eines Rechensystems umfassen kann, einen Speicherbus zum Kommunizieren mit einem Speichercontroller enthalten. Durch einen derartigen Speicherbus kann ein Rechensystem mittels eines Speichercontrollers auf PCM-Module auf einem DIMM zugreifen.
  • Bei einer Ausführungsform kann ein DIMM dafür ausgelegt sein, mindestens teilweise auf der Basis von dynamischen RAM-Modulen (DRAM module – Dynamic Random Access Memory Module) elektronisch zu arbeiten. Beispielsweise kann ein DIMM ein oder mehrere DRAM-Stecksockel umfassen, um ein oder mehrere PCM-Module aufzunehmen. Als ein weiteres Beispiel können ein oder mehrere PCM-Module DRAM-Modusregister und/oder eine DRAM-Schnittstelle mit für ein DRAM ausgelegte Verbindungen umfassen. PCM-Module können in ein derartiges DIMM integriert werden, indem entsprechende Prozesse und/oder Parameter auf Speicherebene und/oder Systemebene verwendet werden, wie unten noch ausführlicher beschrieben ist. Beispielsweise kann ein Rechensystem ein BIOS (Basic Input/Output System) umfassen, das Parameter speichert, die PCM-Modulen entsprechen. Solche Parameter können beispielsweise Werte für Zeitsteuerung, Latenzzeiten und/oder Größe von PCM-Modulen umfassen. Bei einer bestimmten Implementierung braucht ein BIOS bei einem Systembootvorgang keine PCM-Module zu testen. Ein derartiges BIOS kann einen Low-Level-Driver enthalten, der konfiguriert ist, PCM-Module zu handhaben. Außerdem kann ein derartiges BIOS einen ausführbaren Code enthalten, um eine PCM-Modulidentifikation (ID) zu lesen und auf eine PCM-Modulkonfiguration zu reagieren. Als ein weiteres Beispiel können PCM-Module mit einer additiven Latenzzeit assoziiert sein, wodurch eine beispielsweise von einem Speichercontroller generierte Spaltenadresse an einen DIMM geliefert werden kann, unmittelbar nachdem der DIMM eine Zeilenadresse empfängt. Eine derartige additive Latenzzeit kann in ein Zeitsteuerverfahren von PCM-Modulen eingeführt werden, so daß konsekutive Lesebefehle, die an das PCM gerichtet sind, einander ohne Verzögerung und ohne das Einführen von Zeitsteuerlücken in ausgegebene Daten folgen, als Beispiel.
  • Im Allgemeinen können Schreib- oder Programmierprozesse verwendet werden, um Informationen in Speichereinheiten zu speichern, während ein Leseprozeß verwendet werden kann, um gespeicherte Informationen abzurufen. Gespeicherte Informationen können aus einem Teil oder aus einer ganzen Speichereinheit gelöscht und/oder neue Informationen können in einen Teil oder eine ganze Speichereinheit geschrieben werden. Relativ große Anzahlen von solchen Programmier-Lösch- und/oder Programmier-Reprogrammmier-Zyklen können die physische Integrität eines PCM verschlechtern. Beispielsweise kann durch Tausende von solchen Programmier-Lösch-Zyklen, die einem DIMM auferlegt werden, das PCM enthält, die Zuverlässigkeit des DIMM reduziert werden. Wenn ein derartiger PCM-Speicher verwendet wird, kann es nützlich sein, die Häufigkeit des Auftretens von Programmier-Lösch-Zyklen oder das „Cycling“ zu begrenzen und/oder zu reduzieren, dem ein PCM-Speicher ansonsten ausgesetzt sein kann. Dementsprechend kann bei einer Ausführungsform eine Technik zum Verwalten des Cycling von PCM-Modulen auf einem DIMM das Zwischenspeichern von Schreibdaten umfassen. Insbesondere kann eine Speichereinheit, wie etwa ein DRAM-Cache-Speicher, dazu verwendet werden, Schreibdaten zwischenzuspeichern, welchen bestimmten Adressen eines PCM-DIMM entsprechen. Eine Speichergröße eines derartigen DRAM-Cache-Speichers kann mindestens teilweise auf der Basis von Eigenschaften von PCM-Modulen gewählt werden, die ein PCM-DIMM umfassen. Zu solchen Eigenschaften kann beispielsweise die PCM-DIMM-Größe zählen. Solche Eigenschaften können beispielsweise Cycling-Spezifikationen von PCM, PCM-Ausfallrate, PCM-Schreibgeschwindigkeit, Schreibbenutzungsmodell eines ein PCM-DIMM enthaltenden Systems und/oder PCM-Schreibabnutzungsausgleichstechniken („Write Wear“), die verwendet werden, beinhalten. Als ein bestimmtes Beispiel kann eine Größe eines derartigen DRAM-Cache-Speichers im Bereich von etwa 100 KB bis zu mehreren Dutzenden Megabyte an RAM liegen.
  • Bei einer Implementierung kann ein PCM-DIMM PCM-Module enthalten, die in einem Baustein gestapelt sind, mit mehreren Speicherchips pro Baustein. Beispielsweise kann ein derartiger Baustein zwei, vier oder acht Chips pro Baustein enthalten, wobei ein, zwei, vier oder acht I/O-Pins bereitgestellt werden. Als Beispiel kann ein Ergebnis einer derartigen Implementierung sein, daß ein zusätzlicher PCM verwendet werden kann, ohne die Ausgangstreiber zusätzlich zu belasten. Falls außerdem ein PCM in einem DIMM mit einer kleineren Anzahl von Bänken (Partitionen) als der eines DRAM verwendet wird, können Bankadreßbits verwendet werden, um auf mehrere Bänke über mehrere PCM-Bauelemente hinweg zuzugreifen, wie unten noch ausführlicher erläutert wird.
  • 1 ist ein schematisches Diagramm eines DRAM-DIMM 100, das gemäß einer Ausführungsform mehrere DRAM-Module umfaßt, einschließlich DRAM 110, DRAM 120 und DRAM 130, die in der Figur gezeigt sind. Wenngleich acht DRAM-Module in einer bestimmten Ausführungsform enthalten sein können, kann ein DRAM-DIMM eine beliebige Anzahl an DRAM-Modulen enthalten. Beispielsweise kann ein neuntes DRAM-Modul vorliegen, um für eine Fehlerkorrektur zu sorgen. Individuelle DRAM-Module können eine Matrix von adressierbaren Speicherzellen umfassen, auf die zugegriffen wird, indem zuerst eine Zeilenadresse spezifiziert wird, wonach eine Spaltenadresse spezifiziert wird. Der Blockpfeil 150 stellt einen Adreßbus dar, durch den ein nicht gezeigter Speichercontroller eine Lese-/Schreibadresse an das DRAM-DIMM 100 liefern kann. Bei einer bestimmten Implementierung kann ein derartiger Adreßbus sechzehn Bit breit sein. Der Blockpfeil 160 stellt einen Datenbus dar, durch den parallele Daten von/zu DRAM-Modulen Lesedaten geliefert oder Schreibdaten empfangen werden können, und zwar zu/von dem Speichercontroller und/oder einem anderen Abschnitt eines nicht gezeigten Rechensystems. Bei einer bestimmten Implementierung kann ein derartiger Datenbus vierundsechzig Bit breit sein, um acht parallel geschaltete Acht-Bit-DRAM-Module zu berücksichtigen. Um eine bestimmte Stelle auf dem DRAM-DIMM 100 zu adressieren, kann ein Aktivieren-Befehl, welcher unten eingehender erörtert wird, von einer Zeilenadresse begleitet sein, die den DRAM-Modulen 110 bis 130 beispielsweise durch einen Speichercontroller geliefert wird, und zwar auf einem durch Blockpfeile 140 dargestellten Bus. Ein derartiger Zeilenadressbus 140 kann parallel zu individuellen DRAM-Modulen verbunden sein. Nach dem Bereitstellen einer Zeilenadresse kann ein Speichercontroller einen Lese-/Schreibbefehl generieren, der von einer Spaltenadresse begleitet wird, die an die individuellen DRAM-Module über einen Bus geliefert wird, der von Blockpfeilen 170 dargestellt wird. Natürlich sind solche Merkmale und Details eines DRAM-DIMM lediglich Beispiele.
  • 2 ist eine Diagrammansicht eines PCM-DIMM 200, das gemäß einer Ausführungsform mehrere PCM-Module umfaßt, einschließlich PCM 214, PCM 218, PCM 224 und PCM 228. Das PCM-DIMM 200 kann dafür ausgelegt sein, mindestens teilweise auf der Basis von DRAM-Modulen elektronisch zu arbeiten. In einem derartigen Fall kann mehr als ein PCM-Modul anstelle eines DRAM-Moduls verwendet werden, und zwar mindestens teilweise in Abhängigkeit von der Anzahl von Speicherbänken in individuellen PCM-Modulen. Dementsprechend kann das PCM-DIMM 200 einen Speicherort 210 umfassen, wo PCM 214 und/oder PCM 218 anstelle eines DRAM-Moduls verwendet werden, und einen Speicherort 220, wo PCM 224 und/oder PCM 228 anstelle eines anderen DRAM-Moduls verwendet werden können. Hier bezieht sich ein Speicherort auf eine Stelle eines PCM-DIMM 200, wo elektronische Verbindungen zwischen PCM-DIMM 200 und einem DRAM- oder PCM-Modulen hergestellt werden können. Bei einer besonderen Implementierung kann ein PCM-Modul mehr elektronische Verbindungen als ein DRAM-Modul beinhalten. Beispielsweise kann das PCM-DIMM 200 PCM-Module enthalten, die vier Bänke und Drei-Bit-Bankadressen (die in der Lage sind, bis zu acht Bänke zu adressieren) aufweisen; dann kann auf jeweils zwei PCM-Einheiten mit vier Bankadressen zugegriffen werden. Dementsprechend kann bei einer besonderen Implementierung ein PCM-DIMM mit Bankadreßbits versehen werden, die mehreren Speicherbänken über mehrere PCM-Einheiten hinweg entsprechen. Natürlich können solche Speicherorte mehr oder weniger als die Anzahl von PCM-Modulen enthalten, die in dem vorliegenden Ausführungsbeispiel gezeigt und beschrieben sind. Analog kann das PCM-DIMM 200 mehr oder weniger als die Anzahl von solchen Speicherorten enthalten, die in dem vorliegenden Ausführungsbeispiel gezeigt und beschrieben sind.
  • Ähnlich zu den oben beschriebenen DRAM-Modulen können individuelle PCM-Module eine Matrix von adressierbaren Speicherzellen umfassen, auf die zugegriffen werden kann, indem zuerst eine Zeilenadresse spezifiziert wird, wonach eine Spaltenadresse spezifiziert wird. Der Blockpfeil 240 stellt einen Adreßbus dar, durch den ein nicht gezeigter Speichercontroller eine Lese-/Schreibadresse an das PCM-DIMM 200 liefern kann. Bei einer bestimmten Implementierung kann ein derartiger Adreßbus beispielsweise sechzehn Bit breit sein. Der Blockpfeil 250 stellt einen Datenbus dar, durch den parallele Daten von/zu PCM-Modulen Lesedaten liefern oder Schreibdaten empfangen können, und zwar zu/von dem Speichercontroller und/oder einem anderen Abschnitt eines nicht gezeigten Rechensystems. Bei einer bestimmten Implementierung kann ein derartiger Datenbus vierundsechzig Bit breit sein, um acht parallele Gruppen von PCM-Modulen zu berücksichtigen, wobei jede Gruppe acht parallel geschaltete Bit aufweist. Um eine bestimmte Stelle auf dem PCM-DIMM 200 zu adressieren, kann ein Aktivieren-Befehl, welcher unten eingehender beschrieben wird, von einer Zeilenadresse begleitet sein, die den PCM-Modulen 214 bis 228 beispielsweise durch einen Speichercontroller geliefert wird, und zwar auf einem durch Blockpfeile 230 dargestellten Bus. Ein derartiger Adreßbus 230 kann parallel zu individuellen PCM-Modulen verbunden sein. Nach dem Bereitstellen einer Zeilenadresse kann ein Speichercontroller einen Lese-/Schreibbefehl generieren, der von einer Spaltenadresse begleitet wird, die an die individuellen Speicherorte 210 bis 220 über einen Bus 230 geliefert wird. Eine derartige Spaltenadresse, die von einem Lese-/Schreibbefehl begleitet ist, kann auch an individuelle PCM-Module 214 bis 228 über einen durch Blockpfeile 260 dargestellten Bus geliefert werden. Natürlich sind solche Merkmale und Details eines PCM-DIMM lediglich Beispiele.
  • 3 ist ein Zeitsteuerdiagramm eines Speichersteuerprozesses 300, und 4 ist ein Flußdiagramm eines Speichersteuerprozesses 400 gemäß einer Ausführungsform. Das folgende beschreibende Beispiel basiert auf dem Speichersteuerprozeß 300 und dem Speichersteuerprozeß 400, umfassend den gleichen Prozeß. Wie in 3 gezeigt, kann ein Taktsignal 305 eine Zeitsteuerung von Speicherprozessen bilden. Als Beispiel kann bei Block 410 ein Speichercontroller einen Aktivieren-Befehl 310 erteilen, um eine Seite oder Speicherbank eines PCM-Moduls, wie etwa des in 2 gezeigten PCM-Moduls 214, zu öffnen. Während einer derartigen Aktivieren-Phase kann ein PCM-Modul eine Zeilenadresse 315 von einem Speichercontroller empfangen, wie in Block 420. Bei den Blöcken 430 und 440 kann ein Speichercontroller eine Lese-Anweisung 320 und eine Spaltenadresse 325 ausgeben, wodurch eine Speicheradresse (Zeile und Spalte) von einer oder mehreren Speicherzellen geliefert wird, von wo Daten ausgelesen werden sollen. Bei einer bestimmten Implementierung kann eine additive Latenzzeit verwendet werden, um die Speicherprozeßplanung zu verbessern: Eine Zeilenadresse und eine Spaltenadresse können Rücken an Rücken ausgegeben werden, wodurch beispielsweise Zeitsteuerlücken in ausgegebenen Daten vermieden werden. Solche Zeitsteuerlücken können jedoch bei einigen Anwendungen wünschenswert sein. Beispielsweise, wenngleich in 3 nicht gezeigt, können zwischen dem Aktivieren-Befehl 310 und der Leseanweisung 320 ein oder mehrere Taktzyklen vorliegen. Im einzelnen kann unter Verwendung der CAS-Latenzzeit (CAS – Column Address Strobe) und/oder der additiven Latenzzeit eine Leseanweisung unmittelbar nach einem Aktivieren-Befehl ausgegeben werden. Eine derartige Leseanweisung braucht nicht intern mit einer vorbestimmten Anzahl von Taktzyklen verzögert zu werden (deshalb additive Latenzzeit), bevor sie ausgeführt wird. Weil ein derartiger Zeitsteuerprozeß ohne die Notwendigkeit für einen zusätzlichen Befehl ausgeführt wird, kann eine Kollision unter Speicheranweisungen vermieden werden.
  • Wenngleich nicht für eine oder mehrere hierin beschriebene Ausführungsformen benötigt, kann ein Wert für additive Latenzzeit in einem Modusregister des PCM-Moduls gespeichert sein. Dementsprechend läuft bei Block 450 eine Periode tCCD ab, bevor eine andere Leseanweisung 330 ausgegeben wird, bei Block 460. Gleichzeitig kann eine weitere Spaltenadresse wie bei Block 470, ausgegeben werden. Nach einer oder mehreren Latenzzeiten, wie beispielsweise Leselatenzzeit und Spaltenadressierungslatenzzeit, können sich Daten 340 von der Leseanweisung 320 und Daten 350 von der Leseanweisung 330 ergeben. Bei einer Implementierung kann sich ein Prozeß des Bereitstellens von Spaltenadressen und des Lesens eines Speichers bei den entsprechenden Adressen so lange wiederholen, bis beispielsweise eine letzte Spalte der geöffneten Seite erreicht wird, wie bei Block 480 geprüft wird. In einem derartigen Fall kann ein weiterer Aktivieren-Befehl von einem Speichercontroller ausgegeben werden, um eine weitere Seite zu öffnen. Wie oben angegeben, können PCM-Module in ein DIMM integriert sein, das dafür ausgelegt ist, mindestens teilweise auf DRAM-Modulen basierend elektronisch zu arbeiten. Um solche PCM-Module zu berücksichtigen, können entsprechende Prozesse und/oder Parameter auf Speicherebene und/oder Systemebene implementiert werden. Beispielsweise kann auf Systemebene ein BIOS Parameter aus einem oder mehreren Modusregistern abrufen, die in PCM-Modulen oder einem anderen Speicher gespeichert sind. Solche Parameter, die Werte für Leselatenzzeit, Schreiblatenzzeit, CAS-Latenzzeit, die Zeit vom internen Lesebefehl zu den ersten Daten, die Verzögerung beim Aktivieren zum internen Lesen/Schreiben und/oder additive Verzögerung umfassen, um nur einige Beispiele zu nennen, können den PCM-Modulen entsprechen.
  • 5 ist ein schematisches Diagramm, das ein Ausführungsbeispiel eines Rechensystems 500 mit einer Speichereinheit 510 darstellt. Eine Recheneinrichtung 504 kann repräsentativ sein für eine beliebige Einrichtung, ein beliebiges Gerät oder eine beliebige Maschine, die konfiguriert werden können, um die Speichereinheit 510 zu verwalten. Die Speichereinheit 510 kann einen Speichercontroller 515 und einen Speicher 522 enthalten. Als Beispiel, kann die Recheneinrichtung 504 folgendes beinhalten: eine oder mehrere Recheneinrichtungen und/oder -plattformen, wie zum Beispiel einen Desktop-Computer, einen Laptop-Computer, eine Workstation, eine Server-Einrichtung oder dergleichen; ein oder mehrere persönliche Rechen- oder Kommunikationseinrichtungen oder -geräte wie etwa zum Beispiel einen Personal Digital Assistant, eine mobile Kommunikationseinrichtung oder dergleichen; ein Rechensystem und/oder assoziierte Service-Provider-Fähigkeit, wie etwa zum Beispiel einen Provider/ein System für Datenbank- oder Datenbankspeicherungsdienst und/oder eine beliebige Kombination davon.
  • Es ist zu erkennen, daß alle oder ein Teil der im System 500 gezeigten verschiedenen Einrichtungen und der Prozesse und Verfahren, wie hierin weiter beschrieben, implementiert werden können, wobei Hardware, Firmware, Software oder eine beliebige Kombination davon verwendet wird oder enthalten sein kann. Deshalb kann beispielhaft die Recheneinrichtung 504 mindestens eine Verarbeitungseinheit 520 enthalten, die durch einen Bus 540 und einen Host oder Speichercontroller 515 operativ an den Speicher 522 gekoppelt ist. Die Verarbeitungseinheit 520 ist repräsentativ für eine oder mehrere Schaltungen, die konfiguriert werden können, um mindestens einen Abschnitt einer Datenrechenprozedur oder eines Datenrechenprozesses auszuführen. Als Beispielkann die Verarbeitungseinheit 520 einen oder mehrere Prozessoren, Controller, Mikroprozessoren, Mikrocontroller, applikationsspezifische integrierte Schaltungen, Digitalsignalprozessoren, programmierbare Logikbauelemente, feldprogrammierbare Gatearrays und dergleichen oder eine beliebige Kombination davon enthalten. Als Beispiel kann die Verarbeitungseinheit 520 mit dem Speichercontroller 515 kommunizieren, um speicherbetreffende Operationen wie etwa Lesen, Schreiben und/oder Löschen sowie oben erörterte Speicherpartitionsprozesse zu verarbeiten. Die Verarbeitungseinheit 520 kann ein Betriebssystem enthalten, das dafür ausgelegt ist, mit dem Speichercontroller 515 zu kommunizieren. Ein derartiges Betriebssystem kann beispielsweise Befehle generieren, die über den Bus 540 an den Speichercontroller 515 gesendet werden können. Solche Befehle können beispielsweise Lese-/Schreibanweisungen enthalten. Die Recheneinrichtung 504 kann ein BIOS (Basic Input/Output System) umfassen, das Parameter speichert, die PCM-Modulen entsprechen, die mit einer additiven Latenzzeit assoziiert sein können, die es einer, beispielsweise vom Speichercontroller 515 generierten, Spaltenadresse ermöglicht, an einen DIMM geliefert zu werden, unmittelbar nachdem der DIMM eine Zeilenadresse empfängt.
  • Der Speicher 522 ist repräsentativ für einen beliebigen Datenspeicherungsmechanismus. Der Speicher 522 kann beispielsweise einen Primärspeicher 524 und/oder einen Sekundärspeicher 526 enthalten. Bei einer besonderen Ausführungsform kann der Speicher 522 ein PCM-DIMM umfassen, wie oben beschrieben. Insbesondere kann der Primärspeicher 524 beispielsweise einen Direktzugriffsspeicher, einen Festwertspeicher usw. enthalten. Wenngleich der Primärspeicher 524 bei diesem Beispiel als von der Verarbeitungseinheit 520 getrennt dargestellt ist, versteht sich, daß er ganz oder teilweise innerhalb der Verarbeitungseinheit 520 vorgesehen oder anderweitig an gleicher Stelle angeordnet und/oder gekoppelt sein kann.
  • Gemäß einer Ausführungsform können ein oder mehrere Abschnitte des Speichers 522 Signale speichern, die repräsentativ sind für Daten und/oder Informationen, wie durch einen bestimmten Zustand des Speichers 522 ausgedrückt. Beispielsweise kann ein Elektroniksignal, das Daten und/oder Informationen repräsentiert, in einem Abschnitt des Speichers 522 „gespeichert“ werden, indem der Zustand von solchen Abschnitten des Speichers 522 beeinflußt oder geändert wird, um Daten und/oder Informationen als binäre Informationen (zum Beispiel Einsen und Nullen) darstellen. Als solches stellt eine derartige Änderung des Zustands des Abschnitts des Speichers, um ein Daten und/oder Informationen repräsentierendes Signal zu speichern, eine Transformation des Speichers 522 in einen anderen Zustand oder eine andere Sache dar.
  • Der Sekundärspeicher 526 kann beispielsweise die gleiche oder eine ähnliche Art von Speicher wie Primärspeicher und/oder ein oder mehrere Datenspeicherungseinrichtungen oder -systeme enthalten, wie beispielsweise ein Diskettenlaufwerk, ein Laufwerk für optische Platten, ein Bandlaufwerk, ein Festkörperspeicherlaufwerk usw. Bei bestimmten Implementierungen kann der Sekundärspeicher 526 operativ rezeptiv oder anderweitig konfigurierbar sein, um an ein computerlesbares Medium 528 koppeln zu können. Das computerlesbare Medium 528 kann beispielsweise ein beliebiges Medium beinhalten, das Daten, Code und/oder Anweisungen für eines oder mehrere der Einrichtungen im System 500 führen oder diese zugänglich machen kann.
  • Die Recheneinrichtung 504 kann beispielsweise einen Eingang/Ausgang 532 enthalten. Der Eingang/Ausgang 532 ist repräsentativ für eine oder mehrere Einrichtungen oder Merkmale, die konfiguriert werden können, um menschliche und/oder maschinelle Eingaben anzunehmen oder anderweitig einzuführen, und/oder eine oder mehrere Einrichtungen oder Merkmale, die konfiguriert werden können, um menschliche und/oder maschinelle Ausgaben zu liefern oder anderweitig bereitzustellen. Als Beispielkann die Eingabe-/Ausgabeeinrichtung 532 operativ konfiguriertes Display, einen Lautsprecher, eine Tastatur, eine Maus, einen Trackball, einen Touchscreen, einen Datenport usw. enthalten.

Claims (15)

  1. System, umfassend: Ein doppelreihiges Speichermodul (DIMM – Dual Inline Memory Module) (200), das ein Phasenwechselspeicher-Modul (PCM-Modul – Phase Change Memory Module) (214) und ein DRAM – Modul (218) umfaßt; einen Speicherbus (240, 250), um elektronisch mit dem System zu verbinden, wobei das PCM-Modul (214) elektronisch parallel zum Speicherbus (240, 250) gekoppelt ist; einen dynamischen RAM-Cache-Speicher (DRAM – Dynamic Random Access Memory), um Schreibdaten des PCM-Modules (214) zwischenzuspeichern, welche bestimmten Adressen des DIMM (200) entsprechen, um die Häufigkeit des Auftretens von Programmier-Lösch-Zyklen des PCM-Moduls (214) zu begrenzen und/oder zu reduzieren; und einen Speicher, um ein BIOS (Basic Input/Output System) zu speichern, welches Parameter enthält, die dem PCM-Modul (214) entsprechen.
  2. System nach Anspruch 1, wobei die Parameter einen Wert für additive Latenzzeit des PCM-Moduls (214) oder eine CAS-Latenzzeit (Column Address Strobe) enthalten.
  3. System nach Anspruch 1, wobei das PCM-Modul (214) mit einer additiven Latenzzeit assoziiert ist, die es ermöglicht, daß eine Spaltenadresse an das DIMM (200) geliefert wird, unmittelbar nachdem eine Zeilenadresse an das DIMM (200) geliefert wird.
  4. System nach Anspruch 1, wobei Bankadreßbits mehreren Speicherbänken über mehrere des einen oder der mehreren PCM-Module entsprechen.
  5. System nach Anspruch 1, wobei das DIMM (200) einen Hauptspeicher des Systems umfaßt.
  6. System nach Anspruch 1, wobei das PCM-Modul (214) ein DRAM-Modusregister (Dynamic Random Access Memory) und/oder eine DRAM-Schnittstelle umfaßt.
  7. Verfahren, umfassend: Liefern (410) einer Aktivieren-Anweisung an ein doppelreihiges Speichermodul (DIMM – Dual Inline Memory Module), das ein Phasenwechselspeicher-Modul (PCM -Phase Change Memory) und ein DRAM – Modul enthält; Liefern (420) einer Zeilenadresse an das PCM-Modul; Liefern (440) von mehreren Spaltenadressen, bevor eine nachfolgende Zeilenadresse an das PCM-Modul geliefert wird; und Zwischenspeichern von Schreibdaten, welche bestimmten Adressen des DIMM entsprechen, in einem DRAM-Cache-Speicher, um die Häufigkeit des Auftretens von Programmier-Lösch-Zyklen des PCM-Moduls zu begrenzen und/oder zu reduzieren.
  8. Verfahren nach Anspruch 7, weiterhin umfassend: das Liefern (440) von einer der mehreren Spaltenadressen an das DIMM, unmittelbar nach dem Liefern einer Zeilenadresse an das DIMM.
  9. Verfahren nach Anspruch 7, weiterhin umfassend: Speichern von Parametern, welche dem PCM-Modul entsprechen, in einem BIOS (Basic Input/Output System) einer Rechenplattform.
  10. Verfahren nach Anspruch 9, wobei die Parameter einen Wert für additive Latenzzeit des PCM-Moduls enthalten.
  11. Verfahren nach Anspruch 7, weiterhin umfassend: Wählen einer Speichergröße für den DRAM-Cache-Speicher, mindestens teilweise auf der Basis von Eigenschaften des PCM-Moduls.
  12. Verfahren nach Anspruch 7, weiterhin umfassend: Zugreifen auf mehrere Speicherbänke über das PCM-Modul unter Verwendung von Bankadreßbits.
  13. Verfahren nach Anspruch 9, wobei das DIMM einen Hauptspeicher der Rechenplattform umfaßt.
  14. Speichereinheit umfassend: ein doppelreihiges Speichermodul (DIMM – Dual Inline Memory Module) (200), das dafür ausgelegt ist, mindestens teilweise auf der Basis von DRAM-Modulen elektronisch zu arbeiten, wobei das DIMM (200) ein Phasenwechselspeichermodul (PCM) (214) und ein DRAM-Modul (218) umfaßt; und einen DRAM-Cache-Speicher zum Zwischenspeichern von Schreibdaten, die bestimmten Adressen des DIMM (200) entsprechen, um die Häufigkeit des Auftretens von Programmier-Lösch-Zyklen des PCM-Moduls (214) zu begrenzen und/oder zu reduzieren.
  15. Speichereinheit nach Anspruch 14, weiterhin umfassend: einen Speicherbus (240, 260) zum elektronischen Verbinden mit einem Rechensystem (500), wobei die PCM-Module elektronisch parallel zu dem Speicherbus gekoppelt sind und wobei das Rechensystem ein BIOS umfaßt, das den PCM-Modulen entsprechende Parameter speichert.
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