CN114120885B - 显示面板及其像素电路 - Google Patents

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Abstract

本发明提供一种像素电路及显示面板。像素电路包括：一驱动单元、一发光元件及一发光控制电路串联连接于一电源电压及一参考电源之间；一第一驱动区块，耦接至该驱动单元的一控制端及一垂直信号线，用以根据一脉宽调制信号及一振幅调制信号输出一控制信号至该驱动单元，以及于一发光时间自该垂直信号线接收一参考电压，于一数据写入时间自该垂直信号线接收该脉宽调制信号；以及一第二驱动区块，连接至该垂直信号线，用以于该发光时间通过该垂直信号线输出该参考电压至该第一驱动区块。该数据写入时间及该发光时间组成一个帧。

Description

显示面板及其像素电路
技术领域
本发明是有关于一种显示面板及其像素电路。
背景技术
显示装置的分辨率日渐提高。分辨率的提高意味着扫描线(scan line)的增加。对于高分辨率的显示装置来说，循序式(progressive)扫描的驱动方式实际操作上仍存在一些问题。例如，电流分割影响光学效果、信号电压转换载入(loading)等问题。因此，有必要针对高分辨率的显示装置及其驱动方法进行改良。
发明内容
本发明的一方面提供一种像素电路，包括：一驱动单元、一发光元件及一发光控制电路串联连接于一电源电压及一参考电源之间；一第一驱动区块，耦接至该驱动单元的一控制端及一垂直信号线，用以根据一脉宽调制信号及一振幅调制信号输出一控制信号至该驱动单元，以及于一发光时间自该垂直信号线皆收一参考电压，于一数据写入时间自该垂直信号线接收该脉宽调制信号；以及一第二驱动区块，连接至该垂直信号线，用以于该发光时间通过该垂直信号线输出该参考电压至该第一驱动区块。该数据写入时间及该发光时间组成一个帧。
本发明的另一方面提供一种显示面板，包括多个像素电路。该些像素电路被配置为多组。各该像素电路包括一驱动单元、一发光元件及一发光控制电路串联连接于一电源电压及一参考电源之间；一第一驱动区块，耦接至该驱动单元的一控制端及一垂直信号线，用以根据一脉宽调制信号及一振幅调制信号输出一控制信号至该驱动单元，以及于一发光时间自该垂直信号线皆收一参考电压，于一数据写入时间自该垂直信号线接收该脉宽调制信号；以及一第二驱动区块，连接至该垂直信号线，用以于该发光时间通过该垂直信号线输出该参考电压至该第一驱动区块。该数据写入时间及该发光时间组成一个帧。该些像素电路使用的信号时序根据所属的组别而定。
以下结合附图和具体实施例对本发明进行详细描述，但不作为对本发明的限定。
附图说明
图1为根据本发明一实施例的像素电路的方块图。
图2为根据本发明一实施例的显示面板的方块图。
图3为根据本发明一实施例的像素电路的电路图。
图4为根据本发明一实施例的显示面板的操作及信号时序示意图。
图5为根据本发明另一实施例的像素电路的电路图。
其中，附图标记：
100、300、500：像素电路
200：显示面板
120：驱动单元
130：发光控制电路
130-1、130-2：电路
TD：驱动晶体管
T1～T15：晶体管
C1～C3：电容
150：第一驱动区块
160：第二驱动区块
VL、VL1～VLy：垂直信号线
HL1～HLx：水平信号线
210：控制芯片
PPO：参考电压
CS：控制信号
D_PWM：脉宽调制信号
具体实施方式
下面结合附图对本发明的结构原理和工作原理作具体的描述：
请参照图1，图1为根据本发明一实施例的像素电路的方块图。像素电路100包括一驱动单元120、一发光控制器130、一发光元件LED、一第一驱动区块150以及一第二驱动区块160。
驱动单元120包括驱动晶体管TD。驱动晶体管TD具有控制端，用以接收控制信号CS，其中控制信号CS可包括脉宽控制信号及振幅控制信号。驱动晶体管TD根据控制信号CS产生驱动信号，以驱动发光元件LED发光。在本实施例中，发光元件LED可以为任意形式的发光二极管。
发光控制器130中的电路130-1、130-2与驱动晶体管TD以及发光元件LED串联耦接。驱动晶体管TD耦接在电路130-1、130-2之间。在本实施例中，电路130-1、130-2分别包括晶体管T1、T2，并耦接在驱动晶体管TD、电源电压VDD以及发光元件LED间。晶体管T1、T2的控制端分别接收一第一发光控制信号EM1及一第二发光控制信号EM2，并分别依据第一发光控制信号EM1及第二发光控制信号EM2而被导通或关闭。需要注意的是，在替代的实施例中，发光控制器130中的电路130-1、130-2可以择一来实施，不必要同时设置电路130-1、130-2。
第一驱动区块150用以依据脉宽调制信号D_PWM及振幅调制信号D_PAM产生控制信号CS。第一驱动区块150耦接一垂直信号线VL。在一帧(frame)的一数据写入时间(datawriting period)期间，第一驱动区块150通过垂直信号线VL接收脉宽调制信号D_PWM；在帧的一发光时间(emitting period)期间，第一驱动区块150通过垂直信号线VL接收一参考电压PPO。
第二驱动区块160通过垂直信号线耦接至第一驱动区块。在发光时间期间，第二驱动区块160输出参考电压PPO。
在一实施例中，发光控制器130控制发光元件LED在发光时间期间间歇性发光至少二次。
请参照图2，图2为根据本发明一实施例的显示面板的方块图。显示面板200包括多个像素电路P11～Pxy、多条水平信号线HL1～HLx、多条垂直信号线VL1～VLy以及一控制芯片210。像素电路P11～Pxy可应用像素电路100来实现。此些像素电路P11～Pxy被配置为x行及y列，其中x、y为正整数。每一行像素电路通过对应的水平信号线耦接至控制芯片210。每一列的像素电路通过对应的垂直信号线耦接至控制芯片210。像素电路还被划分为至少二组，本实施例以二组为例。第一组及第二组的像素电路分别包括多行像素电路，其中属于第一组的像素电路行称为第一像素电路行，属于第二组的像素电路行称为第二像素电路行。在一实施例中，第一像素电路行与第二像素电路行交错配置。例如，奇数行的像素电路被分配给第一组，偶数行的像素电路被分配给第二组。第一组像素电路操作于一第一时序，第二组像素电路操作于一第二时序，其中第一时序的起始与第二时序的起始具有一时间差。
以下搭配图3为根据本发明一实施例的像素电路的电路图对本发明的细节进行说明。
像素电路300包括一驱动晶体管TD、晶体管T1～T8、发光元件LED及电容C1、C2。像素电路300属于显示面板200中第n行及第m列像素电路，其中n为不大于x的正整数，m为不大于y的正整数。在本实施例中，驱动晶体管TD、T1～T8皆为PMOS。
晶体管T1的第一端接收电源电压VDD。晶体管T1的控制端接收第一发光控制信号EM1[n]。驱动晶体管TD的第一端耦接晶体管T1的第二端。晶体管T2的第一端耦接驱动晶体管TD的第二端。晶体管T2的控制端接收第二发光控制信号EM2[n]。发光元件LED的第一端耦接晶体管T2的第二端。发光元件LED的第二端接收参考电源VSS。晶体管T3的第一端耦接驱动晶体管TD的第一端。晶体管T3的控制端接收一第一栅极驱动信号G1[n]。晶体管T3的第二端接收振幅调制信号D_PAM[m]。晶体管T4的第一端耦接驱动晶体管TD的控制端。晶体管T4的控制端接收第一栅极驱动信号G1[n]。晶体管T5的第一端耦接晶体管T4的第一端。晶体管T5的控制端耦接晶体管T4的第二端。晶体管T5的第二端连接对应的垂直信号线VL。晶体管T6的第一端耦接驱动晶体管TD的第二端。晶体管T6的第二端连接晶体管T4的第一端。晶体管T6的控制端接收一第二栅极驱动信号G2[n]。晶体管T7的第一端耦接晶体管T6的第二端。晶体管T7的第二端接收一重置电压RES。晶体管T7的控制端接收一重置控制信号RES[n]。晶体管T8的第一端连接对应的垂直信号线VL。晶体管T8的第二端接收参考电压PPO。晶体管T8的控制端接收的信号根据像素电路300隶属的组别而定，其中当像素电路300属于第一组，该信号为第一切换信号IF1，当像素电路300属于第二组，该信号为第二切换信号IF2。第一切换信号IF1与第二切换信号IF2被配置以使得对应于第一组像素电路的数据写入时间及发光时间与对应于第二组像素电路的数据写入时间及发光时间之间具有该时间差。电容C1的第一端接收电源电压VDD。电容C1的第二端耦接晶体管T4的第一端。电容C2的第一端耦接晶体管T4的第二端。电容C2的第二端接收依时间控制信号SWEEP[n]。
在本实施例中，发光控制器包括晶体管T1、T2。第一驱动区块包括晶体管T1～T7及电容C1、C2。第二驱动区块包括晶体管T8。
第一栅极驱动信号G1[n]、第二栅极驱动信号G2[n]、第一发光控制信号EM1[n]、第二发光控制信号EM2[n]、重置信号RES[n]、时间控制信号SWEEP[n]皆为对应于第n行像素电路的信号，可由一栅极驱动电路阵列(gate on array，GOA)产生，其中GOA电路可整合于控制芯片或者部整合于控制芯片而额外设置。第一切换信号IF1及第二切换信号IF2可由控制芯片产生。脉宽调制信号D_PWM[m]及振幅调制信号D_PAM[m]为对应于第m列像素电路的数据，可由控制芯片产生。在一实施例中，第m条垂直信号线可通过一多工电路MXm耦接至控制芯片。多工电路MXm根据第一切换信号IF1(或者第二切换信号IF2，取决于n为奇数或偶数)及多工控制信号MXCS选择性输出参考电压PPO及脉宽调制信号D_PWM。在一实施例中，多工电路MXm可包括晶体管T9及T10。晶体管T9的第一端接收参考电压PPO。晶体管T9的第二端连接垂直信号线VLm。晶体管T9的控制端接收第一切换信号IF1(或第二切换信号IF2)。晶体管T10的第一端接收脉宽调制信号D_PWM[m]。晶体管T10的第二端连接垂直信号线VLm。晶体管T10接收多工控制信号MXCS。
具体来说，在数据写入时间期间，第一切换信号IF1及第二切换信号IF2致使晶体管T8及T9关闭，多工控制信号MXCS致使晶体管T10导通；在发光时间期间，第一切换信号IF1及第二切换信号IF2致使晶体管T8及T9导通，多工控制信号MXCS致使晶体管T10关闭。
请参照图4，图4为显示面板的操作与信号时序的示意图。400是第一组像素电路的操作示意图，410是第一组像素电路所使用的信号时序示意图。在400中，横轴为时间，纵轴为第一像素电路行的编号，例如由下而上为1、3、5、…。一个帧FR1被划分为数据写入时间t1及发光时间t2。在数据写入时间t1，第一切换信号IF1维持高电位，在清除像素电路中的旧像素数据后根据脉宽调制信号及振幅调制信号写入新的像素数据。在发光时间t2，第一切换信号IF1为低电位，第一像素电路行逐行间歇性地发光。本实施例中，间歇性发光的间隔为帧FR1的长度的四分之一，即(t1+t2)/4。420是第二组像素电路的操作示意图，430是第一组像素电路所使用的信号时序示意图。在420中，横轴为时间，纵轴为第二像素电路行的编号，例如由下而上为2、4、6、…。相似地，一个帧FR2被划分为数据写入时间t1及发光时间t2。在数据写入时间t1，第二切换信号IF2维持高电位，在清除像素电路中的旧像素数据后根据脉宽调制信号及振幅调制信号写入新的像素数据。在发光时间t2，第二切换信号IF2为低电位，第二像素电路行逐行间歇性地发光。本实施例中，间歇性发光的间隔为帧FR2的长度的四分之一，即(t1+t2)/4。需要注意的是，帧FR2的开始时间与帧FR1的开始时间之间有一时间差t3。本实施例中帧FR1与FR2的长度是相同的，皆为t1+t2，且时间差t3为帧FR1/FR2的长度的二分之一，即t3＝(t1+t2)/2。
详而言之，各组像素电路内各自采循序式扫描发光，多组像素电路之间则采交错式(interlace)发光。将400与420重叠可看出，第一组及第二组像素电路等同于在一个帧的时间内总共发光四次。且此四次发光均匀地分割一个帧的时间。若一个帧的长度为16.6ms，则可以达到60Hz的更新率。也就是说，借由适当的配置像素电路分组的组数、每一组像素电路在一个帧的时间内发光的次数，可以决定出想要的更新率。举例来说，像素电路可分为三组，每组像素电路在发光时间内发光三次，如此等同于在一个帧的时间内均匀发光九次。
请参照图5，图5为根据本发明另一实施例的像素电路的电路图。像素电路500包括驱动晶体管TD、晶体管T1～T15、发光元件LED以及电容C1～C3。
晶体管T1的第一端耦接驱动晶体管TD的第一端。晶体管T2的第一端耦接驱动晶体管TD的第二端。晶体管T2的控制端接收发光控制信号EM_PAM[n]。发光元件LED的第一端耦接晶体管T2的第二端。发光元件LED的第二端接收参考电源VSS。晶体管T3的第一端接收振幅调制信号D_PAM[m]。晶体管T3的第二端耦接晶体管T1的第二端。晶体管T3的控制端接收栅极驱动信号G2[n]。晶体管T4的第一端耦接晶体管T3的第二端。晶体管T4的控制端接收发光控制信号EM_PWM[n]。晶体管T4的第二端耦接电源电压VDD。晶体管T5的第一端耦接晶体管T4的第二端。晶体管T5的控制端耦接晶体管T4的控制端。晶体管T6的第一端耦接晶体管T5的第二端。晶体管T6的控制端接收设置信号VST[n]。晶体管T6的第二端接收参考电压PPO。晶体管T7的第一端耦接晶体管T5的第二端。晶体管T7的第二端耦接晶体管T6的第二端。晶体管T7的控制端接收栅极驱动信号GATE[n]。晶体管T8的第一端耦接晶体管T1的第一端。晶体管T8的第二端耦接晶体管T1的控制端。晶体管T8的控制端耦接晶体管T3的控制端。晶体管T9的第一端耦接晶体管T8的第二端。晶体管T9的控制端接收信号VST[n]。晶体管T9的第二端耦接晶体管T9的控制端。晶体管T10的第一端耦接驱动晶体管TD的控制端。晶体管T10的控制端接收发光控制信号EM_PWM[n]。晶体管T11的第一端耦接晶体管T10的第二端。晶体管T11的控制端接收设置信号SET[n]。晶体管T11的第二端接收设置电压VSET。晶体管T12的第一端耦接晶体管T11的第一端。晶体管T12的控制端耦接晶体管T7的控制端。晶体管T13的第一端耦接晶体管T12的第二端。晶体管T13的第二端及控制端耦接晶体管T9的第二端。晶体管T14的第一端耦接晶体管T12的第一端。晶体管T14的第二端连接垂直信号线VLm，并通过垂直信号线VLm在数据写入时间接收脉宽调制信号D_PWM[m]。晶体管T14的控制端耦接晶体管T12的第二端。晶体管T15的第一端连接垂直信号线VLm。晶体管T15的第二端接收参考电压PPO。晶体管T15的控制端接收切换信号IF。电容C1的第一端耦接晶体管T12的第二端。电容C1的第二端接收时间控制信号SWEEP[n]。电容C2的第一端耦接晶体管T1的控制端。电容C2的第二端耦接晶体管T5的第二端。电容C3的第一端耦接晶体管T10的第一端。电容C3的第二端耦接晶体管T11的第二端。
在此实施例中，晶体管T1也被配置为用以驱动发光元件LED的晶体管。驱动晶体管TD的控制端接收的是根据脉宽调制信号D_PWM[m]产生的脉宽控制信号。晶体管T1的控制端接收的是根据振幅调制信号D_PAM[m]产生的振幅控制信号。也就是说，在本实施例中，驱动单元是包括驱动晶体管TD及晶体管T1，第一驱动区块包括用以产生脉宽控制信号并输出至驱动晶体管TD的控制端的电路以及用以产生振幅控制信号并输出至晶体管T1的控制端的电路。第二驱动区块则是晶体管T15。
需要注意的是，图3的8T2C(八晶体管二电容)架构与图5的16T3C(十六晶体管三电容)架构皆为示例而已，任何适用的PWM/PAM驱动电路架构皆可应用于本发明。
本发明的优点在于，在发光时间内垂直信号线及第二驱动区块会提供稳定的参考电压PPO至第一驱动区块(PAM/PWM驱动电路)，而不用从电源电压抽载。这种方式可以避免发光时因电流分流而造成亮度不稳定而产生视觉上的闪烁感。
当然，本发明还可有其它多种实施例，在不背离本发明精神及其实质的情况下，熟悉本领域的技术人员当可根据本发明作出各种相应的改变和变形，但这些相应的改变和变形都应属于本发明所附的权利要求的保护范围。

Claims (10)

1.一种像素电路，其特征在于，包括：
一驱动单元、一发光元件及一发光控制电路串联连接于一电源电压及一参考电源之间；
一第一驱动区块，耦接至该驱动单元的一控制端及一垂直信号线，用以根据一脉宽调制信号及一振幅调制信号输出一控制信号至该驱动单元，以及于一发光时间自该垂直信号线接收一参考电压，于一数据写入时间自该垂直信号线接收该脉宽调制信号；以及
一第二驱动区块，连接至该垂直信号线，用以于该发光时间通过该垂直信号线输出该参考电压至该第一驱动区块，
其中该数据写入时间及该发光时间组成一个帧；
该第一驱动区块、该驱动单元及该发光控制电路被配置以致使该发光元件于该发光时间期间间歇性发光二次以上。
2.如权利要求1所述的像素电路，其特征在于，该第二驱动区块根据一切换信号选择性地输出该参考电压，该切换信号的一时序取决于该像素电路属于一显示面板的多组像素电路中的组别。
3.如权利要求2所述的像素电路，其特征在于，该第二驱动区块包括一晶体管，该晶体管的一第一端连接该垂直信号线，该晶体管的一控制端接收该切换信号，该晶体管的一第二端接收该参考电压。
4.如权利要求1所述的像素电路，其特征在于，间歇性发光的次数为二次，且两次发光之间间隔的时间为四分之一帧的时间。
5.一种显示面板，其特征在于，包括：
多个像素电路，该些像素电路被配置为多组，各该像素电路包括：
一驱动单元、一发光元件及一发光控制电路串联连接于一电源电压及一参考电源之间；
一第一驱动区块，耦接至该驱动单元的一控制端及一垂直信号线，用以根据一脉宽调制信号及一振幅调制信号输出一控制信号至该驱动单元，以及于一发光时间自该垂直信号线接收一参考电压，于一数据写入时间自该垂直信号线接收该脉宽调制信号；以及
一第二驱动区块，连接至该垂直信号线，用以于该发光时间通过该垂直信号线输出该参考电压至该第一驱动区块，
其中该数据写入时间及该发光时间组成一个帧，且该些像素电路使用的信号时序根据所属的组别而定；
该第一驱动区块、该驱动单元及该发光控制电路被配置以致使该发光元件于该发光时间期间间歇性发光二次以上。
6.如权利要求5所述的显示面板，其特征在于，该第二驱动区块根据一切换信号选择性地输出该参考电压，该切换信号的一时序取决于该像素电路所属的组别。
7.如权利要求6所述的显示面板，其特征在于，该第二驱动区块包括一晶体管，该晶体管的一第一端连接该垂直信号线，该晶体管的一控制端接收该切换信号，该晶体管的一第二端接收该参考电压。
8.如权利要求5所述的显示面板，其特征在于，间歇性发光的次数为二次，且两次发光之间间隔的时间为四分之一帧的时间。
9.如权利要求8所述的显示面板，其特征在于，该些像素电路被配置为一第一组及一第二组，该第一组的像素电路所使用的信号时序与该第二组的像素电路所使用的信号时序之间具有一时间差，且该时间差为二分之一帧。
10.如权利要求5所述的显示面板，其特征在于，各组像素电路内的该些像素电路于该发光时间期间逐行发光。
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