CN115588402B - 驱动电路及显示面板 - Google Patents

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Abstract

本申请公开了一种驱动电路及显示面板，该驱动电路包括发光模块、驱动模块、脉冲宽度调制模块以及第一外部补偿模块，脉冲宽度调制模块用于在脉冲宽度调制信号、数据信号以及发光控制信号的控制下，调整流经发光模块的驱动电流的脉冲宽度；第一外部补偿模块接入第一脉冲宽度补偿信号以及第二脉冲宽度补偿信号，并与脉冲宽度调制模块电连接，第一外部补偿模块用于侦测并补偿第一晶体管的阈值电压。通过第一外部补偿模块侦测并补偿脉冲宽度调制模块中的第一晶体管的阈值电压，以保证画面显示的均一性，提高显示面板的显示效果。

Description

驱动电路及显示面板
技术领域
本申请涉及显示技术领域，具体涉及一种驱动电路及显示面板。
背景技术
目前，显示面板常见的像素驱动方式有两种，即脉冲幅度调制(Pulse AmplitudeModulation，PAM)驱动以及脉冲宽度调制(Pulse Width Modulation，PWM)驱动。其中，PAM驱动是通过控制每个像素单元中的发光器件的驱动电流大小来实现不同亮度显示，但是，PAM驱动方式在低灰阶下存在色点漂移的问题，从而影响显示效果；PWM驱动是通过控制每个素单元中的发光器件的发光时间来实现不同亮度显示，但是，PWM驱动方式对栅极驱动芯片(Gate IC)的要求较高。
为此，结合PWM驱动方式以及PAM驱动方式的优点，本领域技术人员开发出了二者结合的混合驱动电路，低灰阶时采用PWM驱动，高灰阶时采用PAM驱动。其中，混合驱动电路的PWM模块包括驱动晶体管，驱动晶体管的阈值电压(Vth)值决定了驱动晶体管的打开时间，从而决定了发光器件的发光时间，当多个驱动晶体管的Vth值不同时，发光器件的发光时间受影响较大，从而影响显示画面的均一性。
发明内容
本申请提供一种驱动电路及显示面板，通过对驱动电路的驱动晶体管的阈值电压进行侦测，以对驱动晶体管进行外部补偿，达到画面显示的均一性。
一方面，本申请实施例提供一种驱动电路，包括：发光模块、驱动模块、脉冲宽度调制模块以及第一外部补偿模块，所述发光模块在驱动电流的驱动下发光；所述驱动模块与所述发光模块电连接，所述驱动模块用于控制所述发光模块发光；所述脉冲宽度调制模块接入脉冲宽度调制信号、数据信号以及发光控制信号，并与所述驱动模块电连接，所述脉冲宽度调制模块包括第一晶体管，所述脉冲宽度调制模块用于在所述脉冲宽度调制信号、所述数据信号以及所述发光控制信号的控制下，调整流经所述发光模块的驱动电流的脉冲宽度；所述第一外部补偿模块接入脉冲宽度补偿信号，并与所述脉冲宽度调制模块电连接，所述第一外部补偿模块用于侦测并补偿所述第一晶体管的阈值电压。
可选地，在本申请的一些实施例中，所述脉冲宽度调制模块还包括第二晶体管、第三晶体管以及第一电容，所述第一晶体管的栅极电性连接于第一节点，所述第一晶体管的第一电极电性连接于第二节点，所述第一晶体管的第二电极电性连接于所述第一电源端；所述第二晶体管的栅极接入所述脉冲宽度调制信号，所述第二晶体管的第一电极接入所述数据信号，所述第二晶体管的第二电极电性连接于第三节点；所述第三晶体管的栅极接入所述发光控制信号，所述第三晶体管的第一电极电性连接于所述驱动模块，所述第三晶体管的第二电极电性连接于所述第二节点；所述第一电容的一端接入扫频信号，所述第一电容的另一端与所述第三节点电性连接，从而所述扫频信号通过所述第二电容调整所述第三节点电位。
可选地，在本申请的一些实施例中，所述第一外部补偿模块包括第四晶体管、第五晶体管、第六晶体管以及第二电容；所述第四晶体管的栅极接入复位信号，所述第四晶体管的第二电极电性连接于所述第一节点；所述第五晶体管的栅极接入所述脉冲宽度补偿信号，所述第五晶体管的第二电极电性连接于第三节点；所述第六晶体管的栅极接入所述脉冲宽度补偿信号，所述第六晶体管的第一电极电性连接于所述第一节点，所述第六晶体管的第二电极电性连接于所述第二节点；所述第二电容的一端电性连接于所述第一节点，所述第二电容的另一端电性连接于所述第三节点。
可选地，在本申请的一些实施例中，所述第四晶体管的第一电极接入所述数据信号，和/或，所述第五晶体管的第一电极接入所述数据信号。
可选地，在本申请的一些实施例中，所述驱动模块包括第七晶体管以及第三电容，所述第七晶体管的栅极电性连接于第四节点，所述第七晶体管的第一电极电性连接于第五节点，所述第一晶体管的第二电极电性连接于第六节点，其中，所述第四节点与所述脉冲宽度调制模块电连接；所述第三电容的一端电性连接于所述第四节点，所述第三电容的另一端电性连接于所述第六节点。
可选地，在本申请的一些实施例中，所述发光模块包括第八晶体管以及发光器件，所述第八晶体管的栅极接入所述发光控制信号，所述第八晶体管的第一电极与所述第二电源端电性连接，所述第八晶体管的第二电极与所述第五节点电性连接，所述发光器件的阳极与所述第六节点电性连接，所述发光器件的阴极与所述第一电源端电性连接；或，所述第八晶体管的栅极接入所述发光控制信号，所述第八晶体管的第一电极与所述第六节点电性连接，所述第八晶体管的第二电极与所述发光器件的阳极电性连接，所述发光器件的阴极与所述第一电源端电性连接；或，所述第八晶体管的栅极接入所述发光控制信号，所述第八晶体管的第一电极与所述发光器件的阴极电性连接，所述第八晶体管的第二电极与所述第一电源端电性连接，所述发光器件的阳极与所述第六节点电性连接。
可选地，在本申请的一些实施例中，所述第七晶体管的第一电极与所述第八晶体管的第二电极电性连接时，所述第二电源端接入直流信号，所述第七晶体管的第一电极与所述第二电源端电性连接时，所述第二电源端接入交流信号。
可选地，在本申请的一些实施例中，所述驱动电路还包括脉冲幅度调制模块，所述脉冲幅度调制模块接入脉冲幅度调制信号以及所述数据信号，并与所述脉冲宽度调制模块以及所述驱动模块电性连接，所述脉冲幅度调制模块用于在所述脉冲幅度调制信号的控制下，调整所述驱动电流的脉冲幅度。
可选地，在本申请的一些实施例中，所述脉冲幅度调制模块包括第九晶体管，所述第九晶体管的栅极接入所述脉冲幅度调制信号，所述第九晶体管的第一电极接入所述数据信号，所述第九晶体管的第二电极与所述脉冲宽度调制模块以及所述驱动模块电性连接。
可选地，在本申请的一些实施例中，所述驱动电路还包括第二外部补偿模块，所述第二外部补偿模块接入感测信号，并与所述驱动模块电连接，所述第二外部补偿模块用于侦测并补偿所述驱动模块的阈值电压。
可选地，在本申请的一些实施例中，所述第二外部补偿模块包括第十晶体管，所述第十晶体管的栅极接入所述感测信号，所述第十晶体管的第一电极接入参考信号，所述第十晶体管的第二电极与所述驱动模块电连接。
可选地，在本申请的一些实施例中，所述感测信号与所述脉冲幅度调制信号为相同信号。
本申请还提供一种显示面板，包括多个呈阵列排布的像素单元，所述像素单元包括如上所述的驱动电路。
另一方面，本申请提供一种显示面板的驱动方法，所述显示面板包括多个呈阵列排布的像素单元，所述像素单元包括上述所述的驱动电路，所述驱动电路的驱动方法包括：通过第一数据信号以及脉冲幅度调制信号控制数据信号写入模块导通，所述数据信号写入模块电性连接于发光模块并用于控制驱动电流的大小；通过第二数据信号、第三数据信号、发光时间控制信号、第二扫描信号以及第三扫描信号控制控制模块导通，所述控制模块与所述数据信号写入模块以及所述发光模块电性连接，所述控制模块用于在所述发光时间控制信号的控制下控制所述发光模块的发光时间；所述驱动电流驱动所述发光模块发光。
本申请提供一种驱动电路及显示面板，通过设置第一外部补偿模块电连接于驱动模块，实现对脉冲宽度调制模块中的第一晶体管的阈值电压进行侦测，即对驱动晶体管的阈值电压进行侦测，以对驱动晶体管的阈值电压进行外部补偿，保证画面显示的均一性，提高显示面板的显示效果。
附图说明
为了更清楚地说明本申请实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，下面描述中的附图仅仅是本申请的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请实施例提供的驱动电路的第一种结构示意图；
图2为本申请实施例提供的驱动电路的第一种电路示意图；
图3为本申请实施例提供的驱动电路的第二种电路示意图；
图4为本申请实施例提供的驱动电路的第三种电路示意图；
图5为本申请实施例提供的驱动电路的第四种电路示意图；
图6为本申请实施例提供的驱动电路的第五种电路示意图；
图7为本申请实施例提供的驱动电路的第六种电路示意图；
图8为本申请实施例提供的驱动电路的第七种电路示意图；
图9为本申请实施例提供的驱动电路的第二种结构示意图；
图10为本申请实施例提供的驱动电路的第八种电路示意图；
图11为本申请实施例提供的驱动电路的第三种结构示意图；
图12为本申请实施例提供的驱动电路的第九种电路示意图；
图13为本申请实施例提供的驱动电路的第十种电路示意图；
图14为本申请实施例提供的驱动电路的第十一种电路示意图；
图15为本申请实施例提供的驱动电路的第十二种电路示意图；
图16为本申请实施例提供的驱动电路的第十三种电路示意图；
图17为本申请实施例提供的驱动电路的第十四种电路示意图；
图18为图13至图15所示的驱动电路的时序示意图；
图19为图16所示的驱动电路的时序示意图；
图20为图17所示的驱动电路的时序示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请实施例提供一种驱动电路及显示面板，通过对驱动电路的驱动晶体管的阈值电压进行侦测，以对驱动晶体管进行外部补偿，达到画面显示的均一性。以下分别进行详细说明。需说明的是，以下实施例的描述顺序不作为对实施例优选顺序的限定。另外，在本申请的描述中，术语“包括”是指“包括但不限于”。术语“第一”、“第二”、“第三”等仅仅作为标示使用，其用于区别不同对象，而不是用于描述特定顺序。
本申请所有实施例中采用的晶体管可以为薄膜晶体管或场效应管或其他特性相同的器件。由于这里采用的晶体管的第一电极、第二电极是对称的，所以其第一电极、第二电极是可以互换的。在本申请实施例中，为区分晶体管除栅极之外的两极，将其中一极称为第一电极，另一极称为第二电极。
此外本申请实施例所采用的晶体管可以包括P型晶体管和/或N型晶体管两种，其中，P型晶体管在栅极为低电平时导通，在栅极为高电平时截止，N型晶体管为在栅极为高电平时导通，在栅极为低电平时截止。
请参阅图1，图1为本申请实施例提供的驱动电路的第一种结构示意图。如图1所示，本申请实施例提供的驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103以及第一外部补偿模块104。
其中，发光模块101在驱动电流的驱动下发光。驱动模块102与发光模块101电连接，驱动模块102用于控制发光模块101发光。脉冲宽度调制模块103接入脉冲宽度调制信号SPWM、数据信号DATA以及发光控制信号EM，并与驱动模块102以及发光模块101电连接，脉冲宽度调制模块103包括第一晶体管(图中未示出)，脉冲宽度调制模块103用于在脉冲宽度调制信号SPWM、数据信号DATA以及发光控制信号EM的控制下，调整流经发光模块101的驱动电流的脉冲宽度。第一外部补偿模块104接入脉冲宽度补偿信号COMP，并与脉冲宽度调制模块103电连接，第一外部补偿模块104用于侦测并补偿第一晶体管的阈值电压。
本申请提供的驱动电路可以通过第一外部补偿模块104侦测并补偿脉冲宽度调制模块103中的第一晶体管的阈值电压，因而，能很好的适用于低灰阶时驱动，以保证画面显示的均一性，提高显示面板的显示效果。
在一些实施例中，请参阅图2，图2为本申请实施例提供的驱动电路的第一种电路示意图。结合图1、图2所示，脉冲宽度调制模块103包括第一晶体管T1、第二晶体管T2、第三晶体管T3以及第一电容C1，第一晶体管T1的栅极电性连接于第一节点Q，第一晶体管T1的第一电极电性连接于第二节点P，第一晶体管T1的第二电极电性连接于第一电源端VSS；第二晶体管T2的栅极接入脉冲宽度调制信号SPWM，第二晶体管T2的第一电极接入数据信号DATA，第二晶体管T2的第二电极电性连接于第三节点R；第三晶体管T3的栅极接入发光控制信号EM，第三晶体管T3的第一电极电性连接于驱动模块102，第三晶体管T3的第二电极电性连接于第二节点P；第一电容C1的一端接入扫频信号SWEEP，第一电容C1的另一端与第三节点R电性连接，从而扫频信号SWEEP通过第二电容C2调整第三节点R电位。
在一些实施例中，请参阅图3，图3为本申请实施例提供的驱动电路的第二种电路示意图。结合图2、图3所示，第一外部补偿模块104包括第四晶体管T4、第五晶体管T5、第六晶体管T6以及第二电容C2；第四晶体管T4的栅极接入复位信号RESET，第四晶体管T4的第二电极电性连接于第一节点Q；第五晶体管T5的栅极接入脉冲宽度补偿信号COMP，第五晶体管T5的第二电极电性连接于第三节点R；第六晶体管T6的栅极接入脉冲宽度补偿信号COMP，第六晶体管T6的第一电极电性连接于第一节点Q，第六晶体管T6的第二电极电性连接于第二节点P；第二电容C2的一端电性连接于第一节点Q，第二电容C2的另一端电性连接于第三节点R。其中，第四晶体管T4的第一电极以及第五晶体管T5的第一电极中至少一个接入数据信号DATA，另一个接入其它电压信号源即可，图3中示例性的示出第四晶体管T4的第一电极以及第五晶体管T5的第一电极均接入数据信号DATA。这样的设计，有利于减少信号线布线，降低不同信号线间产生干扰，同时，节省布线空间，提升显示效果。
在一些实施例中，请参阅图4，图4为本申请实施例提供的驱动电路的第三种电路示意图。结合图2、图4所示，本实施例与上一实施例的区别在于：第四晶体管T4的第一电极与第二电源端VDD电性连接，第五晶体管T5的第一电极与第一电源端VSS电性连接。
在本实施例中，第一外部补偿模块104包括第四晶体管T4、第五晶体管T5、第六晶体管T6以及第二电容C2；第四晶体管T4的栅极接入复位信号RESET，第四晶体管T4的第二电极电性连接于第一节点Q；第五晶体管T5的栅极接入脉冲宽度补偿信号COMP，第五晶体管T5的第二电极电性连接于第三节点R；第六晶体管T6的栅极接入脉冲宽度补偿信号COMP，第六晶体管T6的第一电极电性连接于第一节点Q，第六晶体管T6的第二电极电性连接于第二节点P；第二电容C2的一端电性连接于第一节点Q，第二电容C2的另一端电性连接于第三节点R。其中，第四晶体管T4的第一电极与第二电源端VDD电性连接，第五晶体管T5的第一电极与第一电源端VSS电性连接。需要说明的是，第四晶体管T4的第一电极以及第五晶体管T5的第一电极还可以接入其它电压信号源。
在一些实施例中，请参阅图5，图5为本申请实施例提供的驱动电路的第四种电路示意图。结合图1、图5所示，驱动模块102包括第七晶体管T7以及第三电容C3，第七晶体管T7的栅极电性连接于第四节点G，第七晶体管T7的第一电极电性连接于第五节点N，第一晶体管T1的第二电极电性连接于第六节点S，其中，第四节点G与脉冲宽度调制模块103电连接；第三电容C3的一端电性连接于第四节点G，第三电容C3的另一端电性连接于第六节点S。
在一些实施例中，请参阅图6，图6为本申请实施例提供的驱动电路的第五种电路示意图。如图6所示，本申请实施例提供的驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103以及第一外部补偿模块104，其中，发光模块101包括第八晶体管T8以及发光器件D，第八晶体管T8的栅极接入发光控制信号EM，第八晶体管T8的第一电极与第二电源端VDD电性连接，第八晶体管T8的第二电极与第五节点N电性连接，发光器件D的阳极与第六节点S电性连接，发光器件D的阴极与第一电源端VSS电性连接。这样的设计，避免第二电源端VDD高低电位切换短路造成第七晶体管T7损坏，且有利于控制流经第七晶体管T7的电流的输入时间和截止时间。
在一些实施例中，请参阅图7，图7为本申请实施例提供的驱动电路的第六种电路示意图。如图7所示，本申请实施例提供的驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103以及第一外部补偿模块104，其中，发光模块101包括第八晶体管T8以及发光器件D，第八晶体管T8的栅极接入发光控制信号EM，第八晶体管T8的第一电极与第六节点S电性连接，第八晶体管T8的第二电极与发光器件D的阳极电性连接，发光器件D的阴极与第一电源端VSS电性连接。这样的设计，有利阻隔非发光阶段电流漏电影响显示效果。
在一些实施例中，请参阅图8，图8为本申请实施例提供的驱动电路的第七种电路示意图。如图8所示，本申请实施例提供的驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103以及第一外部补偿模块104，其中，发光模块101包括第八晶体管T8以及发光器件D，第八晶体管T8的栅极接入发光控制信号EM，第八晶体管T8的第一电极与发光器件D的阴极电性连接，第八晶体管T8的第二电极与第一电源端VSS电性连接，发光器件D的阳极与第六节点S电性连接。这样的设计，有利阻隔非发光阶段电流漏电影响显示效果。
在一些实施例中，请参阅图9，图9为本申请实施例提供的驱动电路的第二种结构示意图。如图9所示，本实施例中的驱动电路相较于图1中的驱动电路区别在于：本实施中的驱动电路还包括脉冲幅度调制模块105。
本实施例中的驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103、第一外部补偿模块104以及脉冲幅度调制模块105。
具体地，发光模块101与驱动模块102、脉冲宽度调制模块103以及第一外部补偿模块104电连接，用于在驱动电流的驱动下发光。
驱动模块102还与脉冲宽度调制模块103、脉冲幅度调制模块105电连接，用于控制发光模块101发光。
脉冲宽度调制模块103还与第一外部补偿模块104以及脉冲幅度调制模块105电连接，用于在脉冲宽度调制信号SPWM、数据信号DATA以及发光控制信号EM的控制下，调整流经发光模块101的驱动电流的脉冲宽度。
脉冲幅度调制模块105接入脉冲幅度调制信号SPAM以及数据信号DATA，用于在脉冲幅度调制信号SPAM的控制下，调整驱动电流的脉冲幅度。
本申请提供的驱动电路可以通过脉冲幅度调制模块105控制流经驱动模块的驱动电流的大小，因而能很好的适用于高灰阶时驱动，同时，可以通过第一外部补偿模块104侦测并补偿脉冲宽度调制模块103中的第一晶体管的阈值电压，进而能同时适用于低灰阶时驱动，以保证画面显示的均一性，提高显示面板的显示效果。
在一些实施例中，请参阅图10，图10为本申请实施例提供的驱动电路的第八种电路示意图。结合图9、图10所示，脉冲幅度调制模块105包括第九晶体管T9，第九晶体管T9的栅极接入脉冲幅度调制信号SPAM，第九晶体管T9的第一电极接入数据信号DATA，第九晶体管T9的第二电极与脉冲宽度调制模块103以及驱动模块102电性连接。
在一些实施例中，请参阅图11，图11为本申请实施例提供的驱动电路的第三种结构示意图。如图11所示，本实施中的驱动电路和上述实施例中的驱动电路的区别在于：本实施例中的驱动电路还包括第二外部补偿模块106。
本实施例中的驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103、第一外部补偿模块104、脉冲幅度调制模块105以及第二外部补偿模块106。
具体地，发光模块101与驱动模块102、脉冲宽度调制模块103以及第一外部补偿模块104电连接，用于在驱动电流的驱动下发光。
驱动模块102还与脉冲宽度调制模块103、脉冲幅度调制模块105电连接，用于控制发光模块101发光。
脉冲宽度调制模块103还与第一外部补偿模块104以及脉冲幅度调制模块105电连接，用于在脉冲宽度调制信号SPWM、数据信号DATA以及发光控制信号EM的控制下，调整流经发光模块101的驱动电流的脉冲宽度。
脉冲幅度调制模块105接入脉冲幅度调制信号SPAM以及数据信号DATA，用于在脉冲幅度调制信号SPAM的控制下，调整驱动电流的脉冲幅度。
第二外部补偿模块106接入感测信号SENSE，并与驱动模块102电连接，第二外部补偿模块106用于侦测并补偿驱动模块102的阈值电压。
在一些实施例中，请参阅图12，图12为本申请实施例提供的驱动电路的第九种电路示意图。结合图11、图12所示，第二外部补偿模块106包括第十晶体管T10，第十晶体管T10的栅极接入感测信号SENSE，第十晶体管T10的第一电极接入参考信号VREF，第十晶体管T10的第二电极与驱动模块102电连接。
需要说明的是，第十晶体管T10的栅极也可以接入脉冲幅度调制信号SPAM，也即，感测信号SENSE与脉冲幅度调制信号SPAM为相同信号。
进一步的，本申请实施例将对该驱动电路的多种完整电路进行说明。请参阅图13至图17，图13为本申请实施例提供的驱动电路的第十种电路示意图；
图14为本申请实施例提供的驱动电路的第十一种电路示意图；图15为本申请实施例提供的驱动电路的第十二种电路示意图；图16为本申请实施例提供的驱动电路的第十三种电路示意图；图17为本申请实施例提供的驱动电路的第十四种电路示意图。结合图11可知，驱动电路包括发光模块101、驱动模块102、脉冲宽度调制模块103、第一外部补偿模块104、脉冲幅度调制模块105以及第二外部补偿模块106。
具体地，如图13至图16所示，脉冲宽度调制模块103包括第一晶体管T1、第二晶体管T2、第三晶体管T3以及第一电容C1；第一外部补偿模块104包括第四晶体管T4、第五晶体管T5、第六晶体管T6以及第二电容C2；驱动模块102包括第七晶体管T7以及第三电容C3；发光模块101包括第八晶体管T8以及发光器件D；脉冲幅度调制模块105包括第九晶体管T9；第二外部补偿模块106包括第十晶体管T10。
需要说明的是，如图17所示，发光模块101也可仅包括发光器件D，驱动电路中的其他结构与图13至图16所示的驱动电路结构相同，故在此不再赘述。
需要说明的是，发光器件D可以是微型发光二极管(Micro Light EmittingDiode，Micro-LED)、迷你发光二极管(Mini Light Emitting Diode，Mini-LED)或有机发光二极管(Organic Light-Emitting Diode，OLED)。在一些实施方式中，该发光器件D可以包括一个Micro-LED、一个Mini-LED或者一个OLED。在另一些实施方式中，该发光器件D可以包括多个Micro-LED、多个Mini-LED或者多个OLED，多个Micro-LED可以串联设置或者并联设置，多个Mini-LED，多个OLED可以串联设置或者并联设置。
需要说明的是，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、第八晶体管T8、第九晶体管T9、第十晶体管T10可以为低温多晶硅薄膜晶体管、氧化物半导体薄膜晶体管或非晶硅薄膜晶体管中的一种或者多种。优选地，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7、第八晶体管T8、第九晶体管T9、第十晶体管T10均为同类型晶体管，优选地，均为N型晶体管或P型晶体管。
本申请实施例提供的驱动电路中的晶体管为同一种类型的晶体管的设计，有利于避免不同类型的晶体管之间的差异性对驱动电路造成的影响。
其中，第一晶体管T1的栅极电性连接于第一节点Q，第一晶体管T1的第一电极电性连接于第二节点P，第一晶体管T1的第二电极电性连接于第一电源端VSS；
第二晶体管T2的栅极接入脉冲宽度调制信号SPWM，第二晶体管T2的第一电极接入数据信号DATA，第二晶体管T2的第二电极电性连接于第三节点R；
第三晶体管T3的栅极接入发光控制信号EM，第三晶体管T3的第一电极电性连接于驱动模块102，第三晶体管T3的第二电极电性连接于第二节点P；
第一电容C1的一端接入扫频信号SWEEP，第一电容C1的另一端与第三节点R电性连接，从而扫频信号SWEEP通过第二电容C2调整第三节点R电位；
第四晶体管T4的栅极接入复位信号RESET，第四晶体管T4的第一电极接入数据信号DATA，第四晶体管T4的第二电极电性连接于第一节点Q；需要说明的是，如图14所示，第四晶体管T4的第一电极接入第二电源端VDD，进一步地，第四晶体管T4的第一电极也可以接入其他电源信号(图中未示出)。
第五晶体管T5的栅极接入脉冲宽度补偿信号COMP，第五晶体管T5的第一电极接入数据信号DATA，第五晶体管T5的第二电极电性连接于第三节点R；需要说明的是，如图16所示，第五晶体管T5的第一电极接入第一电源端VSS，进一步地，第五晶体管T5的第一电极也可以接入其他电源信号(图中未示出)。
第六晶体管T6的栅极接入脉冲宽度补偿信号COMP，第六晶体管T6的第一电极电性连接于第一节点Q，第六晶体管T6的第二电极电性连接于第二节点P；
第二电容C2的一端电性连接于第一节点Q，第二电容C2的另一端电性连接于第三节点R；
第七晶体管T7的栅极电性连接于第四节点G，第七晶体管T7的第一电极电性连接于第五节点N，第一晶体管T1的第二电极电性连接于第六节点S，其中，第四节点G与脉冲宽度调制模块103电连接；
第三电容C3的一端电性连接于第四节点G，第三电容C3的另一端电性连接于第六节点S；
第八晶体管T8的栅极接入发光控制信号EM，第八晶体管T8的第一电极与第二电源端VDD电性连接，第八晶体管T8的第二电极与第五节点N电性连接；需要说明的是，如图14所示，第八晶体管T8的栅极接入发光控制信号EM，第八晶体管T8的第一电极与第二节点S电性连接，第八晶体管T8的第二电极与发光器件D的阳极电性连接，发光器件D的阴极与第一电源端VSS电性连接；或者，如图15所示，第八晶体管T8的栅极接入发光控制信号EM，第八晶体管T8的第一电极与发光器件D的阴极电性连接，第八晶体管T8的第二电极与第一电源端VSS电性连接。
发光器件D的阳极与第六节点S电性连接，发光器件D的阴极与第一电源端VSS电性连接；
第九晶体管T9的栅极接入脉冲幅度调制信号SPAM，第九晶体管T9的第一电极接入数据信号DATA，第九晶体管T9的第二电极与脉冲宽度调制模块103以及驱动模块102电性连接；
第十晶体管T10的栅极接入感测信号SENSE，第十晶体管T10的第一电极接入参考信号VREF，第十晶体管T10的第二电极与驱动模块102电连接。需要说明的是，如图17所示，第十晶体管T10的栅极也可以接入脉冲幅度调制信号SPAM。
需要说明的是，第一节点Q、第二节点P、第三节点R、第四节点G、第五节点N以及第六节点S均表示为与相应器件电性连接的节点，在此仅仅表示为电性连接关系，此处第一节点Q、第二节点P、第三节点R、第四节点G、第五节点N以及第六节点S并不表示为端子。
请参阅图18，图18为图13至图15所示的驱动电路的时序示意图。如图18所示，本申请实施例提供的驱动电路的驱动时序包括复位阶段t1、补偿阶段t2、第一写入阶段t3、第二写入阶段t4以及发光阶段t5。
在复位阶段t1，数据信号DATA以及复位信号RESET均为高电位，数据信号DATA的大小为第一电压V1，第四晶体管T4在复位信号RESET的高电位下打开，以对第一节点Q进行复位，将第一节点Q的电位充电至第一电压V1。
在补偿阶段t2，数据信号DATA以及脉冲宽度补偿信号COMP为高电位，数据信号DATA的大小为第二电压V2，复位信号RESET为低电位，第四晶体管T4关闭，第五晶体管T5在脉冲宽度补偿信号COMP的高电位下打开，通过数据信号DATA将第三节点R的电位充电至第二电压V2；第六晶体管T6在脉冲宽度补偿信号COMP的高电位下打开，使得第一节点Q电位通过第六晶体管T6漏电，至第一晶体管T1的栅极与第一晶体管T1的第二电极的电压差VGS为第一晶体管T1的阈值电压Vth时第一晶体管T1关闭，此时，第一节点QQ电压为VVSS+Vth，因此流经第一晶体管T1的第一电极与第一晶体管T1的第二电极之间的电流大小与第一晶体管T1的阈值电压Vth无关，以完成对第一晶体管T1的内部补偿。
在第一写入阶段t3，数据信号DATA保持高电位，脉冲宽度调制信号SPWM、扫频信号SWEEP为高电位，脉冲宽度补偿信号COMP为低电位，第一晶体管T1、第五晶体管T5以及第六晶体管T6关闭，数据信号DATA的大小为第三电压V3，第三电压V3的大小决定了后面的发光阶段中驱动电流的大小。第二晶体管T2在脉冲宽度调制信号SPWM的高电位下打开，通过数据信号DATA将第三节点RR的电位充电至第三电压V3，同时第二电容C2将第三电压V3耦合至第一节点Q，此时，第一节点Q的电压为VVSS+Vth+V3。
在第二写入阶段t4，脉冲幅度调制信号SPAM、感测信号SENSE以及数据信号DATA均为高电位，脉冲宽度调制信号SPWM以及扫频信号SWEEP为低电位，第二晶体管T2关闭，数据信号DATA的大小为第四电压V4，第九晶体管T9在脉冲幅度调制信号SPAM的高电位下打开，第四电压V4写入第四节点G；第十晶体管T10在感测信号SENSE的高电位下打开，参考信号VREF提供的参考电压VVREF写入第六节点S，以实现对第七晶体管T7的阈值电压的侦测和补偿。
在发光阶段t5，发光控制信号EM为高电位，第一晶体管T1、第三晶体管T3、第八晶体管T8打开，发光器件D发光，同时，扫频信号SWEEP的电位开始抬升，并通过第一电容C1以及第二电容C2的耦合作用，将扫频信号SWEEP传输至第一节点Q，对第一节点Q进行充电直至打开第一晶体管T1，进而终止发光器件D发光。此时，第一晶体管T1的栅极与第一晶体管T1的第二电极之间的电压差为Vth+V3。
需要说明的是，第一电压V1、第二电压V2、第三电压V3以及第四电压V4的大小可以相同也可以不相同，具体电压值可以根据灰阶变化进行调整，本申请在此不做具体限定。
本申请实施例提供的驱动电路，通过对发光器件D的发光时间和驱动电流大小的独立且同时控制，使得驱动电路具有较长的充电时间；其次，对数据带宽需求不高，具有与普通驱动电路相似的驱动方法；再次，不需要考虑薄膜晶体管中阈值电压漂移及补偿问题，当数据信号DATA的电压适当大时，驱动电流对阈值电压不敏感，且本申请提供的驱动电路可使ΔVth在0～nV内发光时间变化维持在5％以内变化量；最后，由于发光器件D以恒定驱动电流发光，因此可以解决发光器件D光源的波长漂移问题。
请参阅图19，图19为图16所示的驱动电路的时序示意图。如图19所示，在复位阶段t1，第二电源端VDD以及复位信号RESET均为高电位，第四晶体管T4在复位信号RESET的高电位下打开，以对第一节点Q进行复位。
在补偿阶段t2，第一电源端VSS以及脉冲宽度补偿信号COMP为高电位，复位信号RESET为低电位，第四晶体管T4关闭，第五晶体管T5在脉冲宽度补偿信号COMP的高电位下打开，通过第一电源端VSS对第三节点R充电；第六晶体管T6在脉冲宽度补偿信号COMP的高电位下打开，使得第一节点Q电位通过第六晶体管T6漏电，至第一晶体管T1的栅极与第一晶体管T1的第二电极的电压差VGS为第一晶体管T1的阈值电压Vth时第一晶体管T1关闭，此时，第一节点Q电压为VVSS+Vth，因此流经第一晶体管T1的第一电极与第一晶体管T1的第二电极之间的电流大小与第一晶体管T1的阈值电压Vth无关，以完成对第一晶体管T1的内部补偿。
在第一写入阶段t3，数据信号DATA、脉冲宽度调制信号SPWM以及扫频信号SWEEP为高电位，脉冲宽度补偿信号COMP为低电位，第一晶体管T1、第五晶体管T5以及第六晶体管T6关闭，数据信号DATA的电压大小决定了后面的发光阶段中驱动电流的大小。第二晶体管T2在脉冲宽度调制信号SPWM的高电位下打开，通过数据信号DATA对第三节点R充电，同时第二电容C2将第三电压V3耦合至第一节点Q，此时，第一节点Q的电压为VVSS+Vth+V3。
在第二写入阶段t4，脉冲幅度调制信号SPAM、感测信号SENSE以及数据信号DATA均为高电位，脉冲宽度调制信号SPWM以及扫频信号SWEEP为低电位，第二晶体管T2关闭，第九晶体管T9在脉冲幅度调制信号SPAM的高电位下打开，数据信号DATA写入第四节点G；第十晶体管T10在感测信号SENSE的高电位下打开，参考信号VREF提供的参考电压VVREF写入第六节点S，以实现对第七晶体管T7的阈值电压的侦测和补偿。
在发光阶段t5，发光控制信号EM为高电位，第一晶体管T1、第三晶体管T3、第八晶体管T8打开，发光器件D发光，同时，扫频信号SWEEP的电位开始抬升，并通过第一电容C1以及第二电容C2的耦合作用，将扫频信号SWEEP传输至第一节点Q，对第一节点Q进行充电直至打开第一晶体管T1，进而终止发光器件D发光。此时，第一晶体管T1的栅极与第一晶体管T1的第二电极之间的电压差为Vth+V3。
请参阅图20，图20为图17所示的驱动电路的时序示意图。图20中所示的驱动电路的时序与图18中的驱动电路的时序的区别在于：在第二写入阶段t4，脉冲幅度调制信号SPAM以及数据信号DATA均为高电位，脉冲宽度调制信号SPWM以及扫频信号SWEEP为低电位，第二晶体管T2关闭，数据信号DATA的大小为第四电压V4，第九晶体管T9以及第十晶体管T10在脉冲幅度调制信号SPAM的高电位下打开，第四电压V4写入第四节点G；参考信号VREF提供的参考电压VVREF写入第六节点S，以实现对第七晶体管T7的阈值电压的侦测和补偿。其它阶段的时序均与图18中的时序一致，故在此不再赘述。
本申请实施例还提供一种显示面板，包括多个呈阵列排布的像素单元，每一像素单元均包括以上的驱动电路，其中，发光器件D可以是Mini-LED、Micro-LED。具体可参照以上对该驱动电路的描述，在此不做赘述。
该显示面板可以为：电子纸、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
本申请提供的显示面板，通过在驱动电路中设置第一外部补偿模块104电连接于驱动模块102，实现对脉冲宽度调制模块103中的第一晶体管T1的阈值电压进行侦测，即对PWM驱动晶体管的阈值电压进行侦测，以对PWM驱动晶体管的阈值电压进行外部补偿，保证画面显示的均一性，提高显示面板的显示效果。
以上对本申请实施例所提供的一种驱动电路及显示面板进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的方法及其核心思想；同时，对于本领域的技术人员，依据本申请的思想，在具体实施方式及应用范围上均会有改变之处，综上，本说明书内容不应理解为对本申请的限制。

Claims (10)

1.一种驱动电路，其特征在于，包括：
发光模块，所述发光模块包括第八晶体管和发光器件，第八晶体管的栅极接入发光控制信号，第八晶体管的第一电极与第二电源端电性连接，第八晶体管的第二电极与第五节点电性连接，所述发光器件的阳极与第六节点电性连接，所述发光器件的阴极与第一电源端电性连接，所述发光模块在驱动电流的驱动下发光；
驱动模块，所述驱动模块包括第七晶体管和第三电容，所述第七晶体管的栅极电性连接于第四节点，所述第七晶体管的第一电极电性连接于所述第五节点，所述第七晶体管的第二电极电性连接于所述第六节点，所述第三电容的一端电性连接于所述第四节点，所述第三电容的另一端电性连接于所述第六节点，所述驱动模块用于控制所述发光模块发光；
脉冲宽度调制模块，所述脉冲宽度调制模块包括第一晶体管、第二晶体管、第三晶体管以及第一电容，所述第一晶体管的栅极电性连接于第一节点，所述第一晶体管的第一电极电性连接于第二节点，所述第一晶体管的第二电极电性连接于第一电源端；所述第二晶体管的栅极接入脉冲宽度调制信号，所述第二晶体管的第一电极接入数据信号，所述第二晶体管的第二电极电性连接于第三节点；所述第三晶体管的栅极接入所述发光控制信号，所述第三晶体管的第一电极电性连接于所述驱动模块，所述第三晶体管的第二电极电性连接于所述第二节点；所述第一电容的一端接入扫频信号，所述第一电容的另一端与所述第三节点电性连接，所述扫频信号通过所述第一电容调整所述第三节点电位，所述脉冲宽度调制模块用于在所述脉冲宽度调制信号、所述数据信号以及所述发光控制信号的控制下，调整流经所述发光模块的驱动电流的脉冲宽度，所述脉冲宽度调制模块用于在所述脉冲宽度调制信号、所述数据信号以及所述发光控制信号的控制下，调整流经所述发光模块的驱动电流的脉冲宽度；以及
第一外部补偿模块，所述第一外部补偿模块包括第四晶体管、第五晶体管、第六晶体管以及第二电容；所述第四晶体管的栅极接入复位信号，所述第四晶体管的第二电极电性连接于所述第一节点；所述第五晶体管的栅极接入所述脉冲宽度补偿信号，所述第五晶体管的第二电极电性连接于第三节点；所述第六晶体管的栅极接入所述脉冲宽度补偿信号，所述第六晶体管的第一电极电性连接于所述第一节点，所述第六晶体管的第二电极电性连接于所述第二节点；所述第二电容的一端电性连接于所述第一节点，所述第二电容的另一端电性连接于所述第三节点，所述第一外部补偿模块用于侦测并补偿所述第一晶体管的阈值电压；
其中，驱动时序包括复位阶段、补偿阶段、第一写入阶段以及发光阶段；
在所述复位阶段，所述第四晶体管在所述复位信号的控制下打开；
在所述补偿阶段，所述第四晶体管关闭，所述第五晶体管和所述第六晶体管在所述脉冲宽度补偿信号的控制下打开，扫频信号为低电位；
在所述第一写入阶段，所述第四晶体管、所述第五晶体管以及所述第六晶体管关闭，所述第二晶体管在所述脉冲宽度调制信号的控制下打开，扫频信号为高电位；
在所述发光阶段，所述第二晶体管关闭，所述第三晶体管和所述第八晶体管在所述发光控制信号的控制下打开，所述发光器件发光，所述第一晶体管在所述扫频信号的控制下打开，所述发光器件停止发光。
2.根据权利要求1所述的驱动电路，其特征在于，所述第四晶体管的第一电极接入所述数据信号，和/或，所述第五晶体管的第一电极接入所述数据信号。
3.根据权利要求1所述的驱动电路，其特征在于，所述第八晶体管的栅极接入所述发光控制信号，所述第八晶体管的第一电极与所述第六节点电性连接，所述第八晶体管的第二电极与所述发光器件的阳极电性连接，所述发光器件的阴极与所述第一电源端电性连接；或，
所述第八晶体管的栅极接入所述发光控制信号，所述第八晶体管的第一电极与所述发光器件的阴极电性连接，所述第八晶体管的第二电极与所述第一电源端电性连接，所述发光器件的阳极与所述第六节点电性连接。
4.根据权利要求3所述的驱动电路，其特征在于，所述第七晶体管的第一电极与所述第八晶体管的第二电极电性连接时，所述第二电源端接入直流信号，所述第七晶体管的第一电极与所述第二电源端电性连接时，所述第二电源端接入交流信号。
5.根据权利要求1-4任一项所述的驱动电路，其特征在于，所述驱动电路还包括脉冲幅度调制模块，所述脉冲幅度调制模块接入脉冲幅度调制信号以及所述数据信号，并与所述脉冲宽度调制模块以及所述驱动模块电性连接，所述脉冲幅度调制模块用于在所述脉冲幅度调制信号的控制下，调整所述驱动电流的脉冲幅度。
6.根据权利要求5所述的驱动电路，其特征在于，所述脉冲幅度调制模块包括第九晶体管，所述第九晶体管的栅极接入所述脉冲幅度调制信号，所述第九晶体管的第一电极接入所述数据信号，所述第九晶体管的第二电极与所述脉冲宽度调制模块以及所述驱动模块电性连接。
7.根据权利要求5所述的驱动电路，其特征在于，所述驱动电路还包括第二外部补偿模块，所述第二外部补偿模块接入感测信号，并与所述驱动模块电连接，所述第二外部补偿模块用于侦测并补偿所述驱动模块的阈值电压。
8.根据权利要求7所述的驱动电路，其特征在于，所述第二外部补偿模块包括第十晶体管，所述第十晶体管的栅极接入所述感测信号，所述第十晶体管的第一电极接入参考信号，所述第十晶体管的第二电极与所述驱动模块电连接。
9.根据权利要求7所述的驱动电路，其特征在于，所述感测信号与所述脉冲幅度调制信号为相同信号。
10.一种显示面板，其特征在于，包括如权利要求1-9任一项所述的驱动电路。
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