CN113971936A - 显示面板及其驱动方法 - Google Patents

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Abstract

本公开公开了一种显示面板及其驱动方法，在栅极驱动电路逐行对像素进行扫描时，驱动芯片控制时钟信号端向栅极驱动电路输入时钟控制信号，使栅极驱动电路输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行像素电路中。其中，时钟控制信号的有效电平时段落入数据信号的有效电平时段之内，数据信号的有效电平时段的开始时刻至少早于时钟控制信号的有效电平时段的开始时刻1μs‑2μs。数据信号写入到像素电路的时段与电源信号的波动时段不重叠或极小部分重叠，由此避免电源信号波动对数据信号写入的影响，避免该行像素产生亮度差异。

Description

显示面板及其驱动方法
技术领域
本公开涉及显示技术领域，尤其涉及一种显示面板及其驱动方法。
背景技术
有机发光二极管(Organic Light Emitting Diode，简称OLED)显示技术具有能耗低、响应速度快、视角宽、更轻薄且具有柔韧性等优点，是一种极具潜力的显示技术。
OLED显示屏采用逐行扫描写入数据信号的方式控制点亮，显示屏中存在大量信号线，因此不可避免地存在串扰问题。当显示屏中相邻两行存储的数据信号差异较大时，会引起电源信号的电位变化，这将导致数据信号在写入的过程中受到电源信号的影响产生变化，从而出现亮度差异，影响显示效果。
发明内容
本公开实施例提供一种显示面板的驱动方法，所述显示面板包括：
多个像素，用于图像显示；
多个像素电路，用于控制所述像素进行发光显示；
栅极驱动电路，位于所述像素电路的一侧，用于向所述像素电路输出栅极扫描信号；
所述驱动方法包括：
在所述栅极驱动电路逐行对所述像素进行扫描时，控制时钟信号端向所述栅极驱动电路输入时钟控制信号，使所述栅极驱动电路输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行所述像素电路中；
其中，所述时钟控制信号的有效电平时段落入所述数据信号的有效电平时段之内，所述数据信号的有效电平时段的开始时刻至少早于所述时钟控制信号的有效电平时段的开始时刻1μs-2μs。
本公开一些实施例中，所述数据信号的有效电平时段在该行像素扫描时段的占空比大于50％。
本公开一些实施例中，所述时钟控制信号的有效电平时段在该行像素扫描时段的占空比小于50％。
本公开一些实施例中，所述时钟控制信号的有效电平时段的时长小于或等于所述数据信号的有效电平时段的时长的一半。
本公开一些实施例中，所述时钟控制信号的有效电平时段的结束时刻早于所述数据信号的有效电平时段的结束时刻。
本公开一些实施例中，所述时钟控制信号的有效电平时段的结束时刻至少早于所述数据信号的有效电平时段的结束时刻1μs-2μs。
本公开一些实施例中，所述数据信号的有效电平时段的时长为4μs-6μs。
本公开一些实施例中，所述时钟控制信号的有效电平时段的时长为2μs-3μs。
本公开一些实施例中，所述数据信号的有效电平时段的开始时刻至少晚于该行像素扫描时段的开始时刻1μs。
本公开一些实施例中，所述数据信号的有效电平时段的结束时刻至少早于该行像素扫描时段的结束时刻1μs。
本公开实施例提供一种显示面板，包括：
多个像素，用于图像显示；
多个像素电路，用于控制所述像素进行发光显示；
栅极驱动电路，位于所述像素电路的一侧，用于向所述像素电路输出栅极扫描信号；
驱动芯片，分别与所述栅极驱动电路和所述像素电路连接，用于向所述栅极驱动电路和所述像素电路输出控制信号；
在所述栅极驱动电路逐行对所述像素进行扫描时，所述驱动芯片控制时钟信号端向所述栅极驱动电路输入时钟控制信号，使所述栅极驱动电路输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行所述像素电路中；
其中，所述时钟控制信号的有效电平时段落入所述数据信号的有效电平时段之内，所述数据信号的有效电平时段的开始时刻至少早于所述时钟控制信号的有效电平时段的开始时刻1μs-2μs。
附图说明
为了更清楚地说明本公开实施例的技术方案，下面将对本公开实施例中所需要使用的附图作简单地介绍，显而易见地，下面所介绍的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本公开实施例提供的显示面板的结构示意图；
图2为本公开实施例提供的移位寄存器的等效电路图；
图3为图2所示移位寄存器的时序图；
图4为本公开实施例提供的像素电路的等效电路图；
图5为图4所示像素电路的时序图；
图6为相关技术的时序图；
图7为本公开实施例提供的时序图；
图8为相关技术的仿真时序图之一；
图9为本公开实施例提供的仿真时序图之一；
图10为相关技术的仿真时序图之一；
图11为本公开实施例提供的仿真时序图之二。
具体实施方式
为使本公开的上述目的、特征和优点能够更为明显易懂，下面将结合附图和实施例对本公开做进一步说明。然而，示例实施方式能够以多种形式实施，且不应被理解为限于在此阐述的实施方式；相反，提供这些实施方式使得本公开更全面和完整，并将示例实施方式的构思全面地传达给本领域的技术人员。在图中相同的附图标记表示相同或类似的结构，因而将省略对它们的重复描述。本公开中所描述的表达位置与方向的词，均是以附图为例进行的说明，但根据需要也可以做出改变，所做改变均包含在本公开保护范围内。本公开的附图仅用于示意相对位置关系不代表真实比例。
OLED显示面板是一种以有机发光二极管作为发光器件的显示面板，OLED作为新一代显示技术，相较于液晶显示面板(Liquid Crystal Display，简称LCD)，OLED面板厚度可以控制在1mm以内，整机更轻薄，重量更加轻盈。OLED屏幕还具有LCD不具备的广视角，可以实现超大可视范围，画面不会失真。其响应速度是LCD屏幕的千分之一。OLED屏幕耐低温，可以在-40℃环境下正常显示内容，具有轻薄、亮度高、功耗低、响应快、清晰度高、柔性好、发光效率高等优势，在显示领域占据越来越重要的位置。
OLED器件包括阳极、发光层和阴极。阳极、发光层和阴极构成三明治结构，在阳极和阳极之间产生电场之后，电子和空穴会向发光层移动，并在发光层中复合成激子，激子激发发光分子最终产生可见光。
本公开实施例提供一种显示面板，该显示面板为OLED显示面板，具体可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
图1为本公开实施例提供的显示面板的结构示意图。
参照图1，本公开实施例提供的显示面板包括：图中未示出的多个像素，栅极驱动电路100、像素电路200以及驱动芯片300。
其中，每个像素均与一个像素电路相连，通过像素电路200驱动像素发光。OLED显示面板中的像素为有机发光二极管器件，在具体实施时，OLED器件可以包括红色OLED器件、绿色OLED器件以及蓝色OLED器件，通过对栅极驱动电路100和像素电路200的信号控制可以驱动相应的像素进行全彩显示。除此之外，也可以采用白色OLED器件配合彩膜来实现全彩显示，在此不做限定。
OLED显示面板中的像素会分布于显示区内，每个像素对应连接一个像素电路200，在显示区一侧的非显示区内设置有栅极驱动电路100。栅极驱动电路100用于向像素电路200输出栅极扫描信号，在栅极扫描信号的控制下将数据信号写入到像素电路200中，该数据信号为控制像素发光亮度灰阶的信号，通过对像素对应的像素电路200写入不同的数据信号，可以实现各像素的灰阶控制。
在本公开实施例提供的上述显示面板中，栅极驱动电路包括相互级联的移位寄存器，第一极的移位寄存器的输入信号由驱动芯片提供，除此之外，每级移位寄存器的输出信号作为下一级移位寄存器的输出信号。每级移位寄存器的输出端连接一条栅极信号线11，该栅极信号线11用于传输控制本行像素的栅极扫描信号。
图2为本公开实施例提供的移位寄存器的等效电路图，图3为图2所示移位寄存器的时序图。
参照图2和图3，本公开实施例提供的移位寄存器包括8个晶体管和2个电容。8个晶体管采用p型晶体管，低电平信号为有效电平。具体工作原理如下：
在输入阶段t1，第一时钟信号端CB上提供的第一时钟控制信号为低电平信号，第二时钟信号端CK上提供的第二时钟控制信号为高电平信号，输入电压信号端STV上提供的输入信号Vin为低电平信号，例如输入信号Vin与第一电源信号VL相等。
由于第一时钟控制信号为低电平信号，第二晶体管T2导通，输入信号经由第二晶体管T2传输至第三节点N3。由于第二晶体管T2传递低电平信号具有阈值损失，从而第三节点N3的电压为Vin-Vth2，即VL-Vth2，其中，Vth2表示第二晶体管T2的阈值电压。由于第六晶体管T6的栅极接收第一电源信号VL，从而第六晶体管T6处于开启状态，由此，电压VL-Vth2经由第六晶体管T6传输至第一节点N1。例如，第六晶体管T6的阈值电压表示为Vth6，同理，由于第六晶体管T6传递低电平信号具有阈值损失，第一节点N1的电压为VL-VthN1，其中，VthN1为Vth2和Vth6中较小的一个。第一节点N1的电压可以控制第八晶体管T8导通，第二时钟控制信号经由第八晶体管T8被写入输出端G(n)以作为输出信号，即在输入阶段t1，输出信号为高电平的第二时钟控制信号，即第二电源信号VH。
在输入阶段t1，由于第一时钟控制信号为低电平信号，第一晶体管T1导通，第一电源信号VL经由第一晶体管T1传输至第二节点N2，由于第三节点N3的电压为VL-Vth2，第七晶体管T7导通，低电平的第一时钟控制信号经由第七晶体管T7传输至第二节点N2。例如，第七晶体管T7的阈值电压表示为Vth7，第一晶体管T1的阈值电压表示为Vth1，当Vth1<Vth7+Vth2时，则第二节点N2的电压为VL-Vth7-Vth2；而当Vth1>Vth7+Vth2时，则第二节点N2的电压为VL-Vth1。此时，第三晶体管T3和第四晶体管T4均导通。由于第二时钟控制信号为高电平信号，第五晶体管T5截止。
在输出阶段t2，第一时钟信号端CB上提供的第一时钟控制信号为高电平信号，第二时钟信号端CK上提供的第二时钟控制信号为低电平信号，输入电压信号端STV上提供的输入信号Vin为高电平信号。第八晶体管T8导通，第二时钟控制信号经由第八晶体管T8被写入输出端G(n)以作为输出信号。在输入阶段t1，第二电容C2的连接输出端G(n)的一端的电压为第二电源信号VH，第二电容C2的连接第一节点N1的一端的电压为VL-VthN1，而在输出阶段t2，第二电容C2的连接输出端G(n)的一端的电压变为VL，由于第二电容C2的自举作用，第二电容C2的连接第一节点N1的一端的电压变为2VL-VthN1-VH，即第一节点N1的电压变为2VL-VthN1-VH，此时，第六晶体管T6截止，第八晶体管T8可以更好地打开，输出信号为第一电源信号VL。
在输出阶段t2，第一时钟控制信号为高电平信号，从而第二晶体管T2和第一晶体管T1均截止。第三节点N3的电压仍为VL-VthN1，第七晶体管T7导通，高电平的第一时钟控制信号经由第七晶体管T7传输至第二节点N2，即第二节点N2的电压为第二电源信号VH，由此，第三晶体管T3和第四晶体管T4均截止。由于第二时钟控制信号为低电平信号，第五晶体管T5导通。
在缓冲阶段t3，第一时钟信号端CB上提供的第一时钟控制信号和第二时钟信号端CK上提供的第二时钟控制信号均为高电平信号，输入电压信号端STV上提供的输入信号Vin为高电平信号。第八晶体管T8导通，第二时钟控制信号经由第八晶体管T8被写入输出端G(n)以作为输出信号，此时，输出信号为高电平的第二时钟控制信号，即第二电源信号VH。由于第二电容C2的自举作用，第一节点N1的电压变为VL-VthN1。
在缓冲阶段t3，第一时钟控制信号为高电平信号，从而第二晶体管T2和第一晶体管T1均截止。第一节点N1的电压变为VL-VthN1，此时，第六晶体管T6导通，第三节点N3的电压也为VL-VthN1，第七晶体管T7导通，高电平的第一时钟控制信号经由第七晶体管T7传输至第二节点N2，即第二节点N2的电压为第二电源信号VH，由此，第三晶体管T3和第四晶体管T4均截止。由于第二时钟控制信号为高电平信号，第五晶体管T5截止。
在稳定阶段t4的第一子阶段t41中，第一时钟信号端CB上提供的第一时钟控制信号为低电平信号，第二时钟信号端CK上提供的第二时钟控制信号为高电平信号，输入电压信号端STV上提供的输入信号Vin为高电平信号，例如输入信号Vin与第二电源信号VH相等。由于第一时钟控制信号为低电平信号，第二晶体管T2导通，输入信号Vin经由第二晶体管T2传输至第三节点N3，由于第二晶体管T2传递高电平信号无阈值损失，第三节点N3的电压为Vin(即，第二电源信号VH)，第七晶体管T7截止。由于第六晶体管T6处于开启状态，第一节点N1的电压与第三节点N3相同，也就是说，第一节点N1的电压为VH，第八晶体管T8截止。由于第一时钟控制信号为低电平信号，第一晶体管T1导通，第二节点N2的电压为VL-Vth1，第三晶体管T3和第四晶体管T4均导通，第二电源信号VH经由第三晶体管T3传输至输出端G(n)，即输出信号为第二电源信号VH。
在稳定阶段t4的第二子阶段t42中，第一时钟信号端CB上提供的第一时钟控制信号为高电平信号，第二时钟信号端CK上提供的第二时钟控制信号为低电平信号，输入电压信号端STV上提供的输入信号Vin为高电平信号。第一节点N1和第三节点N3的电压为Vin(即，第二电源信号VH)，第八晶体管T8和第七晶体管T7均截止。第一时钟控制信号为高电平信号，从而第二晶体管T2和第一晶体管T1均截止，由于第一电容C1的保持作用，第二节点N2的电压仍为VL-Vth1，第三晶体管T3和第四晶体管T4均导通，第二电源信号VH经由第三晶体管T3传输至输出端G(n)，输出信号为第二电源信号VH。
在第二子阶段t42中，由于第二时钟控制信号为低电平信号，第五晶体管T5导通，从而第二电源信号VH经由第四晶体管T4和第五晶体管T5被传输至第三节点N3和第一节点N1，以使第一节点N1的电压和第三节点N3的电压保持为高电平。
在稳定阶段t4的第三子阶段t43中，第一时钟信号端CB上提供的第一时钟控制信号和第二时钟信号端CK上提供的第二时钟控制信号均为高电平信号，输入电压信号端STV上提供的输入信号Vin为高电平信号。第一节点N1和第三节点N3的电压为VH，第八晶体管T8和第七晶体管T7截止。第一时钟控制信号为高电平信号，从而第二晶体管T2和第一晶体管T1均截止，第二节点N2的电压仍为VL-Vth1，第三晶体管T3和第四晶体管T4均导通。第二电源信号VH经由第三晶体管T3传输至输出端G(n)，输出信号为第二电源信号VH。
上述移位寄存器的输出端G(n)连接本行像素对应的栅极信号线11，输出端G(n)输出的信号即为栅极扫描信号。当栅极扫描信号输入到对应行像素的像素电路200中时，各列数据信号线的数据信号可以写入到对应的像素电路中。
图4为本公开实施例提供的像素电路的等效电路，图5为图4所示像素电路的时序图。
参照图4和图5，本公开实施例提供的像素驱动电路包括驱动晶体管M1、第一开关晶体管M3、第二开关晶体管M6、第一控制晶体管M2、第二控制晶体管M4、第三控制晶体管M5、第四控制晶体管M7和存储电容Cst。
第一开关晶体管M3的源极与驱动晶体管M1的栅极电连接，第一开关晶体管M3的漏极与驱动晶体管M1的漏极电连接。
第一开关晶体管M3的栅极与第n行栅极信号线G(n)电连接。
第二开关晶体管M6的栅极与第n行复位线Reset(n)电连接，第二开关晶体管M6的漏极与驱动晶体管M1的栅极电连接，第二开关晶体管M6的源极与初始电压信号线Vint电连接。
第一控制晶体管M2的栅极与第n行栅极信号线G(n)电连接，第一控制晶体管M2的源极与第m列数据信号线Data(m)电连接，第一控制晶体管M2的漏极与驱动晶体管M1的源极电连接。
第二控制晶体管M4的栅极与第n行发光控制线EM(n)电连接，第二控制晶体管M4的源极与电源信号线ELVDD电连接，第二控制晶体管M4的漏极与驱动晶体管M1的源极电连接。
第三控制晶体管M5的栅极与第n行发光控制线EM(n)电连接，第三控制晶体管M5的源极与驱动晶体管M1的漏极电连接，第三控制晶体管M5的漏极与有机发光二极管OLED的阳极电连接；有机发光二极管OLED的阴极与低电压信号线ELVSS电连接。
第四控制晶体管M7的栅极与第n+1行复位信号线Reset(n+1)电连接，第四控制晶体管M7的漏极与有机发光二极管OLED的阳极电连接，第四控制晶体管M7的源极与初始电压信号线Vint电连接。
存储电容Cst的第一极板d1与电源信号线ELVDD电连接，驱动晶体管M1的栅极可以复用为存储电容Cst的第二极板d2。
其中，n为正整数，m为正整数。本公开实施例提供的像素电路中的晶体管为p型薄膜晶体管，低电平为有效电平。
像素电路的驱动分为三个阶段，分别为复位阶段、数据写入阶段和发光阶段。
在第一阶段t1’(复位阶段)，Reset(n)输入低电平，G(n)输入高电平，EM(n)输入高电平，M6打开，M1的栅极的电位被复位为初始电压。
在第二阶段t2’(数据写入和阈值电压补偿阶段)，Reset(n)输入高电平，G(n)输入低电平，Data(m)输入数据电压Vdata，EM(n)输入高电平，M6截止，M4和M5截止，M2、M3、M1和M7开启，Vdata通过M2、M1、M3为Cst充电，以提升M1的栅极的电位，直至M1的栅极的电位变为Vdata+Vth(Vth为M1的阈值电压)时，M3关闭，N1的电位被Cst存储，同时M7打开，以将OLED的阳极的电位复位为初始电压。
在第三阶段t3’(发光阶段)，Reset(n)输入高电平，G(n)输入高电平，EM(n)输入低电平，M2、M3、M6和M7截止，M1、M4和M5导通，OLED发光，M1驱动OLED发光的驱动电流I等于K(Vdata-Vdd)2/2，其中，K为电流系数，Vdd为ELVDD输入的电源信号的电压值。
在显示面板的制作过程中，数据信号线21与电源信号线22的距离较近，因此当数据信号线上的信号出现跳变时，由于两条信号线之间的耦合作用，会使电源信号线22上传输的电压产生跳变。由图4可以看出，电源信号线22输入到存储电容Cst的一个极板d1上，而在数据写入阶段数据信号会写入到存储电容Cst的另一极板d2上，由于存储电容Cst的自举作用，如果电源信号线ELVDD传输的电源信号产生跳变，则会使Cst的另一极板d2的数据信号不稳定，最终可能造成显示亮度的差异。
由上述的分析可知，图2中的第二时钟信号端CK控制栅极扫描信号G(n)的输出，且输出的栅极扫描信号G(n)与第二时钟信号端CK输出的第二时钟控制信号相同，而数据信号是根据栅极扫描信号写入到像素电路中的。
图6为相关技术的时序图。参照图6，当第二时钟信号端CK输入有效电平(低电平)时，数据信号线上输出的数据信号Vdata写入到像素电路的存储电容。而当数据信号线在对不同行的像素输出数据信号时，如果数据信号线输出的数据信号发生跳变，例如在图6中数据信号Vdata由高电平变为低电平以及由低电平变为高电平的时刻，电源信号线传输的电源信号ELVDD会随着数据信号的变化而产生变化，且经过一段时间才能恢复到电源信号ELVDD的固定电位。那么在数据写入阶段，即第二时钟信号端CK输出的时钟控制信号保持低电平的时段与电源信号ELVDD不稳定的时段有重合区域，这将导致写入到像素电路中的数据信号不准确。
为了克服上述问题，本公开实施例提供一种显示面板的驱动方法，在栅极驱动电路逐行对像素进行扫描时，控制时钟信号端(即图2中的第二时钟信号端)向栅极驱动电路输入时钟控制信号(即上述第二时钟控制信号)，使栅极驱动电路输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行像素电路中。
图7为本公开实施例提的时序图，参照图7，本公开实施例提供的驱动方法中，时钟控制信号(CK)的有效电平为低电平，栅极驱动电路输出的栅极扫描信号由时钟控制信号(CK)控制输出，栅极扫描信号的周期以及有效电平时段的占空比均与时钟控制信号(CK)相同。每行像素的像素电路在其连接的栅极信号线输出栅极扫描信号的有效电平时，将该行像素连接的数据线所传输的数据信号(Vdata)写入到对应的像素电路中。因此各行像素的数据写入的时间由时钟控制信号(CK)来控制。
时钟控制信号(CK)的有效电平时段是指在一个周期内，即对一行像素进行扫描的时段H内，输出有效电平的时段，数据信号(Vdata)的有效电平时段是指在对一行像素进行扫描的时段H内输出有效电平的时段。由图7可以看出，时钟控制信号(CK)包括多个低电平的有效电平时段，其中一个有效电平时段均对应着一行像素的数据写入时段，那么在本发明实施例中，可以控制时钟控制信号的一个有效电平时段落入对应的像素行的数据信号(Vdata)的有效电平时段之内，且数据信号(Vdata)的有效电平时段的开始时刻至少早于时钟控制信号(CK)的有效电平时段的开始时刻1μs-2μs。
本公开实施例提供的上述驱动方法，对驱动芯片进行编码，控制数据信号端输出数据信号(Vdata)的起始时刻和终止时刻，以及控制时钟信号端输出的时钟控制信号(CK)的起始时刻和终止时刻，使得在对一行像素进行扫描的时段H内将数据信号(Vdata)的有效电平时段的起始时刻提前，从而提前引起电源信号(ELVDD)的波动，这就使在时钟控制信号(CK)的有效电平时段与电源信号(ELVDD)的波动时段不重叠或极小部分重叠，也就是说，在数据信号(Vdata)写入到像素电路的时段与电源信号(ELVDD)的波动时段不重叠或极小部分重叠，由此避免电源信号波动对数据信号写入的影响，避免该行像素产生亮度差异。
通过实测可以确定当数据信号线传输的数据信号产生跳变而引起电源信号线传输的电源信号产生波动时，该波动大约经历1μs-2μs可以恢复到其固定电位。因此本公开实施例设置数据信号的有效电平时段的开始时刻至少早于时钟控制信号的有效电平时段的开始时刻1μs-2μs，可以保证时钟控制信号进入有效电平时段时，电源信号已恢复到其设定值，那么在时钟控制信号的有效时段，即数据写入到像素电路的时段电源信号保持在固定电位，不会影响数据信号的写入。
对比图6和图7可以看出，在相关技术中时钟控制信号(CK)和数据信号(Vdata)的有效电平时段基本相同，且占据一行像素的扫描时段H的一半左右。本公开实施例为了实现上述效果，在保证显示图像正常显示的前提下，将时钟控制信号(CK)的有效电平时段缩短，这样可以为电源信号(ELVDD)的波动提供一段时间，缩小电源信号(ELVDD)的波动时段与时钟控制信号(CK)的有效电平时段的重叠时间。
如图7所示，本公开实施例将时钟控制信号(CK)的有效电平时段缩短，以使在对一行的像素行的扫描时段H内，时钟控制信号(CK)的有效电平时段的占空比小于50％。
与此同时，本公开实施例还增长了数据信号(Vdata)的有效电平时段，以使数据信号(Vdata)的有效电平时段的开始时刻更靠近该行像素扫描时段的起始时刻，使数据信号(Vdata)的有效电平时段的结束时刻更靠近该行像素扫描时段的终止时刻。这样可以增长数据信号(Vdata)的有效电平时段的开始时刻与时钟控制信号(CK)的有效电平时段的起始时刻之间的时间差，从而提前引起电源信号(ELVDD)的波动，且为电源信号(ELVDD)的恢复提供充足的时间，以保证电源信号(ELVDD)的波动时段与时钟控制信号(CK)的有效电平时段不重叠。
如图7所示，本公开实施例将数据信号(Vdata)的有效电平时段增长，以使在对一行的像素行的扫描时段H内，数据信号(Vdata)的有效电平时段的占空比大于50％。
经过上述设置可以使时钟控制信号(CK)的有效电平时段的时长小于或等于数据信号(Vdata)的有效电平时段的时长的一半。由此可以避免电源信号(ELVDD)的波动时段与数据信号(Vdata)的写入时段重叠，从而避免电源信号(ELVDD)的波动对写入的数据信号(Vdata)产生影响。
如图6和图7所示，数据信号(Vdata)不仅在由高电平跳变到低电平时会造成电源信号(ELVDD)的波动，在数据信号(Vdata)由低电平跳变到高电平时也会造成电源信号(ELVDD)的波动。
如图7所示，本公开实施例为了改善电源信号(ELVDD)对数据信号(Vdata)写入的影响，设置时钟控制信号(CK)的有效电平时段的结束时刻早于数据信号(Vdata)的有效电平时段的结束时刻，这样即使数据信号(Vdata)对电源信号(ELVDD)会产生影响，但产生影响的时段与时钟控制信号(CK)的有效电平时段并不重叠，即不会影响数据信号的写入，由此进一步避免电源信号(ELVDD)对数据信号(Vdata)写入的影响。
在本公开实施例中，设置时钟控制信号(CK)的有效电平时段的结束时刻至少早于数据信号(Vdata)的有效电平时段的结束时刻1μs-2μs。电源信号(ELVDD)产生波动后大约需要1μs-2μs可以恢复到固定电位，采用上述设置可以保证电源信号(ELVDD)的波动不会对数据信号(Vdata)的写入产生影响。
在具体实施时，一行像素的扫描时长大约为7μs，数据信号(Vdata)的有效电平时段的开始时刻至少需要晚于该行像素扫描时段的开始时刻1μs，数据信号(Vdata)的有效电平时段的结束时刻至少需要早于该行像素扫描时段的结束时刻1μs。
在本公开实施例中，可以设置数据信号(Vdata)的有效电平时段的时长为4μs-6μs。而数据信号(Vdata)的有效电平时段的开始时刻需要早于时钟控制信号(CK)的有效电平时段的开始时刻1μs-2μs，因此，可以设置时钟控制信号(CK)的有效电平时段的时长为2μs-3μs。
图8和图9为显示图像由白画面转换成黑画面时对各信号有效电平时段调整前后的对比图。
如图8所示，在对时钟控制信号(CK)以及数据信号(Vdata)的有效电平时段进行调整之前，数据信号(Vdata)由白画面对应的低电平跳变成黑画面对应的高电平时，电源信号(ELVDD)产生波动，且电源信号(ELVDD)产生波动的时间与时钟控制信号(CK)的有效电平时段有重叠，此时电源信号(ELVDD)的波动会对数据信号(Vdata)的写入产生影响，最终影响显示亮度。
如图9所示，在采用本公开实施例提供的上述驱动方法对时钟控制信号(CK)以及数据信号(Vdata)的有效电平时段进行调整之后，提前数据信号(Vdata)由白画面对应的低电平跳变成黑画面对应的高电平的时间，从而使电源信号(ELVDD)提前产生波动，由此使得电源信号(ELVDD)产生波动的时间与时钟控制信号(CK)的有效电平时段不重叠，此时电源信号(ELVDD)的波动不会对数据信号(Vdata)的写入产生影响，也就不会影响显示亮度。
图10和图11为显示图像由黑画面转换成白画面时对各信号有效电平时段调整前后的对比图。
如图10所示，在对时钟控制信号(CK)以及数据信号(Vdata)的有效电平时段进行调整之前，数据信号(Vdata)由黑画面对应的高电平跳变成白画面对应的低电平时，电源信号(ELVDD)产生波动，且电源信号(ELVDD)产生波动的时间与时钟控制信号(CK)的有效电平时段有重叠，此时电源信号(ELVDD)的波动会对数据信号(Vdata)的写入产生影响，最终影响显示亮度。
如图11所示，在采用本公开实施例提供的上述驱动方法对时钟控制信号(CK)以及数据信号(Vdata)的有效电平时段进行调整之后，提前数据信号(Vdata)由黑画面对应的高电平跳变成白画面对应的低电平的时间，从而使电源信号(ELVDD)提前产生波动，由此使得电源信号(ELVDD)产生波动的时间与时钟控制信号(CK)的有效电平时段不重叠，此时电源信号(ELVDD)的波动不会对数据信号(Vdata)的写入产生影响，也就不会影响显示亮度。
基于同一发明构思，本公开实施例还提供一种显示面板，其结构参照图1，本公开实施例提供的显示面板包括：图中未示出的多个像素，栅极驱动电路100、像素电路200以及驱动芯片300。
显示面板中的像素会分布于显示区内，每个像素对应连接一个像素电路200，在显示区一侧的非显示区内设置有栅极驱动电路100。栅极驱动电路100用于向像素电路200输出栅极扫描信号，在栅极扫描信号的控制下将数据信号写入到像素电路200中，该数据信号为控制像素发光亮度灰阶的信号，通过对像素对应的像素电路200写入不同的数据信号，可以实现各像素的灰阶控制。
像素电路200所连接的数据信号线21、电源信号线22，以及栅极驱动电路100的初始信号输入端均与驱动芯片300连接，由驱动芯片300提供栅极驱动电路的初始信号、时钟控制信号，以及提供数据信号、电源信号。而上述各信号的有效电平的起始时间和终止时间，可以通过驱动芯片300的编码实现。
在本公开实施例中，在栅极驱动电路100逐行对像素进行扫描时，驱动芯片300控制时钟信号端向栅极驱动电路100输入时钟控制信号，使栅极驱动电路100输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行像素电路200中。
其中，时钟控制信号的有效电平时段落入数据信号的有效电平时段之内，数据信号的有效电平时段的开始时刻至少早于时钟控制信号的有效电平时段的开始时刻1μs-2μs。
本公开实施例提供的上述显示面板，数据信号写入到像素电路的时段与电源信号的波动时段不重叠或极小部分重叠，由此避免电源信号波动对数据信号写入的影响，避免该行像素产生亮度差异。
尽管已描述了本公开的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例作出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本公开范围的所有变更和修改。
显然，本领域的技术人员可以对本公开进行各种改动和变型而不脱离本公开的精神和范围。这样，倘若本公开的这些修改和变型属于本公开权利要求及其等同技术的范围之内，则本公开也意图包含这些改动和变型在内。

Claims (11)

1.一种显示面板的驱动方法，其中，所述显示面板包括：
多个像素，用于图像显示；
多个像素电路，用于控制所述像素进行发光显示；
栅极驱动电路，位于所述像素电路的一侧，用于向所述像素电路输出栅极扫描信号；
所述驱动方法包括：
在所述栅极驱动电路逐行对所述像素进行扫描时，控制时钟信号端向所述栅极驱动电路输入时钟控制信号，使所述栅极驱动电路输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行所述像素电路中；
其中，所述时钟控制信号的有效电平时段落入所述数据信号的有效电平时段之内，所述数据信号的有效电平时段的开始时刻至少早于所述时钟控制信号的有效电平时段的开始时刻1μs-2μs。
2.如权利要求1所述的驱动方法，其中，所述数据信号的有效电平时段在该行像素扫描时段的占空比大于50％。
3.如权利要求2所述的驱动方法，其中，所述时钟控制信号的有效电平时段在该行像素扫描时段的占空比小于50％。
4.如权利要求3所述的驱动方法，其中，所述时钟控制信号的有效电平时段的时长小于或等于所述数据信号的有效电平时段的时长的一半。
5.如权利要求1所述的驱动方法，其中，所述时钟控制信号的有效电平时段的结束时刻早于所述数据信号的有效电平时段的结束时刻。
6.如权利要求5所述的驱动方法，其中，所述时钟控制信号的有效电平时段的结束时刻至少早于所述数据信号的有效电平时段的结束时刻1μs-2μs。
7.如权利要求1-6任一项所述的驱动方法，其中，所述数据信号的有效电平时段的时长为4μs-6μs。
8.如权利要求7所述的驱动方法，其中，所述时钟控制信号的有效电平时段的时长为2μs-3μs。
9.如权利要求1-6任一项所述的驱动方法，其中，所述数据信号的有效电平时段的开始时刻至少晚于该行像素扫描时段的开始时刻1μs。
10.如权利要求9所述的驱动方法，其中，所述数据信号的有效电平时段的结束时刻至少早于该行像素扫描时段的结束时刻1μs。
11.一种显示面板，其中，包括：
多个像素，用于图像显示；
多个像素电路，用于控制所述像素进行发光显示；
栅极驱动电路，位于所述像素电路的一侧，用于向所述像素电路输出栅极扫描信号；
驱动芯片，分别与所述栅极驱动电路和所述像素电路连接，用于向所述栅极驱动电路和所述像素电路输出控制信号；
在所述栅极驱动电路逐行对所述像素进行扫描时，所述驱动芯片控制时钟信号端向所述栅极驱动电路输入时钟控制信号，使所述栅极驱动电路输出栅极扫描信号，并控制数据信号端输出的数据信号写入该行所述像素电路中；
其中，所述时钟控制信号的有效电平时段落入所述数据信号的有效电平时段之内，所述数据信号的有效电平时段的开始时刻至少早于所述时钟控制信号的有效电平时段的开始时刻1μs-2μs。
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