CN113823236B - 移位寄存器及显示装置 - Google Patents

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Abstract

移位寄存器包括与多个扫描线分别连接并被级联连接的多个核心电路(RG)。核心电路(RG)包括输入部(20)、第1逆变器电路(21o)、第2逆变器电路(21e)、输出部(22)、第1下拉晶体管和第2下拉晶体管。输入部(20)将输入信号向第1节点转送。第1逆变器电路(21o)通过第1帧信号而被有效化，将第1节点的反转信号在第2节点保持。第2逆变器电路(21e)通过第2帧信号而被有效化，将第1节点的反转信号在第3节点保持。输出部(22)包括输出晶体管和电容器。第1下拉晶体管与第1逆变器电路(21o)连接。第2下拉晶体管与第2逆变器电路(21e)连接。

Description

移位寄存器及显示装置
技术领域
本发明涉及移位寄存器及显示装置。
背景技术
使用薄膜晶体管(TFT：Thin Film Transistor)作为有源元件的有源矩阵型的液晶显示装置或有机EL(electroluminescence)显示装置具备以矩阵状配置有TFT的基板(称作TFT基板)。TFT基板具有在列方向上分别延伸并且被输入图像信号的多个信号线和在行方向上分别延伸的多个扫描线。
近年来，将驱动扫描线的栅极驱动器形成在TFT基板上，实现了驱动器IC的成本削减及显示面板的窄边框化。此外，通过在TFT基板上形成栅极驱动器，不再有扫描线的引绕布线的制约，所以成为对于面向车载等要求较高的“异形显示面板”也有用的技术。这样的技术被称作GIP(Gate driver in panel)或GOA(Gate driver on array)。
在由TFT形成的扫描线驱动电路中，使用用来向多个扫描线依次输出脉冲信号的移位寄存器。该移位寄存器具备向扫描线输出脉冲信号的TFT(称作输出TFT)、在扫描线为非选择时使扫描线下拉(pull down)的TFT(称作下拉TFT)和逆变器电路。具备逆变器电路的目的是抑制输出TFT经由栅极－漏极间的寄生电容使自己误动作的所谓自启动现象。
该逆变器电路在扫描线为非选择时需要进行动作以将扫描线保持为关断。因此，对下拉TFT的栅极持续施加正偏压，导致TFT的特性随着时间变化(例如阈值电压的变动)。在此情况下，发生因逆变器电路的功能不良及扫描线的下拉的功能不良造成的误动作。
现有技术文献
专利文献
专利文献1：日本国特许第5190281号公报
专利文献2：日本国特许第5399555号公报
发明内容
发明要解决的课题
本发明的目的是提供一种能够抑制误动作的移位寄存器及显示装置。
用来解决课题的手段
本发明的第1技术方案的移位寄存器具备与多个扫描线分别连接并被级联连接的多个核心电路。上述多个核心电路分别包括：输入部，将与前级的核心电路的输出信号对应的输入信号向第1节点转送；第1逆变器电路，通过第1帧信号而被有效化，将上述第1节点的反转信号在第2节点保持；第2逆变器电路，通过与上述第1帧信号互补的第2帧信号而被有效化，将上述第1节点的反转信号在第3节点保持；输出部，包括输出晶体管和电容器，上述输出晶体管具有与上述第1节点连接的栅极、接收第1时钟信号或第2时钟信号的第1端子、和与扫描线连接的第2端子，上述电容器具有与上述第1节点连接的第1电极、和与上述扫描线连接的第2电极；第1下拉晶体管，具有与上述第2节点连接的栅极、与上述扫描线连接的第1端子、和被供给基准电压的第2端子；以及第2下拉晶体管，具有与上述第3节点连接的栅极、与上述扫描线连接的第1端子、和被供给上述基准电压的第2端子。第奇数个核心电路接收上述第1时钟信号；第偶数个核心电路接收与上述第1时钟信号互补的上述第2时钟信号。
本发明的第2技术方案的移位寄存器在第1技术方案的移位寄存器中，还具备连接在上述第2节点与上述第3节点之间、并具有与上述第1节点连接的栅极的第1晶体管。
本发明的第3技术方案的移位寄存器在第1或第2技术方案的移位寄存器中，上述第1逆变器电路包括第2晶体管及第3晶体管；上述第2晶体管具有与上述第2节点连接的栅极、与上述第1节点连接的第1端子、和被供给上述基准电压的第2端子；上述第3晶体管具有与上述第1节点连接的栅极、与上述第2节点连接的第1端子、和被供给上述基准电压的第2端子；上述第2逆变器电路包括第4晶体管及第5晶体管；上述第4晶体管具有与上述第3节点连接的栅极、与上述第1节点连接的第1端子、和被供给上述基准电压的第2端子；上述第5晶体管具有与上述第1节点连接的栅极、与上述第3节点连接的第1端子、和被供给上述基准电压的第2端子。
本发明的第4技术方案的移位寄存器在第3技术方案的移位寄存器中，如果设上述第2晶体管的沟道宽度为W1，设上述第3晶体管的沟道宽度为W2，则具有W2≤W1≤2×W2的关系。
本发明的第5技术方案的移位寄存器在第1或第2技术方案的移位寄存器中，上述第1逆变器电路包括将上述第1帧信号向上述第2节点转送的第6晶体管；上述第2逆变器电路包括将上述第2帧信号向上述第3节点转送的第7晶体管。
本发明的第6技术方案的移位寄存器在第1或第2技术方案的移位寄存器中，上述输入部包括被输入与后级的核心电路的输出信号对应的复位信号的栅极、与上述第1节点连接的第1端子、和被供给上述基准电压的第2端子的复位晶体管。
本发明的第7技术方案的移位寄存器在第6技术方案的移位寄存器中，在最末级的核心电路所包含的复位晶体管的栅极，被输入在上述最末级的核心电路的输出信号被有效化后被有效化的清零(clear)信号。
本发明的第8技术方案的移位寄存器在第1或第2技术方案的移位寄存器中，在第1级的核心电路的输入部，被输入用来开始扫描动作的开始信号。
本发明的第9技术方案的显示装置具备第1技术方案的移位寄存器。
本发明的第10技术方案的显示装置在第9技术方案的显示装置中，还具备包括多个像素的像素阵列。上述多个扫描线与上述像素阵列连接。
发明效果
根据本发明，能够提供能够抑制误动作的移位寄存器及显示装置。
附图说明
图1是有关实施方式的液晶显示装置的布局图。
图2是有关实施方式的液晶显示装置的框图。
图3是图2所示的像素阵列的电路图。
图4是包含在扫描线驱动电路中的移位寄存器的框图。
图5是图4所示的核心电路的电路图。
图6是说明液晶显示装置的基本的动作的时序图。
图7是说明液晶显示装置的更详细的动作的时序图。
图8是说明选择期间中的核心电路的逆变器动作的示意图。
图9是第1级的核心电路的驱动波形。
图10是第1级的核心电路的驱动波形。
图11是最末级的核心电路的驱动波形。
图12是最末级的核心电路的驱动波形。
具体实施方式
以下，参照附图对实施方式进行说明。但是，附图是示意性或概念性的，各图的尺寸及比率等并不一定与现实相同。此外，在图的相互间表示相同的部分的情况下，也有将相互的尺寸的关系及比率不同地表示的情况。特别是，以下所示的几个实施方式是例示用来将本发明的技术思想具体化的装置及方法的，不由构成部件的形状、构造、配置等确定本发明的技术思想。另外，在以下的说明中，对于具有相同的功能及结构的要素赋予相同的附图标记，将重复的说明省略。
[1]液晶显示装置1的结构
在本实施方式中，作为显示装置而以液晶显示装置为例进行说明。
图1是有关本发明的实施方式的液晶显示装置1的布局图。本实施方式的液晶显示装置1例如由GIP(gate driver in panel)或GOA(gate driver on array)型的LCD(liquidcrystal display)构成。液晶显示装置1具备像素阵列10、扫描线驱动器(表述为GIP)11－1、11－2及集成电路(IC：integrated circuit)2。
在像素阵列10中，配设有分别沿X方向延伸的多个扫描线GL和分别沿与X方向交叉的Y方向延伸的多个信号线SL。
在像素阵列10的X方向两侧，分别配置扫描线驱动器11－1、11－2。扫描线驱动器11－1与第奇数个扫描线GL连接。扫描线驱动器11－2与第偶数个扫描线GL连接。
集成电路2与多个信号线SL连接。此外，集成电路2与扫描线驱动器11－1、11－2连接。集成电路2由IC芯片构成。
图2是有关实施方式的液晶显示装置1的框图。液晶显示装置1具备像素阵列10、扫描线驱动电路11、信号线驱动电路12、共用电极驱动电路13、电压发生电路14及控制电路15。图1所示的扫描线驱动器11－1、11－2与图2所示的扫描线驱动电路11对应。图1所示的集成电路2包括图2所示的信号线驱动电路12、共用电极驱动电路13、电压发生电路14及控制电路15。
像素阵列10具备以矩阵状排列的多个像素PX。在像素阵列10中，配设有分别沿X方向延伸的多个扫描线GL1～GLm和分别沿Y方向延伸的多个信号线SL1～SLn。“m”及“n”分别是2以上的整数。在扫描线GL与信号线SL的交叉区域中配置像素PX。
扫描线驱动电路11与多个扫描线GL电连接。扫描线驱动电路11基于从控制电路15发送的控制信号，向像素阵列10发送用来将包含在像素PX中的开关元件接通/关断的扫描信号。
信号线驱动电路12与多个信号线SL电连接。信号线驱动电路12从控制电路15接收控制信号及显示数据。信号线驱动电路12基于控制信号向像素阵列10发送与显示数据对应的灰度信号(驱动电压)。
共用电极驱动电路13生成共用电压Vcom，将其向像素阵列10内的共用电极供给。共用电极是以夹着液晶层而与按照多个像素PX设置的多个像素电极对置的方式设置的电极。
电压发生电路14生成液晶显示装置1的动作所需要的各种电压，将这些电压向对应的电路供给。
控制电路15统一控制液晶显示装置1的动作。控制电路15从外部接收图像数据DT及控制信号CNT。控制电路15基于图像数据DT生成各种控制信号，将这些控制信号向对应的电路发送。
[2]像素PX的电路结构
接着，对包含在像素阵列10中的像素PX的电路结构进行说明。图3是图2所示的像素阵列10的电路图。
像素PX具备开关元件(有源元件)16、液晶电容(液晶元件)Clc及储存电容Cs。作为开关元件16，例如使用TFT(Thin Film Transistor)，此外使用n沟道TFT。
TFT16的源极与信号线SL连接，其栅极与扫描线GL连接，其漏极与液晶电容Clc连接。作为液晶元件的液晶电容Clc由像素电极、共用电极和被它们夹着的液晶层构成。
储存电容Cs与液晶电容Clc并联连接。储存电容Cs具有抑制在像素电极发生的电位变动并在直到与下个信号对应的驱动电压被施加为止的期间中保持施加到像素电极上的驱动电压的功能。储存电容Cs由像素电极、储存电极(也称作储存电容线)和被它们夹着的绝缘膜构成。在共用电极及储存电极上，由共用电极驱动电路13施加共用电压Vcom。
[3]扫描线驱动电路11的结构
接着，对扫描线驱动电路11的结构进行说明。扫描线驱动电路11具备移位寄存器11A。图4是包含在扫描线驱动电路11中的移位寄存器11A的框图。
移位寄存器11A具备多个核心电路RG1～RGm。核心电路RG1～RGm分别与扫描线GL1～GLm对应而设置。在本说明书中，在对多个核心电路RG1～RGm共用的说明中，表述为“核心电路RG”。
多个核心电路RG1～RGm被级联连接。各核心电路RG作为暂时存储输入数据的寄存器发挥功能。移位寄存器11A与时钟信号同步而动作，以将输入数据(脉冲信号)依次移位的方式动作。
各核心电路RG构成为，根据被输入给自身的多个信号的条件而输出脉冲信号。各核心电路RG具备输入端子V_IN、输出端子OUT、帧端子Fr_o、帧端子Fr_e、时钟端子CLK、清零端子CR及复位端子RST_IN。
多个核心电路RG1～RGm使任意的核心电路RGi的输出端子OUT与后级的核心电路RG(i+1)的输入端子V_IN连接，被级联连接。i是1～m中的任意的数量。另外，对于第1级的核心电路RG1的输入端子V_IN，输入开始信号ST。
对于核心电路RG1～RGm的帧端子Fr_o，输入帧信号Frame_o。对于核心电路RG1～RGm的帧端子Fr_e，输入帧信号Frame_e。对于核心电路RG1～RGm的清零端子CR，输入清零信号CLR。
对于第奇数个核心电路RG1、RG3、…的时钟端子CLK，输入时钟信号ClkA。对于第偶数个核心电路RG2、RG4、…的时钟端子CLK，输入时钟信号ClkB。时钟信号ClkA和时钟信号ClkB具有互补的相位关系。
任意的核心电路RGi的输出端子OUT与前级的核心电路RG(i－1)的复位端子RST_IN连接。对于最末级的核心电路RGm的复位端子RST_IN，输入清零信号CLR。
多个核心电路RG1～RGm的输出端子OUT分别与扫描线GL1～GLm连接。图4的各扫描线GL所连接的电容器将与扫描线连接的像素的电容简略化表示。
控制电路15生成上述的帧信号Frame_o、帧信号Frame_e、时钟信号ClkA、时钟信号ClkB及清零信号CLR，将这些信号向移位寄存器11A供给。
(核心电路RG的具体的结构)
接着，对核心电路RG的具体的结构进行说明。图5是图4所示的核心电路RG的电路图。核心电路RG具备输入部20、寄存器部21、输出部22、下拉部23及清零部24。核心电路RG使用N型电场效应晶体管(FET)而构成。以下，将FET单称作晶体管。在本实施方式中，作为一例，构成核心电路RG的晶体管由N沟道TFT构成。在本说明书中，也将晶体管的源极及漏极的一方称作第1端子，将另一方称作第2端子。
输入部20是用来接收输入信号VIN的电路。输入部20具备两个晶体管M2、M5。在晶体管M2的栅极，经由输入端子V_IN被输入输入信号VIN。输入信号VIN与前级的核心电路RG的输出信号对应。晶体管M2的漏极与自身的栅极连接。即，晶体管M2被二极管连接。晶体管M2的源极与节点An连接。晶体管M2在输入信号VIN为高电位的情况下将输入信号VIN向节点An转送，在输入信号VIN为低电位的情况下关断。
在晶体管(也称作复位晶体管)M5的栅极，经由复位端子RST_IN被输入复位信号RST。复位信号RST与后级的核心电路RG的输出信号对应。晶体管M5的漏极与节点An连接。晶体管M5的源极与被供给电压Vgl的电源端子连接。电压Vgl是用来将信号设定为低电位的基准电压，是比信号的高电位电压低的电压。电压Vgl例如是比接地电压GND低的负电压，被设定为－10V～－20V的范围。
寄存器部21是用来保持作用在选择状态及非选择状态的电容器Cb间的电压的电路。寄存器部21具备两个逆变器电路21o、21e和晶体管M1b。
逆变器电路21o具备3个晶体管M1o、M6o、M7o。在晶体管M1o的栅极，经由帧端子Fr_o被输入帧信号Frame_o。晶体管M1o的漏极与自身的栅极连接。晶体管M1o的源极与节点Bno连接。晶体管M1o在帧信号Frame_o为高电位的情况下，将帧信号Frame_o向节点Bno转送，在帧信号Frame_o为低电位的情况下关断。即，逆变器电路21o在帧信号Frame_o为高电位的情况下被有效化。
晶体管M6o的栅极与节点Bno连接。晶体管M6o的漏极与节点An连接。晶体管M6o的源极与被供给电压Vgl的电源端子连接。晶体管M6o具有将节点An的电位下拉的功能。
晶体管M7o的栅极与节点An连接。晶体管M7o的漏极与节点Bno连接。晶体管M7o的源极与被供给电压Vgl的电源端子连接。晶体管M7o具有将节点Bno的电位下拉的功能。
逆变器电路21e具备3个晶体管M1e、M6e、M7e。在晶体管M1e的栅极，经由帧端子Fr_e被输入帧信号Frame_e。晶体管M1e的漏极与自身的栅极连接。晶体管M1e的源极与节点Bne连接。晶体管M1e在帧信号Frame_e为高电位的情况下，将帧信号Frame_e向节点Bne转送，在帧信号Frame_e为低电位的情况下关断。即，逆变器电路21e在帧信号Frame_e为高电位的情况下被有效化。
晶体管M6e的栅极与节点Bne连接。晶体管M6e的漏极与节点An连接。晶体管M6e的源极与被供给电压Vgl的电源端子连接。晶体管M6e具有将节点An的电位下拉的功能。
晶体管M7e的栅极与节点An连接。晶体管M7e的漏极与节点Bne连接。晶体管M7e的源极与被供给电压Vgl的电源端子连接。晶体管M7e具有将节点Bne的电位下拉的功能。
晶体管M1b的栅极与节点An连接。晶体管M1b的电流路径的一端与节点Bno连接。晶体管M1b的电流路径的另一端与节点Bne连接。晶体管M1b在节点An为高电位的情况下，将节点Bno与节点Bne连接。
输出部22是用来将输出信号向扫描线GL输出的电路。输出部22具备晶体管(也称作输出晶体管)M3和电容器Cb。晶体管M3的栅极与节点An连接。在晶体管M3的漏极，被输入时钟信号Clk。时钟信号Clk是时钟信号ClkA、ClkB的某个，在第奇数个核心电路RG的情况下为时钟信号ClkA，在第偶数个核心电路RG的情况下为时钟信号ClkB。晶体管M3的源极与节点Qn连接。
电容器Cb的一个电极与节点An连接，电容器Cb的另一个电极与节点Qn连接。节点Qn与对应的扫描线GL连接。
下拉部23是用来将节点Qn的电位下拉的电路。下拉部23具备两个晶体管(也称作下拉晶体管)M4o、M4e。晶体管M4o的栅极与节点Bno连接。晶体管M4o的漏极与节点Qn连接。晶体管M4o的源极与被供给电压Vgl的电源端子连接。
晶体管M4e的栅极与节点Bne连接。晶体管M4e的漏极与节点Qn连接。晶体管M4e的源极与被供给电压Vgl的电源端子连接。
清零部24是用来将节点An及节点Qn清零的电路。清零部24具备两个晶体管M8、M9。在晶体管M8的栅极，经由清零端子CR被输入清零信号CLR。晶体管M8的漏极与节点Qn连接。晶体管M8的源极与被供给电压Vgl的电源端子连接。
在晶体管M9的栅极，经由清零端子CR被输入清零信号CLR。晶体管M9的漏极与节点An连接。晶体管M9的源极与被供给电压Vgl的电源端子连接。
[4]动作
对如上述那样构成的液晶显示装置1的动作进行说明。图6是说明液晶显示装置1的基本的动作的时序图。图6的行号与扫描线GL的编号对应。
控制电路15从外部接收信号Vsync。信号Vsync在从暂时成为低电位开始到再次成为低电位的期间是1帧。所述的1帧，是将全部的扫描线扫描1次的期间，此外是在画面上显示1个图像的期间。
移位寄存器11A基于被从控制电路15发送的信号而动作。在1帧期间中，包含在移位寄存器11A中的核心电路RG1～RGm以依次输出脉冲信号的方式动作。
图7是说明液晶显示装置1的更详细的动作的时序图。
帧信号Frame_o、Frame_e按照每1帧被交替地设为有效化(高电位)。对应于帧信号Frame_o、Frame_e，两个逆变器电路21o、21e交替地动作。控制电路15在信号Vsync为低电位的期间中切换帧信号Frame_o、Frame_e的状态。
作为一例，假设帧信号Frame_o被设为有效化(高电位)。帧信号Frame_e是低电位。如果帧信号Frame_o成为高电位，则逆变器电路21o的晶体管M1o接通，逆变器电路21o被有效化。逆变器电路21e的晶体管M1e关断，逆变器电路21e被无效化。
在帧信号Frame_o成为高电位后，开始信号ST被设为高电位。由此，第1级的核心电路RG1的输入信号VIN成为高电位。于是，输入部20的晶体管M2接通，节点An成为高电位。
如果节点An成为高电位，则逆变器电路21o的晶体管M7o接通，节点Bno成为低电位。即，逆变器电路21o在节点Bno保持节点An的反转数据。由此，下拉部23的晶体管M4o关断，节点Qn的下拉动作停止。
此外，如果节点An成为高电位，则输出部22的晶体管M3接通。接着，时钟信号ClkA成为高电位。于是，扫描线GL1成为高电位。
第2级的核心电路RG2作为输入信号VIN而从前级的核心电路RG1接收输出信号。接着，时钟信号ClkB成为高电位。于是，核心电路RG2将扫描线GL2设为高电位。
第1级的核心电路RG1接收第2级的核心电路RG2的输出信号作为复位信号RST。复位信号RST被向输入部20的晶体管M5的栅极输入。于是，晶体管M5接通，节点An成为低电位。
如果节点An成为低电位，则逆变器电路21o的晶体管M7o关断，节点Bno成为高电位。即，逆变器电路21o在节点Bno保持节点An的反转数据。如果节点Bno成为高电位，则晶体管M6o接通，节点An被保持为低电位。由此，下拉部23的晶体管M4o接通，节点Qn成为低电位。
此外，如果节点An成为低电位，则输出部22的晶体管M3关断。由此，扫描线GL1成为低电位。
另外，作为详细的设计，使邻接的核心电路RG不同时动作。因此，以使时钟信号ClkA的脉冲和时钟信号ClkB的脉冲不重叠的方式，在相互的边沿隔开间隔。
以下同样，核心电路RG3～RGm依次输出脉冲信号。
在最末级的核心电路RGm将脉冲信号输出后，清零信号CLR被设为高电位。如果清零信号CLR成为高电位，则清零部24的晶体管M8、M9接通。于是，节点Qn及节点An成为低电位。由此，核心电路RGm将扫描线GLm设为低电位。
然后，帧信号Frame_e被设为高电位，帧信号Frame_o被设为低电位。于是，核心电路RG的逆变器电路21e被有效化。然后，反复进行由移位寄存器11A进行的扫描动作。
通过这样的动作，在核心电路RG中，能够去除持续被施加正偏压的晶体管。由此，能够抑制构成核心电路RG的晶体管的特性变差。特别是，在作为晶体管而使用TFT的情况下，如果被持续施加正偏压，则阈值电压Vth偏移。但是，在本实施方式中，能够抑制TFT的特性变差。
接着，对选择期间中的核心电路RG的逆变器动作进行说明。所谓的选择期间，是扫描线被选择的期间，是扫描线输出脉冲信号的期间。非选择期间是选择期间以外的期间，是扫描线不输出脉冲信号的期间。
图8是说明选择期间中的核心电路RG的逆变器动作的示意图。作为一例，假设帧信号Frame_o被设为有效化(高电位(图8的“Hi”))，逆变器电路21o进行逆变器动作。帧信号Frame_e是低电位(图8的“Lo”)。
在晶体管M2的栅极，被从前级的核心电路RG输入高电位(图8的“ON”)的输入信号VIN。由此，晶体管M2接通，节点An成为高电位(图8的“Hi”)。
在晶体管M1o的栅极，被输入高电位的帧信号Frame_o。由此，晶体管M1o接通，逆变器电路21o被有效化。
由于节点An是高电位，所以晶体管M7o接通，节点Bno被下拉。图8的箭头是指电流。
进而，在选择期间中的逆变器动作中，可以使逆变器电路21e的晶体管M7e也动作。即，由于节点An是高电位，所以晶体管M1b、M7e接通。由此，节点Bno在晶体管M1b、节点Bne及晶体管M7e的路径中也被下拉。由此，能够将节点Bno可靠地设定为低电位。
晶体管M6o的驱动能力被设定为比晶体管M7o的驱动能力大。在非选择期间中，通过晶体管M6o将节点An下拉，能够将节点An可靠地设定为低电位。
作为用来实现上述逆变器动作的条件，晶体管M6、M7被设定为满足以下的条件。晶体管M6分别是指晶体管M6o、M6e，晶体管M7分别是指晶体管M7o、M7e。将晶体管M6、M7的沟道宽度分别表述为W6、W7。沟道宽度也被称作栅极宽度。
W7≤W6≤2×W7
通过设为“W6≤2×W7”，将晶体管M7o、M7e合并后的驱动能力变得比晶体管M6o(或晶体管M6e)的驱动能力大。由此，在选择期间中，能够将节点Bno可靠地设定为低电位。
通过设为“W7≤W6”，晶体管M6的驱动能力变得比晶体管M7的驱动能力大。由此，在非选择期间中能够将节点An可靠地设定为低电位。
着眼于距最末级近的核心电路RG中所包含的逆变器电路。逆变器电路21o、21e中的被无效化的逆变器电路(例如，设为逆变器电路21e)的节点Bne的电位通过晶体管M1e的泄漏电流而逐渐下降。因此，在距最末级近的核心电路RG中，在选择期间中晶体管M1b接通，被有效化侧的节点Bno与节点Bne接通，从而成为能够更切实地设定为低电位的机制。
接着，对第1级的核心电路RG1的详细的驱动波形进行说明。
图9及图10是第1级的核心电路RG1的驱动波形。在图9中表示节点An、Bno、Bne的波形。在图10中表示帧信号Frame_o、Frame_e及扫描线GL1的波形。图9及图10的横轴是时间(msec)，纵轴是电压(V)。波形振幅是Hi＝11V，Lo＝－10V。扫描线的脉冲宽度是约70μs，帧频率是60Hz。
首先，帧信号Frame_o被有效化(高电位)，逆变器电路21o被有效化。接着，节点An成为高电位，通过逆变器电路21o的逆变器动作，节点Bno成为低电位。此外，可知在节点Bno成为低电位的同时，逆变器电路21e的节点Bne成为低电位。由此，逆变器电路21e的晶体管M4e、M6e的栅极电压被保持为低电位，直到帧信号Frame_e成为高电位。然后，在被输入时钟信号ClkA的定时，向扫描线GL1输出脉冲信号。
接着，对最末级的核心电路RGm的详细的驱动波形进行说明。
图11及图12是最末级的核心电路RGm的驱动波形。在图11中示出了节点An、Bno、Bne的波形。在图12中示出了帧信号Frame_o、Frame_e及扫描线GLm的波形。
与核心电路RG1的情况同样，节点An为高电位，通过逆变器电路21o的逆变器动作，节点Bno成为低电位。然后，在被输入时钟信号ClkA的定时，向扫描线GLm输出脉冲信号。
此外，在最末级的核心电路RGm中，节点Bne的电位通过晶体管M1e的泄漏电流，在扫描线GLm被选择之前已经成为低电位。由此，晶体管M1b接通，节点Bno与节点Bne导通，能够将节点Bno更切实地设定为低电位。
[5]实施方式的效果
根据本实施方式，各核心电路RG具备两个逆变器电路21o、21e，通过对应于帧信号Frame_o、Frame_e而将逆变器电路21o、21e交替地有效化，能够防止在构成移位寄存器11A的晶体管(例如TFT)上持续施加电压。
具体而言，能够抑制栅极被连接于节点Bno的晶体管M6o的特性变差。特别是，能够抑制晶体管M6o的阈值电压偏移。由此，能够抑制逆变器电路21o成为功能不良。关于晶体管M6e也是同样的。由此，能够抑制移位寄存器11A误动作。
此外，能够抑制栅极被连接于节点Bno的晶体管M4o的特性变差。特别是，能够抑制晶体管M4o的阈值电压偏移。由此，能够抑制用来将扫描线下拉的晶体管M4o成为功能不良。关于晶体管M4e也是同样的。由此，能够抑制移位寄存器11A误动作。
此外，将节点Bno和节点Bne用晶体管M1b连接，在节点An为高电位的情况下，使节点Bno与节点Bne接通。由此，例如在逆变器电路21o被有效化的情况下，能够将节点Bno更可靠地设定为低电位。由此，能够抑制移位寄存器11A误动作。
此外，在扫描线的根数增加的情况下，也能够使移位寄存器11A可靠地动作。
另外，在上述实施方式中，按照每1帧来切换帧信号Frame_o、Frame_e的电压关系。但是，并不限定于此，也可以按照2帧以上的期间来切换帧信号Frame_o、Frame_e的电压关系。
此外，在上述实施方式中，对将晶体管全部用N型晶体管构成的情况进行了说明。但是，并不限定于此，也可以通过使电源电压及时钟信号的极性反转，将全部的晶体管用P型晶体管构成。
此外，上述实施方式中，作为显示装置而以液晶显示装置为例进行了说明。但是，并不限定于此，也能够对有机EL显示装置等的其他的显示装置应用。
本发明并不限定于上述实施方式，在实施阶段能够在不脱离其主旨的范围中进行各种变形。此外，各实施方式也可以适当组合而实施，在此情况下能得到组合的效果。进而，在上述实施方式中包括各种发明，通过从公开的多个构成要件选择的组合能够提取出各种发明。例如，在即使从实施方式中表示的全部构成要件中删除几个构成要件、也能够解决课题并得到效果的情况下，能够将删除了该构成要件后的结构作为发明。

Claims (9)

1.一种移位寄存器，其中，
具备与多个扫描线分别连接且被级联连接的多个核心电路；
上述多个核心电路分别包括：
输入部，将与前级的核心电路的输出信号对应的输入信号向第1节点转送；
第1逆变器电路，通过第1帧信号而被有效化，将上述第1节点的反转信号在第2节点保持；
第2逆变器电路，通过与上述第1帧信号互补的第2帧信号而被有效化，将上述第1节点的反转信号在第3节点保持；
第1晶体管，连接在上述第2节点与上述第3节点之间，并具有与上述第1节点连接的栅极；
输出部，包括输出晶体管和电容器，上述输出晶体管具有与上述第1节点连接的栅极、接收第1时钟信号或第2时钟信号的第1端子、和与扫描线连接的第2端子，上述电容器具有与上述第1节点连接的第1电极、和与上述扫描线连接的第2电极；
第1下拉晶体管，具有与上述第2节点连接的栅极、与上述扫描线连接的第1端子、和被供给基准电压的第2端子；以及
第2下拉晶体管，具有与上述第3节点连接的栅极、与上述扫描线连接的第1端子、和被供给上述基准电压的第2端子，
第奇数个核心电路接收上述第1时钟信号，
第偶数个核心电路接收与上述第1时钟信号互补的上述第2时钟信号。
2.如权利要求1所述的移位寄存器，其中，
上述第1逆变器电路包括第2晶体管及第3晶体管；
上述第2晶体管具有与上述第2节点连接的栅极、与上述第1节点连接的第1端子、和被供给上述基准电压的第2端子，
上述第3晶体管具有与上述第1节点连接的栅极、与上述第2节点连接的第1端子、和被供给上述基准电压的第2端子，
上述第2逆变器电路包括第4晶体管及第5晶体管，
上述第4晶体管具有与上述第3节点连接的栅极、与上述第1节点连接的第1端子、和被供给上述基准电压的第2端子，
上述第5晶体管具有与上述第1节点连接的栅极、与上述第3节点连接的第1端子、和被供给上述基准电压的第2端子。
3.如权利要求2所述的移位寄存器，其中，
如果设上述第2晶体管的沟道宽度为W1，设上述第3晶体管的沟道宽度为W2，则具有
W2≤W1≤2×W2的关系。
4.如权利要求1～3中任一项所述的移位寄存器，其中，
上述第1逆变器电路包括将上述第1帧信号向上述第2节点转送的第6晶体管，
上述第2逆变器电路包括将上述第2帧信号向上述第3节点转送的第7晶体管。
5.如权利要求1～3中任一项所述的移位寄存器，其中，
上述输入部包括复位晶体管，
该复位晶体管具有：被输入与后级的核心电路的输出信号对应的复位信号的栅极、与上述第1节点连接的第1端子、和被供给上述基准电压的第2端子。
6.如权利要求5所述的移位寄存器，其中，
在最末级的核心电路所包含的复位晶体管的栅极，被输入在上述最末级的核心电路的输出信号被有效化后被有效化的清零信号。
7.如权利要求1～3中任一项所述的移位寄存器，其中，
在第1级的核心电路的输入部，被输入用来开始扫描动作的开始信号。
8.一种显示装置，其中，
具备权利要求1所述的移位寄存器。
9.如权利要求8所述的显示装置，其中，
还具备包括多个像素的像素阵列，
上述多个扫描线与上述像素阵列连接。
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