CN111489710A - 显示器件的驱动方法、驱动器以及显示器件 - Google Patents

显示器件的驱动方法、驱动器以及显示器件 Download PDF

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Abstract

一种显示器件的驱动方法、驱动器以及显示器件。该显示器件的驱动方法包括：分别向栅线输入长度为第一时间的开启信号；以及分别向数据线输入数据信号以驱动显示器件进行显示，沿栅线的信号输入端到远离信号输入端的一端的方向，在与该栅线交叉的并依次间隔排布的M条数据线中，相对于向最靠近信号输入端的第一条数据线输入数据信号的开始时间，向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，从而可减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。

Description

显示器件的驱动方法、驱动器以及显示器件
技术领域
本公开的实施例涉及一种显示器件的驱动方法、驱动器以及显示器件。
背景技术
随着显示技术的不断发展，薄膜晶体管液晶显示器(TFT-LCD)逐渐成为市场的主流。通常的薄膜晶体管液晶显示器包括阵列基板、对置基板以及位于阵列基板和对置基板之间的液晶层。通过阵列基板上的电极驱动液晶层中的液晶分子偏转，从而实现显示功能。
通常，薄膜晶体管液晶显示器包括相互交叉设置的多条栅线和多条数据线，以限定出多个像素单元，各像素单元包括薄膜晶体管和像素电极，薄膜晶体管的栅极与对应的栅线相连，薄膜晶体管的源极与对应的数据线相连，薄膜晶体管的漏极与像素电极相连。通过向栅线输入扫描信号，向数据线输入数据信号，以分时的方式驱动该显示器进行显示。
发明内容
本公开实施例提供一种显示器件的驱动方法、驱动器以及显示器件。该显示器件的驱动方法包括：分别向栅线输入长度为第一时间的开启信号；以及分别向数据线输入数据信号以驱动显示器件进行显示，沿栅线的信号输入端到远离信号输入端的一端的方向，相对于向最靠近信号输入端的数据线输入数据信号的开始时间，向远离信号输入端的数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，从而可减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
本公开至少一个实施例提供一种显示器件的驱动方法中，所述显示器件包括交叉设置的多条栅线和多条数据线，各所述栅线包括信号输入端，所述多条数据线沿所述栅线的延伸方向间隔排列，所述驱动方法包括：分别向所述栅线输入长度为第一时间的开启信号；以及分别向所述数据线输入数据信号以驱动所述显示器件进行显示，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，在与所述栅线交叉的并依次间隔排布的M条所述数据线中，相对于向最靠近所述信号输入端的第一条所述数据线输入数据信号的开始时间，向第m条所述数据线输入数据信号的开始时间延后第二时间，所述第二时间小于所述第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
例如，在本公开一实施例提供的显示器件的驱动方法中，所述多条数据线包括N组数据线组，在各所述数据线组中，向各所述数据线输入数据信号的开始时间相同，沿所述栅线的所述信号输入端到远离所述信号输入端的一端的方向，所述N组数据线组中的所述第二时间随着与所述信号输入端的距离增加而逐渐增加，N为大于等于1的正整数。
例如，在本公开一实施例提供的显示器件的驱动方法中，所述驱动方法还包括：确定各所述栅线的整体延迟时间TCLK；以及将所述整体延迟时间均分为N份，所述N组数据线组中第n组数据线组中的所述第二时间y＝(n-1)×TCLK/N。
例如，在本公开一实施例提供的显示器件的驱动方法中，各所述栅线的整体延迟时间TCLK满足以下公式：
TCLK＝(2j×Tj+2j-1×Tj-1+…+22×T2+21×T1+20×T0+k)×2t，
其中，t为信号时钟周期，k为补正基数，T0、T1、T2.....Tj取值范围是1或0，j的取值范围为4-8，k的取值范围0-10。
例如，在本公开一实施例提供的显示器件的驱动方法中，j的取值为4，6，或8。
例如，在本公开一实施例提供的显示器件的驱动方法中，所述显示器件包括N个源驱动器，被配置为向所述多条数据线加载所述数据信号，所述驱动方法包括：使用所述N个源驱动器分别驱动所述N组数据线组。
例如，在本公开一实施例提供的显示器件的驱动方法中，所述多条栅线包括一一对应设置的多条第一栅线和多条第二栅线，所述第一栅线的信号输入端位于所述显示器件的第一边缘，所述第二栅线的信号输入端位于所述显示器件的与第一边缘相对的第二边缘，对应设置的所述第一栅线和所述第二栅线被配置为加载同一时序的所述开启信号。
例如，在本公开一实施例提供的显示器件的驱动方法中，一一对应设置的所述第一栅线和所述第二栅线相连。
例如，在本公开一实施例提供的显示器件的驱动方法中，所述显示器件还包括：所述多条栅线和所述多条数据线交叉限定的多个像素单元，各所述像素单元包括薄膜晶体管，所述薄膜晶体管的栅极与所述栅线相连，所述薄膜晶体管的源极与所述数据线相连。
例如，在本公开一实施例提供的显示器件的驱动方法中，所述开启信号为第一脉冲信号；所述数据信号为第二脉冲信号。
本公开至少一个实施例提供一种驱动器，包括：至少一个栅驱动器，被配置为分别向所述栅线输入长度为第一时间的开启信号；以及至少一个源驱动器，被配置为分别向所述数据线输入数据信号以驱动显示器件进行显示，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，在与所述栅线交叉的并依次间隔排布的M条所述数据线中，相对于向最靠近所述信号输入端的第一条所述数据线输入数据信号的开始时间，向第m条所述数据线输入数据信号的开始时间延后第二时间，所述第二时间小于所述第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
例如，本公开一实施例提供的驱动器还包括：延迟驱动器，被配置为使得所述源驱动器在沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，在与所述栅线交叉的并依次间隔排布的M条所述数据线中，相对于向最靠近所述信号输入端的第一条所述数据线输入数据信号的开始时间，向第m条所述数据线输入数据信号的开始时间延后第二时间，所述第二时间小于所述第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
例如，在本公开一实施例提供的驱动器中，所述多条数据线包括N组数据线组，所述至少一个源驱动器包括N个源驱动器，被配置为向所述多条数据线加载所述数据信号，所述N个源驱动器被配置为分别驱动N组数据线组，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，所述N组数据线组中的所述第二时间随着与所述信号输入端的距离增加而逐渐增加。
本公开至少一个实施例提供一种显示器件，包括上述的驱动器。
例如，在本公开一实施例提供的显示器件中，所述显示器件的分辨率大于4K*2K。
附图说明
为了更清楚地说明本公开实施例的技术方案，下面将对实施例的附图作简单地介绍，显而易见地，下面描述中的附图仅仅涉及本公开的一些实施例，而非对本公开的限制。
图1为一种显示器件的示意图；
图2为另一种显示器件的示意图；
图3为一种显示器件的栅线和数据线上信号延迟叠加的模拟效果图；
图4为一种显示器件的栅线和数据线上信号的波形图；
图5为根据本公开一实施例提供的一种显示器件的平面示意图；
图6为根据本公开一实施例提供的一种显示器件的驱动方法的流程图；
图7为根据本公开一实施例提供的一种显示器件上栅线和数据线上信号的波形图；
图8为根据本公开一实施例提供的一种显示器件的驱动方法中数据线组的第二时间的变化曲线图；
图9为根据本公开一实施例提供一种显示器件的驱动方法对栅线和数据线上信号延迟的补偿效果示意图；以及
图10为根据本公开一实施例提供的一种驱动器的示意图。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例的附图，对本公开实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本公开的一部分实施例，而不是全部的实施例。基于所描述的本公开的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其他实施例，都属于本公开保护的范围。
除非另外定义，本公开使用的技术术语或者科学术语应当为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。
随着显示器件的分辨率不断的提高，4K显示器件(4K分辨率的显示器件，4K分辨率可包括4096×3112、3656×2664等多种标准)在显示市场上日趋饱和，8K显示器件成为了各大厂商的研究热点。例如，8K的分辨率达到7680×4320的像素尺寸，是4K分辨率的4倍，从而能够带来细腻的高品质画质。
另一方面，大尺寸显示器件成为8K分辨率技术的热门载体。然而，大尺寸、高分辨率的显示器件存在面板充电率问题。以8K分辨率大尺寸的显示器件为例，一行像素的开启时间只有3.7μs，而实际有效的像素充电时间则更少，并且显示器件的分辨率越高，单位面积内所要驱动的像素则越多，从而导致显示器件的整个面板无法有效充电。通过调整充电时间的方法，因受限于充电时间短的问题，在8K分辨率、大尺寸的显示器件上效果有限。对于一些功耗较大的图片，极易产生Block分屏现象和因充电率不均所造成的Mura不良。因此，怎样在有限的时间内使得显示器件的整个面板上的各个像素的充电能力均一性最大化，以消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良是目前亟待解决的问题。
在研究中，本申请的发明人注意到上述问题产生的原因主要是因为显示器件的信号线(例如，栅线和数据线)因阻抗会产生信号衰减和延迟。图1为一种显示器件的示意图；图2为另一种显示器件的示意图。如图1和2所示，该显示器件包括显示面板100、栅驱动器200和源驱动器300。显示面板100包括阵列基板、对置基板、栅线和数据线；栅驱动器200可为GOA(Gate On Array)，设置在阵列基板上，并且可设置在显示器件的两个相对的边缘以使得驱动栅线上的信号可从显示器件的两个相对的边缘向显示器件的中部传播；源驱动器300可为覆晶薄膜(COF)。图1示出了数据线上信号延迟的示意图。如图1所示，在数据线的延伸方向，相对于数据线上靠近信号输入端的部分上的信号，数据线上远离信号输入端的部分上的信号，即远离源驱动器300的部分上的信号会产生延迟。如图2所示，在栅线的延伸方向，相对于栅线上靠近信号输入端的部分上的信号，栅线上远离信号输入端的部分上的信号，即远离栅驱动器200的部分上的信号会产生延迟。
图3示出了一种显示器件的栅线和数据线上信号延迟叠加的模拟效果图。如图3所示，当栅线的信号延迟与数据线的信号延迟叠加后，栅线上远离栅线的信号输入端的一端上的信号和数据线上远离数据线的信号输入端的一端上的信号会不匹配，导致充电时间不足，从而产生充电不足。如图3所示，图3中的三角区域Block分屏现象和Mura不良较为明显。图4示出了一种显示器件的栅线和数据线上信号的波形图。如图4所示，栅线上靠近信号输入端的部分上的信号如图4中线1所示，栅线上远离信号输入端的部分上的信号如图4中线2所示，由于栅线的阻抗等因此，栅线上远离信号输入端的部分上的信号会产生延迟和变形，当栅线上的信号的电压大于一定的值(例如，V0)才能打开薄膜晶体管，从而导致栅线上远离信号输入端的部分上的信号的有效充电时间小于栅线上靠近信号输入端的部分上的信号的有效充电时间。当通过源驱动器向数据线输入如线3所示的数据信号时，该数据信号与栅线上远离信号输入端的部分上的信号的有效充电面积大于该数据信号与栅线上远离信号输入端的部分上的信号的有效充电面积，从而导致栅线上远离信号输入端的部分对应的像素单元的充电时间比栅线上远离信号输入端的部分对应的像素单元的充电时间短，充电效果差异较大。
本公开实施例提供一种显示器件的驱动方法、驱动器以及显示器件。在该显示器件的驱动方法中，显示器件包括交叉设置的多条栅线和多条数据线，各栅线包括信号输入端，多条数据线沿栅线的延伸方向间隔排列，该驱动方法包括：分别向栅线输入长度为第一时间的开启信号；以及分别向数据线输入数据信号以驱动显示器件进行显示，沿栅线的信号输入端到远离信号输入端的一端的方向，沿栅线的信号输入端到远离信号输入端的一端的方向，在与该栅线交叉的并依次间隔排布的M条数据线中，相对于向最靠近信号输入端的第一条数据线输入数据信号的开始时间，向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，其中M、m均为大于等于2的正整数，m小于等于M，从而可使得数据线上的信号可匹配栅线的信号衰减和延迟，从而一方面减小距离栅线的信号输入端较近的数据线对应的像素单元的充电时间，另一方面增加距离栅线的信号输入端较远的数据线对应的像素单元的充电时间，从而使得整个显示器件中沿栅线的延伸方向上排布的像素单元的充电时间的均一性提高，从而减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
下面，结合附图对本公开实施例提供的显示器件的驱动方法、驱动器和显示器件进行详细的说明。
图5为根据本公开一实施例提供的一种显示器件的平面示意图。图6为根据本公开一实施例提供的一种显示器件的驱动方法的流程图。图7为根据本公开一实施例提供的一种显示器件上栅线和数据线上信号的波形图。
如图5所示，该显示器件包括交叉设置的多条栅线120和多条数据线140，各栅线120包括信号输入端127，多条数据线130沿栅线120的延伸方向间隔排列，如图6所示，该驱动方法包括以下步骤S501-S502。
S501：分别向栅线输入长度为第一时间的开启信号；
S502：分别向数据线输入数据信号以驱动显示器件进行显示，沿栅线的信号输入端到远离信号输入端的一端的方向，沿栅线的信号输入端到远离信号输入端的一端的方向，在与该栅线交叉的并依次间隔排布的M条数据线中，相对于向最靠近信号输入端的第一条数据线输入数据信号的开始时间，向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，其中M、m均为大于等于2的正整数，m小于等于M。需要说明的是，上述进行开启时间比较的数据线是对应多条栅线中的一条的数据线；即，向多条栅线中的一条输入长度为第一时间的开启信号时，沿该栅线的信号输入端到远离信号输入端的一端的方向，在与该栅线交叉的并依次间隔排布的M条数据线中，相对于向最靠近信号输入端的第一条数据线输入数据信号的开始时间，向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
在本公开实施例提供的显示器件的驱动方法中，如图7所示，栅线上靠近信号输入端的部分上的信号如图7中线1所示，栅线上远离信号输入端的部分上的信号如图7中线2所示，由于栅线的阻抗等因此，栅线上远离信号输入端的部分上的信号会产生延迟和变形，当栅线上的信号的电压大于一定的值(例如，V0)才能打开薄膜晶体管，从而导致栅线上远离信号输入端的部分上的信号的有效充电时间小于栅线上靠近信号输入端的部分上的信号的有效充电时间。当通过源驱动器向数据线输入如线3(通常的数据信号)所示的数据信号时，该数据信号与栅线上远离信号输入端的部分上的信号的有效充电面积大于该数据信号与栅线上远离信号输入端的部分上的信号的有效充电面积，从而导致栅线上远离信号输入端的部分对应的像素单元的充电时间比栅线上远离信号输入端的部分对应的像素单元的充电时间短，充电效果差异较大；而当通过源驱动器向数据线输入如线4(本公开的数据信号)所示的数据信号时，该数据信号相对于线3所示的数据线延后第二时间，即向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，可使得数据线上的信号可匹配栅线的信号衰减和延迟，从而一方面减小距离栅线的信号输入端较近的数据线对应的像素单元的充电时间，另一方面增加距离栅线的信号输入端较远的数据线对应的像素单元的充电时间，从而使得整个显示器件中沿栅线的延伸方向上排布的像素单元的充电时间的均一性提高，从而减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
例如，在一些示例中，如图5所示，多条数据线130可划分为N组数据线组135，即，多条数据线130包括N组数据线组135。在各数据线组135中，向各数据线130输入数据信号的开始时间相同，也就是说，在各数据线组135中，向各数据线130输入数据信号的开始时间互相之间没有延迟。沿栅线的信号输入端到远离信号输入端的一端的方向，N组数据线组中的第二时间随着与信号输入端的距离增加而逐渐增加。随着与信号输入端的距离的增加，栅线上的信号的延迟也逐渐增加，因此通过将N组数据线组中的第二时间随着与信号输入端的距离增加而逐渐增加，可进一步提高整个显示器件中沿栅线的延伸方向上排布的像素单元的充电时间的均一性，从而进一步减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
例如，在一些示例中，驱动方法还包括：确定各栅线的整体延迟时间TCLK；以及将整体延迟时间均分为N份，N组数据线组中第n组数据线组中的第二时间y＝(n-1)×TCLK/N，从而使得N组数据线组中的第二时间随着与信号输入端的距离增加而逐渐增加的量更均匀，从而进一步提高整个显示器件中沿栅线的延伸方向上排布的像素单元的充电时间的均一性，从而进一步减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
例如，N的取值可为24，即数据线130包括24组数据线组135；此时，24组数据线组135的第n组数据线组中的第二时间y＝(n-1)×TCLK/24。
例如，在一些示例中，各栅线的整体延迟时间TCLK满足以下公式：
TCLK＝(2j×Tj+2j-1×Tj-1+…+22×T2+21×T1+20×T0+k)×2t，
其中，t为信号时钟周期，k为补正基数，T0、T1、T2.....Tj取值范围是1或0，j的取值范围为4-8，k的取值范围0-10。
在该驱动方法中，随着T0、T1、T2.....Tj的取值不同，可获得不同的整体延迟时间，并通过上述驱动方法驱动显示器件进行显示，从而可根据显示器件的显示效果得到Block分屏现象Mura不良较弱的T0、T1、T2.....Tj的值。另外，由于T0、T1、T2.....Tj的值可用一个二进制的数值来表示，因此便于进行计算和存储。另外，补正基数k可保证该栅线的整体延迟时间具有一个最小的补正值。需要说明的是，由于影响栅线上信号延迟的因素较多，并且不同显示器件的具体参数不同，采用上述公式计算栅线的整体延迟时间，仅需要调节j值便可便利地进行计算，具有简单、有效等优点。
例如，当显示器件为8k分辨率75寸的显示器件时，k的取值范围可为4-6，又例如，k＝5。
例如，上述的信号时钟周期t的取值范围可为5-10μm。
需要说明的是，上述的k、t的具体取值范围可根据显示器件的具体参数确定，本公开实施例包括但不限于上述的取值范围。
例如，在一些示例中，j的取值为4，6，或8。当j的取值为4时，计算量较小，当j的取值为8时，栅线的整体延迟时间较大，适合对较大尺寸和分辨率的显示器件进行计算并且效果较好。
例如，如图5所示，该显示器件包括N个源驱动器300，被配置为向多条数据线130加载数据信号，驱动方法包括：使用N个源驱动器300分别驱动N组数据线组135。由此，每个源驱动器300向各数据线130输入数据信号的开始时间互相之间没有延迟，不同源驱动器300数据线130输入数据信号的开始时间不同，从而可降低各源驱动器300的计算压力。
例如，在一些示例中，如图5所示，显示器件还包括多条栅线120和多条数据线130交叉限定的多个像素单元140，各像素单元140包括薄膜晶体管150，薄膜晶体管150的栅极151与栅线120相连，薄膜晶体管150的源极152与数据线130相连。从而，栅线120上的开启信号可打开薄膜晶体管150，使得数据线130上的数据信号可从薄膜晶体管150的源极152流向薄膜晶体管150的漏极153，并加载在像素电极(未示出)上。
例如，在一些示例中，开启信号为第一脉冲信号；数据信号为第二脉冲信号。
例如，如图5所示，多条栅线120包括一一对应设置的多条第一栅线121和多条第二栅线122，第一栅线121的信号输入端1217位于显示器件的第一边缘161，第二栅线122的信号输入端1227位于显示器件的与第一边缘161相对的第二边缘162，对应设置的第一栅线121和第二栅线122被配置为加载同一时序的开启信号。
例如，在一些示例中，一一对应设置的第一栅线121和第二栅线122也可相连。需要说明的是，此时，第一栅线121和第二栅线122可独立计算整体延迟时间，也可分别计算整体延迟时间。
例如，如图5所示，一一对应设置的第一栅线121和第二栅线122可作为一个整体计算整体延迟时间TCLK，并且与第一栅线121交叉设置的数据线130可分为N/2组数据线组，与第二栅线122交叉设置的数据线130可分为N/2组。此时，可将将整体延迟时间TCLK均分为N份，与第一栅线121交叉设置的N/2组数据线组中第n1组数据线组中的第二时间y1＝(n1-1)×TCLK/N，与第二栅线122交叉设置的N/2组数据线组中第n2组数据线组中的第二时间y2＝(n2-1)×TCLK/N。
图8为根据本公开一实施例提供的一种显示器件的驱动方法中数据线组的第二时间的变化曲线图。如图8所示，N的取值可为24，即数据线包括24组数据线组；此时，从第一栅线的信号输入端到远离信号输入端的方向上，与第一栅线交叉设置的N/2组数据线组的第二时间可分别为：0、TCLK/N、2TCLK/N、…(N/2-1)TCLK/N；从第二栅线的信号输入端到远离信号输入端的方向上，与第二栅线交叉设置的N/2组数据线组的第二时间可分别为：0、TCLK/N、2TCLK/N、…(N/2-1)TCLK/N。图9为根据本公开一实施例提供一种显示器件的驱动方法对栅线和数据线上信号延迟的补偿效果示意图。如图9所示的数据线组的第二时间的变化曲线图刚好可与图3所示的栅线和数据线上信号延迟叠加的三角形薄膜区域匹配，从而可实现整个显示器件内像素单元的充电率或充电效果的均一性的最大化，进而改善因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
需要说明的是，图8中的数据线组的第二时间的变化曲线的斜率可根据实际情况进行调整，斜率的大小可根据源驱动器的驱动能力决定的。斜率越高，第二时间的大小就越大，具体可根据显示器件的数据线的阻抗大小来决定。另外，数据线组的第二时间的变化曲线可为连续的，也是可不连续的曲线，可以是斜率一致的直线也可以是斜率有变化的曲线或者折线，本公开实施例包括但不限于此。数据线组的第二时间的变化曲线可根据显示器件的栅线上的信号变化情况进行变更。
图10为根据本公开一实施例提供一种驱动器的示意图。如图10所示，该驱动器700包括至少一个栅驱动器200和至少一个源驱动器300；栅驱动器200被配置为向栅线输入长度为第一时间的开启信号；源驱动器300被配置为分别向数据线输入数据信号以驱动显示器件进行显示，沿栅线的信号输入端到远离信号输入端的一端的方向，相对于向最靠近信号输入端的数据线输入数据信号的开始时间，向远离信号输入端的数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，从而可使得数据线上的信号可匹配栅线的信号衰减和延迟，从而一方面减小距离栅线的信号输入端较近的数据线对应的像素单元的充电时间，另一方面增加距离栅线的信号输入端较远的数据线对应的像素单元的充电时间，从而使得整个显示器件中沿栅线的延伸方向上排布的像素单元的充电时间的均一性提高，从而减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
例如，在一些示例中，该驱动器还包括延迟驱动器600，被配置为使得源驱动器300在沿栅线的信号输入端到远离信号输入端的一端的方向，沿该栅线的信号输入端到远离信号输入端的一端的方向，在与栅线交叉的并依次间隔排布的M条数据线中，相对于向最靠近信号输入端的第一条数据线输入数据信号的开始时间，向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间，其中M、m均为大于等于2的正整数，m小于等于M。也就是说，在该驱动器中，栅驱动器和源驱动器可采用通常的栅驱动器和源驱动器，通过增设延迟驱动器600使得源驱动器300在沿栅线的信号输入端到远离信号输入端的一端的方向，沿该栅线的信号输入端到远离信号输入端的一端的方向，在与栅线交叉的并依次间隔排布的M条数据线中，相对于向最靠近信号输入端的第一条数据线输入数据信号的开始时间，向第m条数据线输入数据信号的开始时间延后第二时间，第二时间小于第一时间。
例如，在一些示例中，多条数据线包括N组数据线组，至少一个源驱动器300包括N个源驱动器300，被配置为向多条数据线加载数据信号，N个源驱动器300被配置为分别驱动N组数据线组，沿栅线的信号输入端到远离信号输入端的一端的方向，N组数据线组中的第二时间随着与信号输入端的距离增加而逐渐增加。
本公开一实施例还提供一种显示器件，包括上述任一种驱动器，从而可使得整个显示器件中沿栅线的延伸方向上排布的像素单元的充电时间的均一性提高，从而减弱甚至消除因充电不均导致的Block分屏现象和因充电率不均所造成的Mura不良。
例如，在一些示例中，该显示器件可为电视机、电脑、导航仪、笔记本电脑、手机、电子相册等具有显示功能的产品。
例如，在一些示例中，该显示器件的分辨率大于4K*2K。又例如，该显示器件的分辨率大于等于8k。
有以下几点需要说明：
(1)本公开实施例附图中，只涉及到与本公开实施例涉及到的结构，其他结构可参考通常设计。
(2)在不冲突的情况下，本公开同一实施例及不同实施例中的特征可以相互组合。
以上，仅为本公开的具体实施方式，但本公开的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本公开揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本公开的保护范围之内。因此，本公开的保护范围应以权利要求的保护范围为准。

Claims (15)

1.一种显示器件的驱动方法，其中，所述显示器件包括交叉设置的多条栅线和多条数据线，各所述栅线包括信号输入端，所述多条数据线沿所述栅线的延伸方向间隔排列，所述驱动方法包括：
分别向所述栅线输入长度为第一时间的开启信号；以及
分别向所述数据线输入数据信号以驱动所述显示器件进行显示，
其中，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，在与所述栅线交叉的并依次间隔排布的M条所述数据线中，相对于向最靠近所述信号输入端的第一条所述数据线输入数据信号的开始时间，向第m条所述数据线输入数据信号的开始时间延后第二时间，
所述第二时间小于所述第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
2.根据权利要求1所述的显示器件的驱动方法，其中，所述多条数据线包括N组数据线组，
在各所述数据线组中，向各所述数据线输入数据信号的开始时间相同，
沿所述栅线的所述信号输入端到远离所述信号输入端的一端的方向，所述N组数据线组中的所述第二时间随着与所述信号输入端的距离增加而逐渐增加，其中N大于等于1的正整数。
3.根据权利要求2所述的显示器件的驱动方法，其中，所述驱动方法还包括：
确定各所述栅线的整体延迟时间TCLK；以及
将所述整体延迟时间均分为N份，所述N组数据线组中第n组数据线组中的所述第二时间y＝(n-1)×TCLK/N。
4.根据权利要求3所述的显示器件的驱动方法，其中，各所述栅线的整体延迟时间TCLK满足以下公式：
TCLK＝(2j×Tj+2j-1×Tj-1+…+22×T2+21×T1+20×T0+k)×2t，
其中，t为信号时钟周期，k为补正基数，T0、T1、T2.....Tj取值范围是1或0，j的取值范围为4-8，k的取值范围0-10。
5.根据权利要求4所述的显示器件的驱动方法，其中，j的取值为4，6，或8。
6.根据权利要求2-5中任一项所述的显示器件的驱动方法，其中，所述显示器件包括N个源驱动器，被配置为向所述多条数据线加载所述数据信号，所述驱动方法包括：
使用所述N个源驱动器分别驱动所述N组数据线组。
7.根据权利要求1-5中任一项所述的显示器件的驱动方法，其中，所述多条栅线包括一一对应设置的多条第一栅线和多条第二栅线，
所述第一栅线的信号输入端位于所述显示器件的第一边缘，所述第二栅线的信号输入端位于所述显示器件的与第一边缘相对的第二边缘，
对应设置的所述第一栅线和所述第二栅线被配置为加载同一时序的所述开启信号。
8.根据权利要求7所述的显示器件的驱动方法，其中，一一对应设置的所述第一栅线和所述第二栅线相连。
9.根据权利要求1-5中任一项所述的显示器件的驱动方法，其中，所述显示器件还包括：所述多条栅线和所述多条数据线交叉限定的多个像素单元，各所述像素单元包括薄膜晶体管，
其中，所述薄膜晶体管的栅极与所述栅线相连，所述薄膜晶体管的源极与所述数据线相连。
10.根据权利要求1-5中任一项所述的显示器件的驱动方法，其中，所述开启信号为第一脉冲信号；所述数据信号为第二脉冲信号。
11.一种驱动器，包括：
至少一个栅驱动器，被配置为分别向所述栅线输入长度为第一时间的开启信号；以及
至少一个源驱动器，被配置为分别向所述数据线输入数据信号以驱动显示器件进行显示，
其中，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，在与所述栅线交叉的并依次间隔排布的M条所述数据线中，相对于向最靠近所述信号输入端的第一条所述数据线输入数据信号的开始时间，向第m条所述数据线输入数据信号的开始时间延后第二时间，
所述第二时间小于所述第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
12.根据权利要求11所述的驱动器，还包括：
延迟驱动器，被配置为使得所述源驱动器在沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，在与所述栅线交叉的并依次间隔排布的M条所述数据线中，相对于向最靠近所述信号输入端的第一条所述数据线输入数据信号的开始时间，向第m条所述数据线输入数据信号的开始时间延后第二时间，
所述第二时间小于所述第一时间，其中M、m均为大于等于2的正整数，m小于等于M。
13.根据权利要求11或12所述的驱动器，其中，所述多条数据线包括N组数据线组，所述至少一个源驱动器包括N个源驱动器，被配置为向所述多条数据线加载所述数据信号，所述N个源驱动器被配置为分别驱动N组数据线组，沿所述栅线的信号输入端到远离所述信号输入端的一端的方向，所述N组数据线组中的所述第二时间随着与所述信号输入端的距离增加而逐渐增加。
14.一种显示器件，包括根据权利要求11-13中任一项所述驱动器。
15.根据权利要求14所述的显示器件，其中，所述显示器件的分辨率大于4K*2K。
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