CN111477190A - Goa器件及栅极驱动电路 - Google Patents

Goa器件及栅极驱动电路 Download PDF

Info

Publication number
CN111477190A
CN111477190A CN202010403135.8A CN202010403135A CN111477190A CN 111477190 A CN111477190 A CN 111477190A CN 202010403135 A CN202010403135 A CN 202010403135A CN 111477190 A CN111477190 A CN 111477190A
Authority
CN
China
Prior art keywords
unit
goa unit
level
thin film
pull
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN202010403135.8A
Other languages
English (en)
Inventor
徐志达
姚晓慧
金一坤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd
Original Assignee
Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd filed Critical Shenzhen China Star Optoelectronics Semiconductor Display Technology Co Ltd
Priority to CN202010403135.8A priority Critical patent/CN111477190A/zh
Priority to US17/042,964 priority patent/US11763769B2/en
Priority to PCT/CN2020/094713 priority patent/WO2021227161A1/zh
Publication of CN111477190A publication Critical patent/CN111477190A/zh
Pending legal-status Critical Current

Links

Images

Classifications

    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3674—Details of drivers for scan electrodes
    • G09G3/3677—Details of drivers for scan electrodes suitable for active matrices only
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/28—Digital stores in which the information is moved stepwise, e.g. shift registers using semiconductor elements
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2300/00—Aspects of the constitution of display devices
    • G09G2300/04—Structural and physical details of display devices
    • G09G2300/0404—Matrix technologies
    • G09G2300/0408—Integration of the drivers onto the display substrate
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00—Command of the display device
    • G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
    • G09G2310/0264—Details of driving circuits
    • G09G2310/0286—Details of a shift registers arranged for use in a driving circuit

Landscapes

  • Engineering & Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Liquid Crystal Display Device Control (AREA)
  • Shift Register Type Memory (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Abstract

本申请提出了一种GOA器件及栅极驱动电路，该GOA器件包括级联的至少两个GOA单元，该第GOA单元包括一上拉控制单元、一自举电容、一上拉单元、一下拉单元以及一下拉维持单元。本申请通过将自举电容、下拉单元及下拉维持单元复用，在一级GOA单元中同时输出第n级GOA单元及第n+1级GOA单元的栅极驱动信号，减少了栅极驱动电路中薄膜晶体管的数量，简化了栅极驱动电路的结构。

Description

GOA器件及栅极驱动电路
技术领域
本申请涉及显示领域，特别涉及一种GOA器件及栅极驱动电路。
背景技术
阵列基板行驱动(Gate Drive On Array，GOA)技术，为将扫描线驱动电路集成在液晶面板的阵列基板上，从而在材料成本和制作工艺方面上降低产品成本。
随着显示行业技术的发展，用户对显示面板的外观设计要求越来越高，比如窄边框的设计。显示面板边框区域设置有栅极驱动电路，该栅极驱动电路包括n级GOA单元，而任一级GOA单元设置有多个薄膜晶体管，使得边框区域无法进一步减小。
目前，亟需一种栅极驱动电路以解决上述技术问题。
发明内容
本申请提供一种GOA器件及栅极驱动电路，以解决现有显示面板中栅极驱动电路结构复杂的技术问题。
为解决上述问题，本申请提供的技术方案如下：
本申请提供了一种GOA器件，包括级联的至少两个GOA单元，第n级GOA单元用于对第n级水平扫描线输出栅极驱动信号，其中，所述第n级GOA单元包括一上拉控制单元、一自举电容、一上拉单元、一下拉单元以及一下拉维持单元；
所述上拉控制单元于第一阶段接收一启动信号而使第n级GOA单元及第n+1级GOA单元的控制节点(Qn)拉高至第一高电位以及对所述自举电容充电；
所述自举电容于第二阶段将所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)维持在所述第一高电位；
所述上拉单元依据第一时钟信号、所述第n级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n级GOA单元的栅极信号端(Gn)，以及所述上拉单元依据第二时钟信号、所述第n+1级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n+1级GOA单元的栅极信号端(Gn+1)；
所述下拉单元于第三阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位拉低至一第一直流低电平、将所述第n级GOA单元的栅极信号端(Gn)的电位拉低至一第二直流低电平、及将所述第n+1级GOA单元的栅极信号端(Gn+1)的电位拉低至一第二直流低电平；
所述下拉维持单元于第四阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)维持于所述第一直流低电平，并将所述第n级GOA单元的栅极信号端(Gn)及所述第n+1级GOA单元的栅极信号端(Gn+1)的电位维持于所述第二直流低电平。
在本申请的GOA器件中，所述上拉控制单元连接第n-6级GOA单元的级传信号端(STn-6)和所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)；
在所述第一阶段中，所述上拉控制单元自所述第n-6级GOA单元的级传信号端(STn-6)接收所述启动信号，以及根据所述第n-6级GOA单元的级传信号端(STn-6)接收所述启动信号使所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)处于所述第一高电位。
在本申请的GOA器件中，所述上拉控制单元包括一第十一薄膜晶体管(T11)；
所述第十一薄膜晶体管(T11)的栅极及源极连接所述第n-6级GOA单元的级传信号输出端(STn-6)，所述第十一薄膜晶体管(T11)的漏极连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)。
在本申请的GOA器件中，所述自举电容连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、所述下拉维持单元、及所述上拉单元；
所述自举电容的第一端连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)、所述上拉单元，所述自举电容的第二端连接所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)及所述下拉维持单元。
在本申请的GOA器件中，所述上拉单元包括第一上拉子单元和第二上拉子单元；
所述第一上拉子单元连接所述第n级GOA单元的控制节点(Qn)、第一时钟信号端(CKn)、第n级GOA单元的级传信号端(STn)、及所述第n级的栅极信号端(Gn)；
所述第二上拉子单元连接所述第n+1级GOA单元的控制节点(Qn)、第二时钟信号端(CKn+1)、第n+1级GOA单元的级传信号端(STn+1)、及所述第n+1级的栅极信号端(Gn+1)；
所述第一时钟信号端(CKn)用于提供所述第一时钟信号，所述第二时钟信号端(CKn+1)用于提供所述第二时钟信号；
所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位用于控制所述上拉单元中的薄膜晶体管打开和关闭。
在本申请的GOA器件中，所述第一上拉子单元包括一第二十一薄膜晶体管(T21)和一第二十二薄膜晶体管(T22)；
所述第二十一薄膜晶体管(T21)的栅极连接所述第n级GOA单元的控制节点(Qn)，所述第二十一薄膜晶体管(T21)的源极连接所述第一时钟信号端(CK)，所述第二十一薄膜晶体管(T21)的漏极连接所述第n级的栅极信号端(Gn)；
所述第二十二薄膜晶体管(T22)的栅极连接所述第n级GOA单元的控制节点(Qn)，所述第二十二薄膜晶体管(T22)的源极连接所述第一时钟信号端(CK)，所述第二十二薄膜晶体管(T22)的漏极连接第n级GOA单元的级传信号端(STn)；
所述第二上拉子单元包括一第七十一薄膜晶体管(T71)和一第七十二薄膜晶体管(T72)；
所述第七十一薄膜晶体管(T71)的栅极连接所述第n+1级GOA单元的控制节点(Qn)，所述第七十一薄膜晶体管(T71)的源极连接所述第二时钟信号端(CK)，所述第七十一薄膜晶体管(T71)的漏极连接所述第n+1级的栅极信号端(Gn+1)；
所述第七十二薄膜晶体管(T72)的栅极连接所述第n+1级GOA单元的控制节点(Qn)，所述第七十二薄膜晶体管(T72)的源极连接所述第二时钟信号端(CK)，所述第七十二薄膜晶体管(T72)的漏极连接第n+1级GOA单元的级传信号端(STn+1)。
在本申请的GOA器件中，所述下拉单元连接所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、第n+7级GOA单元的栅极信号端(Gn+7)、第n+8级GOA单元的栅极信号端(Gn+8)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)；
所述第一直流低电平端(VSSQ)提供所述第一直流低电平，所述第二直流低电平端(VSSG)提供所述第二直流低电平；
所述第三阶段开始于所述第n+7级GOA单元的栅极信号端(Gn+7)及所述第n+8级GOA单元的栅极信号端(Gn+8)处于高电位时。
在本申请的GOA器件中，所述下拉单元包括一第三十一薄膜晶体管(T31)、一第四十一薄膜晶体管(T41)、及一第七十薄膜晶体管(T70)；
所述第三十一薄膜晶体管(T31)的源极连接所述第n级GOA单元的栅极信号端(Gn)，所述第七十薄膜晶体管(T70)的源极连接所述第n+1级GOA单元的栅极信号端(Gn+1)，所述第四十一薄膜晶体管(T41)的源极连接所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)；
所述第三十一薄膜晶体管(T31)的漏极连接所述第二直流低电平端(VSSG)，所述第七十薄膜晶体管(T70)的漏极连接所述第二直流低电平端(VSSG)，所述第四十一薄膜晶体管(T41)的漏极连接所述第一直流低电平端(VSSQ)；
所述第三十一薄膜晶体管(T31)栅极连接所述第n+7级GOA单元的栅极信号端(Gn+7)，所述四十一薄膜晶体管(T41)的栅极连接所述第n+8级GOA单元的栅极信号端(Gn+8)，所述七十薄膜晶体管(T70)的栅极连接所述第n+8级GOA单元的栅极信号端(Gn+8)。
在本申请的GOA器件中，所述下拉维持单元包括第一下拉维持子单元及第二下拉维持子单元；
所述第一下拉维持子单元连接第一高压信号、所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)；
所述第二下拉维持子单元连接第二高压信号、所述第n级GOA单元的控制节点(Qn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)。
本申请还提出了一种栅极驱动电路，其中，所述栅极驱动电路包括上述GOA器件。
有益效果：本申请通过将自举电容、下拉单元及下拉维持单元复用，在一级GOA单元中同时输出第n级GOA单元及第n+1级GOA单元的栅极驱动信号，减少了栅极驱动电路中薄膜晶体管的数量，简化了栅极驱动电路的结构。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1为本申请显示面板的第一种结构图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
在本申请的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”、“顺时针”、“逆时针”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个所述特征。在本申请的描述中，“多个”的含义是两个或两个以上，除非另有明确具体的限定。
在本申请的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接或可以相互通讯；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通或两个元件的相互作用关系。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本申请中的具体含义。
在本申请中，除非另有明确的规定和限定，第一特征在第二特征之“上”或之“下”可以包括第一和第二特征直接接触，也可以包括第一和第二特征不是直接接触而是通过它们之间的另外的特征接触。而且，第一特征在第二特征“之上”、“上方”和“上面”包括第一特征在第二特征正上方和斜上方，或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”包括第一特征在第二特征正下方和斜下方，或仅仅表示第一特征水平高度小于第二特征。
下文的公开提供了许多不同的实施方式或例子用来实现本申请的不同结构。为了简化本申请的公开，下文中对特定例子的部件和设置进行描述。当然，它们仅仅为示例，并且目的不在于限制本申请。此外，本申请可以在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。此外，本申请提供了各种特定的工艺和材料的例子，但是本领域普通技术人员可以意识到其他工艺的应用和/或其他材料的使用。
随着显示行业技术的发展，用户对显示面板的外观设计要求越来越高，比如窄边框的设计。显示面板边框区域设置有栅极驱动电路，该栅极驱动电路包括n级GOA单元，而任一级GOA单元设置有多个薄膜晶体管，使得边框区域无法进一步减小。本申请基于上述技术问题提出了下列技术方案：
请参阅图1，本申请提供了一种GOA器件，包括级联的至少两个GOA单元，第n级GOA单元用于对第n级水平扫描线输出栅极驱动信号，其中，所述第n级GOA单元包括一上拉控制单元100、一自举电容Cb、一上拉单元200、一下拉单元300以及一下拉维持单元400；
所述上拉控制单元100于第一阶段接收一启动信号而使第n级GOA单元及第n+1级GOA单元的控制节点(Qn)拉高至第一高电位以及对所述自举电容Cb充电；
所述自举电容Cb于第二阶段将所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)维持在所述第一高电位；
所述上拉单元200依据第一时钟信号、所述第n级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n级GOA单元的栅极信号端(Gn)，以及所述上拉单元200依据第二时钟信号、所述第n+1级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n+1级GOA单元的栅极信号端(Gn+1)；
所述下拉单元300于第三阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位拉低至一第一直流低电平、将所述第n级GOA单元的栅极信号端(Gn)的电位拉低至一第二直流低电平、及将所述第n+1级GOA单元的栅极信号端(Gn+1)的电位拉低至一第二直流低电平；
所述下拉维持单元400于第四阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)维持于所述第一直流低电平，并将所述第n级GOA单元的栅极信号端(Gn)及所述第n+1级GOA单元的栅极信号端(Gn+1)的电位维持于所述第二直流低电平。
本申请通过将自举电容Cb、下拉单元300及下拉维持单元400复用，在一级GOA单元中同时输出第n级GOA单元及第n+1级GOA单元的栅极驱动信号，减少了栅极驱动电路中薄膜晶体管的数量，简化了栅极驱动电路的结构。
现结合具体实施例对本申请的技术方案进行描述。
请参阅图1，所述上拉控制单元100于第一阶段接收一启动信号而使第n级GOA单元及第n+1级GOA单元的控制节点(Qn)拉高至第一高电位以及对所述自举电容Cb充电。
在本实施例中，所述上拉控制单元100连接第n-6级GOA单元的级传信号端(STn-6)和所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)。所述启动信号来自于第n-6级GOA单元的级传信号端(STn-6)。
在所述第一阶段中，所述上拉控制单元100自所述第n-6级GOA单元的级传信号端(STn-6)接收所述启动信号，以及根据所述第n-6级GOA单元的级传信号端(STn-6)接收所述启动信号使所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)处于所述第一高电位。
在本实施例中，所述上拉控制单元100包括一第十一薄膜晶体管(T11)。所述第十一薄膜晶体管(T11)的栅极及源极连接所述第n-6级GOA单元的级传信号输出端(STn-6)，所述第十一薄膜晶体管(T11)的漏极连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)。所述第十一薄膜晶体管(T11)接收所述第n-6级GOA单元的级传信号端(STn-6)将发出的启动信号将所述第十一薄膜晶体管(T11)打开，所述第十一薄膜晶体管(T11)的漏极将所述第n-6级GOA单元的级传信号端(STn-6)发出的启动信号传输至所述第n级GOA单元的控制节点(Qn)，以及使所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)处于所述第一高电位。
在本实施例中，所述第n级GOA单元及所述第n+1级GOA单元共用同一控制节点(Qn)。
请参阅图1，所述自举电容Cb于第二阶段将所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)维持在所述第一高电位。
在本实施例中，所述自举电容Cb连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、所述下拉维持单元400、及所述上拉单元200；
所述自举电容Cb的第一端连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)、所述上拉单元200，所述自举电容Cb的第二端连接所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)及所述下拉维持单元400。
在第二阶段，所述第十一薄膜晶体管(T11)关闭，所述第n-6级GOA单元的级传信号端(STn-6)无法发出的启动信号以维持所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)的第一高电位，此时自举电容CbCb将使所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)继续维持在所述第一高电位。
在本实施例中，所述上拉单元200依据第一时钟信号、所述第n级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n级GOA单元的栅极信号端(Gn)，以及所述上拉单元200依据第二时钟信号、所述第n+1级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n+1级GOA单元的栅极信号端(Gn+1)。
在本实施例中，所述上拉单元200包括第一上拉子单元201和第二上拉子单元202。所述第一上拉子单元201连接所述第n级GOA单元的控制节点(Qn)、第一时钟信号端(CKn)、第n级GOA单元的级传信号端(STn)、及所述第n级的栅极信号端(Gn)。所述第二上拉子单元202连接所述第n+1级GOA单元的控制节点(Qn)、第二时钟信号端(CKn+1)、第n+1级GOA单元的级传信号端(STn+1)、及所述第n+1级的栅极信号端(Gn+1)。
在本实施例中，所述第一时钟信号端(CKn)用于提供所述第一时钟信号，所述第二时钟信号端(CKn+1)用于提供所述第二时钟信号。
在本实施例中，所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位用于控制所述上拉单元200中的薄膜晶体管打开和关闭。
在本实施例中，所述第一上拉子单元201包括一第二十一薄膜晶体管(T21)和一第二十二薄膜晶体管(T22)。
所述第二十一薄膜晶体管(T21)的栅极连接所述第n级GOA单元的控制节点(Qn)，所述第二十一薄膜晶体管(T21)的源极连接所述第一时钟信号端(CK)，所述第二十一薄膜晶体管(T21)的漏极连接所述第n级的栅极信号端(Gn)。
所述第二十二薄膜晶体管(T22)的栅极连接所述第n级GOA单元的控制节点(Qn)，所述第二十二薄膜晶体管(T22)的源极连接所述第一时钟信号端(CK)，所述第二十二薄膜晶体管(T22)的漏极连接第n级GOA单元的级传信号端(STn)。
所述第n级GOA单元的控制节点(Qn)的第一高电位将所述第二十一薄膜晶体管(T21)及所述第二十二薄膜晶体管(T22)打开，所述第二十一薄膜晶体管(T21)的漏极连接所述第n级的栅极信号端(Gn)，以输出所述栅极驱动信号至第n级扫描线，所述第二十二薄膜晶体管(T22)的漏极连接第n级GOA单元的级传信号端(STn)输出另一启动信号，以控制下一级GOA单元的打开和关闭。
在本实施例中，所述第二上拉子单元202包括一第七十一薄膜晶体管(T71)和一第七十二薄膜晶体管(T72)。
所述第七十一薄膜晶体管(T71)的栅极连接所述第n+1级GOA单元的控制节点(Qn)，所述第七十一薄膜晶体管(T71)的源极连接所述第二时钟信号端(CK)，所述第七十一薄膜晶体管(T71)的漏极连接所述第n+1级的栅极信号端(Gn+1)；
所述第七十二薄膜晶体管(T72)的栅极连接所述第n+1级GOA单元的控制节点(Qn)，所述第七十二薄膜晶体管(T72)的源极连接所述第二时钟信号端(CK)，所述第七十二薄膜晶体管(T72)的漏极连接第n+1级GOA单元的级传信号端(STn+1)。
所述第n+1级GOA单元的控制节点(Qn)的第一高电位将所述第七十一薄膜晶体管(T71)及所述第七十二薄膜晶体管(T72)打开，所述第七十一薄膜晶体管(T71)的漏极连接所述第n+1级的栅极信号端(Gn+1)，以输出所述栅极驱动信号至第n+1级扫描线，所述第七十二薄膜晶体管(T72)的漏极连接第n+1级GOA单元的级传信号端(STn+1)输出另一启动信号，以控制另一级GOA单元的打开和关闭。
在本实施例中，所述第一上拉子单元201输出的启动信号可以是第n或者第n+k级，所述第二上拉子单元202输出的启动信号可以是第n+1或者第n+1+k级。例如当n＝1，k＝4时，第1级GOA单元的第一上拉子单元201输出的是第5级GOA单元的启动信号，第2级GOA单元的第一上拉子单元201输出的是第6级GOA单元的启动信号，具体所传的级数本申请不作具体限定。
请参阅图1，所述下拉单元300于第三阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位拉低至一第一直流低电平、将所述第n级GOA单元的栅极信号端(Gn)的电位拉低至一第二直流低电平、及将所述第n+1级GOA单元的栅极信号端(Gn+1)的电位拉低至一第二直流低电平；
在本实施例中，所述下拉单元300连接所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、第n+7级GOA单元的栅极信号端(Gn+7)、第n+8级GOA单元的栅极信号端(Gn+8)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)；
在本实施例中，所述第一直流低电平端(VSSQ)提供所述第一直流低电平，所述第二直流低电平端(VSSG)提供所述第二直流低电平；
在本实施例中，所述第三阶段开始于所述第n+7级GOA单元的栅极信号端(Gn+7)及所述第n+8级GOA单元的栅极信号端(Gn+8)处于高电位时。
在本实施例中，所述下拉单元300包括一第三十一薄膜晶体管(T31)、一第四十一薄膜晶体管(T41)、及一第七十薄膜晶体管(T70)；
所述第三十一薄膜晶体管(T31)的源极连接所述第n级GOA单元的栅极信号端(Gn)，所述第七十薄膜晶体管(T70)的源极连接所述第n+1级GOA单元的栅极信号端(Gn+1)，所述第四十一薄膜晶体管(T41)的源极连接所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)；
所述第三十一薄膜晶体管(T31)的漏极连接所述第二直流低电平端(VSSG)，所述第七十薄膜晶体管(T70)的漏极连接所述第二直流低电平端(VSSG)，所述第四十一薄膜晶体管(T41)的漏极连接所述第一直流低电平端(VSSQ)；
所述第三十一薄膜晶体管(T31)栅极连接所述第n+7级GOA单元的栅极信号端(Gn+7)，所述四十一薄膜晶体管(T41)的栅极连接所述第n+8级GOA单元的栅极信号端(Gn+8)，所述七十薄膜晶体管(T70)的栅极连接所述第n+8级GOA单元的栅极信号端(Gn+8)。
当所述第n+7级GOA单元的栅极信号端(Gn+7)及所述第n+8级GOA单元的栅极信号端(Gn+8)处于高电位时，第三十一薄膜晶体管(T31)及第四十一薄膜晶体管(T41)被打开，所述第n级GOA单元的控制节点(Qn)被拉低至所述第一直流低电平，所述第n级GOA单元的栅极信号端(Gn)被拉低至所述第二直流低电平。
当所述第n+8级GOA单元的栅极信号端(Gn+8)处于高电位时，第七十薄膜晶体管(T70)及第四十一薄膜晶体管(T41)被打开，所述第n+1级GOA单元的控制节点(Qn)被拉低至所述第一直流低电平，所述第n+1级GOA单元的栅极信号端(Gn+1)被拉低至所述第二直流低电平。
请参阅图1，所述下拉维持单元400于第四阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)维持于所述第一直流低电平，并将所述第n级GOA单元的栅极信号端(Gn)及所述第n+1级GOA单元的栅极信号端(Gn+1)的电位维持于所述第二直流低电平。
在本实施例中，所述下拉维持单元400包括第一下拉维持子单元401及第二下拉维持子单元402。所述第一下拉维持子单元401连接第一高压信号、所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)。所述第二下拉维持子单元402连接第二高压信号、所述第n级GOA单元的控制节点(Qn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)。
在本实施例中，所述第一高压信号由第一高压直流信号端LC1发出，所述第二高压信号由第二高压直流信号端LC2发出。
在本实施例中，所述第一高压信号和第二高压信号为200倍帧周期，所述第一高压信号和第二高压信号为占空比50％的低频信号，所述第一高压信号和第二高压信号的相位相差1/2。
所述第一下拉维持子单元401包括第五十一薄膜晶体管(T51)、第五十二薄膜晶体管(T52)、第五十三薄膜晶体管(T53)、第五十四薄膜晶体管(T54)、第四十二薄膜晶体管(T42)以及第三十二薄膜晶体管(T32)。
所述第五十一薄膜晶体管(T51)的栅极以及漏极接入第一高压直流信号端LC1，所述第五十一薄膜晶体管(T51)的源极电性连接于所述第五十二薄膜晶体管(T52)的漏极以及所述第五十三薄膜晶体管(T53)的栅极。
所述第五十二薄膜晶体管(T52)的栅极电性连接至所述上拉控制模块的输出端，所述第五十二薄膜晶体管(T52)的源极电性连接于所述第一直流低电平端(VSSQ)。
所述第五十三薄膜晶体管(T53)的漏极接入第一高压直流信号端LC1，所述第五十三薄膜晶体管(T53)的源极电性连接至所述第五十四薄膜晶体管(T54)的漏极、所述第四十二薄膜晶体管(T42)的栅极以及所述第三十二薄膜晶体管(T32)的栅极。
所述第五十四薄膜晶体管(T54)的栅极电性连接至所述上拉控制模块的输出端，所述第五十四薄膜晶体管(T54)的源极电性连接于所述第一直流低电平端(VSSQ)。
所述第四十二薄膜晶体管(T42)的源极电性连接于所述第一直流低电平端(VSSQ)，所述第四十二薄膜晶体管(T42)的漏极电性连接至所述上拉控制模块的输出端。
所述第三十二薄膜晶体管(T32)的源极电性连接于所述第二直流低电平端(VSSG)，所述第三十二薄膜晶体管(T32)的漏极电性连接至第n级GOA单元的栅极信号端(Gn)。
所述第二下拉维持子单元402包括第六十一薄膜晶体管(T61)、第六十二薄膜晶体管(T62)、第六十三薄膜晶体管(T63)、第六十四薄膜晶体管(T64)、第四十三薄膜晶体管(T43)以及第三十三薄膜晶体管(T33)。
所述第六十一薄膜晶体管(T61)的栅极以及漏极接入第二高压直流信号端LC2，所述第六十一薄膜晶体管(T61)的源极电性连接于所述第六十二薄膜晶体管(T62)的漏极以及所述第六十三薄膜晶体管(T63)的栅极。
所述第六十二薄膜晶体管(T62)的栅极电性连接至所述上拉控制模块的输出端，所述第六十二薄膜晶体管(T62)的源极电性连接至所述第一直流低电平端(VSSQ)。
所述第六十三薄膜晶体管(T63)的漏极接入第二高压直流信号端LC2，所述第六十三薄膜晶体管(T63)的源极电性连接于所述第六十四薄膜晶体管(T64)的漏极、所述第四十三薄膜晶体管(T43)的栅极以及所述第三十三薄膜晶体管(T33)的栅极。
所述第六十四薄膜晶体管(T64)的栅极电性连接至所述上拉控制模块的输出端，所述第六十四薄膜晶体管(T64)的源极电性连接于所述第一直流低电平端(VSSQ)。
所述第四十三薄膜晶体管(T43)的源极电性连接于所述第一直流低电平端(VSSQ)，所述第四十三薄膜晶体管(T43)的漏极电性连接于所述上拉控制模块的输出端。
所述第三十三薄膜晶体管(T33)的源极电性连接于所述第二直流低电平端(VSSG)，所述第三十三薄膜晶体管(T33)的漏极电性连接于第n+1级GOA单元的栅极信号端(Gn+1)。
本申请还提出了一种栅极驱动电路，其中，所述栅极驱动电路包括上述GOA器件。所述栅极驱动电路的工作原理与上述GOA器件的工作原理相同或相似，此处不再赘述。
本申请提出了一种GOA器件及栅极驱动电路，该GOA器件包括级联的至少两个GOA单元，该第GOA单元包括一上拉控制单元、一自举电容、一上拉单元、一下拉单元以及一下拉维持单元。本申请通过将自举电容、下拉单元及下拉维持单元复用，在一级GOA单元中同时输出第n级GOA单元及第n+1级GOA单元的栅极驱动信号，减少了栅极驱动电路中薄膜晶体管的数量，简化了栅极驱动电路的结构。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
以上对本申请实施例所提供的一种GOA器件及栅极驱动电路进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (10)

1.一种GOA器件，包括级联的至少两个GOA单元，第n级GOA单元用于对第n级水平扫描线输出栅极驱动信号，其特征在于，所述第n级GOA单元包括一上拉控制单元、一自举电容、一上拉单元、一下拉单元以及一下拉维持单元；
所述上拉控制单元于第一阶段接收一启动信号而使第n级GOA单元及第n+1级GOA单元的控制节点(Qn)拉高至第一高电位以及对所述自举电容充电；
所述自举电容于第二阶段将所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)维持在所述第一高电位；
所述上拉单元依据第一时钟信号、所述第n级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n级GOA单元的栅极信号端(Gn)，以及所述上拉单元依据第二时钟信号、所述第n+1级GOA单元的控制节点(Qn)的第一高电位输出栅极驱动信号至第n+1级GOA单元的栅极信号端(Gn+1)；
所述下拉单元于第三阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位拉低至一第一直流低电平、将所述第n级GOA单元的栅极信号端(Gn)的电位拉低至一第二直流低电平、及将所述第n+1级GOA单元的栅极信号端(Gn+1)的电位拉低至一第二直流低电平；
所述下拉维持单元于第四阶段将所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)维持于所述第一直流低电平，并将所述第n级GOA单元的栅极信号端(Gn)及所述第n+1级GOA单元的栅极信号端(Gn+1)的电位维持于所述第二直流低电平。
2.根据权利要求1所述的GOA器件，其特征在于，
所述上拉控制单元连接第n-6级GOA单元的级传信号端(STn-6)和所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)；
在所述第一阶段中，所述上拉控制单元自所述第n-6级GOA单元的级传信号端(STn-6)接收所述启动信号，以及根据所述第n-6级GOA单元的级传信号端(STn-6)接收所述启动信号使所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)处于所述第一高电位。
3.根据权利要求2所述的GOA器件，其特征在于，
所述上拉控制单元包括一第十一薄膜晶体管(T11)；
所述第十一薄膜晶体管(T11)的栅极及源极连接所述第n-6级GOA单元的级传信号输出端(STn-6)，所述第十一薄膜晶体管(T11)的漏极连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)。
4.根据权利要求1所述的GOA器件，其特征在于，
所述自举电容连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、所述下拉维持单元、及所述上拉单元；
所述自举电容的第一端连接所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)、所述上拉单元，所述自举电容的第二端连接所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)及所述下拉维持单元。
5.根据权利要求1所述的GOA器件，其特征在于，所述上拉单元包括第一上拉子单元和第二上拉子单元；
所述第一上拉子单元连接所述第n级GOA单元的控制节点(Qn)、第一时钟信号端(CKn)、第n级GOA单元的级传信号端(STn)、及所述第n级的栅极信号端(Gn)；
所述第二上拉子单元连接所述第n+1级GOA单元的控制节点(Qn)、第二时钟信号端(CKn+1)、第n+1级GOA单元的级传信号端(STn+1)、及所述第n+1级的栅极信号端(Gn+1)；
所述第一时钟信号端(CKn)用于提供所述第一时钟信号，所述第二时钟信号端(CKn+1)用于提供所述第二时钟信号；
所述第n级GOA单元及所述第n+1级GOA单元的控制节点(Qn)的电位用于控制所述上拉单元中的薄膜晶体管打开和关闭。
6.根据权利要求5所述的GOA器件，其特征在于，所述第一上拉子单元包括一第二十一薄膜晶体管(T21)和一第二十二薄膜晶体管(T22)；
所述第二十一薄膜晶体管(T21)的栅极连接所述第n级GOA单元的控制节点(Qn)，所述第二十一薄膜晶体管(T21)的源极连接所述第一时钟信号端(CK)，所述第二十一薄膜晶体管(T21)的漏极连接所述第n级的栅极信号端(Gn)；
所述第二十二薄膜晶体管(T22)的栅极连接所述第n级GOA单元的控制节点(Qn)，所述第二十二薄膜晶体管(T22)的源极连接所述第一时钟信号端(CK)，所述第二十二薄膜晶体管(T22)的漏极连接第n级GOA单元的级传信号端(STn)；
所述第二上拉子单元包括一第七十一薄膜晶体管(T71)和一第七十二薄膜晶体管(T72)；
所述第七十一薄膜晶体管(T71)的栅极连接所述第n+1级GOA单元的控制节点(Qn)，所述第七十一薄膜晶体管(T71)的源极连接所述第二时钟信号端(CK)，所述第七十一薄膜晶体管(T71)的漏极连接所述第n+1级的栅极信号端(Gn+1)；
所述第七十二薄膜晶体管(T72)的栅极连接所述第n+1级GOA单元的控制节点(Qn)，所述第七十二薄膜晶体管(T72)的源极连接所述第二时钟信号端(CK)，所述第七十二薄膜晶体管(T72)的漏极连接第n+1级GOA单元的级传信号端(STn+1)。
7.根据权利要求1所述的GOA器件，其特征在于，
所述下拉单元连接所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、第n+7级GOA单元的栅极信号端(Gn+7)、第n+8级GOA单元的栅极信号端(Gn+8)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)；
所述第一直流低电平端(VSSQ)提供所述第一直流低电平，所述第二直流低电平端(VSSG)提供所述第二直流低电平；
所述第三阶段开始于所述第n+7级GOA单元的栅极信号端(Gn+7)及所述第n+8级GOA单元的栅极信号端(Gn+8)处于高电位时。
8.根据权利要求7所述的GOA器件，其特征在于，所述下拉单元包括一第三十一薄膜晶体管(T31)、一第四十一薄膜晶体管(T41)、及一第七十薄膜晶体管(T70)；
所述第三十一薄膜晶体管(T31)的源极连接所述第n级GOA单元的栅极信号端(Gn)，所述第七十薄膜晶体管(T70)的源极连接所述第n+1级GOA单元的栅极信号端(Gn+1)，所述第四十一薄膜晶体管(T41)的源极连接所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)；
所述第三十一薄膜晶体管(T31)的漏极连接所述第二直流低电平端(VSSG)，所述第七十薄膜晶体管(T70)的漏极连接所述第二直流低电平端(VSSG)，所述第四十一薄膜晶体管(T41)的漏极连接所述第一直流低电平端(VSSQ)；
所述第三十一薄膜晶体管(T31)栅极连接所述第n+7级GOA单元的栅极信号端(Gn+7)，所述四十一薄膜晶体管(T41)的栅极连接所述第n+8级GOA单元的栅极信号端(Gn+8)，所述七十薄膜晶体管(T70)的栅极连接所述第n+8级GOA单元的栅极信号端(Gn+8)。
9.根据权利要求1所述的GOA器件，其特征在于，所述下拉维持单元包括第一下拉维持子单元及第二下拉维持子单元；
所述第一下拉维持子单元连接第一高压信号、所述第n级GOA单元及第n+1级GOA单元的控制节点(Qn)、所述第n级GOA单元的栅极信号端(Gn)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)；
所述第二下拉维持子单元连接第二高压信号、所述第n级GOA单元的控制节点(Qn)、所述第n+1级GOA单元的栅极信号端(Gn+1)、一第一直流低电平端(VSSQ)、以及一第二直流低电平端(VSSG)。
10.一种栅极驱动电路，其特征在于，所述栅极驱动电路包括权利要求1～9任一项所述的GOA器件。
CN202010403135.8A 2020-05-13 2020-05-13 Goa器件及栅极驱动电路 Pending CN111477190A (zh)

Priority Applications (3)

Application Number Priority Date Filing Date Title
CN202010403135.8A CN111477190A (zh) 2020-05-13 2020-05-13 Goa器件及栅极驱动电路
US17/042,964 US11763769B2 (en) 2020-05-13 2020-06-05 GOA device and gate driving circuit
PCT/CN2020/094713 WO2021227161A1 (zh) 2020-05-13 2020-06-05 Goa 器件及栅极驱动电路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN202010403135.8A CN111477190A (zh) 2020-05-13 2020-05-13 Goa器件及栅极驱动电路

Publications (1)

Publication Number Publication Date
CN111477190A true CN111477190A (zh) 2020-07-31

Family

ID=71757358

Family Applications (1)

Application Number Title Priority Date Filing Date
CN202010403135.8A Pending CN111477190A (zh) 2020-05-13 2020-05-13 Goa器件及栅极驱动电路

Country Status (3)

Country Link
US (1) US11763769B2 (zh)
CN (1) CN111477190A (zh)
WO (1) WO2021227161A1 (zh)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113658539A (zh) * 2021-08-23 2021-11-16 深圳市华星光电半导体显示技术有限公司 Goa电路
WO2022041370A1 (zh) * 2020-08-31 2022-03-03 武汉华星光电技术有限公司 栅极驱动电路及显示装置

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN107689221A (zh) * 2017-10-11 2018-02-13 深圳市华星光电半导体显示技术有限公司 Goa电路
US20190073978A1 (en) * 2017-09-04 2019-03-07 Shenzhen China Star Optoelectronics Semiconductor Display Technology Co., Ltd. Goa circuit for preventing clock signals from missing
CN109637423A (zh) * 2019-01-21 2019-04-16 深圳市华星光电半导体显示技术有限公司 Goa器件及栅极驱动电路

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI384756B (zh) * 2009-12-22 2013-02-01 Au Optronics Corp 移位暫存器
CN104505049B (zh) 2014-12-31 2017-04-19 深圳市华星光电技术有限公司 一种栅极驱动电路
CN107799087B (zh) 2017-11-24 2020-06-05 深圳市华星光电技术有限公司 一种goa电路及显示装置
CN108637423A (zh) * 2018-05-05 2018-10-12 芜湖君如保温材料有限公司 一种水箱人孔的切割工装
CN109410886A (zh) * 2018-12-27 2019-03-01 深圳市华星光电半导体显示技术有限公司 Goa电路
CN111028755B (zh) * 2019-12-06 2022-07-12 武汉华星光电半导体显示技术有限公司 一种单级goa电路及显示装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20190073978A1 (en) * 2017-09-04 2019-03-07 Shenzhen China Star Optoelectronics Semiconductor Display Technology Co., Ltd. Goa circuit for preventing clock signals from missing
CN107689221A (zh) * 2017-10-11 2018-02-13 深圳市华星光电半导体显示技术有限公司 Goa电路
CN109637423A (zh) * 2019-01-21 2019-04-16 深圳市华星光电半导体显示技术有限公司 Goa器件及栅极驱动电路

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2022041370A1 (zh) * 2020-08-31 2022-03-03 武汉华星光电技术有限公司 栅极驱动电路及显示装置
US11615726B2 (en) 2020-08-31 2023-03-28 Wuhan China Star Optoelectronics Technology Co., Ltd. Gate driving circuit and display device
CN113658539A (zh) * 2021-08-23 2021-11-16 深圳市华星光电半导体显示技术有限公司 Goa电路
CN113658539B (zh) * 2021-08-23 2023-10-31 深圳市华星光电半导体显示技术有限公司 Goa电路

Also Published As

Publication number Publication date
US11763769B2 (en) 2023-09-19
US20230119817A1 (en) 2023-04-20
WO2021227161A1 (zh) 2021-11-18

Similar Documents

Publication Publication Date Title
US10424390B2 (en) Pulse output circuit, shift register and display device
CN110827776B (zh) Goa器件及栅极驱动电路
CN110111743B (zh) Goa电路及显示面板
CN108320717B (zh) 一种goa驱动电路及其制备的液晶显示面板
CN211529585U (zh) 栅极驱动电路及显示面板
KR101943237B1 (ko) 산화물 반도체 박막 트랜지스터용 스캔 구동회로
CN108962178B (zh) Goa电路及液晶面板
CN108962171B (zh) Goa电路及具有该goa电路的液晶显示装置
CN109064982B (zh) Goa电路驱动系统及goa电路驱动方法与显示装置
WO2020151065A1 (zh) Goa器件及栅极驱动电路、显示面板
CN111402829A (zh) Goa电路、显示面板
CN107492362B (zh) 一种栅极驱动电路及液晶显示器
CN111477190A (zh) Goa器件及栅极驱动电路
CN111223452B (zh) Goa电路
CN111243547B (zh) Goa电路及显示面板
CN112185311B (zh) Goa驱动电路及显示面板
CN111445880B (zh) Goa器件及栅极驱动电路
CN111081196B (zh) Goa电路及显示面板
CN111312188A (zh) Goa电路及显示装置
CN114283727B (zh) 驱动电路
CN111402828A (zh) Goa电路和显示面板
CN114283726B (zh) 驱动电路
CN112071251B (zh) 栅极驱动电路和显示面板
CN114944123A (zh) Goa电路及阵列基板
CN113189806B (zh) Goa电路、液晶面板及其驱动方法、显示装置

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination