CN111435295A - 具非易失性存储器的随机码产生器 - Google Patents
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Abstract
本发明公开一种具非易失性存储器的随机码产生器,包括一差动存储器胞阵列、一电源供应电路、一第一选择电路,一电流判断电路。电源供应电路接收一注册信号与一反馈信号。第一选择电路接收一第一选择信号。当该注册信号动作并对该第一差动存储器胞进行一注册动作时,该电源供应电路供应一注册电压,经由该选择电路传递至该第一差动存储器胞的第一存储元件与第二存储元件,并产生该存储器胞电流。当该存储器胞电流大于一特定电流值时,电流判断电路动作该反馈信号,使得该电源供应电路停止供应该注册电压。
Description
技术领域
本发明涉及一种随机码产生器(random code generator),且特别涉及一种具非易失性存储器(non-volatile memory)的随机码产生器。
背景技术
物理不可复制技术(physically unclonable function,简称PUF技术)是一种创新的方式,经由提供一个不可复制码(unclonable code)来保护半导体芯片内部的数据,防止半导体芯片的内部数据被窃取或被复制。根据PUF技术,半导体芯片能够提供一随机码(random code)。此随机码可作为半导体芯片(semiconductor chip)上特有的身份码(IDcode),用来保护内部的数据。
一般来说,PUF技术是利用半导体芯片的制造变异(manufacturing variation)来获得独特的随机码。此制造变异包括半导体的工艺变异(process variation)。亦即,就算有精确的工艺步骤可以制作出半导体芯片,但是其随机码几乎不可能被复制(duplicate)。因此,具有PUF技术的半导体芯片通常被运用于高安全防护的应用(applications withhigh security requirements)。
美国专利US 9,613,714提出一种用于PUF技术的一次编程存储器胞与存储器胞阵列以及相关随机码产生方法。该专利利用半导体的制造变异所设计出的一次编程存储器胞(one time programmable memory cell)与存储器胞阵列,在编程动作进行后,即具有独特的随机码。
发明内容
本发明涉及一种随机码产生器,包括:一差动存储器胞阵列,包括多个差动存储器胞,其中这些差动存储器胞中的一第一差动存储器胞包括:一第一选择晶体管,具有一第一源/漏端连接至一第一源极线,一栅极端连接至一第一字线;一第一存储元件,连接在该第一选择晶体管的一第二源/漏端以及一第一控制线对的一第一子控制线之间;以及,一第二存储元件,连接在该第一选择晶体管的该第二源/漏端以及该第一控制线对的一第二子控制线之间;一电源供应电路接收一注册信号与一反馈信号;一第一选择电路,接收一第一选择信号,且连接至该电源供应电路的一输出端以及该第一差动存储器胞;以及一电流判断电路,检测该电源供应电路的该输出端上的一存储器胞电流;其中,当该注册信号动作并对该第一差动存储器胞进行一注册动作时,该电源供应电路供应一注册电压,经由该第一选择电路传递至该第一差动存储器胞的该第一存储元件与该第二存储元件,并产生该存储器胞电流;其中,当该存储器胞电流大于一特定电流值时,电流判断电路动作该反馈信号,使得该电源供应电路停止供应该注册电压。
为了对本发明的上述及其他方面有更佳的了解,下文特举优选实施例,并配合附图,作详细说明如下:
附图说明
图1为本发明随机码产生器的第一实施例;
图2A与图2B为本发明第一实施例随机码产生器在注册周期时的运作以及相关信号示意图;
图2C为第一实施例随机码产生器在读取周期时的运作示意图;
图3为本发明随机码产生器的第二实施例;
图4A与图4B为本发明第二实施例随机码产生器在注册周期时的运作以及相关信号示意图;
图4C为第二实施例随机码产生器在读取周期时的运作示意图;以及
图5为本发明运用于随机码产生器的注册电路详细电路图。
【符号说明】
110、120:差动存储器胞
112、114、122、124:存储元件
130、330、500:注册电路
132、152、332、520:选择电路
134:电流检测器
135、532:比较器
138、530:电流判断电路
139、510:电源供应电路
150:读取电路
154:电流比较器
512:电源供应器
514:运算放大器
具体实施方式
请参照图1,其所绘示为本发明随机码产生器的第一实施例。随机码产生器包括一差动存储器胞阵列(differential cell array)、注册电路(enroll circuit)130与读取电路(read circuit)150。
存储器胞阵列中包括多个差动存储器胞。为了简化说明,附图中仅绘示二个差动存储器胞110与120。
差动存储器胞110包括一选择晶体管Ms1与二存储器元件(storage element)112、114。选择晶体管Ms1的栅极连接至字线WL1,第一源/漏端连接至源极线(source line)SL1。再者,存储元件112的第一端连接至选择晶体管Ms1的第二源/漏端,存储元件112的第二端连接至第一控制线对(control line pair)中的子控制线La1。存储元件114的第一端连接至选择晶体管Ms的第二源/漏端,存储元件114的第二端连接至第一控制线对中的子控制线La2。
差动存储器胞120包括一选择晶体管Ms2与二存储器元件122、124。选择晶体管Ms2的栅极连接至字线WL1,第一源/漏端连接至源极线SL2。再者,存储元件122的第一端连接至选择晶体管Ms2的第二源/漏端,存储元件122的第二端连接至第二控制线对中的子控制线La3。存储元件124的第一端连接至选择晶体管Ms2的第二源/漏端,存储元件124的第二端连接至第二控制线对中的子控制线La4。
再者,注册电路130包括选择电路132、电源供应电路139、电流判断电路138。
电流判断电路138包括一电流检测器(current detector)134与一比较器135。电流检测器134可以检测选定差动存储器胞(selected differential cell)的存储器胞电流(cell current),并产生对应的检测电压Vs。比较器135接收检测电压Vs以及参考电压Vref并产生一反馈信号Sfb。
基本上,电流检测器134产生的检测电压Vs会正比于存储器胞电流。亦即,当存储器胞电流上升时,电流检测器134的检测电压Vs会上升。反之,当存储器胞电流下降时,电流检测器134的检测电压Vs会下降。因此,当检测电压Vs大于参考电压时,比较器135即动作反馈信号Sfb。换句话说,当存储器胞电流大于一特定电流值时,电流判断电路138可动作反馈信号Sfb。
选择电路132连接至电源供应电路139以及差动存储器胞阵列中的所有控制线对La1、La2、La3、La4。选择电路132根据选择信号Ss1来决定一选定控制线对,并将电源供应电路139提供的注册电压(enrolling voltage)Vp传递至选定控制线对。
电源供应电路139接收注册信号Enroll与反馈信号Sfb。在注册周期(enrollcycle)时,电源供应电路139提供注册电压Vp经由选择电路132传送至选定控制线对所连接的选定差动存储器胞。并且,当反馈信号Sfb动作时,电源供应电路139即停止供应注册电压Vp至选定差动存储器胞。
读取电路150包括选择电路152、电流比较器(current comparator)154。在读取周期(read cycle)时,选择电路152根据选择信号Ss2来将选定控制线对连接至电流比较器154。之后,电流比较器154根据选定控制线对上,选定差动存储器胞所产生的二个读取电流来产生输出数据Do,且输出数据即可作为一位(bit)的随机码。其中,选择电路132、152可为多工器(multiplexer)。
根据本发明的第一实施例,差动存储器胞110、120中的存储元件112、114、122、124可为电阻性存储元件(resistive storage element)或者是浮动栅晶体管(floating gatetransistor)。举例来说,电阻性存储元件可为磁式存储器元件(MRAM)、相变式存储器元件(PCRAM)或者电阻式存储器元件(ReRAM)。
一般来说,当电阻性存储元件接收到高电压的前后,其为高电阻状态。当电阻性存储元件接收到高电压后,电阻性元件会转变为低电阻状态。以下以电阻性存储元件R112、R114为例来介绍本发明随机码产生器的运作原理。
请参照图2A与图2B,其所绘示为本发明第一实施例随机码产生器在注册周期(enroll cycle)时的运作以及相关信号示意图。
假设随机码产生器欲对差动存储器胞110进行注册动作(enrollment)时,则选择信号Ss1会决定控制线对La1、La2为选定控制线对,使得选择电路132将电源供应电路139连接至控制线对La1、La2。另外,当字线WL1动作时,选择晶体管Ms1开启,使得差动存储器胞110为选定差动存储器胞,而注册电路130即可对选定差动存储器胞进行注册动作。
如图2B所示,时间点ta至时间点td之间为注册周期Tenroll。此时,注册信号Enroll为高电平。举例来说,注册周期为1μs。
在时间点ta时,注册信号Enroll动作,代表注册周期开始。电源供应电路139提供注册电压Vp经由选择电路132传送至选定控制线对La1、La2。由于选择晶体管Ms1开启且源极线SL1连接至接地端,使得电阻性存储元件R112、R114同时接收到注册电压Vp。由于电阻性存储元件R112、R114皆为高电阻状态,所以电阻性存储元件R112、R114产生的电流I112、I114皆很小。再者,二个电流I112、I114的总和即为差动存储器胞110所产生的存储器胞电流Icell,亦即Icell=I112+I114。
由于半导体的制造变异,所以二个电阻性存储元件R112、R114之间存在所微小差异,使得二个电阻性存储元件R112、R114开始转变存储状态的时间点会不同。
假设在时间点tb时,电阻性存储元件R112开始转变存储状态,所以电阻性存储元件R112的电阻值开始降低,电流I112逐渐上升。同时,由于电阻性存储元件R114尚未转变存储状态,所以电阻性存储元件R114的电阻值很高,电流I114很小。此时,存储器胞电流Icell逐渐上升。
由于电流检测器134产生的检测电压Vs会正比于存储器胞电流Icell。在时间点tc时,电阻性存储元件R112已转变为低电阻状态。电流检测器134根据存储器胞电流Icell所产生的检测电压Vs已经大于参考电压Vref,所以比较器135动作反馈信号Sfb,并使得电源供应电路139停止供应注册电压Vp。
当电源供应电路139停止供应注册电压Vp时,选定差动存储器胞110不再产生存储器胞电流Icell。此时,选定差动存储器胞110完成注册动作。
由于半导体的制造变异,所以随机码产生器在注册动作时,将无法预测选定差动存储器胞的二个电阻性存储元件R112、R114中,哪一个电阻性存储元件会先改变存储状态。因此,本发明的随机码产生器即为运用PUF技术来产生随机码。
请参照图2C,其所绘示为第一实施例随机码产生器在读取周期(read cycle)时的运作示意图。假设随机码产生器欲对差动存储器胞110进行读取动作时,则选择信号Ss2会决定控制线对La1、La2为选定控制线对,并使得选择电路152将控制线对La1、La2连接至电流比较器154的二个输入端。另外,当字线WL1动作时,选择晶体管Ms1开启,使得差动存储器胞110为选定差动存储器胞,而读取电路150即可对选定差动存储器胞进行读取动作。
如图2C所示,在进行读取动作时,源极线SL1接收读取电压Vread,例如0.5V。使得电阻性存储元件R112、R114产生各别的读取电流Ir112、Ir114。由于注册动作后,选定差动存储器胞110中的电阻性存储元件R112为低电阻状态,电阻性元件R114为高电阻状态,所以读取电流Ir112大于读取电流Ir114。所以电流比较器154根据选定控制线对La1、La2上的二个电流Ir112、Ir114来产生输出数据Do。例如输出数据Do为逻辑"1",且输出数据Do产生的逻辑"1"即可作为一位(bit)的随机码。
当然,如果进行注册动作后,选定差动存储器胞110中的电阻性存储元件R112为高电阻状态,电阻性元件R114为低电阻状态时,则电流比较器154在读取动作时会产生逻辑"0"的输出数据Do来作为一位的随机码。
利用相同的方式,随机码产生器也可以对差动存储器胞阵列中的多个差动存储器胞进行注册动作。之后,对多个差动存储器胞进行读取动作以获得多位的随机码。例如,随机码产生器对8个差动存储器胞进行注册动作。之后,对8个差动存储器胞进行读取动作以获得一个字节(byte)的随机码。
请参照图3,其所绘示为本发明随机码产生器的第二实施例。相较于第一实施例,其差异仅在于注册电路330中选择电路332的连接关系。以下仅介绍选择电路332的连接关系,其他部分不再赘述。
注册电路330的选择电路332连接至电源供应电路139以及差动存储器胞阵列中的所有源极线SL1、SL2。选择电路332根据选择信号Ss1来决定一选定源极线,并将电源供应电路139提供的注册电压Vp传递至选定源极线。
根据本发明的第二实施例,差动存储器胞110、120中的存储元件112、114、122、124可为电阻性存储元件或者是浮动栅晶体管。举例来说,电阻性存储元件可为磁式存储器元件(MRAM)、相变式存储器元件(PCRAM)或者电阻式存储器元件(ReRAM)。
一般来说,当浮动栅晶体管(floating gate transistor)制造完成后,其浮动栅极中尚未存储热载子(hot carrier),例如电子,浮动栅晶体管关闭(turn off),且具备高电阻状态。当浮动栅晶体管的浮动栅极注入热载子时,例如电子,浮动栅晶体管开启(turnon),且具备低电阻状态。以下以P型浮动栅晶体管Mp122、Mp124为例来介绍本发明随机码产生器的运作原理。
请参照图4A与图4B,其所绘示为本发明第二实施例随机码产生器在注册周期(enroll cycle)时的运作以及相关信号示意图。
假设随机码产生器欲对差动存储器胞120进行注册动作(enrollment)时,则选择信号Ss1会决定源极线SL2为选定源极线,使得选择电路332将电源供应电路139连接至源极线SL2。另外,当字线WL1动作时,选择晶体管Ms2开启,使得差动存储器胞120为选定差动存储器胞,而注册电路330即可对选定差动存储器胞进行注册动作。
如图4B所示,时间点t1至时间点t4之间即为注册周期Tenroll。此时,注册信号Enroll为高电平。举例来说,注册周期为110μs。
在时间点t1时,注册周期开始。此时,注册信号Enroll动作,电源供应电路139提供注册电压Vp经由选择电路332传送至选定源极线SL2。由于选择晶体管Ms2开启且控制线对La3、La4连接至接地端,使得P型浮动栅晶体管Mp122、Mp124同时接收到注册电压Vp。由于P型浮动栅晶体管Mp122、Mp124皆为高电阻状态,所以P型浮动栅晶体管Mp122、Mp124产生的电流I122、I124皆很小。再者,二个电流I122、I124的总和即为差动存储器胞120所产生的存储器胞电流Icell,亦即Icell=I122+I124。
由于半导体的制造变异,所以二个P型浮动栅晶体管Mp122、Mp124之间存在所微小差异,使得二个P型浮动栅晶体管Mp122、Mp124开始转变存储状态的时间点会不同。
假设在时间点t2时,P型浮动栅晶体管Mp124开始转变存储状态,所以电子会由P型浮动栅晶体管Mp124的沟道区域(channel region)注入浮动栅极,此时P型浮动栅晶体管Mp124的电阻值开始降低,电流I124逐渐上升。同时,由于P型浮动栅晶体管Mp122的浮动栅极尚未注入电子,所以P型浮动栅晶体管Mp122的电阻值很高,电流I122很小。此时,存储器胞电流Icell逐渐上升。
在时间点t3时,P型浮动栅晶体管Mp124的浮动栅极已经注入相当多的电子,使得P型浮动栅晶体管Mp124开启(turn on),并具备低电阻状态。电流检测器134根据存储器胞电流Icell所产生的检测电压Vs已经大于参考电压Vref,所以比较器135动作反馈信号Sfb,并使得电源供应电路139停止供应注册电压Vp。
当电源供应电路139停止供应注册电压Vp时,选定差动存储器胞120不再产生存储器胞电流Icell。此时,选定差动存储器胞120完成注册动作。
由于半导体的制造变异,所以随机码产生器在注册动作时,将无法预测选定差动存储器胞的二个P型浮动栅晶体管Mp122、Mp124中,哪一个P型浮动栅晶体管会先改变存储状态。因此,本发明的随机码产生器即为运用PUF技术来产生随机码。
请参照图4C,其所绘示为第二实施例随机码产生器在读取周期时的运作示意图。假设随机码产生器欲对差动存储器胞120进行读取动作时,则选择信号Ss2会决定源极线La3、La4为选定控制线对,并使得选择电路152将控制线对La3、La4连接至电流比较器154的二个输入端。另外,当字线WL1动作时,选择晶体管Ms2开启,使得差动存储器胞120为选定差动存储器胞,而读取电路150即可对选定差动存储器胞进行读取动作。
如图4C所示,在进行读取动作时时,源极线SL2接收读取电压Vread,例如1.0V。使得电阻性P型浮动栅晶体管Mp124、Mp124产生各别的读取电流Ir122、Ir124。由于注册动作后,选定差动存储器胞120中的P型浮动栅晶体管Mp124为低电阻状态,P型浮动栅晶体管Mp122为高电阻状态,所以读取电流Ir124大于读取电流Ir122。所以电流比较器154根据选定控制线对La1、La2上的二个电流Ir122、Ir124来产生输出数据Do。例如输出数据Do为逻辑"0",且输出数据Do产生的逻辑"0"即可作为一位(bit)的随机码。
当然,如果进行注册动作后,选定差动存储器胞120中的P型浮动栅晶体管Mp124为高电阻状态,P型浮动栅晶体管Mp122为低电阻状态时,则电流比较器154在读取动作时会产生逻辑"1"的输出数据Do来作为一位的随机码。
请参照图5,其所绘示为本发明运用于随机码产生器的注册电路详细电路图。注册电路500包括选择电路520、电源供应电路510、电流判断电路530。
电源供应电路510包括一电源供应器(power supply)512、运算放大器(OP)514、晶体管M1、M2。电源供应器512包括一电压输出端、一致能端EN与一反馈端。电源供应器512的电压输出端连接至运算放大器514的正输入端。电源供应器512的致能端EN接收注册信号Enroll。电源供应器512的反馈端接收反馈信号Sfb。其中,当注册信号Enroll为高电平,电源供应器512被致能,并产生注册电压Vp至运算放大器514的正输入端。另外,当反馈信号Sfb动作时,电源供应器512停止供应注册电压Vp。举例来说,当反馈信号Sfb动作时,电源供应器512的电压输出端提供接地电压(0V)至运算放大器514的正输入端。
再者,晶体管M1的源极端接收电源电压Vd,栅极端与漏极端相互连接。晶体管M2的漏极端连接至晶体管M1的漏极端,栅极端连接至运算放大器514的输出端,晶体管M2的源极端连接至运算放大器514的负输入端。另外,晶体管M2的源极端作为电源供应电路510的输出端,连接至选择电路520。
电流判断电路530包括晶体管M3、比较器532、电阻R。晶体管M3栅极端连接至电源供应电路510中晶体管M1的栅极端,源极端接收电源电压Vd,漏极端连接至节点a。再者,节点a与接地端之间连接电阻R。另外,比较器532的正输入端连接至节点a,比较器532的负输入端接收参考电压Vref,比较器532的输出端产生反馈信号Sfb。
另外,选择电路520为多工器。当选择电路520运用于第一实施例时,选择电路520根据选择信号Ss1将电源供应电路510的注册电压Vp传递至选定控制线对。当选择电路520运用于第二实施例时,选择电路520根据选择信号Ss1将电源供应电路510的注册电压Vp传递至选定源极线。
在注册动作时,注册信号为高电平,电源供应器512输出注册电压Vp。再者,反馈信号Sfb为低电平,代表反馈信号Sfb尚未动作。此时,所以运算放大器(OP)514的正输入端接收注册电压Vp,并使得电源供应电路510的输出端产生注册电压Vp。另外,当选择电路520连接至选定差动存储器胞时,电源供应电路510的输出端会产生存储器胞电流Icell。
再者,由于晶体管M1、M3连接成电流镜(current mirror),所以晶体管M3会产生镜射电流Icell'流经电阻R。当存储器胞电流Icell上升时,镜射电流Icell'也会上升,使得节点a的检测电压Vs上升。当节点a的检测电压Vs到达参考电压vref时,比较器532动作反馈信号Sfb。此时,电源供应电路510即停止供应注册电压Vp,并完成注册动作。
由以上的说明可知,本发明提出一种随机码产生器。在进行注册动作时,在差动存储器胞中利用二个存储元件的微小差异来产生无法预测(unpredictable)的存储状态。因此,在读取动作时,即确认此对差动存储器胞的存储状态并作为一位的随机码。
综上所述,虽然本发明已以优选实施例公开如上,然其并非用以限定本发明。本发明所属领域技术人员在不脱离本发明的精神和范围内,当可作各种的更动与润饰。因此,本发明的保护范围当视所附权利要求书界定范围为准。
Claims (10)
1.一种随机码产生器,包括:
差动存储器胞阵列,包括多个差动存储器胞,其中这些差动存储器胞中的第一差动存储器胞包括:第一选择晶体管,具有第一源/漏端连接至第一源极线,栅极端连接至第一字线;第一存储元件,连接在该第一选择晶体管的第二源/漏端以及第一控制线对的第一子控制线之间;以及,第二存储元件,连接在该第一选择晶体管的该第二源/漏端以及该第一控制线对的第二子控制线之间;
电源供应电路接收注册信号与反馈信号;
第一选择电路,接收第一选择信号,且连接至该电源供应电路的输出端以及该第一差动存储器胞;以及
电流判断电路,检测该电源供应电路的该输出端上的存储器胞电流;
其中,当该注册信号动作并对该第一差动存储器胞进行注册动作时,该电源供应电路供应注册电压,经由该第一选择电路传递至该第一差动存储器胞的该第一存储元件与该第二存储元件,并产生该存储器胞电流;
其中,当该存储器胞电流大于特定电流值时,电流判断电路动作该反馈信号,使得该电源供应电路停止供应该注册电压。
2.如权利要求1所述的随机码产生器,还包括读取电路,连接至该第一控制线对的该第一子控制线与该第二子控制线;
其中,在读取周期对该第一差动存储器胞进行读取动作时,提供读取电压至该第一存储元件与该第二存储元件,并分别产生第一读取电流与第二读取电流经由该第一子控制线与该第二子控制线传递至该读取电路;
其中,该读取电路根据该第一读取电流与该第二读取电流来产生输出数据,并作为随机码的一位。
3.如权利要求2所述的随机码产生器,该读取电路包括:
电流比较器,具有第一电流输入端与第二电流输入端,以及输出端;以及
第二选择电路,连接至该第一子控制线、该第二子控制线、该第一电流输入端与该第二电流输入端;
其中,在该读取周期对该第一差动存储器胞进行该读取动作时,提供该读取电压至该第一源极线,且该电流比较器根据第二选择信号将该第一子控制线连接至该第一电流输入端,并将该第二子控制线连接至该第二电流输入端,使得该电流比较器根据该第一读取电流与该第二读取电流来产生该输出数据,并作为该随机码的一个位。
4.如权利要求2所述的随机码产生器,其中该第一选择电路连接至该第一控制线对,当该注册信号动作并对该第一差动存储器胞进行该注册动作时,将该第一源极线连接至接地端,该第一选择电路根据该第一选择信号将该电源供应电路的该输出端连接至该第一控制线对,使得该第一差动存储器胞产生该存储器胞电流。
5.如权利要求2所述的随机码产生器,其中该第一选择电路连接至该第一源极线,当该注册信号动作并对该第一差动存储器胞进行该注册动作时,将该第一控制线对连接至接地端,该第一选择电路根据该第一选择信号将该电源供应电路的该输出端连接至该第一源极线,使得该第一差动存储器胞产生该存储器胞电流。
6.如权利要求1所述的随机码产生器,其中该电源供应电路包括:
电源供应器,具有致能端接收该注册信号以及反馈端接收反馈信号,其中在该注册信号动作时,该电源供应器的电压输出端供应该注册电压,且在该反馈信号动作时,该电源供应器的该电压输出端停止供应该注册电压;
运算放大器,具有正输入端连接至该电源供应器的该电压输出端;
第一晶体管,具有源极端接收电源电压;以及
第二晶体管,具有漏极端连接至该第一晶体管的栅极端与漏极端,栅极端连接至该运算放大器的输出端,源极端连接至该运算放大器的负输入端;
其中,该第二晶体管的该源极端连接至该第一选择电路。
7.如权利要求6所述的随机码产生器,其中该电流判断电路包括:
第三晶体管,具有源极端接收该电源电压,栅极端连接至该第一晶体管的该栅极端;
电阻,连接在该第三晶体管的漏极端与接地端之间;以及
比较器,具有第一输入端连接至该第三晶体管的该漏极端,第二输入端接收参考电压,以及输出端产生该反馈信号。
8.如权利要求1所述的随机码产生器,其中该第一存储元件为第一电阻性存储元件,且该第二存储元件为第二电阻性存储元件。
9.如权利要求8所述的随机码产生器,其中该第一电阻性存储元件与该第二电阻性存储元件为磁式存储器元件、相变式存储器元件或者电阻式存储器元件。
10.如权利要求1所述的随机码产生器,其中该第一存储元件为第一P型浮动栅晶体管,且该第二存储元件为第二P型浮动栅晶体管。
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201962791870P | 2019-01-13 | 2019-01-13 | |
US62/791,870 | 2019-01-13 | ||
US16/661,012 | 2019-10-23 | ||
US16/661,012 US11416416B2 (en) | 2019-01-13 | 2019-10-23 | Random code generator with non-volatile memory |
Publications (2)
Publication Number | Publication Date |
---|---|
CN111435295A true CN111435295A (zh) | 2020-07-21 |
CN111435295B CN111435295B (zh) | 2022-06-07 |
Family
ID=71517608
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201911127813.6A Active CN111435295B (zh) | 2019-01-13 | 2019-11-18 | 具非易失性存储器的随机码产生器 |
CN202010018464.0A Active CN111435603B (zh) | 2019-01-13 | 2020-01-08 | 储存单元 |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN202010018464.0A Active CN111435603B (zh) | 2019-01-13 | 2020-01-08 | 储存单元 |
Country Status (4)
Country | Link |
---|---|
US (2) | US11416416B2 (zh) |
JP (1) | JP6855668B2 (zh) |
CN (2) | CN111435295B (zh) |
TW (3) | TWI713312B (zh) |
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- 2019-11-07 TW TW108140521A patent/TWI713312B/zh active
- 2019-11-07 TW TW108140518A patent/TWI722645B/zh active
- 2019-11-18 CN CN201911127813.6A patent/CN111435295B/zh active Active
- 2019-12-05 US US16/703,892 patent/US11055235B2/en active Active
- 2019-12-05 JP JP2019220574A patent/JP6855668B2/ja active Active
-
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- 2020-01-08 TW TW109100542A patent/TWI729666B/zh active
- 2020-01-08 CN CN202010018464.0A patent/CN111435603B/zh active Active
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Publication number | Publication date |
---|---|
JP6855668B2 (ja) | 2021-04-07 |
US20200227121A1 (en) | 2020-07-16 |
TWI713312B (zh) | 2020-12-11 |
TW202044249A (zh) | 2020-12-01 |
CN111435295B (zh) | 2022-06-07 |
TW202025969A (zh) | 2020-07-16 |
TWI729666B (zh) | 2021-06-01 |
US20200226073A1 (en) | 2020-07-16 |
CN111435603A (zh) | 2020-07-21 |
CN111435603B (zh) | 2022-04-05 |
US11055235B2 (en) | 2021-07-06 |
TWI722645B (zh) | 2021-03-21 |
TW202027430A (zh) | 2020-07-16 |
JP2020113263A (ja) | 2020-07-27 |
US11416416B2 (en) | 2022-08-16 |
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Legal Events
Date | Code | Title | Description |
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PB01 | Publication | ||
PB01 | Publication | ||
SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
GR01 | Patent grant | ||
GR01 | Patent grant |