CN109686292B - 栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置 - Google Patents

栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置 Download PDF

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Abstract

本发明提供一种栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置。栅极驱动单元包括输入端、锁存节点控制电路、第一节点电位维持电路和锁存节点复位电路，锁存节点控制电路在输入端提供的输入信号的控制下，通过所述锁存充电端输入的充电电压，控制所述锁存节点的电压；第一节点电位维持电路在锁存节点的电压的控制下，控制第一节点与锁存使能端之间连通，维持第一节点的电位；锁存节点复位电路在锁存节点复位端输入的锁存节点复位信号的控制下，控制对锁存节点的电位进行复位。本发明在锁存时间段能够维持第一节点的电位，在锁存时间段之后的显示时间段能够实现正常显示。

Description

栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置
技术领域
本发明涉及显示驱动技术领域，尤其涉及一种栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置。
背景技术
在In-Cell(内嵌式)触控显示领域，会根据触控分配方式对公共电极进行分时复用，即GOA(Gate On Array，设置于阵列基板上的栅极驱动电路)包括的若干级栅极驱动单元逐级开启后中断并进入锁存时间段，在所述锁存时间段开启触控扫描，所述公共电极复用为触控电极，触控扫描若干行后再进入下一显示时间段，在一帧画面显示时间内循环多次。但是，在这一过程中GOA的第一节点的电位自保持能力弱是一个很严重的问题，因为TFT(薄膜晶体管)的漏电流的存在，尤其是在温度较高的环境下，TFT的漏电流会大大降低GOA的第一节点的电位自保持能力，导致在锁存时间段，GOA包括的断点位置的栅极驱动单元的第一节点的电位不能保持为有效电压，从而会导致锁存时间段结束后，进入下一显示时间段时，GOA不能正常输出栅极驱动信号，在断点位置出现显示异常。
发明内容
本发明的主要目的在于提供一种栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置，解决现有的栅极驱动电路在两相邻显示时间段之间的锁存时间段，断点位置的栅极驱动单元中的第一节点的电位不能维持为有效电压，从而会出现显示异常的问题。
为了达到上述目的，本发明提供了一种栅极驱动单元，包括输入端、锁存节点控制电路、第一节点电位维持电路和锁存节点复位电路，其中，
所述锁存节点控制电路分别与所述锁存节点、所述输入端和锁存充电端连接，用于在输入端提供的输入信号的控制下，通过所述锁存充电端输入的充电电压，控制所述锁存节点的电压；
所述第一节点电位维持电路分别与所述锁存节点、第一节点和锁存使能端连接，用于在所述锁存节点的电压的控制下，控制所述第一节点与所述锁存使能端之间连通，维持所述第一节点的电位；
所述锁存节点复位电路分别与锁存节点复位端和所述锁存节点连接，用于在所述锁存节点复位端输入的锁存节点复位信号的控制下，控制对所述锁存节点的电位进行复位。
实施时，所述锁存节点控制电路包括充电控制电路和锁存储能电路；
所述锁存储能电路的第一端与所述锁存节点连接，所述锁存储能电路的第二端与第一电压端连接；
所述充电控制电路分别与所述输入端、所述锁存充电端和所述锁存节点连接，用于在所述输入信号的控制下，控制所述锁存充电端与所述锁存节点连通，以通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压。
实施时，所述锁存储能电路包括锁存电容；所述充电控制电路包括充电控制晶体管；
所述锁存电容的第一端与所述锁存节点连接，所述锁存电容的第二端与所述第一电压端连接；
所述充电控制晶体管的控制极与所述输入端连接，所述充电控制晶体管的第一极与所述锁存充电端连接，所述充电控制晶体管的第二极与所述锁存节点连接。
实施时，所述第一节点电位维持电路包括电位维持晶体管；
所述电位维持晶体管的控制极与所述锁存节点连接，所述电位维持晶体管的第一极与所述锁存使能端连接，所述电位维持晶体管的第二极与所述第一节点连接。
实施时，所述锁存节点复位电路包括锁存节点复位晶体管；
所述锁存节点复位晶体管的控制极与所述锁存节点复位端连接，所述锁存节点复位晶体管的第一极与所述锁存节点连接，所述锁存节点复位晶体管的第二极与复位电压端连接。
实施时，所述锁存充电端与所述锁存使能端为同一端子。
实施时，本发明所述的栅极驱动单元还包括栅极驱动信号输出端、储能电路、输出电路、触控复位电路和第一节点复位电路；
所述储能电路的第一端与所述第一节点连接，所述储能电路的第二端与栅极驱动信号输出端连接，所述储能电路用于控制所述第一节点的电位；
所述输出电路分别与所述第一节点、所述栅极驱动信号输出端和第一时钟信号端连接，用于在所述第一节点的电压的控制下，控制所述栅极驱动信号输出端与所述第一时钟信号端之间连通；
所述触控复位电路分别与触控复位端、所述栅极驱动信号输出端和复位电压端连接，用于在所述触控复位端输入的触控复位信号的控制下，控制所述栅极驱动信号输出端与所述复位电压端之间连通；
所述第一节点复位电路分别与空白区复位端、所述第一节点和所述复位电压端连接，用于在所述空白区复位端输入的空白区复位信号的控制下，控制所述第一节点与所述复位电压端之间连通。
实施时，所述储能电路包括存储电容，所述输出电路包括输出晶体管，所述触控复位电路包括触控复位晶体管，所述第一节点复位电路包括第一节点复位晶体管；
所述存储电容的第一端与所述第一节点连接，所述存储电容的第二端与所述栅极驱动信号输出端连接；
所述输出晶体管的控制极与所述第一节点连接，所述输出晶体管的第一极与所述第一时钟信号端连接，所述输出晶体管的第二极与所述栅极驱动信号输出端连接；
所述触控复位晶体管的控制极与触控复位端连接，所述触控复位晶体管的第一极与所述栅极驱动信号输出端连接，所述触控复位晶体管的第二极与所述复位电压端连接；
所述第一节点复位晶体管的控制极与空白区复位端连接，所述第一节点复位晶体管的第一极与所述第一节点连接，所述第一节点复位晶体管的第二极与所述复位电压端连接。
实施时，本发明所述的栅极驱动单元还包括第一节点控制电路、第二节点控制电路和输出复位电路，其中，
所述第一节点控制电路分别与所述第一节点、所述输入端、复位端、第一扫描电压端、第二扫描电压端、第二节点和第二电压端连接，用于在所述输入信号的控制下，控制所述第一节点与所述第一扫描电压端之间连通，在所述复位端输入的复位信号的控制下，控制所述第一节点与所述第二扫描电压端之间连通，在所述第二节点的电压的控制下，控制所述第一节点与所述第二电压端之间连通；
所述第二节点控制电路分别与所述第一节点、所述第二节点、第二时钟信号端、栅极驱动信号输出端和所述第二电压端连接，用于在所述第二时钟信号端输入的第二时钟信号、所述第一节点的电压和所述栅极驱动信号输出端输出的栅极驱动信号的控制下，控制所述第二节点的电位；
所述输出复位电路分别与所述第二节点、所述栅极驱动信号输出端和所述第二电压端连接，用于在所述第二节点的电压的控制下，控制所述栅极驱动信号输出端与所述第二电压端之间连通。
本发明还提供了一种栅极驱动方法，应用于上述的栅极驱动单元，在两相邻显示时间段之间设置有锁存时间段，所述栅极驱动方法包括：
在锁存时间段，锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平；第一节点电位维持电路在所述锁存节点的电压的控制下，控制第一节点与锁存使能端之间连通，维持所述第一节点的电位为有效电压；
在所述显示时间段，锁存节点复位电路在锁存节点复位端输入的锁存节点复位信号的控制下，控制对所述锁存节点的电位进行复位，以控制所述第一节点电位维持电路断开所述第一节点与所述锁存使能端之间的连接。
实施时，所述锁存节点控制电路包括充电控制电路和锁存储能电路，所述锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平步骤包括：
所述充电控制电路在所述输入信号的控制下，控制所述锁存充电端与所述锁存节点连通，以通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压为有效电平。
实施时，所述栅极驱动单元包括栅极驱动信号输出端和输出电路，所述栅极驱动方法还包括：
在所述锁存时间段，所述输出电路在所述第一节点的控制下，控制所述栅极驱动信号输出端与第一时钟信号端之间连通，以使得所述栅极驱动信号输出端输出无效电平。
本发明还提供了一种栅极驱动电路，包括A级上述的栅极驱动单元；A为大于1的整数；
第a级栅极驱动单元的输入端与第a-1级栅极驱动单元的栅极驱动信号输出端连接；a为小于或等于A而大于1的整数；
第一级栅极驱动单元的输入端与起始电压端连接。
本发明还提供了一种显示装置，包括上述的栅极驱动电路。
与现有技术相比，本发明所述的栅极驱动单元、栅极驱动方法、栅极驱动电路和显示装置在两相邻显示时间段之间设置的锁存时间段，锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平；第一节点电位维持电路在所述锁存节点的电压的控制下，控制第一节点与锁存使能端之间连通，维持所述第一节点的电位为有效电压，以使得在锁存时间段，第一节点的电位能够维持为有效电压，以在锁存时间段之后的显示时间段能够实现正常显示；并在显示时间段，锁存节点复位电路控制对所述锁存节点的电位进行复位，以控制所述第一节点电位维持电路断开所述第一节点与所述锁存使能端之间的连接，以不影响正常显示。
附图说明
图1是本发明实施例所述的栅极驱动单元的结构图；
图2是本发明另一实施例所述的栅极驱动单元的结构图；
图3是本发明又一实施例所述的栅极驱动单元的电路图；
图4是本发明再一实施例所述的栅极驱动单元的结构图；
图5是本发明另一实施例所述的栅极驱动单元的结构图；
图6是本发明所述的栅极驱动单元的一具体实施例的电路图；
图7本发明所述的栅极驱动单元的该具体实施例的工作时序图；
图8本发明所述的栅极驱动电路的一具体实施例的结构图；
图9是本发明所述的栅极驱动电路的该具体实施例中的第N-1级栅极驱动单元、第N级栅极驱动单元和第N+1级栅极驱动单元的电路图；
图10是本发明所述的栅极驱动电路的该具体实施例的工作时序图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明所有实施例中采用的晶体管均可以为三极管、薄膜晶体管或场效应管或其他特性相同的器件。在本发明实施例中，为区分晶体管除控制极之外的两极，将其中一极称为第一极，另一极称为第二极。
在实际操作时，当所述晶体管为三极管时，所述控制极可以为基极，所述第一极可以为集电极，所述第二极可以发射极；或者，所述控制极可以为基极，所述第一极可以为发射极，所述第二极可以集电极。
在实际操作时，当所述晶体管为薄膜晶体管或场效应管时，所述控制极可以为栅极，所述第一极可以为漏极，所述第二极可以为源极；或者，所述控制极可以为栅极，所述第一极可以为源极，所述第二极可以为漏极。
如图1所示，本发明实施例所述的栅极驱动单元包括输入端INPUT、锁存节点控制电路11、第一节点电位维持电路12和锁存节点复位电路13，其中，
所述锁存节点控制电路11分别与所述锁存节点HN、所述输入端INPUT和锁存充电端HOLD_CHR连接，用于在输入端INPUT提供的输入信号的控制下，通过所述锁存充电端HOLD_CHR输入的充电电压，控制所述锁存节点HN的电压；
所述第一节点电位维持电路12分别与所述锁存节点HN、第一节点PU和锁存使能端HOLD_EN连接，用于在所述锁存节点HN的电压的控制下，控制所述第一节点PU与所述锁存使能端HOLD_EN之间连通，维持所述第一节点PU的电位；
所述锁存节点复位电路13分别与锁存节点复位端HOLD_RST和所述锁存节点HN连接，用于在所述锁存节点复位端HOLD_RST输入的锁存节点复位信号的控制下，控制对所述锁存节点HN的电位进行复位。
本发明实施例所述的栅极驱动单元在两相邻显示时间段之间设置的锁存时间段，锁存节点控制电路11在输入端INPUT提供的输入信号的控制下，通过锁存充电端HOLD_CHR输入的充电电压，控制所述锁存节点HN的电压为有效电平；第一节点电位维持电路12在所述锁存节点HN的电压的控制下，控制第一节点PU与锁存使能端HOLD_EN之间连通，维持所述第一节点PU的电位为有效电压，以使得在锁存时间段，第一节点PU的电位能够维持为有效电压，以在锁存时间段之后的显示时间段能够实现正常显示；并在显示时间段，锁存节点复位电路13控制对所述锁存节点HN的电位进行复位，以控制所述第一节点电位维持电路12断开所述第一节点PU与所述锁存使能端HOLD_EN之间的连接，以不影响正常显示。
在具体实施时，一帧画面显示时间可以包括至少两个显示时间段，相邻两个显示时间段之间可以设置有锁存时间段。
在实际操作时，在所述锁存时间段可以进行触控、指纹识别等操作，所述锁存时间段为GOA(Gate On Array，设置于阵列基板上的栅极驱动电路)中断时间段。
在具体实施时，当所述时栅极驱动单元中的第一节点电位维持电路12包括的电位维持晶体管为n型晶体管时，所述有效电平可以为高电平，但不以此为限；当该电位维持晶体管为p型晶体管时，所述有效电平可以为低电平，但不以此为限。
在具体实施时，当所述栅极驱动单元包括的栅极与所述第一节点PU连接的输出晶体管为n型晶体管时，所述有效电压可以为高电压，无效电压可以为低电压，但不以此为限；当该输出晶体管为p型晶体管时，所述有效电压可以为低电压，无效电压可以为高电压，但不以此为限。
本发明实施例所述的栅极驱动单元具有第一节点电位锁存功能，能够实现在逐级驱动的GOA单元级联结构中的任意位置插入断点，对处于断点位置的GOA单元进行第一节点电位锁存，保证该处于断点位置的GOA单元中的第一节点的电位被锁存，从而维持为有效电压，保证该GOA单元在长时间中断结束后，仍可正常进行显示驱动，使得级联的GOA单元继续正常逐级驱动。
本发明实施例可以为In-Cell(内嵌式)触控显示产品中的公共电极提供十分稳定的分时复用解决方案，也即在GOA单元逐级驱动时间段，公共电极用于显示，而在锁存时间段(也即GOA中断时间段)，所述公共电极用于触控、指纹识别等。
具体的，所述锁存节点控制电路可以包括充电控制电路和锁存储能电路；
所述锁存储能电路的第一端与所述锁存节点连接，所述锁存储能电路的第二端与第一电压端连接；
所述充电控制电路分别与所述输入端、所述锁存充电端和所述锁存节点连接，用于在所述输入信号的控制下，控制所述锁存充电端与所述锁存节点连通，以通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压。
在实际操作时，所述第一电压端可以为低电压端或地端，但不以此为限。
在具体实施时，所述锁存节点控制电路可以包括充电控制电路和锁存储能电路，在两相邻显示时间段之间设置的锁存时间段，充电控制电路在输入信号的控制下，通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压为有效电平。
如图2所示，在图1所示的栅极驱动单元的实施例的基础上，所述锁存节点控制电路包括充电控制电路111和锁存储能电路112；
所述锁存储能电路112的第一端与所述锁存节点HN连接，所述锁存储能电路112的第二端与低电压端连接；所述低电压端用于输入低电压VGL_G；
所述充电控制电路111分别与所述输入端INPUT、所述锁存充电端HOLD_CHR和所述锁存节点HN连接，用于在所述输入信号的控制下，控制所述锁存充电端HOLD_CHR与所述锁存节点HN连通，以通过所述充电电压为所述锁存储能电路112充电，以控制所述锁存节点HN的电压。
在具体实施时，VGL_G为GOA基准低电位。
在两相邻显示时间段之间设置的锁存时间段，充电控制电路111在输入信号的控制下，通过所述充电电压为所述锁存储能电路112充电，以控制所述锁存节点HN的电压为有效电平。
具体的，所述锁存储能电路可以包括锁存电容；所述充电控制电路可以包括充电控制晶体管；
所述锁存电容的第一端与所述锁存节点连接，所述锁存电容的第二端与所述第一电压端连接；
所述充电控制晶体管的控制极与所述输入端连接，所述充电控制晶体管的第一极与所述锁存充电端连接，所述充电控制晶体管的第二极与所述锁存节点连接。
具体的，所述第一节点电位维持电路可以包括电位维持晶体管；
所述电位维持晶体管的控制极与所述锁存节点连接，所述电位维持晶体管的第一极与所述锁存使能端连接，所述电位维持晶体管的第二极与所述第一节点连接。
具体的，所述锁存节点复位电路可以包括锁存节点复位晶体管；
所述锁存节点复位晶体管的控制极与所述锁存节点复位端连接，所述锁存节点复位晶体管的第一极与所述锁存节点连接，所述锁存节点复位晶体管的第二极与复位电压端连接。
在具体实施时，所述复位电压端可以为低电压端或地端，但不以此为限。
在优选情况下，所述锁存充电端与所述锁存使能端为同一端子，以能够减少采用的端子的数目，利于实现窄边框。
如图3所示，在图2所示的栅极驱动单元的实施例的基础上，所述锁存储能电路112包括锁存电容C3；所述充电控制电路111包括充电控制晶体管T11；
所述锁存电容C3的第一端与所述锁存节点HN连接，所述锁存电容C3的第二端与低电压端连接；所述低电压端用于输入低电压VGL_G；
所述充电控制晶体管T11的栅极与所述输入端INPUT连接，所述充电控制晶体管T11的漏极与锁存使能端HOLD_EN连接，所述充电控制晶体管T11的源极与所述锁存节点HN连接；
所述第一节点电位维持电路12包括电位维持晶体管T12；
所述电位维持晶体管T12的栅极与所述锁存节点HN连接，所述电位维持晶体管T12的漏极与所述锁存使能端HOLD_EN连接，所述电位维持晶体管T12的源极与第一节点PU连接；
所述锁存节点复位电路13包括锁存节点复位晶体管T13；
所述锁存节点复位晶体管T13的栅极与所述锁存节点复位端HOLD_RST连接，所述锁存节点复位晶体管T13的漏极与所述锁存节点HN连接，所述锁存节点复位晶体管T13的源极与所述低电压端连接；所述低电压端用于输入低电压VGL_G。
在图3所示的实施例中，所述锁存充电端与所述锁存使能端为同一端子。
在图3所示的实施例中，T11、T12和T13都为n型薄膜晶体管，但不以此为限。
本发明如图3所示的栅极驱动单元的实施例在工作时，在两相邻显示时间段之间设置的锁存时间段，HOLD_EN输出高电平，HOLD_RST输出低电平，INPUT接入相邻上一级栅极驱动单元输出的栅极驱动信号；
在所述锁存时间段，当INPUT接入高电平时，T11打开，通过HOLD_EN输出的高电平向C3充电，以使得HN的电位为高电压，T12打开，控制HOLD_EN与第一节点PU连接，以使得该第一节点PU的电位为高电压；
在所述锁存时间段，在INPUT接入高电平之后，INPUT接入低电平，T11关闭，HN的电位由C3维持为高电压，T12继续打开，控制HOLD_EN与第一节点PU连接，以使得该第一节点PU的电位为高电压，以使得在所述锁存时间段结束后，下一显示时间段开始时，该第一节点的电位能够维持为高电压，以能进行正常显示驱动。
本发明如图3所示的栅极驱动单元的实施例在工作时，在显示时间段，HOLD_EN输出低电平，HOLD_RST输出高电平，T13打开，打开C3放电路径，对C3进行放电，以对所述锁存节点HN的电位进行复位，以使得所述锁存节点HN的电位为低电压，从而控制T11和T12都关闭；在所述锁存时间段，HOLD_RST输出低电平，以控制T13关闭，以关闭C3的放电路径。
具体的，本发明实施例所述的栅极驱动单元还可以包括栅极驱动信号输出端、储能电路、输出电路、触控复位电路和第一节点复位电路；
所述储能电路的第一端与所述第一节点连接，所述储能电路的第二端与栅极驱动信号输出端连接，所述储能电路用于控制所述第一节点的电位；
所述输出电路分别与所述第一节点、所述栅极驱动信号输出端和第一时钟信号端连接，用于在所述第一节点的电压的控制下，控制所述栅极驱动信号输出端与所述第一时钟信号端之间连通；
所述触控复位电路分别与触控复位端、所述栅极驱动信号输出端和复位电压端连接，用于在所述触控复位端输入的触控复位信号的控制下，控制所述栅极驱动信号输出端与所述复位电压端之间连通；
所述第一节点复位电路分别与空白区复位端、所述第一节点和所述复位电压端连接，用于在所述空白区复位端输入的空白区复位信号的控制下，控制所述第一节点与所述复位电压端之间连通。
在具体实施时，所述复位电压端可以为低电压端或地端，但不以此为限。
如图4所示，在图1所示的栅极驱动单元的实施例的基础上，本发明实施例所述的栅极驱动单元还可以包括栅极驱动信号输出端OUT、储能电路14、输出电路15、触控复位电路16和第一节点复位电路17；
所述储能电路14的第一端与所述第一节点PU连接，所述储能电路14的第二端与栅极驱动信号输出端OUT连接，所述储能电路14用于控制所述第一节点PU的电位；
所述输出电路15分别与所述第一节点PU、所述栅极驱动信号输出端OUT和用于输入第一时钟CK的第一时钟信号端连接，用于在所述第一节点PU的电压的控制下，控制所述栅极驱动信号输出端OUT与所述第一时钟信号端之间连通；
所述触控复位电路16分别与触控复位端EN_Touch、所述栅极驱动信号输出端OUT和用于输入低电压VGL_G的低电压端连接，用于在所述触控复位端EN_Touch输入的触控复位信号的控制下，控制所述栅极驱动信号输出端OUT与所述低电压端之间连通；
所述第一节点复位电路17分别与空白区复位端RESET、所述第一节点PU和所述低电压端连接，用于在所述空白区复位端RESET输入的空白区复位信号的控制下，控制所述第一节点PU与所述低电压端之间连通。
本发明如图4所示的栅极驱动单元的实施例在工作时，在显示时间段包括的相应级栅极驱动单元输出阶段，所述输出电路15在所述第一节点PU的电压的控制下，控制将第一时钟信号CK输出至所述栅极驱动信号输出端OUT，以使得OUT输出高电平，控制相应行栅线打开；并在EN_Touch输入的触控复位信号的控制下，所述触控复位电路16控制对所述栅极驱动信号输出端OUT输出的栅极驱动信号进行复位；在所述空白区复位端RESET输入的空白区复位信号的控制下，所述第一节点复位电路17控制对所述栅极驱动信号输出端OUT输出的栅极驱动信号进行复位。
当所述触控复位电路16包括的触控复位晶体管为n型晶体管时，在触控时间段(所述锁存时间段可以包括所述触控时间段)，EN_Touch输出高电平，以使得所述触控复位晶体管打开，以控制OUT输出低电压信号，控制相应行栅线关闭；
当所述触控复位电路16包括的触控复位晶体管为p型晶体管时，在触控时间段(所述锁存时间段可以包括所述触控时间段)，EN_Touch输出低电平，以使得所述触控复位晶体管打开，以控制OUT输出低电压信号，控制相应行栅线关闭；
当所述第一节点复位电路17包括的第一节点复位晶体管为n型晶体管时，在blanking(空白)时间段(所述空白时间段为相邻两帧画面显示时间之间的时间段)，RESET输出高电平，以使得所述第一节点复位晶体管打开，以控制OUT接入低电压；
当所述第一节点复位电路17包括的第一节点复位晶体管为p型晶体管时，在blanking(空白)时间段，RESET输出低电平，以使得所述第一节点复位晶体管打开，以控制OUT接入低电压。
在具体实施时，相应行栅线打开指的是：像素电路包括的栅极与该相应行栅线连接的晶体管打开；相应行栅线关闭指的是：像素电路包括的栅极与该相应行栅线连接的晶体管关闭。
具体的，所述储能电路可以包括存储电容，所述输出电路可以包括输出晶体管，所述触控复位电路可以包括触控复位晶体管，所述第一节点复位电路可以包括第一节点复位晶体管；
所述存储电容的第一端与所述第一节点连接，所述存储电容的第二端与所述栅极驱动信号输出端连接；
所述输出晶体管的控制极与所述第一节点连接，所述输出晶体管的第一极与所述第一时钟信号端连接，所述输出晶体管的第二极与所述栅极驱动信号输出端连接；
所述触控复位晶体管的控制极与触控复位端连接，所述触控复位晶体管的第一极与所述栅极驱动信号输出端连接，所述触控复位晶体管的第二极与所述复位电压端连接；
所述第一节点复位晶体管的控制极与空白区复位端连接，所述第一节点复位晶体管的第一极与所述第一节点连接，所述第一节点复位晶体管的第二极与所述复位电压端连接。
具体的，本发明实施例所述的栅极驱动单元还可以包括第一节点控制电路、第二节点控制电路和输出复位电路，其中，
所述第一节点控制电路分别与所述第一节点、所述输入端、复位端、第一扫描电压端、第二扫描电压端、第二节点和第二电压端连接，用于在所述输入信号的控制下，控制所述第一节点与所述第一扫描电压端之间连通，在所述复位端输入的复位信号的控制下，控制所述第一节点与所述第二扫描电压端之间连通，在所述第二节点的电压的控制下，控制所述第一节点与所述第二电压端之间连通；
所述第二节点控制电路分别与所述第一节点、所述第二节点、第二时钟信号端、栅极驱动信号输出端和所述第二电压端连接，用于在所述第二时钟信号端输入的第二时钟信号、所述第一节点的电压和所述栅极驱动信号输出端输出的栅极驱动信号的控制下，控制所述第二节点的电位；
所述输出复位电路分别与所述第二节点、所述栅极驱动信号输出端和所述第二电压端连接，用于在所述第二节点的电压的控制下，控制所述栅极驱动信号输出端与所述第二电压端之间连通。
在具体实施时，所述第二节点为控制对所述栅极驱动信号输出端输出的栅极驱动信号进行复位的节点，并且，所述第二节点也用于对第一节点进行复位，也即，当第二节点的电位为有效电平时，所述栅极驱动信号输出端输出无效电平，并第一节点的电位为无效电平，但不以此为限。
在具体实施时，所述第一扫描电压端和所述第二扫描电压端用于控制扫描方向；所述输入端与相邻上一级栅极驱动单元的栅极驱动信号输出端连接，所述复位端与相邻下一级栅极驱动单元的栅极驱动信号输出端连接；
在进行正向扫描时，也即从第一级栅极驱动单元依次向后扫描，此时第一扫描电压端输入的第一扫描电压为有效电压，第二扫描电压端输入的第二扫描电压为无效电压；
在进行反向扫描时，也即从最后一级栅极驱动单元以此向前扫描，此时第一扫描电压端输入的第一扫描电压为无效电压，第二扫描电压端输入的第二扫描电压为有效电压。
在具体实施时，所述第二电压端可以为低电压端或地端，但不以此为限。
在具体实施时，所述第二节点控制电路用于控制第二节点的电位，所述输出复位电路用于在第二节点的电压的控制下，对所述栅极驱动信号输出端输出的栅极驱动信号进行复位。
在实际操作时，所述第一时钟信号和所述第二时钟信号为各级栅极驱动单元输出时序控制信号，在显示时间段，第一时钟信号的电位和第二时钟信号的电位交替为高电压。
如图5所示，在图4所示的栅极驱动单元的实施例的基础上，本发明实施例所述的栅极驱动单元还可以包括第一节点控制电路18、第二节点控制电路19和输出复位电路110，其中，
所述第一节点控制电路18分别与所述第一节点PU、所述输入端INPUT、复位端RST、第一扫描电压端CN、第二扫描电压端CNB、第二节点PD和用于输入低电压VGL_G的低电压端连接，用于在所述输入信号的控制下，控制所述第一节点PU与所述第一扫描电压端CN之间连通，在所述复位端RST输入的复位信号的控制下，控制所述第一节点PU与所述第二扫描电压端CNB之间连通，在所述第二节点PD的电压的控制下，控制所述第一节点PU与所述低电压端之间连通；
所述第二节点控制电路19分别与所述第一节点PU、所述第二节点PD、用于输入第二时钟信号CKB的第二时钟信号端、栅极驱动信号输出端OUT和所述低电压端连接，用于在所述第二时钟信号端输入的第二时钟信号CKB、所述第一节点PU的电压和所述栅极驱动信号输出端OUT输出的栅极驱动信号的控制下，控制所述第二节点PD的电位；
所述输出复位电路110分别与所述第二节点PD、所述栅极驱动信号输出端OUT和所述低电压端连接，用于在所述第二节点PD的电压的控制下，控制所述栅极驱动信号输出端OUT与所述低电压端之间连通。
具体的，所述第一节点控制电路可以包括输入晶体管、复位晶体管和第一节点控制晶体管，其中，
所述输入晶体管的控制极与所述输入端连接，所述输入晶体管的第一极与所述第一扫描电压端连接，所述输入晶体管的第二极与所述第一节点连接；
所述复位晶体管的控制极与所述复位端连接，所述复位晶体管的第一极与所述第一节点连接，所述复位晶体管的第二极与所述第二扫描电压端连接；
所述第一节点控制晶体管的控制极与所述第二节点连接，所述第一节点控制晶体管的第一极与所述第一节点连接，所述第一节点控制晶体管的第二极与所述第二电压端连接。
具体的，所述第二节点控制电路可以包括第一控制晶体管、第二控制晶体管、第三控制晶体管和第二节点控制电容，其中，
所述第一控制晶体管的控制极和所述第一控制晶体管的第一极都与所述第二时钟信号端连接，所述第一控制晶体管的第二极与所述第二节点连接；
所述第二控制晶体管的控制极与所述第一节点连接，所述第二控制晶体管的第一极与所述第二节点连接，所述第二控制晶体管的第二极与所述第二电压端连接；
所述第三控制晶体管的控制极与所述栅极驱动信号输出端连接，所述第三控制晶体管的第一极与所述第二节点连接，所述第二控制晶体管的第二极与所述第二电压端连接；
所述第二节点控制电容的第一端与所述第二节点连接，所述第二节点控制电容的第二端与所述第二电压端连接。
具体的，所述输出复位电路可以包括输出复位晶体管；
所述输出复位晶体管的控制极与所述第二节点连接，所述输出复位晶体管的第一极与所述栅极驱动信号输出端连接，所述输出复位晶体管的第二极与所述第二电压端连接。
下面通过一具体实施例来说明本发明所述的栅极驱动单元。
如图6所示，本发明所述的栅极驱动单元的一具体实施例包括输入端INPUT、锁存节点控制电路、第一节点电位维持电路12、锁存节点复位电路13、栅极驱动信号输出端OUT、储能电路14、输出电路15、触控复位电路16、第一节点复位电路17、第一节点控制电路18、第二节点控制电路19和输出复位电路110；
所述锁存节点控制电路包括充电控制电路111和锁存储能电路112；
所述充电控制电路111包括充电控制晶体管T11；所述锁存储能电路112包括锁存电容C3；所述第一节点电位维持电路12包括电位维持晶体管T12；所述锁存节点复位电路13包括锁存节点复位晶体管T13；
所述锁存电容C3的第一端与锁存节点HN连接，所述锁存电容C3的第二端与低电压端连接；所述低电压端用于输入低电压VGL_G；
所述充电控制晶体管T11的栅极与所述输入端INPUT连接，所述充电控制晶体管T11的漏极与锁存使能端HOLD_EN连接，所述充电控制晶体管T11的源极与所述锁存节点HN连接；
所述电位维持晶体管T12的栅极与所述锁存节点HN连接，所述电位维持晶体管T12的漏极与所述锁存使能端HOLD_EN连接，所述电位维持晶体管T12的源极与第一节点PU连接；
所述锁存节点复位晶体管T13的栅极与所述锁存节点复位端HOLD_RST连接，所述锁存节点复位晶体管T13的漏极与所述锁存节点HN连接，所述锁存节点复位晶体管T13的源极与所述低电压端连接；所述低电压端用于输入低电压VGL_G；
所述储能电路14包括存储电容C1，所述输出电路15包括输出晶体管T3，所述触控复位电路16包括触控复位晶体管T10，所述第一节点复位电路17包括第一节点复位晶体管T9；
所述存储电容C1的第一端与所述第一节点PU连接，所述存储电容C1的第二端与所述栅极驱动信号输出端OUT连接；
所述输出晶体管T3的栅极与所述第一节点PU连接，所述输出晶体管T3的漏极与所述第一时钟信号端连接，所述输出晶体管T3的源极与所述栅极驱动信号输出端OUT连接；所述第一时钟信号端用于输入第一时钟信号CLK；
所述触控复位晶体管T10的栅极与触控复位端EN_Touch连接，所述触控复位晶体管T10的漏极与所述栅极驱动信号输出端OUT连接，所述触控复位晶体管T10的源极与所述低电压端连接；
所述第一节点复位晶体管T9的栅极与空白区复位端RESET连接，所述第一节点复位晶体管T9的漏极与所述第一节点PU连接，所述第一节点复位晶体管T9的源极与所述低电压端连接；
所述第一节点控制电路18包括输入晶体管T1、复位晶体管T2和第一节点控制晶体管T5，其中，
所述输入晶体管T1的栅极与所述输入端INPUT连接，所述输入晶体管T1的漏极与第一扫描电压端CN连接，所述输入晶体管T1的源极与所述第一节点PU连接；
所述复位晶体管T2的栅极与复位端RST连接，所述复位晶体管T2的漏极与所述第一节点PU连接，所述复位晶体管T2的源极与所述第二扫描电压端CNB连接；
所述第一节点控制晶体管T5的栅极与所述第二节点PD连接，所述第一节点控制晶体管T5的漏极与所述第一节点PU连接，所述第一节点控制晶体管T5的源极与所述低电压端连接；
所述第二节点控制电路19包括第一控制晶体管T7、第二控制晶体管T6、第三控制晶体管T8和第二节点控制电容C2，其中，
所述第一控制晶体管T7的栅极和所述第一控制晶体管T7的漏极都与第二时钟信号端连接，所述第一控制晶体管T7的源极与所述第二节点PD连接；
所述第二控制晶体管T6的栅极与所述第一节点PU连接，所述第二控制晶体管T6的漏极与所述第二节点PD连接，所述第二控制晶体管T6的源极与所述低电压端连接；
所述第三控制晶体管T8的栅极与所述栅极驱动信号输出端OUT连接，所述第三控制晶体管T8的漏极与所述第二节点PD连接，所述第三控制晶体管T8的源极与所述低电压端连接；
所述第二节点控制电容C2的第一端与所述第二节点PD连接，所述第二节点控制电容C2的第二端与所述低电压端连接；
所述输出复位电路110包括输出复位晶体管T4；
所述输出复位晶体管T4的栅极与所述第二节点PD连接，所述输出复位晶体管T4的漏极与所述栅极驱动信号输出端OUT连接，所述输出复位晶体管T4的源极与所述低电压端连接。
在图6所示的具体实施例中，锁存使能端和锁存充电端为同一端子。
在图6所示的具体实施例中，所有的晶体管都为n型薄膜晶体管，但不以此为限。
下面以栅极驱动电路处于正向扫描模式下的工作过程举例说明，在正向扫描时，CN输入高电平，CNB输入低电平。
如图7所示，本发明如图6所示的栅极驱动单元的具体实施例在工作时，在第一显示时间段S11和第二显示时间段S12之间设置有锁存时间段S2，在所述锁存时间段S2，HOLD_EN输出高电平，HOLD_RST输出低电平，INPUT接入相邻上一级栅极驱动单元输出的栅极驱动信号；
在所述锁存时间段S2，CK保持为低电平，以使得即使PU的电位为高电平，OUT也保持输出低电平，以控制相应的栅线关闭；
在所述锁存时间段S2，HOLD_RST输出低电平，T13关闭；
在所述锁存时间段S2开始时，INPUT接入高电平，T1和T11开启，CN输入高电平，经过T1为C1充电，以使得PU的电位为高电平；同时HOLD_EN输入高电平，经过T11给C3充电，以控制HN的电位为高电平，T12打开，HOLD_EN输入的高电平经过T12为C1充电，以使得PU的电位为高电压；
在所述锁存时间段S2，在INPUT接入高电平之后，INPUT接入低电平，HN的电位由C3维持为高电压，T12继续打开，控制HOLD_EN与第一节点PU连接，HOLD_EN输入的高电平经过T12为C1充电，以使得该第一节点PU的电位为高电压，以使得在所述锁存时间段结束后，下一显示时间段开始时，该第一节点的电位能够维持为高电压，以能进行正常显示驱动。
在所述锁存时间段S2，虽然C1经过T5和T9的漏电路径依然存在，但是HOLD_EN输入的高电压可以控制持续对C1充电，以使得第一节点PU的电位稳定的钳位在高电位，没有任何衰减，以使得锁存时间段结束后，进入所述第二显示时间段S12，CK恢复为正常的时钟信号，所述栅极驱动单元能够正常输出栅极驱动信号，GOA能够继续级联输出。
本发明实施例所述的栅极驱动单元通过HOLD_EN对C1的强力电位锁存功能，能够保证在GOA的断点位置，栅极驱动单元中的第一节点的电位能够长时间保持为有效电压，从而解决传统的GOA中断自保持能力弱的问题，避免出现因GOA中断异常而导致的异常显示问题。
本发明如图6所示的栅极驱动单元的具体实施例在工作时，如图7所示，在所述第一显示时间段S11和所述第二显示时间段S12，CK恢复为正常的时钟信号，HOLD_EN输入低电平，HOLD_RST输出高电平，T13打开，打开C3放电路径，对C3进行放电，以对所述锁存节点HN的电位进行复位，以使得所述锁存节点HN的电位为低电压，从而控制T12关闭。
本发明实施例所述的栅极驱动方法应用于上述的栅极驱动单元，在两相邻显示时间段之间设置有锁存时间段，所述栅极驱动方法包括：
在锁存时间段，锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平；第一节点电位维持电路在所述锁存节点的电压的控制下，控制第一节点与锁存使能端之间连通，维持所述第一节点的电位为有效电压；
在所述显示时间段，锁存节点复位电路在锁存节点复位端输入的锁存节点复位信号的控制下，控制对所述锁存节点的电位进行复位，以控制所述第一节点电位维持电路断开所述第一节点与所述锁存使能端之间的连接。
在本发明实施例所述的栅极驱动方法中，在两相邻显示时间段之间设置的锁存时间段，锁存节点控制电路在输入端控制所述锁存节点的电压为有效电平；第一节点电位维持电路在维持所述第一节点的电位为有效电压，以使得在锁存时间段，第一节点的电位能够维持为有效电压，以在锁存时间段之后的显示时间段能够实现正常显示；并在显示时间段，锁存节点复位电路控制对所述锁存节点的电位进行复位，以控制所述第一节点电位维持电路断开所述第一节点与所述锁存使能端之间的连接，以不影响正常显示。
在具体实施时，所述锁存节点控制电路可以包括充电控制电路和锁存储能电路，所述锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平步骤包括：
所述充电控制电路在所述输入信号的控制下，控制所述锁存充电端与所述锁存节点连通，以通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压为有效电平。
在具体实施时，所述栅极驱动单元可以包括栅极驱动信号输出端和输出电路，所述栅极驱动方法还包括：
在所述锁存时间段，所述输出电路在所述第一节点的控制下，控制所述栅极驱动信号输出端与第一时钟信号端之间连通，以使得所述栅极驱动信号输出端输出无效电平，以控制相应行栅线关闭。
本发明实施例所述的栅极驱动电路包括A级上述的栅极驱动单元；A为大于1的整数；
第a级栅极驱动单元的输入端与第a-1级栅极驱动单元的栅极驱动信号输出端连接；a为小于或等于A而大于1的整数；
第一级栅极驱动单元的输入端与起始电压端连接。
所述起始电压端用于输入起始电压信号，所述起始电压信号为帧起始信号，为第一级栅极驱动单元提供输入信号。
如图8所示，本发明所述的栅极驱动电路的一具体实施例包括1920级栅极驱动单元；
在图8中，标号为G1的为第一级栅极驱动单元，标号为G2的为第二级栅极驱动单元，标号为G3的为第三级栅极驱动单元，标号为G4的为第四级栅极驱动单元，标号为GN-1的为第N-1级栅极驱动单元，标号为GN的为第N级栅极驱动单元，标号为GN+1的为第N+1级栅极驱动单元，标号为GN+2的为第N+2级栅极驱动单元，标号为GM-1的为第M-1级栅极驱动单元，标号为GM的为第M级栅极驱动单元，标号为GM+1的为第M+1级栅极驱动单元，标号为G1920的为第1920级栅极驱动单元；
标号为STV的为起始电压端，标号为OUT_1的为第一栅极驱动信号输出端，标号为OUT_2的为第二栅极驱动信号输出端，标号为OUT_3的为第三栅极驱动信号输出端，标号为OUT_4的为第四栅极驱动信号输出端；标号为OUT_N-1的为第N-1级栅极驱动信号输出端，标号为OUT_N的为第N级栅极驱动信号输出端，标号为OUT_N+1的为第N+1级栅极驱动信号输出端，标号为OUT_N+2的为第N+2级栅极驱动信号输出端，标号为OUT_M-1的为第M-1级栅极驱动信号输出端，标号为OUT_M的为第M级栅极驱动信号输出端，标号为OUT_M+1的为第M+1级栅极驱动信号输出端，标号为OUT_1920的为第1920级栅极驱动信号输出端；
N为大于5的整数，M为大于N+3的整数；
标号为INPUT的为输入端，标号为RST的为复位端；
G1的输入端与STV连接，G1的复位端与OUT_2连接，G2的输入端与OUT_1连接，G2的复位端与OUT_3连接，G3的输入端与OUT_2连接，G3的复位端与OUT_4连接，G4的输入端与OUT_3连接，G4的复位端与第四级栅极驱动单元(图8中未示出)的栅极驱动信号输出端连接；GN-1的输入端与第N-2级栅极驱动单元(图8中未示出)的栅极驱动信号输出端连接，GN-1的复位端与OUT_N连接；GN的输入端与OUT_N-1连接，GN的复位端与OUT_N+1连接；GN+1的输入端与OUT_N连接，GN+1的复位端与OUT_N+2连接，GN+2的输入端与OUT_N+1连接，GN+2的复位端与第N+3级栅极驱动单元(图8中未示出)的栅极驱动信号输出端连接；GM-1的输入端与第M-2级栅极驱动单元(图8中未示出)的栅极驱动信号输出端连接，GM-1的复位端与OUT_M连接；GM的输入端与OUT_M-1连接，GM的复位端与OUT_M+1连接；GM+1的输入端与OUT_M连接，GM+1的复位端与第M+2级栅极驱动单元(图8中未示出)的栅极驱动信号输出端连接。
在图8所示的栅极驱动电路的具体实施例中，G1包括的输出晶体管的第一极接入第一时钟信号CK，G2包括的输出晶体管的第一极接入第二时钟信号CKB，G3包括的输出晶体管的第一极接入第一时钟信号CK，G4包括的输出晶体管的第一极接入第二时钟信号CKB，GN-1包括的输出晶体管的第一极接入第一时钟信号CK，GN包括的输出晶体管的第一极接入第二时钟信号CKB，GN+1包括的输出晶体管的第一极接入第一时钟信号CK，GN+2包括的输出晶体管的第一极接入第二时钟信号CKB，GM-1包括的输出晶体管的第一极接入第一时钟信号CK，GM包括的输出晶体管的第一极接入第二时钟信号CKB，GM+1包括的输出晶体管的第一极接入第一时钟信号CK，G1920包括的输出晶体管的第一极接入第二时钟信号CKB。
图9示出了本发明所述的栅极驱动电路的该具体实施例中的第N-1级栅极驱动单元、第N级栅极驱动单元和第N+1级栅极驱动单元的电路图。
如图9所示，所述第N-1级栅极驱动单元包括第N-1级输入晶体管T1N-1、第N-1级复位晶体管T2N-1、第N-1级充电控制晶体管T11N-1、第N-1级锁存电容C3N-1、第N-1级电位维持晶体管T12N-1、第N-1级锁存节点复位晶体管T13N-1、第N-1级存储电容C1N-1、第N-1级输出晶体管T3N-1、第N-1级触控复位晶体管T10N-1、第N-1级第一节点复位晶体管T9N-1、第N-1级第一节点控制晶体管T5N-1、第N-1级第一控制晶体管T7N-1、第N-1级第二控制晶体管T6N-1、第N-1级第三控制晶体管T8N-1、第N-1级第二节点控制电容C2N-1和第N-1级输出复位晶体管T4N-1；
T3N-1的漏极接入第一时钟信号CK，T7N-1的栅极和T7N-1的漏极都接入第二时钟信号CKB；
T1N-1的栅极和T11N-1的栅极都与第N-2级栅极驱动单元的栅极驱动信号输出端OUT_N-2连接，T11N-1的漏极和T12N-1的漏极都与锁存使能端HOLD_EN连接，T13N-1的栅极与锁存使能端HOLD_RST连接；T10N-1的栅极与触控复位端EN_Touch连接，T9N-1的栅极与空白区复位端RESET连接，T2N-1的栅极与OUT_N连接；
所述第N级栅极驱动单元包括第N级输入晶体管T1N、第N级复位晶体管T2N、第N级充电控制晶体管T11N、第N级锁存电容C3N、第N级电位维持晶体管T12N、第N级锁存节点复位晶体管T13N、第N级存储电容C1N、第N级输出晶体管T3N、第N级触控复位晶体管T10N、第N级第一节点复位晶体管T9N、第N级第一节点控制晶体管T5N、第N级第一控制晶体管T7N、第N级第二控制晶体管T6N、第N级第三控制晶体管T8N、第N级第二节点控制电容C2N和第N级输出复位晶体管T4N；
T3N的漏极接入第一时钟信号CKB，T7N的栅极和T7N的漏极都接入第二时钟信号CK；
T1N的栅极和T11N的栅极都与第N-1级栅极驱动单元的栅极驱动信号输出端OUT_N-1连接，T11N的漏极和T12N的漏极都与锁存使能端HOLD_EN连接，T13N的栅极与锁存使能端HOLD_RST连接；T10N的栅极与触控复位端EN_Touch连接，T9N的栅极与空白区复位端RESET连接，T2N的栅极与OUT_N+1连接；
所述第N+1级栅极驱动单元包括第N+1级输入晶体管T1N+1、第N+1级复位晶体管T2N+1、第N+1级充电控制晶体管T11N+1、第N+1级锁存电容C3N+1、第N+1级电位维持晶体管T12N+1、第N+1级锁存节点复位晶体管T13N+1、第N+1级存储电容C1N+1、第N+1级输出晶体管T3N+1、第N+1级触控复位晶体管T10N+1、第N+1级第一节点复位晶体管T9N+1、第N+1级第一节点控制晶体管T5N+1、第N+1级第一控制晶体管T7N+1、第N+1级第二控制晶体管T6N+1、第N+1级第三控制晶体管T8N+1、第N+1级第二节点控制电容C2N+1和第N+1级输出复位晶体管T4N+1；
T3N+1的漏极接入第一时钟信号CK，T7N+1的栅极和T7N+1的漏极都接入第二时钟信号CKB；
T1N+1的栅极和T11N+1的栅极都与第N级栅极驱动单元的栅极驱动信号输出端OUT_N连接，T11N+1的漏极和T12N+1的漏极都与锁存使能端HOLD_EN连接，T13N+1的栅极与锁存使能端HOLD_RST连接；T10N+1的栅极与触控复位端EN_Touch连接，T9N+1的栅极与空白区复位端RESET连接，T2N+1的栅极与OUT_N+2连接；其中，OUT_N+2为第N+2级栅极驱动单元的栅极驱动信号输出端。
在图9中，标号为CN的为第一扫描电压端，标号为CNB的为第二扫描电压端，标号为VGL_G的为低电压。
在图9所示的具体实施例中，所有的晶体管都为n型薄膜晶体管，但不以此为限。
在图9所示的具体实施例中，标号为HN-N的为第N级栅极驱动单元中的锁存节点，标号为PUN的为第N级栅极驱动单元中的第一节点。
下面介绍本发明所述的栅极驱动电路的该具体实施例正向扫描时的工作过程，在正向扫描时，CN输入高电平，CNB输入低电平；在反向扫描时，CN输入低电平，CNB输入高电平。
如图10所示，一帧画面显示时间包括依次设置的第一显示时间段S11、第一锁存时间段S21、第二显示时间段S12、第二锁存时间段S22和第三显示时间段S13；第一锁存时间段S21包括第一锁存阶段S211和第二锁存阶段S212；所述第二显示时间段S12包括第一显示阶段S121和第二显示阶段S122；第二锁存时间段S22包括第三锁存阶段S221和第四锁存阶段S222；
在所述第一显示时间段S11，依次扫描第一级栅极驱动单元G1至第N-2级栅极驱动单元，OUT_1、OUT_2、OUT_3、OUT_4至第N-2级栅极驱动信号输出端依次输出高电平，之后进入第一锁存时间段S21；
在所述第一显示时间段S11，HOLD_EN输出低电平，HOLD_RST输出高电平，以控制各级栅极驱动单元中的锁存节点复位晶体管打开，以使得各级栅极驱动单元中的锁存节点的电位为低电压，从而控制各级栅极驱动单元中的充电控制晶体管和电位维持晶体管都关闭；
在第一锁存时间段S21包括的第一锁存阶段S211，CK为高电平，CKB为低电平，OUT_N-1输出高电平，T1N和T11N打开，HOLD_EN输出高电平信号，HOLD_RST输出低电平信号，CN输入的高电平信号经过T1N为C1N充电，HOLE_EN输出的高电平信号通过T11N为C3N充电，以控制第N级栅极驱动单元中的锁存节点HN-N的电位为高电平，T12N打开；
在所述第一锁存时间段S21包括的第二锁存阶段S212，HOLD_EN输出高电平信号，HOLD_RST输出低电平信号，CK和CKB都为低电平，OUT_N-1输出低电平，T11N关闭，HN-N的电位被C3N维持为高电平，以控制T12N打开，HOLD_EN输出的高电平信号经过T12N为C1N充电，以维持PUN的电位为高电平；并由于CK为低电平，则OUT_N输出低电平，进入GOA中断；
在GOA中断过程中，HOLD_EN一直输出高电平信号，C3N的高电位控制T12N常开，HOLD_EN输出的高电平信号经过T12N为C1N充电，以维持PUN的电位为稳定的高电位；在此过程中，C1N经过T5N和T9N的漏电路径虽然依然存在，但HOLD_EN输入的高电平信号可以将PUN的电位稳定的钳位在高电位，没有任何衰减。当GOA中断结束后，CK和CKB恢复为正常的时钟信号，使得GOA能够继续级联输出；通过HOLD_EN对C1的强力电位锁存功能，可以保证在断点位置，栅极驱动单元中的第一节点的电位能够长时间保持为高电平，在GOA中断结束后能够正常输出；
在所述第二显示时间段S12包括的第一显示阶段S121，CKB为高电平，PUN的电位维持为高电平，OUT_N输出高电平；
在所述第二显示时间段S12包括的第二显示阶段S122，HOLD_EN输出低电平信号，HOLD_RST输出高电平信号，CK、CKB依次为高电平，OUT_N+1、OUT_N+2至第M-2级栅极驱动单元包括的栅极驱动信号输出端依次输出高电平，之后进入第二锁存时间段S22；
在第二锁存时间段S22包括的第三锁存阶段S221，CK为高电平，CKB为低电平，OUT_M-1输出高电平，HOLD_EN输出高电平，HOLD_RST输出低电平，通过第M级栅极驱动单元中的充电控制晶体管、锁存电容和电位维持晶体管，控制将第M级栅极驱动单元中的第一节点的电位维持为高电平，并由于CKB为低电平，则OUT_M输出低电平；
在所述第二锁存时间段S22包括的第四锁存阶段S222，HOLD_EN输出高电平信号，HOLD_RST输出低电平信号，CK和CKB都为低电平，OUT_M-1输出低电平，通过第M级栅极驱动单元中的锁存电容和电位维持晶体管，控制将第M级栅极驱动单元中的第一节点的电位维持为高电平，并由于CKB为低电平，则OUT_M输出低电平；
在所述第三显示时间段S13，CKB、CK以此为高电平，OUT_M、OUT_M+1至OUT_1920以此输出高电平。
在图10中，标号为TB1的为第一空白时间段，标号为TB2的为第二空白时间段。
本发明实施例所述的显示装置包括上述的栅极驱动电路。
本发明实施例所提供的显示装置可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
以上所述是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明所述原理的前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (14)

1.一种栅极驱动单元，其特征在于，包括输入端、锁存节点控制电路、第一节点电位维持电路和锁存节点复位电路，其中，
所述锁存节点控制电路分别与所述锁存节点、所述输入端和锁存充电端连接，用于在输入端提供的输入信号的控制下，通过所述锁存充电端输入的充电电压，控制所述锁存节点的电压；
所述第一节点电位维持电路分别与所述锁存节点、第一节点和锁存使能端连接，用于在所述锁存节点的电压的控制下，控制所述第一节点与所述锁存使能端之间连通，维持所述第一节点的电位；
所述锁存节点复位电路分别与锁存节点复位端和所述锁存节点连接，用于在所述锁存节点复位端输入的锁存节点复位信号的控制下，控制对所述锁存节点的电位进行复位；
所述锁存节点与所述第一节点为不同的节点；所述栅极驱动单元还包括第一节点控制电路和输出电路；
所述第一节点控制电路分别与所述第一节点、所述输入端、复位端、第一扫描电压端和第二扫描电压端连接，用于在所述输入信号的控制下，控制所述第一节点与所述第一扫描电压端之间连通，在所述复位端输入的复位信号的控制下，控制所述第一节点与所述第二扫描电压端之间连通；
所述输出电路分别与所述第一节点、所述栅极驱动信号输出端和第一时钟信号端连接，用于在所述第一节点的电压的控制下，控制所述栅极驱动信号输出端与所述第一时钟信号端之间连通。
2.如权利要求1所述的栅极驱动单元，其特征在于，所述锁存节点控制电路包括充电控制电路和锁存储能电路；
所述锁存储能电路的第一端与所述锁存节点连接，所述锁存储能电路的第二端与第一电压端连接；
所述充电控制电路分别与所述输入端、所述锁存充电端和所述锁存节点连接，用于在所述输入信号的控制下，控制所述锁存充电端与所述锁存节点连通，以通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压。
3.如权利要求2所述的栅极驱动单元，其特征在于，所述锁存储能电路包括锁存电容；所述充电控制电路包括充电控制晶体管；
所述锁存电容的第一端与所述锁存节点连接，所述锁存电容的第二端与所述第一电压端连接；
所述充电控制晶体管的控制极与所述输入端连接，所述充电控制晶体管的第一极与所述锁存充电端连接，所述充电控制晶体管的第二极与所述锁存节点连接。
4.如权利要求1所述的栅极驱动单元，其特征在于，所述第一节点电位维持电路包括电位维持晶体管；
所述电位维持晶体管的控制极与所述锁存节点连接，所述电位维持晶体管的第一极与所述锁存使能端连接，所述电位维持晶体管的第二极与所述第一节点连接。
5.如权利要求1所述的栅极驱动单元，其特征在于，所述锁存节点复位电路包括锁存节点复位晶体管；
所述锁存节点复位晶体管的控制极与所述锁存节点复位端连接，所述锁存节点复位晶体管的第一极与所述锁存节点连接，所述锁存节点复位晶体管的第二极与复位电压端连接。
6.如权利要求1至5中任一权利要求所述的栅极驱动单元，其特征在于，所述锁存充电端与所述锁存使能端为同一端子。
7.如权利要求1至5中任一权利要求所述的栅极驱动单元，其特征在于，还包括栅极驱动信号输出端、储能电路、输出电路、触控复位电路和第一节点复位电路；
所述储能电路的第一端与所述第一节点连接，所述储能电路的第二端与栅极驱动信号输出端连接，所述储能电路用于控制所述第一节点的电位；
所述触控复位电路分别与触控复位端、所述栅极驱动信号输出端和复位电压端连接，用于在所述触控复位端输入的触控复位信号的控制下，控制所述栅极驱动信号输出端与所述复位电压端之间连通；
所述第一节点复位电路分别与空白区复位端、所述第一节点和所述复位电压端连接，用于在所述空白区复位端输入的空白区复位信号的控制下，控制所述第一节点与所述复位电压端之间连通。
8.如权利要求7所述的栅极驱动单元，其特征在于，所述储能电路包括存储电容，所述输出电路包括输出晶体管，所述触控复位电路包括触控复位晶体管，所述第一节点复位电路包括第一节点复位晶体管；
所述存储电容的第一端与所述第一节点连接，所述存储电容的第二端与所述栅极驱动信号输出端连接；
所述输出晶体管的控制极与所述第一节点连接，所述输出晶体管的第一极与所述第一时钟信号端连接，所述输出晶体管的第二极与所述栅极驱动信号输出端连接；
所述触控复位晶体管的控制极与触控复位端连接，所述触控复位晶体管的第一极与所述栅极驱动信号输出端连接，所述触控复位晶体管的第二极与所述复位电压端连接；
所述第一节点复位晶体管的控制极与空白区复位端连接，所述第一节点复位晶体管的第一极与所述第一节点连接，所述第一节点复位晶体管的第二极与所述复位电压端连接。
9.如权利要求1至5中任一权利要求所述的栅极驱动单元，其特征在于，还包括第一节点控制电路、第二节点控制电路和输出复位电路，其中，
所述第一节点控制电路还分别与第二节点和第二电压端连接，用于在所述第二节点的电压的控制下，控制所述第一节点与所述第二电压端之间连通；
所述第二节点控制电路分别与所述第一节点、所述第二节点、第二时钟信号端、栅极驱动信号输出端和所述第二电压端连接，用于在所述第二时钟信号端输入的第二时钟信号、所述第一节点的电压和所述栅极驱动信号输出端输出的栅极驱动信号的控制下，控制所述第二节点的电位；
所述输出复位电路分别与所述第二节点、所述栅极驱动信号输出端和所述第二电压端连接，用于在所述第二节点的电压的控制下，控制所述栅极驱动信号输出端与所述第二电压端之间连通。
10.一种栅极驱动方法，其特征在于，应用于如权利要求1至9中任一权利要求所述的栅极驱动单元，在两相邻显示时间段之间设置有锁存时间段，所述栅极驱动方法包括：
在锁存时间段，锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平；第一节点电位维持电路在所述锁存节点的电压的控制下，控制第一节点与锁存使能端之间连通，维持所述第一节点的电位为有效电压；
在所述显示时间段，锁存节点复位电路在锁存节点复位端输入的锁存节点复位信号的控制下，控制对所述锁存节点的电位进行复位，以控制所述第一节点电位维持电路断开所述第一节点与所述锁存使能端之间的连接。
11.如权利要求10所述的栅极驱动方法，其特征在于，所述锁存节点控制电路包括充电控制电路和锁存储能电路，所述锁存节点控制电路在输入端提供的输入信号的控制下，通过锁存充电端输入的充电电压，控制所述锁存节点的电压为有效电平步骤包括：
所述充电控制电路在所述输入信号的控制下，控制所述锁存充电端与所述锁存节点连通，以通过所述充电电压为所述锁存储能电路充电，以控制所述锁存节点的电压为有效电平。
12.如权利要求10或11所述的栅极驱动方法，其特征在于，所述栅极驱动单元包括栅极驱动信号输出端和输出电路，所述栅极驱动方法还包括：
在所述锁存时间段，所述输出电路在所述第一节点的控制下，控制所述栅极驱动信号输出端与第一时钟信号端之间连通，以使得所述栅极驱动信号输出端输出无效电平。
13.一种栅极驱动电路，其特征在于，包括A级如权利要求1至9中任一权利要求所述的栅极驱动单元；A为大于1的整数；
第a级栅极驱动单元的输入端与第a-1级栅极驱动单元的栅极驱动信号输出端连接；a为小于或等于A而大于1的整数；
第一级栅极驱动单元的输入端与起始电压端连接。
14.一种显示装置，其特征在于，包括如权利要求13所述的栅极驱动电路。
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