CN107591183B - 移位暂存器及其触控显示装置 - Google Patents

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Abstract

本发明公开了一种移位暂存器及其触控显示装置。移位暂存器包括电压设定单元、驱动单元、控制单元、放电单元、第一补偿晶体管及第二补偿晶体管。电压设定单元设定内部端点的端点电压。驱动单元耦接内部端点以提供栅极信号及驱动信号。控制单元接收端点电压以提供控制信号。放电单元依据控制信号对端点电压及栅极信号进行放电。第一补偿晶体管及第二补偿晶体管串联耦接于触控致能信号与内部端点之间，并且第一补偿晶体管及第二补偿晶体管的控制端分别接收端点电压及触控致能信号。

Description

移位暂存器及其触控显示装置
技术领域
本发明是有关于一种移位暂存器，且特别是有关于一种移位暂存器及其触控显示装置。
背景技术
为了迎合电子装置轻薄及高操控灵敏度的需求，内嵌式触控面板(In-cell TouchPanel)已成为触控应用的重点产品。其中，内嵌式触控面板中的触控与显示部分为分时驱动，并且在触控扫描时，提供栅极信号的移位暂存器的状态会先维持原状。然而，由于内嵌式触控面板中的电荷容易流失，若移位暂存器的状态维持过久，则可能会引起操作失误，导致内嵌式触控面板的显示部分无法正常运作。因此，如何在触控扫描期间良好的维持移位暂存器的状态则成为设计移位暂存器的一个重点。
发明内容
本发明提供一种移位暂存器及其触控显示装置，可在触控扫描期间对移位暂存器的内部端点进行充电，以避免移位暂存器无法正常运作。
本发明的移位暂存器，包括电压设定单元、驱动单元、第一控制单元、放电单元、第一补偿晶体管及第二补偿晶体管。电压设定单元接收第一栅极参考信号，以设定内部端点的端点电压。驱动单元耦接内部端点，而驱动单元接收端点电压及时脉信号，以提供栅极信号及驱动信号。第一控制单元耦接内部端点，接收第一低频时脉信号、端点电压及低电压，以提供第一控制信号。放电单元耦接第一控制单元以接收第一控制信号，并且依据第一控制信号对端点电压及栅极信号进行放电。第一补偿晶体管具有第一端、一控制端及第二端，其中第一端接收触控致能信号，控制端则耦接内部端点。第二补偿晶体管具有第一端、控制端及第二端，其中第一端耦接于第一补偿晶体管的第二端，控制端接收触控致能信号，而第二端则耦接于内部端点。
本发明的触控显示装置，包含显示面板、触控层及多级的移位暂存器。显示面板具有主动区与周边区。触控层位于主动区。多级的移位暂存器位于周边区，且耦接于显示面板，其中每级的移位暂存器可接收触控致能信号与第一时脉信号，且可输出当级栅极信号与当级驱动信号。每级的移位暂存器更包含电压设定单元、驱动单元、第一控制单元、放电单元、第一补偿晶体管及第二补偿晶体管。电压设定单元分别耦接于前二级栅极信号与前两级驱动信号。驱动单元耦接第一时脉信号，且输出当级栅极信号与当级驱动信号，其中电压设定单元与驱动单元通过一内部端点而耦接。控制单元耦接于内部端点，且输出控制信号。放电单元分别耦接于内部端点、控制单元与驱动单元，且接收控制信号。第一补偿晶体管具有一第一端、一控制端及一第二端，其中第一端耦接触控致能信号，控制端则耦接内部端点。第二补偿晶体管具有一第一端、一控制端及一第二端，其中第一端耦接于第一补偿晶体管的第二端，控制端耦接触控致能信号，而第二端则耦接于内部端点。
基于上述，本发明实施例的移位暂存器及其触控显示装置，在触控显示面板进行扫描时，第一补偿晶体管及第二补偿晶体管会导通，以对端点电压进行充电。藉此，可避免端点电压因时间而衰减，进而避免无法正常运作。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合所附图式作详细说明如下。
附图说明
图1为依据本发明一实施例的移位暂存器的系统示意图。
图2为依据本发明一实施例的移位暂存器的电路示意图。
图3为依据本发明另一实施例的移位暂存器的电路示意图。
图4为依据本发明一实施例的触控显示装置的系统示意图。
其中，附图标记：
100、200、300、SR：移位暂存器
110、110a、110b：电压设定单元
120、120a：驱动单元
130、130a、130b：放电单元
140、140a、140b：第一控制单元
150：第二控制单元
400：触控显示装置
405：触控显示面板
411：栅极电路
413：栅极线
415：驱动线
430：数据驱动电路
AA：主动区
C1：电容
G[1]～G[m]、G[n]、G[n-2]：栅极信号
HC1：时脉信号
K[n]：第一控制信号
LC1：第一低频时脉信号
LC2：第二低频时脉信号
Nix：内部端点
P：像素
P[n]：第二控制信号
PH：周边区
Q[n]：端点电压
ST[1]～ST[m]、ST[n]、ST[n-2]、ST[n+2]、ST[n+4]：驱动信号
T1～T37：晶体管
TC1：第一补偿晶体管
TC2：第二补偿晶体管
TD1、TD2：驱动晶体管
TP_EN：触控致能信号
VSS0、VSS1：低电压
具体实施方式
以下结合附图和具体实施例对本发明进行详细描述，但不作为对本发明的限定。
图1为依据本发明一实施例的移位暂存器的系统示意图。请参照图1，在本实施例中，移位暂存器100包括电压设定单元110、驱动单元120、放电单元130、第一控制单元140、第一补偿晶体管TC1及第二补偿晶体管TC2。其中，电压设定单元110与驱动单元120通过内部端点Nix而耦接。
电压设定单元110接收前二级栅极信号G[n-2](对应第一栅极参考信号)及前两级驱动信号ST[n-2]，以设定内部端点Nix的端点电压Q[n]，其中n为一正整数。驱动单元120耦接内部端点Nix，而驱动单元120接收端点电压Q[n]及时脉信号HC1，以提供当级栅极信号G[n]及当级驱动信号ST[n]。其中，电压设定单元110与驱动单元120通过内部端点Nix而耦接。
第一控制单元140耦接内部端点Nix，接收第一低频时脉信号LC1、端点电压Q[n]及第一低电压VSS0，以提供第一控制信号K[n]。放电单元130耦接第一控制单元140以接收第一控制信号K[n]，并且耦接内部端点Nix及驱动单元120以依据第一控制信号K[n]对端点电压Q[n]及当级栅极信号G[n]进行放电。
第一补偿晶体管TC1的第一端接收触控致能信号TP_EN，第一补偿晶体管TC1的控制端则耦接内部端点Nix。第二补偿晶体管TC2的第一端耦接于第一补偿晶体管TC1的第二端，第二补偿晶体管TC2的控制端接收触控致能信号TP_EN，而第二补偿晶体管TC2的第二端则耦接于内部端点Nix。
依据上述，在触控显示面板进行扫描时，可致能触控致能信号TP_EN(例如为高电平)。并且，当移位暂存器100被启动时，端点电压Q[n]会为高电平。此时，第一补偿晶体管TC1及第二补偿晶体管TC2皆为导通，而致能的触控致能信号TP_EN会通过导通的第一补偿晶体管TC1及第二补偿晶体管TC2对端点电压Q[n]进行充电，避免端点电压Q[n]因时间而衰减，进而避免无法正常运作。
在上述实施例中，电压设定单元110同时接收前二级栅极信号G[n-2]及前两级驱动信号ST[n-2]，但在某些实施例中，电压设定单元110可接收前二级栅极信号G[n-2]及前两级驱动信号ST[n-2]的其中之一，此可依据电路设计而定，本发明实施例不以此为限。
图2为依据本发明一实施例的移位暂存器的电路示意图。请参照图1及图2，在本实施例中，移位暂存器200包括电压设定单元110a、驱动单元120a、放电单元130a、第一控制单元140a、第二控制单元150、第一补偿晶体管TC1及第二补偿晶体管TC2，其中相同或相似元件使用相同或相似标号。其中，第二控制单元150耦接内部端点Nix，且接收第二低频时脉信号LC2、端点电压Q[n]及第一低电压VSS0，以提供第二控制信号P[n]。于本实施例中，第二低频时脉信号LC2为第一低频时脉信号LC1的反相信号，举例而言，当第一低频时脉信号LC1为高电平时，则第二低频时脉信号LC2为低电平；当第一低频时脉信号LC1为低电平时，则第二低频时脉信号LC2为高电平。
于图2的实施例中，电压设定单元110a包括晶体管T1～T3(对应第一晶体管至第三晶体管)。晶体管T1的第一端耦接于前二级栅极信号G[n-2]，晶体管T1的控制端耦接于前二级驱动信号ST[n-2]。晶体管T2的第一端耦接晶体管T1的第二端，晶体管T2的控制端接收前二级驱动信号ST[n-2]，晶体管T2的第二端耦接内部端点Nix。晶体管T3的第一端耦接于晶体管T1的第二端，晶体管T3的第二端与控制端分别耦接于触控致能信号TP_EN。
当前二级驱动信号ST[n-2]及前二级栅极信号G[n-2]为高电平时，则晶体管T1及T2会同时导通，而为高电平的前二级栅极信号G[n-2]为高电平会对内部端点Nix充电，亦即拉高端点电压Q[n]；当前二级驱动信号ST[n-2]及前二级栅极信号G[n-2]为低电平时，则晶体管T1及T2会同时截止(不导通)，而端点电压Q[n]的状态与前二级栅极信号G[n-2]的电平无关。此外，当触控致能信号TP_EN为高电平时，晶体管T1及T2的连接点的电压会被拉高，以抑制流经晶体管T1及T2的漏电流。
于图2的实施例中，驱动单元120a包括驱动晶体管TD1～TD2(对应第一驱动晶体管及第二驱动晶体管)及电容C1。驱动晶体管TD1的第一端接收时脉信号HC1，驱动晶体管TD1的控制端接收端点电压Q[n]，驱动晶体管TD1的第二端提供当级栅极信号G[n]。驱动晶体管TD2的第一端接收时脉信号HC1，驱动晶体管TD2的控制端接收端点电压Q[n]，驱动晶体管TD2的第二端提供当级驱动信号ST[n]。电容C1耦接于驱动晶体管TD1的控制端与第二端之间。
当端点电压Q[n]为高电平时，则驱动晶体管TD1及TD2会同时导通，以分别输出时脉信号HC1而形成当级栅极信号G[n]及当级驱动信号ST[n]；当端点电压Q[n]为低电平时，则驱动晶体管TD1及TD2会同时截止(不导通)，此时当级栅极信号G[n]及当级驱动信号ST[n]的电平与时脉信号HC1无关。
于图2的实施例中，第一控制单元140a包括晶体管T4～T7。晶体管T4的第一端接收第一低频时脉信号LC1，晶体管T4的控制端耦接晶体管T4的第一端，换言之，晶体管T4的第一端与控制端分别接收第一低频时脉信号LC1。晶体管T5的第一端耦接晶体管T4的第二端，晶体管T5的控制端接收端点电压Q[n]，晶体管T5的第二端接收第一低电压VSS0。晶体管T6的第一端接收第一低频时脉信号LC1，晶体管T6的控制端耦接晶体管T4的第二端，晶体管T6的第二端提供第一控制信号K[n]。晶体管T7的第一端耦接晶体管T6的第二端，晶体管T7的控制端接收端点电压Q[n]，晶体管T7的第二端接收第一低电压VSS0。
于本实施例中，第二控制单元150包括晶体管T20～T23。晶体管T20的第一端接收第二低频时脉信号LC2，晶体管T20的控制端耦接晶体管T20的第一端。晶体管T21的第一端耦接晶体管T20的第二端，晶体管T21的控制端接收端点电压Q[n]，晶体管T21的第二端接收第一低电压VSS0。晶体管T22的第一端接收第二低频时脉信号LC2，晶体管T22的控制端耦接晶体管T20的第二端，晶体管T21的第二端提供第二控制信号P[n]。晶体管T23的第一端耦接晶体管T22的第二端，晶体管T23的控制端接收端点电压Q[n]，晶体管T23的第二端接收第一低电压VSS0。
第二控制单元150的运作与第一控制单元140a的运作大致相同，其不同之处在于通过第一低频时脉信号LC1及第二低频时脉信号LC2而轮流驱动，亦即第一控制信号K[n]及第二控制信号P[n]会轮流为高电平。
于图2的实施例中，放电单元130a包括晶体管T8～T19。晶体管T8(对应第四晶体管)的第一端耦接内部端点Nix，晶体管T8的控制端接收第一控制信号K[n]，晶体管T8的第二端耦接当级驱动信号ST[n]。晶体管T9(对应第五晶体管)的第一端耦接当级驱动信号ST[n]，晶体管T9的控制端接收第一控制信号K[n]，晶体管T9的第二端接收第一低电压VSS0。晶体管T10(对应第六晶体管)的第一端耦接当级栅极信号G[n]，晶体管T10的控制端接收第一控制信号K[n]，晶体管T10的第二端接收第一低电压VSS0。
当第一控制信号K[n]为高电平时，则晶体管T8～T10会同时导通，以通过第一低电压VSS0拉低端点电压Q[n]及当级栅极信号G[n]；当第一控制信号K[n]为低电平时，则晶体管T8～T10会同时截止(不导通)，此时端点电压Q[n]及当级栅极信号G[n]的电平与第一低电压VSS0无关。
晶体管T11(对应第七晶体管)的第一端耦接内部端点Nix，晶体管T11的控制端接收后二级驱动信号ST[n+2](对应第二驱动参考信号)。晶体管T12(对应第八晶体管)的第一端接收晶体管T11的第二端，晶体管T12的控制端接收后二级驱动信号ST[n+2]，晶体管T12的第二端接收第一低电压VSS0。晶体管T13(对应第九晶体管)的第一端耦接晶体管T11的第二端，晶体管T13的控制端及第二端接收触控致能信号TP_EN。晶体管T14(对应第十晶体管)的第一端接收当级栅极信号G[n]，晶体管T14的控制端接收后二级驱动信号ST[n+2]，晶体管T14的第二端接收第一低电压VSS0。
当后二级驱动信号ST[n+2]为高电平时，则晶体管T11、T12及T14会同时导通，以通过第一低电压VSS0拉低端点电压Q[n]及当级栅极信号G[n]；当后二级驱动信号ST[n+2]为低电平时，则则晶体管T11、T12及T14会同时截止(不导通)，此时端点电压Q[n]及当级栅极信号G[n]的电平与第一低电压VSS0无关。此外，当触控致能信号TP_EN为高电平时，晶体管T11及T12的连接点的电压会被拉高，以抑制流经晶体管T11及T12的漏电流。
晶体管T15(对应第十一晶体管)的第一端接收当级栅极信号G[n]，晶体管T15的控制端接收触控致能信号TP_EN，晶体管T15的第二端接收第一低电压VSS0。晶体管T16(对应第十二晶体管)的第一端接收当级驱动信号ST[n]，晶体管T16的控制端接收触控致能信号TP_EN，晶体管T16的第二端接收第一低电压VSS0。
当触控致能信号TP_EN为高电平时，则晶体管T15及T16会同时导通，以通过第一低电压VSS0拉低当级栅极信号G[n]及当级驱动信号ST[n]；当触控致能信号TP_EN为低电平时，则晶体管T15及T16会同时截止(不导通)，此时当级栅极信号G[n]及当级驱动信号ST[n]的电平与第一低电压VSS0无关。
晶体管T17的第一端耦接内部端点Nix，晶体管T17的控制端接收第二控制信号P[n]，晶体管T17的第二端耦接当级驱动信号ST[n]。晶体管T18的第一端接收当级驱动信号ST[n]，晶体管T18的控制端接收第二控制信号P[n]，晶体管T18的第二端接收第一低电压VSS0。晶体管T19的第一端接收当级栅极信号G[n]，晶体管T19的控制端接收第二控制信号P[n]，晶体管T19的第二端接收第一低电压VSS0。
当第二控制信号P[n]为高电平时，则晶体管T17～T19会导通，以通过第一低电压VSS0拉低端点电压Q[n]及当级栅极信号G[n]；当第二控制信号P[n]为低电平时，则晶体管T17～T19会截止(不导通)，则端点电压Q[n]及当级栅极信号G[n]的电平与第一低电压VSS0无关。
在上述实施例中，移位暂存器200更包括第二控制单元150，但在部分实施例中，可省略第二控制单元150，并且放电单元130a可对应地省略晶体管T17～T19，此依据电路设计而定，本发明实施例不以此为限。
图3为依据本发明另一实施例的移位暂存器的电路示意图。请参照图1至图3，在本实施例中，移位暂存器300包括电压设定单元110b、驱动单元120a、放电单元130b、第一控制单元140b、第一补偿晶体管TC1及第二补偿晶体管TC2，其中相同或相似元件使用相同或相似标号。
于图3的实施例中，移位暂存器300的电压设定单元110b包括晶体管T24。晶体管T24的第一端及控制端耦接于前二级驱动信号ST[n-2]，晶体管T1的第二端耦接于内部端点Nix。进一步来说，当前二级驱动信号ST[n-2]为高电平时，则端点电压Q[n]会被抬升；当前二级驱动信号ST[n-2]为低电平时，则端点电压Q[n]与前二级驱动信号ST[n-2]无关。
于本实施例中，移位暂存器300的第一控制单元140b包括晶体管T25～T29。晶体管T25的第一端耦接第一控制信号K[n]，晶体管T25的控制端接收前二级驱动信号ST[n-2]，晶体管T25的第二端接收第一低电压VSS0。当前二级驱动信号ST[n-2]为高电平时，第一控制信号K[n]受第一低电压VSS0的影响而拉低；当前二级驱动信号ST[n-2]为低电平时，第一控制信号K[n]与第一低电压VSS0无关。晶体管T26的第一端接收时脉信号HC1，晶体管T26的控制端耦接晶体管T26的第一端，换言之，晶体管T26的第一端与控制端分别接收时脉信号HC1。晶体管T27的第一端耦接晶体管T26的第二端，晶体管T27的控制端接收当级驱动信号ST[n]，晶体管T27的第二端接收第二低电压VSS1。晶体管T28的第一端接收时脉信号HC1，晶体管T28的控制端耦接晶体管T26的第二端，晶体管T28的第二端提供第一控制信号K[n]。晶体管T29的第一端耦接晶体管T28的第二端，晶体管T29的控制端接收当级驱动信号ST[n]，晶体管T29的第二端接收低电压VSS1。
于本实施例中，移位暂存器300的放电单元130b包括晶体管T30～T37。晶体管T30的第一端耦接内部端点Nix，晶体管T30的控制端接收第一控制信号K[n]，晶体管T30的第二端接收第一低电压VSS0。晶体管T31的第一端接收当级栅极信号G[n]，晶体管T31的控制端接收第一控制信号K[n]，晶体管T31的第二端接收第二低电压VSS1。晶体管T32的第一端接收当级驱动信号ST[n]，晶体管T32的控制端接收第一控制信号K[n]，晶体管T32的第二端接收第一低电压VSS0。
当第一控制信号K[n]为高电平时，则晶体管T30～T32会同时导通，以通过第一低电压VSS0及第二低电压VSS1分别拉低端点电压Q[n]、当级栅极信号G[n]及当级驱动信号ST[n]；当第一控制信号K[n]为低电平时，则晶体管T30～T32会截止(不导通)，此时端点电压Q[n]、当级栅极信号G[n]及当级驱动信号ST[n]的电平与第一低电压VSS0及第二低电压VSS1无关。
于放电单元130b中，晶体管T33的第一端耦接内部端点Nix，晶体管T33的控制端接收后四级驱动信号ST[n+4]，晶体管T33的第二端接收第一低电压VSS0。当后四级驱动信号ST[n+4]为高电平时，则晶体管T33会导通，以通过第一低电压VSS0拉低端点电压Q[n]；当后四级驱动信号ST[n+4]为低电平时，则晶体管T33会截止(不导通)，则端点电压Q[n]与第一低电压VSS0无关。
晶体管T34的第一端耦接内部端点Nix，晶体管T34的控制端接收后二级驱动信号ST[n+2]。晶体管T35的第一端及控制端耦接晶体管T34的第二端，晶体管T35的第二端接收第一低电压VSS0。另外，晶体管T36的第一端接收当级驱动信号ST[n]，晶体管T36的控制端接收后二级驱动信号ST[n+2]，晶体管T36的第二端接收第一低电压VSS0。晶体管T37的第一端接收当级栅极信号G[n]，晶体管T37的控制端接收后二级驱动信号ST[n+2]，晶体管T37的第二端接收第二低电压VSS1。
当后二级驱动信号ST[n+2]为高电平时，则晶体管T34～T37会同时导通，以通过第一低电压VSS0及第二低电压VSS1分别拉低端点电压Q[n]、当级栅极信号G[n]及当级驱动信号ST[n]；当后二级驱动信号ST[n+2]为低电平时，则晶体管T34～T37会截止(不导通)，此时端点电压Q[n]、当级栅极信号G[n]及当级驱动信号ST[n]的电平与第一低电压VSS0及第二低电压VSS1无关。
于图3的实施例中，第二低电压VSS1不同于第一低电压VSS0。举例来说，第二低电压VSS1可小于第一低电压VSS0，此可依据电路设计而定，本发明实施例不以此为限。并且，通过提供多个不同电压电平的低电压，可避免晶体管处于负临界电压时部分的晶体管仍然正常运作。
图4为依据本发明一实施例的触控显示装置的系统示意图。请参照图4，在本实施例中，触控显示装置400包括触控显示面板405及数据驱动电路430，其中，触控显示面板405包括显示面板、触控层(未绘示)与栅极电路411。显示面板具有主动区AA与周边区PH，而触控层设置于主动区AA，栅极电路411设置于周边区PH。于本实施例中，显示面板亦包含多个像素P、多个栅极线413及多个驱动线415，其中多个像素P位于主动区AA，可用来显示影像与触控感测所使用，且多个像素P可排列为阵列、蜂窝等形状以展现影像与感测的不同解析度，但本发明不以此为限。栅极电路411则包含多级的移位暂存器SR，每级移位暂存器SR可输出当级栅极信号(如G[1]～G[m])与当级驱动信号(如ST[1]～ST[m])，且分别通过栅极线413与驱动线415而传递于像素P。于本实施例中，移位暂存器SR可参照图1至图3所示移位暂存器100、200及300。
详言之，移位暂存器SR可接收触控致能信号TP_EN与时脉信号HC1，进而输出对应的栅极信号与驱动信号，如栅极信号G[1]～G[m]及驱动信号ST[1]～ST[m]，其中m为正整数。于本实施例中，数据驱动电路430位于周边区PH，且耦接于各像素P。当触控显示装置400于显示模式时，则通过栅极电路411启动各像素P，且藉由数据驱动电路430输入像素数据于各像素P，进而显示影像。当触控显示装置400于触控模式时，则触控致能信号TP_EN会分别致能栅极电路411与数据驱动电路430，进而使各像素P感测触控信号。于本实施例的栅极电路411中，移位暂存器SR包含第一补偿晶体管TC1与第二补偿晶体管TC2，且第一补偿晶体管TC1与第二补偿晶体管TC2皆接收触控致能信号TP_EN。如此一来，于触控模式时，受到触控致能信号TP_EN的致能影响(如:触控致能信号TP_EN为高电平)，使得移位暂存器SR的端点电压Q能持续为充电状态。因此，当进入显示模式中，移位暂存器SR输出的栅极信号G[n]能避免失误或漏电，确保触控显示装置400能够正常显示影像。于本实施例中，触控致能信号TP_EN可由控制电路所提供，例如时序控制器。于图4的实施例中，栅极电路411位于主动区AA的单一侧边，即为单边驱动。但本发明不以此为限，可依不同驱动需求来安排，如栅极电路411位于主动区的相对两侧边，形成双边驱动。
综上所述，本发明实施例的移位暂存器及其触控显示装置，在触控显示面板进行扫描时，第一补偿晶体管及第二补偿晶体管会导通，以对端点电压进行充电。藉此，可避免端点电压因时间而衰减，进而避免无法正常运作。
虽然本发明已以实施例揭露如上，然其并非用以限定本发明，任何所属技术领域中具有通常知识者，在不脱离本发明的精神和范围内，当可作些许的更动与润饰，故本发明的保护范围当视后附的申请专利范围所界定者为准。

Claims (10)

1.一种移位暂存器，应用于触控显示面板，其特征在于，包括：
一电压设定单元，接收一第一栅极参考信号，以设定一内部端点的一端点电压；
一驱动单元，耦接该内部端点，而该驱动单元接收该端点电压及一时脉信号，以提供一栅极信号及一驱动信号；
一第一控制单元，耦接该内部端点，接收一第一低频时脉信号、该端点电压及一低电压，以提供一第一控制信号；
一放电单元，耦接该第一控制单元以接收该第一控制信号，并且依据该第一控制信号对该端点电压及该栅极信号进行放电；
一第一补偿晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收一触控致能信号，该控制端则耦接该内部端点；以及
一第二补偿晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接于该第一补偿晶体管的该第二端，该控制端接收该触控致能信号，而该第二端则耦接于该内部端点；
其中，当该触控显示面板进行扫描时，致能该触控致能信号，该端点电压为高电平，该第一补偿晶体管及该第二补偿晶体管导通，以对该端点电压进行充电。
2.如权利要求1所述的移位暂存器，其特征在于，该驱动单元包括：
一第一驱动晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该时脉信号，该控制端接收该端点电压，该第二端提供该栅极信号；以及
一第二驱动晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该时脉信号，该控制端接收该端点电压，该第二端提供该驱动信号。
3.如权利要求1所述的移位暂存器，其特征在于，该电压设定单元包括：
一第一晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该第一栅极参考信号，该控制端接收一第一驱动参考信号；
一第二晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接该第一晶体管的该第二端，该控制端接收该第一驱动参考信号，该第二端耦接该内部端点；以及
一第三晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该第一晶体管的该第二端，该控制端及该第二端接收该触控致能信号。
4.如权利要求1所述的移位暂存器，其特征在于，该放电单元包括：
一第四晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接该内部端点，该控制端接收该第一控制信号，该第二端接收该驱动信号；
一第五晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该驱动信号，该控制端接收该第一控制信号，该第二端接收该低电压；以及
一第六晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该栅极信号，该控制端接收该第一控制信号，该第二端接收该低电压。
5.如权利要求4所述的移位暂存器，其特征在于，该放电单元更包括：
一第七晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接该内部端点，该控制端接收一第二驱动参考信号；
一第八晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该第七晶体管的该第二端，该控制端接收该第二驱动参考信号，该第二端接收该低电压；
一第九晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接该第七晶体管的该第二端，该控制端及该第二端接收该触控致能信号；以及
一第十晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该栅极信号，该控制端接收该第二驱动参考信号，该第二端接收该低电压。
6.如权利要求5所述的移位暂存器，其特征在于，该放电单元更包括：
一第十一晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该栅极信号，该控制端接收该触控致能信号，该第二端接收该低电压；以及
一第十二晶体管，具有一第一端、一控制端及一第二端，其中该第一端接收该驱动信号，该控制端接收该触控致能信号，该第二端接收该低电压。
7.如权利要求1所述的移位暂存器，其特征在于，更包括一第二控制单元，耦接该内部端点，接收一第二低频时脉信号、该端点电压及该低电压，以提供一第二控制信号。
8.如权利要求7所述的移位暂存器，其特征在于，该第二低频时脉信号为该第一低频时脉信号的反相信号。
9.一种触控显示装置，其特征在于，包含：
一显示面板，具有一主动区与一周边区；
一触控层，位于该主动区；以及
多级的移位暂存器，位于该周边区，且耦接于该显示面板，其中每级的移位暂存器可接收一触控致能信号与一第一时脉信号，且可输出一当级栅极信号与一当级驱动信号，每级的移位暂存器更包含：
一电压设定单元，分别耦接于一前二级栅极信号与一前两级驱动信号；
一驱动单元，耦接该第一时脉信号，且输出该当级栅极信号与该当级驱动信号，其中该电压设定单元与该驱动单元通过一内部端点而耦接；
一控制单元，耦接于该内部端点，且输出一控制信号；
一放电单元，分别耦接于该内部端点、该控制单元与该驱动单元，且接收该控制信号；
一第一补偿晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接该触控致能信号，该控制端则耦接该内部端点；以及
一第二补偿晶体管，具有一第一端、一控制端及一第二端，其中该第一端耦接于该第一补偿晶体管的该第二端，该控制端耦接该触控致能信号，而该第二端则耦接于该内部端点；
其中，当该触控显示装置进行扫描时，致能该触控致能信号，该端点电压为高电平，该第一补偿晶体管及该第二补偿晶体管导通，以对该端点电压进行充电。
10.如权利要求9所述的触控显示装置，其特征在于，该电压设定单元包含：
一第一晶体管，具有一第一端、一第二端与一控制端，其中该第一端耦接于该前二级栅极信号，该控制端耦接于该前两级驱动信号；
一第二晶体管，具有一第一端、一第二端与一控制端，其中该第一端耦接于该第一晶体管的该第二端，该第二端耦接于该内部端点，该控制端耦接于该前两级驱动信号；以及
一第三晶体管，具有一第一端、一第二端与一控制端，其中该第一端耦接于该第一晶体管的该第二端，该第二端与该控制端分别耦接于该触控致能信号。
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