CN107210291B - 半导体装置 - Google Patents

半导体装置 Download PDF

Info

Publication number
CN107210291B
CN107210291B CN201680007637.0A CN201680007637A CN107210291B CN 107210291 B CN107210291 B CN 107210291B CN 201680007637 A CN201680007637 A CN 201680007637A CN 107210291 B CN107210291 B CN 107210291B
Authority
CN
China
Prior art keywords
circuit substrate
substrate
semiconductor element
semiconductor device
housing component
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201680007637.0A
Other languages
English (en)
Other versions
CN107210291A (zh
Inventor
梶勇辅
三村研史
原田耕三
殷晓红
原田启行
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Publication of CN107210291A publication Critical patent/CN107210291A/zh
Application granted granted Critical
Publication of CN107210291B publication Critical patent/CN107210291B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/07—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
    • H01L25/072—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00 the devices being arranged next to each other
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/02—Containers; Seals
    • H01L23/04—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls
    • H01L23/053—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having an insulating or insulated base as a mounting for the semiconductor body
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001—Core members of the connector
    • H01L2224/4501—Shape
    • H01L2224/45012—Cross-sectional shape
    • H01L2224/45014—Ribbon connectors, e.g. rectangular cross-section
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001—Core members of the connector
    • H01L2224/4501—Shape
    • H01L2224/45012—Cross-sectional shape
    • H01L2224/45015—Cross-sectional shape being circular
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001—Core members of the connector
    • H01L2224/45099—Material
    • H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/45124—Aluminium (Al) as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001—Core members of the connector
    • H01L2224/45099—Material
    • H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45144—Gold (Au) as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805—Shape
    • H01L2224/4809—Loop shape
    • H01L2224/48091—Arched
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42—Wire connectors; Manufacturing methods related thereto
    • H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481—Disposition
    • H01L2224/48135—Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/48137—Connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being arranged next to each other, e.g. on a common substrate
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732—Location after the connecting process
    • H01L2224/73251—Location after the connecting process on different surfaces
    • H01L2224/73265—Layer and wire connectors
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838—Bonding techniques
    • H01L2224/83801—Soldering or alloying
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H01L2224/852—Applying energy for connecting
    • H01L2224/85201—Compression bonding
    • H01L2224/85205—Ultrasonic bonding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H01L2224/858—Bonding techniques
    • H01L2224/85801—Soldering or alloying
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
    • H01L2224/92—Specific sequence of method steps
    • H01L2224/922—Connecting different surfaces of the semiconductor or solid-state body with connectors of different types
    • H01L2224/9222—Sequential connecting processes
    • H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
    • H01L2224/92247—Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00—Details of semiconductor or other solid state devices
    • H01L23/16—Fillings or auxiliary members in containers or encapsulations, e.g. centering rings
    • H01L23/18—Fillings characterised by the material, its physical or chemical properties, or its arrangement within the complete device
    • H01L23/24—Fillings characterised by the material, its physical or chemical properties, or its arrangement within the complete device solid or gel at the normal operating temperature of the device
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42—Wire connectors; Manufacturing methods related thereto
    • H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/73—Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/18—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001—Technical content checked by a classifier
    • H01L2924/00014—Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181—Encapsulation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191—Disposition
    • H01L2924/19101—Disposition of discrete passive components
    • H01L2924/19107—Disposition of discrete passive components off-chip wires

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Abstract

半导体装置(1)主要具备半导体元件基板(3)、半导体元件(13)、壳体件(15)以及密封树脂(29)。在半导体元件基板(3)中，在基底板(5)的表面隔着绝缘基板(7)配置有导电性的第1电路基板(9)。在壳体件(15)设置有从内壁向着配置有半导体元件(13)的一侧突出的电路基板台(17)和电极端子(19)。在电路基板台(17)直接安装有导电性的第2电路基板(21)。电极端子(19)与第2电路基板(21)通过布线(25)电连接，第2电路基板(21)与半导体元件(13)通过布线(27)电连接。

Description

半导体装置
技术领域
本发明涉及半导体装置，特别是涉及用密封树脂密封功率用的半导体元件的半导体装置。
背景技术
随着产业设备、铁路车辆或者汽车等的高性能化，使用搭载于它们的半导体装置的状态的温度(使用温度)有上升的倾向。近年来，半导体元件的小型化、高耐压化、高电流密度化得以发展，对于与此相伴的半导体元件的高温工作的开发正在加速。特别是，碳化硅(SiC)或者氮化镓(GaN)等宽带隙半导体与硅(Si)半导体相比带隙大，作为适合于近年来半导体元件的开发的材料而受到关注。
为了将能够进行高温工作的半导体元件装置化为半导体装置，需要即使半导体元件在150℃以上的高温下工作时，也要抑制密封树脂与其它部件的剥离以及绝缘基板的裂纹等，从而稳定地确保绝缘性。以往，提出了抑制这样的剥离以及裂纹等的方法。
例如，在专利文献1中提出了如下方法：用线膨胀率低的高耐热密封树脂来密封芯片的周边，用抗氧化劣化性优良的密封材料覆盖半导体装置的表面，从而提高芯片的周边以及模块的可靠性。另外，在专利文献2中提出了如下方法：与搭载有半导体元件的第1绝缘基板独立地，在构成半导体装置的壳体部件的部分搭载通过焊接固定有电阻元件的第2绝缘基板，从而抑制焊料由于从半导体元件产生的热而产生裂纹等。此外，还存在专利文献3。
现有技术文献
专利文献
专利文献1：日本特开2014－146774号公报
专利文献2：日本特开2007－329387号公报
专利文献3：日本特开平11－74433号公报
发明内容
发明所要解决的技术问题
如上所述，用密封树脂密封功率用的半导体元件的半导体装置要求即使在高温下工作的状态也稳定地确保绝缘性。
本发明是作为这样的开发的一环而完成的，其目的在于提供在较高温下也能够稳定地确保绝缘性的半导体装置。
解决技术问题的技术方案
本发明的半导体装置具备半导体元件基板、半导体元件、壳体件、电路基板台、导电性的第2电路基板、电极端子、布线以及密封材料。半导体元件基板包括基底板、配置于基底板的表面的绝缘基板以及配置于绝缘基板的表面的导电性的第1电路基板。半导体元件安装于半导体元件基板的第1电路基板。壳体件以包围半导体元件的方式装配于半导体元件基板。电路基板台设置于壳体件，以向着半导体元件位于的内侧突出的形态配置于与绝缘基板不同的高度位置。导电性的第2电路基板直接配置于电路基板台的表面。电极端子装配于壳体件。布线经由第2电路基板将半导体元件与电极端子电连接。密封材料被填充到由壳体件包围的区域，密封半导体元件、电路基板台以及布线。
发明效果
根据本发明的半导体装置，导电性的第2电路基板被直接配置于在与绝缘基板不同的高度位置配置的电路基板台。由此，当在高温下工作的状态下，即使在密封材料与第2电路基板的界面产生剥离，该剥离也不会到达配置有第1电路基板的绝缘基板，绝缘基板不会产生裂纹。其结果是，能够稳定地确保半导体装置的绝缘性。
附图说明
图1是本发明的实施方式1的半导体装置的俯视图。
图2是在该实施方式中图1所示的剖面线II－II处的剖视图。
图3是比较例的半导体装置的剖视图。
图4是用于说明图3所示的半导体装置的问题点的部分放大剖视图。
图5是用于说明在该实施方式中半导体装置的作用效果的部分放大剖视图。
图6是本发明的实施方式2的半导体装置的俯视图。
图7是在该实施方式中图6所示的剖面线VII－VII处的剖视图。
图8是本发明的实施方式3的半导体装置的俯视图。
图9是在该实施方式中图8所示的剖面线IX－IX处的剖视图。
图10是示出在该实施方式中填充有密封树脂的情形的部分放大剖视图。
图11是本发明的实施方式4的半导体装置的俯视图。
图12是在该实施方式中图11所示的剖面线XII－XII处的剖视图。
图13是在实施方式3中第1变形例的半导体装置的剖视图。
图14是在实施方式3中第2变形例的半导体装置的剖视图。
(符号说明)
1半导体装置；3半导体元件基板；5基底板；7绝缘基板；9第1电路基板；11粘合剂；13半导体元件；15壳体件；17电路基板台；18倾斜部；19电极端子；21第2电路基板；23粘接件；25布线；27布线；29密封树脂、31间隙。
具体实施方式
实施方式1
对实施方式1的半导体装置进行说明。该半导体装置是半导体功率模块。半导体功率模块广泛用于例如以家电设备以及汽车等为代表的进行电力控制的设备。
如图1以及图2所示，半导体装置1主要具备半导体元件基板3、半导体元件13、壳体件15以及密封树脂29。
在半导体元件基板3中，在基底板5的表面隔着绝缘基板7配置有导电性的第1电路基板9。作为绝缘基板7，使用例如陶瓷基板或者氮化铝等。作为第1电路基板9，使用例如对一张铜板实施基于半导体元件的布局等的规定的构图而得到的基板。
半导体元件13通过例如焊料等粘合剂11被安装于第1电路基板9。作为半导体元件13，例如形成并联连接于功率用半导体元件的回流二极管。在半导体装置1中，搭载有多个并联连接于功率用半导体元件的半导体元件13。
壳体件15通过粘接剂23被固定于半导体元件基板3。将从内壁向配置有半导体元件13的一侧突出的电路基板台17设置于壳体件15。该电路基板台17被配置于比绝缘基板7高的位置。另外，电路基板台17与壳体件15一体地形成。导电性的第2电路基板21被直接安装于电路基板台17。作为第2电路基板21，使用例如实施了规定的构图的铜板。另外，将铜的电极端子19设置于壳体件15。
电极端子19与第2电路基板21通过布线25电连接。另外，第2电路基板21与半导体元件13通过布线27电连接。这样，多个半导体元件13分别经由第2电路基板21电连接于电极端子19。
对直接安装有第2电路基板21的电路基板台17，设定足以安装第2电路基板21的宽度L1、长度L2以及厚度T1。宽度L1是沿着壳体件15的内壁的长度，设定为例如10mm～100mm。如果宽度L1窄于10mm，则不够安装第2电路基板21。另一方面，如果宽度L1超过100mm，则有可能成为填充密封树脂2时的障碍。
长度L2是从壳体件15的内壁突出的长度，设定为例如5mm～20mm。如果长度L2短于5mm，则不够安装第2电路基板21。另一方面，如果长度L2超过20mm，则有可能成为填充密封树脂2时的障碍。厚度T1设定为例如1mm～10mm。如果厚度T1薄于1mm，则机械强度不够。另一方面，如果厚度T1超过10mm，则会过厚而不合适。
另外，电路基板台17与绝缘基板7之间的高度方向的距离H1设定为例如3mm～10mm。如果距离H1短于3mm，则在填充密封树脂29时，密封树脂29有可能被填充得不够。另一方面，如果距离H1超过10mm，则有可能无法可靠地密封第2电路基板21等。
作为第1电路基板9、第2电路基板21以及电极端子19各自的材料，虽然例举了通常使用的铜(铜板)，但只要是具有所需的散热特性的材料，则不限于铜。例如，也可以使用铝(Al)、铁(Fe)或者将铝与铁复合而成的材料。另外，也可以使用铜/殷钢(inver)/铜等的复合材料。进一步地，也可以使用铝－碳化硅合金(AlSiC)或者铜－钼合金(CuMo)等合金。
对第1电路基板9以及第2电路基板21等的表面通常实施镀镍(Ni)，但只要是能够将所需的电流与电压供给到半导体元件13的构造，则既可以实施镀敷，也可以不实施镀敷。在实施镀敷的情况下，除镀镍之外，还可以实施例如镀金或者镀锡。
另外，在电极端子19、第1电路基板9以及第2电路基板21各自的与密封树脂29接触的部分，为了提高与密封树脂29的密合性，也可以在电极端子19、第1电路基板9以及第2电路基板21各自的表面设置微小的凹凸。或者，也可以进行底漆处理(primer treatment)等将密合性提高剂涂敷到电极端子19、第1电路基板9以及第2电路基板21各自的表面。作为密合性提高剂，使用例如硅烷偶联剂、聚酰亚胺或者环氧树脂等，但只要能够提高半导体元件基板3的电极部件与密封树脂29的密合性，则不限于这些。
绝缘基板7被设为使散布有氧化铝(Al2O3)、二氧化硅(SiO2)、氮化铝(AlN)、氮化硼(BN)、氮化硅(Si3N4)等陶瓷粉的树脂硬化而成的树脂硬化物基板。关于半导体元件基板3，将第1电路基板9粘附到这样的绝缘基板7的一个表面，将基底板5粘附到另一表面。
半导体元件基板3由于需要具备散热性和绝缘性，所以也可以使用如下半导体元件基板：作为绝缘基板7，使用将陶瓷板嵌入到树脂而得的树脂硬化物基板或者仅由陶瓷构成的绝缘基板，将第1电路基板粘附到该绝缘基板的一个表面，将基底板粘附到另一表面。
另外，作为绝缘基板7中包括的陶瓷粉，虽然例举了氧化铝(Al2O3)、二氧化硅(SiO2)、氮化铝(AlN)、氮化硼(BN)、氮化硅(Si3N4)等，但不限于此，也可以使用例如金刚石(C)、碳化硅(SiC)、氧化硼(B2O3)等。
除陶瓷粉之外，例如也可以使用硅树脂或者丙烯酸树脂等树脂制的粉体。在粉体的情况下，多使用形状为球状的粉体，但不限于此，也可以使用例如粉碎状、粒状、鳞状、聚集体等粉体。另外，作为粉体的填充量，对绝缘基板7填充能够得到所需的散热性和绝缘性的量即可。
作为用于绝缘基板7的树脂，通常使用环氧树脂，但不限于此。除此之外，也可以使用例如聚酰亚胺树脂、硅树脂或者丙烯酸树脂等，只要是兼具绝缘性与粘接性的材料的树脂即可。
作为用于基底板5的材料，通常使用铜(Cu)或者铝(Al)等金属，但不限于此。除此之外，例如也可以使用铝－碳化硅合金(AlSiC)或者铜－钼合金(CuMo)等合金。另外，作为基底板5的材料，也可以使用环氧树脂、聚酰亚胺树脂或者丙烯酸树脂等有机材料。
作为布线25、27，使用由铝或者金形成的剖面形状为圆形的线体，但不限于此。除圆形的线体之外，例如也可以使用将剖面形状是方形(矩形)的铜板做成带状而得到的线体。此外，在图1中，示出对一个半导体元件13连接有1根布线27的构造，但这只不过是为了方便进行与布线25、27相关的说明而简略示出的，在实际的半导体装置1中，会根据半导体元件13的电流密度等来设置所需根数的布线。
在布线27与半导体元件13的接合中，能够使用使铜或者锡等金属片熔融而接合的熔融接合或者施加超声波的超声波接合等，只要是能够将所需的电流与电压供给到半导体元件的接合方法即可。
作为密封树脂29的材料，使用例如环氧树脂，但不限于此，只要是具有期望的弹性率与耐热性的树脂，就能够用作密封树脂的材料。除环氧树脂之外，也可以使用例如硅树脂、聚氨酯树脂、聚酰亚胺树脂、聚酰胺树脂、聚酰胺酰亚胺树脂或者丙烯酸树脂等，只要是兼具绝缘性与粘接性的材料即可。
在上述半导体装置1中，安装于第1电路基板9的半导体元件13与电极端子19通过布线27、25经由第2电路基板21电连接。该第2电路基板21直接安装于壳体件15的电路基板台17。由此，能够更稳定地确保绝缘性。对于这点，与比较例的半导体装置对比地进行说明。
如图3所示，比较例的半导体装置101主要具备半导体元件基板103、半导体元件113、壳体件115以及密封树脂129。在半导体元件基板103中，隔着绝缘基板107将第1电路基板109配置于基底板105的表面。将第2电路基板121配置于绝缘基板107的表面。半导体元件113通过焊料等粘合剂111安装于第1电路基板9。
壳体件115通过粘接剂123固定于半导体元件基板103。电极端子119被安装于壳体件115。电极端子119与第2电路基板121通过布线125电连接，第2电路基板121与半导体元件113通过布线127电连接。在壳体件115的内侧区域填充有密封树脂129以密封半导体元件113以及布线125、127等。
在比较例的半导体装置101中，半导体元件113通过布线127、125经由第2电路基板121电连接于电极端子119。作为其电中继点的第2电路基板121被配置于配置有第1电路基板109的绝缘基板107的规定区域。
作为中继点的第2电路基板121的面积小于安装有半导体元件113的第1电路基板109的面积。因此，密封树脂129与第1电路基板109的接触面积较大，相对于此，密封树脂129与第2电路基板121的接触面积较小。
如果接触面积小，则与密封树脂129的粘接强度也变低。在此，如图4所示，当在粘接强度低的密封树脂129与第2电路基板121的界面产生剥离时，由于伴随着热循环或者高温保存的热历程，密封树脂129反复膨胀与收缩，从而剥离131有时会到达绝缘基板107。
进一步地，如果密封树脂129的膨胀与收缩反复发生，则会从剥离到达的绝缘基板107的部分开始在绝缘基板107中产生裂纹133，最终在半导体装置101产生绝缘不良。
相对于比较例，在上述半导体装置1中，如图1或者图2所示，第2电路基板21被直接安装于从壳体件15的内壁突出的电路基板台17。因此，如图5所示，即使在密封树脂29与第2电路基板21的界面产生剥离31，由于密封树脂29反复膨胀与收缩，该剥离31也会达到电路基板台17。由此，在第2电路基板21与密封树脂29的界面产生的剥离31不会使绝缘基板7产生裂纹。其结果是，能够可靠地抑制在半导体装置1产生绝缘不良。
特别是，在应用宽带隙半导体的在150℃以上的温度下工作的半导体装置中，在工作时，密封树脂中产生的应力较大，容易产生剥离，所以通过做成将第2电路基板21直接安装于电路基板台17的构造，能够稳定地确保半导体装置的绝缘性。
此外，在不是将第2电路基板21直接安装于电路基板台17的构造、而是使其它绝缘基板夹在第2电路基板与电路基板台17之间来安装的构造(未图示)中，与对于比较例的半导体装置所说明的同样地，设想为从剥离所到达的其它绝缘基板的部分开始在其它绝缘基板中产生裂纹，最终产生绝缘不良。
另外，第2电路基板21被安装于从壳体件15的内壁向搭载有半导体元件13的一侧突出的电路基板台17。由此，将半导体元件13与第2电路基板21电连接的布线27的长度较短就行，能够有助于使布线的寿命变长。
这样，在实施方式的半导体装置1中，能够抑制绝缘不良，并且能够延长布线的寿命，能够进一步提高作为半导体装置的可靠性。
实施方式2
在此，对将电路基板台配置为跨接相互对置的壳体件的内壁间的半导体装置进行说明。
如图6以及图7所示，半导体装置1主要具备半导体元件基板3、半导体元件13、壳体件15以及密封树脂29。特别是，在壳体件15，桥接构造的电路基板台17被设置为跨接相互对置的一个内壁和另一内壁。该电路基板台17配置于比绝缘基板7高的位置。另外，电路基板台17与壳体件15一体地形成。第2电路基板21被直接安装于该电路基板台17。此外，关于这以外的结构，与图1以及图2所示的半导体装置相同，所以，对同一部件附加同一符号，除必要的情况之外不重复进行其说明。
对直接安装有第2电路基板21的桥接构造的电路基板台17，设定足以安装第2电路基板21的宽度L3与厚度T2。宽度L3例如设定为5mm～30mm。如果宽度L3窄于5mm，则不够安装第2电路基板21。另一方面，如果宽度L3超过30mm，则有可能成为填充密封树脂2时的障碍。
厚度T2例如设定为1mm～10mm。如果厚度T2薄于1mm，则机械强度不够。另一方面，如果厚度T2超过10mm，则会过厚而不合适。
另外，电路基板台17与绝缘基板7之间的高度方向的距离H2例如设定为3mm～10mm。如果距离H2短于3mm，则在填充密封树脂29时，密封树脂29有可能被填充得不够。另一方面，如果距离H2超过10mm，则有可能无法可靠地密封第2电路基板21等。
在上述半导体装置1中，第2电路基板21直接安装于设置为跨接壳体件15的相互对置的一个内壁与另一内壁的桥接构造的电路基板台17。因此，即使在密封树脂29与第2电路基板21的界面产生剥离(未图示)，由于密封树脂29反复膨胀与收缩，该剥离也达到电路基板台17。由此，在第2电路基板21与密封树脂29的界面产生的剥离不会使绝缘基板7产生裂纹。其结果是，能够可靠地抑制在半导体装置1产生绝缘不良，能够稳定地确保半导体装置的绝缘性。
另外，电路基板台17是桥接构造，从而容易使电路基板台17处的第2电路基板21的位置接近于半导体元件13。由此，将半导体元件13与第2电路基板21电连接的布线27的长度较短就行，能够有助于延长布线的寿命。
进一步地，通过使桥接构造的电路基板台17配置于壳体件15的中央附近，从而第2电路基板21被配置于与半导体装置1的外周部分隔开距离的位置，能够使第2电路基板21中产生的应力降低。由此，能够抑制在密封树脂29与第2电路基板21的界面产生剥离。
实施方式3
在此，对将倾斜部设置于电路基板台的半导体装置的第1例进行说明。
如图8以及图9所示，半导体装置1主要具备半导体元件基板3、半导体元件13、壳体件15以及密封树脂29。特别是，设置于壳体件15的电路基板台17具备倾斜部18。在电路基板台17，倾斜部18形成于与绝缘基板7对置的下表面侧。
第2电路基板21被直接安装于该电路基板台17。此外，对于这以外的结构，与图1以及图2所示的半导体装置相同，所以对同一部件附加同一符号，除必要的情况之外不重复进行其说明。
接下来，对形成有倾斜部18的电路基板台17具体进行说明。首先，与对图1以及图2所示的半导体装置说明的同样地，对电路基板台17设定足以安装第2电路基板21的宽度L1以及长度L2。宽度L1是沿着壳体件15的内壁的长度，例如设定为10mm～100mm。如果宽度L1窄于10mm，则不够安装第2电路基板21。另一方面，如果宽度L1超过100mm，则有可能成为填充密封树脂2时的障碍。
长度L2是从壳体件15的内壁突出的长度，例如设定为5mm～20mm。如果长度L2短于5mm，则不够安装第2电路基板21。另一方面，如果长度L2超过20mm，则有可能成为填充密封树脂2时的障碍。
另外，电路基板台17的内侧端部与绝缘基板7之间的高度方向的距离H1例如设定为3mm～10mm。如果距离H1短于3mm，则在填充密封树脂29时，密封树脂29有可能被填充得不够。另一方面，如果距离H1超过10mm，则有可能无法可靠地密封第2电路基板21等。
接下来，对倾斜部18进行说明。倾斜部18以从电路基板台17的突出前端部向着壳体件15而接近绝缘基板7的形态倾斜。倾斜部18相对于绝缘基板7以5°以上的倾角θ倾斜。
在此，如果将电路基板台17的长度L2设为20mm(容许最大值)，将距离H1设为3mm(容许最小值)，则最小的倾角θ为约8.5°。如果该倾角θ进一步地变小而变成小于5°的倾角θ，则在电路基板台17与绝缘基板7之间，密封树脂29有可能被填充得不够。因此，倾斜部18的倾角θ最好在5°以上。
在上述半导体装置中，除使绝缘基板7不产生裂纹的效果之外，还得到如下的效果。
在电路基板台17设置有以从电路基板台17的突出端部向着壳体件15而接近绝缘基板7的形态倾斜的倾斜部18。通过如图10所示设置倾斜部18，密封树脂29容易流入到电路基板台17与绝缘基板7之间的较窄的空间(参照箭头)。
由此，抑制由于未被充分填充密封树脂并在半导体装置内部残留气泡而在半导体装置的工作中发生放电。其结果是，能够更加稳定地确保半导体装置1的绝缘性。
实施方式4
在此，对在电路基板台设置有倾斜部的半导体装置的第2例进行说明。
如图11以及图12所示，半导体装置1主要具备半导体元件基板3、半导体元件13、壳体件15以及密封树脂29。特别是，设置于壳体件15的桥接构造的电路基板台17具备倾斜部18。在电路基板台17，倾斜部18形成于与绝缘基板7对置的下表面侧。
第2电路基板21被直接安装于该电路基板台17。此外，对于这以外的结构，与图6以及图7所示的半导体装置相同，所以，对同一部件附加同一符号，除必要的情况之外不重复进行其说明。
接下来，对形成有倾斜部18的桥接构造的电路基板台17具体进行说明。首先，与对于图6以及图7所示的半导体装置所说明的同样地，对电路基板台17设定足以安装第2电路基板21的宽度L3。宽度L3例如设定为5mm～30mm。如果宽度L3窄于5mm，则不够安装第2电路基板21。另一方面，如果宽度L3超过30mm，则有可能成为填充密封树脂2时的障碍。
另外，电路基板台17与绝缘基板7之间的高度方向的距离H2例如设定为3mm～10mm。如果距离H2短于3mm，则在填充密封树脂29时，密封树脂29有可能被填充得不够。另一方面，如果距离H2超过10mm，则有可能无法可靠地密封第2电路基板21等。
接下来，对倾斜部18进行说明。倾斜部18以从桥接构造的电路基板台17中的与壳体件15隔开距离的规定位置向着壳体件15而接近绝缘基板7的形态倾斜。倾斜部18相对于绝缘基板7以5°以上的倾角θ倾斜。与上述同样地，如果该倾角θ小于5°，则在电路基板台17与绝缘基板7之间，密封树脂29有可能被填充得不够。因此，倾斜部18的倾角θ最好在5°以上。
在上述半导体装置中，除使绝缘基板7不产生裂纹的效果之外，还能够得到如下的效果。
在电路基板台17，以从桥接构造的电路基板台17的规定位置向着壳体件15而绝缘基板7与电路基板台17之间的距离(高度)逐渐变短的形态设置倾斜部18。通过设置倾斜部18，密封树脂29容易流入到电路基板台17与绝缘基板7之间的较窄的空间。
由此，抑制由于未充分地填充密封树脂并在半导体装置内部残留气泡而在半导体装置的工作中发生放电。其结果是，能够更加稳定地确保半导体装置1的绝缘性。
此外，在图9或者图12中示出了倾斜部18的倾斜面平坦的情况，但只要倾角θ在5°以上，则倾斜面也可以是曲面，例如，如图13所示，也可以是凹面(向上凸)。另外，如图14所示，也可以是凸面(向下凸)。进一步地，对于桥接构造的电路基板台17的倾斜部18的倾斜面，也同样地可以设为凹面或者凸面(未图示)。
此外，在上述各实施方式中，以一体地形成电路基板台17与壳体件15的情况为例进行了说明。作为电路基板台，不限于此，例如，也可以将用与壳体件15相同的材料另行形成的电路基板台固定于壳体件。
对于在各实施方式中说明的半导体装置，根据需要能够进行各种组合，例如也可以将沿着壳体件15的内壁配置的电路基板台和桥接构造的电路基板组合。
本次公开的实施方式是示例，并非限制于此。本发明不通过上述说明的范围而是通过权利要求书来表示，旨在包括与权利要求书等同的含义以及范围内的全部变更。
产业上的可利用性
本发明能够有效地用于由密封树脂密封功率用的半导体元件的半导体装置。

Claims (16)

1.一种半导体装置，具备：
半导体元件基板，包括基底板、配置于所述基底板的表面的绝缘基板以及配置于所述绝缘基板的表面的导电性的第1电路基板；
半导体元件，安装于所述半导体元件基板的所述第1电路基板；
壳体件，以包围所述半导体元件的方式装配于所述半导体元件基板；
电路基板台，设置于所述壳体件，以向着所述半导体元件位于的内侧突出的形态配置于与所述绝缘基板不同的高度位置；
导电性的第2电路基板，直接配置于所述电路基板台的表面；
电极端子，装配于所述壳体件；
布线，将所述半导体元件、所述第2电路基板和所述电极端子按照所述半导体元件、所述第2电路基板以及所述电极端子的顺序电连接；以及
密封材料，被填充到由所述壳体件包围的区域，密封所述半导体元件、所述电路基板台以及所述布线。
2.根据权利要求1所述的半导体装置，其中，
所述电路基板台沿着所述壳体件的内壁配置。
3.根据权利要求2所述的半导体装置，其中，
所述电路基板台的沿着所述内壁的长度被设定为10mm以上且100mm以下，所述电路基板台的从所述内壁突出的长度被设定为5mm以上且20mm以下，所述电路基板台的厚度被设定为1mm以上且10mm以下。
4.根据权利要求1所述的半导体装置，其中，
所述绝缘基板与所述电路基板台之间的高度方向的距离被设定为3mm以上且10mm以下。
5.根据权利要求1所述的半导体装置，其中，
所述电极端子的水平部分和所述第2电路基板的高度不同。
6.根据权利要求2所述的半导体装置，其中，
在所述电路基板台的与所述绝缘基板对置的一侧设置有以从所述电路基板台的突出前端部向着所述壳体件而接近所述绝缘基板的形态倾斜的倾斜部。
7.根据权利要求6所述的半导体装置，其中，
所述倾斜部相对于所述绝缘基板的倾角为5°以上。
8.一种半导体装置，具备：
半导体元件基板，包括基底板、配置于所述基底板的表面的绝缘基板以及配置于所述绝缘基板的表面的导电性的第1电路基板；
半导体元件，安装于所述半导体元件基板的所述第1电路基板；
壳体件，以包围所述半导体元件的方式装配于所述半导体元件基板；
电路基板台，设置于所述壳体件，以向着所述半导体元件位于的内侧突出的形态配置于与所述绝缘基板不同的高度位置；
导电性的第2电路基板，直接配置于所述电路基板台的表面；
电极端子，装配于所述壳体件；
布线，经由所述第2电路基板将所述半导体元件和所述电极端子电连接；以及
密封材料，被填充到由所述壳体件包围的区域，密封所述半导体元件、所述电路基板台以及所述布线，其中，
所述电路基板台被配置成跨接所述壳体件的相互对置的一个内壁与另一内壁之间。
9.根据权利要求8所述的半导体装置，其中，
所述电路基板台的宽度被设定为5mm以上且30mm以下，所述电路基板台的厚度被设定为1mm以上且10mm以下。
10.根据权利要求8所述的半导体装置，其中，
所述绝缘基板与所述电路基板台之间的高度方向的距离被设定为3mm以上且10mm以下。
11.根据权利要求8所述的半导体装置，其中，
在所述电路基板台的与所述绝缘基板对置的一侧设置有以从与所述壳体件隔开距离的位置向着所述壳体件而接近所述绝缘基板的形态倾斜的倾斜部。
12.根据权利要求11所述的半导体装置，其中，
所述倾斜部相对于所述绝缘基板的倾角为5°以上。
13.根据权利要求1或8所述的半导体装置，其中，
所述电路基板台被一体地设置于所述壳体件。
14.根据权利要求1或8所述的半导体装置，其中，
所述电路基板台由与所述壳体件的材料相同的材料形成，
所述电路基板台与所述壳体件分体地固定于所述壳体件。
15.根据权利要求1或8所述的半导体装置，其中，
所述密封材料是环氧树脂以及硅树脂中的任意材料。
16.根据权利要求1或8所述的半导体装置，其中，
所述基底板通过有机材料以及无机材料中的任意材料形成。
CN201680007637.0A 2015-01-30 2016-01-08 半导体装置 Active CN107210291B (zh)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP2015-017000 2015-01-30
JP2015017000 2015-01-30
PCT/JP2016/050462 WO2016121456A1 (ja) 2015-01-30 2016-01-08 半導体装置

Publications (2)

Publication Number Publication Date
CN107210291A CN107210291A (zh) 2017-09-26
CN107210291B true CN107210291B (zh) 2019-07-16

Family

ID=56543076

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201680007637.0A Active CN107210291B (zh) 2015-01-30 2016-01-08 半导体装置

Country Status (4)

Country Link
JP (1) JP6054009B1 (zh)
CN (1) CN107210291B (zh)
DE (1) DE112016000517T5 (zh)
WO (1) WO2016121456A1 (zh)

Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6625037B2 (ja) * 2016-11-17 2019-12-25 三菱電機株式会社 半導体装置および半導体装置の製造方法
US11031355B2 (en) 2017-07-03 2021-06-08 Mitsubishi Electric Corporation Semiconductor device
JP6816691B2 (ja) * 2017-09-29 2021-01-20 三菱電機株式会社 半導体装置
WO2019131866A1 (ja) * 2017-12-28 2019-07-04 京セラ株式会社 配線基板、電子装置及び電子モジュール
JP2020013920A (ja) * 2018-07-19 2020-01-23 三菱電機株式会社 半導体装置及び電力変換装置
JP7074046B2 (ja) * 2018-12-21 2022-05-24 株式会社デンソー 半導体装置とその製造方法
JP7367352B2 (ja) * 2019-06-24 2023-10-24 富士電機株式会社 半導体モジュール、車両、および半導体モジュールの製造方法
JP7170614B2 (ja) * 2019-09-18 2022-11-14 株式会社東芝 半導体装置
JP7209615B2 (ja) * 2019-11-13 2023-01-20 三菱電機株式会社 半導体装置

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6060772A (en) * 1997-06-30 2000-05-09 Kabushiki Kaisha Toshiba Power semiconductor module with a plurality of semiconductor chips
JP2001024143A (ja) * 1999-07-12 2001-01-26 Nippon Inter Electronics Corp 複合半導体装置
CN101086984A (zh) * 2006-06-09 2007-12-12 三菱电机株式会社 半导体装置
JP2014203978A (ja) * 2013-04-05 2014-10-27 三菱電機株式会社 パワーモジュール

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3410969B2 (ja) * 1997-06-30 2003-05-26 株式会社東芝 半導体装置
JP4064741B2 (ja) * 2002-06-25 2008-03-19 株式会社日立製作所 半導体装置
US9343388B2 (en) * 2012-01-25 2016-05-17 Mitsubishi Electric Corporation Power semiconductor device

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6060772A (en) * 1997-06-30 2000-05-09 Kabushiki Kaisha Toshiba Power semiconductor module with a plurality of semiconductor chips
JP2001024143A (ja) * 1999-07-12 2001-01-26 Nippon Inter Electronics Corp 複合半導体装置
CN101086984A (zh) * 2006-06-09 2007-12-12 三菱电机株式会社 半导体装置
JP2014203978A (ja) * 2013-04-05 2014-10-27 三菱電機株式会社 パワーモジュール

Also Published As

Publication number Publication date
DE112016000517T5 (de) 2017-10-19
WO2016121456A1 (ja) 2016-08-04
CN107210291A (zh) 2017-09-26
JP6054009B1 (ja) 2016-12-27
JPWO2016121456A1 (ja) 2017-04-27

Similar Documents

Publication Publication Date Title
CN107210291B (zh) 半导体装置
CN107210238B (zh) 功率模块
JP5832557B2 (ja) 電力用半導体装置
JP5602077B2 (ja) 半導体装置
JP6366857B2 (ja) 電力用半導体装置
JP6045749B2 (ja) 半導体装置
JP2007012831A (ja) パワー半導体装置
JP6057927B2 (ja) 半導体装置
US10403559B2 (en) Power semiconductor device
JP2011228336A (ja) 半導体装置および半導体装置の製造方法
EP2571053A1 (en) Power semiconductor arrangement and method of forming thereof
CN207381382U (zh) 电力电子模块和电力电子元器件封装基板
JP2017034152A (ja) 電力用半導体装置
CN106252332B (zh) 热敏电阻搭载装置及热敏电阻部件
CN113206048B (zh) 半导体装置及其制造方法
JP2020174156A (ja) 半導体装置および半導体装置の製造方法
US11244922B2 (en) Semiconductor device
JP2011023458A (ja) 半導体装置およびその製造方法
EP3958305B1 (en) Power semiconductor module arrangement and method for producing the same
JP6895307B2 (ja) 半導体装置
CN112530915B (zh) 半导体装置
CN103579480A (zh) 热电分离的半导体装置与其制造方法
JP7419781B2 (ja) 半導体モジュール
JP2017135144A (ja) 半導体モジュール
CN109742057B (zh) 功率器件及其基底、功率器件组件、射频模块和基站

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant