CN105720955B - 一种具有失调补偿的动态比较器 - Google Patents
一种具有失调补偿的动态比较器 Download PDFInfo
- Publication number
- CN105720955B CN105720955B CN201610036584.7A CN201610036584A CN105720955B CN 105720955 B CN105720955 B CN 105720955B CN 201610036584 A CN201610036584 A CN 201610036584A CN 105720955 B CN105720955 B CN 105720955B
- Authority
- CN
- China
- Prior art keywords
- switch
- phase
- input
- approach
- offset voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000013459 approach Methods 0.000 claims abstract description 48
- 102100029469 WD repeat and HMG-box DNA-binding protein 1 Human genes 0.000 claims description 11
- 101710097421 WD repeat and HMG-box DNA-binding protein 1 Proteins 0.000 claims description 11
- 238000012937 correction Methods 0.000 claims description 10
- 102100031024 CCR4-NOT transcription complex subunit 1 Human genes 0.000 claims description 8
- 101000919674 Caenorhabditis elegans CCR4-NOT transcription complex subunit let-711 Proteins 0.000 claims description 8
- 101000919672 Homo sapiens CCR4-NOT transcription complex subunit 1 Proteins 0.000 claims description 8
- 230000015572 biosynthetic process Effects 0.000 claims 2
- 230000005611 electricity Effects 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 239000000243 solution Substances 0.000 description 2
- 238000004891 communication Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 238000011160 research Methods 0.000 description 1
- 230000006641 stabilisation Effects 0.000 description 1
- 238000011105 stabilization Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/22—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral
- H03K5/24—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude
- H03K5/2472—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude using field effect transistors
- H03K5/2481—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude using field effect transistors with at least one differential stage
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/22—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Manipulation Of Pulses (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
本发明公开一种具有失调补偿的动态比较器，该比较器包括动态差分比较电路、基于逐次逼近逻辑的失调电压校正电路和时钟控制电路三个部分组成。基于逐次逼近逻辑的失调电压校正电路相较于传统的校正电路，不需要前置放大器，这样失调电压只由基于逐次逼近逻辑的失调电压校正电路的精度所决定,从而降低了比较器的系统失调电压，并且大大的减少了系统功耗。利用本发明可以实现较低的失调电压和功耗。
Description
技术领域
本发明涉及集成电路设计领域，具体涉及一种具有失调补偿的动态比较器。
背景技术
随着无线通信技术的快速发展，采用便携电池工作的可穿戴式设备越来越多，因而不断研发高精度、低功耗的集成电路技术是便携式电子系统的迫切需要。降低电源电压并减小工艺的特征尺寸是减小功耗的主要方式之一，但是电源电压的降低将导致电路各项性能指标的恶化，工艺角的相对变化量也随之不断增大。这些问题限制着模数转换器的转换精度和功耗的进一步提升。在模数转换器中比较器所消耗的功耗是比较大的。出于低功耗的需要，采用动态电路则能很好地解决功耗过大的问题，但是传统的动态比较器一般会加入前置预放大器，而不是全动态电路，失调电压较大，这样势必会消耗较大的功耗，对于整个模数转换器的精度有较大的影响。
发明内容
本发明所要解决的是传统动态比较器的失调电压较大，而对整个模数转换器的精度产生较大影响的问题，提供一种具有失调补偿的动态比较器。
为解决上述问题，本发明是通过以下技术方案实现的：
一种具有失调补偿的动态比较器，包括动态差分比较电路、基于逐次逼近逻辑的失调电压校正电路、时钟控制电路、第一开关SW11、第二开关SW121、第三开关SW13、第四开关SW14和第五开关SW15；
时钟控制电路的时钟输入端连接外部输入的时钟信号CLK；时钟控制电路的同相控制电位输出端输出同相控制电位信号CAL，时钟控制电路的反相控制电位输出端输出反相控制电位信号
基于逐次逼近逻辑的失调电压校正电路的时钟输入端连接外部输入的时钟信号CLK；基于逐次逼近逻辑的失调电压校正电路的控制电位输入端连接同相控制电位信号CAL；基于逐次逼近逻辑的失调电压校正电路的参考输入端连接参考电压Vb；基于逐次逼近逻辑的失调电压校正电路的同相输入端连接同相输出信号Von；基于逐次逼近逻辑的失调电压校正电路的反相输入端连接反相输出信号Vop；基于逐次逼近逻辑的失调电压校正电路的同相补偿输出端输出同相补偿信号Din；基于逐次逼近逻辑的失调电压校正电路的反相补偿输出端输出反相补偿信号Dip；
动态差分比较电路的时钟输入端连接外部输入的时钟信号CLK；动态差分比较电路的同相输入端同时连接第一开关SW11和第三开关SW13的其中一端，第一开关SW11的另一端连接外部输入的同相输入信号Vin，第三开关SW13的另一端连接外部输入的共模信号Vcm；动态差分比较电路的反相输入端同时连接第二开关SW12和第五开关SW15的其中一端，第二开关SW12的另一端连接外部输入的反相输入信号Vip，第五开关SW15的另一端连接外部输入的共模信号Vcm；第四开关SW14的一端连接动态差分比较电路的同相输入端，另一端连接动态差分比较电路的反相输入端；第一开关SW11和第二开关SW12的控制端连接反相控制电位信号第三开关SW13、第四开关SW14和第五开关SW15的控制端连接同相控制电位信号CAL；动态差分比较电路的同相补偿输入端连接同相补偿信号Din；动态差分比较电路的反相补偿输入端连接同相补偿信号Dip；动态差分比较电路的同相输出端输出同相输出信号Von；动态差分比较电路的反相输出端输出反相输出信号Vop。
上述方案中，动态差分比较电路包括动态比较器和锁存比较器；动态比较器的同相输入端和反相输入端分别形成动态差分比较电路的同相输入端和反相输入端；动态比较器的同相输出端和锁存比较器的同相输入端相连，并形成动态差分比较电路的同相补偿输入端；动态比较器的反相输出端和锁存比较器的反相输入端相连，并形成动态差分比较电路的反相补偿输入端；动态比较器的时钟输入端形成动态差分比较电路的时钟输入端；锁存比较器的同相输出端和反相输出端分别形成动态差分比较电路同相输出端和反相相输出端。
上述方案中，基于逐次逼近逻辑的失调电压校正电路包括第一晶体管M31、第二晶体管M32、第一电容C31、第六开关SW31、第七开关SW32、第八开关SW33、第一电流源Icp1、第二电流源Icp2、第一与门AND1、第二与门AND2和反相器NOT1；
第一晶体管M31的栅极形成基于逐次逼近逻辑的失调电压校正电路的参考输入端；第一晶体管M31的源极形成基于逐次逼近逻辑的失调电压校正电路的同相补偿输出端；第一晶体管M31的漏极接地；第二晶体管M32的源极形成基于逐次逼近逻辑的失调电压校正电路的反相补偿输出端；第二晶体管M32的漏极接地；第二晶体管M32的栅极连接第一电容C31的上极板、第六开关SW31的一端、第七开关SW32的一端和第八开关SW33的两端；第一电容C31的下极板接地；第六开关SW31的另一端连接第一电流源Icp1的一端，第一电流源Icp1的另一端接电源；第七开关SW32的另一端连接第二电流源Icp2的一端，第二电流源Icp2的另一端接地；
第六开关SW31的控制端连接第一与门AND1的输出端；第七开关SW32的控制端连接第二与门AND2输出端；第八开关SW33的控制端连接反相器NOT1的输出端；第一与门AND1的一个输入端和第二与门AND2的一个输入端共同形成基于逐次逼近逻辑的失调电压校正电路的控制电位输入端；第一与门AND1的另一个输入端形成基于逐次逼近逻辑的失调电压校正电路的同相输入端；第二与门AND2的另一个输入端形成基于逐次逼近逻辑的失调电压校正电路的反相输入端；反相器NOT1的输入端形成基于逐次逼近逻辑的失调电压校正电路的时钟输入端。
上述方案中，第六开关SW31的宽长比和第七开关SW32的宽长比相等，第八开关SW33的宽长比为第六开关SW31宽长比的二分之一。
与现有技术相比，本发明采用的失调校正技术，无须增加前置预放大器，使得整个电路的全部为动态电路，有效地减小了功耗；此外，通过失调电压校正电路的关键位置的开关增加虚拟开关进行补偿，能够有效降低失调电压，提高整个电路的精度。
附图说明
图1为一种具有失调补偿的动态比较器的原理图。
图2为图1中动态差分比较电路的原理图。
图3为图1中基于逐次逼近逻辑的失调电压校正电路的原理图。
具体实施方式
下面通过实施例，结合附图，对本发明的技术方案作进一步的具体说明。
一种具有失调补偿的动态比较器，如图1所示，其主要包括动态差分比较电路、基于逐次逼近逻辑的失调电压校正电路和时钟控制电路。
动态差分比较电路同相输入端Vn用于连接开关SW11、SW13和SW14，反相输入端Vp用于连接开关SW12、SW14和SW15，开关SW11的另一端用于连接输入信号Vin，开关SW12的另一端用于连接Vip，开关SW13和开关SW15的另一端用于连接共模信号Vcm。开关SW11和开关SW12受控于控制信号开关SW13、SW14和SW15受控于控制信号CAL。
动态差分比较电路的时钟输入端用于连接时钟信号CLK，补偿信号输入端用于连接基于逐次逼近逻辑的失调电压校正电路输出信号Din和Dip。动态差分比较电路的输出端Von和Vop用于连接基于逐次逼近逻辑的失调电压校正电路输入端。在本发明优选实施例中，动态差分比较电路，如图2所示，动态比较器输入端分别用于连接Vn和Vp，控制端用于连接时钟信号CLK，输出端分别用于连接锁存比较器的输入端Din和Dip。锁存比较器的输入端用于连接动态比较器的输出端Din和Dip，输出端分别用于连接信号Von和Vop。
基于逐次逼近逻辑的失调电压校正电路的参考输入端用于连接参考电压Vb，时钟控制输入端用于连接输入信号CLK，控制电位输入端用于连接时钟控制电路输出端CAL。时钟输入端用于连接时钟信号CLK。时钟控制电路输入端用于连接时钟信号CLK，输出端CAL用于校正电路和开关SW13、SW14和SW15。输出端用于连接开关SW11和SW12。在本发明优选实施例中，基于逐次逼近逻辑的失调电压校正电路，如图3所示，包括晶体管M31栅极用于连接共模电平Vb，源极用于连接Din，漏极接地。晶体管M32栅极用于连接电容C31上极板节点CH，源极用于连接Dip，漏极接地。电容C31上极板用于连接节点CH，下极板接地。开关SW31一端用于连接节点CH，另一端用于连接电流源Icp1，控制端用于连接与门AND1输出端。开关SW32一端用于连接节点CH，另一端用于连接电流源Icp2，控制端用于连接与门AND2输出端。开关SW33两端都用于连接节点CH，控制端用于连接反相器NOT1输出端。与门AND1输入端接控制信号CAL，另一输入端接第二级比较器输出端Von，输出端接开关SW31控制信号端。与门AND2输入端接控制信号CAL，另一输入端接第二级比较器输出端Vop，输出端接开关SW32控制信号端。反相器NOT1输入端接时钟信号CLK，输出端接开关SW33控制信号端。开关SW33作为虚拟开关对另外两个开关SW31和SW32进行补偿，减小了开关对于电容电荷注入效应，提高了校正电路的精度。在本发明优选实施例中，开关SW31的宽长比和开关SW32的宽长比尺寸一样，开关SW33的宽长比尺寸为开关SW31和开关SW32宽长比尺寸的一半。
本发明专利工作原理如下：
当CAL＝1时，动态差分比较电路的输入端输入共模电平，基于逐次逼近逻辑的失调电压校正电路输出的失调电压经过动态差分比较电路后输出端Von和Vop其中一端输出高电平另一端输出低电平。
当Von＝1时，基于逐次逼近逻辑的失调电压校正电路的与门AND1的输出控制开关SW31打开，同时开关SW33相当于一个虚拟开关对SW31进行补偿，电流源对电容C31充电，晶体管M32栅极电位上升。每过一个时钟周期晶体管M32的栅极电位上升一个台阶。当晶体管M32栅极电位上升到一定程度的时候，因为晶体管M32和晶体管M31的栅极存在电压差，晶体管M31和晶体管M32分别对动态差分比较电路的失调电压进行补偿。从而会导致Von＝0，与门AND2的输出控制开关SW32打开，同时开关SW33相当于一个虚拟开关对SW32进行补偿。电容C31通过电流源对地放电，晶体管M32栅极电位下降。节点CH处的电位稳定在这个跳变点附近。基于逐次逼近逻辑的失调电压校正电路降低了动态差分比较电路的系统失调电压，失调电压只由基于逐次逼近逻辑的失调电压校正电路的精度决定。电容C31充放电的速度决定基于逐次逼近逻辑的失调电压校正电路的精度，放电速度越慢晶体管M32栅极电位的上升和下降就越慢，从而检测出来的节点CH处的电位越准确。
本发明由于全部采用动态结构所以电路功耗很小，经过失调电压校正之后失调电压可以达到1mV以内。可以广泛的引用于低功耗高精度应用场合。
本发明公开一种具有失调补偿的动态比较器，包括动态差分比较电路、基于逐次逼近逻辑的失调电压校正电路和时钟控制电路三个部分组成。该动态比较器的比较过程分为失调电压检测、比较和复位三个步骤。本发明可以将动态比较器的失调电压大幅度的减小。基于逐次逼近逻辑的失调电压校正电路相较于传统的校正电路，不需要前置放大器，这样失调电压只由基于逐次逼近逻辑的失调电压校正电路的精度所决定,从而降低了比较器的系统失调电压，并且大大的减少了系统功耗。利用本发明可以实现较低的失调电压和功耗。
需要强调的是：以上仅是本发明专利的较佳实施例而已，并非对本发明专利作任何形式上的限制，凡是依据本发明专利的技术实质对以上实施例所作的任何简单修改、等同变化与修饰，均仍属于本发明专利技术方案的范围内。
Claims (3)
1.一种具有失调补偿的动态比较器，包括动态差分比较电路、基于逐次逼近逻辑的失调电压校正电路、时钟控制电路、第一开关SW11、第二开关SW12、第三开关SW13、第四开关SW14和第五开关SW15；
时钟控制电路的时钟输入端连接外部输入的时钟信号CLK；时钟控制电路的同相控制电位输出端输出同相控制电位信号CAL，时钟控制电路的反相控制电位输出端输出反相控制电位信号CAL；
基于逐次逼近逻辑的失调电压校正电路的时钟输入端连接外部输入的时钟信号CLK；基于逐次逼近逻辑的失调电压校正电路的控制电位输入端连接同相控制电位信号CAL；基于逐次逼近逻辑的失调电压校正电路的参考输入端连接参考电压Vb；基于逐次逼近逻辑的失调电压校正电路的同相输入端连接同相输出信号Von；基于逐次逼近逻辑的失调电压校正电路的反相输入端连接反相输出信号Vop；基于逐次逼近逻辑的失调电压校正电路的同相补偿输出端输出同相补偿信号Din；基于逐次逼近逻辑的失调电压校正电路的反相补偿输出端输出反相补偿信号Dip；
动态差分比较电路的时钟输入端连接外部输入的时钟信号CLK；动态差分比较电路的同相输入端同时连接第一开关SW11和第三开关SW13的其中一端，第一开关SW11的另一端连接外部输入的同相输入信号Vin，第三开关SW13的另一端连接外部输入的共模信号Vcm；动态差分比较电路的反相输入端同时连接第二开关SW12和第五开关SW15的其中一端，第二开关SW12的另一端连接外部输入的反相输入信号Vip，第五开关SW15的另一端连接外部输入的共模信号Vcm；第四开关SW14的一端连接动态差分比较电路的同相输入端，另一端连接动态差分比较电路的反相输入端；第一开关SW11和第二开关SW12的控制端连接反相控制电位信号CAL，第三开关SW13、第四开关SW14和第五开关SW15的控制端连接同相控制电位信号CAL；动态差分比较电路的同相补偿输入端连接同相补偿信号Din；动态差分比较电路的反相补偿输入端连接反相补偿信号Dip；动态差分比较电路的同相输出端输出同相输出信号Von；动态差分比较电路的反相输出端输出反相输出信号Vop；其特征是：
所述基于逐次逼近逻辑的失调电压校正电路包括第一晶体管M31、第二晶体管M32、第一电容C31、第六开关SW31、第七开关SW32、第八开关SW33、第一电流源Icp1、第二电流源Icp2、第一与门AND1、第二与门AND2和反相器NOT1；
第一晶体管M31的栅极形成基于逐次逼近逻辑的失调电压校正电路的参考输入端；第一晶体管M31的源极形成基于逐次逼近逻辑的失调电压校正电路的同相补偿输出端；第一晶体管M31的漏极接地；第二晶体管M32的源极形成基于逐次逼近逻辑的失调电压校正电路的反相补偿输出端；第二晶体管M32的漏极接地；第二晶体管M32的栅极连接第一电容C31的上极板、第六开关SW31的一端、第七开关SW32的一端和第八开关SW33的两端；第一电容C31的下极板接地；第六开关SW31的另一端连接第一电流源Icp1的一端，第一电流源Icp1的另一端接电源；第七开关SW32的另一端连接第二电流源Icp2的一端，第二电流源Icp2的另一端接地；
第六开关SW31的控制端连接第一与门AND1的输出端；第七开关SW32的控制端连接第二与门AND2输出端；第八开关SW33的控制端连接反相器NOT1的输出端；第一与门AND1的一个输入端和第二与门AND2的一个输入端共同形成基于逐次逼近逻辑的失调电压校正电路的控制电位输入端；第一与门AND1的另一个输入端形成基于逐次逼近逻辑的失调电压校正电路的同相输入端；第二与门AND2的另一个输入端形成基于逐次逼近逻辑的失调电压校正电路的反相输入端；反相器NOT1的输入端形成基于逐次逼近逻辑的失调电压校正电路的时钟输入端。
2.根据权利要求1所述的一种具有失调补偿的动态比较器，其特征是：动态差分比较电路包括动态比较器和锁存比较器；动态比较器的同相输入端和反相输入端分别形成动态差分比较电路的同相输入端和反相输入端；动态比较器的同相输出端和锁存比较器的同相输入端相连，并形成动态差分比较电路的同相补偿输入端；动态比较器的反相输出端和锁存比较器的反相输入端相连，并形成动态差分比较电路的反相补偿输入端；动态比较器的时钟输入端形成动态差分比较电路的时钟输入端；锁存比较器的同相输出端和反相输出端分别形成动态差分比较电路同相输出端和反相输出端。
3.根据权利要求1所述的一种具有失调补偿的动态比较器，其特征是：第六开关SW31的宽长比和第七开关SW32的宽长比相等，第八开关SW33的宽长比为第六开关SW31宽长比的二分之一。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201810176369.6A CN108322199B (zh) | 2016-01-20 | 2016-01-20 | 一种动态比较方法 |
| CN201610036584.7A CN105720955B (zh) | 2016-01-20 | 2016-01-20 | 一种具有失调补偿的动态比较器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201610036584.7A CN105720955B (zh) | 2016-01-20 | 2016-01-20 | 一种具有失调补偿的动态比较器 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| CN201810176369.6A Division CN108322199B (zh) | 2016-01-20 | 2016-01-20 | 一种动态比较方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| CN105720955A CN105720955A (zh) | 2016-06-29 |
| CN105720955B true CN105720955B (zh) | 2018-06-08 |
Family
ID=56147772
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| CN201810176369.6A Expired - Fee Related CN108322199B (zh) | 2016-01-20 | 2016-01-20 | 一种动态比较方法 |
| CN201610036584.7A Active CN105720955B (zh) | 2016-01-20 | 2016-01-20 | 一种具有失调补偿的动态比较器 |
Family Applications Before (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| CN201810176369.6A Expired - Fee Related CN108322199B (zh) | 2016-01-20 | 2016-01-20 | 一种动态比较方法 |
Country Status (1)
| Country | Link |
|---|---|
| CN (2) | CN108322199B (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN110474623A (zh) * | 2019-07-08 | 2019-11-19 | 浙江大学 | 一种用于逐次逼近型模数转换器的失调自校正动态比较器 |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106656124B (zh) * | 2016-12-30 | 2019-07-19 | 北京华大九天软件有限公司 | 一种高速低失调动态比较器 |
| CN107241098B (zh) * | 2017-05-24 | 2020-10-16 | 东南大学 | 一种异步逐次逼近型模数转换器中比较器的失调校准电路 |
| CN109245768B (zh) * | 2018-09-19 | 2022-04-05 | 中国电子科技集团公司第二十四研究所 | 一种具有高精度采样开关的sar adc |
| CN109818604A (zh) * | 2019-04-03 | 2019-05-28 | 江苏集萃微纳自动化系统与装备技术研究所有限公司 | 一种高精度差分电容mems接口电路及mems器件 |
| CN110855274B (zh) * | 2019-10-23 | 2024-05-14 | 广西师范大学 | 一种低失调轨对轨动态锁存比较器 |
| CN114371753A (zh) * | 2021-01-08 | 2022-04-19 | 中国科学院微电子研究所 | 一种具有动态失调校准电路的比较器电路和电子设备 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1681212A (zh) * | 2004-04-09 | 2005-10-12 | 恩益禧电子股份有限公司 | 逐次逼近ad转换器 |
| CN103036538A (zh) * | 2012-12-06 | 2013-04-10 | 国民技术股份有限公司 | 校准比较器失调电压的电路及其方法 |
| CN205336242U (zh) * | 2016-01-20 | 2016-06-22 | 桂林电子科技大学 | 一种具有失调补偿的动态比较器 |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN101282117B (zh) * | 2007-04-05 | 2010-06-23 | 中国科学院微电子研究所 | 一种动态比较器 |
| US8446304B2 (en) * | 2010-06-30 | 2013-05-21 | University Of Limerick | Digital background calibration system and method for successive approximation (SAR) analogue to digital converter |
| TWI443969B (zh) * | 2010-11-17 | 2014-07-01 | Ind Tech Res Inst | 以動態比較器為基礎的比較系統 |
| US8344931B2 (en) * | 2011-06-01 | 2013-01-01 | University Of Macau | N-bits successive approximation register analog-to-digital converting circuit |
| CN102332921A (zh) * | 2011-07-28 | 2012-01-25 | 复旦大学 | 一种适用于自动增益控制环路的逐次逼近型模数转换器 |
| CN102843136B (zh) * | 2012-09-15 | 2015-10-28 | 复旦大学 | 一种高速高精度大范围低功耗动态比较器失调校正方法 |
| CN103023437B (zh) * | 2012-12-17 | 2015-11-18 | 清华大学深圳研究生院 | 一种校正失调电压的动态比较器 |
| CN103036512B (zh) * | 2012-12-17 | 2016-01-06 | 清华大学深圳研究生院 | 一种具有大失调电压校正范围的动态比较器 |
| US8928506B2 (en) * | 2013-04-09 | 2015-01-06 | Maxlinear, Inc. | Successive approximation analog-to-digital converter (ADC) with dynamic search algorithm |
| CN203377849U (zh) * | 2013-07-15 | 2014-01-01 | 中国电子科技集团公司第五十八研究所 | 高速失调补偿动态比较器 |
| CN104320139B (zh) * | 2014-09-29 | 2017-11-21 | 清华大学 | 基于电荷匹配的全对称四端动态比较器的失调校正方法 |
-
2016
- 2016-01-20 CN CN201810176369.6A patent/CN108322199B/zh not_active Expired - Fee Related
- 2016-01-20 CN CN201610036584.7A patent/CN105720955B/zh active Active
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1681212A (zh) * | 2004-04-09 | 2005-10-12 | 恩益禧电子股份有限公司 | 逐次逼近ad转换器 |
| CN103036538A (zh) * | 2012-12-06 | 2013-04-10 | 国民技术股份有限公司 | 校准比较器失调电压的电路及其方法 |
| CN205336242U (zh) * | 2016-01-20 | 2016-06-22 | 桂林电子科技大学 | 一种具有失调补偿的动态比较器 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN110474623A (zh) * | 2019-07-08 | 2019-11-19 | 浙江大学 | 一种用于逐次逼近型模数转换器的失调自校正动态比较器 |
| CN110474623B (zh) * | 2019-07-08 | 2021-01-12 | 浙江大学 | 一种用于逐次逼近型模数转换器的失调自校正动态比较器 |
Also Published As
| Publication number | Publication date |
|---|---|
| CN108322199B (zh) | 2021-08-13 |
| CN108322199A (zh) | 2018-07-24 |
| CN105720955A (zh) | 2016-06-29 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| CN105720955B (zh) | 一种具有失调补偿的动态比较器 | |
| CN101807922B (zh) | 采用补偿方式提高性能的采样保持电路 | |
| CN104270152B (zh) | 用于电荷耦合流水线模数转换器的pvt不敏感共模电荷控制装置 | |
| CN106959724A (zh) | 参考电压电路 | |
| CN108768142A (zh) | 一种自举电路 | |
| CN108241396A (zh) | 一种提高瞬态响应速度的低压差线性稳压器 | |
| CN105530002B (zh) | 一种高精度时钟产生装置 | |
| CN205336242U (zh) | 一种具有失调补偿的动态比较器 | |
| CN209182729U (zh) | 一种半周期电容比例可编程带隙基准电路 | |
| CN208571909U (zh) | 一种自举电路 | |
| CN106612119A (zh) | 一种比较器及模数转化器 | |
| CN103107791B (zh) | 带宽恒定的增益线性可变增益放大器 | |
| CN108462388A (zh) | 自举电源的实现电路 | |
| CN101710827B (zh) | 一种用于流水线模数转换器的动态偏置产生电路 | |
| CN103762985B (zh) | 采样保持电路 | |
| CN109582073A (zh) | 一种半周期电容比例可编程带隙基准电路 | |
| CN206524828U (zh) | 一种比较器及模数转化器 | |
| CN204761416U (zh) | 一种微位移测试系统用ad转换电路 | |
| CN209471391U (zh) | 一种对电源电压不敏感的使能电路 | |
| CN207853848U (zh) | 一种多输入放大器及包括该放大器的双控制电路 | |
| CN209593406U (zh) | 一种适用于12位流水线adc中的新型运算放大电路 | |
| CN207752400U (zh) | 一种用于基准电压源的补偿电路 | |
| CN107689728A (zh) | 电荷泵控制环路 | |
| CN106200852B (zh) | 唤醒开关电路及终端 | |
| CN106371496B (zh) | 一种用于mppt电路的超低压比较器电路及mppt电路 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| C06 | Publication | ||
| PB01 | Publication | ||
| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| GR01 | Patent grant | ||
| GR01 | Patent grant | ||
| EE01 | Entry into force of recordation of patent licensing contract |
Application publication date: 20160629 Assignee: Guangxi Langyuantong Technology Co.,Ltd. Assignor: GUILIN University OF ELECTRONIC TECHNOLOGY Contract record no.: X2023980044847 Denomination of invention: A Dynamic Comparator with Offset Compensation Granted publication date: 20180608 License type: Common License Record date: 20231031 |
|
| EE01 | Entry into force of recordation of patent licensing contract |