CN105702295A - 移位寄存器单元、栅极驱动电路、显示面板及显示装置 - Google Patents

移位寄存器单元、栅极驱动电路、显示面板及显示装置 Download PDF

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Abstract

本发明公开了一种移位寄存器单元、栅极驱动电路、显示面板及显示装置，该移位寄存器单元中发光信号输出模块和扫描信号输出模块相结合，从而可以实现将发光移位寄存器单元和扫描移位寄存器单元整合在一个电路结构中，减少控制时钟的数量；且该移位寄存器单元是一种同步输出可调脉宽和周期常开型移位寄存器单元，通过控制第一节点和第五节点的电位使发光信号输出模块持续输出第一参考信号端的信号或输出第二参考信号端的信号，通过控制第三节点和第四节点的电位使扫描信号输出模块持续输出第二参考信号端的信号或输出第二时钟信号端的信号，这样可实现输出多脉宽宽度的发光信号和多个发光信号触发脉冲控制扫描输出，即实现了发光信号的占空比控制。

Description

移位寄存器单元、栅极驱动电路、显示面板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种移位寄存器单元、栅极驱动电路、显示面板及显示装置。
背景技术
有机发光显示器(OrganicLightEmittingDiode，OLED)是当今平板显示器研究领域的热点之一，与液晶显示器相比，OLED具有低能耗、生产成本低、自发光、宽视角及响应速度快等优点，目前，在手机、PDA、数码相机等显示领域OLED已经开始取代传统的LCD显示屏。有机发光显示面板(OLED，OrganicLightEmittingDiode)需要驱动集成电路(IC，IntegratedCircuit)的控制，例如，栅极驱动电路控制显示面板实现了逐行扫描和逐帧刷新的功能，使得输入到显示面板的图像数据能够实时刷新，从而实现动态显示；发光驱动电路用于向显示面板输入发光信号，从而控制各像素中OLED在发光阶段发光，其中，栅极驱动电路包括多个扫描移位寄存器单元，发光驱动电路包括多个发光移位寄存器单元。
目前，随着有机电致发光显示技术的不断发展，通过控制发光移位寄存器输出的发光信号与扫描移位寄存器输出的扫描信号的占空比，可以实现调制OLED亮度，从而实现显示面板的亮度调制。
因此，如何实现发光信号与扫描信号的占空比控制，是本领域技术人员亟待解决的技术问题。
发明内容
本发明实施例提供了一种移位寄存器单元、栅极驱动电路、显示面板及显示装置，用以实现发光信号与扫描信号的占空比控制。
本发明实施例提供了一种移位寄存器单元，包括：第一输入模块、第二输入模块、第一控制模块、第二控制模块、发光信号输出模块和扫描信号输出模块；其中，
所述第一输入模块的第一控制端和第一输入端分别与第一时钟信号端相连，第二控制端和第一输出端分别与第一节点相连，第二输入端与第一信号输入端相连，第三输入端与第一参考信号端相连，第二输出端与第二节点相连；所述第一输入模块用于在所述第一时钟信号端控制下，将所述第一信号输入端的信号和所述第一参考信号端的信号分别输出到所述第一节点和所述第二节点，在所述第一节点的控制下，将所述第一时钟信号端的信号输出到所述第二节点；
所述第二输入模块的第一控制端和第一输入端分别与所述第一时钟信号端相连，第二控制端和第一输出端分别与第三节点相连，第二输入端与第二信号输入端相连，第三输入端与所述第一参考信号端相连，第二输出端与第四节点相连；所述第二输入模块用于在所述第一时钟信号端控制下，将所述第二信号输入端的信号和所述第一参考信号端的信号分别输出到所述第三节点和所述第四节点，在所述第三节点的控制下，将所述第一时钟信号端的信号输出到所述第四节点；
所述第一控制模块的第一控制端与所述第二节点相连，第二控制端与第二时钟信号端相连，第三控制端与所述第一节点相连，第一输入端与第二参考信号端相连，第二输入端与所述第一参考信号端相连，输出端与第五节点相连；所述第一控制模块用于在所述第二节点和所述第二时钟信号端的控制下将所述第一参考信号端的信号输出到所述第五节点，在所述第一节点的控制下将所述第二参考信号端的信号输出到所述第五节点；
所述第二控制模块的第一控制端与所述第四节点相连，第二控制端与所述第一节点相连，第三控制端与所述第五节点相连，输入端与所述第二参考信号端相连，输出端与所述第三节点相连；所述第二控制模块用于在所述第四节点、所述第一节点和所述第五节点的控制下，将所述第二参考信号端的信号输出到所述第三节点；
所述发光信号输出模块的第一控制端与所述第一节点相连，第二控制端与所述第五节点相连，第一输入端与所述第一参考信号端相连，第二输入端与所述第二参考信号端相连，输出端与发光信号输出端相连；所述发光信号输出模块用于在所述第一节点和所述第五节点的控制下，将所述第一参考信号端的信号或所述第二参考信号端的信号输出到所述发光信号输出端；
所述扫描信号输出模块的第一控制端与所述第三节点相连，第二控制端与所述第四节点相连，第一输入端与所述第二参考信号端相连，第二输入端与所述第二时钟信号端相连，输出端与扫描信号输出端相连；所述扫描信号输出模块用于在所述第三节点和所述第四节点的控制下，将所述第二参考信号端的信号或所述第二时钟信号端的信号输出到所述扫描信号输出端。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述发光信号输出模块，具体包括：第一输出单元和第二输出单元；其中，
所述第一输出单元的控制端与所述第五节点相连，输入端与所述第二参考信号端相连，输出端与所述发光信号输出端相连；所述第一输出单元用于在所述第五节点的控制下，将所述第二参考信号端的信号输出到所述发光信号输出端；
所述第二输出单元的控制端与所述第一节点相连，输入端与所述第一参考信号端相连，输出端与所述发光信号输出端相连；所述第二输出单元用于在所述第一节点的控制下，将所述第一参考信号端的信号输出到所述发光信号输出端。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第一输出单元，具体包括：第一开关晶体管和第一电容；其中，
所述第一开关晶体管的栅极与所述第五节点相连，源极与所述第二参考信号端相连，漏极与所述发光信号输出端相连；
所述第一电容连接于所述第二参考信号端和所述第五节点之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第二输出单元，具体包括：第二开关晶体管和第二电容；其中，
所述第二开关晶体管的栅极与所述第一节点相连，源极与所述第一参考信号端相连，漏极与所述发光信号输出端相连；
所述第二电容连接于所述第一节点和所述发光信号输出端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述扫描信号输出模块，具体包括：第三输出单元和第四输出单元；其中，
所述第三输出单元的控制端与所述第四节点相连，输入端与所述第二参考信号端相连，输出端与所述扫描信号输出端相连；所述第三输出单元用于在所述第四节点的控制下，将所述第二参考信号端的信号输出到所述扫描信号输出端；
所述第四输出单元的控制端与所述第三节点相连，输入端与所述第二时钟信号端相连，输出端与所述扫描信号输出端相连；所述第四输出单元用于在所述第三节点的控制下，将所述第二时钟信号端的信号输出到所述扫描信号输出端。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第三输出单元，具体包括：第三开关晶体管和第三电容；其中，
所述第三开关晶体管的栅极与所述第四节点相连，源极与所述第二参考信号端相连，漏极与所述扫描信号输出端相连；
所述第三电容连接于所述第四节点和所述第二参考信号端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第四输出单元，具体包括：第四开关晶体管和第四电容；其中，
所述第四开关晶体管的栅极与所述第三节点相连，源极与所述第二时钟信号端相连，漏极与所述扫描信号输出端相连；
所述第四电容连接于所述第三节点和所述扫描信号输出端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第一控制模块，具体包括：第一控制单元和第二控制单元；其中，
所述第一控制单元的第一控制端与所述第二节点相连，第二控制端与所述第二时钟信号端相连，输入端与所述第一参考信号端相连，输出端与所述第五节点相连；所述第一控制单元用于在所述第二节点和所述第二时钟信号端的控制下，将所述第一参考信号端的信号输出到所述第五节点；
所述第二控制单元的控制端与所述第一节点相连，输入端与所述第二参考信号端相连，输出端与所述第五节点相连；所述第二控制单元用于在所述第一节点的控制下，将所述第二参考信号端的信号输出到所述第五节点。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第一控制单元，具体包括：第五开关晶体管、第六开关晶体管和第五电容；其中，
所述第五开关晶体管的栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述第六开关晶体管的源极相连；
所述第六开关晶体管的栅极与所述第二时钟信号端相连，漏极与所述第五节点相连；
所述第五电容连接于所述第二节点和所述第二时钟信号端之间。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第二控制单元，具体包括：第七开关晶体管；
所述第七开关晶体管的栅极与所述第一节点相连，源极与所述第二参考信号端相连，漏极与所述第五节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第一输入模块，具体包括：第一输入单元和第二输入单元；其中，
所述第一输入单元的控制端与所述第一时钟信号端相连，第一输入端与所述第一参考信号端相连，第二输入端与所述第一信号输入端相连，第一输出端与所述第一节点相连，第二输出端与所述第二节点相连；所述第一输入单元用于在所述第一时钟信号端的控制下，将所述第一信号输入端的信号和所述第一参考信号端的信号分别输出到所述第一节点和所述第二节点；
所述第二输入单元的控制端与所述第一节点相连，输入端与所述第一时钟信号端相连，输出端与所述第二节点相连；所述第二输入单元用于在所述第一节点的控制下，将所述第一时钟信号端的信号输出到所述第二节点。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第一输入单元，具体包括：第八开关晶体管和第九开关晶体管；其中，
所述第八开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第一信号输入端相连，漏极与所述第一节点相连；
所述第九开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第一参考信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第二输入单元，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述第一节点相连，源极与所述第一时钟信号端相连，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第二输入模块，具体包括：第三输入单元和第四输入单元；其中，
所述第三输入单元的控制端与所述第一时钟信号端相连，第一输入端与所述第一参考信号端相连，第二输入端与所述第二信号输入端相连，第一输出端与所述第三节点相连，第二输出端与所述第四节点相连；所述第三输入单元用于在所述第一时钟信号端的控制下，将所述第二信号输入端的信号和所述第一参考信号端的信号分别输出到所述第三节点和所述第四节点；
所述第四输入单元的控制端与所述第三节点相连，输入端与所述第一时钟信号端相连，输出端与所述第四节点相连；所述第四输入单元用于在所述第三节点的控制下，将所述第一时钟信号端的信号输出到所述第四节点。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第三输入单元，具体包括：第十一开关晶体管和第十二开关晶体管；其中，
所述第十一开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第二信号输入端相连，漏极与所述第三节点相连；
所述第十二开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第一参考信号端相连，漏极与所述第四节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第四输入单元，具体包括：第十三开关晶体管；
所述第十三开关晶体管的栅极与所述第三节点相连，源极与所述第一时钟信号端相连，漏极与所述第四节点相连。
在一种可能的实施方式中，本发明实施例提供的上述移位寄存器单元中，所述第二控制模块，具体包括：第十四开关晶体管、第十五开关晶体管和第十六开关晶体管；其中，
所述第十四开关晶体管的栅极与所述第四节点相连，源极与所述第二参考信号端相连，漏极分别与所述第十五开关晶体管的源极和第十六开关晶体管的源极相连；
所述第十五开关晶体管的栅极与所述第一节点相连，漏极与所述第三节点相连；
所述第十六开关晶体管的栅极与所述第五节点相连，漏极与所述第三节点相连。
本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器单元；除最后一个移位寄存器单元之外，其余每个移位寄存器单元的发光信号输出端均向与其相邻的下一级移位寄存器单元的第一信号输入端输入触发信号，扫描信号输出端均向与其相邻的下一级移位寄存器单元的第二信号输入端输入触发信号。
本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。
本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。
本发明实施例的有益效果包括：
本发明实施例提供了一种移位寄存器单元、栅极驱动电路、显示面板及显示装置，该移位寄存器单元，包括：第一输入模块、第二输入模块、第一控制模块、第二控制模块、发光信号输出模块和扫描信号输出模块；其中，第一输入模块用于在第一时钟信号端控制下，将第一信号输入端的信号和第一参考信号端的信号分别输出到第一节点和所述第二节点，在第一节点的控制下，将第一时钟信号端的信号输出到第二节点；第二输入模块用于在第一时钟信号端控制下，将第二信号输入端的信号和第一参考信号端的信号分别输出到第三节点和第四节点，在第三节点的控制下，将第一时钟信号端的信号输出到第四节点；第一控制模块用于在第二节点和第二时钟信号端的控制下将第一参考信号端的信号输出到第五节点，在第一节点的控制下将第二参考信号端的信号输出到第五节点；第二控制模块用于在第四节点、第一节点和第五节点的控制下，将第二参考信号端的信号输出到第三节点；发光信号输出模块用于在第一节点和第五节点的控制下，将第一参考信号端的信号或第二参考信号端的信号输出到发光信号输出端；扫描信号输出模块用于在第三节点和第四节点的控制下，将第二参考信号端的信号或第二时钟信号端的信号输出到扫描信号输出端。
具体地，本发明实施例提供的上述移位寄存器单元，各模块在各自的控制信号端的控制下输出对应的信号，可以实现扫描信号和发光信号的输出；同时发光信号输出模块和扫描信号输出模块相结合，从而可以实现将发光移位寄存器单元和扫描移位寄存器单元整合在一个电路结构中，减少控制时钟的数量；且本发明实施例提供的移位寄存器单元是一种可以同步输出可调脉宽和周期常开型移位寄存器单元，通过控制第一节点和第五节点的电位，使得发光信号输出模块可以持续输出第一参考信号端的信号或输出第二参考信号端的信号，通过控制第三节点和第四节点的电位，使得扫描信号输出模块可以持续输出第二参考信号端的信号或输出第二时钟信号端的信号，这样可以实现输出多脉宽宽度的发光信号和多个发光信号触发脉冲控制扫描输出，即将发光移位寄存器单元与扫描移位寄存器单元整合到一个电路结构中的前提下，实现了发光信号与扫描信号的占空比控制。
附图说明
图1为本发明实施例提供的移位寄存器单元的结构示意图；
图2为本发明实施例提供的移位寄存器单元的具体结构示意图；
图3为本发明实施例提供的移位寄存器单元的工作时序图；
图4为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器单元、栅极驱动电路、显示面板及显示装置的具体实施方式进行详细的说明。
本发明实施例提供了一种移位寄存器单元，如图1所示，可以包括：第一输入模块01、第二输入模块02、第一控制模块03、第二控制模块04、发光信号输出模块05和扫描信号输出模块06；其中，
第一输入模块01的第一控制端和第一输入端分别与第一时钟信号端CLK1相连，第二控制端和第一输出端分别与第一节点P1相连，第二输入端与第一信号输入端STVE相连，第三输入端与第一参考信号端VGL相连，第二输出端与第二节点P2相连；第一输入模块01用于在第一时钟信号端CLK1控制下，将第一信号输入端STVE的信号和第一参考信号端VGL的信号分别输出到第一节点P1和第二节点P2，在第一节点P1的控制下，将第一时钟信号端CLK1的信号输出到第二节点P2；
第二输入模块02的第一控制端和第一输入端分别与第一时钟信号端CLK1相连，第二控制端和第一输出端分别与第三节点P3相连，第二输入端与第二信号输入端STVG相连，第三输入端与第一参考信号端VGL相连，第二输出端与第四节点P4相连；第二输入模块02用于在第一时钟信号端CLK1控制下，将第二信号输入端STVG的信号和第一参考信号端VGL的信号分别输出到第三节点P3和第四节点P4，在第三节点P3的控制下，将第一时钟信号端CLK1的信号输出到第四节点P4；
第一控制模块03的第一控制端与第二节点P2相连，第二控制端与第二时钟信号端CLK2相连，第三控制端与第一节点P1相连，第一输入端与第二参考信号端VGH相连，第二输入端与第一参考信号端VGL相连，输出端与第五节点P5相连；第一控制模块03用于在第二节点P2和第二时钟信号端CLK2的控制下将第一参考信号端VGL的信号输出到第五节点P5，在第一节点P1的控制下将第二参考信号端VGH的信号输出到第五节点P5；
第二控制模块04的第一控制端与第四节点P4相连，第二控制端与第一节点P1相连，第三控制端与第五节点P5相连，输入端与第二参考信号端VGH相连，输出端与第三节点P3相连；第二控制模块04用于在第四节点P4、第一节点P1和第五节点P5的控制下，将第二参考信号端VGH的信号输出到第三节点P3；
发光信号输出模块05的第一控制端与第一节点P1相连，第二控制端与第五节点P5相连，第一输入端与第一参考信号端VGL相连，第二输入端与第二参考信号端VGH相连，输出端与发光信号输出端EM相连；发光信号输出模块05用于在第一节点P1和第五节点P5的控制下，将第一参考信号端VGL的信号或第二参考信号端VGH的信号输出到发光信号输出端；
扫描信号输出模块06的第一控制端与第三节点P3相连，第二控制端与第四节点P4相连，第一输入端与第二参考信号端VGH相连，第二输入端与第二时钟信号端CLK2相连，输出端与扫描信号输出端Gate相连；扫描信号输出模块06用于在第三节点P3和第四节点P4的控制下，将第二参考信号端VGH的信号或第二时钟信号端CLK2的信号输出到扫描信号输出端Gate。
本发明实施例提供的上述移位寄存器单元中，各模块在各自的控制信号端的控制下输出对应的信号，可以实现扫描信号和发光信号的输出；同时发光信号输出模块和扫描信号输出模块相结合，从而可以实现将发光移位寄存器单元和扫描移位寄存器单元整合在一个电路结构中，减少控制时钟的数量；且本发明实施例提供的移位寄存器单元是一种可以同步输出可调脉宽和周期常开型移位寄存器单元，通过控制第一节点和第五节点的电位，使得发光信号输出模块可以持续输出第一参考信号端的信号或输出第二参考信号端的信号，通过控制第三节点和第四节点的电位，使得扫描信号输出模块可以持续输出第二参考信号端的信号或输出第二时钟信号端的信号，这样可以实现输出多脉宽宽度的发光信号和多个发光信号触发脉冲控制扫描输出，即将发光移位寄存器单元与扫描移位寄存器单元整合到一个电路结构中的前提下，实现了发光信号与扫描信号的占空比控制。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，发光信号输出模块可以具体包括：第一输出单元051和第二输出单元052；其中，第一输出单元051的控制端与第五节点P5相连，输入端与第二参考信号端VGH相连，输出端与发光信号输出端EM相连；第一输出单元051用于在第五节点P5的控制下，将第二参考信号端VGH的信号输出到发光信号输出端EM；第二输出单元052的控制端与第一节点P1相连，输入端与第一参考信号端VGL相连，输出端与发光信号输出端EM相连；第二输出单元052用于在第一节点P1的控制下，将第一参考信号端VGL的信号输出到发光信号输出端EM。具体地，发光信号输出模块可以具体包括第一输出单元和第二输出单元，从而在第一节点的控制下可以通过第二输出单元持续输出第一参考信号端的信号，在第五节点的控制下通过第一输出单元输出第二参考信号端的信号。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第一输出单元051可以具体包括：第一开关晶体管T1和第一电容C1；其中，第一开关晶体管T1的栅极与第五节点P5相连，源极与第二参考信号端VGH相连，漏极与发光信号输出端EM相连；第一电容C1连接于第二参考信号端VGH和第五节点P5之间。具体地，第一开关晶体管可以在第五节点的控制下导通，导通的第一开关晶体管将第二参考信号端与发光信号输出端导通，从而将第二参考信号端的信号输出到发光信号输出端。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第二输出单元052可以具体包括：第二开关晶体管T2和第二电容C2；其中，第二开关晶体管T2的栅极与第一节点P1相连，源极与第一参考信号端VGL相连，漏极与发光信号输出端EM相连；第二电容C2连接于第一节点P1和发光信号输出端EM之间。具体地，第二开关晶体管可以在第一节点的控制下导通，导通的第二开关晶体管将第一参考信号端与发光信号输出端导通，从而将第一参考信号端的信号输出到发光信号输出端。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，扫描信号输出模块可以具体包括：第三输出单元061和第四输出单元062；其中，第三输出单元061的控制端与第四节点P4相连，输入端与第二参考信号端VGH相连，输出端与扫描信号输出端Gate相连；第三输出单元061用于在第四节点P4的控制下，将第二参考信号端VGH的信号输出到扫描信号输出端Gate；第四输出单元062的控制端与第三节点P3相连，输入端与第二时钟信号端CLK2相连，输出端与扫描信号输出端Gate相连；第四输出单元062用于在第三节点P3的控制下，将第二时钟信号端CLK2的信号输出到扫描信号输出端Gate。具体地，扫描信号输出模块可以具体包括第三输出单元和第四输出单元，从而在第四节点的控制下可以通过第三输出单元持续输出第二参考信号端的信号，在第三节点的控制下通过第四输出单元输出第二时钟信号端的信号。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第三输出单元可以具体包括：第三开关晶体管T3和第三电容C3；其中，第三开关晶体管T3的栅极与第四节点P4相连，源极与第二参考信号端VGH相连，漏极与扫描信号输出端Gate相连；第三电容C3连接于第四节点P4和第二参考信号端VGH之间。具体地，第三开关晶体管可以在第四节点的控制下导通，导通的第三开关晶体管将第二参考信号端与扫描信号输出端导通，从而将第二参考信号端的信号输出到扫描信号输出端。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如如2所示，第四输出单元可以具体包括：第四开关晶体管T4和第四电容C4；其中，第四开关晶体管T4的栅极与第三节点P3相连，源极与第二时钟信号端CLK2相连，漏极与扫描信号输出端Gate相连；第四电容C4连接于第三节点P3和扫描信号输出端Gate之间。具体地，第四开关晶体管可以在第三节点的控制下导通，导通的第四开关晶体管将第二时钟信号端与扫描信号输出端导通，从而将第二时钟信号端的信号输出到扫描信号输出端。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第一控制模块可以具体包括：第一控制单元031和第二控制单元032；其中，
第一控制单元031的第一控制端与第二节点P2相连，第二控制端与第二时钟信号端CLK2相连，输入端与第一参考信号端VGL相连，输出端与第五节点P5相连；第一控制单元031用于在第二节点P2和第二时钟信号端CLK2的控制下，将第一参考信号端VGL的信号输出到第五节点P5；第二控制单元032的控制端与第一节点P1相连，输入端与第二参考信号端VGH相连，输出端与第五节点P5相连；第二控制单元032用于在第一节点P1的控制下，将第二参考信号端VGH的信号输出到第五节点P5。具体地，第一控制模块可以具体包括第一控制单元和第二控制单元，从而在第二节点和第二时钟信号端的控制下可以通过第一控制单元将第一参考信号端的信号输出到第五节点，在第一节点的控制下通过第二控制单元将第二参考信号端的信号输出到第五节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第一控制单元可以具体包括：第五开关晶体管T5、第六开关晶体管T6和第五电容C5；其中，第五开关晶体管T5的栅极与第二节点P2相连，源极与第一参考信号端VGL相连，漏极与第六开关晶体管T6的源极相连；第六开关晶体管T6的栅极与第二时钟信号端CLK2相连，漏极与第五节点P5相连；第五电容C5连接于第二节点P2和第二时钟信号端CLK2之间。具体地，第五开关晶体管可以在第二节点的控制下导通，导通的第五开关晶体管将第一参考信号端与第六开关晶体管的源极导通，进而将第一参考信号端的信号输出到第六开关晶体管的源极；第六开关晶体管可以在第二时钟信号端的控制下导通，进而将源极的信号输出到第五节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第二控制单元可以具体包括：第七开关晶体管T7；第七开关晶体管T7的栅极与第一节点P1相连，源极与第二参考信号端VGH相连，漏极与第五节点P5相连。具体地，第七开关晶体管可以在第一节点的控制下导通，导通的第七开关晶体管将第二参考信号端与第五节点导通，进而将第二参考信号端的信号输出到第五节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第一输入模块可以具体包括：第一输入单元011和第二输入单元012；其中，第一输入单元011的控制端与第一时钟信号端CLK1相连，第一输入端与第一参考信号端VGL相连，第二输入端与第一信号输入端STVE相连，第一输出端与第一节点P1相连，第二输出端与第二节点P2相连；第一输入单元011用于在第一时钟信号端CLK1的控制下，将第一信号输入端STVE的信号和第一参考信号端VGL的信号分别输出到第一节点P1和第二节点P2；第二输入单元012的控制端与第一节点P1相连，输入端与第一时钟信号端CLK1相连，输出端与第二节点P2相连；第二输入单元012用于在第一节点P1的控制下，将第一时钟信号端CLK1的信号输出到第二节点P2。具体地，第一输入模块可以具体包括第一输入单元和第二输入单元，从而在第一时钟信号端的控制下可以通过第一输入单元将第一信号输入端的信号和第一参考信号端的信号分别输出到第一节点和第二节点，在第一节点的控制下通过第二输入单元将第一时钟信号端的信号输出到第二节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第一输入单元011可以具体包括：第八开关晶体管T8和第九开关晶体管T9；其中，第八开关晶体管T8的栅极与第一时钟信号端CLK1相连，源极与第一信号输入端STVE相连，漏极与第一节点P1相连；第九开关晶体管T9的栅极与第一时钟信号端CLK1相连，源极与第一参考信号端VGL相连，漏极与第二节点P2相连。具体地，第八开关晶体管可以在第一时钟信号端的控制下导通，导通的第八开关晶体管将第一信号输入端与第一节点导通，进而将第一信号输入端的信号输出到第一节点；第九开关晶体管可以在第一时钟信号端的控制下导通，导通的第九开关晶体管将第一参考信号端与第二节点导通，进而将第一参考信号端的信号输出到第二节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第二输入单元可以具体包括：第十开关晶体管T10；第十开关晶体管T10的栅极与第一节点P1相连，源极与第一时钟信号端CLK1相连，漏极与第二节点P2相连。具体地，第十开关晶体管可以在第一节点的控制下导通，导通的第十开关晶体管将第一时钟信号端与第二节点导通，进而将第一时钟信号端的信号输出到第二节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第二输入模块可以具体包括：第三输入单元021和第四输入单元022；其中，第三输入单元021的控制端与第一时钟信号端CLK1相连，第一输入端与第一参考信号端VGL相连，第二输入端与第二信号输入端STVG相连，第一输出端与第三节点P3相连，第二输出端与第四节点P4相连；第三输入单元021用于在第一时钟信号端CLK1的控制下，将第二信号输入端STVG的信号和第一参考信号端VGL的信号分别输出到第三节点P3和第四节点P4；第四输入单元022的控制端与第三节点P3相连，输入端与第一时钟信号端CLK1相连，输出端与第四节点P4相连；第四输入单元022用于在第三节点P3的控制下，将第一时钟信号端CLK1的信号输出到第四节点P4。具体地，第二输入模块可以具体包括第三输入单元和第四输入单元，从而在第一时钟信号端的控制下可以通过第三输入单元将第二信号输入端的信号和第一参考信号端的信号分别输出到第三节点和第四节点，在第三节点的控制下通过第四输入单元将第一时钟信号端的信号输出到第四节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第三输入单元可以具体包括：第十一开关晶体管T11和第十二开关晶体管T12；其中，第十一开关晶体管T11的栅极与第一时钟信号端CLK1相连，源极与第二信号输入端STVG相连，漏极与第三节点P3相连；第十二开关晶体管T12的栅极与第一时钟信号端CLK1相连，源极与第一参考信号端VGL相连，漏极与第四节点P4相连。具体地，第十一开关晶体管可以在第一时钟信号端的控制下导通，导通的第十一开关晶体管将第二信号输入端与第三节点导通，进而将第二信号输入端的信号输出到第三节点；第十二开关晶体管可以在第一时钟信号端的控制下导通，导通的第十二开关晶体管将第一参考信号端与第四节点导通，进而将第一参考信号端的信号输出到第四节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第四输入单元可以具体包括：第十三开关晶体管T13；第十三开关晶体管T13的栅极与第三节点P3相连，源极与第一时钟信号端CLK1相连，漏极与第四节点P4相连。具体地，第十三开关晶体管可以在第三节点的控制下导通，导通的第十三开关晶体管将第一时钟信号端与第四节点导通，进而将第一时钟信号端的信号输出到第四节点。
在具体实施时，本发明实施例提供的上述移位寄存器单元中，如图2所示，第二控制模块可以具体包括：第十四开关晶体管T14、第十五开关晶体管T15和第十六开关晶体管T16；其中，第十四开关晶体管T14的栅极与第四节点P4相连，源极与第二参考信号端VGH相连，漏极分别与第十五开关晶体管T15的源极和第十六开关晶体管T16的源极相连；第十五开关晶体管T15的栅极与第一节点P1相连，漏极与第三节点P3相连；第十六开关晶体管T16的栅极与第五节点P5相连，漏极与第三节点P3相连。具体地，第十四开关晶体管可以在第四节点的控制下导通，导通的第十四开关晶体管将第二参考信号端与第十五开关晶体管的源极和第十六开关晶体管的源极，进而将第二参考信号端的信号分别输出到第十五开关晶体管的源极和第十六开关晶体管的源极；第十五开关晶体管可以在第一节点的控制下导通，导通的第十五开关晶体管将源极的信号输出到第三节点；第十六开关晶体管可以在第五节点的控制下导通，导通的第十六开关晶体管将源极的信号输出到第三节点。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，ThinFilmTransistor)，也可以是金属氧化物半导体场效应管(MOS，MetalOxideSemiconductor)，在此不做限定。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
下面结合本发明实施例提供的移位寄存器单元电路结构和工作时序对本发明实施例提供的移位寄存器单元的工作过程进行详细描述。以如图2所示的采用P型晶体管设计的移位寄存器单元以及图3所示的图2的输入输出时序图，对本发明实施例提供的移位寄存器单元的工作过程作以描述。具体地，选取如图3所示的输入输出时序图中的t1～t8八个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在t1阶段，STVE＝0，STVG＝1，CLK1＝0，CLK2＝1，VGL＝0，VGH＝1。由于CLK1＝0，因此，第八开关晶体管T8、第九开关晶体管T9、第十一开关晶体管T11和第十二开关晶体管T12导通；导通的第八开关晶体管T8将第一信号输入端STVE与第一节点P1导通，进而将第一信号输入端STVE的信号输出到第一节点P1，此时由于STVE＝0，因此第二开关晶体管T2、第七开关晶体管T7、第十开关晶体管T10和第十五开关晶体管T15导通；导通的第二开关晶体管T2将第一参考信号端VGL与发光信号输出端EM导通，由于VGL＝0，因此使得发光信号输出端EM输出低电平信号；导通的第七开关晶体管T7将第二参考信号端VGH与第五节点P5导通，进而使得第一开关晶体管T1截止；导通的第九开关晶体管T9和第十开关晶体管T10分别将第一参考信号端VGL的信号和第一时钟信号端CLK1的信号输出到第二节点P2；导通的第十一开关晶体管T11将第二信号输入端STVG与第三节点P3导通，由于STVG＝1，进而第四开关晶体管T4在第三节点P3的控制下截止；导通的第十二开关晶体管T12将第一参考信号端VGL与第四节点P4导通，进而第三开关晶体管T3在第四节点P4的控制下导通，导通的第三开关晶体管T3将第二参考信号端VGH与扫描信号输出端Gate导通，由于VGH＝1，因此使得扫描信号输出端Gate输出高电平信号；同时第十四开关晶体管T14在第四节点P4的控制下也处于导通状态，导通的第十四开关晶体管T14与导通的第十五开关晶体管T15将第二参考信号端VGH与第三节点P3导通，使第三节点P3保持高电位；在t1阶段的后半段，第一信号输入端STVE、第二信号输入端STVG和第二时钟信号端CLK2输入的信号不变，第一时钟信号端CLK1输入的信号由低电平信号变为高电平信号，从而使得导通的第十开关晶体管T10将第一时钟信号端CLK1的高电平信号输出到第二节点P2，从而使得第五开关晶体管T5处于截止状态。
在t2阶段，STVE＝0，STVG＝1，CLK1＝1，CLK2＝0，VGL＝0，VGH＝1。由于CLK2＝0，因此，第六开关晶体管T6导通；由于在t1阶段的后半段将第二节点P2的电位拉高使得第五开关晶体管T5处于截止状态，因此在t2阶段第二节点P2的电位由于第五电容C5的作用保持高电位，因此第一参考信号端VGL的信号不会通过第五开关晶体管T5和第六开关晶体管T6输出到第一节点P1，第一节点P1保持上一阶段的低电位，第二开关晶体管T2仍处于导通状态，从而发光信号输出端EM仍输出第一参考信号端VGL的信号；同时，第四节点P4保持上一阶段的低电位，因此第三开光晶体管T3处于导通状态，扫描信号输出端Gate输出第二参考信号端VGH的信号。
在t3阶段，STVE＝1，STVG＝0，CLK1＝0，CLK2＝1，VGL＝0，VGH＝1。由于CLK1＝0，因此，第八开关晶体管T8、第九开关晶体管T9、第十一开关晶体管T11和第十二开关晶体管T12导通；导通的第八开关晶体管T8将第一信号输入端STVE与第一节点P1导通，进而将第一信号输入端STVE的信号输出到第一节点P1，此时由于STVE＝1，因此第二开关晶体管T2、第七开关晶体管T7、第十开关晶体管T10和第十五开关晶体管T15截止；导通的第九开关晶体管T9将第一参考信号端VGL与第二节点P2导通，由于VGL＝0，因此使得第五开关晶体管T5导通，由于此时CLK2＝1因此第六开关晶体管T6截止；导通的第十一开关晶体管T11将第二信号输入端STVG与第三节点P3导通，由于STVG＝0，进而第四开关晶体管T4和第十三开关晶体管T13在第三节点P3的控制下导通；导通的第四开关晶体管T4将第二时钟信号端CLK2与扫描信号输出端Gate导通，由于此时CLK2＝1，进而使得扫描信号输出端Gate输出高电平信号；同时，导通的第十三开关晶体管T13将第一时钟信号端CLK1与第四节点P4导通，由于此时CLK1＝0，因此第三开关晶体管T3在第四节点P4的控制下导通，导通的第三开关晶体管T3将第二参考信号端VGH与扫描信号输出端Gate导通，由于VGH＝1，因此使得扫描信号输出端Gate输出高电平信号；在此阶段由于第一节点P1和第五节点P5均为高电位，因此第一开关晶体管T1和第二开关晶体管T2均处于截止状态，发光信号输出端EM保持上一阶段的输出状态，即输出低电平信号。
在t4阶段，STVE＝1，STVG＝1，CLK1＝1，CLK2＝0，VGL＝0，VGH＝1。由于CLK2＝0，因此，第六开关晶体管T6导通；此时第二节点P2由于第五电容C5的作用保持上一阶段的低电位，因此第五开关晶体管T5处于导通状态，从而第一参考信号端VGL的信号通过导通的第五开关晶体管T5和第六开关晶体管T6输出到第五节点P5，因此第一开关晶体管T1在第五节点P5的控制下导通，进而将第二参考信号端VGH的信号输出到发光信号输出端EM；此时，由于第二时钟信号端CLK2的信号由高电平变为低电平，因此第四开关晶体管T4通过栅源间耦合电容即第四电容C4的自举作用，将第三节点P3的电位进一步拉低，因此第四开关晶体管T4在第三节点P3的控制下导通，进而将第二时钟信号端CLK2的信号输出到扫描信号输出端Gate，由于此时CLK2＝0，因此扫描信号输出端Gate输出低电平信号，同时第十三开关晶体管T13在第三节点P3的控制下导通，将第一时钟信号端CLK1的信号输出到第四节点P4，此时CLK1＝1，因此保持第四节点P4的电位位高电位，使第三开关晶体管T3处于截止状态。
在t5阶段，STVE＝1，STVG＝1，CLK1＝0，CLK2＝1，VGL＝0，VGH＝1。由于CLK1＝0，因此，第八开关晶体管T8、第九开关晶体管T9、第十一开关晶体管T11和第十二开关晶体管T12导通；导通的第八开关晶体管T8将第一信号输入端STVE的信号输出到第一节点P1，此时由于STVE＝1，因此第二开关晶体管T2、第七开关晶体管T7、第十开关晶体管T10和第十五开关晶体管T15截止；导通的第九开关晶体管T9将第一参考信号端VGL的信号输出到第二节点P2；导通的第十一开关晶体管T11将第二信号输入端STVG的信号输出到第三节点P3，此时STVG＝1，因此第十三开关晶体管T13和第四开关晶体管T4截止；导通的第十二开关晶体管T12将第一参考信号端VGL的信号输出到第四节点P4，因此第三开关晶体管T3和第十四开关晶体管T14导通，导通的第三开关晶体管T3将第二参考信号端VGH的信号输出到扫描信号输出端Gate，同时第五节点P2保持上一阶段的低电位，因此第一开关晶体管T1和第十六开关晶体管T16导通，导通的第一开关晶体管T1将第二参考信号端VGH的信号输出到发光信号输出端EM，同时第二参考信号端VGH的信号通过导通的第十四开关晶体管T14和第十六开关晶体管T16输出到第三节点P3，进一步保持第三节点P3的高电位。
在t6阶段，STVE＝0，STVG＝1，CLK1＝1，CLK2＝0，VGL＝0，VGH＝1。由于CLK2＝0，因此第六开关晶体管T6导通，此时第二节点P2由于第五电容C5的作用保持上一阶段低电位，因此第五开关晶体管T5导通，第一参考信号端VGL的信号通过导通的第五开关晶体管T5和第六开关晶体管T6输出到第五节点P5，因此第一开关晶体管T1和第十六开关晶体管T16导通，导通的第一开关晶体管T1将第二参考信号端VGH的信号输出到发光信号输出端EM；同时第四节点P4保持上一阶段的低电位，因此第三开关晶体管T3和第十四开关晶体管T14导通，导通的第三开关晶体管T3将第二参考信号端VGH的信号输出到扫描信号输出端Gate，且第二参考信号端VGH的信号通过导通的第十四开关晶体管T14和第十六开关晶体管T16输出到第三节点P3，进一步保持第三节点P3的高电位。
在t7阶段，STVE＝0，STVG＝1，CLK1＝0，CLK2＝1，VGL＝0，VGH＝1。由于CLK1＝0，因此第八开关晶体管T8、第九开关晶体管T9、第十一开关晶体管T11和第十二开关晶体管T12导通；导通的第八开关晶体管T8将第一信号输入端STVE的信号输出到第一节点P1，此时由于STVE＝0，因此第二开关晶体管T2、第七开关晶体管T7、第十开关晶体管T10和第十五开关晶体管T15导通；导通的第二开关晶体管T2将第一参考信号端VGL与发光信号输出端EM导通，由于VGL＝0，因此使得发光信号输出端EM输出低电平信号；导通的第七开关晶体管T7将第二参考信号端VGH与第五节点P5导通，进而使得第一开关晶体管T1截止；导通的第九开关晶体管T9和第十开关晶体管T10分别将第一参考信号端VGL的信号和第一时钟信号端CLK1的信号输出到第二节点P2；导通的第十一开关晶体管T11将第二信号输入端STVG与第三节点P3导通，由于STVG＝1，进而第四开关晶体管T4在第三节点P3的控制下截止；导通的第十二开关晶体管T12将第一参考信号端VGL与第四节点P4导通，进而第三开关晶体管T3在第四节点P4的控制下导通，导通的第三开关晶体管T3将第二参考信号端VGH与扫描信号输出端Gate导通，由于VGH＝1，因此使得扫描信号输出端Gate输出高电平信号；同时第十四开关晶体管T14在第四节点P4的控制下也处于导通状态，导通的第十四开关晶体管T14与导通的第十五开关晶体管T15将第二参考信号端VGH与第三节点P3导通，使第三节点P3保持高电位；在t7阶段的后半段，第一信号输入端STVE、第二信号输入端STVG和第二时钟信号端CLK2输入的信号不变，第一时钟信号端CLK1输入的信号由低电平信号变为高电平信号，从而使得导通的第十开关晶体管T10将第一时钟信号端CLK1的高电平信号输出到第二节点P2，从而使得第五开关晶体管T5处于截止状态。
在t8阶段，STVE＝0，STVG＝1，CLK1＝1，CLK2＝0，VGL＝0，VGH＝1。由于CLK2＝0，因此，第六开关晶体管T6导通；由于在t7阶段的后半段将第二节点P2的电位拉高使得第五开关晶体管T5处于截止状态，因此在t8阶段第二节点P2的电位由于第五电容C5的作用保持高电位，因此第一参考信号端VGL的信号不会通过第五开关晶体管T5和第六开关晶体管T6输出到第一节点P1，第一节点P1保持上一阶段的低电位，第二开关晶体管T2仍处于导通状态，从而发光信号输出端EM仍输出第一参考信号端VGL的信号；同时，第四节点P4保持上一阶段的低电位，因此第三开光晶体管T3处于导通状态，扫描信号输出端Gate输出第二参考信号端VGH的信号。
之后的阶段中在第一信号输入端STVE保持低电平信号时，将不断重复t7和t8的工作状态。当第一信号输入端STVE再次触发成高电平信号时，将重复t3，t4，t5的过程，直到第一信号输入端STVE由高电平信号再次变为低电平信号时，将在完成t6过程后重复t7和t8的过程。其中在重复t3、t4、t5过程中，在重复t3时，第一信号输入端STVE的信号一直为高电平信号，因为在t3阶段中第一信号输入端STVE、第二时钟信号端CLK2处于高电平状态，第二信号输入端STVG、第一时钟信号端CLK1处于低电平状态，这样第一时钟信号端CLK1控制的第八开关晶体管T8、第九开关晶体管T9、第十一开关晶体管T11和第十二开关晶体管T12导通；第十二开关晶体管T12的导通将第一参考信号端VGL写入到第四节点P4，进而将第三开关晶体管T3导通，从而将第二参考信号端VGH的信号输出到扫描信号输出端Gate，同时第二信号输入端STVG的低电平信号输出到第三节点P3，使第十三开关晶体管T13和第四开关晶体管T4处于导通状态，导通的第四开关晶体管T4将第二时钟信号端CLK2与扫描信号输出端Gate导通，由于此时CLK2＝1，进而使得扫描信号输出端Gate输出高电平信号；同时由于第八开关晶体管T8的导通，将第一信号输入端STVE输出到第一节点P1，此时STVE＝1，使得第一节点P1为高电位，因此第二开关晶体管T2截止，且第五节点P5保持上一阶段的高电位，因此第一开关晶体管T1处于截止状态，发光信号输出端EM保持上一阶段的输出状态，即输出低电平信号。之后的过程就是重复t4和t5，使发光信号输出端EM持续输出第一参考信号端VGL的低电平信号，扫描信号输出端Gate持续输出第二参考信号端VGH的高电平信号。这样就实现了发光信号输出端EM输出多脉宽宽度的发光信号，以及多个发光信号触发脉冲控制扫描输出，即实现了发光信号与扫描信号的占空比控制。
基于同一发明构思，本发明实施例提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述移位寄存器单元，除最后一个移位寄存器单元之外，其余每个移位寄存器单元的发光信号输出端均向与其相邻的下一级移位寄存器单元的第一信号输入端输入触发信号，扫描信号输出端均向与其相邻的下一级移位寄存器单元的第二信号输入端输入触发信号。
为了方便说明，图4中仅示出了八个移位寄存器单元，分别为第1级移位寄存器单元、第2级移位寄存器单元、第3级移位寄存器单元、第4级移位寄存器单元、第N-3级移位寄存器单元、第N-2级移位寄存器单元、第N-1级移位寄存器单元、第N级移位寄存器单元。其中，第N-1级移位寄存器单元的发光信号输出端EM向第N级移位寄存器单元的第一信号输入端输出触发信号，扫描信号输出端Gate向第N级移位寄存器单元的第二信号输入端输出触发信号，其中第一时钟信号端CLK1和第二时钟信号端CLK2在下一级中的位置和本级中的位置互换。
基于同一发明构思，本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。由于该显示面板解决问题的原理与栅极驱动电路相似，因此该显示面板的实施可以参见上述栅极驱动电路的实施，重复之处不再赘述。
基于同一发明构思，本发明实施例提供了一种显示装置，包括本发明实施例提供的上述显示面板。该显示装置可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示装置解决问题的原理与显示面板相似，因此该显示装置的实施可以参见上述显示面板的实施，重复之处不再赘述。
本发明实施例提供了一种移位寄存器单元、栅极驱动电路、显示面板及显示装置移位寄存器单元，该移位寄存器单元包括：第一输入模块、第二输入模块、第一控制模块、第二控制模块、发光信号输出模块和扫描信号输出模块；其中，第一输入模块用于在第一时钟信号端控制下，将第一信号输入端的信号和第一参考信号端的信号分别输出到第一节点和所述第二节点，在第一节点的控制下，将第一时钟信号端的信号输出到第二节点；第二输入模块用于在第一时钟信号端控制下，将第二信号输入端的信号和第一参考信号端的信号分别输出到第三节点和第四节点，在第三节点的控制下，将第一时钟信号端的信号输出到第四节点；第一控制模块用于在第二节点和第二时钟信号端的控制下将第一参考信号端的信号输出到第五节点，在第一节点的控制下将第二参考信号端的信号输出到第五节点；第二控制模块用于在第四节点、第一节点和第五节点的控制下，将第二参考信号端的信号输出到第三节点；发光信号输出模块用于在第一节点和第五节点的控制下，将第一参考信号端的信号或第二参考信号端的信号输出到发光信号输出端；扫描信号输出模块用于在第三节点和第四节点的控制下，将第二参考信号端的信号或第二时钟信号端的信号输出到扫描信号输出端。
具体地，本发明实施例提供的上述移位寄存器单元，各模块在各自的控制信号端的控制下输出对应的信号，可以实现扫描信号和发光信号的输出；同时发光信号输出模块和扫描信号输出模块相结合，从而可以实现将发光移位寄存器单元和扫描移位寄存器单元整合在一个电路结构中，减少控制时钟的数量；且本发明实施例提供的移位寄存器单元是一种可以同步输出可调脉宽和周期常开型移位寄存器单元，通过控制第一节点和第五节点的电位，使得发光信号输出模块可以持续输出第一参考信号端的信号或输出第二参考信号端的信号，通过控制第三节点和第四节点的电位，使得扫描信号输出模块可以持续输出第二参考信号端的信号或输出第二时钟信号端的信号，这样可以实现输出多脉宽宽度的发光信号和多个发光信号触发脉冲控制扫描输出，即将发光移位寄存器单元与扫描移位寄存器单元整合到一个电路结构中的前提下，实现了发光信号与扫描信号的占空比控制。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (20)

1.一种移位寄存器单元，其特征在于，包括：第一输入模块、第二输入模块、第一控制模块、第二控制模块、发光信号输出模块和扫描信号输出模块；其中，
所述第一输入模块的第一控制端和第一输入端分别与第一时钟信号端相连，第二控制端和第一输出端分别与第一节点相连，第二输入端与第一信号输入端相连，第三输入端与第一参考信号端相连，第二输出端与第二节点相连；所述第一输入模块用于在所述第一时钟信号端控制下，将所述第一信号输入端的信号和所述第一参考信号端的信号分别输出到所述第一节点和所述第二节点，在所述第一节点的控制下，将所述第一时钟信号端的信号输出到所述第二节点；
所述第二输入模块的第一控制端和第一输入端分别与所述第一时钟信号端相连，第二控制端和第一输出端分别与第三节点相连，第二输入端与第二信号输入端相连，第三输入端与所述第一参考信号端相连，第二输出端与第四节点相连；所述第二输入模块用于在所述第一时钟信号端控制下，将所述第二信号输入端的信号和所述第一参考信号端的信号分别输出到所述第三节点和所述第四节点，在所述第三节点的控制下，将所述第一时钟信号端的信号输出到所述第四节点；
所述第一控制模块的第一控制端与所述第二节点相连，第二控制端与第二时钟信号端相连，第三控制端与所述第一节点相连，第一输入端与第二参考信号端相连，第二输入端与所述第一参考信号端相连，输出端与第五节点相连；所述第一控制模块用于在所述第二节点和所述第二时钟信号端的控制下将所述第一参考信号端的信号输出到所述第五节点，在所述第一节点的控制下将所述第二参考信号端的信号输出到所述第五节点；
所述第二控制模块的第一控制端与所述第四节点相连，第二控制端与所述第一节点相连，第三控制端与所述第五节点相连，输入端与所述第二参考信号端相连，输出端与所述第三节点相连；所述第二控制模块用于在所述第四节点、所述第一节点和所述第五节点的控制下，将所述第二参考信号端的信号输出到所述第三节点；
所述发光信号输出模块的第一控制端与所述第一节点相连，第二控制端与所述第五节点相连，第一输入端与所述第一参考信号端相连，第二输入端与所述第二参考信号端相连，输出端与发光信号输出端相连；所述发光信号输出模块用于在所述第一节点和所述第五节点的控制下，将所述第一参考信号端的信号或所述第二参考信号端的信号输出到所述发光信号输出端；
所述扫描信号输出模块的第一控制端与所述第三节点相连，第二控制端与所述第四节点相连，第一输入端与所述第二参考信号端相连，第二输入端与所述第二时钟信号端相连，输出端与扫描信号输出端相连；所述扫描信号输出模块用于在所述第三节点和所述第四节点的控制下，将所述第二参考信号端的信号或所述第二时钟信号端的信号输出到所述扫描信号输出端。
2.如权利要求1所述的移位寄存器单元，其特征在于，所述发光信号输出模块，具体包括：第一输出单元和第二输出单元；其中，
所述第一输出单元的控制端与所述第五节点相连，输入端与所述第二参考信号端相连，输出端与所述发光信号输出端相连；所述第一输出单元用于在所述第五节点的控制下，将所述第二参考信号端的信号输出到所述发光信号输出端；
所述第二输出单元的控制端与所述第一节点相连，输入端与所述第一参考信号端相连，输出端与所述发光信号输出端相连；所述第二输出单元用于在所述第一节点的控制下，将所述第一参考信号端的信号输出到所述发光信号输出端。
3.如权利要求2所述的移位寄存器单元，其特征在于，所述第一输出单元，具体包括：第一开关晶体管和第一电容；其中，
所述第一开关晶体管的栅极与所述第五节点相连，源极与所述第二参考信号端相连，漏极与所述发光信号输出端相连；
所述第一电容连接于所述第二参考信号端和所述第五节点之间。
4.如权利要求2所述的移位寄存器单元，其特征在于，所述第二输出单元，具体包括：第二开关晶体管和第二电容；其中，
所述第二开关晶体管的栅极与所述第一节点相连，源极与所述第一参考信号端相连，漏极与所述发光信号输出端相连；
所述第二电容连接于所述第一节点和所述发光信号输出端之间。
5.如权利要求1所述的移位寄存器单元，其特征在于，所述扫描信号输出模块，具体包括：第三输出单元和第四输出单元；其中，
所述第三输出单元的控制端与所述第四节点相连，输入端与所述第二参考信号端相连，输出端与所述扫描信号输出端相连；所述第三输出单元用于在所述第四节点的控制下，将所述第二参考信号端的信号输出到所述扫描信号输出端；
所述第四输出单元的控制端与所述第三节点相连，输入端与所述第二时钟信号端相连，输出端与所述扫描信号输出端相连；所述第四输出单元用于在所述第三节点的控制下，将所述第二时钟信号端的信号输出到所述扫描信号输出端。
6.如权利要求5所述的移位寄存器单元，其特征在于，所述第三输出单元，具体包括：第三开关晶体管和第三电容；其中，
所述第三开关晶体管的栅极与所述第四节点相连，源极与所述第二参考信号端相连，漏极与所述扫描信号输出端相连；
所述第三电容连接于所述第四节点和所述第二参考信号端之间。
7.如权利要求5所述的移位寄存器单元，其特征在于，所述第四输出单元，具体包括：第四开关晶体管和第四电容；其中，
所述第四开关晶体管的栅极与所述第三节点相连，源极与所述第二时钟信号端相连，漏极与所述扫描信号输出端相连；
所述第四电容连接于所述第三节点和所述扫描信号输出端之间。
8.如权利要求1所述的移位寄存器单元，其特征在于，所述第一控制模块，具体包括：第一控制单元和第二控制单元；其中，
所述第一控制单元的第一控制端与所述第二节点相连，第二控制端与所述第二时钟信号端相连，输入端与所述第一参考信号端相连，输出端与所述第五节点相连；所述第一控制单元用于在所述第二节点和所述第二时钟信号端的控制下，将所述第一参考信号端的信号输出到所述第五节点；
所述第二控制单元的控制端与所述第一节点相连，输入端与所述第二参考信号端相连，输出端与所述第五节点相连；所述第二控制单元用于在所述第一节点的控制下，将所述第二参考信号端的信号输出到所述第五节点。
9.如权利要求8所述的移位寄存器单元，其特征在于，所述第一控制单元，具体包括：第五开关晶体管、第六开关晶体管和第五电容；其中，
所述第五开关晶体管的栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述第六开关晶体管的源极相连；
所述第六开关晶体管的栅极与所述第二时钟信号端相连，漏极与所述第五节点相连；
所述第五电容连接于所述第二节点和所述第二时钟信号端之间。
10.如权利要求8所述的移位寄存器单元，其特征在于，所述第二控制单元，具体包括：第七开关晶体管；
所述第七开关晶体管的栅极与所述第一节点相连，源极与所述第二参考信号端相连，漏极与所述第五节点相连。
11.如权利要求1所述的移位寄存器单元，其特征在于，所述第一输入模块，具体包括：第一输入单元和第二输入单元；其中，
所述第一输入单元的控制端与所述第一时钟信号端相连，第一输入端与所述第一参考信号端相连，第二输入端与所述第一信号输入端相连，第一输出端与所述第一节点相连，第二输出端与所述第二节点相连；所述第一输入单元用于在所述第一时钟信号端的控制下，将所述第一信号输入端的信号和所述第一参考信号端的信号分别输出到所述第一节点和所述第二节点；
所述第二输入单元的控制端与所述第一节点相连，输入端与所述第一时钟信号端相连，输出端与所述第二节点相连；所述第二输入单元用于在所述第一节点的控制下，将所述第一时钟信号端的信号输出到所述第二节点。
12.如权利要求11所述的移位寄存器单元，其特征在于，所述第一输入单元，具体包括：第八开关晶体管和第九开关晶体管；其中，
所述第八开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第一信号输入端相连，漏极与所述第一节点相连；
所述第九开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第一参考信号端相连，漏极与所述第二节点相连。
13.如权利要求11所述的移位寄存器单元，其特征在于，所述第二输入单元，具体包括：第十开关晶体管；
所述第十开关晶体管的栅极与所述第一节点相连，源极与所述第一时钟信号端相连，漏极与所述第二节点相连。
14.如权利要求1所述的移位寄存器单元，其特征在于，所述第二输入模块，具体包括：第三输入单元和第四输入单元；其中，
所述第三输入单元的控制端与所述第一时钟信号端相连，第一输入端与所述第一参考信号端相连，第二输入端与所述第二信号输入端相连，第一输出端与所述第三节点相连，第二输出端与所述第四节点相连；所述第三输入单元用于在所述第一时钟信号端的控制下，将所述第二信号输入端的信号和所述第一参考信号端的信号分别输出到所述第三节点和所述第四节点；
所述第四输入单元的控制端与所述第三节点相连，输入端与所述第一时钟信号端相连，输出端与所述第四节点相连；所述第四输入单元用于在所述第三节点的控制下，将所述第一时钟信号端的信号输出到所述第四节点。
15.如权利要求14所述的移位寄存器单元，其特征在于，所述第三输入单元，具体包括：第十一开关晶体管和第十二开关晶体管；其中，
所述第十一开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第二信号输入端相连，漏极与所述第三节点相连；
所述第十二开关晶体管的栅极与所述第一时钟信号端相连，源极与所述第一参考信号端相连，漏极与所述第四节点相连。
16.如权利要求14所述的移位寄存器单元，其特征在于，所述第四输入单元，具体包括：第十三开关晶体管；
所述第十三开关晶体管的栅极与所述第三节点相连，源极与所述第一时钟信号端相连，漏极与所述第四节点相连。
17.如权利要求1-16任一项所述的移位寄存器单元，其特征在于，所述第二控制模块，具体包括：第十四开关晶体管、第十五开关晶体管和第十六开关晶体管；其中，
所述第十四开关晶体管的栅极与所述第四节点相连，源极及与所述第二参考信号端相连，漏极分别与所述第十五开关晶体管的源极和第十六开关晶体管的源极相连；
所述第十五开关晶体管的栅极与所述第一节点相连，漏极与所述第三节点相连；
所述第十六开关晶体管的栅极与所述第五节点相连，漏极与所述第三节点相连。
18.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-17任一项所述的移位寄存器单元；除最后一个移位寄存器单元之外，其余每个移位寄存器单元的发光信号输出端均向与其相邻的下一级移位寄存器单元的第一信号输入端输入触发信号，扫描信号输出端均向与其相邻的下一级移位寄存器单元的第二信号输入端输入触发信号。
19.一种显示面板，其特征在于，包括如权利要求18所述的栅极驱动电路。
20.一种显示装置，其特征在于，包括如权利要求19所述的显示面板。
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