CN104750619A - 数据储存装置以及快闪存储器控制方法 - Google Patents

数据储存装置以及快闪存储器控制方法 Download PDF

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Abstract

本发明揭示快闪存储器所实现的数据储存装置以及快闪存储器控制技术,其中是分段将一物理区块所对应的物理-逻辑地址映射资讯封存至快闪存储器。一微控制器是设置来规划该快闪存储器提供一第一数据接收区块。在该第一数据接收区块上的一第一写入操作以及一第二写入操作之间,该微控制器基于一第一物理-逻辑映射表的仅部分空间更新一逻辑-物理地址映射表。该逻辑-物理地址映射表是维护于该快闪存储器中。该第一物理-逻辑地址映射表是建立于随机存取存储器中,负责记录一个物理区块的物理地址所对应的逻辑地址。

Description

数据储存装置以及快闪存储器控制方法
技术领域
本发明有关于快闪存储器(flash memory)实现的数据储存装置以及快闪存储器控制方法。
背景技术
现今数据储存装置常以快闪存储器(flash memory)为储存媒体。例如,快闪存储器常用作记忆卡(memory card)、通用串行汇流排闪存装置(USB flash device)、固态硬碟(SSD)…等产品。另外有一种应用是采多芯片封装、将一与非门型快闪存储器与其控制芯片包装在同一封装中─称为嵌入式快闪存储器模组(如eMMC)。
快闪存储器的实体空间通常包括多个物理区块(blocks)。各物理区块包括多个物理页(pages)。针对快闪存储器而设计的抹除操作须以物理区块为抹除单位,一物理区块接着一物理区块地释放储存空间。为了方便管理快闪存储器,各物理区块的物理-逻辑地址映射资讯动态收集于一挥发式存储器(例如,一静态随机存取存储器(SRAM))。传统技术中,针对一个完整物理区块动态收集到的物理-逻辑地址映射资讯是一次性地上传至该快闪存储器作非挥发性储存。一个完整物理区块的物理-逻辑地址映射资讯的上传非常耗时。
发明内容
本发明揭示快闪存储器所实现的数据储存装置以及快闪存储器控制方法,是分段将一物理区块所对应的物理-逻辑地址映射资讯上传至快闪存储器。
根据本发明一种实施方式所实现的数据储存装置包括一快闪存储器以及一控制单元。该快闪存储器是划分为多个物理区块。各物理区块包括多个物理页。该控制单元耦接该快闪存储器至一主机,且包括一微控制器以及一随机存取存储器。该微控制器是运作来配置该快闪存储器的这些物理区块其一为一第一数据接收区块。在该第一数据接收区块上的一第一写入操作以及一第二写入操作之间,该微控制器基于一第一物理-逻辑映射表的仅部分空间更新一逻辑-物理地址映射表。该逻辑-物理地址映射表是维护于该快闪存储器中。该第一物理-逻辑地址映射表是建立于该随机存取存储器上,记载一物理区块的物理页所对应的逻辑页。
根据本发明一种实施方式所实现的一快闪存储器控制方法包括以下步骤:配置一快闪存储器的多个物理区块其一为一第一数据接收区块,各物理区块包括多个物理页;并且在该第一数据接收区块上一第一写入操作以及一第二写入操作之间,根据一第一物理-逻辑地址映射表的仅部分内容更新一逻辑-物理地址映射表。该逻辑-物理地址映射表维护于该快闪存储器之上。该第一物理-逻辑地址映射表建立于该随机存取存储器上,记录一物理区块的逻辑地址所对应的物理地址。
下文特举实施例,并配合附图,详细说明本发明内容。
附图说明
图1图解了一快闪存储器100的储存空间规划;
图2为方块图,根据本发明一种实施方式实现一数据储存装置200,其中显示主机202以及快闪存储器204之间的映射资讯是如何建立且动态更新;
图3根据本发明一种实施方式图解了如此在区块内写入操作之间执行的局部F2HH2F封存,其中该物理-逻辑地址映射表F2H是根据该数据接收区块214上的写入操作建立于该随机存取存储器222上;
图4根据本发明另一种实施方式图解了如此在区块内写入操作之间执行的局部F2HH2F封存,其中该物理-逻辑地址映射表F2H是根据该数据接收区块214上的写入操作建立于该随机存取存储器222上;
图5根据本发明另一种实施方式图解了如此在区块内写入操作之间执行的局部F2HH2F封存,其中上述物理-逻辑地址映射表F2H是针对表格过期区块218建立于该随机存取存储器222中;
图6说明了两种不同型态写入操作所对应物理区块规划以及映射资讯更新。
符号说明
100~快闪存储器;102~物理页;
104、106、108以及110~物理区段;
200~数据储存装置;202~主机;
204~快闪存储器;206~控制单元;
208~系统内程序区块;210~系统资讯区块;
212~闲置区块;
214、214_1、214_2~数据接收区块;
216~数据集合;
218、218_1、218_2~表格过期区块;
220~微控制器;222~随机存取存储器;
224~只读存储器;
302、306、310以及314~各为32个物理页;
304、308、312以及316~对应302、306、310以及314的映射资讯;
402~多个物理页;404~一串4K尺寸数据;
406、408、410、412~各自为4K尺寸数据;
414、416、418、420~物理-逻辑地址映射资讯;
422~区域;
502、504、506、508~物理-逻辑地址映射资讯;
510、512、514、516~储存空间;
BLK1、BLK2…BLKN…~物理区块;
F2H、F2H1、F2H2~物理-逻辑地址映射表;
H2F~逻辑-物理地址映射表;
Hm(LBAk0~LBAk0+7)、Hm+1(LBAk1~LBAk1+7)、Hm+2(LBAk2~LBAk2+7)、Hm+3(LBAk3~LBAk3+7)~主机页。
具体实施方式
以下叙述列举本发明的多种实施例。以下叙述介绍本发明的基本概念,且并非意图限制本发明内容。实际发明范围应依照权利要求书界定。
图1图解了一快闪存储器100的储存空间规划。快闪存储器100所提供的储存空间划分为多个物理区块(blocks)BLK1、BLK2…BLKN…等。各物理区块包括多物理页(pages)。各物理页包括多物理区段(sectors)。例如,物理区块BLKN上的物理页102包括四个物理区段104、106、108以及110。若各物理区段配置储存一主机页的使用者数据(对应一串逻辑地址,如LBAk~LBAk+7),各物理页是配置给四个主机页使用。例如,物理区段104、106、108以及110分别对应主机页Hm(即,LBAk0~LBAk0+7)、Hm+1(即,LBAk1~LBAk1+7)、Hm+2(即,LBAk2~LBAk2+7)、Hm+3(即,LBAk3~LBAk3+7)。若一物理区块包括128个物理页,则有128x4个主机页对应一物理区块的128x4个物理区段。针对各物理区块,128x4个物理区段以及128x4个主机页之间的映射资讯需记录下来,作储存空间管理。
图2为方块图,根据本发明一种实施方式实现一数据储存装置200,其中显示主机202以及快闪存储器204之间的映射资讯是如何建立且动态更新。数据储存装置200除了包括快闪存储器204、还包括一控制单元206。
快闪存储器204的物理区块是配置作多种用途。部分物理区块208是储存系统内程序(in-system programs,简称ISPs)。部分物理区块210是储存系统资讯。部分物理区块212为闲置物理区块。配置自该些闲置区块212的一数据接收区块214则是负责接收写入数据,将推入数据集合216为一数据区块。在另外一种实施方式中,数据接收区块214的映射资讯可能正确更新在随机存取存储器222上,但在快闪存储器204上已过时;参考虚线标示,如此数据接收区块214可先标示为表格过期区块218,待映射表更新完成,方自表格过期区块218改标示为数据区块,推入数据集合216中。快闪存储器204可还包括未作任何配置使用的物理区块(freeblocks,未显示于图示中)。
控制单元206是耦接该快闪存储器204至主机202,且包括一微控制器220、一随机存取存储器222以及一只读存储器224。只读程序码是储存于只读存储器224中。微控制器220包括执行该只读存储器224内的只读程序码或/以及该快闪存储器204的该些物理区块208内的系统内程序码,据以操作该快闪存储器204。微控制器220是运作来实现该快闪存储器204上的物理区块配置(参考图2),在该随机存取存储器222上建立物理-逻辑地址映射表F2H,以及在该快闪存储器204上维护一逻辑-物理位置映射表H2F(例如,记录在系统资讯物理区块210中)。该物理-逻辑地址映射表F2H是建立在该随机存取存储器222上,以动态纪录该数据接收区块214(或该表格过期区块218)的物理地址所对应的逻辑地址。不同于将物理-逻辑地址映射表F2H完整地一口气用来更新该逻辑-物理地址映射表H2F,微控制器220是运作来在该数据接收区块214上两个写入操作之间,仅基于该物理-逻辑地址映射表F2H局部内容更新该逻辑-物理地址映射表H2F。基于该物理-逻辑地址映射表F2H而对该逻辑-物理地址映射表H2F所作的更新动作可称为“F2H H2F更新/封存”。微控制器220是运作来在区块内写入操作之间(run-time,在数据接收区块214两个写入操作之间)执行局部F2H H2F封存(即,仅封存该物理-逻辑地址映射表F2H局部内容)─将显著改善数据储存装置200的系统效能。
图3根据本发明一种实施方式图解如此在区块内写入操作之间执行的局部F2H H2F封存,其中该物理-逻辑地址映射表F2H是根据该数据接收区块214上的写入操作建立于该随机存取存储器222上。图2控制器220是运作来在写入特定尺寸的使用者数据(例如,32个物理页,小于该数据接收区块214的完整尺寸(128个物理页))至该数据接收区块214后,封存对应该特定尺寸使用者数据的该段物理-逻辑地址映射表F2H至该快闪存储器204上的该逻辑-物理地址映射表H2F。如图所示,物理-逻辑地址映射资讯304是基于32个物理页302的写入操作产生,用于组成该随机存取存储器222上的物理-逻辑地址映射表F2H。上述32个物理页302的写入操作完成后,快闪存储器204上的逻辑-物理地址映射表H2F是随后根据上述物理-逻辑地址映射资讯304作更新。上述物理-逻辑地址映射资讯304即物理-逻辑地址映射表F2H中对应上述32个物理页302的段落。类似地,物理-逻辑地址映射资讯308是基于32个物理页306的写入操作产生,用于组成该随机存取存储器222上的物理-逻辑地址映射表F2H。上述32个物理页306的写入操作完成后,快闪存储器204上的逻辑-物理地址映射表H2F是随后根据上述物理-逻辑地址映射资讯308作更新。类似地,物理-逻辑地址映射资讯312是基于32个物理页310的写入操作产生,用于组成该随机存取存储器222上的物理-逻辑地址映射表F2H。上述32个物理页310的写入操作完成后,快闪存储器204上的逻辑-物理地址映射表H2F是随后根据上述物理-逻辑地址映射资讯312作更新。至于尚未填满的32个物理页314,其物理-逻辑地址映射资讯316同样尚未完全建立。因此,快闪存储器204上的逻辑-物理地址映射表H2F尚未基于该段物理-逻辑地址映射资讯316作更新。图2的微控制器220可还运作来以一指标标示该段物理-逻辑地址映射资讯316,以标示尚未封存至该快闪存储器204的该段映射资讯。因此,面对搜寻该段未封存映射资讯的需求时,微控制器220是即刻根据上述指标寻得该段物理-逻辑地址映射资讯316,相当省时,且大幅缩小未封存的映射资讯的搜寻区域。
图4根据本发明另一种实施方式图解如此在区块内写入操作之间执行的局部F2H H2F封存,其中该物理-逻辑地址映射表F2H是根据该数据接收区块214上的写入操作建立于该随机存取存储器222上。如此在区块内写入操作之间执行的局部F2H H2F封存是由一连串短于一物理页的使用者数据触发。如图所示,在一系列物理页402后,一连串的短数据404、406~412(一连串4K尺寸的数据)写入该数据接收区块214。物理-逻辑地址映射资讯F2H是根据该数据接收区块214的写入操作建立于该物理-逻辑地址映射表F2H。例如,物理-逻辑地址映射资讯414~420是对应多个物理页402以及该串4K尺寸数据404形成,而区域422内的物理-逻辑映射资讯是针对该串4K尺寸数据406~412形成。在感测到该串4K尺寸数据404的写入操作时,图2微控制器220是于该数据接收区块214接续的写入操作之间基于该物理-逻辑地址映射表F2H更新该逻辑-物理地址映射表H2F。在4K尺寸数据406写入该数据接收区块214之前,该逻辑-物理地址映射表H2F是根据该物理-逻辑地址映射资讯414更新。在4K尺寸数据406以及4K尺寸数据408的写入操作之间,逻辑-物理地址映射表H2F是根据该物理-逻辑地址映射资讯416更新。在4K尺寸数据408以及4K尺寸数据410的写入操作之间,逻辑-物理地址映射表H2F是根据该物理-逻辑地址映射资讯418更新。在4K尺寸数据410以及4K尺寸数据412的写入操作之间,逻辑-物理地址映射表H2F是根据该物理-逻辑地址映射资讯420更新。图2的微控制器220还可运作来以一指标标示储存空间422内剩余的物理-逻辑地址映射资讯(即,尚未封存的映射资讯)。因此,面对搜寻该段未封存的映射资讯的需求时,微控制器220即刻根据上述指标寻得储存空间422,相当省时,且大幅缩小未封存的映射资讯的搜寻区域。
图5根据本发明另一种实施方式图解如此在区块内写入操作之间执行的局部F2HH2F封存,其中上述物理-逻辑地址映射表F2H是针对表格过期区块218建立于该随机存取存储器222中。
在一种实施方式中,图的微控制器220可设置来在该表格过期区块218写满时令该快闪存储器204配置提供上述数据接收区块214。在此例中,微控制器220可设置来在该数据接收区块214的写入操作间根据该物理-逻辑地址映射表F2H更新上述逻辑-物理映射表H2F。
在另一实施方式中,表格过期区块218的写入操作是曾被非预期掉电事件打断,图2的微控制器220是运作来在一复电程序中配置该快闪存储器204提供上述数据接收区块214。在此实施例中,微控制器220是运作于该复电程序修复该物理-逻辑地址映射表格F2H,并在该数据接收区块214的写入操作之间将修复后的该物理-逻辑地址映射表格F2H封存至该逻辑-物理地址映射表H2F。
在图5,储存空间510的写入操作以及储存空间512的写入操作间隔是长于该数据储存装置200的负荷警示时间(time out period)两倍。在储存空间510的写入操作以及储存空间512的写入操作之间,该微控制器220先基于该物理-逻辑地址映射资讯502更新该逻辑-物理地址映射表H2F,再基于该物理-逻辑地址映射资讯504更新该逻辑-物理地址映射表H2F。至于储存空间512的写入操作以及储存空间514的写入操作间隔则是较该数据储存装置200的负荷警示时间的两倍短。在储存空间512的写入操作以及储存空间514的写入操作之间,该微控制器220是基于该物理-逻辑地址映射资讯506更新该逻辑-物理地址映射表H2F。至于储存空间514的写入操作以及储存空间516的写入操作间隔同样是较该数据储存装置200的负荷警示时间的两倍短。在储存空间514的写入操作以及储存空间516的写入操作之间,该微控制器220是基于该物理-逻辑地址映射资讯508更新该逻辑-物理地址映射表H2F。使用者数据接收以及映射资讯封存是交错实行。此外,更有一指标可设计来标示出尚未封存至该逻辑-物理地址映射表H2F的物理-逻辑地址映射资讯。
在某些实施方式中,主机202下达的写入操作有两种分类。例如,串行数据以及零散数据可分开写入该快闪存储器204。图6图解针对以上两种写入操作而设计物理区块配置以及映射资讯更新。数据接收区块214_1以及表格过期区块218_1提供来写入串行数据,数据接收区块214_2以及表格过期区块218_2提供来写入零散数据。对应表格过期区块218_1的物理-逻辑地址映射记录于物理-逻辑地址映射表F2H1。对应表格过期区块218_2的物理-逻辑地址映射记录于物理-逻辑地址映射表F2H2。
在一种实施方式中,图2微控制器220是运作来在该表格过期区块218_1满载时,配置该快闪存储器204提供该数据接收区块214_1。微控制器220在该数据接收区块214_1的写入操作之间,穿插将该物理-地址逻辑映射表F2H1封存至该逻辑-物理地址映射表H2F。微控制器220在该数据接收区块214_2的写入操作之间,穿插将该物理-地址逻辑映射表F2H2封存至该逻辑-物理地址映射表H2F。
在另一种实施方式中,若表格过期区块218_1的写入操作因非预期掉电事件中断,图2该微控制器220在一复电程序是运作来配置该快闪存储器204提供上述数据接收区块214_1。该微控制器220是运作来在该复电程序修复该物理-逻辑地址映射表F2H1。该微控制器220会在该数据写入区块214_1的写入操作间,穿插将修复后的物理-逻辑地址映射表F2H1封存至该逻辑-物理地址映射表H2F。若表格过期区块218_2的写入操作因非预期掉电事件中断,图2该微控制器220在一复电程序是运作来配置该快闪存储器204提供上述数据接收区块214_2。该微控制器220是运作来在该复电程序修复该物理-逻辑地址映射表F2H2。该微控制器220会在该数据写入区块214_2的写入操作间,穿插将修复后的物理-逻辑地址映射表F2H2封存至该逻辑-物理地址映射表H2F。
其他采用上述概念控制一快闪存储器的技术都属于本发明所欲保护的范围。基于以上技术内容,本发明更涉及快闪存储器的控制方法,不限定以特定架构的控制单元实现。
虽然本发明已以较佳实施例揭示如上,然其并非用以限定本发明,任何熟悉本技术领域者,在不脱离本发明的精神和范围内,当可做些许更动与润饰,因此本发明的保护范围当由权利要求书界定为准。

Claims (18)

1.一种数据储存装置,包括:
一快闪存储器,划分为多个物理区块,且上述物理区块各自包括多个物理页;以及
一控制单元,耦接该快闪存储器至一主机,且包括一微控制器以及一随机存取存储器;
其中:
该微控制器是运作来配置该快闪存储器以这些物理区块的一作一第一数据接收区块;
在该第一数据接收区块上一第一写入操作以及一第二写入操作之间,该微控制器将一第一物理-逻辑地址映射表的仅仅局部封存至一逻辑-物理地址映射表;
该逻辑-物理地址映射表设置在该快闪存储器上;且
该第一物理-逻辑地址映射表建立于该随机存取存储器上,以记录一个物理区块的物理页所对应的逻辑地址。
2.如权利要求1所述的数据储存装置,其特征在于:
该微控制器包括根据该主机对该第一数据接收区块所下达的写入操作建立该第一物理-逻辑地址映射表。
3.如权利要求2所述的数据储存装置,其特征在于:
将特定长度的使用者数据写入该第一数据接收区块后,该微控制器是运作来将该第一物理-逻辑地址映射表中对应上述特定长度的使用者数据的一段落封存至该逻辑-物理地址映射表;且
该特定尺寸是小于该第一数据接收区块的总尺寸。
4.如权利要求2所述的数据储存装置,其特征在于:
在写入各短于一物理页的一串使用者数据进该第一数据接收区块后,该微控制器是运作来在该第一数据接收区块上接续的写入操作之间,穿插将该第一物理-逻辑地址映射表封存至该逻辑-物理地址映射表。
5.如权利要求1所述的数据储存装置,其特征在于:
该微控制器是运作来在该快闪存储器的这些物理区块之间对应该第一物理-逻辑地址映射表的一第一表格过期区块填满时,配置该快闪存储器提供上述第一数据接收区块;且
该微控制器是运作来在该第一数据接收区块的写入操作之间,穿插将该第一物理-逻辑地址映射表封存至该逻辑-物理地址映射表。
6.如权利要求5所述的数据储存装置,其特征在于:
该微控制器是运作来在该快闪存储器的这些物理区块之间对应一第二物理-逻辑地址映射表的一第二表格过期区块填满时,配置该快闪存储器提供一第二数据接收区块,该第二物理-逻辑地址映射表是建立于该随机存取存储器上;
该微控制器是运作来在该第二数据接收区块的写入操作之间,穿插将该第二物理-逻辑地址映射表封存至该逻辑-物理地址映射表;
该第一数据接收区块以及该第一表格过期区块是配置作一第一型态的写入操作;且
该第二数据接收区块以及该第二表格过期区块是配置作一第二型态的写入操作。
7.如权利要求1所述的数据储存装置,其特征在于:
该微控制器是运作来在该快闪存储器的这些物理区块之间对应该第一物理-逻辑地址映射表的一第一表格过期区块遭非预期掉电事件中断时,于一复电程序配置该快闪存储器提供上述第一数据接收区块;
该微控制器是运作来在该复电程序修复该第一物理-逻辑地址映射表;以及
该微控制器是运作来在该第一数据接收区块的写入操作之间,穿插将修复后的该第一物理-逻辑地址映射表封存至该逻辑-物理地址映射表。
8.如权利要求7所述的数据储存装置,其特征在于:
该微控制器是运作来在该快闪存储器的这些物理区块之间对应一第二物理-逻辑地址映射表的一第二表格过期区块遭非预期掉电事件中断时,于该复电程序配置该快闪存储器提供一第二数据接收区块,该第二物理-逻辑地址映射表是建立于该随机存取存储器上;
该微控制器是运作来在该复电程序修复该第二物理-逻辑地址映射表;
该微控制器是运作来在该第二数据接收区块的写入操作之间,穿插将修复后的该第二物理-逻辑地址映射表封存至该逻辑-物理地址映射表;
该第一数据接收区块以及该第一表格过期区块是配置作一第一型态的写入操作;且
该第二数据接收区块以及该第二表格过期区块是配置作一第二型态的写入操作。
9.如权利要求1所述的数据储存装置,其特征在于:
该微控制器是还更运作来使用一指标标示该第一物理-逻辑地址映射表中尚未封存至该逻辑-物理地址映射表的一段内容;且
该微控制器是运作来根据该指标搜寻该第一物理-逻辑地址映射表。
10.一种快闪存储器控制方法,包括:
配置一快闪存储器,以由该快闪存储器的多个物理区块提供一第一数据接收区块,上述物理区块各自包括多个物理页;以及
在该第一数据接收区块上一第一写入操作以及一第二写入操作之间,将一第一物理-逻辑地址映射表的仅仅局部封存至一逻辑-物理地址映射表;
其中:
该逻辑-物理地址映射表是维护于该快闪存储器上;且
该第一物理-逻辑地址映射表是建立于一随机存取存储器上,以记录一个物理区块的物理页所对应的逻辑地址。
11.如权利要求10所述的快闪存储器控制方法,其特征在于:
该第一物理-逻辑地址映射表是根据一主机对该第一数据接收区块所下达的写入操作而建立。
12.如权利要求11所述的快闪存储器方法,其特征在于:
在特定长度的使用者数据写入该第一数据接收区块后,将该第一物理-逻辑地址映射表中对应上述特定长度的使用者数据的一段落封存至该逻辑-物理地址映射表;且
上述特定尺寸是小于该第一数据接收区块的总尺寸。
13.如权利要求11所述的快闪存储器控制方法,其特征在于:
在写入各短于一物理页的一串使用者数据进该第一数据接收区块后,在该第一数据接收区块上接续的写入操作之间,穿插将该第一物理-逻辑地址映射表封存至该逻辑-物理地址映射表。
14.如权利要求10所述的快闪存储器控制方法,其特征在于:
该快闪存储器是在该快闪存储器的这些物理区块之间对应该第一物理-逻辑地址映射表的一第一表格过期区块填满时,配置提供上述第一数据接收区块;且
该第一物理-逻辑地址映射表是穿插在该第一数据接收区块的写入操作之间封存至该逻辑-物理地址映射表。
15.如权利要求14所述的快闪存储器控制方法,其特征在于,还包括:
在该快闪存储器的这些物理区块之间对应一第二物理-逻辑地址映射表的一第二表格过期区块填满时,配置该快闪存储器更提供一第二数据接收区块,该第二物理-逻辑地址映射表是建立于该随机存取存储器上;以及
穿插在该第二数据接收区块的写入操作之间封存该第二物理-逻辑地址映射表至该逻辑-物理地址映射表;
其中:
该第一数据接收区块以及该第一表格过期区块是配置作一第一型态的写入操作;且
该第二数据接收区块以及该第二表格过期区块是配置作一第二型态的写入操作。
16.如权利要求10所述的快闪存储器控制方法,其特征在于:
在该快闪存储器的这些物理区块之间对应该第一物理-逻辑地址映射表的一第一表格过期区块的写入操作遭非预期掉电中断后,该快闪存储器是于一复电程序配置提供上述第一数据接收区块;
该第一物理-逻辑地址映射表是在上述复电程序修复;并且
修复后的该第一物理-逻辑地址映射表是穿插在该第一数据接收区块的写入操作之间封存至该逻辑-物理地址映射表。
17.如权利要求16所述的快闪存储器控制方法,其特征在于,还包括:
在该快闪存储器的这些物理区块之间对应一第二物理-逻辑地址映射表的一第二表格过期区块的写入操作遭非预期掉电中断后,配置该快闪存储器于上述复电程序更配置提供一第二数据接收区块,该第二物理-逻辑地址映射表建立于该随机存取存储器上;
在上述复电程序修复该第二物理-逻辑地址映射表;并且
穿插在该第二数据接收区块的写入操作之间将修复后的该第二物理-逻辑地址映射表是封存至该逻辑-物理地址映射表;
其中:
该第一数据接收区块以及该第一表格过期区块是配置作一第一型态的写入操作;且
该第二数据接收区块以及该第二表格过期区块是配置作一第二型态的写入操作。
18.如权利要求10所述的快闪存储器控制方法,其特征在于,还包括:
使用一指标标示该第一物理-逻辑地址映射表中尚未封存至该逻辑-物理地址映射表的一段内容;且
根据该指标搜寻该第一物理-逻辑地址映射表。
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