CN103929178B - 逐次逼近模数转换器及其转换方法 - Google Patents
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Abstract
本发明中公开一种逐次逼近模数转换器及其转换方法,其中该逐次逼近模数转换器包括:带冗余位的分段多级电容阵列、比较器、权重存储电路、编码重建电路以及控制逻辑电路。本发明可以实现降低电路设计的复杂度,节省版图面积和功耗,且不需要辅助电容阵列、辅助开关和控制逻辑,就能精确测量电容失配误差并进行电容失配误差校正。
Description
技术领域
本发明涉及模数转换器技术领域,更确切的说涉及一种逐次逼近模数转换器及其转换方法。
背景技术
逐次逼近型模数(A/D,Analog to Digital)转换器通常包含一个电容阵列,该阵列的精度决定了逐次逼近型A/D转换器的精度。在逐次逼近型A/D转换器的实现中,会遇到三个问题:
(1)结构问题:
(a)如果电容阵列采用单段结构,需要单位电容个数为:
其中Ns为A/D转换器的精度,可见单位电容的个数随A/D转换器精度的增加呈指数增加,当Ns较大时,需要的芯片面积和功耗都非常大,通常Ns大于10时,需要进行电容失配误差修调。
(b)如果电容阵列采用传统的分段结构,需要的单位电容数可以大幅度减少,例如,Ns为偶数时分为相同的两端结构,需要的单位电容个数为:
可见,需要的单位电容个数减少,特别是在Ns较大时,减少很明显,但是,分段结构必然引入等效电容失配误差,只要采用了分段结构,就必须要进行电容失配误差的修调,而分段结构中电容失配误差修调比单段结构中电容失配误差修调更复杂,传统的电容失配误差修调方法通常采用补偿电容阵列对电容失配误差进行补偿,当某个电容参与了电荷的加减运算时,相应的补偿电容阵列对其失配误差引起的电荷变化进行补偿,补偿电容阵列的精度必须达到1最低有效位(LSB,Least Significant Bit)以内,因此,当Ns很大时,补偿电容阵列必须采用复杂的结构来实现高的补偿精度,因此,补偿电容阵列很难实现。
而在传统结构的逐次逼近型A/D转换器中如果采用数字修调的方法,记录每个电容的实际权重,即使能够正确测量每个电容的实际权重,但是,在高位权重大于剩余所有位权重之和加1LSB时,会出现失码现象。例如,一个4bit的A/D转换器,实际权重为(9,3,2,1),输入输出对应关系为:
可见,输出码中7和8丢失了。
因此,有必要对现有的逐次逼近A/D转换器的结构进行改进。
发明内容
本发明解决的技术问题是提供一种逐次逼近模数转换器及其转换方法,以实现降低电路设计的复杂度,节省版图面积和功耗,且不需要辅助电容阵列、辅助开关和控制逻辑,就能精确测量电容失配误差并进行电容失配误差校正。
为了解决上述技术问题,本发明采用如下技术方案:
一种逐次逼近模数转换器,其包括:带冗余位的分段多级电容阵列、比较器、权重存储电路、编码重建电路以及控制逻辑电路,其中
所述带冗余位的分段多级电容阵列,用于采集输入电压,然后在所述控制逻辑电路的控制下产生输出电压Vout+和Vout-;其包含第1级电容阵列,第2级电容阵列,…,第m级电容阵列,第1分段电容C1,第2分段电容C2,…,第(m-1)分段电容C(m-1),前(m-1)级电容阵列中每级电容阵列至少包含1个冗余位;第m级电容阵列需要的最小冗余位个数由工艺决定的电容失配的最大值决定,其中m为大于等于2的正整数;
所述比较器用于比较所述带冗余位的分段多级电容阵列的输出电压Vout+和Vout-,并输出比较结果;
所述权重存储电路用于存储所述带冗余位的分段多级电容阵列中各组电容的权重值;
所述编码重建电路用于根据比较器输出结果和权重存储电路中的电容权重,计算逐次逼近模数转换器的输出码;
所述控制逻辑电路用于根据控制逻辑控制上述带冗余位的分段多级电容阵列、比较器、权重存储电路以及编码重建电路进行相应操作。
其中,工艺决定的电容失配误差最大值为Nmismatch_max个最低有效位,所述第m级电容阵列需要的最小冗余位个数为Nr_min=log2(2·Nmismatch_max)。
其中,所述带冗余位的分段多级电容阵列中冗余位位于与其权重相同的有效位的后一位。
其中,所述带冗余位的分段多级电容阵列中第1级电容阵列包含正端电容以及负端电容 其中C11和C'11为1组,其权重为W11;C12和C'12为1组,其权重为和为1组,其权重为冗余电容C1r和C'1r为1组,其权重为W1r;
第2级电容阵列包含正端电容以及负端电容其中C21和C'21为1组,其权重为W21;C22和C'22为1组,其权重为和为1组,其权重为冗余电容C2r和C'2r为1组,其权重为W2r;
以此类推,第m级电容阵列包含正端电容 以及负端电容 其中Cm1和C'm1为1组,其权重为Wm1;Cm2和C'm2为1组,其权重为和为1组,其权重为Cmr1和C'mr1为1组,其权重为Wmr1;…;冗余电容Cmrk和C'mrk为1组,其权重为Wmrk。
其中,所述第1分段电容C1为第1级电容阵列最后1个电容的2倍,C1等于C'1;所述第2分段电容C2为第2级电容阵列最后1个电容的2倍,C2等于C'2;…;所述第(m-1)分段电容C(m-1)为第(m-1)级电容阵列最后1个电容的2倍,C(m-1)等于C'(m-1)。
其中,所述带冗余位的分段多级电容阵列和比较器均同时采用差分结构连接或同时采用单端结构连接。
相应地,本发明一种实现逐次逼近模数转换的方法,其包括:
带冗余位的分段多级电容阵列采样;
控制第1级电容阵列所有开关接Vcm,得到输出电压Vout+和Vout-的第1次输出;
比较器比较输出电压Vout+和Vout-的第1次输出,得到输出结果R11;
根据比较器输出结果R11,控制开关K11的连接方式,得到输出电压Vout+和Vout-的第2次输出;同时编码重建电路从权重存储电路中读取与K11相连接的电容C11的权重W11,并计算相应的权重值,得到Dout=R11·W11;
比较器比较输出电压Vout+和Vout-的第2次输出,得到输出结果R12;
根据比较器输出结果R12,控制开关K12的连接方式,得到输出电压Vout+和Vout-的第3次输出;同时编码重建电路从权重存储电路中读取与K12相连接的电容C12的权重W12,并计算相应的权重值,与上次输出结果相加,得到Dout=R11·W11+R12·W12;
循环上述步骤,直到完成最后一个开关Kmrk的连接方式控制,此时得到重建码输出结果:Dout=R11·W11+R12·W12+...+Rmrk·Wmrk。
其中,比较器进行比较时,若输出电压Vout+大于Vout-,比较器输出结果为1,否则,比较器输出结果为0。
另外,还包括电容失配误差测量的步骤,具体包括:
设置权重存储电路初始值为理想权重;
进行模数转换得到比较器输出结果和重建码输出结果;
在偏差平方和最小的约束条件下,对重建码输出结果进行曲线拟合;
根据实际输出曲线与拟合曲线之间的误差估计电容实际权重。
其中,所述设置权重存储电路初始值为理想权重具体包括:
有效位权重设置,其中第1级电容阵列有效位个数为n1,第2级电容阵列有效位个数为n2,…,第m级电容阵列有效位个数为nm;第1级电容阵列最高位权重W11的理想值为第1级电容阵列次高位权重W12的理想值为第m级电容阵列第1位权重Wm1的理想值为第m级电容阵列次高位权重Wm2的理想值为第m级电容阵列第nm位权重的理想值为1;
冗余位权重设置,其中第1级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,即Wideal1r=Wideal1i;第2级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,即Wideal2r=Wideal2i;…,第m电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,可能为多个,即为:
Widealmrk=20=1
Widealmr(k-1)=21=2
Widealmr(k-2)=22=4
…
Widealmr1=2k-1。
其中,所述进行模数转换得到比较器输出结果和重建码输出结果具体包括:
输入信号特征已知的输入信号,输入信号幅度需大于模数转换器输入信号范围的一半;
模数转换器根据设置的理想权重值,进行模数转换,得到比较器输出结果和重建码输出结果,采样点的个数N必须大于第1级电容阵列有效位个数为n1,第2级电容阵列有效位个数为n2,…,第m级电容阵列有效位个数为nm。
其中,所述在偏差平方和最小的约束条件下,对重建码输出结果进行曲线拟合具体包括:
假设输入信号函数为f(i),输出信号为Dout(i);i和Dout(i)已知,在偏差平方和最小的约束条件下:得到拟合的输入信号曲线其中,i=1,2,...,N,N表示采样点个数。
其中,所述根据实际输出曲线与拟合曲线之间的误差估计电容实际权重具体包括:
a)计算第1个实际输出值与拟合值之间的误差
b)根据误差值,按权重比例,估计电容实际权重
其中,μ为步长因子,0<μ<1
若由工艺偏差确定第m电容阵列中第p位以后的电容权重不影响电容阵列的单调性,则权重小于Wmp的电容失配误差可以忽略,则其权重为理想权重,并按以下公式估计其它电容实际权重
c)根据估计的权重计算估计输出值
Dout_est(1)=R11(2)·W11(1)+R12(2)·W12(1)+...+Rmrk(2)·Wmrk(1)
d)计算估计输出值与拟合值之间的误差
e)根据误差值,按权重比例,再次估计电容实际权重
若由工艺偏差确定第m电容阵列中第p位以后的电容权重不影响电容阵列的单调性,则权重小于Wmp的电容失配误差可以忽略,则其权重为理想权重,并按以下公式估计其它电容实际权重:
f)循环步骤c)至步骤e),直到得到完成N次估计,得到最后1次估计权重W11(N),W12(N),…,Wmrk(N)。
另外,还可包括电容失配误差校正步骤,具体包括:
将估计得到的电容实际权重写入权重存储电路;
进行模数转换,利用电容实际权重得到校正后的重建码输出。
与现有技术相比,本发明具有如下有益效果:
首先,本发明的逐次逼近模数转换器中电容阵列使用改进的分段结构,能够大幅降低单位电容个数,节省版图面积和功耗。以10位A/D转换器为例,所采用常规的不分段的方法,则需要单位电容个数为210=1024,若采用本发明提供的分段电容结构,若采用2段结构,每段最后1个权重为冗余位,则需要的单位电容个数为2×(210/2+1)+1=67,节省单位电容数量93.5%。
其次,采用传统的单段和分段结构的电容阵列时,如果使用数字方法来校正电容失配误差,可能出现失码现象,因此传统单段和分段结构的电容阵列都不能使用数字方法来校正电容失配误差,而本发明的逐次逼近模数转换器中电容阵列使用改进的分段结构,使得逐次逼近A/D转换器能够运用数字方法来校正电容失配误差。
再次,本发明的逐次逼近模数转换器中避免了电容失配误差测量相关的辅助电容阵列、辅助开关和控制逻辑电路的使用,大幅降低了模拟电路的设计复杂度,节省了版图面积和功耗。
再次,传统的模拟测量方法,测量电路的精度受限于测量辅助电容阵列的精度,而本发明的逐次逼近模数转换器的电容失配误差的测量精度高。使用数字方法测量电容失配,误差测量精度不受工艺条件限制。
再次,本发明避免了电容失配误差校正相关的补偿电容阵列及相关电路的使用,大幅度降低了模拟电路的设计复杂度,节省了版图面积和功耗。
再次,本发明电容失配误差校正的精度高。利用数字校正的方法,可达到的校正精度与电容失配误差测量精度相同,而传统的模拟校正方法,其校正精度受限于补偿电容的最小值(即工艺允许的最小电容值),导致电容失配误差补偿精度小于电容失配误差测量精度。
附图说明
图1为本发明基于冗余位的逐次逼近模数转换器的具体实施例结构示意图;
图2为图1中带冗余位的分段多级电容阵列的具体实施例结构示意图;
图3是本发明基于冗余位的逐次逼近模数转换器的电容失配误差测量方法的具体实施例流程图;
图4是本发明基于冗余位的逐次逼近模数转换器的电容误差校正具体实施例流程图。
具体实施方式
参考图1,本实施例逐次逼近模数转换器包括:1个带冗余位的分段多级电容阵列11、1个比较器12、1个权重存储电路13、1个编码重建电路14和1个控制逻辑电路15。
其工作原理为:外部输入信号Vin+和Vin-送往带冗余位的分段多级电容阵列11,制逻辑电路15控制带冗余位的分段多级电容阵列11对输入信号采样,并产生输出电压Vout+和Vout-,送往比较器12进行比较,根据比较器12输出结果依次控制带冗余位的分段多级电容阵列中的电容开关,重新产生输出电压Vout+和Vout-,送往比较器12进行比较,如此循环,直到最后一组电容的控制开关被重新设置。比较器12每次输出结果都送往编码重建电路14,编码重建电路14根据比较器12输出结果和从权重存储电路13读取的权重信息,重建编码,得到A/D转换器的输出,同时比较器12的比较结果也单独输出用于电容实际权重的测量。
本实施例中带冗余位的分段多级电容阵列11主要用于采集输入电压,在控制逻辑电路的控制下,产生输出电压Vout+和Vout-,送入比较器进行比较,根据比较器输出结果,在控制逻辑电路的控制下,依次改变开关的连接方式,重新产生输出电压Vout+和Vout-,送入比较器进行比较,如此循环,直到最后一组电容的控制开关被重新设置。参考图2,作为一个优选的具体实施例,所述带冗余位的分段多级电容阵列包含第1级电容阵列,第2级电容阵列,…,第m级电容阵列,第1分段电容C1,第2分段电容C2,…,第(m-1)分段电容C(m-1),其中m为大于等于2的正整数。
所述第1级电容阵列,包含正端电容 以及负端电容正端开关以及负端开关 其中,正端电容C11的一端与Vout-相接,另一端与开关K11相接,开关K11一端与电容C11相接,另一端在控制逻辑电路的控制下与Vin+、V+、V-或Vcm相接;C12的一端与Vout-相接,另一端与开关K12相接,开关K12一端与电容C12相接,另一端在控制逻辑电路的控制下与Vin+、V+、V-或Vcm相接;…;的一端与Vout-相接,另一端与开关相接,开关一端与电容相接,另一端在控制逻辑电路的控制下与Vin+、V+、V-或Vcm相接;冗余电容C1r的一端与Vout-相接,另一端与开关K1r相接,开关K1r一端与电容C1r相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接。其中,负端电容C'11的一端与Vout+相接,另一端与开关K'11相接,开关K'11一端与电容C'11相接,另一端在控制逻辑电路的控制下与Vin+、V+、V-或Vcm相接;C'12的一端与Vout+相接,另一端与开关K'12相接,开关K'12一端与电容C'12相接,另一端在控制逻辑电路的控制下与Vin+、V+、V-或Vcm相接;…;的一端与Vout+相接,另一端与开关相接,开关一端与电容相接,另一端在控制逻辑电路的控制下与Vin+、V+、V-或Vcm相接;冗余电容C'1r的一端与Vout+相接,另一端与开关K'1r相接,开关K'1r一端与电容C'1r相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接。理想情况下,C11与C'11相等,C12与C'12相等,…,与相等;理想情况下C11等于2倍C12,C12等于2倍C13,…,C1i等于2倍C1(i+1),等于2倍C1r等于C1i,等于理想情况下C'11等于2倍C'12,C'12等于2倍C'13,…,C'1i等于2倍C'1(i+1),等于2倍C'1r等于C'1i,等于
在理想情况下,所述第1分段电容C1为第1级电容阵列最后1个电容的2倍,C1等于C'1。
所述第2级电容阵列,包含正端电容 以及负端电容正端开关 以及负端开关 其中,正端电容C21的一端与V2-相接,另一端与开关K21相接,开关K21一端与电容C21相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;C22的一端与V2-相接,另一端与开关K22相接,开关K22一端与电容C22相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;…;的一端与V2-相接,另一端与开关相接,开关一端与电容相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;冗余电容C2r的一端与V2-相接,另一端与开关K2r相接,开关K2r一端与电容C2r相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接。其中,负端电容C'21的一端与V2+相接,另一端与开关K'21相接,开关K'21一端与电容C'21相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;C'22的一端与V2+相接,另一端与开关K'22相接,开关K'22一端与电容C'22相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;…;的一端与V2+相接,另一端与开关相接,开关一端与电容相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;冗余电容C'2r的一端与V2+相接,另一端与开关K'2r相接,开关K'2r一端与电容C'2r相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接。理想情况下,C21与C'21相等,C22与C'22相等,…,与相等;理想情况下C21等于2倍C22,C22等于2倍C23,…,C2i等于2倍C2(i+1),等于2倍C2r等于C1i;理想情况下C'21等于2倍C'22,C'22等于2倍C'23,…,C'2i等于2倍C'2(i+1),等于2倍C'2r等于C'2i。
在理想情况下,所述第2分段电容C2为第2级电容阵列最后1个电容的2倍,C2等于C'2。
同理,其他直到第m级电容阵列也是如此,即所述第m级电容阵列,包含正端电容以及负端电容正端开关以及负端开关其中,正端电容Cm1的一端与Vm-相接,另一端与开关Km1相接,开关Km1一端与电容Cm1相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;Cm2的一端与Vm-相接,另一端与开关Km2相接,开关Km2一端与电容Cm2相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;…;的一端与Vm-相接,另一端与开关相接,开关一端与电容相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;Cmr1的一端与Vm-相接,另一端与开关Kmr1相接,开关Kmr1一端与电容Cmr1相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接,…,冗余电容Cmrk的一端与Vm-相接,另一端与开关Kmrk相接,开关Kmrk一端与电容Cmrk相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接。其中,负端电容C'm1的一端与Vm+相接,另一端与开关K'm1相接,开关K'm1一端与电容C'm1相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;C'm2的一端与Vm+相接,另一端与开关K'm2相接,开关K'm2一端与电容C'm2相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;…;的一端与Vm+相接,另一端与开关相接,开关一端与电容相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接;C'mr1的一端与Vm+相接,另一端与开关K'mr1相接,开关K'mr1一端与电容C'mr1相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接,…,冗余电容C'mrk的一端与Vm+相接,另一端与开关K'mrk相接,开关K'mrk一端与电容C'mrk相接,另一端在控制逻辑电路的控制下与V+、V-或Vcm相接。
以此类推,在理想情况下,所述第(m-1)分段电容C(m-1)为第(m-1)级电容阵列最后1个电容的2倍,C(m-1)等于C'(m-1)。
需要说明的,本发明中前(m-1)级电容阵列中,每级电容阵列至少包含1个冗余位,冗余位位于与其权重相同的有效位的后一位。最后一级电容阵列需要的最小冗余位个数,由工艺决定的电容失配的最大值决定。若工艺决定的电容失配误差最大值为Nmismatch_max个LSB(最低有效位),则需要的最小冗余位个数为Nr_min=log2(2·Nmismatch_max),冗余位位于与其权重相同的有效位的后一位。
本实施例中比较器12主要用于比较带冗余位的分段多级电容阵列11的输出电压Vout+和Vout-,若Vout+大于Vout-,比较器出为1,否则,比较器输出为0,其具体操作步骤如下:
1)在采样阶段,采样开关Ks和Ks'导通,Vout+和Vout-都等于采样共模电压Vcms;第1级电容阵列中,除冗余位开关K1r以外的所有正端开关都接输入电压Vin+,除冗余位开关K'1r以外的所有负端开关都接输入电压Vin-;第2级电容阵列中,所有开关都接共模电压Vcm;同理,其他级的阵列直到第m级电容阵列中,所有开关都接Vcm;当采样开关Ks和Ks'断开时,采样结束。
2)在比较阶段,首先,第1级电容阵列中的所有开关接Vcm,使得Vout+和Vout-变化,若(Vin+-Vin-)大于0,则Vout+大于Vout-,比较器输出结果R11为1,送往控制逻辑电路,控制逻辑电路使开关K11接V+,K'11接V_,否则,比较器输出结果R11为0,使开关K11接V_,K'11接V+,重新产生Vout+和Vout-;比较器进入第2次比较,同样,当Vout+大于Vout-,比较器输出结果R12为1,送往控制逻辑电路,控制逻辑电路使开关K12接V+,K'12接V_,否则,比较器输出结果R12为0,使开关K12接V_,K'12接V+,重新产生Vout+和Vout-;如此重复,直到第m级电容阵列中的所有开关都根据比较器输出结果重新设置。
另外,本实施例中权重存储电路13主要用于存储电容权重。在第1级电容阵列中C11和C'11为1组,其权重为W11;C12和C'12为1组,其权重为W1x;…;和为1组,其权重为C1r和C'1r为1组,其权重为W1r。在第2级电容阵列中,C21和C'21为1组,其权重为W21;C22和C'22为1组,其权重为W22;和为1组,其权重为C2r和C'2r为1组,其权重为W2r,同理,直到第m级电容阵列,在第m级电容阵列中Cm1和C'm1为1组,其权重为Wm1;Cm2和C'm2为1组,其权重为Wm2;和为1组,其权重为Cmr1和C'mr1为1组,其权重为Wmr1;…;Cmrk和C'mrk为1组,其权重为Wmrk。
另外,本实施例中编码重建电路14,利用比较器12结果和权重存储电路13中的电容权重,计算逐次逼近A/D转换器的输出码(本发明中也称为重建码),包括以下步骤:
1)读取比较器12输出结果R11,R12,…,Rmrk
2)读取电容权重W11,W12,…,Wmrk
3)计算输出码,即将所有比较器输出结果按权重相加:
Dout=R11·W11+R12·W12+...+Rmrk·Wmrk
而所述控制逻辑电路15主要用于控制带冗余位的分段多级电容阵列11、比较器12、权重存储电路13和编码重建电路14工作进行相应操作。控制逻辑电路控制整个A/D转换器的工作过程也是本发明实现逐次逼近模数转换的流程,该流程具体如下:
1)带冗余位的分段多级电容阵列采样;
2)控制第1级电容阵列所有开关接Vcm,得到Vout+和Vout-的第1次输出;
3)比较器比较Vout+和Vout-的第1次输出,得到输出结果R11;
4)根据比较器输出结果R11,控制开关K11的连接方式,得到Vout+和Vout-的第2次输出;同时编码重建电路从权重存储电路中读取与K11相连接的电容C11的权重W11,并计算相应的权重值,得到Dout=R11·W11;
5)比较器比较Vout+和Vout-的第2次输出,得到输出结果R12;
6)根据比较器输出结果R12,控制开关K12的连接方式,得到Vout+和Vout-的第3次输出;同时编码重建电路从权重存储电路中读取与K12相连接的电容C12的权重W12,并计算相应的权重值,与上次输出结果相加,得到Dout=R11·W11+R12·W12;
7)如此循环,直到完成最后一个开关Kmrk的连接方式控制,此时得到重建码输出结果:Dout=R11·W11+R12·W12+...+Rmrk·Wmrk。
需要说明的,上述输出结果可能还存在误差,为此,本发明中还需要进行电容失配误差测量和校正,参考图3,本发明还包括电容失配误差测量的流程,具体步骤如下:
1)设置权重存储电路中电容权重初始值为理想权重
a)有效位权重设置
由于第1级电容阵列有效位个数为n1,第2级电容阵列有效位个数为n2,…,第m级电容阵列有效位个数为nm,因此第1级电容阵列最高位权重W11的理想值为第1级电容阵列次高位权重W12的理想值为第m级电容阵列第1位权重Wm1的理想值为第m级电容阵列次高位权重Wm2的理想值为第m级电容阵列第nm位权重的理想值为1。
b)冗余位权重设置
第1级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,即Wideal1r=Wideal1i
第2级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,即Wideal2r=Wideal2i
第m级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,可能为多个,即为:
Widealmrk=20=1
Widealmr(k-1)=21=2
Widealmr(k-2)=22=4
…
Widealmr1=2k-1
2)进行A/D转换,得到比较器输出结果和重建码输出结果,本步骤中重建码为编码重建电路的输出码,主要是为了测量和校准电容实际权重而输出,这里不再赘述,本步骤具体包括以下操作:
a)输入信号特征已知的输入信号(如正弦信号,斜升信号等),输入信号幅度需大于A/D转换器输入信号范围的一半;
b)A/D转换器根据设置的理想权重值,进行A/D转换,得到比较器输出结果和重建码输出结果,采样点的个数N必须大于第1级电容阵列有效位个数为n1,第2级电容阵列有效位个数为n2,…,第m级电容阵列有效位个数为nm。
3)在偏差平方和最小的约束条件下,对重建码输出结果进行曲线拟合
假设输入信号函数为f(i),输出信号为Dout(i);i和Dout(i)已知,在偏差平方和最小的约束条件下:得到拟合的输入信号曲线其中,i=1,2,...,N,N表示采样点个数。
4)根据实际输出曲线与拟合曲线之间的误差估计电容实际权重
a)计算第1个实际输出值与拟合值之间的误差
b)根据误差值,按权重比例,估计电容实际权重
其中,μ为步长因子,0<μ<1
若由工艺偏差确定第m电容阵列中第p位以后的电容权重不影响电容阵列的单调性,则权重小于Wmp的电容失配误差可以忽略,则其权重为理想权重,并按以下公式估计其它电容实际权重
c)根据估计的权重计算估计输出值
Dout_est(1)=R11(2)·W11(1)+R12(2)·W12(1)+...+Rmrk(2)·Wmrk(1)
d)计算估计输出值与拟合值之间的误差
e)根据误差值,按权重比例,再次估计电容实际权重
若由工艺偏差确定第m电容阵列中第p位以后的电容权重不影响电容阵列的单调性,则权重小于Wmp的电容失配误差可以忽略,则其权重为理想权重,并按以下公式估计其它电容实际权重
f)循环步骤c)至步骤e),直到得到完成N次估计,得到最后1次估计权重W11(N),W12(N),…,Wmrk(N)。
参考图4,基于上述测量得到的电容实际权重即可进行电容失配误差校正,具体包括如下步骤:
1)将估计得到的权重作为电容实际权重写入权重存储电路
将最后1次估计得到的权重W11(N),W12(N),…,Wmrk(N)作为电容的实际权重,写入权重存储电路
Wact11=W11(N)
Wact12=W12(N)
…
Wactmrk=Wmrk(N)
2)进行A/D转换,利用实际权重得到校正后的重建码输出,即:
Dact_out=R11·Wact11+R12·Wact12+...+Rmrk·Wactmrk
最终得到校正后的模数转换结果。
虽然本发明的较佳实施例已揭露如上,本发明并不受限于上述实施例,任何本技术领域内的技术人员,在不脱离本发明所揭露的范围内,当可作些许的改动与调整。
Claims (14)
1.一种逐次逼近模数转换器,其特征在于,包括:带冗余位的分段多级电容阵列、比较器、权重存储电路、编码重建电路以及控制逻辑电路,其中
所述带冗余位的分段多级电容阵列,用于采集输入电压,然后在所述控制逻辑电路的控制下产生输出电压Vout+和Vout-;其包含第1级电容阵列,第2级电容阵列,…,第m级电容阵列,第1分段电容C1,第2分段电容C2,…,第(m-1)分段电容C(m-1),前(m-1)级电容阵列中每级电容阵列至少包含1个冗余位;第m级电容阵列需要的最小冗余位个数由工艺决定的电容失配的最大值决定,其中m为大于等于2的正整数;
所述比较器用于比较所述带冗余位的分段多级电容阵列的输出电压Vout+和Vout-,并输出比较结果;
所述权重存储电路用于存储所述带冗余位的分段多级电容阵列中各组电容的权重值;
所述编码重建电路用于根据比较器输出结果和权重存储电路中的电容权重,计算逐次逼近模数转换器的输出码;
所述控制逻辑电路用于根据控制逻辑控制上述带冗余位的分段多级电容阵列、比较器、权重存储电路以及编码重建电路进行相应操作。
2.根据权利要求1所述的逐次逼近模数转换器,其特征在于,工艺决定的电容失配误差最大值为Nmismatch_max个最低有效位,所述第m级电容阵列需要的最小冗余位个数为Nr_min=log2(2·Nmismatch_max)。
3.根据权利要求1所述的逐次逼近模数转换器,其特征在于,所述带冗余位的分段多级电容阵列中冗余位位于与其权重相同的有效位的后一位。
4.根据权利要求1所述的逐次逼近模数转换器,其特征在于,所述带冗余位的分段多级电容阵列中第1级电容阵列包含正端电容 以及负端电容其中C11和C'11为1组,其权重为W11;C12和C'12为1组,其权重为和为1组,其权重为冗余电容C1r和C'1r为1组,其权重为W1r;
第2级电容阵列包含正端电容以及负端电容其中C21和C'21为1组,其权重为W21;C22和C'22为1组,其权重为和为1组,其权重为冗余电容C2r和C'2r为1组,其权重为W2r;
以此类推,第m级电容阵列包含正端电容 以及负端电容 其中Cm1和C'm1为1组,其权重为Wm1;Cm2和C'm2为1组,其权重为和为1组,其权重为Cmr1和C'mr1为1组,其权重为Wmr1;…;冗余电容Cmrk和C'mrk为1组,其权重为Wmrk。
5.根据权利要求4所述的逐次逼近模数转换器,其特征在于,所述第1分段电容C1为第1级电容阵列最后1个电容的2倍,C1等于C'1;所述第2分段电容C2为第2级电容阵列最后1个电容的2倍,C2等于C'2;…;所述第(m-1)分段电容C(m-1)为第(m-1)级电容阵列最后1个电容的2倍,C(m-1)等于C'(m-1)。
6.根据权利要求1所述的逐次逼近模数转换器,其特征在于,所述带冗余位的分段多级电容阵列和比较器均同时采用差分结构连接或同时采用单端结构连接。
7.一种实现逐次逼近模数转换的方法,其特征在于,包括:
带冗余位的分段多级电容阵列采样;
控制第1级电容阵列所有开关接Vcm,得到输出电压Vout+和Vout-的第1次输出;
比较器比较输出电压Vout+和Vout-的第1次输出,得到输出结果R11;
根据比较器输出结果R11,控制开关K11的连接方式,得到输出电压Vout+和Vout-的第2次输出;同时编码重建电路从权重存储电路中读取与K11相连接的电容C11的权重W11,并计算相应的权重值,得到Dout=R11·W11;
比较器比较输出电压Vout+和Vout-的第2次输出,得到输出结果R12;
根据比较器输出结果R12,控制开关K12的连接方式,得到输出电压Vout+和Vout-的第3次输出;同时编码重建电路从权重存储电路中读取与K12相连接的电容C12的权重W12,并计算相应的权重值,与上次输出结果相加,得到Dout=R11·W11+R12·W12;
循环上述步骤,直到完成最后一个开关Kmrk的连接方式控制,此时得到重建码输出结果:Dout=R11·W11+R12·W12+...+Rmrk·Wmrk。
8.根据权利要求7所述的方法,其特征在于,比较器进行比较时,若输出电压Vout+大于Vout-,比较器输出结果为1,否则,比较器输出结果为0。
9.根据权利要求7所述的方法,其特征在于,还包括电容失配误差测量的步骤,具体包括:
设置权重存储电路初始值为理想权重;
进行模数转换得到比较器输出结果和重建码输出结果;
在偏差平方和最小的约束条件下,对重建码输出结果进行曲线拟合;
根据实际输出曲线与拟合曲线之间的误差估计电容实际权重。
10.根据权利要求9所述的方法,其特征在于,所述设置权重存储电路初始值为理想权重具体包括:
有效位权重设置,其中第1级电容阵列有效位个数为n1,第2级电容阵列有效位个数为n2,…,第m级电容阵列有效位个数为nm;第1级电容阵列最高位权重W11的理想值为第1级电容阵列次高位权重W12的理想值为第m级电容阵列第1位权重Wm1的理想值为第m级电容阵列次高位权重Wm2的理想值为第m级电容阵列第nm位权重的理想值为1;
冗余位权重设置,其中第1级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,即Wideal1r=Wideal1i;第2级电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,即Wideal2r=Wideal2i;…,第m电容阵列中冗余位权重理想值与其前1个有效位权重理想值相同,可能为多个,即为:
Widealmrk=20=1
Widealmr(k-1)=21=2
Widealmr(k-2)=22=4
…
Widealmr1=2k-1。
11.根据权利要求9所述的方法,其特征在于,所述进行模数转换得到比较器输出结果和重建码输出结果具体包括:
输入信号特征已知的输入信号,输入信号幅度需大于模数转换器输入信号范围的一半;
模数转换器根据设置的理想权重值,进行模数转换,得到比较器输出结果和重建码输出结果,采样点的个数N必须大于第1级电容阵列有效位个数为n1,第2级电容阵列有效位个数为n2,…,第m级电容阵列有效位个数为nm。
12.根据权利要求9所述的方法,其特征在于,所述在偏差平方和最小的约束条件下,对重建码输出结果进行曲线拟合具体包括:
假设输入信号函数为f(i),输出信号为Dout(i);i和Dout(i)已知,在偏差平方和最小的约束条件下:得到拟合的输入信号曲线其中,i=1,2,...,N,N表示采样点个数。
13.根据权利要求12所述的方法,其特征在于,所述根据实际输出曲线与拟合曲线之间的误差估计电容实际权重具体包括:
a)计算第1个实际输出值与拟合值之间的误差
b)根据误差值,按权重比例,估计电容实际权重
其中,μ为步长因子,0<μ<1
若由工艺偏差确定第m电容阵列中第p位以后的电容权重不影响电容阵列的单调性,则权重小于Wmp的电容失配误差可以忽略,则其权重为理想权重,并按以下公式估计其它电容实际权重:
c)根据估计的权重计算估计输出值
Dout_est(1)=R11(2)·W11(1)+R12(2)·W12(1)+...+Rmrk(2)·Wmrk(1)
d)计算估计输出值与拟合值之间的误差
e)根据误差值,按权重比例,再次估计电容实际权重
若由工艺偏差确定第m电容阵列中第p位以后的电容权重不影响电容阵列的单调性,则权重小于Wmp的电容失配误差可以忽略,则其权重为理想权重,并按以下公式估计其它电容实际权重:
f)循环步骤c)至步骤e),直到完成N次估计,得到最后1次估计权重W11(N),W12(N),…,Wmrk(N)。
14.根据权利要求9所述的方法,其特征在于,还包括电容失配误差校正步骤具体包括:
将估计得到的电容实际权重写入权重存储电路;
进行模数转换,利用电容实际权重得到校正后的重建码输出。
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