CN103915052B - 一种栅极驱动电路、方法及显示装置 - Google Patents

Abstract

本发明公开了一种栅极驱动电路、方法及显示装置，所述栅极驱动电路包括多级GOA单元，每个GOA单元包括双向扫描控制模块、上拉控制模块、上拉模块、下拉模块和输出端，双向扫描控制模块用于在正向扫描控制信号为高电平时，控制所述上拉控制模块以上一级GOA单元的输出信号为输入信号，控制所述下拉模块以下一级GOA单元的输出信号为复位信号；在反向扫描控制信号为高电平时，控制所述上拉控制模块以下一级GOA单元的输出信号为输入信号，控制所述下拉模块以上一级GOA单元的输出信号为复位信号。相应的，本发明还公开了液晶显示器及栅极驱动方法，既能够满足液晶显示器窄边框的要求，又能够实现双向栅极扫描。

Description

一种栅极驱动电路、方法及显示装置

技术领域

本发明涉及栅极驱动技术，尤其涉及一种栅极驱动电路、方法及显示装置。

背景技术

液晶显示器是目前常用的平板显示器，其中薄膜场效应晶体管液晶显示器（TFT-LCD。Thin Film Transistor Liquid Crystal Display）是目前液晶显示器中的主流产品。随着TFT-LCD产品的竞争日益激烈，各厂家纷纷通过采用新技术来降低产品的成本，提高产品的市场竞争力。其中，栅极驱动（GOA，Gate onArray）技术是指将TFT-LCD的栅极驱动器（Gate Driver）集成在阵列基板上，形成对面板的扫描驱动。相比传统覆晶薄膜（COF，ChipOn Flex/Film）和直接绑定在玻璃上（COG，Chip On Glass）的工艺，其不仅可以节省成本，而且面板可以做到两边对称美观设计，省去了栅集成电路（Gate IC）的绑定（Bonding）区域以及扇出（Fan-out）布线空间，实现了窄边框的设计；同时由于可以省去Gate方向Bonding的工艺，对产能和良品率提升也比较有利。

但是，相比于COF和COG技术，现有的GOA技术虽然能够满足窄边框的设计需求，但却不能满足进行双向栅极扫描的需求。

发明内容

有鉴于此，本发明的主要目的在于提供一种栅极驱动电路、方法及显示装置，能够实现双向栅极扫描。

为达到上述目的，本发明的技术方案是这样实现的：

一种栅极驱动电路，所述栅极驱动电路包括多级GOA单元，每个GOA单元包括上拉控制模块、上拉模块、下拉模块和输出端，

所述GOA单元还包括：双向扫描控制模块，用于在正向扫描控制信号为高电平时，控制所述上拉控制模块以上一级GOA单元的输出信号为输入信号，控制所述下拉模块以下一级GOA单元的输出信号为复位信号；在反向扫描控制信号为高电平时，控制所述上拉控制模块以下一级GOA单元的输出信号为输入信号，控制所述下拉模块以上一级GOA单元的输出信号为复位信号；

上拉控制模块，用于在所述输入信号为高电平时，控制所述上拉模块导通；上拉模块，用于在导通时将第一时钟信号作为栅极驱动信号进行输出；

下拉模块，用于在所述复位信号为高电平时停止输出端的输出。

所述双向扫描控制模块包括正向扫描控制子模块和反向扫描控制子模块；其中，

正向扫描控制子模块，用于在正向扫描控制信号为高电平时控制所述上拉控制模块以上一级GOA单元的输出信号为输入信号，控制所述下拉模块以下一级GOA单元的输出信号为复位信号；

所述反向扫描控制子模块，用于在反向扫描控制信号为高电平时控制所述上拉控制模块以下一级GOA单元的输出信号为输入信号，控制所述下拉模块以上一级GOA单元的输出信号为复位信号；

所述正向扫描控制信号与所述反向扫描控制信号的周期为一帧且相位相反。

所述正向扫描控制子模块包括第十四薄膜晶体管和第十六薄膜晶体管；其中，

第十四薄膜晶体管的栅极与所述第十六薄膜晶体管的栅极连接且连接点作为正向扫描控制端，接收正向扫描控制信号；

第十四薄膜晶体管的源极连接上一级GOA单元的输出端，漏极连接所述上拉控制模块的输入信号端；

第十六薄膜晶体管的源极连接下一级GOA单元的输出端，漏极连接所述下拉模块的复位信号输入端。

所述反向扫描控制子模块包括第七薄膜晶体管和第十五薄膜晶体管；其中，

第七薄膜晶体管的栅极与所述第十五薄膜晶体管的栅极连接且连接点作为反向扫描控制端，接收反向扫描控制信号；

第七薄膜晶体管的源极连接下一级GOA单元的输出端，漏极连接所述上拉控制模块的输入信号端；

第十五薄膜晶体管的源极连接上一级GOA单元的输出端，漏极连接所述下拉模块的复位信号输入端。

所述上拉控制模块包括：第一薄膜晶体管和第十三薄膜晶体管；其中，第一薄膜晶体管的栅极和源极连接，作为所述上拉控制模块的输入信号端，漏极与第十三薄膜晶体管的漏极连接；第十三薄膜晶体管的源极连接所述第一薄膜晶体管的源极，栅极连接第二时钟信号输入端；

所述上拉模块包括：第三薄膜晶体管和升压器件；其中，第三薄膜晶体管的栅极连接所述上拉控制模块中第一薄膜晶体管漏极和第十三薄膜晶体管漏极的连接点，源极作为第一时钟信号的输入端，漏极作为输出端；升压器件的一端连接所述上拉控制模块中第一薄膜晶体管漏极和第十三薄膜晶体管漏极的连接点，另一端作为输出端。

所述下拉模块包括：第二薄膜晶体管和第四薄膜晶体管；其中，

第二薄膜晶体管的栅极与第四薄膜晶体管的栅极连接，并作为所述下拉模块的复位信号输入端，漏极连接低电平端，源极连接所述上拉控制模块中第一薄膜晶体管漏极和第十三薄膜晶体管漏极的连接点；

第四薄膜晶体管的源极连接所述输出模块，漏极连接低电平端。

所述GOA单元还包括下拉控制模块，用于在第二时钟信号为高电平时拉高所述下拉模块，使得所述下拉模块导通；

所述第二时钟信号与所述第一时钟信号周期相同相位相反。

一种显示装置，包括上述的栅极驱动电路。

一种栅极驱动方法，包括：

在正向扫描控制信号为高电平时，以上一级GOA单元的输出信号为输入信号，以下一级GOA单元的输出信号为复位信号；在反向扫描控制信号为高电平时，以下一级GOA单元的输出信号为输入信号，以上一级GOA单元的输出信号为复位信号；

在所述输入信号为高电平时，将第一时钟信号作为栅极驱动信号输出；

在所述复位信号为高电平时，停止输出。

所述在正向扫描控制信号为高电平时，以上一级GOA单元的输出信号为输入信号，以下一级GOA单元的输出信号为复位信号，为：在正向扫描控制信号为高电平时导通正向扫描控制子模块，正向扫描控制子模块在导通时控制上拉控制模块以上一级GOA单元的输出信号为输入信号，控制下拉模块以下一级GOA单元的输出信号为复位信号；

所述在反向扫描控制信号为高电平时，以下一级GOA单元的输出信号为输入信号，以上一级GOA单元的输出信号为复位信号，为：所述用于在反向扫描控制信号为高电平时导通反向扫描控制子模块，所述反向扫描控制子模块在导通时控制上拉控制模块以下一级GOA单元的输出信号为输入信号，控制下拉模块以上一级GOA单元的输出信号为复位信号；

所述正向扫描控制信号与所述反向扫描控制信号的周期为一帧且相位相反；

所述在所述输入信号为高电平时，将第一时钟信号作为栅极驱动信号输出，包括：上拉模块在输入信号为高电平时导通，拉高上拉模块，使得上拉模块导通；上拉模块导通时控制输出模块将第一时钟信号作为栅极驱动信号输出；

所述在所述复位信号为高电平时，停止输出，包括：下拉模块在所述复位信号为高电平时导通，并在导通时控制所述输出模块停止输出。

本发明的栅极驱动电路、方法及显示装置，能够在扫描控制信号的控制下进行正向扫描或反向扫描，既能够满足显示装置窄边框的要求，又能够实现双向栅极扫描，提高了栅极驱动电路的灵活度及工作效率，进而提高了显示装置显示图像的效率。

附图说明

图1为本发明实施例中显示装置栅极驱动电路的组成结构示意图；

图2为图1所示栅极驱动电路正向扫描时输入输出信号的时序图；

图3为图1所示栅极驱动电路反向扫描时输入输出信号的时序图；

图4为本发明实施例栅极驱动电路中每个GOA单元的组成结构示意图；

图5为本发明实施例中GOA单元的具体电路结构示意图；

图6为本发明栅极驱动方法的实现流程图。

附图标记说明：M1-第一薄膜晶体管；M2-第二薄膜晶体管；M3-第三薄膜晶体管；M4-第四薄膜晶体管；M5-第五薄膜晶体管；M6-第六薄膜晶体管；M7-第七薄膜晶体管；M8-第八薄膜晶体管；M9-第九薄膜晶体管；M10-第十薄膜晶体管；M11-第十一薄膜晶体管；M12-第十二薄膜晶体管；M13-第十三薄膜晶体管；M14-第十四薄膜晶体管；M15-第十五薄膜晶体管；M16-第十六薄膜晶体管；C1-升压器件；41-双向扫描控制模块；42-上拉控制模块；43-上拉模块；44-下拉控制模块；45-下拉模块。

具体实施方式

本发明中的显示装置，其阵列基板上包含m（m为不小于1的整数）条数据驱动线和n（n为不小于1的整数）条栅极驱动线，在数据驱动线和栅极驱动线交错的区域上设置有像素，也就是说，显示装置的阵列基板上设置有n行m列像素，显示装置的栅极驱动电路通过栅极数据线逐行向像素输出栅极驱动信号，从而逐行驱动像素打开，使得各行像素能够接收数据驱动电路通过数据驱动线输出的数据信号，进而基于数据信号进行图像显示。

显示装置的栅极驱动电路包括多级GOA单元，每个GOA单元通过一条栅极驱动线驱动一行像素，在GOA单元输出高电平信号时，通过相应的栅极驱动线驱动相应行上的像素打开，使得该行像素能够接收数据信号；在GOA单元输出低电平信号时，相应行上的像素关闭，停止接收数据信号。如此，在一帧画面里，栅极驱动电路中的多级GOA单元，依次输出高电平信号，逐行驱动像素。

本发明中的栅极驱动电路可以从第一级GOA电路开始由各GOA单元依次输出高电平信号，从最后一行像素开始逐行驱动像素，实现正向扫描；还可以从最后一级GOA单元开始由各GOA单元依次输出高电平信号，从最后一行像素开始逐行驱动像素，实现反向扫描。

如图1所示，本发明实施例中的栅极驱动电路包括800个GOA单元（GOA_1~GOA_800），分别用于驱动800行像素，此外，还包括八个冗余（Dummy）GOA单元（GOA_LU1、GOA_LU2、GOA_LD1、GOA_LD2；GOA_RU1、GOA_RU2、GOA_RD1、GOA_RD2），其中，所述800个GOA单元采用两列的方式排布，位于左边的一列包含用于驱动奇数行像素的GOA单元（GOA_1、GOA_3、……、GOA_797、GOA_799）、以及Dummy GOA单元（GOA_LU1、GOA_LU2、GOA_LD1、GOA_LD2），位于右边的一列包含用于驱动偶数行像素的GOA单元（GOA_2、GOA_4、……、GOA_798、GOA_800）、以及Dummy GOA单元（GOA_RU1、GOA_RU2、GOA_RD1、GOA_RD2），其中，各Dummy GOA单元对显示装置的正常显示没有影响，与时序相关，由时序决定。

其中，位于同一列的各GOA单元组成一个GOA单元组，一个GOA单元组中的各GOA单元相互级联，每级GOA单元具有正向扫描控制端、正向扫描输入端、反向扫描控制端、反向扫描输入端、低电平端（图2中未示出）、第一时钟信号输入端、第二时钟信号输入端和输出端，其中，每级GOA单元的正向扫描输入端连接上一级GOA单元的输出端，接收上一级GOA单元的输出信号（OUPUT_n-1），反向扫描输入端连接下一级GOA单元的输出端，接收下一级GOA单元的输出信号（OUPUT_n+1），输出端分别连接上一级GOA单元的反向扫描输入端和下一级GOA单元的正向扫描输入端，输出本级的栅极驱动信号（OUPUT_n），正向扫描输入端接收正向扫描控制信号（VDD/VSS），反向扫描输入端接收反向扫描控制信号（VSS/VDD），低电平端（VGL）接收低电平信号（VSL），第一时钟信号输入端（CLK）接收第一时钟信号（CLK），第二时钟信号输入端接收第二时钟信号（CLKB）。每个GOA单元在上一级GOA单元的输出信号OUPUT_n-1、下一级GOA单元的输出信号OUPUT_n+1、第一时钟信号CLK和第二时钟信号CLKB的控制下工作，输出本级的栅极控制信号OUPUT_n。

特别的，对于各GOA单元组中的第一行GOA单元，其正向扫描输入端接收输入启动信号（STV），对于各GOA单元组中的最后一行GOA单元来说，其反向扫描输入端接收输入启动信号（STV）。

实际应用中，各GOA单元输入输出信号正向扫描时的时序如图2所示，反向扫描时的时序如图3所示，其中，第一时钟信号CLK与第二时钟信号CLKB的相位相反，周期相同，在正向扫描和反向扫描时这两个信号互换；具体的，对于左边一列的GOA单元组，其输入启动信号为STVPL，第一时钟信号为CLKL，第二时钟信号为CLKBL；对于右边一列的GOA单元组，其输入启动信号为STVPR，第一时钟信号为CLKR，第二时钟信号为CLKBR。其中，STVPL与STVPR之间相位相同且相差半个周期，CLKL与CLKR之间相位相同且相差半个周期，CLKBL与CLKBR之间相位相同且相差半个周期。

如图2所示，正向扫描时，正向扫描控制信号VDD/VSS保持为高电平，反向扫描控制信号VDD/VSS保持为低电平，此时，每级GOA单元在正向扫描控制信号VDD/VSS的控制下，以上一级GOA单元的输出信号OUTPUT_n-1为输入信号（INPUT），以下一级GOA单元的输出信号OUTPUT_n+1为复位信号（RESET），以第一时钟信号CLK为输出信号OUTPUT_n。

如图3所示，反向扫描时，反向扫描控制信号VDD/VSS保持为高电平，正向扫描控制信号VDD/VSS保持为低电平，此时，CLK与正向扫描时的CLKB相同，CLKB与正向扫描时的CLK相同，每级GOA单元在反向扫描控制信号VSS/VDD的控制下，以下一级GOA单元的输出信号OUTPUT_n+1为输入信号（INPUT），以上一级GOA单元的输出信号OUTPUT_n-1为复位信号（RESET），以第一时钟信号CLK为输出信号OUTPUT_n。

具体的，如图4所示，每级GOA单元包含双向扫描控制模块41、上拉（PU，Pull Up）控制模块42、上拉模块43、下拉（PD，Pull Down）控制模块44、下拉模块45和输出端。其中，下拉控制模块44为可选，可以根据需要在GOA单元中设置。

其中，双向扫描控制模块41中包含有正向扫描控制子模块411和反向扫描控制子模块412，在正向扫描控制信号VDD/VSS为高电平时，正向扫描控制子模块411导通，控制上拉控制模块42以上一级GOA单元的输出信号OUTPUT_n-1为输入信号（INPUT），控制下拉模块45以下一级GOA单元的输出信号OUTPUT_n+1为复位信号（RESET）；在反向扫描控制信号VSS/VDD为高电平时，反向扫描控制子模块412导通，控制上拉控制模块42以下一级GOA单元的输出信号OUTPUT_n+1为INPUT，并控制下拉模块45以上一级GOA单元的输出信号OUTPUT_n-1为RESET；

上拉控制模块42在INPUT为高电平时，拉高上拉模块42，使得上拉模块43导通，上拉模块43导通时将第一时钟信号（CLK）作为栅极驱动信号（OUTPUT_n）输出。下拉模块45用于在下一个GOA单元正常工作即输出高电平的栅极驱动信号（即RESET为高电平）时导通，并在导通时停止输出端输出信号（即栅极驱动信号）。

下拉控制模块44用于在CLKB为高电平时，拉高下拉模块45，使得下拉模块45导通，并在导通时停止输出端输出信号。

每级GOA单元的具体电路结构如图5所示，其中，双向扫描控制模块41包括第十四薄膜晶体管M14、第十六薄膜晶体管M16、第七薄膜晶体管M7、和第十五薄膜晶体管M15；上拉控制模块42包括第一薄膜晶体管M1和第十三薄膜晶体管M13，上拉模块43包括第三薄膜晶体管M3和升压器件C1，下拉控制模块44包括第九薄膜晶体管M9、第五薄膜晶体管M5、第八薄膜晶体管M8、第六薄膜晶体管M6，下拉模块45包括第二薄膜晶体管M2、第四薄膜晶体管M4、第十薄膜晶体管M10、第十一薄膜晶体管M11、第十二薄膜晶体管M12；输出端（OUTPUT_n）。

具体的，正向扫描控制子模块411包括M14和M16，M14的源极作为正向扫描的输入信号（INPUT）端，接收OUTPUT_n-1，栅极作为正向扫描控制端，接收正向扫描控制信号VDD/VSS，漏极连接上拉控制模块42中M1的栅极和源极；M16的栅极作为正向扫描控制端，接收正向扫描控制信号VDD/VSS，源极作为复位信号（RESET）输入端，接收OUTPUT_n+1，漏极连接下拉模块45中M2的栅极。在正向扫描控制信号VDD/VSS为高电平时，M14和M16导通。

反向扫描控制子模块412包括M7和M15，M7的源极作为反向扫描的INPUT端，接收OUTPUT_n+1，栅极作为反向扫描控制端，接收反向扫描控制信号VSS/VDD，漏极连接上拉控制模块42中M1的栅极和源极；M15的栅极作为反向扫描控制端，接收反向扫描控制信号VSS/VDD，源极作为RESET输入端，接收OUTPUT_n-1，漏极连接下拉模块42中M2的栅极。在反向扫描控制信号VSS/VDD为高电平时，M7和M15导通。

具体的，上拉控制模块42中，M1的栅极和源极连接双向扫描控制模块中M14的漏极和M7的漏极，M13的源极连接M1的源极和栅极，栅极连接第二时钟信号（CLKB）输入端，接收CLKB，M1的漏极与M13的漏极连接，其连接点为上拉节点PU点，用于连接上拉模块43；

上拉模块43中，C1的一端连接上拉节点PU点，另一端与M3的漏极连接，M3的栅极连接PU点，源极作为第一时钟信号（CLK）输入端，接收CLK，其中，M3漏极与C1一端的连接点用于连接输出模块46的输出端；这里，

其中，M1和M13用于在导通时为PU点充电，拉升PU点电压，在PU点处于高电平时上拉模块中M3导通，C1用于进一步拉升M3两端电压，M3导通时将CLK输出到输出端，使得输出端输出与CLK相同的高电平，即使得输出端输出栅极驱动信号。这里，M13、C1均为可选器件。

下拉控制模块44中，M9的栅极与源极连接CLKB输入端，M9的漏极连接M5的栅极，M5的漏极连接CLKB输入端，源极连接M6的源极，M6的栅极和M8的栅极连接并连接在PU点上，M6和M8的漏极连接VGL端，M8的源极连接在PDCN点上。其中，M5源极与M6源极的连接点为下拉节点PD点，M5栅极与M9漏极的连接点为下拉控制节点PDCN点，PD点用于控制下拉模块45的电压，PDCN点用于控制PD点的电压；

下拉模块45中，M2的源极和M10的源极连接在PU点上，M2的漏极与M10的漏极连接低电平（VGL）端，M2的栅极连接在双向扫描控制模块41中M16漏极与M15漏极的连接点上，M10的栅极连接在下拉控制模块44的PD点，M12的栅极连接CLKB输入端，M12、M11和M4的源极连接并连接在输出模块46的输出端OUTPUT上，M12、M11和M4的漏极均连接在VGL端上，M11的栅极连接在PD点上，M4的栅极连接在双向扫描控制模块41中M16漏极与M15漏极的连接点上。

其中，M2、M10在导通时为PU点放电，拉低PU点电压，在PU点处于低电平时断开M3，进而拉低输出端的电压，使得输出端停止输出栅极驱动信号；M4、M11、M12用于在导通时为输出端放电，拉低输出端的电压，使得输出端停止输出栅极驱动信号。其中，M10、M11和M12为可选器件。

其中，M9用于在导通时为PDCN点充电，PDCN点为高电平时，M5导通，M5在导通时为PD充电，PD点为高电平时，使得下拉模块45中的M10、M11和M12导通；在PU点为高电平时，M6、M8导通，M6在导通时为PD放电，M8导通时为PDCN点放电，以抑制PDCN点和PD点在低电平时产生的噪声。

这里，下拉模块45和下拉控制模块44还可以用于在输出模块46正常输出栅极驱动信号时抑制PU点和输出端的噪声。

上述GOA单元正向扫描时的工作过程如下：正向扫描时，VDD/VSS信号接入高电平VDD，VSS/VDD信号接入低电平VSS，M14和M16导通，M7和M15断开，此时，OUTPUT_n-1作为当前GOA单元的INPUT，OUTPUT_n+1作为RESET，当INPUT为高时（即上一行GOA单元正常输出时），此时CLKB也是高电平，M1和M13导通，PU点电压被拉高，C1进一步将PU点拉高，由PU点的高电压为M3的栅极进行预充电，之后，CLKB变为低电平，CLK由低电平转换为高电平，M3导通，CLK通过M3的源极、漏极输入到输出端，为输出端进行充电，此时，输出端的输出信号OUTPUT_n与CLK相同，为高电平，当前GOA单元正常输出栅极驱动信号，驱动相应行上像素打开并接收数据信号；而在下一行GOA单元进行正常输出时，即OUTPUT_n+1信号为高电平，即RESET为高，M2和M4导通，M2为M3的栅极放电，M4为输出端放电，将输出信号OUTPUT_n迅速拉低，使得当前GOA单元的输出端处于关闭状态，停止输出栅极驱动信号，相应行上像素关闭。

上述GOA单元正向扫描时的工作过程如下：反向扫描时，VDD/VSS接入低电平VSS，VSS/VDD接入高电平VDD，M7和M15导通，而M14和M16断开，此时，OUTPUT_n+1作为当前GOA单元的INPUT，OUTPUT_n-1作为RESET，当INPUT为高时（即下一行GOA单元正常输出时），此时CLKB也是高电平，M1和M13导通，PU点电压被拉高，C1进一步将PU点拉高，由PU点的高电压为M3的栅极进行预充电，之后，CLKB变为低电平，CLK由低电平转换为高电平，M3导通，CLK通过M3的源极、漏极输入到输出端，为输出端进行充电，此时，输出端的输出信号OUTPUT_n与CLK相同，为高电平，当前GOA单元正常输出栅极驱动信号，驱动相应行上像素打开并接收数据信号；而在上一行GOA单元进行正常输出时，即OUTPUT_n-1信号为高电平，即RESET为高，M2和M4导通，M2为M3的栅极放电，M4为输出端放电，将输出信号OUTPUT_n迅速拉低，使得当前GOA单元的输出端处于关闭状态，停止输出栅极驱动信号，相应行上像素关闭。

其中，上述M1~M16具体可以为金属-氧化物-半导体场效应晶体（Metal-Oxide-Semiconductor，MOS）管。上述C1具体可以为电容器件。

本发明还提供了一种利用上述栅极驱动电路实现的栅极驱动方法，所述方法的实现流程参见图6，包括：

步骤601：在正向扫描控制信号为高电平时，以上一级GOA单元的输出信号为输入信号，以下一级GOA单元的输出信号为复位信号；在反向扫描控制信号为高电平时，以下一级GOA单元的输出信号为输入信号，以上一级GOA单元的输出信号为复位信号；

具体地，在正向扫描控制信号为高电平时导通正向扫描控制子模块，正向扫描控制子模块在导通时控制上拉控制模块以上一级GOA单元的输出信号为输入信号，控制下拉模块以下一级GOA单元的输出信号为复位信号；

具体地，在反向扫描控制信号为高电平时导通反向扫描控制子模块，所述反向扫描控制子模块在导通时控制上拉控制模块以下一级GOA单元的输出信号为输入信号，控制下拉模块以上一级GOA单元的输出信号为复位信号；

这里，所述正向扫描控制信号与所述反向扫描控制信号的周期为一帧且相位相反。

步骤602：在所述输入信号为高电平时，将第一时钟信号作为栅极驱动信号输出；在所述复位信号为高电平时，停止输出。

具体地，上拉模块在输入信号为高电平时导通，拉高上拉模块，使得上拉模块导通；上拉模块导通时控制输出模块将第一时钟信号作为栅极驱动信号输出；下拉模块在所述复位信号为高电平时导通，并在导通时控制所述输出模块停止输出。

这里，所述方法还可以包括：在CLKB为高电平时，下拉控制模块导通，拉高所述下拉模块，使得下拉模块导通，下拉模块导通时控制所述输出模块停止输出。

以上所述，仅为本发明的较佳实施例而已，并非用于限定本发明的保护范围。

Claims (7)

1.一种栅极驱动电路，所述栅极驱动电路包括多级GOA单元，每个GOA单元包括上拉控制模块、上拉模块、下拉模块和输出端，其特征在于，

所述GOA单元还包括：双向扫描控制模块，用于在正向扫描控制信号为高电平时，控制所述上拉控制模块以上一级GOA单元的输出信号为输入信号，控制所述下拉模块以下一级GOA单元的输出信号为复位信号；在反向扫描控制信号为高电平时，控制所述上拉控制模块以下一级GOA单元的输出信号为输入信号，控制所述下拉模块以上一级GOA单元的输出信号为复位信号；

上拉控制模块，用于在所述输入信号为高电平时，控制所述上拉模块导通；上拉模块，用于在导通时将第一时钟信号作为栅极驱动信号进行输出；

下拉模块，用于在所述复位信号为高电平时停止输出端的输出；

其中，所述正向扫描控制信号与所述反向扫描控制信号的周期为一帧且相位相反；

所述双向扫描控制模块包括正向扫描控制子模块和反向扫描控制子模块；其中，

正向扫描控制子模块，用于在正向扫描控制信号为高电平时控制所述上拉控制模块以上一级GOA单元的输出信号为输入信号，控制所述下拉模块以下一级GOA单元的输出信号为复位信号；

所述反向扫描控制子模块，用于在反向扫描控制信号为高电平时控制所述上拉控制模块以下一级GOA单元的输出信号为输入信号，控制所述下拉模块以上一级GOA单元的输出信号为复位信号；

所述正向扫描控制子模块包括第十四薄膜晶体管和第十六薄膜晶体管；其中，

第十四薄膜晶体管的栅极与所述第十六薄膜晶体管的栅极连接且连接点作为正向扫描控制端，接收正向扫描控制信号；

第十四薄膜晶体管的源极连接上一级GOA单元的输出端，漏极连接所述上拉控制模块的输入信号端；

第十六薄膜晶体管的源极连接下一级GOA单元的输出端，漏极连接所述下拉模块的复位信号输入端。

2.根据权利要求1所述的栅极驱动电路，其特征在于，所述反向扫描控制子模块包括第七薄膜晶体管和第十五薄膜晶体管；其中，

第七薄膜晶体管的栅极与所述第十五薄膜晶体管的栅极连接且连接点作为反向扫描控制端，接收反向扫描控制信号；

第七薄膜晶体管的源极连接下一级GOA单元的输出端，漏极连接所述上拉控制模块的输入信号端；

第十五薄膜晶体管的源极连接上一级GOA单元的输出端，漏极连接所述下拉模块的复位信号输入端。

3.根据权利要求1或2所述的栅极驱动电路，其特征在于，

所述上拉控制模块包括：第一薄膜晶体管和第十三薄膜晶体管；其中，第一薄膜晶体管的栅极和源极连接，作为所述上拉控制模块的输入信号端，漏极与第十三薄膜晶体管的漏极连接；第十三薄膜晶体管的源极连接所述第一薄膜晶体管的源极，栅极连接第二时钟信号输入端；

所述上拉模块包括：第三薄膜晶体管和升压器件；其中，第三薄膜晶体管的栅极连接所述上拉控制模块中第一薄膜晶体管漏极和第十三薄膜晶体管漏极的连接点，源极作为第一时钟信号的输入端，漏极作为输出端；升压器件的一端连接所述上拉控制模块中第一薄膜晶体管漏极和第十三薄膜晶体管漏极的连接点，另一端作为输出端。

4.根据权利要求3所述的栅极驱动电路，其特征在于，所述下拉模块包括：第二薄膜晶体管和第四薄膜晶体管；其中，

第二薄膜晶体管的栅极与第四薄膜晶体管的栅极连接，并作为所述下拉模块的复位信号输入端，漏极连接低电平端，源极连接所述上拉控制模块中第一薄膜晶体管漏极和第十三薄膜晶体管漏极的连接点；

第四薄膜晶体管的源极连接所述输出模块，漏极连接低电平端。

5.根据权利要求4所述的栅极驱动电路，其特征在于，所述GOA单元还包括下拉控制模块，用于在第二时钟信号为高电平时拉高所述下拉模块，使得所述下拉模块导通；

所述第二时钟信号与所述第一时钟信号周期相同相位相反。

6.一种显示装置，其特征在于，所述显示装置包括如权利要求1至5任一项所述的栅极驱动电路。

7.一种栅极驱动方法，其特征在于，所述栅极驱动方法包括：

在正向扫描控制信号为高电平时，以上一级GOA单元的输出信号为输入信号，以下一级GOA单元的输出信号为复位信号；在反向扫描控制信号为高电平时，以下一级GOA单元的输出信号为输入信号，以上一级GOA单元的输出信号为复位信号；

在所述输入信号为高电平时，将第一时钟信号作为栅极驱动信号输出；

在所述复位信号为高电平时，停止输出；

所述正向扫描控制信号与所述反向扫描控制信号的周期为一帧且相位相反；

所述在正向扫描控制信号为高电平时，以上一级GOA单元的输出信号为输入信号，以下一级GOA单元的输出信号为复位信号，为：在正向扫描控制信号为高电平时导通正向扫描控制子模块，正向扫描控制子模块在导通时控制上拉控制模块以上一级GOA单元的输出信号为输入信号，控制下拉模块以下一级GOA单元的输出信号为复位信号；

所述在反向扫描控制信号为高电平时，以下一级GOA单元的输出信号为输入信号，以上一级GOA单元的输出信号为复位信号，为：在反向扫描控制信号为高电平时导通反向扫描控制子模块，反向扫描控制子模块在导通时控制上拉控制模块以下一级GOA单元的输出信号为输入信号，控制下拉模块以上一级GOA单元的输出信号为复位信号；

所述在所述输入信号为高电平时，将第一时钟信号作为栅极驱动信号输出，包括：上拉模块在输入信号为高电平时导通，拉高上拉模块，使得上拉模块导通；上拉模块导通时控制输出模块将第一时钟信号作为栅极驱动信号输出；

所述在所述复位信号为高电平时，停止输出，包括：下拉模块在所述复位信号为高电平时导通，并在导通时控制所述输出模块停止输出；

所述正向扫描控制子模块包括第十四薄膜晶体管和第十六薄膜晶体管；其中，

第十四薄膜晶体管的栅极与所述第十六薄膜晶体管的栅极连接且连接点作为正向扫描控制端，接收正向扫描控制信号；

第十四薄膜晶体管的源极连接上一级GOA单元的输出端，漏极连接所述上拉控制模块的输入信号端；

第十六薄膜晶体管的源极连接下一级GOA单元的输出端，漏极连接所述下拉模块的复位信号输入端。