CN103832965A - 基片刻蚀方法 - Google Patents
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- 238000005530 etching Methods 0.000 title claims abstract description 111
- 238000000034 method Methods 0.000 title claims abstract description 82
- 239000000758 substrate Substances 0.000 title claims abstract description 58
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims abstract description 42
- 229910052710 silicon Inorganic materials 0.000 claims abstract description 42
- 239000010703 silicon Substances 0.000 claims abstract description 42
- 229920000642 polymer Polymers 0.000 claims abstract description 4
- 238000000151 deposition Methods 0.000 claims description 16
- 230000007423 decrease Effects 0.000 claims description 9
- 230000011218 segmentation Effects 0.000 claims description 2
- 230000006378 damage Effects 0.000 abstract description 7
- 230000008021 deposition Effects 0.000 abstract description 5
- 239000007789 gas Substances 0.000 description 13
- 238000010586 diagram Methods 0.000 description 9
- 239000007795 chemical reaction product Substances 0.000 description 7
- 238000005516 engineering process Methods 0.000 description 5
- 230000001351 cycling effect Effects 0.000 description 2
- 238000007599 discharging Methods 0.000 description 2
- 230000005284 excitation Effects 0.000 description 2
- 238000002474 experimental method Methods 0.000 description 2
- 238000012886 linear function Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 238000012163 sequencing technique Methods 0.000 description 2
- 208000027418 Wounds and injury Diseases 0.000 description 1
- 230000009286 beneficial effect Effects 0.000 description 1
- 238000005538 encapsulation Methods 0.000 description 1
- 208000014674 injury Diseases 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000004377 microelectronic Methods 0.000 description 1
- 238000005457 optimization Methods 0.000 description 1
- 239000002210 silicon-based material Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 235000012431 wafers Nutrition 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3205—Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
- H01L21/321—After treatment
- H01L21/3213—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
- H01L21/32133—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
- H01L21/32135—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only
- H01L21/32136—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas
- H01L21/32137—Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas of silicon-containing layers
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B81—MICROSTRUCTURAL TECHNOLOGY
- B81C—PROCESSES OR APPARATUS SPECIALLY ADAPTED FOR THE MANUFACTURE OR TREATMENT OF MICROSTRUCTURAL DEVICES OR SYSTEMS
- B81C1/00—Manufacture or treatment of devices or systems in or on a substrate
- B81C1/00436—Shaping materials, i.e. techniques for structuring the substrate or the layers on the substrate
- B81C1/00523—Etching material
- B81C1/00531—Dry etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
- H01L21/3065—Plasma etching; Reactive-ion etching
- H01L21/30655—Plasma etching; Reactive-ion etching comprising alternated and repeated etching and passivation steps, e.g. Bosch process
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B81—MICROSTRUCTURAL TECHNOLOGY
- B81C—PROCESSES OR APPARATUS SPECIALLY ADAPTED FOR THE MANUFACTURE OR TREATMENT OF MICROSTRUCTURAL DEVICES OR SYSTEMS
- B81C2201/00—Manufacture or treatment of microstructural devices or systems
- B81C2201/01—Manufacture or treatment of microstructural devices or systems in or on a substrate
- B81C2201/0101—Shaping material; Structuring the bulk substrate or layers on the substrate; Film patterning
- B81C2201/0111—Bulk micromachining
- B81C2201/0112—Bosch process
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- B—PERFORMING OPERATIONS; TRANSPORTING
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- B81C—PROCESSES OR APPARATUS SPECIALLY ADAPTED FOR THE MANUFACTURE OR TREATMENT OF MICROSTRUCTURAL DEVICES OR SYSTEMS
- B81C2201/00—Manufacture or treatment of microstructural devices or systems
- B81C2201/01—Manufacture or treatment of microstructural devices or systems in or on a substrate
- B81C2201/0101—Shaping material; Structuring the bulk substrate or layers on the substrate; Film patterning
- B81C2201/0128—Processes for removing material
- B81C2201/013—Etching
- B81C2201/0132—Dry etching, i.e. plasma etching, barrel etching, reactive ion etching [RIE], sputter etching or ion milling
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- Engineering & Computer Science (AREA)
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Abstract
本发明提供一种基片刻蚀方法,其包括以下步骤:沉积作业,用以在硅槽侧壁上沉积聚合物;刻蚀作业,用以对所述硅槽侧壁进行刻蚀;重复所述沉积作业和刻蚀作业至少两次;其中,在完成所述刻蚀作业的所有循环次数的过程中,反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值。本发明提供的基片刻蚀方法能够避免产生侧壁伤害的问题,从而可以使侧壁形貌光滑。
Description
技术领域
本发明涉及微电子技术领域,特别涉及一种基片刻蚀方法。
背景技术
随着MEMS器件和MEMS系统被越来越广泛地应用于汽车和消费电子领域,以及TSV通孔刻蚀(Through Silicon Etch)技术在未来封装领域的广阔前景,干法等离子体深硅刻蚀工艺逐渐成为MEMS加工领域及TSV技术中最炙手可热的工艺之一。
深硅刻蚀工艺相对于一般的硅刻蚀工艺,主要区别在于:深硅刻蚀工艺的刻蚀深度远大于一般的硅刻蚀工艺,深硅刻蚀工艺的刻蚀深度一般为几十微米甚至可以达到上百微米,而一般硅刻蚀工艺的刻蚀深度则小于1微米。要刻蚀厚度为几十微米的硅材料,就要求深硅刻蚀工艺具有更快的刻蚀速率,更高的选择比及更大的深宽比。
目前主流的深硅刻蚀工艺为德国Robert Bosch公司发明的Bosch工艺或在Bosch工艺上进行的优化。其主要特点为:整个刻蚀过程为一个循环单元的多次重复,该循环单元包括刻蚀作业和沉积作业,即整个刻蚀过程是刻蚀作业与沉积作业的交替循环。其中刻蚀作业所采用的工艺气体为SF6,而且,在进行刻蚀作业的过程中,为了能够产生更多的活性自由基,以提高该工艺气体刻蚀硅基底的刻蚀速率,通常需要在进行刻蚀作业的过程中始终保持较高的腔室压力,然而,这会产生这样的问题,即:在较高的腔室压力下,刻蚀后产生的反应生成物不易从硅槽中排出,导致积压在硅槽中的反应生成物损伤硅槽的侧壁,从而使硅槽的侧壁形貌粗糙,进而使刻蚀方法的工艺结果不理想。
发明内容
本发明旨在至少解决现有技术中存在的技术问题之一,提出了一种基片刻蚀方法,其能够避免产生侧壁伤害的问题,从而可以使侧壁形貌光滑。
为实现本发明的目的而提供一种基片刻蚀方法,包括以下步骤:
沉积作业,用以在硅槽侧壁上沉积聚合物;
刻蚀作业,用以对所述硅槽侧壁进行刻蚀;
重复所述沉积作业和刻蚀作业至少两次;
并且,在完成所述刻蚀作业的所有循环次数的过程中,反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值。
其中,降低腔室压力的所述预设规则包括以下步骤:
在自第一次所述刻蚀作业开始的预定时间之内,所述腔室压力在进行刻蚀作业时保持所述的最高压力值不变;
在经过所述预定时间之后,所述腔室压力在完成后续的刻蚀作业的循环次数的过程中按函数关系自所述最高压力值降低至所述最低压力值。
其中,在经过所述预定时间之后,每次刻蚀作业所对应的腔室压力保持不变,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力按函数关系有所降低。
其中,在经过所述预定时间之后,每次刻蚀作业所对应的腔室压力按函数关系逐渐降低,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力降低。
其中,降低腔室压力的所述预设规则包括以下步骤:在完成刻蚀作业的所有循环次数的过程中,所述腔室压力按预设的函数关系逐渐降低。
其中,所述函数关系包括线性、分段、指数或多项式。
其中,所述预定时间的范围在0.5~20s;所述最高压力值的范围在20mT~200mT;并且激励功率的范围在50~3000W;偏压功率的范围在0~100W;刻蚀气体的流量范围在50~1000sccm。
其中,所述预定时间的范围在1~10s;所述最高压力值的范围在40mT~120mT;并且激励功率的范围在500~2000W;偏压功率的范围在10~40W;刻蚀气体的流量范围在200~700sccm。
其中,在经过所述预定时间之后,完成刻蚀作业的循环次数的时间范围在0.1~100s;所述压力最低值为的范围在1~40mT;并且激励功率的范围在50~3000W;偏压功率的范围在0~100W;所述刻蚀气体的流量范围在50~1000sccm。
本发明具有以下有益效果:
本发明提供的基片刻蚀方法,其通过在完成刻蚀作业的所有循环次数的过程中,使反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值,可以使刻蚀后产生的反应生成物因腔室压力的降低而从硅槽中排出,从而可以避免出现硅槽侧壁出现损伤的问题,进而可以提高硅槽侧壁形貌的光滑性,提高工艺质量。
附图说明
图1本发明提供的基片刻蚀方法的流程图;
图2a为本发明第一实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图;
图2b为本发明第一实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图;
图2c为本发明第一实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图;
图3a为采用现有的基片刻蚀方法获得的硅槽侧壁形貌的扫描电镜图;
图3b为采用本发明提供的基片刻蚀方法获得的硅槽侧壁形貌的扫描电镜图;
图4a为本发明第二实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图;
图4b为本发明第二实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图;以及
图4c为本发明第二实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图。
具体实施方式
为使本领域的技术人员更好地理解本发明的技术方案,下面结合附图来对本发明提供的基片刻蚀方法及基片处理设备进行详细描述。
根据本发明的实施例,沉积作业用于在硅槽侧壁上沉积聚合物;刻蚀作业用于对所述硅槽侧壁进行刻蚀;而且,在整个刻蚀工艺过程中,沉积作业和刻蚀作业交替循环至少两次。在实际应用中,可以先进行沉积作业,后进行刻蚀作业;或者,也可以先进行刻蚀作业,后进行沉积作业,二者的先后顺序可以根据具体情况设定。
下面针对本发明提供的基片刻蚀方法进行详细的描述。具体地,图1为本发明提供的基片刻蚀方法的流程图。请参阅图1,该方法包括以下步骤:
步骤S1,将待处理的硅晶片等基片放入反应腔室。
步骤S2,进行沉积作业,该沉积作业的具体流程至少包括以下步骤:向反应腔室内输入沉积气体;开启激励电源(例如射频电源),以在反应腔室内产生等离子体;开启偏压电源,以向待处理基片施加偏压功率。该沉积气体可以为C4F8或C2F4。
步骤S3,进行刻蚀作业,该刻蚀作业的具体流程至少包括以下步骤:停止向反应腔室内输入沉积气体,同时向反应腔室内输入刻蚀气体;开启激励电源(例如射频电源),以在反应腔室内产生等离子体;开启偏压电源以向待处理基片施加偏压功率。该刻蚀气体可以为SF6。
步骤S4,重复上述步骤S2-S3,直至完成基片的刻蚀。
而且,在完成步骤S3的所有循环次数的过程中,反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值。此外,上述步骤S2和S3的先后顺序也可以调换,即:也可以先进行刻蚀作业,后进行沉积作业。
下面对降低腔室压力的几种预设规则进行详细地描述。具体地,图2a为本发明第一实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图。请参阅图2a,图2a中横坐标为刻蚀作业(即,上述步骤S3)的循环次数N,且N为大于0的整数;纵坐标为腔室压力值P(单位为mT,毫托)。在本实施例中,降低腔室压力的预设规则包括以下步骤:
步骤S30,在自第一次刻蚀作业开始的预定时间T之内,腔室压力保持最高压力值Pmax不变。
步骤S31,在经过预定时间T之后,腔室压力在完成后续的刻蚀作业的循环次数的过程中按线性的函数关系自最高压力值Pmax降低至最低压力值Pmin。最高压力值Pmax和最低压力值Pmin可以根据具体情况自由设定。
在步骤S31中,每次刻蚀作业所对应的腔室压力按线性关系逐渐降低,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力按线性关系有所降低。
需要说明的是,如图2b所示,在步骤S31中,每次刻蚀作业所对应的腔室压力也可以按分段函数的关系有所降低,而且,本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力也可以按分段函数的关系有所降低。当然,在实际应用中,还可以采用诸如指数或多项式等其他任意函数关系,其可以根据具体情况设定。
此外,如图2c所示,在步骤S31中,还可以使每次刻蚀作业所对应的腔室压力保持不变,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力按线性函数或分段函数等的关系有所降低。
为了验证本实施例提供的刻蚀基片方法是否能够改善硅槽的侧壁形貌的光滑性,下面针对本实施例提供的刻蚀基片方法和现有技术中采用保持高腔室压力不变的刻蚀基片方法分别进行基片刻蚀实验,在该基片刻蚀实验中,本实施例和现有技术所使用的基片处理设备除腔室压力不同之外,其余规格和参数均大致相同。
具体地,如图3a和图3b所示,分别为采用现有的基片刻蚀方法获得的硅槽侧壁形貌的扫描电镜图和采用本发明提供的基片刻蚀方法获得的硅槽侧壁形貌的扫描电镜图。比较图3a和图3b可以看出,在现有技术中,由于在进行刻蚀作业的过程中始终保持较高的腔室压力,因而刻蚀后产生的反应生成物不易从硅槽中排出,导致积压在硅槽中的反应生成物损伤硅槽的侧壁,从而使硅槽的侧壁形貌粗糙,进而使刻蚀方法的工艺结果不理想。与之相比,在本实施例提供的基片刻蚀方法,其通过在完成刻蚀作业的所有循环次数的过程中,使反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值,可以使刻蚀后产生的反应生成物因腔室压力的降低而从硅槽中排出,从而可以避免出现硅槽侧壁出现损伤的问题,进而可以提高硅槽侧壁形貌的光滑性,提高工艺质量。
图4a为本发明第二实施例提供的基片刻蚀方法的腔室压力降低规则的坐标图。请参阅图4a,图4a中横坐标为刻蚀作业(即,上述步骤S3)的循环次数N,且N为大于0的整数;纵坐标为腔室压力值P(单位为mT,毫托)。在本实施例中,降低腔室压力的预设规则包括以下步骤:
在完成刻蚀作业的所有循环次数的过程中,腔室压力P按线性关系逐渐降低。
需要说明的是,虽然在本实施例中,上述函数关系为线性函数,但是本发明并不局限于此,在实际应用中,也可以采用以下两种函数关系,即:第一种函数关系为:如图4b所示,每次刻蚀作业所对应的腔室压力保持不变,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力按分段函数的关系有所降低;第二种函数关系为:如图4c所示,每次刻蚀作业所对应的腔室压力按线性关系有所降低,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力按分段函数的关系有所降低。
优选地,预定时间T的范围可以在0.5~20s;最高压力值的范围可以在20mT~200mT;并且激励功率的范围可以在50~3000W;偏压功率的范围可以在0~100W;刻蚀气体的流量范围可以在50~1000sccm。
更优选地,预定时间T的范围在1~10s;最高压力值的范围在40mT~120mT;并且激励功率的范围可以在500~2000W;偏压功率的范围可以在10~40W;刻蚀气体的流量范围在200~700sccm。另外,经过预定时间T之后,完成后续的刻蚀作业的循环次数的时间可以在0.1-100s;压力最低值的范围可以在1~40mT;并且激励功率的范围在50~3000W;偏压功率的范围在0~100W;刻蚀气体的流量范围在50~1000sccm。
综上所述,本实施例提供的基片刻蚀方法,其通过在完成刻蚀作业的所有循环次数的过程中,使反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值,可以使刻蚀后产生的反应生成物因腔室压力的降低而从硅槽中排出,从而可以避免出现硅槽侧壁出现损伤的问题,进而可以提高硅槽侧壁形貌的光滑性,提高工艺质量。
可以理解的是,以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式,然而本发明并不局限于此。对于本领域内的普通技术人员而言,在不脱离本发明的精神和实质的情况下,可以做出各种变型和改进,这些变型和改进也视为本发明的保护范围。
Claims (9)
1.一种基片刻蚀方法,包括以下步骤:
沉积作业,用以在硅槽侧壁上沉积聚合物;
刻蚀作业,用以对所述硅槽侧壁进行刻蚀;
重复所述沉积作业和刻蚀作业至少两次;
其特征在于,在完成所述刻蚀作业的所有循环次数的过程中,反应腔室的腔室压力按预设规则由预设的最高压力值降低至最低压力值。
2.如权利要求1所述的基片刻蚀方法,其特征在于,降低腔室压力的所述预设规则包括以下步骤:
在自第一次所述刻蚀作业开始的预定时间之内,所述腔室压力在进行刻蚀作业时保持所述的最高压力值不变;
在经过所述预定时间之后,所述腔室压力在完成后续的刻蚀作业的循环次数的过程中按函数关系自所述最高压力值降低至所述最低压力值。
3.如权利要求2所述的基片刻蚀方法,其特征在于,在经过所述预定时间之后,每次刻蚀作业所对应的腔室压力保持不变,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力按函数关系有所降低。
4.如权利要求2所述的基片刻蚀方法,其特征在于,在经过所述预定时间之后,每次刻蚀作业所对应的腔室压力按函数关系逐渐降低,且本次刻蚀作业所对应的腔室压力比前一次刻蚀作业所对应的腔室压力降低。
5.如权利要求1所述的基片刻蚀方法,其特征在于,降低腔室压力的所述预设规则包括以下步骤:在完成刻蚀作业的所有循环次数的过程中,所述腔室压力按预设的函数关系逐渐降低。
6.如权利要求2-5所述的基片刻蚀方法,其特征在于,所述函数关系包括线性、分段、指数或多项式。
7.如权利要求2-5所述的基片刻蚀方法,其特征在于,所述预定时间的范围在0.5~20s;所述最高压力值的范围在20mT~200mT;并且
激励功率的范围在50~3000W;偏压功率的范围在0~100W;刻蚀气体的流量范围在50~1000sccm。
8.如权利要求2-5所述的基片刻蚀方法,其特征在于,所述预定时间的范围在1~10s;所述最高压力值的范围在40mT~120mT;并且
激励功率的范围在500~2000W;偏压功率的范围在10~40W;刻蚀气体的流量范围在200~700sccm。
9.如权利要求8所述的基片刻蚀方法,其特征在于,在经过所述预定时间之后,完成刻蚀作业的循环次数的时间范围在0.1~100s;所述压力最低值为的范围在1~40mT;并且
激励功率的范围在50~3000W;偏压功率的范围在0~100W;所述刻蚀气体的流量范围在50~1000sccm。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201210482401.6A CN103832965B (zh) | 2012-11-23 | 2012-11-23 | 基片刻蚀方法 |
TW102138574A TWI506692B (zh) | 2012-11-23 | 2013-10-25 | Substrate etching method |
KR1020157016574A KR101735089B1 (ko) | 2012-11-23 | 2013-11-01 | 기판 에칭 방법 |
SG11201503933RA SG11201503933RA (en) | 2012-11-23 | 2013-11-01 | Substrate etching method |
US14/646,909 US9478439B2 (en) | 2012-11-23 | 2013-11-01 | Substrate etching method |
EP13857651.7A EP2924000B1 (en) | 2012-11-23 | 2013-11-01 | Substrate etching method |
PCT/CN2013/086420 WO2014079315A1 (zh) | 2012-11-23 | 2013-11-01 | 基片刻蚀方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201210482401.6A CN103832965B (zh) | 2012-11-23 | 2012-11-23 | 基片刻蚀方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN103832965A true CN103832965A (zh) | 2014-06-04 |
CN103832965B CN103832965B (zh) | 2017-02-08 |
Family
ID=50775520
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201210482401.6A Active CN103832965B (zh) | 2012-11-23 | 2012-11-23 | 基片刻蚀方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US9478439B2 (zh) |
EP (1) | EP2924000B1 (zh) |
KR (1) | KR101735089B1 (zh) |
CN (1) | CN103832965B (zh) |
SG (1) | SG11201503933RA (zh) |
TW (1) | TWI506692B (zh) |
WO (1) | WO2014079315A1 (zh) |
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- 2013-11-01 WO PCT/CN2013/086420 patent/WO2014079315A1/zh active Application Filing
- 2013-11-01 SG SG11201503933RA patent/SG11201503933RA/en unknown
- 2013-11-01 KR KR1020157016574A patent/KR101735089B1/ko active IP Right Grant
- 2013-11-01 US US14/646,909 patent/US9478439B2/en active Active
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KR20150089044A (ko) | 2015-08-04 |
SG11201503933RA (en) | 2015-06-29 |
EP2924000A1 (en) | 2015-09-30 |
TW201421578A (zh) | 2014-06-01 |
EP2924000A4 (en) | 2016-07-06 |
CN103832965B (zh) | 2017-02-08 |
WO2014079315A1 (zh) | 2014-05-30 |
US9478439B2 (en) | 2016-10-25 |
US20150311091A1 (en) | 2015-10-29 |
KR101735089B1 (ko) | 2017-05-24 |
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C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant | ||
CP03 | Change of name, title or address | ||
CP03 | Change of name, title or address |
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