CN103745932A - Wb型封装基板的制作方法 - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title claims abstract description 26
- 239000000758 substrate Substances 0.000 title abstract description 9
- 238000000034 method Methods 0.000 claims abstract description 32
- 238000003801 milling Methods 0.000 claims abstract description 26
- 238000012546 transfer Methods 0.000 claims abstract description 5
- 239000010410 layer Substances 0.000 claims description 31
- 238000004806 packaging method and process Methods 0.000 claims description 20
- 238000003475 lamination Methods 0.000 claims description 8
- 238000004381 surface treatment Methods 0.000 claims description 8
- 238000003466 welding Methods 0.000 claims description 8
- 150000001875 compounds Chemical class 0.000 claims description 5
- 239000007788 liquid Substances 0.000 claims description 5
- 239000011229 interlayer Substances 0.000 claims description 4
- 238000009832 plasma treatment Methods 0.000 claims description 3
- 239000000126 substance Substances 0.000 claims description 3
- 238000010030 laminating Methods 0.000 abstract 2
- 239000003292 glue Substances 0.000 description 7
- 238000003825 pressing Methods 0.000 description 6
- 238000005516 engineering process Methods 0.000 description 4
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 4
- 241000218202 Coptis Species 0.000 description 3
- 235000002991 Coptis groenlandica Nutrition 0.000 description 3
- 239000013078 crystal Substances 0.000 description 3
- 239000010931 gold Substances 0.000 description 3
- 229910052737 gold Inorganic materials 0.000 description 3
- 239000000463 material Substances 0.000 description 3
- 238000012986 modification Methods 0.000 description 3
- 230000004048 modification Effects 0.000 description 3
- 229920000139 polyethylene terephthalate Polymers 0.000 description 2
- 239000005020 polyethylene terephthalate Substances 0.000 description 2
- 210000004027 cell Anatomy 0.000 description 1
- 230000003749 cleanliness Effects 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 239000004744 fabric Substances 0.000 description 1
- 238000007731 hot pressing Methods 0.000 description 1
- 239000011159 matrix material Substances 0.000 description 1
- 238000001465 metallisation Methods 0.000 description 1
- 238000000465 moulding Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- -1 polyethylene terephthalate Polymers 0.000 description 1
- 238000012545 processing Methods 0.000 description 1
- 238000005476 soldering Methods 0.000 description 1
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4871—Bases, plates or heatsinks
- H01L21/4875—Connection or disconnection of other leads to or from bases or plates
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45144—Gold (Au) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
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- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
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Abstract
本发明提供了一种WB型封装基板的制作方法,包括:制作带引线键合焊盘的台阶单元;在台阶单元的有引线键合焊盘的面上贴组合干膜层,然后对组合干膜层进行图形转移,以便在台阶单元的有引线键合焊盘的面上形成形成有图案的组合干膜层;对半固化片进行铣切开槽以在半固化片中形成开窗,并将铣切开槽后的半固化片、形成有干膜的台阶单元以及顶层板一起进行定位层压;执行外层PCB制造流程;从顶层板进行通槽铣切和控深铣切,露出台阶单元的组合干膜层;去除组合干膜层,从而露出引线键合焊盘;而且在露出引线键合焊盘之后进行成品铣切。
Description
技术领域
本发明涉及集成电路制造领域,更具体地说,本发明涉及一种WB型封装基板的制作方法。
背景技术
以输入输出(I/O)元件到基板的连接方式,分为传统打金线(WireBonding,WB型,也称为引线连接或引线键合)和覆晶方式(Flip Chip,FC型)。
如图1所示,对于WB型,布置在布线4上的单晶片或多晶片1上I/O元件通过诸如金线(Gold Wire)之类的引线2连接到封装基板接合焊盘(Bonding Pad)(例如布线端子3)上,晶片朝上放置,晶片I/O点在外围四周,点数一般受到限制。对于FC型,将打金线方式改为凸点焊接,将晶片倒转,再焊接到基板上形成覆晶式晶粒接合,晶片朝下放置,晶片I/O焊盘可成矩阵排列,点数比WB型高出许多。
引线连接法是通过热压、钎焊等方法将芯片中各金属化端子与封装基板相应引脚焊盘之间的键合连接的方法,其主要包括热压键合法、超声键合法、热超声键合法等,无论哪种方法均对金手指(Wire Bonding Pad,也称为引线键合焊盘)表面清洁度、平整性很敏感,否则易出现打线不良问题。
为了提高WB型基板布线密度,通常将基板设计成多台阶结构,目前针对台阶型基板尚无很好的制造工艺,多采用低流动度(No-Flow,NF)半固化片内缩挖槽后将基材(或台阶单元)与半固化片定位压合,因高温高压过程半固化片流动特性,会有胶流向台阶的引线键合焊盘表面流动趋势,且流胶通常微观上是不均匀的,部分流胶多的地方,溢胶会上盘,导致后续无法进行引线键合,部分流胶少的地方,台阶下面形成空洞;且层压过程台阶位置有往下压塌的趋势,该类基板制造良率通常极低。
现有技术通常采用半固化片内缩压合(半固化片开窗尺寸通常大于台阶槽尺寸),基材(或台阶单元)预先铣切开窗,工艺稳定性、重复性较差,常出现溢胶上盘、焊盘污染、台阶下方空洞、台阶塌陷等一系列问题。
发明内容
本发明所要解决的技术问题是针对现有技术中存在上述缺陷,提供一种实现多台阶WB型基板台阶上金手指表观溢胶的控制、台阶引脚共面性、台阶洁净度的保护和台阶位置可靠性的确保的WB型封装基板的制作方法。
根据本发明,提供了一种WB型封装基板的制作方法,其包括:
第一步骤:制作带引线键合焊盘的台阶单元;
第二步骤:在台阶单元的有引线键合焊盘的面上贴组合干膜层,然后对组合干膜层进行图形转移,以便在台阶单元的有引线键合焊盘的面上形成形成有图案的组合干膜层;
第三步骤:对半固化片进行铣切开槽以在半固化片中形成开窗,并将铣切开槽后的半固化片、形成有干膜的台阶单元以及顶层板一起进行定位层压;
第四步骤:执行外层PCB制造流程;
第五步骤:从顶层板进行通槽铣切和控深铣切,露出台阶单元的组合干膜层;
第六步骤:去除组合干膜层,从而露出引线键合焊盘。
优选地,所述WB型封装基板的制作方法还包括第七步骤:在第六步骤露出引线键合焊盘之后进行成品铣切。
优选地,组合干膜层的厚度与层间半固化片的厚度匹配。
优选地,形成图案之后的组合干膜层与半固化片开窗区域匹配。
优选地,在第一步骤或第六步骤中,对引线键合焊盘进行表面处理。
优选地,在第六步骤中,采用化学粗化和褪膜液的组合方式去除台阶引线键合焊盘上的干膜。
优选地,在第六步骤中,采用等离子处理和褪膜液的组合方式去除台阶引线键合焊盘上的干膜。
由此,针对采用半固化片内缩压合、基材预先铣切开窗的现有技术中的工艺稳定性、重复性较差、溢胶上盘、焊盘污染、台阶下方空洞、台阶塌陷等一系列问题,本发明采用一种新的工艺既能避免溢胶上盘、成品焊盘污染、或台阶下空洞,又能避免层压后台阶位置塌陷,可靠性大大提高。
附图说明
结合附图,并通过参考下面的详细描述,将会更容易地对本发明有更完整的理解并且更容易地理解其伴随的优点和特征,其中:
图1示意性地示出了WB型封装基板。
图2示意性地示出了根据本发明优选实施例的WB型封装基板的制作方法的流程图。
图3至图9示意性地示出了根据本发明优选实施例的WB型封装基板的制作方法的流程图。
需要说明的是,附图用于说明本发明,而非限制本发明。注意,表示结构的附图可能并非按比例绘制。并且,附图中,相同或者类似的元件标有相同或者类似的标号。
具体实施方式
为了使本发明的内容更加清楚和易懂,下面结合具体实施例和附图对本发明的内容进行详细描述。
图2示意性地示出了根据本发明优选实施例的WB型封装基板的制作方法的流程图。
具体地说,如图2所示,根据本发明优选实施例的WB型封装基板的制作方法包括:
第一步骤S1:制作带引线键合焊盘的台阶单元,如图3的平面图所示,例如制作带引线键合焊盘11的第一台阶单元101以及带引线键合焊盘12的第二台阶单元102;台阶单元可以是单片、双面盲孔单元或多层盲孔单元等;此外,台阶单元表面的引线键合焊盘可以预先进行表面处理(如引工艺线电镀金、化金或其他),也可以先不处理,而是成品控深铣切揭盖后一起表面处理(如化金或化镍钯金);
第二步骤S2:在台阶单元的有引线键合焊盘的面上贴组合干膜层,然后对组合干膜层进行图形转移,以便在台阶单元的有引线键合焊盘的面上形成形成有图案的组合干膜层(例如,在第一台阶单元101上形成第一组合干膜层201,在第二台阶单元102上形成第二组合干膜层202,如附图4的平面图所示);其中,优选地,在具体操作中,每贴一层干膜后撕掉PET(聚对苯二甲酸乙二酯)保护膜,接着贴第二层,直到组合干膜层的厚度与半固化片压合后层间介厚一致或接近;通过对组合干膜层进行曝光、显影流程,露出引线键合焊盘位置和成品铣掉但过程需垫平的区域,留下需要干膜保护的区域上的组合干膜层;
第三步骤S3:对半固化片(优选采用低流动或不流动的半固化片)进行铣切开槽(例如,如附图5的平面图所示,第一半固化片301上的第一开槽311和第二半固化片302上的第二开槽312),并将铣切开槽后的半固化片定位层压;其中,例如,各台阶单元之间的半固化片开槽尺寸通常单边比成品台阶槽内缩0.1~1.0mm;对铣切开槽后的台阶单元进行棕化和烘烤,然后将半固化片、形成有干膜的台阶单元以及顶层板400一起定位堆叠和层压,如图6所示;
这时,因层压高温高压过程半固化片有溢出流动趋势,通过干膜阻胶,很好地使得流胶饱满,刚好停在干膜位置,这样可以避免台阶下方出现空洞、压合塌陷等问题,且不会出现溢胶流到引线键合焊盘上;具体地说,如图8所示,其中箭头20示出了半固化片的流动趋势,但是这种流动趋势被第一组合干膜层201和第二组合干膜层202有效阻挡;
第四步骤S4:执行正常的外层PCB制造流程;例如,执行钻孔、去钻污、孔化电镀、表层图形转移、防焊制作、表面处理(若台阶上的引线键合焊盘未预先做表面处理,此步省略)等;
第五步骤S5:从顶层板400进行通槽铣切和控深铣切,露出台阶单元的组合干膜层(例如如图7所示,而且图8示出了沿着图7的虚线A得到的截面图),例如,露出第一组合干膜层201和第二组合干膜层202;例如,在本步骤中,首先,按客户图纸通槽铣切去除所有台阶单元不需要的图形内部分;然后,控深盲铣,去除引线键合焊盘顶部的盖子;
第六步骤S6:去除组合干膜层,从而露出引线键合焊盘;例如,可以采用化学粗化(或等离子处理)和褪膜液组合方式去除台阶引线键合焊盘上的干膜;若前面台阶上引线键合焊盘未做表面处理,需将台阶上焊盘与表层图形一起做表面处理,如化金或化镍钯金等;
第七步骤S7:成品铣切;依据图纸要求铣切成型。
在根据本发明优选实施例的WB型封装基板的制作方法中,优选地使得组合干膜厚度与层间半固化片厚度匹配,曝光区域(干膜保护区域)与半固化片开窗区域匹配,盲铣揭盖深度控制,揭盖后褪膜方式。
从而,本发明既能避免溢胶上盘、成品焊盘污染、或台阶下空洞,又能避免层压后台阶位置塌陷,可靠性大大提高。
此外,需要说明的是,除非特别指出,否则说明书中的术语“第一”、“第二”、“第三”等描述仅仅用于区分说明书中的各个组件、元素、步骤等,而不是用于表示各个组件、元素、步骤之间的逻辑关系或者顺序关系等。
可以理解的是,虽然本发明已以较佳实施例披露如上,然而上述实施例并非用以限定本发明。对于任何熟悉本领域的技术人员而言,在不脱离本发明技术方案范围情况下,都可利用上述揭示的技术内容对本发明技术方案作出许多可能的变动和修饰,或修改为等同变化的等效实施例。因此,凡是未脱离本发明技术方案的内容,依据本发明的技术实质对以上实施例所做的任何简单修改、等同变化及修饰,均仍属于本发明技术方案保护的范围内。
Claims (7)
1.一种WB型封装基板的制作方法,其特征在于包括:
第一步骤:制作带引线键合焊盘的台阶单元;
第二步骤:在台阶单元的有引线键合焊盘的面上贴组合干膜层,然后对组合干膜层进行图形转移,以便在台阶单元的有引线键合焊盘的面上形成形成有图案的组合干膜层;
第三步骤:对半固化片进行铣切开槽以在半固化片中形成开窗,并将铣切开槽后的半固化片、形成有干膜的台阶单元以及顶层板一起进行定位层压;
第四步骤:执行外层PCB制造流程;
第五步骤:从顶层板进行通槽铣切和控深铣切,露出台阶单元的组合干膜层;
第六步骤:去除组合干膜层,从而露出引线键合焊盘。
2.根据权利要求1所述的WB型封装基板的制作方法,其特征在于还包括第七步骤:在第六步骤露出引线键合焊盘之后进行成品铣切。
3.根据权利要求1或2所述的WB型封装基板的制作方法,其特征在于,组合干膜层的厚度与层间半固化片的厚度匹配。
4.根据权利要求1或2所述的WB型封装基板的制作方法,其特征在于,形成图案之后的组合干膜层与半固化片开窗区域匹配。
5.根据权利要求1或2所述的WB型封装基板的制作方法,其特征在于,在第一步骤或第六步骤中,对引线键合焊盘进行表面处理。
6.根据权利要求1或2所述的WB型封装基板的制作方法,其特征在于,在第六步骤中,采用化学粗化和褪膜液的组合方式去除台阶引线键合焊盘上的干膜。
7.根据权利要求1或2所述的WB型封装基板的制作方法,其特征在于,在第六步骤中,采用等离子处理和褪膜液的组合方式去除台阶引线键合焊盘上的干膜。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201410033506.2A CN103745932B (zh) | 2014-01-23 | 2014-01-23 | Wb型封装基板的制作方法 |
Applications Claiming Priority (1)
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---|---|
CN103745932A true CN103745932A (zh) | 2014-04-23 |
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