CN103178093A - 高压结型场效应晶体管的结构及制备方法 - Google Patents

高压结型场效应晶体管的结构及制备方法 Download PDF

Info

Publication number
CN103178093A
CN103178093A CN 201110441024 CN201110441024A CN103178093A CN 103178093 A CN103178093 A CN 103178093A CN 201110441024 CN201110441024 CN 201110441024 CN 201110441024 A CN201110441024 A CN 201110441024A CN 103178093 A CN103178093 A CN 103178093A
Authority
CN
China
Prior art keywords
deep well
body region
type
inversion layer
effect transistor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN 201110441024
Other languages
English (en)
Other versions
CN103178093B (zh
Inventor
宁开明
董科
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shanghai Huahong Grace Semiconductor Manufacturing Corp
Original Assignee
Shanghai Hua Hong NEC Electronics Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shanghai Hua Hong NEC Electronics Co Ltd filed Critical Shanghai Hua Hong NEC Electronics Co Ltd
Priority to CN201110441024.7A priority Critical patent/CN103178093B/zh
Publication of CN103178093A publication Critical patent/CN103178093A/zh
Application granted granted Critical
Publication of CN103178093B publication Critical patent/CN103178093B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Junction Field-Effect Transistors (AREA)

Abstract

本发明公开了一种高压结型场效应晶体管的结构,其体区的深沟道中注入了一个反型层。本发明还公开了上述结构的HV JFET的制备方法,即在HV JFET的常规制备工艺中,在制作体区的衬底阱或漏端漂移区的反型层的同时,在体区的深沟道中通过光刻和离子注入工艺制作一个反型层。本发明通过往JFET体区的深沟道中注入类型相反的杂质,在未增加任何光刻层次的基础上,降低了JFET体区沟道的杂质浓度,使沟道更容易被耗尽,从而有效降低了HV JFET器件的夹断电压。

Description

高压结型场效应晶体管的结构及制备方法
技术领域
本发明涉及半导体集成电路制造领域,特别是涉及一种高压结型场效应晶体管的结构及其制备方法。
背景技术
传统的高压结型场效应晶体管(High-Voltage Junction Field Effect Transistor,HVJFET),一般由Drain(漏)端漂移区和JFET体区两部分组成,如图1所示。其中,
漏端漂移区主要起耐高压的作用,有一个DNW(N型深阱)。由于DNW中的N型杂质浓度太淡会影响导通电阻,因此需要做的相对浓些,并要另外加一层反型的注入,如图1中的Ptop(P型埋层),来平衡其电荷。
体区主要用于控制JFET电流的大小和夹断电压。体区中由DNW中的N型杂质组成一沟道,如图2、3所示,并通过DNW两侧的PW(P阱)对沟道进行夹断,即当Source(源)端DNW和Gate(栅极)端PW反偏时,DNW开始进行耗尽,直到沟道通路被耗尽夹断。
这种结构的HV JFET器件,由于其体区沟道仅由单一杂质(N型或P型)构成,即杂质的浓度较高,沟道通路不容易被耗尽,因此,器件的夹断电压会比较高。
发明内容
本发明要解决的技术问题是提供一种高压结型场效应晶体管的结构,它可以降低高压结型场效应晶体管的夹断电压。
为解决上述技术问题,本发明的高压结型场效应晶体管,包括体区和漏端漂移区,一深阱横贯体区和漏端漂移区,且体区的深阱中注入有一个反型层,该反型层的杂质类型与该深阱的杂质类型相反。
本发明要解决的技术问题是提供上述结构的高压结型场效应晶体管的制备方法。
为解决上述技术问题,本发明的高压结型场效应晶体管的制备方法,包括以下步骤:
1)在衬底上,用光刻和离子注入工艺,形成横贯体区和漏端漂移区且掺杂类型与衬底相反的深阱;
2)用光刻和离子注入工艺,在体区的深阱中形成掺杂类型与衬底相同的阱;
3)在硅片表面形成多个局部氧化硅隔离结构;
4)用光刻和离子注入工艺,在漏端漂移区的深阱中形成掺杂类型与深阱相反的反型层;
5)在所述隔离结构上形成多晶硅场板;
6)在体区和漏端漂移区末端,通过重掺杂离子注入,形成源、漏、栅和衬底的引出端;
7)淀积介电层,刻蚀接触孔,并在接触孔中填充源极、栅极、漏极和衬底极,完成HV JFET的制备;其中,在步骤2)或4)中,在体区的深阱中也同时制作一个掺杂类型与深阱相反的反型层。
本发明通过在JFET体区的沟道中注入类型相反的杂质,在未增加任何光刻层次的基础上,降低了JFET体区沟道的杂质浓度,使沟道更容易被耗尽,从而有效降低了HV JFET器件的夹断电压。
附图说明
图1是传统N型沟道的HV JFET的截面图。
图2是传统N型沟道的HV JFET的俯视图。
图3是传统N型沟道的HV JFET的体区侧视图。
图4是本发明实施例的N型沟道的HV JFET的截面图。
图5是本发明实施例的N型沟道的HV JFET的俯视图。
图6是本发明实施例的N型沟道的HV JFET的体区侧视图。
具体实施方式
为对本发明的技术内容、特点与功效有更具体的了解,现以N型沟道的HV JFET为例,结合图示的实施方式,对本发明的技术方案详述如下:
本实施例的HV NJFET的结构如图4至6所示,除漏端漂移区的DNW中注入了Ptop外,其体区的DNW中也注入了Ptop。这种结构的HV NJFET器件的具体制备工艺如下:
步骤1,在低掺杂P型衬底(PSUB)上,用光刻工艺和离子注入工艺,形成漏端漂移区和JFET体区的DNW。
步骤2,在低掺杂P型衬底上,用光刻工艺和离子注入工艺,形成PW。PW可以两面或者三面包围JFET体区的DNW。
步骤3,在硅片表面形成多个LOCOS(Local Oxidation of Silicon,局部硅氧化物层)隔离结构。
步骤4,利用光刻工艺,分别在漏端漂移区的DNW中和JFET体区的DNW中,开出部分区域,然后利用离子注入工艺,注入P型杂质,形成两个反型层Ptop,注入的剂量为2.0e12~4.0e12/cm2
步骤5,在硅片表面生长栅氧化层,然后淀积一层多晶硅,通过刻蚀该层多晶硅和栅氧化层,在隔离结构LOCOS上形成漏端多晶硅(poly)场板。
步骤6,在漏端漂移区和JFET体区末端,通过重掺杂离子注入,分别形成漏区引出端N+(plus)、源区引出端N+、栅引出端P+和衬底引出端P+。
步骤7,淀积介电层,进行接触孔刻蚀,然后在接触孔中填充金属电极(包括源极、栅极、漏极和衬底极),完成HV JFET器件的制备。
步骤4中,JFET体区的反型层Ptop,也可以在步骤2中形成,即在做PW光刻的同时,在体区DNW中开出部分区域,注入P型杂质,形成JFET体区的Ptop。
上述方法在HV JFET的传统制备工艺基础上,通过在JFET体区的沟道中部分注入与沟道杂质类型相反的杂质,对沟道进行部分“中和”,降低了沟道杂质的浓度(但沟道杂质的最终类型不变,即不能引起反型),这样,在源端的DNW和栅极端的PW反偏时,沟道就会很容易被耗尽,从而降低了JFET器件的夹断电压。

Claims (6)

1.一种高压结型场效应晶体管的结构,包括体区和漏端漂移区,一深阱横贯体区和漏端漂移区,其特征在于,所述体区的深阱中注入有一个反型层,该反型层的杂质类型与该深阱的杂质类型相反。
2.根据权利要求1所述的高压结型场效应晶体管的结构,其特征在于,所述深阱为N型深阱,所述反型层为P型埋层。
3.根据权利要求1所述的高压结型场效应晶体管的结构,其特征在于,所述深阱为P型深阱,所述反型层为N型埋层。
4.权利要求1所述结构的高压结型场效应晶体管的制备方法,包括步骤:
1)在衬底上,用光刻和离子注入工艺,形成横贯体区和漏端漂移区且掺杂类型与衬底相反的深阱;
2)用光刻和离子注入工艺,在体区的深阱中形成掺杂类型与衬底相同的阱;
3)在硅片表面形成多个局部氧化硅隔离结构;
4)用光刻和离子注入工艺,在漏端漂移区的深阱中形成掺杂类型与深阱相反的反型层;
5)在所述隔离结构上形成多晶硅场板;
6)在体区和漏端漂移区末端,通过重掺杂离子注入,形成源、漏、栅和衬底的引出端;
7)淀积介电层,刻蚀接触孔,并在接触孔中填充源极、栅极、漏极和衬底极,完成HV JFET的制备;其特征在于,
在进行步骤2)或4)的同时,在体区的深阱中也制作一个掺杂类型与深阱相反的反型层。
5.根据权利要求4所述的方法,其特征在于,所述深阱为N型深阱,所述反型层为P型埋层。
6.根据权利要求4所述的方法,其特征在于,所述深阱为P型深阱,所述反型层为N型埋层。
CN201110441024.7A 2011-12-26 2011-12-26 高压结型场效应晶体管的结构及制备方法 Active CN103178093B (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201110441024.7A CN103178093B (zh) 2011-12-26 2011-12-26 高压结型场效应晶体管的结构及制备方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201110441024.7A CN103178093B (zh) 2011-12-26 2011-12-26 高压结型场效应晶体管的结构及制备方法

Publications (2)

Publication Number Publication Date
CN103178093A true CN103178093A (zh) 2013-06-26
CN103178093B CN103178093B (zh) 2015-10-14

Family

ID=48637840

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201110441024.7A Active CN103178093B (zh) 2011-12-26 2011-12-26 高压结型场效应晶体管的结构及制备方法

Country Status (1)

Country Link
CN (1) CN103178093B (zh)

Cited By (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN103700711A (zh) * 2014-01-09 2014-04-02 帝奥微电子有限公司 一种结型场效应管结构
CN104701370A (zh) * 2013-12-06 2015-06-10 上海华虹宏力半导体制造有限公司 稳流管及其制造方法
WO2016000600A1 (zh) * 2014-06-30 2016-01-07 无锡华润上华半导体有限公司 结型场效应晶体管及其制造方法
CN105679820A (zh) * 2016-03-16 2016-06-15 上海华虹宏力半导体制造有限公司 Jfet及其制造方法
CN105765730A (zh) * 2013-11-22 2016-07-13 ams有限公司 高电压半导体器件及其制备方法
CN105914238A (zh) * 2016-04-27 2016-08-31 上海华虹宏力半导体制造有限公司 高压jfet器件及工艺方法
CN105957899A (zh) * 2016-04-27 2016-09-21 上海华虹宏力半导体制造有限公司 高压jfet器件及工艺方法
CN106449768A (zh) * 2016-11-25 2017-02-22 东莞市联洲知识产权运营管理有限公司 一种jfet管
CN111128727A (zh) * 2019-12-10 2020-05-08 上海华虹宏力半导体制造有限公司 Jfet器件的制造方法、jfet器件及其版图结构

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3812421B2 (ja) * 2001-06-14 2006-08-23 住友電気工業株式会社 横型接合型電界効果トランジスタ
CN103094319B (zh) * 2011-11-04 2015-10-14 上海华虹宏力半导体制造有限公司 双通道高压结型场效应管降低夹断电压的结构及制造方法

Cited By (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN105765730A (zh) * 2013-11-22 2016-07-13 ams有限公司 高电压半导体器件及其制备方法
CN105765730B (zh) * 2013-11-22 2019-05-31 ams有限公司 高电压半导体器件及其制备方法
CN104701370A (zh) * 2013-12-06 2015-06-10 上海华虹宏力半导体制造有限公司 稳流管及其制造方法
CN103700711B (zh) * 2014-01-09 2017-01-25 帝奥微电子有限公司 一种结型场效应管结构
CN103700711A (zh) * 2014-01-09 2014-04-02 帝奥微电子有限公司 一种结型场效应管结构
WO2016000600A1 (zh) * 2014-06-30 2016-01-07 无锡华润上华半导体有限公司 结型场效应晶体管及其制造方法
US9947785B2 (en) 2014-06-30 2018-04-17 Csmc Technologies Fab1 Co., Ltd. Junction field effect transistor and manufacturing method therefor
CN105679820A (zh) * 2016-03-16 2016-06-15 上海华虹宏力半导体制造有限公司 Jfet及其制造方法
CN105679820B (zh) * 2016-03-16 2018-08-21 上海华虹宏力半导体制造有限公司 Jfet及其制造方法
CN105914238B (zh) * 2016-04-27 2019-10-11 上海华虹宏力半导体制造有限公司 高压jfet器件及工艺方法
CN105914238A (zh) * 2016-04-27 2016-08-31 上海华虹宏力半导体制造有限公司 高压jfet器件及工艺方法
CN105957899A (zh) * 2016-04-27 2016-09-21 上海华虹宏力半导体制造有限公司 高压jfet器件及工艺方法
CN106449768A (zh) * 2016-11-25 2017-02-22 东莞市联洲知识产权运营管理有限公司 一种jfet管
CN106449768B (zh) * 2016-11-25 2019-06-21 东莞市联洲知识产权运营管理有限公司 一种jfet管
CN111128727A (zh) * 2019-12-10 2020-05-08 上海华虹宏力半导体制造有限公司 Jfet器件的制造方法、jfet器件及其版图结构
CN111128727B (zh) * 2019-12-10 2023-08-18 上海华虹宏力半导体制造有限公司 Jfet器件的制造方法、jfet器件及其版图结构

Also Published As

Publication number Publication date
CN103178093B (zh) 2015-10-14

Similar Documents

Publication Publication Date Title
CN103178093B (zh) 高压结型场效应晶体管的结构及制备方法
US9466700B2 (en) Semiconductor device and method of fabricating same
US8704300B1 (en) Semiconductor device and fabricating method thereof
US20160181369A1 (en) Jfet device and its manufacturing method
US8431990B2 (en) Semiconductor device
JP2007513523A5 (zh)
US9054129B1 (en) Semiconductor device and method for manufacturing the same
CN104518034B (zh) Jfet器件及其制造方法
KR20100064263A (ko) 반도체 소자 및 이의 제조 방법
KR101688831B1 (ko) 반도체 집적회로 장치 및 그 제조방법
US8698237B2 (en) Superjunction LDMOS and manufacturing method of the same
JP6618615B2 (ja) 横方向拡散金属酸化物半導体電界効果トランジスタ
US10243051B2 (en) Transistor device with a field electrode that includes two layers
WO2018040973A1 (zh) 集成有耗尽型结型场效应晶体管的器件及其制造方法
US8723256B1 (en) Semiconductor device and fabricating method thereof
CN109830538B (zh) Ldmos器件及其制造方法
CN104599974B (zh) 半导体结构及其形成方法
KR20110078621A (ko) 반도체 소자 및 그 제조 방법
CN103094319B (zh) 双通道高压结型场效应管降低夹断电压的结构及制造方法
CN106158956B (zh) 具有resurf结构的ldmosfet及其制造方法
CN102420227B (zh) 一种抑制漏极感应势垒降低效应的后栅极工艺cmos器件及其制备方法
KR20130073776A (ko) 횡형 디모스 트랜지스터 및 이의 제조방법
CN113990942B (zh) 圆形对称结构的ldmos器件及其制备方法
CN103137694A (zh) 一种表面沟道场效应晶体管及其制造方法
CN102420226B (zh) 一种抑制漏极感应势垒降低效应的cmos器件及其制备方法

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
ASS Succession or assignment of patent right

Owner name: SHANGHAI HUAHONG GRACE SEMICONDUCTOR MANUFACTURING

Free format text: FORMER OWNER: HUAHONG NEC ELECTRONICS CO LTD, SHANGHAI

Effective date: 20140107

C41 Transfer of patent application or patent right or utility model
COR Change of bibliographic data

Free format text: CORRECT: ADDRESS; FROM: 201206 PUDONG NEW AREA, SHANGHAI TO: 201203 PUDONG NEW AREA, SHANGHAI

TA01 Transfer of patent application right

Effective date of registration: 20140107

Address after: 201203 Shanghai city Zuchongzhi road Pudong New Area Zhangjiang hi tech Park No. 1399

Applicant after: Shanghai Huahong Grace Semiconductor Manufacturing Corporation

Address before: 201206, Shanghai, Pudong New Area, Sichuan Road, No. 1188 Bridge

Applicant before: Shanghai Huahong NEC Electronics Co., Ltd.

C14 Grant of patent or utility model
GR01 Patent grant