CN102879960A - 一种阵列基板及液晶显示面板 - Google Patents

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Abstract

本发明公开了一种应用于偏光式三维液晶显示的阵列基板，包括多个像素单元和作用于像素单元的电路，将像素单元分为主像素区域和次像素区域，并将电路布局在像素单元之间。本发明还提供一种偏光式三维液晶显示面板。通过上述方式，本发明能够在三维显示模式下能够提高液晶显示面板的开口率和穿透率，增加液晶显示面板的亮度。

Description

一种阵列基板及液晶显示面板
技术领域
本发明涉及液晶显示技术领域，特别是涉及一种阵列基板及液晶显示面板。
背景技术
FPR（Film-type Patterned Retarder，偏光式）是现有3D液晶显示的成像方式之一。如图1所示，FPR 3D显示系统包括液晶显示面板11、偏光（Patterned Retarder）薄膜12以及偏光眼镜13。液晶显示面板101包括形成左眼信号的像素16、形成右眼信号的像素17以及两者之间的BM（Black Matrix，黑色矩阵）18。FPR 3D显示系统主要是通过附着在液晶显示面板11上的偏光薄膜12将3D画面分离成左眼图像14和右眼图像15，再经过偏光眼镜13将左眼图像14和右眼图像15分别送至用户的左、右眼睛。用户的左右眼接收到两组图像，再经大脑合成立体影像。FPR 3D显示模式存在视角限制问题。当观看者处于较大视角位置时会出现双眼信号相互串扰的现象，如本应送到右眼的信号却被左眼同时观察到了，如图1虚线部分所示，由此会导致画面严重串扰，图像清晰度差。通常的解决方案是增加两个像素间BM 18的宽度，以减小双眼信号串扰的可能性。
VA（Vertical Alignment，液晶垂直取向）型液晶显示面板在大视角观察时往往会发生颜色漂移现象，在大视角观看时容易出现色偏。为了提高大视角显示效果，通常会对液晶显示面板进行低色偏（Low colorwashout)设计。如图2所示，液晶显示面板的像素区域2包括主像素（MainPixel）区域21和次像素（Sub Pixel）区域22，在主像素区域21和次像素区域22的交界处20设置有金属走线23，金属走线23包括充电扫描线（Charge Gate）23a、电荷共享扫描线（Share Gate）23b和电荷共享电容23c。在正常显示时，充电扫描线23a打开，同时电荷共享扫描线23b关闭，主像素区域21和次像素区域22充电至相同的电位。随后，充电扫描线23a关闭，打开电荷共享扫描线23b，由于电荷共享电容23c的作用，使得次像素区域22的电位低于主像素区域21的电位。不同的电位使得主像素区域21和次像素区域22的液晶分子转向分布不相同，从而具备低射偏的效果。
VA型显示面板相较于传统显示面板而言具有相当高的对比度和较短的响应时间，因此，通常将FPR 3D显示技术应用于VA型显示面板上来观看3D影像以获得更好的视觉体验。但是，在将上述的低色偏设计和FPR 3D显示技术相结合时，如图3所示，为了保证3D模式下的视角要求必须增加两像素间BM30的宽度。而对于低色偏的像素设计，一方面由于金属走线33所在的区域已存在BM，再增加其他区域的BM30宽度则会导致像素的开口率大幅降低，从而导致穿透率降低，显示面板的亮度也随之降低，成本增加；在另一方面，增加的BM30使得主像素区域31和次像素区域32相对应的区域面积比例大幅改变，导致上下视角会出现严重色偏。
发明内容
本发明主要解决的技术问题是提供一种阵列基板及液晶显示面板，能够满足液晶显示面板在三维显示模式的视角要求，提高液晶显示面板的开口率和穿透率，增加面板的亮度。
为解决上述技术问题，本发明采用的一个技术方案是：提供一种应用于偏光式三维液晶显示的阵列基板，包括多个像素单元，每个像素单元包括主像素区域和次像素区域；作用于像素单元的电路，电路布局于像素单元之间。
其中，电路包括充电扫描线、电荷共享扫描线以及电荷共享电容，其中一个像素单元的充电扫描线、电荷共享扫描线以及电荷共享电容分别对应与相邻一像素单元的电荷共享扫描线和电荷共享电容、相邻另一像素单元的充电扫描线相邻。
其中，电路包括用于对次像素区域输入电信号的次数据线，次数据线穿过主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
其中，电路包括用于对次像素区域输入电信号的次数据线，次数据线绕开主像素区域并穿过次像素区域，以对次像素区域和电荷共享电容输入电信号。
其中，电路包括用于对次像素区域输入电信号的次数据线，次数据线绕开主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
为解决上述技术问题，本发明采用的另一个技术方案是：提供一种偏光式三维液晶显示面板，包括阵列基板和彩色滤光基板；彩色滤光基板包括黑色矩阵；阵列基板包括：多个像素单元，每个像素单元包括主像素区域和次像素区域；作用于像素单元的电路，电路布局于像素单元之间，并且至少部分位于黑色矩阵垂直投影区域内。
其中，电路包括充电扫描线、电荷共享扫描线以及电荷共享电容，其中一个像素单元的充电扫描线、电荷共享扫描线以及电荷共享电容分别对应与相邻一像素单元的电荷共享扫描线和电荷共享电容、相邻另一像素单元的充电扫描线相邻。
其中，电路包括用于对次像素区域输入电信号的数据线，数据线穿过主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
其中，电路包括用于对次像素区域输入电信号的数据线，数据线绕开主像素区域并穿过次像素区域，以对次像素区域和电荷共享电容输入电信号。
其中，电路包括用于对次像素区域输入电信号的数据线，数据线绕开主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
本发明的有益效果是：区别于现有技术的情况，本发明的阵列基板，将像素单元分为主像素区域和次像素区域，并将作用于像素单元的电路布局在像素单元之间，以在三维显示模式下能够提高液晶显示面板的开口率和穿透率，增加液晶显示面板的亮度。
附图说明
图1是现有技术中一种FPR 3D显示系统的结构示意图，同时示出两种视角条件下的光路差异；
图2是现有技术中一种FPR 3D显示系统的像素单元的金属走线布局的结构示意图；
图3是图2中的像素单元在3D显示模式下黑色矩阵的分布示意图；
图4是本发明应用于偏光式液晶显示的阵列基板的一实施方式的结构示意图；
图5是图4中的电路的一实施方式的结构示意图；
图6是图4中的电路的另一实施方式的结构示意图；
图7是图4中的电路的又一实施方式的结构示意图；
图8是本发明液晶显示面板的一实施方式的结构示意图。
具体实施方式
本发明应用于偏光式三维液晶显示的阵列基板以及液晶显示面板，能够在三维显示模式下提高液晶显示面板的开口率和穿透率，增加液晶显示面板的亮度。
下面将结合附图和实施方式对本发明进行详细说明。
参阅图4，在本发明应用于偏光式三维液晶显示的阵列基板的一实施方式中，阵列基板100包括多个像素单元101和作用于像素单元101的电路102。
每个像素单元101包括主像素区域1011和次像素区域1012。电路102包括充电扫描线1021、电荷共享扫描线1022以及电荷共享电容1023。电路102布局于上下相邻的像素单元101之间。
具体地，参阅图5，本实施方式以图4中上下相邻的两个像素单元为例进行说明，两个像素单元分别为第一像素单元201和第二像素单元202。第一像素单元201包括第一主像素区域2011和第一次像素区域2012，第二像素单元202包括第二主像素区域2021和第二次像素区域2022。第一电路（未标示）作用于第一像素单元201，包括第一充电扫描线2031、第一电荷共享扫描线2032以及第一电荷共享电容2033。第二电路（未标示）作用于第二像素单元202，包括第二充电扫描线2041、第二电荷共享扫描线2042以及第二电荷共享电容2043。
其中，第一电路的第一充电扫描线2031设置于第一像素单元201的上顶端，第一电荷共享扫描线2032和第二电荷共享电容2033对应设置于第一像素单元201的下底端；第二电路的第二充电扫描线2041设置于第二像素单元202的上顶端，第二电荷共享扫描线2042和第二电荷共享电容2043对应设置于第二像素单元202的下底端。
通过上述电路的布局，使得第二像素单元202对应的第二充电扫描线2041与相邻的第一像素单元201的第一电荷共享扫描线2032和第一电荷共享电容2033相邻，而第二像素单元202对应的第二电荷共享扫描线2042和第二电荷共享电容2043与相邻的另一像素单元（位于第二像素单元202下方，图未示）的充电扫描线（图未示）相邻，第一像素单元201对应的第一充电扫描线2031与相邻的另一像素单元（位于第一像素单元201的上方，图未示）的电荷共享扫描线和电荷共享电容（图均未示）相邻。
本实施方式将作用于第一像素单元201的第一电路布局在第一像素单元201与其他上下相邻的像素单元的交界处，如与第二像素单元202的交界处205；将作用于第二像素单元202的第二电路布局在第二像素单元202与其他上下相邻的像素单元的交界处，如与第一像素单元201的交界处205。各电路布局在上下相邻的像素单元的交界处，也使得对应像素单元的主像素区域和次像素区域的交界处变为穿透区域，增加了显示区域面积。并且，两像素单元的交界处205位于黑色矩阵（图未示）垂直投影的覆盖区域206，而各电路的各走线也具有黑色矩阵的效果，将其设在黑色矩阵垂直投影的覆盖区域206，节省了显示区域面积，在增加黑色矩阵以满足三维显示的视角要求时，能够减少对主像素区域和次像素区域的面积比例的影响，同时也能在三维显示模式下提高液晶显示面板的开口率和穿透率，增加液晶显示面板的亮度。
进一步地，本实施方式的电路还包括用于对次像素区域输入电信号的次数据线。以图5中的第一像素单元为例进行说明，继续参阅图5，在第一充电扫描线2031的区域，还设置有分别控制第一主像素区域2011和第一次像素区域2012显示和关闭的第一薄膜晶体管2034和第二薄膜晶体管2035。在第一电荷共享扫描线2032和第一电荷共享电容2033的区域，还设置有第三薄膜晶体管2036。每个薄膜晶体均包括栅极、源极以及漏极。第一电路还包括主数据线2037和次数据线2038，主数据线2037用于对第一主像素区域2011和第一次像素区域2012提供电信号，次数据线2038用于将电信号传输至第一次像素区域2012，其中电信号为数据信号。此外，第一主像素区域2011设置有主像素电极20111，第一次像素区域2012设置有次像素电极20121。
其中，第一薄膜晶体管2034的第一栅极20341电连接第一充电扫描线2031，第一源极20342电连接主数据线2037，第一漏极20343电连接主像素电极20111。第二薄膜晶体管2035的第二栅极20351电连接第一充电扫描线2031，第二源极20352电连接主数据线2037，第二漏极20353电连接次数据线2038，以通过次数据线2038与次像素电极20121电连接。第三薄膜晶体2036的第三栅极20361电连接第一电荷共享扫描线2032，第三源极20362电连接次数据线2038，以通过次数据线2038与次像素电极20121电连接，第三漏极20363电连接第一电荷共享电容2033。
本实施方式中，次数据线2038穿过第一主像素区域2011和第一次像素区域2012，以将主数据线2037提供的数据信号传输至第一次像素区域2012和第一电荷共享电容2033处。
在三维显示模式下，第一充电扫描线2031输入扫描信号以打开第一薄膜晶体管2034和第二薄膜晶体管2035，然后主数据线2037输入三维显示所需的数据信号。进入第一主像素区域2011的数据信号从第一源极20342输入至第一薄膜晶体管2034，并通过第一漏极20343输出至主像素电极20111，以使得第一主像素区域2011显示三维画面。进入第一次像素区域2012的数据信号从第二源极20352输入至第二薄膜晶体管2035，并通过第二漏极20353输出至次数据线2038，数据信号通过次数据线2038传输至次像素电极20121。此时主像素电极20111和次像素电极20121电位相同，即第一主像素区域2011和第一次像素区域2012电位相同。停止对第一充电扫描线2031输入扫描信号，第一电荷共享扫描线2032输入扫描信号以打开第三薄膜晶体管2036，由于第三源极20361通过次数据线2038与次像素电极20121电连接，因此在第三薄膜晶体管2036打开时，次像素电极20121的电压信号通过次数据线2038传输至第三源极20361，然后耦合至与第三漏极20363电连接的第一电荷共享电容2033。在第一电荷共享电容2033的作用下，使得次像素电极20121的电位低于主像素电极20111的电位，即第一主像素区域2011和第一次像素区域2012存在电位差。
第一主像素区域2011和第一次像素区域2012存在电位差，使得两像素区域的液晶分子的转向分布不同，从而能够使液晶显示面板在三维显示模式下在一定程度上改善大视角的颜色差异，降低色彩失真，提高显示效果。
此外，参阅图6，本实施方式与图5所示的电路的布局的主要区别在于，本实施方式的次数据线3038还可以绕开第一主像素区域3011并穿过第一次像素区域3012以将数据信号传输至第一次像素区域3012的次像素电极30121，次像素电极30121通过次数据线3038与第三薄膜晶体管3036连接以将数据信号传输至第一电荷共享电容3033。在第一电荷共享电容3033的作用下使第一主像素区域3011和第一次像素区域3012存在电压差。具体的电路连接关系以及驱动原理可参考上述实施方式进行，在此不进行赘述。
参阅图7，本发明的电路的又一实施方式的结构示意图，与图5所示的电路的布局的主要区别在于，本实施方式的次数据线4038绕开第一主像素区域4011和第一次像素区域4012，即经过第一主像素区域4011和第一次像素区域4012的边缘，以将数据信号传输至第一次像素区域4012的次像素电极40121，此时次像素电极40121布局在第一电荷共享扫描线4032和第一电荷共享电容4033所在的区域。次像素电极40121通过次数据线4038与第三薄膜晶体管4036连接以将数据信号传输至第一电荷共享电容4033。在第一电荷共享电容4033的作用下使第一主像素区域4011和第一次像素区域4012存在电压差。具体的电路连接关系以及驱动原理可参考上述实施方式进行，在此也不进行一一赘述。
综上所述，本实施方式的阵列基板，在三维显示模式下，能够使液晶显示面板在一定程度上改善大视角的颜色差异，降低色彩失真，同时也能提高液晶显示面板的开口率和穿透率，增加液晶显示面板的亮度。
参阅图8，本发明偏光式三维液晶显示面板的一实施方式中，液晶显示面板500包括：阵列基板501和彩色滤光基版502，其中，图中为更好显示，是将正常为上下叠置的阵列基板501和彩色滤光基版502改为同一平面平铺的方式。其中，彩色滤光基版502包括黑色矩阵5021；阵列基板包括：多个像素单元5011，每个像素单元5011包括主像素区域50111和次像素区域50112；作用于像素单元5011的电路5012，电路5012布局于像素单元5011之间，并且至少部分位于黑色矩阵5021垂直投影区域内。
电路5012包括充电扫描线50121、电荷共享扫描线50122以及电荷共享电容50123。其中，一个像素单元5011的充电扫描线50121、电荷共享扫描线50122和电荷共享电容50123分别对应与相邻的一像素单元5011的电荷共享扫描线50122和电荷共享电容50123、相邻另一像素单元5011的充电扫描线50121相邻。可以理解为，电路5012布局在上下相邻的像素单元之间。
本实施方式的电路5012还包括次数据线（图未示），次数据线用于对次像素区域50112和电荷共享电容50123输入数据信号，使得主像素区域50111和次像素区域50112在电荷共享电容50123的作用下存在电压差，从而使液晶显示面板在三维显示模式下具有低色偏的效果。次数据线的具体布局可参考图5-图7所示的电路布局，在此不进行一一赘述。
电路5012中的各种走线也具备黑色矩阵的效果，将其设置在彩色滤光基板502的黑色矩阵5021的投影区域，而不需要占用另外的显示区域面积。在增加黑色矩阵5021的宽度以满足三维显示模式下的视角要求时，能够减少对主像素区域50111和次像素区域50112两个显示区域面积的影响，从而能够提高液晶显示面板的开口率和穿透率，增加液晶显示面板亮度。
以上所述仅为本发明的实施方式，并非因此限制本发明的专利范围，凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本发明的专利保护范围内。

Claims (10)

1.一种应用于偏光式三维液晶显示的阵列基板，其特征在于，包括：
多个像素单元，每个所述像素单元包括主像素区域和次像素区域；
作用于所述像素单元的电路，所述电路布局于像素单元之间。
2.根据权利要求1所述的阵列基板，其特征在于，
所述电路包括充电扫描线、电荷共享扫描线以及电荷共享电容，其中一个所述像素单元的充电扫描线、电荷共享扫描线以及电荷共享电容分别对应与相邻一像素单元的电荷共享扫描线和电荷共享电容、相邻另一像素单元的充电扫描线相邻。
3.根据权利要求2所述的阵列基板，其特征在于
所述电路包括用于对次像素区域输入电信号的次数据线，所述次数据线穿过主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
4.根据权利要求2所述的阵列基板，其特征在于，
所述电路包括用于对次像素区域输入电信号的次数据线，所述次数据线绕开主像素区域并穿过次像素区域，以对次像素区域和电荷共享电容输入电信号。
5.根据权利要求2所述的阵列基板，其特征在于，
所述电路包括用于对次像素区域输入电信号的次数据线，所述次数据线绕开主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
6.一种偏光式三维液晶显示面板，其特征在于：
包括阵列基板和彩色滤光基板；
所述彩色滤光基板包括黑色矩阵；
所述阵列基板包括：
多个像素单元，每个所述像素单元包括主像素区域和次像素区域；
作用于所述像素单元的电路，所述电路布局于像素单元之间，并且至少部分位于所述黑色矩阵垂直投影区域内。
7.根据权利要求6所述的液晶显示面板，其特征在于，
所述电路包括充电扫描线、电荷共享扫描线以及电荷共享电容，其中一个所述像素单元的充电扫描线、电荷共享扫描线以及电荷共享电容分别对应与相邻一像素单元的电荷共享扫描线和电荷共享电容、相邻另一像素单元的充电扫描线相邻。
8.根据权利要求7所述的液晶显示面板，其特征在于，
所述电路包括用于对次像素区域输入电信号的数据线，所述数据线穿过主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
9.根据权利要求7所述的液晶显示面板，其特征在在于，
所述电路包括用于对次像素区域输入电信号的数据线，所述数据线绕开主像素区域并穿过次像素区域，以对次像素区域和电荷共享电容输入电信号。
10.根据权利要求7所述的液晶显示面板，其特征在于，
所述电路包括用于对次像素区域输入电信号的数据线，所述数据线绕开主像素区域和次像素区域，以对次像素区域和电荷共享电容输入电信号。
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