CN102879966B - 一种阵列基板及液晶显示装置 - Google Patents
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Abstract
本发明公开了一种阵列基板,包括至少多条第一扫描线、第二扫描线、数据线以及多个行列排列的像素单元,每个像素单元开关元件和像素电极,像素电极包括主像素电极和次像素电极,控制主像素电极和次像素电极之间存在预设电压差,并使数据线直接通过次像素电极所在的区域对次像素电极输入数据信号,将第一扫描线、第二扫描线以及开关元件设置在上下相邻的像素单元之间,且像素单元之间的区域为对应不透光区域的暗区。本发明还提供一种液晶显示装置。通过上述方式,本发明能够减小3D显示模式下的信号串扰,同时减小大视角下的颜色差异,提高液晶显示面板的可靠率。
Description
技术领域
本发明涉及液晶显示技术领域,特别是涉及一种阵列基板及液晶显示装置。
背景技术
FPR(Film-type Patterned Retarder,偏光式)是现有3D液晶显示的成像方式之一。如图1所示,FPR3D显示系统包括下玻璃基板11、上玻璃基板12、偏振(Patterned Retarder)薄膜13。下玻璃基板11和上玻璃基板用以形成液晶显示面板,液晶显示面板包括用于显示图像的图像单元14,图像单元14包括对应于一个像素单元并用于显示左眼图像的左图像单元141,以及对应于一个像素并用于显示右眼图像的右图像单元142。偏振薄膜13贴附在液晶显示面板上,通过与偏振眼镜16的配合以将3D画面分离为左眼图像21和右眼图像22。并分别传送至观看者的左眼和右眼以实现立体显示。但是在3D显示模式下,当观看者处于较大视角时,会出现左右眼影像互相串扰(Crosstalk)的现象,例如,原本送到左眼的左眼图像23同时被右眼观察到了,产生了双眼信号串扰。通常的解决方案是增加左图像单元141和右图像单元142之间的黑色矩阵(Black Matrix,BM)15的宽度,以减小双眼信号串扰的可能性,并且,黑色矩阵15的宽度需达到一定的宽度才能在一定程度上减少双眼信号串扰。
而在MVA(Multi-domain vertical alignment,多域分割垂直配向)型面板的液晶显示模式中,大视角的显示颜色与正视所显示的颜色存在较大差异,为了解决此色偏问题,一般采用Charge-shared(电荷共享)技术以达到低色偏的效果。如图2所示,在一种Charge-shared像素设计中,将一个像素Pixel(N)30分为主像素(N)和次像素(N),一个Pixel(N)30对应两条不同时间且依序开启的扫描线(N)和扫描线(M)。扫描线(N)为高电位时使得薄膜晶体管31和薄膜晶体管32同时导通,数据线(x)分别通过薄膜晶体管31和32将电压信号同时送至主像素(N)和次像素(N)的像素电极中,使得主像素(N)和次像素(N)电位相同。关闭扫描线(N)后,扫描线(M)输入高电位以导通薄膜晶体管33,薄膜晶体管33的输入端连接次像素(N)的像素电极,输出端连接储存电容34的一端,而储存电容34的另一端通常与另一基板的公共电极(Com)连接。驱动液晶显示面板显示时会有极性上的切换,在薄膜晶体管33开启前储存电容34所存储的电荷的极性会与目前次像素(N)的电荷极性相反,因此薄膜晶体管33开启后会导致次像素(N)的电荷被储存电容34中和,减小了次像素(N)的电场,使得主像素(N)和次像素(N)的电场产生差异,从而能达到大视角色偏补偿的目的。
但是,采用此种Charge-shared技术的像素设计,像素Pixel(N)30的两条扫描线(N)和扫描线(M)位于主像素(N)和次像素(N)之间,与扫描线(N)相连的薄膜晶体管31和32、以及与扫描线(M)相连的薄膜晶体管33和储存电容34均位于主像素(N)和次像素(N)之间。如图3所示,这会使得像素Pixel(N)30对应不透光区域的主要暗区35位于像素Pixel(N)30的主像素(N)和次像素(N)之间,主要暗35的宽度较大,而像素Pixel(N)30和像素Pixel(N+1)40之间的对应不透光区域的暗区36宽度相对较小,从而在将FPR3D显示技术应用于MVA面板时,对应于FPR3D显示模式下(如图1所示)的左图像单元141和右图像单元142之间的黑色矩阵15的宽度也相对较小,不利于减少双眼信号串扰。因此上述的Charge-shared像素设计并不适合用于FPR3D显示模式。
在另一种Charge-shared像素设计中,参阅图4,同样地,一个像素Pixel(N)50分为主像素(N)和次像素(N),所对应的两条依序打开的扫描线(N)和扫描线(M)位于像素Pixel(N)50的同一侧。其中,扫描线(N)分别通过薄膜晶体管51和52与主像素(N)和次像素(N)的像素电极连接,扫描线(M)通过薄膜晶体管53与次像素(N)的像素电极相连,薄膜晶体管53的输出端连接存储电容54。此种Charge-shared的像素设计,像素Pixel(N)50所对应的扫描线以及薄膜晶体管等元件均位于像素Pixel(N)50的同一侧,如图5所示,使得两个不同像素Pixel(N)50和Pixel(N+1)60之间的区域宽度变大,即对应不透光区域的主要暗区57的宽度较大,从而在将FPR3D显示技术应用于MVA面板时,对应于FPR3D显示模式下(如图1所示)的左图像单元141和右图像单元142之间的黑色矩阵15的宽度也相对较大,能够减少双眼信号串扰。因此,此种Charge-shared像素设计相较于图2所示的Charge-shared像素设计更适合用于FPR3D显示模式。
但是,在图4所示的Charge-shared像素设计中,与次像素(N)的像素电极连接的连线55需要经过主像素(N)所在的区域,导致主像素(N)和次像素(N)的像素电极之间存在较大的寄生电容56。寄生电容56会降低主像素(N)和次像素(N)的电位,且在四道光罩制程(4PEP)的情况下,寄生电容56会因光照而产生变化,影响了液晶显示面板的可靠性。同时,连线55经过主像素(N)所在的区域也会导致穿透率和开口率降低。
发明内容
本发明主要解决的技术问题是提供一种阵列基板及液晶显示装置,能够减少3D显示模式下双眼信号串扰的现象,有效提高液晶显示面板制程的良率,同时能够减小大视角下的颜色差异,提高穿透率和开口率。
为解决上述技术问题,本发明采用的一个技术方案是:提供一种阵列基板,包括至少多条第一扫描线、第二扫描线、数据线以及多个行列排列的像素单元,每个像素单元均包括开关元件和像素电极,每个像素单元对应至少一条第一扫描线、第二扫描线以及数据线;每个像素单元的开关元件包括控制端、输入端以及输出端,数量为至少三个,至少分别是第一开关元件、第二开关元件以及第三开关元件;像素电极包括主像素电极和次像素电极,第一扫描线和第二扫描线分别与第一开关元件和第二开关元件连接以分别控制第一开关元件和第二开关元件的导通与断开,数据线分别经过主像素电极所在的区域和次像素电极所在的区域而连接主像素电极和次像素电极以输入电压信号;阵列基板还包括对应不透光区域的暗区,暗区的至少一部分设置于像素单元之间,第一扫描线、第二扫描线以及开关元件布局于像素单元之间;其中,对于任意三个沿数据线方向排列的相邻像素单元,位于中间的像素单元对应的第一扫描线和第一开关元件与前面的像素单元对应的第二扫描线、第二开关元件以及第三开关元件相邻,以对主像素电极输入扫描信号,中间的像素单元对应的第二扫描线、第二开关元件以及第三开关元件与后面的像素单元对应的第一扫描线和第一开关元件相邻,以对次像素电极输入扫描信号;第一开关元件的输出端电连接主像素电极,第二开关元件的输出端电连接次像素电极,第三开关元件的输出端用于电连接储存电容,第一开关元件和第二开关元件的输入端分别电连接数据线,第三开关的输入端电连接次像素电极,第一开关元件的控制端电连接第一扫描线,第二开关元件的控制端电连接第二扫描线,第三开关元件的控制端电连接后面的像素单元对应的第一扫描线;其中,在进入3D显示模式时,中间的像素单元对应的第一扫描线和第二扫描线输入扫描信号以分别控制第一开关元件和第二开关元件导通,数据线分别通过第一开关元件和第二开关元件同时输入电压信号至中间的像素单元的主像素电极和次像素电极,随后停止输入扫描信号至第一扫描线和第二扫描线;停止输入扫描信号至第一扫描线和第二扫描线后,与第三开关元件的控制端电连接的后面的像素单元对应的第一扫描线输入扫描信号以控制第三开关元件导通,中间的像素单元的次像素电极的电压信号通过第三开关元件耦合至与第三开关元件的输出端电连接的储存电容,调整储存电容的大小以控制中间的像素单元的主像素电极和次像素电极之间存在预设电压差。
其中,第一开关元件、第二开关元件以及第三开关元件分别为第一薄膜晶体管、第二薄膜晶体管以及第三薄膜晶体管;第一薄膜晶体管包括第一栅极、第一源极以及第一漏极,第一源极作为输入端与数据线电连接,第一漏极作为输出端与主像素电极电连接,第一栅极作为控制端与第一扫描线电连接以控制第一薄膜晶体管的导通与断开;第二薄膜晶体管包括第二栅极、第二源极以及第二漏极,第二源极作为输入端与数据线电连接,第二漏极作为输出端与次像素电极电连接,第二栅极作为控制端与第二扫描线电连接以控制第二薄膜晶体管的导通与断开;第三薄膜晶体管包括第三栅极、第三源极以及第三漏极,第三源极与次像素电极电连接,第三漏极作为输出端用于与储存电容电连接,第三栅极与相邻一像素单元对应的第一扫描线电连接以控制第三薄膜晶体管的导通与断开。
为解决上述技术问题,本发明采用的另一个技术方案是:提供一种液晶显示装置,包括偏振薄膜以及液晶显示面板,液晶显示面板包括阵列基板和彩色滤光基板;彩色滤光基板包括黑色矩阵,偏振薄膜设置于彩色滤光基板的外侧;阵列基板包括至少多条第一扫描线、第二扫描线、数据线以及多个行列排列的像素单元,每个像素单元均包括开关元件和像素电极,每个像素单元对应至少一条第一扫描线、第二扫描线以及数据线;每个像素单元的开关元件包括控制端、输入端和输出端,数量为至少三个,至少分别是第一开关元件、第二开关元件以及第三开关元件;像素电极包括主像素电极和次像素电极,第一扫描线和第二扫描线分别与第一开关元件和第二开关元件连接以分别控制第一开关元件和第二开关元件的导通与断开,数据线分别经过主像素电极所在的区域和次像素电极所在的区域而连接主像素电极和次像素电极以输入电压信号;阵列基板还包括多个暗区,暗区位于黑色矩阵的垂直投影覆盖区域内,并且暗区的至少一部分设置于像素单元之间,第一扫描线、第二扫描线以及开关元件布局于像素单元之间;其中,对于任意三个沿数据线方向排列的相邻像素单元,位于中间的像素单元对应的第一扫描线和第一开关元件与前面的像素单元对应的第二扫描线、第二开关元件以及第三开关元件相邻,以对主像素电极输入扫描信号,中间的像素单元对应的第二扫描线、第二开关元件以及第三开关元件与后面的像素单元对应的第一扫描线和第一开关元件相邻,以对次像素电极输入扫描信号;第一开关元件的输出端电连接主像素电极,第二开关元件的输出端电连接次像素电极,第三开关元件的输出端用于电连接储存电容,第一开关元件和第二开关元件的输入端分别电连接数据线,第三开关的输入端电连接次像素电极,第一开关元件的控制端电连接第一扫描线,第二开关元件的控制端电连接第二扫描线,第三开关元件的控制端电连接后面的像素单元对应的第一扫描线;其中,在进入3D显示模式时,中间的像素单元对应的第一扫描线和第二扫描线输入扫描信号以分别控制第一开关元件和第二开关元件导通,数据线通过第一开关元件和第二开关元件同时输入电压信号至中间的像素单元的主像素电极和次像素电极,随后停止输入扫描信号至第一扫描线和第二扫描线;停止输入扫描信号至第一扫描线和第二扫描线后,与第三开关元件的控制端电连接的后面的像素单元对应的第一扫描线输入扫描信号以控制第三开关元件导通,中间的像素单元的次像素电极的电压信号通过第三开关元件耦合至与第三开关元件的输出端电连接的储存电容,调整储存电容的大小以控制中间的像素单元的主像素电极和次像素电极之间存在预设电压差。
其中,第一开关元件、第二开关元件以及第三开关元件分别为第一薄膜晶体管、第二薄膜晶体管以及第三薄膜晶体管;第一薄膜晶体管包括第一栅极、第一源极以及第一漏极,第一源极作为输入端与数据线电连接,第一漏极作为输出端与主像素电极电连接,第一栅极作为控制端与第一扫描线电连接以控制第一薄膜晶体管的导通与断开;第二薄膜晶体管包括第二栅极、第二源极以及第二漏极,第二源极作为输入端与数据线电连接,第二漏极作为输出端与次像素电极电连接,第二栅极作为控制端与第二扫描线电连接以控制第二薄膜晶体管的导通与断开;第三薄膜晶体管包括第三栅极、第三源极以及第三漏极,第三源极与次像素电极电连接,第三漏极作为输出端用于与储存电容电连接,第三栅极与相邻一像素单元对应的第一扫描线电连接以控制第三薄膜晶体管的导通与断开。
其中,液晶显示面板是MVA(Multi-domain vertical alignment,多域分割垂直配向)型液晶显示面板。
本发明的有益效果是:本发明的阵列基板,其每个像素单元对应至少一条第一扫描线、第二扫描线以及数据线,每个像素单元包括开关元件和像素电极,像素电极包括主像素电极和次像素电极,数据线分别经过主像素电极所在的区域和次像素电极所在的区域而连接主像素电极和次像素电极以输入电压信号,使得与次像素电极连接的连接线无需经过主像素电极所在的区域而与次像素电极连接,由此能够减小主像素电极所在的区域和次像素电极所在的区域之间的寄生电容,以提高后续制程中液晶显示面板的可靠性,同时能在一定程度上提高穿透率;并且,将第一扫描线、第二扫描线以及开关元件布局于上下相邻的像素单元之间,且像素单元之间的区域为对应不透光区域的暗区,能够增大像素单元之间的不透光暗区的宽度,从而能减少3D显示模式下双眼信号串扰的现象;此外,使次像素电极通过第三开关元件与储存电容连接,在第三开关元件导通时,次像素电极的电荷会与储存电容的电荷发生中和,使得次像素电极的电场减小,造成电压降低,通过调整储存电容的大小可使得主像素电极和次像素电极之间存在预设电压差,从而能够减小大视角下的颜色差异,达到低色偏的效果。
附图说明
图1是现有技术中一种FPR3D显示系统的结构示意图,同时示出两种视角条件下的光路差异;
图2是现有技术中一种MVA型液晶显示面板的像素的结构示意图;
图3是图2中液晶显示面板的像素的平面示意图;
图4是现有技术中另一种MVA型液晶显示面板的像素的结构示意图;
图5是图4中液晶显示面板的像素的平面示意图;
图6是本发明阵列基板一实施方式的结构示意图;
图7是图6中阵列基板的像素单元的一实施方式的结构示意图;
图8是图7中像素单元的平面示意图。
具体实施方式
下面将结合附图和实施方式对本发明进行详细说明。
参阅图6,本发明阵列基板的一实施方式包括:多条第一扫描线101、第二扫描线102、数据线103以及多个行列排列的像素单元104。每个像素单元104均包括开关元件1041和像素电极1042。每个像素单元104对应一条第一扫描线101、第二扫描线102以及数据线103。
具体地,参阅图7,图7为图6中阵列基板的像素单元的一实施方式的结构示意图,并且图7示出了图6中任意三个沿数据线203方向排列的相邻像素单元的结构,其中所示的三个沿数据线203方向排列的相邻像素单元中,中间的像素单元、后面的像素单元以及前面的像素单元分别是第一像素单元204、第二像素单元205以及第三像素单元206,第三像素单元206只示出部分结构。以第一像素单元204为例,第一像素单元204的开关元件的数量为三个,分别是第一开关元件2041、第二开关元件2042以及第三开关元件2043。第一像素单元204的像素电极2010包括主像素电极2044和次像素电极2045。对应地,主像素电极2044所在的区域为主像素区域2046,次像素电极2045所在的区域为次像素区域2047。第一扫描线201与第一开关元件2041连接以输入扫描信号,从而控制第一开关元件2041的导通与断开;第二扫描线202与第二开关元件2042连接以输入扫描信号,从而控制第二开关元件2042的导通与断开。数据线203通过第一开关元件2041与主像素电极2044连接,并且连接线(即第一开关元件2041的第一输出端20413与主像素电极2044之间的连接线)直接经过主像素区域2046与主像素电极2044连接以对主像素电极2044输入数据信号。数据线203通过第二开关元件2042与次像素电极2045连接,并且连接线(即第二开关元件2042的第二输出端20423与次像素电极2045之间的连接线)直接经过次像素区域2047而无需经过主像素区域2046即可与次像素电极2045连接以对次像素电极2045输入数据信号。
通过上述方式,与主像素电极2044连接的连接线不需要经过次像素区域2047与主像素电极2044连接,而与次像素电极2045连接的连接线也不需要经过主像素区域2046与次像素电极2045连接,由此减小了主像素区域2046和次像素区域2047之间的寄生电容。
本实施方式中,请参阅图7和图8,阵列基板还包括对应不透光区域的暗区300(图8中的阴影部分),第一像素单元204对应的第一扫描线201、第二扫描线202、第一开关元件2041、第二开关元件2042以及第三开关元件2043相应设置在第一像素单元204与前后相邻的像素单元206、205之间。具体地,对应不透光区域的暗区300的一部分设置在像素单元之间,如第一像素单元204和第二像素单元205之间的暗区区域301,即三个相邻像素单元之间的区域为对应不透光区域的暗区300的一部分。第一像素单元204对应的第一扫描线201和第一开关元件2041均位于第一像素单元204的上一侧,其与第三像素单元206(图只示出部分结构)对应的第二扫描线207、第二开关元件2061以及第三开关元件2062相邻,以对主像素电极2044输入扫描信号;而第一像素单元204对应的第二扫描线202、第二开关元件2042以及第三开关元件2043位于第一像素单元204的下一侧,其与第二像素单元205对应的第一扫描线208和第一开关元件209相邻,以对次像素电极2045输入扫描信号。
进一步地,将本实施方式的阵列基板组装以形成液晶显示面板,在驱动液晶显示面板显示时,控制主像素电极2044和次像素电极2045存在预设电压差以使液晶显示面板在大视角下具有低色偏的效果。具体地,第一像素单元204的第一开关元件2041的第一控制端20411电连接第一扫描线201,第一输入端20412电连接数据线203,第一输出端20413电连接主像素电极2044。第二开关元件2042的第二控制端20421电连接第二扫描线202,第二输入端20422电连接数据线203,第二输出端20423电连接次像素电极2045。第三开关元件2043的第三控制端20431电连接第二像素单元205所对应的第一扫描线208,第三输入端20432电连接次像素电极2045,第三输出端20433用于电连接储存电容2011。其中,储存电容2011由与阵列基板同一侧的金属层和另一基板(通常为彩色滤光基板)的公共电极(Com)所构成,第三开关元件2043的第三输出端20433电连接形成储存电容2011的金属层,使得储存电容2011通过第三开关元件2043与次像素电极2045连接。
在进入3D显示模式时,第一像素单元204对应的第一扫描线201和第二扫描线202输入扫描信号至第一控制端20411和第二控制端20421,以分别控制第一开关元件2041和第二开关元件2042导通,然后数据线203输入数据信号至第一输入端20411和第二输入端20421,以使得数据信号分别通过第一输出端20413和第二输出端20423传送至第一像素单元204的主像素电极2044和次像素电极2045。数据线203将数据信号同时输入至主像素电极2044和次像素电极2045中后,主像素电极2044和次像素电极2045电位相同。关闭第一扫描线201和第二扫描线202以停止对第一像素单元204输入扫描信号,开始驱动后面的像素单元即第二像素单元205显示,首先需对第二像素单元205对应的第一扫描线208输入扫描信号以控制第二像素单元205的第一开关元件209的导通。此时,由于第一像素单元204对应的第三开关元件2043的第三控制端20431电连接第二像素单元205对应的第一扫描线208,在第一扫描线208输入扫描信号时,此时第三开关元件2043被导通。
在驱动液晶显示面板显示时,液晶显示面板会有极性上的切换,显示电压在正极性和负极性之间不停的更换,以避免液晶分子的转向一直固定在一个方向而造成的特性破坏。当像素电极2010的电压高于公共电极电压时,显示电压为正极性,反之则为负极性。因此,在第一像素单元204对应的第三开关元件2043未导通之前,储存电容2011所储存的电荷的极性与第一像素单元204的次像素电极2045的电荷极性相反,所以在第三开关元件2043导通时,次像素电极2045的电荷会通过第三开关元件2043与储存电容2011的电荷发生中和,使得次像素电极2045的电场减小,由此造成主像素电极2044和次像素电极2045之间存在电压差。根据视角需求,调整储存电容2011的大小使得主像素电极2044和次像素电极2045之间存在预设电压差,以控制液晶分子的偏转,从而能够减小大视角下的色彩差异,达到低色偏的效果。
其中,本实施方式的第一开关元件2041、第二开关元件2042以及第三开关元件2043分别为第一薄膜晶体管、第二薄膜晶体管以及第三薄膜晶体管,每个薄膜晶体管均包括作为控制端的栅极、作为输入端的源极以及作为输出端的漏极。相应地,第一薄膜晶体管的第一栅极与第一扫描线201电连接以控制第一薄膜晶体管的导通与断开,第一源极与数据线203电连接,第一漏极与主像素电极2044电连接,以使得数据线203通过第一薄膜晶体管将数据信号输入至主像素电极2044;第二薄膜晶体管的第二栅极与第二扫描线202电连接以控制第二薄膜晶体管的导通与断开,第二源极与数据线203电连接,第二漏极与次像素电极2045电连接,以使得数据线203通过第二薄膜晶体管将数据信号输入至次像素电极2045;第三薄膜晶体管的第三栅极与第二像素单元205对应的第一扫描线208电连接以控制第三薄膜晶体管的导通与断开,第三源极与次像素电极2045电连接,第三漏极用于与储存电容2011电连接,以控制主像素电极2044和次像素电极2045之间存在预设电压差。
本实施方式中,第一像素单元204中的像素电极2010包括主像素电极2044和次像素电极2045,使第一开关元件2041的第一输出端20413与主像素电极2044之间的连接线直接经过主像素电极2044所在的主像素区域2046与主像素电极2044连接,而第二开关元件2042的第二输出端20423和第三开关元件2043的第三输入端20432与次像素电极2045之间的连接线直接经过次像素电极2045所在的次像素区域2047而无需经过主像素区域2046与次像素电极2045连接,能够减小主像素区域2046和次像素区域2047之间的寄生电容,提高后续四道光罩制程中液晶显示面板的可靠性,同时也能在一定程度上提高穿透率和开口率。并且,沿数据线203方向相邻的像素单元之间的区域为对应不透光区域的暗区区域301,第一像素单元204对应的第一扫描线201和第一开关元件2041设置在第一像素单元204和第三像素单元206之间,第二扫描线202、第二开关元件2042以及第三开关元件2043设置在第一像素单元204和第二像素单元205之间,使得这些扫描线和开关元件均布局于上下相邻的像素单元之间,增大了像素单元之间的暗区区域301的宽度,由此能够在3D显示模式下减少大视角下双眼信号串扰的现象,也能提高穿透率。此外,次像素电极2045通过第三开关元件2043与储存电容2011连接,通过调整储存电容2011的大小能够控制主像素电极2044和次像素电极2045之间存在预设电压差,以此控制液晶分子的偏转,从而能够减小大视角下的颜色差异,达到低色偏的效果。
本发明还提供液晶显示装置的一实施方式,其包括偏振薄膜以及液晶显示面板。偏振薄膜用于将液晶显示面板显示的3D画面分离为左眼信号和右眼信号以同时发送至观看者眼中,使观看者能看到较少闪烁的3D画面。液晶显示面板包括阵列基板和彩色滤光基板。彩色滤光基板包括黑色矩阵,偏振薄膜设置于彩色滤光基板的外侧。阵列基板为上述实施方式所述的阵列基板。
具体地,参阅图6,阵列基板包括多条第一扫描线101、第二扫描线102、数据线103以及多个行列排列的像素单元104。每个像素单元104包括开关元件1041和像素单元1042,并且每个像素单元104对应至少一条第一扫描线101、第二扫描线102以及数据线103。
其中,像素单元104的具体结构,可参考图7所示的实施方式进行,此处不进行一一赘述。值得注意的是,图7和图8所示的第一像素单元204和第二像素单元205之间的暗区区域301为彩色滤光基板的黑色矩阵的垂直投影覆盖区域,将第一扫描线201、第二扫描线202以及三个开关元件2041-2043设置在黑色矩阵的垂直投影覆盖区域内,也能提高液晶显示面板的穿透率和开口率。
其中,本实施方式的液晶显示面板为MVA型液晶显示面板。
以上所述仅为本发明的实施方式,并非因此限制本发明的专利范围,凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换,或直接或间接运用在其他相关的技术领域,均同理包括在本发明的专利保护范围内。
Claims (5)
1.一种阵列基板,其特征在于:
所述阵列基板包括至少多条第一扫描线、第二扫描线、数据线以及多个行列排列的像素单元,每个所述像素单元均包括开关元件和像素电极,每个所述像素单元对应至少一条第一扫描线、第二扫描线以及数据线;
每个所述像素单元的开关元件包括控制端、输入端以及输出端,数量为至少三个,至少分别是第一开关元件、第二开关元件以及第三开关元件;
所述像素电极包括主像素电极和次像素电极,所述第一扫描线和第二扫描线分别与第一开关元件和第二开关元件连接以分别控制第一开关元件和第二开关元件的导通与断开,所述数据线分别经过主像素电极所在的区域和次像素电极所在的区域而连接主像素电极和次像素电极以输入电压信号;
所述阵列基板还包括对应不透光区域的暗区,所述暗区的至少一部分设置于像素单元之间,所述第一扫描线、第二扫描线以及开关元件布局于像素单元之间;
其中,对于任意三个沿数据线方向排列的相邻像素单元,位于中间的所述像素单元对应的第一扫描线和第一开关元件与前面的像素单元对应的第二扫描线、第二开关元件以及第三开关元件相邻,以对主像素电极输入扫描信号,所述中间的像素单元对应的第二扫描线、第二开关元件以及第三开关元件与后面的像素单元对应的第一扫描线和第一开关元件相邻,以对次像素电极输入扫描信号;
所述第一开关元件的输出端电连接主像素电极,所述第二开关元件的输出端电连接次像素电极,所述第三开关元件的输出端用于电连接储存电容,所述第一开关元件和第二开关元件的输入端分别电连接数据线,所述第三开关的输入端电连接次像素电极,所述第一开关元件的控制端电连接第一扫描线,所述第二开关元件的控制端电连接第二扫描线,所述第三开关元件的控制端电连接后面的像素单元对应的第一扫描线;
其中,在进入3D显示模式时,所述中间的像素单元对应的第一扫描线和第二扫描线输入扫描信号以分别控制第一开关元件和第二开关元件导通,所述数据线分别通过第一开关元件和第二开关元件同时输入电压信号至所述中间的像素单元的主像素电极和次像素电极,随后停止输入扫描信号至所述第一扫描线和第二扫描线;停止输入扫描信号至所述第一扫描线和第二扫描线后,与所述第三开关元件的控制端电连接的后面的像素单元对应的第一扫描线输入扫描信号以控制第三开关元件导通,所述中间的像素单元的次像素电极的电压信号通过第三开关元件耦合至与第三开关元件的输出端电连接的储存电容,调整储存电容的大小以控制所述中间的像素单元的主像素电极和次像素电极之间存在预设电压差。
2.根据权利要求1所述的阵列基板,其特征在于,
所述第一开关元件、第二开关元件以及第三开关元件分别为第一薄膜晶体管、第二薄膜晶体管以及第三薄膜晶体管;
所述第一薄膜晶体管包括第一栅极、第一源极以及第一漏极,所述第一源极作为输入端与数据线电连接,所述第一漏极作为输出端与主像素电极电连接,所述第一栅极作为控制端与第一扫描线电连接以控制第一薄膜晶体管的导通与断开;
所述第二薄膜晶体管包括第二栅极、第二源极以及第二漏极,所述第二源极作为输入端与数据线电连接,所述第二漏极作为输出端与次像素电极电连接,所述第二栅极作为控制端与第二扫描线电连接以控制第二薄膜晶体管的导通与断开;
所述第三薄膜晶体管包括第三栅极、第三源极以及第三漏极,所述第三源极与次像素电极电连接,所述第三漏极作为输出端用于与储存电容电连接,所述第三栅极与相邻一像素单元对应的第一扫描线电连接以控制第三薄膜晶体管的导通与断开。
3.一种液晶显示装置,其特征在于,包括偏振薄膜以及液晶显示面板,所述液晶显示面板包括阵列基板和彩色滤光基板;
所述彩色滤光基板包括黑色矩阵,所述偏振薄膜设置于彩色滤光基板的外侧;
所述阵列基板包括至少多条第一扫描线、第二扫描线、数据线以及多个行列排列的像素单元,每个所述像素单元均包括开关元件和像素电极,每个所述像素单元对应至少一条第一扫描线、第二扫描线以及数据线;
每个所述像素单元的开关元件包括控制端、输入端和输出端,数量为至少三个,至少分别是第一开关元件、第二开关元件以及第三开关元件;
所述像素电极包括主像素电极和次像素电极,所述第一扫描线和第二扫描线分别与第一开关元件和第二开关元件连接以分别控制第一开关元件和第二开关元件的导通与断开,所述数据线分别经过主像素电极所在的区域和次像素电极所在的区域而连接主像素电极和次像素电极以输入电压信号;
所述阵列基板还包括多个暗区,所述暗区位于黑色矩阵的垂直投影覆盖区域内,并且所述暗区的至少一部分设置于像素单元之间,所述第一扫描线、第二扫描线以及开关元件布局于像素单元之间;
其中,对于任意三个沿数据线方向排列的相邻像素单元,位于中间的像素单元对应的第一扫描线和第一开关元件与前面的像素单元对应的第二扫描线、第二开关元件以及第三开关元件相邻,以对主像素电极输入扫描信号,所述中间的像素单元对应的第二扫描线、第二开关元件以及第三开关元件与后面的像素单元对应的第一扫描线和第一开关元件相邻,以对次像素电极输入扫描信号;
所述第一开关元件的输出端电连接主像素电极,所述第二开关元件的输出端电连接次像素电极,所述第三开关元件的输出端用于电连接储存电容,所述第一开关元件和第二开关元件的输入端分别电连接数据线,所述第三开关的输入端电连接次像素电极,所述第一开关元件的控制端电连接第一扫描线,所述第二开关元件的控制端电连接第二扫描线,所述第三开关元件的控制端电连接后面的像素单元对应的第一扫描线;
其中,在进入3D显示模式时,所述中间的像素单元对应的第一扫描线和第二扫描线输入扫描信号以分别控制第一开关元件和第二开关元件导通,所述数据线通过第一开关元件和第二开关元件同时输入电压信号至所述中间的像素单元的主像素电极和次像素电极,随后停止输入扫描信号至所述第一扫描线和第二扫描线;停止输入扫描信号至所述第一扫描线和第二扫描线后,与所述第三开关元件的控制端电连接的后面的像素单元对应的第一扫描线输入扫描信号以控制第三开关元件导通,所述中间的像素单元的次像素电极的电压信号通过第三开关元件耦合至与第三开关元件的输出端电连接的储存电容,调整储存电容的大小以控制所述中间的像素单元的主像素电极和次像素电极之间存在预设电压差。
4.根据权利要求3所述的液晶显示装置,其特征在于,
所述第一开关元件、第二开关元件以及第三开关元件分别为第一薄膜晶体管、第二薄膜晶体管以及第三薄膜晶体管;
所述第一薄膜晶体管包括第一栅极、第一源极以及第一漏极,所述第一源极作为输入端与数据线电连接,所述第一漏极作为输出端与主像素电极电连接,所述第一栅极作为控制端与第一扫描线电连接以控制第一薄膜晶体管的导通与断开;
所述第二薄膜晶体管包括第二栅极、第二源极以及第二漏极,所述第二源极作为输入端与数据线电连接,所述第二漏极作为输出端与次像素电极电连接,所述第二栅极作为控制端与第二扫描线电连接以控制第二薄膜晶体管的导通与断开;
所述第三薄膜晶体管包括第三栅极、第三源极以及第三漏极,所述第三源极与次像素电极电连接,所述第三漏极作为输出端用于与储存电容电连接,所述第三栅极与相邻一像素单元对应的第一扫描线电连接以控制第三薄膜晶体管的导通与断开。
5.根据权利要求3所述的液晶显示装置,其特征在于,
所述液晶显示面板是MVA(Multi-domain vertical alignment,多域分割垂直配向)型液晶显示面板。
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C10 | Entry into substantive examination | ||
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GR01 | Patent grant |