CN101669345A - 对串行流的稳健控制/描述 - Google Patents

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Abstract

将采取{k1－k2－k2－k1}形式的控制符插入到包括m位数据字的串行流中。k1和k2均被预定义位与m位数据字不同的m位控制字。k1和k2之间的汉明距离至少为2。在符号中、或紧接符号之前或之后的数据字中存在一比特错误的情况下，可以稳健地检测这类控制符。该m位字可以是8B/10B编码的数据或定义的控制字。控制符可以用于数据描述、流同步、发送器/接收器同步或用于其它控制信令。

Description

对串行流的稳健控制/描述
技术领域
本发明总地涉及串行流，更具体来说，涉及适于描述数据和同步流数据的增强的描述和控制符。
背景技术
现在，对信息的数字处理和表达广泛用于消费电子和个人计算产业。目前，在大量的应用中，以数字方式操纵和表达视频、音频和文本。
尤其，数字显示终端很快变得普遍---快速替代旧的模拟装置，例如阴极射线管显示器。数字视频传输可以发生在给定显示装置中的两个集成电路之间或者两个外部装置之间。在计算机和显示器之间、在机顶盒和电视显示器之间以及在投影仪和显示终端之间，会观察到装置之间的数字视频转换。
为了有助于在传输装置和接收器之间灵活传输数字视频数据，发展出了定义合适通信的各种标准。目前的趋势是使用串行链路，来携载一个或多个数据流。
例如，显示端口标准(DisplayPort standard)提供了纵贯数据链路的高宽带(目前是每数据流2.7Gbps)、多数据流向前传输信道，其误码率不超过为10-9/通道。每个串行流被称作一个通道。显示端口还提供了从接收器到传输装置的双向辅助信道和中断请求线，以有助于链路调训(link training)和控制数据的交换。
使用符号纵贯所有通道并行发送数字视频帧中的像素。接收器必须能够识别这些帧，并且处理一起传输的来自不同通道的符号。因为视频一帧帧地传输，所以需要携带同步信息的控制符和控制指令。控制符所携带的信息可以包括垂直和水平消隐间隔的起始和结束、用于重置扰频器或重建数据链路的指令和/或用于使发送器与接收器同步的符号。
不幸的是，在如此高的传输速率下，错误会恶化数据流和控制符，会造成接收器和发送器之间的同步丢失。
当前用于重新同步的机制需要接收器使用辅助信道来警告发送器同步丢失。然而，这必定伴随不能接受的延迟，从而导致用户体验差。
因此，仍然需要一种更稳健的交换控制符技术，该控制符号可用于重新同步、数据描述或其它控制。
发明内容
根据本发明的实例，将{k1-k2-k2-k1}或{k1-k1-k2-k2}形式的控制符插入到包括m位数据字的串行流中。k1和k2均被预定义为与该m位数据字不同的m位控制字。k1和k2之间的汉明距离(Hammingdistance)至少为2。在该符号中、紧接该符号之前或之后的数据字中存在一位错误的情况下，可以稳健地检测这类控制符。该控制符可以用于数据描述、流同步、发送器/接收器同步或其他控制信令(signaling)。
根据本发明的一个方面，提供了一种方法，该方法包括：将串行流从发送器发送到接收器，其中，所述串行流中的m位数据字表示n位数据字，其中，m＞n；以及将多个控制符包含到所述串行流中，其中，所述控制符中的每个采取{k1-k2-k2-k1}的形式，并且其中，k1和k2均被预先定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2之间的汉明距离至少为2。
根据本发明的另一方面，提供了一种将数据以串行流发送到接收器的发送器，所述数据布置为所述串行流中的m位数据字，所述发送器包括：编码器，所述编码器用于将待发送的n位数据字编码为所述m位数据字，其中，m＞n；控制器，与所述编码器通信，以将控制符插入到所述串行流中，所述控制符采用{k1-k2-k2-k1}的形式，其中，k1和k2均被预先定义为与所述m位数据字不同的m位控制字，并且其中，将k1和k2以至少为2的汉明距离分隔开。
根据本发明的又一方面，提供了一种将数据以多个串行流发送到接收器的发送器，在每个所述串行流中所述数据被布置为m位字，所述发送器包括：至少两个通道编码器，每个用于对所述串行流之一进行编码，每个通道编码器包括m/n编码器，用于将待发送的n位数据字编码为所述m位数据字，其中，m＞n；控制器，其与所述m/n编码器通信，以在每个所述串行流中插入控制符，所述控制符采取{k1-k2-k2-k1}的形式，其中，k1和k2均被预定义为与所述m位数据字不同的m位控制字，并且其中，将k1和k2以至少为2的汉明距离分隔开。
根据本发明的另一方面，提供了一种用于接收串行比特流的接收器，包括：串/并(S/P)转换器，所述串/并转换器用于将所述串行比特流转换成m位字，其中，所述m位字包括m位数据字和m位控制字；解码器，与所述S/P转换器互连，用于将所述m位数据字解码成n位数据字并且用于检测m位控制字，其中，m＞n；以及控制器，与所述解码器通信，用于检测{k1-k2-k2-k1}形式的控制符，其中，k1和k2均被预定义为m位控制字，以至少为2的汉明距离分隔开。
根据本发明的又一方面，提供了一种用于接收多个串行流中的数据的接收器，在每个所述串行流中所述数据布置为m位字，所述接收器包括：至少两个通道解码器，每个用于对所述串行流之一进行解码，每个通道解码器包括串/并转换器，用于将所述串行比特流之一转换成m位字，其中，所述m位字包括m位数据字和m位控制字，与所述S/P转换器互连的解码器，用于将所述m位数据字解码成n位数据字并且用于检测m位控制字，其中，m＞n；以及控制器，所述控制器与所述解码器之一通信，用于检测所述串行流中{k1-k2-k2-k1}形式的控制符，其中，k1和k2均被预定义为m位控制字，以至少为2的汉明距离分隔开。
根据本发明的又一方面，提供一种从发送器接收多个串行流的方法，包括：对所述串行流中的每个进行串/并转换，以形成m位控制字和m位数据字；将每个所述m位数据字解码为n位数据字；在每个所述串行流中检测{k1-k2-k2-k1}形式的控制符，其中，k1和k2均被预定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2之间的汉明距离为至少2。
根据本发明的另一方面，提供了一种方法，包括：将串行流从发送器发送到接收器，其中，所述串行流中的m位数据字表示n位数据字，其中，m＞n；将控制符包含在所述串行流中，其中，每个所述控制符采取{k1-k2-k2-k1}的形式，并且其中，k1和k2均被预定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2之间的汉明距离为至少2。
在结合附图阅读本发明具体实施例的描述的情况下，对于本领域的普通技术人员来说，本发明的其它方面和特征将变得清楚。
附图说明
在附图中，只是作为示例示出本发明的实施例。
图1是本发明示例性实施例的由携载至少一个串行流的信道互连的数字发送器和接收器的框图；
图2是可在图1中的发送器/接收器中使用的单通道发送器的简化示意图；
图3是在图1中的发送器/接收器中可用的互补单通道接收器的框图；
图4是示出图2和图3中的发送器/接收器之间传送的数据流中数据和控制符的组织的框图；
图5是示出由图3中的接收器检测控制符的状态图；
图6是图1中的发送器/接收器可用的多通道发送器的简化示意图；
图7是图1中的发送器/接收器可用的互补多通道接收器的框图；
图8是示出在图6和图7中的发送器/接收器之间传输的多通道中数据和控制符的组织的框图；以及
图9是示出图7中的接收器中对齐的数据流中数据和控制符的组织的框图。
具体实施方式
图1是包括通过串行链路互连的发送器102/102′和接收器104/104′的数字发送器/接收器对的示意性框图。单向主链路100将串行数据流从发送器102/102′提供到接收器104/104′。如将变得清楚的是，发送器102/102′和接收器104/104′可以适于视频和音频的交换。由此，发送器102/102′可以形成数字视频源的一部分，例如个人录像机、有线电视或地面电视接收器、DVD播放器、视频游戏机、计算装置等。接收器104/104′可以形成显示器的一部分，例如液晶显示器(LCD)、等离子体显示器、表面传导电子发射显示器(SED)或类似面板。
如所示出的，主向前发送通道100可以用于发送数据，并且发送器102/102′和接收器104/104′都可以使用双向辅助通道108来在它们之间传递状态和控制数据。
图2是图1中发送器102的示意性框图。所述发送器102发送单个串行流。如将清楚的是，图1中的发送器/接收器可以容易地形成为多通道发送器。
为此，发送器102包括单个串行信道编码器130。信道编码器130包括用于从多个源接收数据的多路复用器112、主信道数据缓存器110、次信道数据缓存器106和基础数据源(stuff data source)108。对主信道数据缓存器110输送要发送数据的主源，例如视频像素数据流的源。对次信道数据缓存器106类似地输送要发送的次数据源，例如音频数据的源，从而提供被适当编码的音频数据。
来自主数据源和次数据源的数据被设置成n位数据字。在所描述的实施例中，n＝8。
将多路复用器112的输出m位字流提供给加密模块116，其中数据被加密以使得在可能不安全的信道上的传输安全。加密模块116可以是公钥或私钥加密模块，其将未加密的m位字转换成对应的m位加密字，如普通技术人员所理解的一样。
扰频器118接收加密模块116的输出，以确切地对数据进行扰频，从而保证扰频器118输出的n位数据字具有特定统计学分布。例如，扰频器118可以降低数据流中由于重复模式(pattern)造成的电磁干扰。将扰频器118的输出输送到可选的先进先出缓存器(FIFO)116，其可在由FIFO 120输出的数据字输出流中引入期望的延迟。FIFO 120的输出被提供到m/n位编码器122。
m/n位编码器122为在其输入端提供的每个n位数据字生成m位数据字(m大于n)。例如，编码器122可以是ANSI 8B/10B编码器(即，n＝8，m＝10)。选择输出的10位数据字来确保以编码的m位数据字的序列的比特输出中“1”和“0”的近似平衡。为了保持DC平衡，每8位数据字可以被编码为两个可能的10位数据字，其中一个具有的“1”比“0”多，另一个具有的“0”比“1”多。
控制电路126控制串行流编码器130的操作，并且因此控制编码器130产生的串行流的总的格式。具体来讲，控制电路126控制在任何瞬时选择缓存器106、110或基础源108中的哪一个。特别地，控制电路126确保主信道数据和次信道被时分多路复用。在不存在主信道和次信道的数据的情况下，向多路复用器110提供该基础数据。控制电路126可以进一步控制在所产生数据流中插入控制符，如以下所述的加密模块116的循环、扰频器118的循环和缓存器120产生的时滞(skew)。
m/n编码器122另外输出所限定的m位控制字，作为由控制电路126提供到编码器122的控制信号的结果。具体来讲，在存在断言控制信号的情况下，编码器122输出所保留的m位字，其没有用于编码n位数据输入，并且可以因此容易与编码的数据字区分开。ANSI8B/10B(如ANSI INCITS 230-1994(R1999)：InformationTechnology-Fiber Channel-Physical and Signaling Interface(FC-PH)(先前是ANSI X3.230-1994(R1999))中详细描述的，其内容通过引用包含于此)限定了被称作K代码的许多控制字。
实例K代码如下在表1中列出。
表1
Figure A20088000622600151
如将理解的是，用两个单独的二进制代码表示以上每个K代码，其中一个可以用在数据流中存在过多的“0”的情况下，另一个用在数据流中存在过多的“1”的情况下。
具体来讲，在控制输入端由控制电路126提供到编码器122的控制信号可以迫使编码器122的输出产生限定的10位输出，而与编码器122输入端的数据无关。
并/串转换器124将m位字的数据流转换成串行二进制流。便利地，由于提供到串行转换器124的10位字的数据流通常是DC平衡的，所以，所得到的由并/串转换器124产生的串行位数据流也是DC平衡的。
在图4中描述了所产生的数据流的示例格式。如所示出的，数据流可以包括来自缓存器110的主数据402，并且可以可选地包括来自缓存器106的次数据408。主数据402和次数据408可以散置有源自基础数据源108的基础数据406。
在所描述的实施例中，主数据402(和任意伴随的基础数据)被组织成字的行。字的行可以对应于数字视频图像的行。通过消隐间隔来限定行的边界。在图4中，描述了行N中的数据。可以在消隐间隔中携载次信道数据。主数据402由控制符BS(消隐开始)和BE(消隐结束)来框定。次数据408由控制符SS(次开始)和SE(次结束)来框定。控制符BE和BS分别限定消隐间隔的开始和结束。如将清楚的，符号BE和/或BS可以方便地用于描述发送器102输出的串行流内的数据，并且用于使接收器104与发送器102同步。根据本发明的示例性实施例，在存在错误的情况下，描述符选择为使得能够稳健描述数据流400内的数据。
为了确保稳健检测和描述的能力，BS选择为四个m位控制字。例如，BS可以选择为表示为{k1-k2-k2-k1}的符号。k1和k2选择为汉明距离至少为2。如将理解的是，在存在一比特错误的情况下，汉明距离选择为至少为2以防止k1被混到k2中并且防止k2被混到k1中。便利地，对k1和k2的这种选择，使得在存在噪声而在BS之前的数据字中、BS符号自身中或者在BS之后的数据字中导致单比特错误的情况下，能够明确并及时地检测控制符BS。
对比之下，使用单个控制字作为控制符将不能允许在控制符中存在单比特错误的情况下检测控制符。
类似地，使用重复的控制符(例如{k1-k1})形成控制符将不允许稳健检测，这是因为单比特错误会使数据流中符号的位置混乱。例如，就在控制符之前的数据字D混到控制字k1中将会导致不确定性。即，在存在{...D，k1，k 1 ，k 1 ，D，D...}或{...D，D，k 1 ，k 1 ，k1，D...}的情况下，不可能进行控制符检测和数据描述/同步。
使用k1和k2的两个控制字符号(例如，{k1-k2})将类似地不会降低不确定性。例如，数据符混到控制符k1或k2中将会导致对控制符进行错误检测。类似地，由k1和k2形成的其它控制字也不能用。
便利地，使用利用具有至少两个汉明距离的控制符k1、k2形成为{k1-k2-k2-k1}的控制符，确保了控制符中的k1、k2、k2或k1中的任一个中的单比特错误仍然会被明确地检测到。
满足需求的控制符{k1-k2-k2-k1}的示例性列表包括ANSI8B/10B控制符{k28.5-k28.3-k28.3-k28.5}、{k28.0-k28.3-k28.3-k28.0}、{k28.5-k28.1-k28.1-k28.5}和{k28.0-k28.1-k28.1-k28.0}。
可选择地，控制电路126可以插入额外的控制符，其可描述数据流的其它部分或者以其它方式在互补接收器被处理。例如，所谈到的次数据408可以由控制符404SS(次开始)和SE(次结束)划界；填充数据406可以由控制符FS(填充开始)和FE(填充结束)划界。类似地，数据流可以包括符号CPSR，以重置加密序列或SR，从而重置接收器104的扰频序列。根据这些符号是否应该稳健，可以使用一个控制字或者多个控制字来形成SS、SE、FS、FE、CPSR和SR。
图3描述了与发送器102互补的图1中的接收器104的示意性框图。所描述的接收器104包括单数据流编码器230。单数据流编码器230接收由与发送器102并行的串行转换器124输出、从发送器100通过串行信道的单个串行流。由此，流编码器230包括串/并(S/P)转换器224，其将接收的串行比特流转换成m位字的流。控制电路226控制接收器104的整体运行。
n/m解码器222为由S/P转换器224在该n/m解码器输入提供的每个m位数据字生成n位数据字。n/m解码器222与发送器102的编码器122互补。由此，n/m编码器222可以(例如)是ANSI 8B/10B编码器。
n/m解码器222进一步在收到任何m位控制字时向控制电路226发信号。控制电路226可以使用m位控制字来检测控制符，以描述接收到的数据，或者以其它方式控制接收器104的操作。
向FIFO缓存器220提供n位解码数据字222，该缓存器向解扰器218输送数据，解扰器218将扰频数据解扰。解扰器218与扰频器118互补，并且解开由扰频器118执行的任意扰频。受控制电路226控制的FIFO 220可以用于在使用多通道时重新排列时滞的数据流，如以下将描述的。
解扰器218的输出提供到解密模块以对接收到的数据流进行解密，并且提供到与控制电路226通信的去复用器212。解密模块216与发送器102的加密模块116互补，并且产生解密序列，该解密序列可以用于解密之前由加密模块116加密的n位数据字。可以由控制电路216控制解密模块116，其可以将解密模块216产生的解密序列重置或重新同步。
去复用器212接收经解密的输出，并且可以将其输入数据去复用成主/主要数据流和次数据流。控制电路226可以控制去复用器212的操作。例如，由BE和/或BS符号描述的数据可以被去复用为像素数据，并且输出到主数据缓存器210。类似地，由SS和SE符号描述的数据可以被去复用成次数据流，并且输出到次数据缓存器206。同样，由符号FS和FE描述的数据可以被去复用为填充数据。
便利地，使用所描述的四个控制字编码被稳健编码的任何控制符可以被如图5中所示的控制电路216检测。具体来讲，控制电路216保持状态机500来检测控制符{k1-k2-k2-k1}或其任一位变化。因此，状态机500初始处于其等待状态502。在受到由n/m解码器222发送的控制字k1或k2到达信号的情况下，状态机500进入状态504或者状态518。此后，接下来到达的三个数据或控制字控制状态机500的状态转变。所以，如果在接收了k1之后，不同于k2的数据或控制字(总的用符号x表示)到达输入流，状态机500呈现状态510，并且等待随后的控制字k2(状态512)并在此后是k1，以检测{k1-x-k2-k1}并在状态516中将其解释为控制符{k1-k2-k2-k1}。类似地，如果在接收了k1之后，接收到字k2、x′(不同于k2的数据或控制字)、k1，则通过状态508在状态516中检测{k1-k2-x′-k1}并且将其解释为{k1-k2-k2-k1}。同样，通过状态522检测{k1-k2-k2-k1}。响应于检测到字序列{k1-x-x}或{k1-x-k2-x}而进入符号非检测状态(或错误状态)514。
类似地，在接收到符号k2，通过状态518和520，在状态516中检测字序列{x-k2-k2-k1}，并被解释为控制符{k1-k2-k2-k1}。
便利地，一呈现状态516，就是已经检测到描述或控制符号{k1-k2-k2-k1}，可以通过控制电路216产生定时信号。该定时信号可以用于对接收到的流中的数据进行划界，或使接收器104与发送器102同步。
对于要被接收器102识别的{k1-k2-k2-k1}形式的每个控制符，接收器102可以包括另外的有状态机500形式的状态机。再者，每个状态机可以在检测到其四个控制字控制符号时产生定时信号。
在发送器102和接收器104之间出现同步丢失的情况下，例如由于高误码率导致的，经由辅助信道108(图1)，接收器104可以交替地发送重新同步或重新传输被传输的数据流。
如将理解的，以10-9的误码率，会频繁出现单比特错误。例如，在1.62Gbps的数据率，单比特错误导致在接收器每0.62秒检测到错误。在2.70Gbps的数据率，单比特错误导致在接收器每0.37秒检测到错误。有利的是，在存在稳健描述/控制符号的情况下，这类单比特错误可以容忍，且不比造成同步丢失或其它错误。
可选择地，在接收到如同SR和CPSR的其它控制符时，控制电路216可以重置解扰器218或解密模块216产生的循环，这样使得这些模块与在发送器102的它们的发送器对应部分(即，扰频器118、加密模块116)精确同步。如将理解的，对于待检测的每个控制符，状态机500可以被复制。
在图7和图8中示出了另外的示例性发送器/接收器对102′/104′。如所示出的，示例发送器102′可以由多个单通道编码器130′-1、130′-2...130′-n(单独以及共同地称为通道编码器130′)形成，形成类似图2中的发送器102的单通道边码器130。受控制电路140控制的另外的去复用器136、138可以去复用来自多个单通道编码器130′之中的主和次数据源的主和次数据。以此方式，来自主源和次源的有效载荷数据可以纵贯多个串行流(或通道)多路复用。每个数据流可以由单独的线缆或电线携载。
在图8中示出了所得到的有效载荷数据。如所示出的，可以使用每个通道编码器130′的FIFO缓存器120时滞纵贯多个道上的有效载荷数据。在所描述的实施例中，每个通道编码器130′以与发送器102的通道编码器130完全相同的方式形成。然而，单个控制器140控制多个通道编码器以及多路复用器136和138的总体操作。控制器140确保多通道中的每个包括控制符，如参照图4中的数据流所描述的。控制器140还通过控制每个FIFO 130的有效字长来控制通道内时滞。
再者，可以使用四个控制字{k1-k2-k2-k1}形成该多个通道每个中的控制符(例如符号BS)，如上所述。通道内时滞会增大链路对外部噪声的免疫力。
在图7中示意性描述了互补型多通道接收器。如所示出的，多通道接收器包括多个串行通道解码器230′-1、230′-2...230′-n(单独以及共同地称为通道解码器230′)，每个与图3中的接收器104的串行通道解码器230完全相同。
向控制电路240提供来自每个通道解码器230的每个n/m位解码器222的控制信号。控制电路240可以为每个通道，以及可选地为待检测的每个别的控制符(包括四字控制符)包括如同状态机500(图5)的状态机。控制电路240可以利用对每个通道中控制符BS＝{k1-k2-k2-k1}的检测，来控制由每个通道的FIFO缓存器220引入的延迟。具体来讲，FIFO缓存器220，每个FIFO缓存器的尺寸可以调节以确保每个通道内的BS符号对齐，如图9中所示。多个数据流中的数据因此被对齐。便利地，一旦对齐，BS符号的检测还可以用于控制每个通道解码器230的去复用器212，从而可以去复用出主数据和次数据，并且将主数据和次数据可以引入到每个通道解码器230的缓存器210和206。来自多通道解码器230的主数据和次数据可以进一步被多路复用器236和238多路复用，以产生主数据流和次数据流，所有这些操作都在控制电路240的控制下。
如现在可以理解的，{k1-k2-k2-k1}形式的控制符不是适于在接收器/发送器对102/104或102′/104′中使用的唯一符号。而是，也可以使用{k1-k1-k2-k2}形式的控制符。可以适当地修改状态机500。
当然，上述实施例的意图只是说明性的，而不以任何方式限制。对所述实现本发明的实施例的许多形式、部件布置、操作细节和次序的修改是可以接受的。更确切地来说，本发明意图包括如权利要求书限定的本发明范围内的所有这样的修改。

Claims (26)

1.一种方法，包括：
将串行流从发送器发送到接收器，其中，所述串行流中的m位数据字表示n位数据字，其中，m＞n，
将控制符包含在所述串行流中，其中，所述控制符中的每个采取{k1-k2-k2-k1}的形式，并且其中，k1和k2均被预先定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2之间的汉明距离至少为2。
2.根据权利要求1所述的方法，其中，所述控制符是在所述串行流中相对所述m位数据字的限定位置处的描述符。
3.根据权利要求1所述的方法，其中，所述控制符用于使所述接收器与所述发送器同步。
4.根据权利要求1所述的方法，其中，m＝10并且n＝8。
5.根据权利要求3所述的方法，其中，所述编码包括8B/10B编码。
6.根据权利要求1所述的方法，其中，所述编码在所述串行流中保持大致的DC平衡。
7.根据权利要求1所述的方法，其中，选择k1或k2中的每个作为m位控制字或这两个的互补。
8.根据权利要求1所述的方法，其中，从由K28.0、K28.1、K28.3和K28.5组成的8B/10B控制字的组中选择k1和k2。
9.根据权利要求1所述的方法，其中，k2＝k28.5并且k1＝k28.3，ANSI 8B/10控制字。
10.根据权利要求2所述的方法，其中，所述描述符描述所述串行流中所述n位数据字的行的开始。
11.根据权利要求2所述的方法，还包括从所述发送器发送到所述接收器的第二串行流，所述第二串行流包括在所述第二串行流中相对数据字的限定位置处的描述符，其中所述描述符中的每个采取{k1-k2-k2-k1}的形式。
12.根据权利要求11所述的方法，其中，所述串行流和所述第二串行流中的所述描述符将所述串行流与所述第二串行流同步。
13.一种将数据以串行流发送到接收器的发送器，所述数据布置为所述串行流中的m位数据字，所述发送器包括：
编码器，用于将待发送的n位数据字编码为所述m位数据字，其中，m＞n；
控制器，与所述编码器通信以将控制符插入到所述串行流中，所述控制符采用{k1-k2-k2-k1}的形式，其中，k1和k2均被预先定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2分隔至少为2个汉明距离。
14.根据权利要求13所述的发送器，其中，所述控制器将所述控制符插入到所述串行流中相对于所述m位数据字的限定位置。
15.根据权利要求14所述的发送器，其中，m＝10并且n＝8。
16.根据权利要求13所述的发送器，其中，所述编码器在所述串行流中保持大致DC平衡。
17.根据权利要求16所述的发送器，其中，所述编码器包括8B/10B编码器。
18.一种将数据以多个串行流发送到接收器的发送器，所述数据被布置为所述串行流每个中的m位字，所述发送器包括：
至少两个通道编码器，每个用于对所述串行流中的一个进行编码，每个通道编码器包括
m/n编码器，用于将待传送的n位数据字编码为所述m位数据字，其中，m＞n；
控制器，与所述m/n编码器通信，以在所述串行流的每个中插入控制符，所述控制符采取{k1-k2-k2-k1}的形式，其中，k1和k2均被预定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2分隔至少为2个汉明距离。
19.一种用于接收串行比特流的接收器，包括：
串/并转换器，用于将所述串行比特流转换成m位字，其中所述m位字包括m位数据字和m位控制字；
解码器，与所述串/并转换器互连，用于将所述m位数据字解码成n位数据字并且用于检测m位控制字，其中，m＞n；以及
控制器，与所述解码器通信，用于检测{k1-k2-k2-k1}形式的控制符，其中，k1和k2均被预定义为m位控制字，分隔开至少为2个汉明距离。
20.根据权利要求19所述的接收器，其中，所述控制器在检测所述控制符之一时将所述接收器与互补的发送器同步。
21.一种用于接收多个串行流中的数据的接收器，所述数据布置为所述串行流中的每个中的m位字，所述接收器包括：
至少两个通道解码器，每个用于对所述串行流之一进行解码，每个通道解码器包括：
串/并转换器，用于将所述串行比特流之一转换成m位字，其中，所述m位字包括m位数据字和m位控制字；
解码器，与所述串/并转换器互连，用于将所述m位数据字解码成n位数据字并且用于检测m位控制字，其中，m＞n；以及
控制器，与所述解码器的至少一个通信，用于检测所述串行流中{k1-k2-k2-k1}形式的控制符，其中，k1和k2均被预定义为m位控制字，分隔开至少为2个汉明距离。
22.根据权利要求21所述的接收器，其中，所述通道解码器中的每个包括先进先出(FIFO)缓存器，用于将可控延迟引入到每个所述串行流中。
23.根据权利要求22所述的接收器，其中，基于所述多个串行流中的所述控制符，所述控制器控制所述先进先出缓存器以对所述多个串行流中的数据去时滞。
24.一种从发送器接收多个串行流的方法，包括：
对所述串行流中的每个进行串/并转换，以形成m位控制字和m位数据字；
将所述m位数据字中的每个解码为n位数据字；
在每个所述串行流中检测{k1-k2-k2-k1}形式的控制符，其中，k1和k2均被预定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2之间的汉明距离为至少2。
25.根据权利要求24所述的方法，还包括：
使用所述控制符描述和对齐所述多个串行流中的数据。
26.一种方法，包括：
将串行流从发送器发送到接收器，其中，所述串行流中的m位数据字表示n位数据字，其中，m＞n；
将控制符包含在所述串行流中，其中所述控制符中的每个采取{k1-k2-k2-k1}的形式，其中，k1和k2均被预定义为与所述m位数据字不同的m位控制字，并且其中，k1和k2之间的汉明距离为至少2。
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