CH679719A5 - - Google Patents

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CH679719A5
CH679719A5 CH363889A CH363889A CH679719A5 CH 679719 A5 CH679719 A5 CH 679719A5 CH 363889 A CH363889 A CH 363889A CH 363889 A CH363889 A CH 363889A CH 679719 A5 CH679719 A5 CH 679719A5
Authority
CH
Switzerland
Prior art keywords
counter
synchronization
logic
memory
bit
Prior art date
Application number
CH363889A
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German (de)
English (en)
Inventor
Hans-Peter Waible
Original Assignee
Alcatel Nv
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Publication date
Application filed by Alcatel Nv filed Critical Alcatel Nv
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04J—MULTIPLEX COMMUNICATION
    • H04J3/00—Time-division multiplex systems
    • H04J3/02—Details
    • H04J3/06—Synchronising arrangements
    • H04J3/0602—Systems characterised by the synchronising information used
    • H04J3/0605—Special codes used as synchronising signal
    • H04J3/0608—Detectors therefor, e.g. correlators, state machines
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L5/00—Arrangements affording multiple use of the transmission path
    • H04L5/22—Arrangements affording multiple use of the transmission path using time-division multiplexing

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  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Time-Division Multiplex Systems (AREA)
CH363889A 1988-09-30 1989-09-28 CH679719A5 (ja)

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DE19883833184 DE3833184A1 (de) 1988-09-30 1988-09-30 Verfahren und schaltungsanordnung zur herstellung einer rahmensynchronisation in einem zeitmultiplexsystem

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Publication Number Publication Date
CH679719A5 true CH679719A5 (ja) 1992-03-31

Family

ID=6364042

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CH363889A CH679719A5 (ja) 1988-09-30 1989-09-28

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DE (1) DE3833184A1 (ja)

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DE3833184A1 (de) 1990-04-05
DE3833184C2 (ja) 1993-09-09

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